DE2846882C2 - - Google Patents

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DE2846882C2
DE2846882C2 DE19782846882 DE2846882A DE2846882C2 DE 2846882 C2 DE2846882 C2 DE 2846882C2 DE 19782846882 DE19782846882 DE 19782846882 DE 2846882 A DE2846882 A DE 2846882A DE 2846882 C2 DE2846882 C2 DE 2846882C2
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    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04QSELECTING
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    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04MTELEPHONIC COMMUNICATION
    • H04M3/00Automatic or semi-automatic exchanges
    • H04M3/22Arrangements for supervision, monitoring or testing
    • H04M3/2272Subscriber line supervision circuits, e.g. call detection circuits

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  • Signal Processing (AREA)
  • Computer Networks & Wireless Communication (AREA)
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Description

g = c + e ,g = c + e,

2. /1 = d + f, 2. / 1 = d + f,

3. i =(c + e)(dJ 3. i = (c + e) (dJ

QiQi).QiQi).

5050

5555

wobei Q\ bzw. Q2 ein Ausgangssignal eines ersten bzw. eines zweiten D-Flip-FIops (18 bzw. 19) des logischen Kreises (17) darstellen, dessen Eingang (D, T) das Ausgangssignal (d bzw. f) des zweiten bzw. to des vierten Kippkreises (14 bzw. 16) zugeführt ist.where Q \ or Q 2 represent an output signal of a first or a second D-flip-flop (18 or 19) of the logic circuit (17), the input (D, T) of which is the output signal (d or f) of the second or to of the fourth tilting circle (14 or 16) is supplied.

6. Detektorschaltung nach Anspruch 5, dadurch gekennzeichnet, daß die Ausgänge (Q\, Q2) der D-Flip-Flops (18,19) über ein erstes EX-ODER-Tor (24) an einen Eingang eines UND-Tores (23) mit einem das Ausgangssignal (i) führenden Ausgang geschaltet sind, deren D-Eingänge mit den Ausgängen des zweiten bzw. des vierten Kippkreises (14 bzw. 16) verbunden sind, die weiterhin über je ein Verzögerungsglied (20 bzw. 21) sowohl mit Takteingängen (T) der D-Flip-Flops (18,19) als auch mit den Eingängen eines zweiten EX-ODEK-Tores (22) verbunden sind, dessen Ausgang mit einem weiteren Eingang des UND-Tores (23) in Verbindung steht, daß weiter der Ausgang des ersten Kippkreises (13) einerseits mit dem das logische Signal (g) führenden Ausgang des logischen Kreises (17) und mit einem noch weiteren Eingang des UND-Tores (23) und über den Ausgang des dritten Kippkreises (15) sowohl direkt als auch über einen Inverter (30) mit einem Differenzierglied (31) verbunden ist, dessen Ausgänge mit den Eingängen Reset 1 und Reset 2 der D-Flip-FIops (18 bzw. 19) und über je ein Differenzierglied (27 bzw. 29) und je einen Inverter (26 bzw. 28) mit den Ausgängen des zweiten bzw. des vierten Kippkreises (14 bzw. 16) verbunden sind, die an die Eingänge eines NOR-Tores (25) geschaltet sind, dessen über einen Inverter (32) mit dem Differenzierglied (31) in Verbindung stehender Ausgang das logische Signal (h) führt.6. Detector circuit according to claim 5, characterized in that the outputs (Q \, Q2) of the D flip-flops (18, 19) via a first EX-OR gate (24) to an input of an AND gate (23 ) are connected to an output leading to the output signal (i) , the D inputs of which are connected to the outputs of the second and fourth trigger circuits (14 and 16), which continue to each have a delay element (20 or 21) with both Clock inputs (T) of the D flip-flops (18, 19) and the inputs of a second EX-ODEK gate (22) are connected, the output of which is connected to another input of the AND gate (23), that further the output of the first trigger circuit (13) on the one hand with the output of the logic circuit (17) carrying the logic signal (g) and with another input of the AND gate (23) and via the output of the third trigger circuit (15) is connected both directly and via an inverter (30) to a differentiating element (31), the outputs of which are connected to the inputs Reset 1 and Reset 2 of the D flip-flops (18 or 19) and each via a differentiating element (27 or 29) and an inverter (26 or 28) with the outputs of the second and fourth flip-flop circuits (14 or 16), which are connected to the inputs of a NOR gate (25), whose output, which is connected to the differentiating element (31) via an inverter (32), carries the logic signal (h).

7. Detektorschaltung nach einem der vorhergehenden Ansprüche, dadurch gekennzeichnet, daß der logische Schaltkreis (17) durch einen Mikroprozesser mit programmierbarer Logik gebildet ist.7. Detector circuit according to one of the preceding claims, characterized in that the logic circuit (17) is formed by a microprocessor with programmable logic.

Die bekannten, z. B. im Artikel »Enregistrement automatique dans les autocommutateurs prives« in der Zeitschrift »Commutation & Electronic«, Nr. 57 vom April 1977 angeführten Detektorkreise für die Ermittlung von Teilnehmerleitungszuständen in Fernsprechnetzen beruhen auf der Messung des in der Teilnehmerschleife fließenden Stromes und können zwischen einer kurzen Unterbrechung der Speisespannung, die in manchen Fernsprechnetzen beim Abheben des Hörers entstent, und zwischen einer durch das Öffnen und Schließen des Wählerscheibenkontaktes hervorgerufenen Unterbrechung nicht unterscheiden. Somit kommt es vor, daß eine solche Unterbrechung der Gleichstromspeisung als ein von der Wählerscheibe bewirktes Signal interpretiert wird, woraus eine unrichtige Registrierung der Teilnehmernummer resultiert. Die zumeist serielle Einschaltung der bekannten Detektorkreise, die eine nicht vernachlässigbare Dämpfung der Teilnehmerschleife verursacht, erfordert, daß die Telefonzuleitung während der Montage unterbrochen wird, was z. B. in Großbritannien nicht zulässig ist. Außerdem ist jeder der bekannten Detektorkreise nicht in allen bekannten Telefonnetzen einsetzbar.The known, z. B. in the article "Enregistrement automatique dans les autocommutateurs prives" in the Journal "Commutation & Electronic", No. 57 from April 1977 cited detector circles for the investigation of subscriber line conditions in telephone networks are based on the measurement of the in the subscriber loop flowing current and can be between a brief interruption of the supply voltage, which in some telephone networks stent when lifting the handset, and between one by opening and Do not distinguish the interruption caused by closing the dial contact. So comes it is before that such an interruption of the direct current supply as a signal caused by the dial is interpreted, resulting in an incorrect registration of the subscriber number. Mostly serial Activation of the known detector circuits, which have a non-negligible attenuation of the subscriber loop causes, requires that the telephone line is interrupted during assembly, which z. Am Great Britain is not allowed. In addition, each of the known detector circuits is not in all of the known ones Telephone networks can be used.

Aus den DE-OS 22 15 879 und DE-OS 25 42 615 sind Schaltungsanordnungen bekannt, die parallel an die Teilnehmerschleife geschaltet sind und bei weichen mit Hilfe einer zyklischen Abfragung durch Impulse eines Impulsgenerators der Übergang vom Ruhezustand der Teilnehmerschleife in den Anrufzustand beim Abheben des Telefonhörers festgestellt und ausgewertet wird. Die Ermittlung der Rufsignale sowie der Polaritätsänderung der Teilnehmerschleife ist dabei nicht gewährleistet. From DE-OS 22 15 879 and DE-OS 25 42 615 circuit arrangements are known which are parallel to the Subscriber loops are switched and with soft with the help of a cyclical query by pulses of a Pulse generator the transition from the idle state of the subscriber loop to the call state when picking up of the telephone receiver is determined and evaluated. The determination of the ringing signals as well as the polarity change the participant loop is not guaranteed.

Der vorliegenden Erfindung liegt die Aufgabe zugrunde, eine in allen bekannten Telefonnetzen einsetzbare Detektorschaltung für die Ermittlung der Betriebszustände von Teilnehmerleitungen aufgrundThe present invention is based on the object of providing one in all known telephone networks Usable detector circuit for the determination of the operating states of subscriber lines due to

der Erfassung des Schleifenstromes, der Rufsignale sowie der Umkehr der Polarität der Teilnehmerschleife zu schaffen.the detection of the loop current, the ringing signals and the reversal of the polarity of the subscriber loop to accomplish.

Die Lösung dieser Aufgabe geht aus der Fassung des Patentanspruchs 1 hervor.The solution to this problem emerges from the version of claim 1.

Nachfolgend wird ein Ausführungsbeispiel der erfindungsgemäßen Detektorschaltung anhand der Zeichnung näher erläutert. Es zeigtAn exemplary embodiment of the detector circuit according to the invention is described below with reference to FIG Drawing explained in more detail. It shows

F i g. 1 ein Blockschaltbild der Detektorschaltung undF i g. 1 shows a block diagram of the detector circuit and

F i g. 2 und 3 Signal-Diagramme beim rufenden und angerufenen Teilnehmer.F i g. 2 and 3 signal diagrams for the calling and called subscriber.

Die Detektorschaltung gemäß der F i g. 1 weist zwei parallel zu einer aus Adern a, b bestehenden und zum Teilnehmerfernsprecher TG führenden Telefonzuleitung geschaltete DC/DC-Wandler 1, 2 auf, von denen immer nur der eine oder der andere je nach der Polarität der Teilnehmerschlaufe arbeitet Jeder der DC/DC-Wandler 1, 2 besteht aus einem Oszillator 3 bzw. 4, aus einem elektromagnetischen Kopplungsglied 5 bzw. 6 und aus einem Gleichrichter 7 bzw. 8. Lie Kopplungsglieder 5, 6 dienen der galvanischen Trennung der Telefonzuleitung von anderen Kreisen der Detektorschaltung und bewirken, daß die Detektorschaltung eine hohe Impedanz in der Größenordnung von 1 bis 2 ΜΩ aufweist, so daß die Teilnehmerschleife nur geringfügig gedämpft wird. Die von den Oszillatoren 3,4 gelieferten und durch die Gleichrichter 7, 8 gleichgerichteten Signale sind der Spannung zwischen den Adern a und b proportional und werden über nachgeschaltete Verzögerungsglieder 9, 10 bzw. 11,12 aus Schmitt-Triggern bestehenden Kippkreisen 13, 14 bzw. 15, 16 zugeführt Die Kippkreise 13 und 15 kippen bei einem zwischen der Schleifenspannung bei aufgelegtem Hörer (z. B. 48 V) und bei abgenommenem Hörer (z.B. 10V) liegenden Kipp-Pegel. Ihre Ausgangssignale c bzw. e werden zur Ermittlung des Schleifenstromes und zur Zählung der durch die Wählerscheibe erzeugten Impulse ausgenutzt Die Kippkreise 14 und 16 mit Ausgangssignalen t/und / kippen bei einem Spannungsniveau in der Nähe von Null Volt und werden zur Ermittlung des Rufstromes, d. h. der aus der Vermittlung ausgesandten Signale für die Betätigung des Weckers, und zur Ermittlung der Polaritätsänderung des in der Teilnehmerschleife fließenden Stromes verwendet.The detector circuit according to FIG. 1 has two DC / DC converters 1, 2 connected in parallel to a telephone line consisting of wires a, b and leading to the subscriber telephone TG , of which only one or the other works depending on the polarity of the subscriber loop. Each of the DC / DC -Transducers 1, 2 consists of an oscillator 3 or 4, an electromagnetic coupling element 5 or 6 and a rectifier 7 or 8. Lie coupling elements 5, 6 are used to galvanically separate the telephone line from other circuits of the detector circuit and that the detector circuit has a high impedance on the order of 1 to 2 ΜΩ, so that the subscriber loop is only slightly damped. The signals supplied by the oscillators 3, 4 and rectified by the rectifiers 7, 8 are proportional to the voltage between the wires a and b and are triggered via delay elements 9, 10 and 11, 12 consisting of Schmitt triggers 15, 16 supplied The trigger circuits 13 and 15 tilt at a tilt level lying between the loop voltage when the receiver is on-hook (eg 48 V) and when the receiver is removed (eg 10 V). Your output signals c and e are used to determine the loop current and to count the pulses generated by the selector disk the signals sent from the exchange are used to activate the alarm clock and to determine the change in polarity of the current flowing in the subscriber loop.

Die Ausgangssignale c, d, eund /der Kippkreise 13, 14, 15, 16 werden einem logischen Kreis 17 — im beschriebenen Ausführungsbeispiel mit festverdrahteter Logik — zugeführt, welcher Ausgangssignale g, h und / für die Auswertung in nicht näher dargestellten Geräten liefert Das Ausgangssignal g zeigt die Anwesenheit des Schleifenstromes, das Signal h die Anwesenheit des Rufstromes und das Signal / die Änderung der Polarität des Stromes in der Teilnehmer schleife an.The output signals c, d, e and / of the trigger circuits 13, 14, 15, 16 are fed to a logic circuit 17 - in the exemplary embodiment described with hard-wired logic - which supplies output signals g, h and / for the evaluation in devices not shown in detail g shows the presence of the loop current, the signal h the presence of the ringing current and the signal / the change in polarity of the current in the subscriber loop.

Die Signale dbzw. /"der Kippkreise 14 bzw. 16 werden direkt den D-Eingängen und über je ein Verzögerungsglied 20 bzw. 21 sowohl den Takteingängen Γνοη zwei £>-Flip-Flops 18 bzw. 19 des logischen Kreises 17 als auch einem EX-ODER-Tor 22 zugeführt, dessen Ausgang mit einem UND-Tor 23 in Verbindung steht. Die Ausgänge Q\ und Q2 dp- D-Flip-Flops 18 bzw. 19 sind über ein EX-ODEP "·,. _; mit dem UND-Tor 23 verbunden, an dessen Ausgang das Signal i für die Ermittlung der Polaritätsänderung der Teilnehmerschleife abgenommen wird. Die Signale if und /werden außerdem einem NOR-Tor 25 direkt und über je einen Inverter 26 bzw. 28 und über je ein Differenzierglied 27 bzw. 29 den Eingängen Reset 1 bzw. Reset 2 derThe signals dbzw. / "of the flip-flops 14 and 16 are connected directly to the D inputs and via a delay element 20 and 21, both the clock inputs Γνοη two £> flip-flops 18 and 19 of the logic circuit 17 and an EX-OR gate 22, the output of which is connected to an AND gate 23. The outputs Q 1 and Q 2 dp-D flip-flops 18 and 19 are connected via an EX-ODEP "·,. _; connected to the AND gate 23, at the output of which the signal i for determining the change in polarity of the subscriber loop is picked up. The signals if and / are also sent to a NOR gate 25 directly and via an inverter 26 or 28 and via a differentiating element 27 or 29 to the inputs Reset 1 or Reset 2

D-Flip-FIops 18 bzw. 19 zugelührt Die miteinander verbundenen Ausgänge der Kippkreise 131 und 15 mit den Ausgangssignalen cbzw. e sind einerseits direkt und andererseits über einen Inverter 30 an ein Differenzierglied 31 angeschlossen, dessen Ausgänge mit den Eingängen Reset 1 und Reset 2 der D-Flip-Flops 18,19 in Verbindung stehen. Das Differenzierglied 31 ist über einen Inverter 32 mit dem Ausgang des NOR-Tores 25 verbunden, an dessen Ausgang das Signal h für die Ermittlung des Rufstromes abgenommen wird. Der Ausgang des Kippkreises 13 ist außerdem mit dem Eingang des UND-Tores 23 verbunden.D-Flip-FIops 18 and 19 supplied. The interconnected outputs of the trigger circuits 131 and 15 with the output signals cbzw. e are connected on the one hand directly and on the other hand via an inverter 30 to a differentiating element 31, the outputs of which are connected to the inputs Reset 1 and Reset 2 of the D flip-flops 18, 19. The differentiating element 31 is connected via an inverter 32 to the output of the NOR gate 25, at the output of which the signal h for determining the ringing current is tapped. The output of the trigger circuit 13 is also connected to the input of the AND gate 23.

Zwischen den Eingängen und Ausgängen des logischen Kreises 17 gelten folgende logische Beziehungen: The following logical relationships apply between the inputs and outputs of the logical circuit 17:

1. g = c + e ,1. g = c + e ,

3. i = (c + e) (df + /2) (Q1 Q2 + Q2 Q1). 3. i = (c + e) (df + / 2) (Q 1 Q 2 + Q 2 Q 1 ).

Die Funktionsweise der beschriebenen Detektorschaltung wird anhand der Signaldiagramme in den F i g. 2 und 3 erläutert Dabei wird vorausgesetzt, daß die Ader a positiv und die Ader b negativ istThe mode of operation of the described detector circuit is illustrated using the signal diagrams in FIGS. 2 and 3 explained It is assumed that wire a is positive and wire b is negative

I. Verhältnisse beim rufenden Teilnehmer, Fig.2I. Conditions at the calling subscriber, Fig. 2

Vor dem Abheben des Hörers liegt zwischen den Adern a und b eine Spannung von z. B. 48 V, die beim Abheben des Hörers auf ca. 10 V sinkt (Punkt A) und derart die Ansprechschwelle des Kippkreises 13 überschreitet. Der Kippkreis 13 wird gesetzt, das SignalLies between the wires a before lifting the handset and b, a voltage of z. B. 48 V, which drops to about 10 V when you lift the handset (point A) and so the response threshold of the breakover circuit 13 exceeds. The trigger circuit 13 is set, the signal

ng= (c+ e) für die Feststellung des Schleifenstromes nimmt den logischen Zustand 1 an, weil das Signal c ebenfalls den logischen Zustand 1 hat Die an den Eingängen Reset 1 und Reset 2 der D-Flip-Flops 18 und 19 entstandenen Impulse sorgen dafür, daß die Siguale an den Ausgängen Oi und Q2 den logischen Wert Null haben, so daß die Signale h und / ebenfalls einen logischen Zustand Null aufweisen. ng = (c + e) for the determination of the loop current assumes the logic state 1, because the signal c also has the logic state 1. The pulses generated at the inputs Reset 1 and Reset 2 of the D flip-flops 18 and 19 ensure this that the signals at the outputs Oi and Q 2 have the logic value zero, so that the signals h and / also have a logic state zero.

In bestimmten Telefonnetzen entsteht beim Abheben des Hörers fast immer eine kurzzeitige Unterbrechung der Speisespannung (Stelle B). Der Schleifenstrom wird Null, so daß der Kippkreis 14 mit einer durch die Zeitkonstante des Verzögerungsgliedes 10 gegebenen Verzögerung gesetzt wird. Die Potentiale am Ausgang Qi des D-Flip-Flops 18 und am Ausgang des EX-ODER-Tores 24 wechseln von Null auf 1 (Q\ — 1,Q2 = O) und das Potential des EX-ODER-Tores 22 von 1 auf Null (d= 1, /=1). Nach der Erneuerung des Speisesitromflusses (Punkt C) kehrt das Signal dauf Null zurück. Durch den am Eingang Reset I entstandenen Impuls wechseln die Potentiale am Ausgang Q\ des D-Flip-Flops 18, am Ausgang des EX-ODER-Tores 22 und am Ausgang des EX-ODER-Tores 24 von 1 auf 0. Während der kurzen Unterbrechung bleibt das Signal g—x, weil der Kippkreis 13 mit Rücksicht auf die Verzögerung des Verzögerungsgliedes 9 auf diese Unterbrechung nicht reagiert. Dadurch wird vermieden, daß diese Unterbrechung als Wählerscheibensignal interpretiert wird. Die Signale Λ und /bleiben Null.
Beim Betätigen der Wählerscheibe bei abgehobenem Hörer pulsiert die Schleifenspannung zwischen 48 V und ca. 1 V im Rhythmus der Wählerscheibenimpulse (Stelle DJ. Das Kippniveau des Kippkreises 13 wird bei jedem Übergang von 48 V auf 1 V und umgekehrt
In certain telephone networks, when you lift the handset, there is almost always a brief interruption in the supply voltage (position B). The loop current becomes zero, so that the trigger circuit 14 is set with a delay given by the time constant of the delay element 10. The potentials at the output Qi of the D flip-flop 18 and at the output of the EX-OR gate 24 change from zero to 1 (Q \ - 1, Q 2 = O) and the potential of the EX-OR gate 22 changes from 1 to zero (d = 1, / = 1). After the renewal of the supply current flow (point C), the signal d returns to zero. Due to the pulse generated at the input Reset I, the potentials at the output Q \ of the D flip-flop 18, at the output of the EX-OR gate 22 and at the output of the EX-OR gate 24 change from 1 to 0. During the short The signal g- x remains interrupted because the trigger circuit 13 does not react to this interruption with regard to the delay of the delay element 9. This prevents this interruption from being interpreted as a dial signal. The signals Λ and / remain zero.
When you press the dial when the receiver is lifted, the loop voltage pulsates between 48 V and approx. 1 V in the rhythm of the dial pulses (position DJ. The tilt level of the tilt circle 13 changes from 48 V to 1 V and vice versa with every transition

überschritten. Das Signal g weist demzufolge den Wählimpulsen entsprechende Impulse auf, die den Schleifenstrom anzeigen. Die dabei an den Eingängen Reset 1 und Reset 2 der D-Flip-Flops 18 und 19 enstandenen Impulse sorgen dafür, daß die Signale h und /Null bleiben.exceeded. The signal g accordingly has pulses corresponding to the dialing pulses, which indicate the loop current. The pulses generated at the inputs Reset 1 and Reset 2 of the D flip-flops 18 and 19 ensure that the signals h and / remain zero.

In bestimmten Telefonnetzen, ζ. B. in Italien, findet beim Abheben des Hörers durch den angerufenen Teilnehmer eine den Anfang der Gebührenzählung markierende Polaritätsänderung statt. Die Spannung zwischen den Adern a und b geht vom Wert —10 V auf den Wert -10 V über (Punkt E), so daß die Kippkreise 14 und 16 angesteuert werden. Mit einer durch die Zeitkonstante des Verzögerungsgliedes 10 gegebenen Verzögerung wird zuerst der Kippkreis 14 gesetzt. Das Signa! dgeht von Nu!! auf I1 die Signale am Ausgang Q-, des D-Flip-Flops 18 von Null auf 1, des EX-ODER-Tores 22 von 1 auf Null (d=\, f=\) und des EX-ODER-Tores 24 von Null auf \ (Q\ = 1, O2 = O). Beim Kippen des durch die Zeitkonstante des Verzögerungsgliedes 12 verzögerten Kippkreises 16 kehrt der Ausgang des EX-ODER-Tores 22 auf 1 (d=l, /=0) zurück. Das Signal /nimmt den logischen Wert 1 an, weil alle drei Eingänge des UND-Tores 23 einen logischen Zustand 1 aufweisen. Dadurch wird die Polaritätsänderung angezeigt und für die Einleitung der Gebührenzählung ausgenütztIn certain telephone networks, ζ. B. in Italy, when the called subscriber lifts the handset, a polarity change that marks the beginning of the billing takes place. The voltage between wires a and b changes from a value of -10 V to a value of -10 V (point E), so that the trigger circuits 14 and 16 are activated. With a delay given by the time constant of the delay element 10, the trigger circuit 14 is set first. The Signa! d goes from now! on I 1 the signals at the output Q-, the D flip-flop 18 from zero to 1, the EX-OR gate 22 from 1 to zero (d = \, f = \) and the EX-OR gate 24 from zero to \ (Q \ = 1, O 2 = O). When tilting the trigger circuit 16 delayed by the time constant of the delay element 12, the output of the EX-OR gate 22 returns to 1 (d = 1, / = 0). The signal / assumes the logic value 1 because all three inputs of the AND gate 23 have a logic state 1. This indicates the change in polarity and uses it to initiate billing

II. Verhältnisse beim angerufenen Teilnehmer,
Fig.3
II. Conditions at the called subscriber,
Fig. 3

Ein von der Vermittlung ausgesandtes Rufsignal für die Betätigung des Weckers ist ein Wechselsignal mit einem Effektiv-Wert von ca. 70 V, welches der Gleichspannung in der Teilnehmerschleife von 48 V überlagert wird (Stelle F). Bei jedem Durchgang durch das Ansprechniveau des Kippkreises 13 entsteht auf dem das Signal g führenden Ausgang des logischen Kreises 17 ein Impuls. Das Signal d bleibt Null, weil der Kippkreis 14 wegen der Zeitkonstante des Verzögerungsgliedes 10 nicht reagiert Der Kippkreis 12 kippt mit der durch die Zeitkonstante des Verzögerungsgliedes 12 gegebenen Verzögerung von 1 auf Null (f= 0). Bei /=0 und c/=0 geht das Signal h, welches das Rufsignal anzeigt, von Null auf 1 über. Bei jeder ansteigenden und jeder abfallenden Flanke des Signals g entstehen Impulse, die den Eingängen Reset 1 und Reset 2 der D-Flip-Flops 18 und 19 über den Inverter 32 und das Differenzierglied 31 zugeführt werden, wodurch gesichert wird, daß die Signale an den Ausgängen Qi und Q2 A call signal sent by the exchange for the activation of the alarm clock is an alternating signal with an effective value of approx. 70 V, which is superimposed on the DC voltage of 48 V in the subscriber loop (position F). With each passage through the response level of the trigger circuit 13, a pulse is generated on the output of the logic circuit 17 carrying the signal g. The signal d remains zero because the trigger circuit 14 does not react because of the time constant of the delay element 10. The trigger circuit 12 tilts with the delay given by the time constant of the delay element 12 from 1 to zero (f = 0). When / = 0 and c / = 0, the signal h, which indicates the call signal, changes from zero to 1. With every rising and falling edge of the signal g , pulses are generated which are fed to the inputs Reset 1 and Reset 2 of the D flip-flops 18 and 19 via the inverter 32 and the differentiating element 31, which ensures that the signals are sent to the Outputs Qi and Q 2

ίο und demzufolge auch das Signal /Null bleiben.ίο and consequently the signal / zero remain.

Am Ende des Rufsignals kehren das Signal /mit der Verzögerung des Verzögerungsgliedes 12 auf I1 das Signal am Ausgang des EX-ODER-Tores 22 auf 1 und das Signal h auf Null zurück, weil d=0 und /= 1 werden.At the end of the call signal return the signal / with the delay of the delay element 12 to I 1, the signal at the output of the EX-OR gate 22 to 1 and the signal h to zero because d = 0 and / = 1.

Beim Abheben des Hörers (Punkt G) durch den angerufenen Teilnehmer nimmt das Signal g den logischen Zustand 1 an, wodurch die Anwesenheit des Schleifenstromes angezeigt wird. Die an den Eingängen Reset 1 und Reset 2 entstandenen Impulse sorgen dafür, daß die Ausgänge Q\ und Q2 der D-FIip-Flops 18 und 19 den logischen Zustand Null aufweisen.When the called subscriber lifts the receiver (point G), the signal g assumes the logic state 1, which indicates the presence of the loop current. The pulses generated at the inputs Reset 1 and Reset 2 ensure that the outputs Q \ and Q 2 of the D-FIip-Flops 18 and 19 have the logic state zero.

Am Ende der Verbindungsdurchschaltung (Punkt H) kehrt die Spannung in der Zuleitung auf den Wert von 48 V zurück, der Kippkreis 13 kippt auf Null, das Signal g geht auf Null, an den Eingängen Reset 1 und Reset 2 entsteht ein Impuls, wodurch wiederum gesichert wird, daß die Ausgänge Q\ und Q2 ein Signal Null führen. Der Ausgang des EX-ODER-Tores 22 weist den logischen Zustand 1 und der des EX-ODER-Tores 24 den logischen Zustand Null auf, so daß /= 0 istAt the end of the connection through-connection (point H), the voltage in the supply line returns to the value of 48 V, the trigger circuit 13 tilts to zero, the signal g goes to zero, a pulse is generated at the inputs Reset 1 and Reset 2, which in turn it is ensured that the outputs Q \ and Q 2 carry a signal zero. The output of the EX-OR gate 22 has the logic state 1 and that of the EX-OR gate 24 has the logic state zero, so that / = 0

Die beschriebene Detektorschaltung, die ohne Rücksicht auf die Polarität der Teilnehmerschleife funktioniert, ist in allen bekannten Telefonnetzen einsetzbar. Sie kann zwischen den Impulsen der Wählerscheibe und dem bei der Unterbrechung des Speisestromes beim Abheben des Hörers entstehenden Impuls unterscheiden. Die Montage erfolgt parallel zur Telefonleitung und kann daher ohne Unterbrechung derselben vorgenommen werden. Die Dämpfung der Teilnehmerschleife ist praktisch vernachlässigbar.The described detector circuit, which works regardless of the polarity of the subscriber loop, can be used in all known telephone networks. You can choose between the impulses of the voter disc and distinguish between the impulse generated when the supply current is interrupted when the receiver is lifted. The installation takes place parallel to the telephone line and can therefore be carried out without interruption of the same be made. The attenuation of the subscriber loop is practically negligible.

Hierzu 3 Blatt ZeichnungenFor this purpose 3 sheets of drawings

Claims (5)

Patentansprüche:Patent claims: 1. Detektorschaltung für die Ermittlung von Teilnehmerteitungszuständen in Fernsprechnetzen, die parallel zu der Teilnehmerschleife anschaltbar ist, dadurch gekennzeichnet, daß für jede Polarität der Teilnehmerschleife je ein eine galvanische Trennung bewirkender Eingangskreis (1 bzw. 2) vorgesehen ist, welcher über verzögerte Kippkreise (13,14 bzw. 15,16) mit einem logischen Schaltkreis (17) mit drei Ausgängen verbunden ist, von denen der erste Ausgang ein die Anwesenheit des Schleifenstromes anzeigendes Signal (g), der zweite Ausgang ein den Rufstrom anzeigendes Signal (h) und der dritte Ausgang ein die Änderung der Polarität anzeigendes Signal (i) führen.1. Detector circuit for the determination of subscriber line conditions in telephone networks, which can be connected in parallel to the subscriber loop, characterized in that a galvanic separation effecting input circuit (1 or 2) is provided for each polarity of the subscriber loop, which via delayed trigger circuits (13 , 14 or 15,16) is connected to a logic circuit (17) with three outputs, of which the first output is a signal (g) indicating the presence of the loop current, the second output is a signal (h) indicating the ringing current and the third output carry a signal (i) indicating the change in polarity. 2. Detektorschaltung nach Anspruch J, dadurch gekennzeichnet, daß der erste Eingangskreis (1) mit einem ersten Kippkreis (13) mit einem ersten Ausgangssignal (cjund mit einem zweiten Kippkreis (14) mit einem zweiten Ausgangssignal (d) verbunden ist und daß der zweite Eingangskreis (2) an einen dritten Kippkreis (15) mit einem dritten Ausgangssignal (e) und an einen vierten Kippkreis (16) mit einem vierten Ausgangssigna1 (!) geschaltet ist, wobei der Kipp-Pegel des ersten und des dritten Kippkreises (13,15) zwischen der Schleifenspannung bei aufgelegtem und bei abgenommenem Hörer und der Kipp-Pegel des zweiten und des vierten Kippkreises (14, 16) in der Nähe von Null Volt liegen.2. Detector circuit according to claim J, characterized in that the first input circuit (1) is connected to a first trigger circuit (13) with a first output signal (cjund with a second trigger circuit (14) with a second output signal (d) and that the second Input circuit (2) is connected to a third trigger circuit (15) with a third output signal (e) and to a fourth trigger circuit (16) with a fourth output signal 1 (!) , The trigger level of the first and third trigger circuit (13 , 15) between the loop voltage when the receiver is on-hook and when the receiver is picked up and the breakover level of the second and fourth breakover circuit (14, 16) are in the vicinity of zero volts. 3. Detektorschaltung nach Anspruch 2, dadurch gekennzeichnet, daß die Eingangskreise (1, 2) aus je einem DC/DC-Wandler bestehen, die je einen Oszillator (3 bzw. 4), ein Kopplungsglied (5 bzw. 6) und je einen Gleichrichter (7 bzw. 8) aufweisen.3. Detector circuit according to claim 2, characterized in that the input circuits (1, 2) from each a DC / DC converter, each with an oscillator (3 or 4), a coupling element (5 or 6) and each have a rectifier (7 or 8). 4. Detektorschaltung nach Anspruch 1 oder 2, dadurch gekennzeichnet, daß die verzögerten Kippkreise (13, 14, 15, 16) aus Schmitt-Triggern bestehen, deren Verzögerung durch vorgeschaltete Verzögerungsglieder (9,10,11,12)bewirkt ist.4. Detector circuit according to claim 1 or 2, characterized in that the delayed Toggle circuits (13, 14, 15, 16) consist of Schmitt triggers, the delay of which is provided by upstream Delay elements (9,10,11,12) is effected. 5. Detektorschaltung nach Anspruch 1, dadurch gekennzeichnet, daß der logische Kreis (17) so aufgebaut ist, daß zwischen seinen den Ausgangssignalen (c, d, e, f) der Kippkreise (13, 14, 15, 16) entsprechenden Eingangssignalen und Ausgangssignalen (g, h, i) folgende logische Beziehungen bestehen:5. Detector circuit according to claim 1, characterized in that the logic circuit (17) is constructed so that between its output signals (c, d, e, f) of the trigger circuits (13, 14, 15, 16) corresponding input signals and output signals (g, h, i) the following logical relationships exist:
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