DE2723536A1 - DEVICE FOR TESTING DIFFERENT TYPES OF CABLE SETS - Google Patents
DEVICE FOR TESTING DIFFERENT TYPES OF CABLE SETSInfo
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Description
Daiinler-llenz Aktiengesellschaft Daini 10 022 Daiinler-llenz Aktiengesellschaft Daini 10 022
Stuttgart 10· Mai 1^77 Stuttgart 10 May 1 ^ 77
"Vorrichtung zum Prüfen verschiedenartiger Kabelsätze""Device for testing different types of cable sets"
Die Erfindung bezieht sich auf eine Vorrichtung zun. Prüfen verschiedenartiger Kabelsätze, insbesondere von Kr;>ftfnhrzeuj;-Knbelsätzen mit verketteten Leitern und mit Adaptern für nicht festgelegte Verpolung. Es gibt eine Heilie von Prüfvorrichtung«!», welche aus Einzelleitern bestehende Knbelsätze auf Vertaus· hung, Unterbrechung und Kurzschluß der Leiter prüfen können. Ein derartiges Gerät wurde beispielsweise mit der Patentanmeldung P 26 09 0Ί7 vorgeschlagen.The invention relates to a device. Check different types of cable sets, especially cable sets with chained conductors and with adapters for non-defined polarity reversal. There is a cure from tester «!», which can check bracket sets consisting of individual conductors for interchangeability, interruption and short-circuit of the conductors. A such a device was proposed, for example, with the patent application P 26 09 0Ί7.
Alle derartigen Geräte sind jedoch für die Prüfung von Kabelsätzen ungeeignet, welche - wie beispielsweise umfangreiche Omnibuskabelsätze - eine Vielzahl verketteter Loiter und Adapter für nicht festgelegte Verpolung aufweisen. Solche Kabelsätze werden entweder für Seriellausführungen in größerer Stückzahl bzw. für besondere Kundenwünsche in Einzelfertigung hergestellt.However, all such devices are designed for testing harnesses unsuitable which - such as extensive Omnibus cable sets - have a large number of chained loiter and adapter for non-fixed polarity reversal. Such harnesses are either for serial versions in larger quantities or for special customer requests in individual production manufactured.
Es ist Aufgabe der Erfindung, eine Vorrichtung zu schaffen, welche in der Lage ist, obengenannte Knbelsätze zu prüfen und dabei zulässige Verpolungen von Adaptern als richtig zu erken-It is the object of the invention to provide a device which is able to test the above-mentioned toggle sets and recognizing permissible polarity reversal of adapters as correct
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nen, schnell auf andere Knbeleätze umstellbar zu sein und auch für Stichprobenprüfung von Kabelsatzlosen einsetzbar zu sein.to be able to quickly switch to other knuckle patches and also to be used for random testing of cable harness lots.
Diese Aufgabe wird nach der Erfindung durch die im kennzeichnenden Teil des Anspruchs 1 aufgeführten Maßnahmen gelöst.This object is achieved according to the invention by the measures listed in the characterizing part of claim 1.
Die Erfindung wird anhand eines in der Zeichnung schematisch dargestellten Ausführungsbeispiels naher erläutert.The invention is explained in more detail using an exemplary embodiment shown schematically in the drawing.
Es zeigen:Show it:
Fig. 1 einen schematisehen Gesamtschaltplan und1 shows a schematic overall circuit diagram and
Fig. 2 eine Ausführung der Adapter- und Fehlerlogik.Figure 2 shows an implementation of the adapter and error logic.
I i r-ur 1 zeigt einen schematischen Gesanitschaltplan der Vorrichtung am Ueispiel eines der Übersichtlichkeit wegen kleinen Kabelsatzes, bestehend aus zwei Einzelleitern 1 und 2 sowie zwei verketteten Leitern mit einmal drei und einmal vier Anschlüssen, bezeichnet mit 3a,b,c und 4a,b,c,d. Ein Schieberegister 5, welches von einem Impulsgeber 6 manuell, periodisch oder über Impulse der Prüfgatter weitergeschaltet wird, übernimmt die serielle Abfragung des Kabelsatzes. Seine aufeinanderfolgenden Ausgange sind mit den zugeordneten Anschlüssen der Eingangsadapter der Leiter 1 bis 't, und den entsprechenden Takt leitungen Tl bis ΤΊ verbunden. Die Takt leitungen Tl bis Tk führen zur später erläuterten Fehlerlogik 11 sowie zu je einem Eingang der zugeordneten Prüfgatter Pl bis P'i und den zugeordneten Leuchtdioden LtI bis Lt'l. Die Anschlüsse der Auegangsadapter der verketteten Leiter 3a bis 3c und *»a bis kd führenI r-ur 1 shows a schematic general circuit diagram of the device using the example of a small cable set for the sake of clarity, consisting of two individual conductors 1 and 2 as well as two concatenated conductors with three and four connections, labeled 3a, b, c and 4a, b, c, d. A shift register 5, which is switched manually, periodically or via pulses from the test gate by a pulse generator 6, takes over the serial interrogation of the cable set. Its successive outputs are connected to the associated connections of the input adapter of the conductors 1 to 't, and the corresponding clock lines Tl to ΤΊ. The clock lines Tl to Tk lead to the later explained error logic 11 as well as to one input each of the assigned test gates Pl to P'i and the assigned light-emitting diodes LtI to Lt'l. Lead the connections of the output adapter of the linked conductors 3a to 3c and * »a to kd
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Daim 10 Daim 10 f\22/kf \ 22 / k
zu den Eingängen eines Kreuzechienenverteilers 7 ι an dessen zugeordneten Ausgängen jedem verkettetem Leitersatz eine steck- oder schaltbare logische Gatterschaltung zugeordnet ist, die beispielsweise aus UND-Gattern zusammengesetzt ist. Den Leitern 3a bis 3c ist die Gatterschaltung G3 zugeordnet, den Leitern 'la bis 'id die Gatterschaltung G'i. Die Logische Gatterschaltung gibt ein L-Signal ab, wenn alle Ausgangsadapter des verketteten Leiters mit dem zugeordneten Schieberegisterausgang verbunden sind und dessen L-Signal weiterleiten, also richtig angeschlossen und weder kurzgeschlossen noch unterbrochen sind. Die Ausgänge der logischen Gatterschaltungen G3 und G'» sind mit den jeweiligen zweiten Eingangen der Prüfg.itter V) und P't und den Leuchtdioden L3 und L'i verbunden. Die Anschlüsse der Ausgangsadapter der Leiter 1 und 2 sind mit den entsprechenden zweiten Eingängen der Prüfgatter Pl und P2 und den Leuchtdioden Ll und L2 verbunden. Die Anschlüsse der Ausgangsadapter aller Leiter 1 bis 'ld führen außerdem zur Adapterlogik 10.a pluggable or switchable logic gate circuit, which is composed, for example, of AND gates, is assigned to the inputs of a crossbar distributor 7 ι at its assigned outputs to each linked set of conductors. The gate circuit G3 is assigned to the conductors 3a to 3c, the gate circuit G'i is assigned to the conductors 'la to' id. The logic gate circuit emits an L signal when all output adapters of the chained conductor are connected to the assigned shift register output and forward its L signal, i.e. correctly connected and neither short-circuited nor interrupted. The outputs of the logic gate circuits G3 and G '»are connected to the respective second inputs of the test grid V) and P't and the light-emitting diodes L3 and L'i. The connections of the output adapters of the conductors 1 and 2 are connected to the corresponding second inputs of the test gates Pl and P2 and the light-emitting diodes Ll and L2. The connections of the output adapters of all conductors 1 to 'ld also lead to the adapter logic 10.
Die Vorrichtung, soweit bis hierher beschrieben und in Fig. links von der gestrichelten Linie dargestellt, wird zur Prüfung von einzelnen Kabelsätzen verwendet. Nachdem der Kabelsatz angeschlossen ist, Kreuzschienenverteiler 7t logische Gatter G3, G't, Prüf gatter Pl bis P't und Leuchtdioden Ll bis L'» und LtI bis LtΊ entsprechend geschaltet bzw. gesteckt sind, wird der Impulsgeber 6 von Hand gestartet. Somit erscheint am ersten Ausgang des Schieberegisters 5 LvSignal, welches über Leiter 1 - sofern dieser nicht vertauscht angeschlossen, kurzgeschlossen oder Unterbrecher ist - und Taktleitung 1 zu den Leuchtdioden Ll und LtI und zu den Eingängen des Priifgatters Pl gelangt. Am Prüfgatter Pl, einer UND-Schaltung, erscheintThe device, as far as described up to this point and shown in the figure to the left of the dashed line, is used to test individual cable sets. After the cable set is connected, the 7t logical crossbar distributor Gates G3, G't, test gates Pl to P't and LEDs Ll to L '» and LtI to LtΊ are switched or plugged in accordingly, the pulse generator 6 is started manually. Thus appears at the first output of the shift register 5 LvSignal, which over Conductor 1 - provided it is not connected, short-circuited or interrupted - and clock line 1 to the LEDs Ll and LtI and to the inputs of the test gate Pl. At the test gate Pl, an AND circuit, appears
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ebenfalls L-Signal, welches bei entsprechender Einstellung des Impulsgebers 6 für dieses ein Signal zum Weiterschalten des Schieberegisters 5 bedeutet. Sind beispielsweise die Ein- oder Ausgänge der Leiter 1 und 2 miteinander vertauscht, so leuchten LtI und L2 auf und Prüfgatter Pl ist gesperrt, bis entweder der Fehler behoben ist oder der Impulsgeber 6 von Hand weitergeschaltet wird. Bei Unterbrechung von Leiter 1 leuchtet nur LtI und bei Kurzschluß leuchtet keine Leuchtdiode auf. L'ber die symmetrische Anordnung des alphanumerisch gekennzeichneten Leuchtdiodenfeldes kann die Zuordnung zum Kabelsatz erkannt werden.also L signal, which with the appropriate setting of the pulse generator 6 for this a signal to advance of the shift register 5 means. For example, if the inputs or outputs of conductors 1 and 2 are interchanged, LtI and L2 light up and test gate Pl is blocked until either the error has been rectified or the pulse generator 6 is advanced manually. If conductor 1 is interrupted, only LtI lights up and no LED lights up in the event of a short circuit on. The assignment to the Cable set can be recognized.
Über ein Kleinleuchtdiodenfeld, das allen Kreuzschienenverteiler-Eirigangen direkt zugeordnet ist, kann auch bei verketteten Leitungen die Lage des vertauschten Leiters abgelesen werden. In allen diesen Fällen wird das Schieberegister 5 nicht automatisch weitergeschaltet, da das entsprechende Prüfgatter gesperrt bleibt.Via a small LED field that is common to all crossbar distribution boards is assigned directly, the position of the interchanged conductor can be read off even with chained lines will. In all of these cases, the shift register 5 is not automatically advanced, since the corresponding Test gate remains locked.
Nach Durchlauf aller benötigten Stellen des Schieberegisters 5 wird der Impulsgeber 6 abgeschaltet und das Ende des Prüfvorganges in nicht dargestellter Weise in einer Rückstelleinheit 9 angezeigt. Dies kann in einem Zähler 8 mit digitaler Anzeige geschehen, der für den zweiten Teil der Vorrichtung vorgesehen ist.After passing through all the required positions in the shift register 5, the pulse generator 6 is switched off and the test process is ended displayed in a reset unit 9 in a manner not shown. This can be done in a counter 8 with digital Display happen, which is provided for the second part of the device.
Dieser zweite Teil ist in Fig. 1 rechts von der gestrichelten Linie dargestellt; ihm werden die T.tktleitungen T, d.h. Tl bis T*t und die Ausgänge L der Leiter 1 und 2 sowie der Leiterverkettzungen 3^1 b,c und *ta,b,c,d zugeführt. Sind LeiterThis second part is shown in Figure 1 to the right of the dashed line; the T.tkt lines T, i.e. Tl to T * t and the outputs L of conductors 1 and 2 as well as the interlinked conductors 3 ^ 1 b, c and * ta, b, c, d supplied. Are leaders
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zu Adaptern mit zulässiger Verpolung zusammengeführt, d.h., knnn der Adapter dee Kabelsatzes später richtig oder verkehrt angeschlossen werden, beispielsweise ein Anschluß mit stromführendem Leiter und Masseleiter für eine Glühlampe, so führen die Ausgänge dieser Leiter zur Adapterlogik 10, welche diese Verpolungen nicht als Fehler registriert. Die Ausgänge der Adapterlogik 10 sowie die Ausgänge der übrigen Leiter und die Taktleiter T führen zur Fehlerlogik 11, welche die einzelnen Leiter bzw. Leiterverkettunjen auf Vertauschung, Unterbrechung und Kurzschluß prüft. Liegt kein Fehler vor, wird über die Freigabe 17 ein Impuls πη den Impulsgeber G zum Weiterschieben des Schieberegisters abgegeben. Tritt hingegen ein Fehler auf, wird dieser in der Fehleranzeige angezeigt und über eine Stopschaltung 16 die Freigabe 17 gesperrt. In einem Fehlerspeicher 13 werden die aufgetretenen Fehler registriert bzw. addiert und die Fohlerzahl mit der in einem Höchstwertgeber l'i vorgegebenen Fohlerzahl verglichen. Danach kann durch Tastendruck von !land oder automatisch die Prüfung fortgesetzt werden. Sobald die Zahl der aufgetretenen Fehler diese vorgegebene Fehlerzahl erreicht, wird eine Anzeige 13 in Tätigkeit gesetzt und gegebenenfalls die Freigabe 17 gesperrt.Combined to adapters with permissible polarity reversal, i.e. the adapter of the cable set can later be correct or incorrect be connected, for example, a connection with a live conductor and ground conductor for an incandescent lamp, so lead the outputs of these conductors to the adapter logic 10, which does not register this polarity reversal as an error. The exits the adapter logic 10 and the outputs of the other conductors and the clock conductor T lead to the error logic 11, which the individual conductors or interlinked conductors, Checks interruption and short circuit. If there is no error, a pulse πη the pulse generator G via the release 17 issued to advance the shift register. If, on the other hand, an error occurs, this is shown in the error display and the release 17 is blocked via a stop circuit 16. The errors that have occurred are registered or added up in an error memory 13 and the number of foals is compared with the in compared to a maximum value generator l'i given number of foals. Then, by pressing! Land or automatically, the Examination to be continued. As soon as the number of errors that have occurred reaches this specified number of errors, a Display 13 set in action and, if necessary, the release 17 blocked.
Dieser zweite Teil der Prüfschaltung eignet sich besonders zur Stichprobenprüfung von Kabelsatzlosen, insbesondere für seriengefertigte Kabelsätze. Im Höchstwertgeber ik wird die Zahl von Fehlern gespeichert, die nicht mehr zugelassen wird. Danach werden sämtliche Kabelsätze, des Loses, beispiels-This second part of the test circuit is particularly suitable for random testing of lots of cable sets, in particular for series-produced cable sets. The number of errors that are no longer permitted is stored in the maximum value transmitter ik. Then all cable sets of the lot, for example
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weise fünfzig Stück, geprüft. Vird dabei die gespeicherte Fohlerzahl erreicht, so wird mittels der Anzeige 15 dieses Los gesperrt. Darüber hinaus ist die Adapterlogik in einem separaten Prüfgerätevorsatz untergebracht, der gleichzeitig als Aufnahmeadapter für den zu prüfenden Kabelsatz dient. Der Anschluß an das Crundgerät erfolgt über einen genormten Anschluß. Das heißt, daß im Prüfgerät selbst die universelle Grundlogik sitzt und im Prüfgerätevorsatz die speziellen elektrischen und mechanischen Anschlußgegebenlieiten berücksichtig sind.fifty pieces, checked. The saved Foal number is reached, this is indicated by means of the display 15 Lot locked. In addition, the adapter logic is housed in a separate test device attachment that simultaneously serves as a mounting adapter for the cable set to be tested. The connection to the basic unit is made via a standardized Connection. This means that the universal basic logic is located in the test device itself and the special logic in the test device attachment electrical and mechanical connections are taken into account.
Dei Änderungen oder N'euteilen werden keine Änderungen am Prüfgerät erforderlich, sondern nur der betroffene einzelne Prüfgerätevorsatz wird entsprechend geändert und vorbereitet, ohne daß Stillstandzeiten am Prüfgerät selbst auftreten .Changes or new parts will not change the Test device required, only the affected individual test device attachment is changed and prepared accordingly, without downtimes occurring on the test device itself.
Fig. 2 zeigt ein schematisches Ausführungebeispiel für Adapterlogik 10, Fehlerlogik 11 sowie Fehleranzeige 12, Stopschaltung 16 und Freigabe 17 anhand eines Kabelsatzteiles aus Fig. 1, bestehend aus den Leitern 1, 2, 3a und 3b. Dieser Kabelsatzteil hat auf der Eingangsseite einen dreipoligen Adapter 20 und mündet auf der Ausgangsseite in einen zweipoligen Adapter 21 für die Leiter 1 und 3a und einen zweipoligen Adapter 22 für die Leiter 2 und 3b. Die Adapter 21 und 22 haben keine festgelegte Polung, d.h., sie können auch verkehrt in die zugehörige Fassung gesteckt werden,2 shows a schematic embodiment example for adapter logic 10, error logic 11 and error display 12, stop circuit 16 and release 17 using a cable set part from Fig. 1, consisting of the conductors 1, 2, 3a and 3b. This Cable set part has a three-pin adapter 20 on the input side and opens into one on the output side two-pole adapter 21 for conductors 1 and 3a and one two-pole adapter 22 for conductors 2 and 3b. The adapters 21 and 22 do not have a fixed polarity, i.e. they can can also be put upside down in the corresponding version,
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was durch gekreuzte, unterbrochene Linien dargestellt ist. Aus diesem Grunde wird dem Kabelsatzteil eine Adapterlogik 10 nachgeschaltet, welche verhindern soll, daß bei verkehrter, aber zulässiger Verpolung ein Fehler registriert wird.what is represented by crossed, broken lines. For this reason, the cable set part is an adapter logic 10 connected downstream, which is intended to prevent an error from being registered if the polarity is incorrect, but permissible.
Die Adapterlogik 10 besteht für diesen Anwendungsfall aus vier Dioden D, drei UND-Gliedern 2k bis 26 und einem Inverter 23 die nach Fig. 2 geschaltet sind. Jedem Ausgang der Adapter 21 und 22 ist eine Diode zugeordnet, die in Hichtung zu den UND-Gliedern 2k bis 26 durchlässig ist. Die Kathoden der demselben Adapter zugeordneten Dioden sind kurzgeschlossen und verbinden je einen Eingang der UND-Glieder 2k ur.d 2 5 bzw. 25 und 26 miteinander. Die beiden anderen Eingänge der UND-Glieder 2k und 26 sind ebenfalls miteinander und mit dem Ausgang des Inverters 23 verbunden, dessen Eingang mit der Taktleitung T3 verbunden ist. Von der Adapterlogik 10 wird nun nacheinander geprüft, ob Leitung 1 bzw. 2 oder 3 von dem mit der Taktleitung Tl bzw. T2 oder T3 verbundenen Schieberegisterausgang mit einem der beiden Anschlüsse des Adapters 21 (bzw. bei Leitung 3 mit je einem Anschluß der beiden Adapter) Kontakt hat. Zuerst erhält Leitung 1 vom zugeordneten Schieberegister L-Signal. Dieses gelangt über den Adapter 21 und eine der beiden Dioden D zu je einem Eingang der UND-Glieder 2k und 25· Da Leitung 3 und deren Taktleitung T3 zu dieser Zeit Null-Signal führt, steht am Auegang des Inverters 23 und damit auch am zweiten Eingang des UND-Gliedes 2k L-Signal, so daß dieses durch-For this application, the adapter logic 10 consists of four diodes D, three AND gates 2k to 26 and an inverter 23 which are connected as shown in FIG. Each output of the adapters 21 and 22 is assigned a diode which is transparent towards the AND gates 2k to 26. The cathodes of the diodes assigned to the same adapter are short-circuited and each connect one input of the AND elements 2k ur.d 2 5 or 25 and 26 to one another. The other two inputs of the AND gates 2k and 26 are also connected to one another and to the output of the inverter 23, the input of which is connected to the clock line T3. The adapter logic 10 now checks in succession whether line 1 or 2 or 3 is from the shift register output connected to the clock line T1 or T2 or T3 with one of the two connections of the adapter 21 (or with line 3 with one connection of the two Adapter) is in contact. First line 1 receives an L signal from the assigned shift register. This arrives via the adapter 21 and one of the two diodes D to one input each of the AND gates 2k and 25 · Since line 3 and its clock line T3 have a zero signal at this time, the output of the inverter 23 and thus also the second Input of the AND gate 2k L signal, so that this through-
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lässig ist und Leitung Ll (identisch mit der zur Leuchtdiode Ll im ersten Teil der Schaltung) ebenfalls L-Signal führt. Dieselbe Prüfung erfolgt nach Weiterschalten des Schieberegisters mit Leitung 2, wobei dann Leitung L2 L-Signal führt. Bei der Prüfung der Leitungen 3«"» und 3b erhält je ein Eingang der UND-Glieder 2li und 26 und beide Eingange des UND-Gliedes 25 L-Signal, so daß L3 L-Signal erhält. Lber T3 und den Inverter 23, dessen Ausgang jetzt Nullsignal führt, werden die beiden UND-Glieder 2'k und 26 gesperrt. Für andere Kabelsatzkonfigurationen wird die Adapterlogik 10 entsprechend geschaltet sein. Bei der Prüfung einzelner Kabelsätze mit der im linken Teil von Fig. 1 dargestellten Vorrichtung kann zur Zulassung nicht festgelegter Verpolungen an die entsprechenden Ausgänge der entsprechenden Leitungen ebenfalls eine oben beschriebene Adapterlogik angeschlossen sein.is cool and line Ll (identical to the one to the light-emitting diode Ll in the first part of the circuit) also carries an L signal. The same check is carried out after the shift register has been switched on with line 2, with line L2 then carrying an L signal. When the lines 3 """and 3b are checked, one input each of the AND elements 2 l i and 26 and both inputs of the AND element 25 receive an L signal, so that L3 receives an L signal via T3 and the inverter 23 , the output of which now has a zero signal, the two AND gates 2'k and 26. The adapter logic 10 is switched accordingly for other cable set configurations If polarity reversal is not defined, an adapter logic described above must also be connected to the corresponding outputs of the corresponding lines.
An die Adapterlogik 10 schließt sich die Fehlerlogik 11 an. Bei der Prüfung von Einzelleitungen des Kabelsatzes ist der Adapter-Ausgang derselben direkt an die Fehlerlogik angeschlossen. Für jede Einzelleitung bzw. verkettete Leitung, d.h., also für jeden Schieberegisterauegang bzw. für jede Taktleitung ist eine Schaltung 27,28,29 ··· vorgesehen, die im Kasten 28 näher dargestellt und für alle Leitungen identisch ist. Sie besteht aus zwei UND-Gliedern 30 und 32 und au» zwei NOK-Gliedern 31 und 33; sie hat drei Eingänge, nämlich einen Eingang T für die Taktleitung, einen Eingang L für die zu prüfende Leitung und einen Fremdleitungseingang F. Die jeweilige Indexzahl dazu bezieht sich auf die zugehörige zu prüfende Leitung. Die Eingänge L und F aller Schaltungen sind über Dioden SD so miteinander verkoppelt, daß ein L-Signal an einem Eingang Lx an die Freindleitungseingänge aller anderenThe error logic 11 connects to the adapter logic 10. When checking the individual lines of the cable set, the Adapter output of the same connected directly to the error logic. For each individual line or linked line, i.e., for each shift register output or for each clock line, a circuit 27, 28, 29 ··· is provided which is shown in more detail in box 28 and is identical for all lines. It consists of two AND gates 30 and 32 and a » two NOK members 31 and 33; it has three inputs, namely an input T for the clock line, an input L for the line to be tested and an external line input F. The respective index number refers to the associated to testing line. The inputs L and F of all circuits are coupled to one another via diodes SD in such a way that an L signal is applied one input Lx to the free line inputs of all others
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Schaltungen gelangt mit Ausnahme des eigenen Freiiidleitungseinganges Fx. Die von weiteren, nicht gezeichneten Schaltungen kommenden bzw. dorthin führenden Dioden sind durch Pfeile symbolisiert, wobei die Pfeilrichtung der Durchlaßrichtung der Dioden entspricht.With the exception of its own free line input Fx. The of other, not shown circuits Diodes coming or leading there are symbolized by arrows, the direction of the arrows being the direction of passage of the Diodes.
Die Schaltung der Fehlerlogik 11, die auch anders als gezeigt aufgebaut sein kann, arbeitet so, daß zumindestThe circuit of the error logic 11, which can also be constructed differently than shown, works so that at least
a) bei L-Signal gleichzeitig und ausschließlich am T- und L-Eingang der Ausgang des NOR-Gliedes 33 L-Signal führt,a) with an L signal simultaneously and exclusively on T and L input the output of the NOR element 33 carries an L signal,
b) bei L-Signal gleichzeitig am T- und F-Eingang der Ausgang des UND-Gliedes 30 L-Signal führt,b) with an L signal at the same time at the T and F input, the output of the AND element 30 carries an L signal,
c) bei L-Signal am T-Eingang allein der Ausgang des UND-Gliedes 32 L-Signal führt undc) with an L signal at the T input, only the output of the AND element 32 carries an L signal and
d) niemals mehrere Ausgänge gleichzeitig L-Signal führen.d) never have several outputs carry an L signal at the same time.
Die Ausgänge der UND-Glieder 30 aller Schaltungen der Fehlerlogik 11 sind zu einer Sammelleitung V, ebenso die Ausgänge aller NOR-Glieder 33 zu einer Sammelleitung H und die Ausgänge aller UND-Glieder 32 zu einer Sammelleitung U zusammengeschlossen und jeweils durch der Übersichtlichkeit halber nicht gezeichnete Dioden gegeneinander entkoppelt. Die Sammelleitung V führt zum Eingang eines Inverters 37. dessen Ausgang und die Sammelleitung H auf die Eingänge eines UND-Gliedes 36 führen. An die Sammelleitung V ist eine Leuchtdiode 35, an die Sammelleitung U eine Leuchtdiode 3'* angeschlossen. Die beiden Leuchtdioden "}k und 35 bilden zusammen die Fehleranzeige 12, während der Inverter 37 und das UND-Glied 36 die Stoßschaltung l6 darstellen. Der Ausgang des UND-Gliedes 36, der nach Fig. 1 mit dem Impulsgeber 6 verbunden ist, bildet die Freigabe 17·The outputs of the AND elements 30 of all the circuits of the error logic 11 are combined to form a bus V, as are the outputs of all NOR elements 33 to form a bus H and the outputs of all AND elements 32 to form a bus U and not for the sake of clarity Drawn diodes are decoupled from each other. The bus line V leads to the input of an inverter 37. The output of the inverter and the bus line H lead to the inputs of an AND gate 36. A light-emitting diode 35 is connected to the bus line V, and a light-emitting diode 3 '* is connected to the bus line U. The two light-emitting diodes "} k and 35 together form the error display 12, while the inverter 37 and the AND element 36 represent the surge circuit l6. The output of the AND element 36, which is connected to the pulse generator 6 according to FIG the release 17
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Daim 10 822/*!Daim 10 822 / *!
Im folgenden wird die Funktionsweise der in Fig. 2 dargestellten Fehlerlogik beschrieben.The mode of operation of the error logic shown in FIG. 2 is described below.
Vird eine Leitung, beispielsweise Leitung 2, geprüft, so führt der zugeordnete Schieberegisterausgang L-Signal. Dieses geht zunächst über die zu prüfende Leitung 2 und in die Adapterlogik 10. Dort wird, wie bereits beschrieben, geprüft, ob an einem der erlaubten Adapterarischlüsse L-Signal vorhanden ist. Kenn ja, erhält die Leitung L2 ebenfalls L-Signal. Dieses und das ursprüngliche L-Signal über die zugeordnete Taktleitung T2 werden der Schaltung 28 der Fehlerlogik zugeführt. Heim Vorhandensein dieser beiden Signale erhält, wie bereits beschrieben, der Ausgang des NOK-Gliedes 33 und damit die Sammelleitung H L-Signal. Oa die Schaltung so aufgebaut ist, daß immer nur eine Sammelleitung L-Signal führen kann, erhält der Eingang des Inverters 37 Null-Signal, das UND-Glied ")C demnach an beide Eingänge L-Signal, so daß der Ausgang des UND-Gliedes 36 ebenfalls L-Signal fiihrt, welches als Freigabesignal an den Impulsgeber 6 zur Weiterschaltung des Schieberegisters geht.If a line, for example line 2, is checked, the assigned shift register output carries a L signal. This first goes via the line 2 to be tested and into the adapter logic 10. There, as already described, it is checked whether an L signal is present on one of the permitted adapter connections. If yes, line L2 also receives an L signal. This and the original L signal via the associated clock line T2 are fed to the circuit 28 of the error logic. In the presence of these two signals, as already described, the output of the NOK element 33 and thus the collecting line receives an H L signal. Oa the circuit is constructed in such a way that only one common line can carry an L signal, the input of the inverter 37 receives a zero signal, the AND element ") C accordingly to both inputs an L signal, so that the output of the AND Member 36 also carries an L signal, which is sent as an enable signal to the pulse generator 6 for the further switching of the shift register.
L-Signal auf der Sammelleitung Ji bedeutet, daß die Leitung als "richtig geschaltet" bewertet wird und ein Freigabesignal erfolgt. L-Signal auf der Sammelleitung U und Aufleuchten der Leuchtdiode 3'* zeigt eine Unterbrechung der geprüften Leitung an und L-Signal auf der Sammelleitung V schließlich mit Aufleuchten der Leuchtdiode 35 signalisiert eine Vertauschung der geprüften Leitung. Um welche Leitung es sich dabei handelt, ist der mit dem Impulsgeber 6 gekoppelten Anzeige des Zählere 8 zu entnehmen. Ein Kurzschluß endlich ist daran zu erkennen. An L signal on the bus Ji means that the line is assessed as "correctly switched" and a release signal is issued. The L signal on the bus U and the lighting up of the light-emitting diode 3 '* indicates an interruption in the line under test and the L signal on the bus V finally with the lighting up of the light-emitting diode 35 signals that the line under test has been interchanged. The display of the counter 8 coupled to the pulse generator 6 shows which line is involved. A short circuit can finally be recognized by it.
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- %Λ- - Doini 10 822/*! - % Λ- - Doini 10 822 / *!
4h4h
daß keine der beiden Leuchtdioden 3't und 35 aufleuchtet,
das Schieberegister 5 aber trotzdem nicht weitergeschaltet wird, da infolge des Kurzschlusses keine der Sammelleitungen
L-Signal führt. Der gesamte Ablauf des Prüfvorganges wurde
bereits weiter oben beschrieben.that neither of the two LEDs 3't and 35 light up,
however, the shift register 5 is not switched further because, as a result of the short circuit, none of the bus lines carries an L signal. The entire test procedure has already been described above.
809849/0101809849/0101
Claims (1)
und/oderhead and a test gate (Pl to P'i) is vorgeselien for each ladder linkage, the inputs of which are on the one hand the output of the conductor (1,2) and the output of the logic gate circuit (G3, Cl) and assigned to the ladder linkage (3, Ί) on the other hand, the assigned clock line (Tl to T ^) can be fed, that each input of the test gates (Pl to Pk) is assigned an optical display (Ll to L't and LtI to Lt * ») and that the outputs of the test gates (Pl to Pk) lead to the input of the shift register (5)
and or
die Stichprobenprüfung von Kabelsatzlosen ein Höchstwertgeber (l'i) für die erlaubte Fehlerzahl vorgesehen ist, der bei Überschreiten des Höchstwertes Signale für eine Sperrung des Loses abgibt.b) an adapter logic (1O) for checking the permissibility of polarity reversals and an error logic (H) for determining short circuits, swaps and interruptions with a memory (13) for the number of errors that have occurred and that for
the random inspection of cable harness lots a maximum value transmitter (l'i) is provided for the permitted number of errors, which sends signals for a blockage of the lot if the maximum value is exceeded.
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| DE2723536A DE2723536C3 (en) | 1977-05-25 | 1977-05-25 | Device for testing various types of cable sets |
| GB20523/78A GB1601860A (en) | 1977-05-25 | 1978-05-18 | Test apparatus for cable sets |
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| FR7815250A FR2392393A1 (en) | 1977-05-25 | 1978-05-23 | DEVICE FOR CHECKING CABLE HARNESSES OF DIFFERENT TYPES |
Applications Claiming Priority (1)
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| DE2723536A DE2723536C3 (en) | 1977-05-25 | 1977-05-25 | Device for testing various types of cable sets |
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| DE2723536B2 DE2723536B2 (en) | 1980-03-06 |
| DE2723536C3 DE2723536C3 (en) | 1980-10-23 |
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Family Applications (1)
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- 1978-05-23 FR FR7815250A patent/FR2392393A1/en active Granted
- 1978-05-23 US US05/908,728 patent/US4271388A/en not_active Expired - Lifetime
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