DE1134667T1 - UART-Taktaufwecksequenz - Google Patents

UART-Taktaufwecksequenz

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Publication number
DE1134667T1
DE1134667T1 DE1134667T DE00308833T DE1134667T1 DE 1134667 T1 DE1134667 T1 DE 1134667T1 DE 1134667 T DE1134667 T DE 1134667T DE 00308833 T DE00308833 T DE 00308833T DE 1134667 T1 DE1134667 T1 DE 1134667T1
Authority
DE
Germany
Prior art keywords
interrupt
clock
integrated circuit
counter
clock generator
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
DE1134667T
Other languages
English (en)
Inventor
Sun Man Lo
Glenn Wegner
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Exar Corp
Original Assignee
Exar Corp
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Filing date
Publication date
Application filed by Exar Corp filed Critical Exar Corp
Publication of DE1134667T1 publication Critical patent/DE1134667T1/de
Pending legal-status Critical Current

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    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F13/38—Information transfer, e.g. on bus
    • G06F13/382—Information transfer, e.g. on bus using universal interface adapter
    • G06F13/385—Information transfer, e.g. on bus using universal interface adapter for adaptation of a particular data processing system to different peripheral devices
    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04B—TRANSMISSION
    • H04B1/00—Details of transmission systems, not covered by a single one of groups H04B3/00 - H04B13/00; Details of transmission systems not characterised by the medium used for transmission
    • H04B1/38—Transceivers, i.e. devices in which transmitter and receiver form a structural unit and in which at least one part is used for functions of transmitting and receiving
    • H04B1/40—Circuits

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  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
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  • General Physics & Mathematics (AREA)
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  • Signal Processing (AREA)
  • Microcomputers (AREA)
  • Electric Clocks (AREA)

Claims (12)

Ansprüche
1. Integrierter UART-Schaltkreis, mit
einem Taktgeber (32), der einen Schlafmodus hat;
einem Zähler (38), der an einen Ausgang (36) des
Taktgebers (32) angeschlossen ist;
einer Unterbrechungsleitung (40), die an einen Ausgang des Zählers (38) angeschlossen ist;
einem Unterbrechungsregister.
2. Integrierter Schaltkreis nach Anspruch 1, wobei das Unterbrechungsregister keinen zugewiesenen Unterbrechungscode für ein Aufwachen des Taktgebers (32) hat.
3. Integrierter Schaltkreis nach Anspruch 1, wobei das Unterbrechungsregister ausschließlich Nullen aufweist, wenn es keinen zugewiesenen Unterbrechungscode hat.
4. Integrierter Schaltkreis nach Anspruch 1, wobei der Zähler (38) ein Acht-Bit-Zähler ist.
5. Integrierter Schaltkreis nach Anspruch 1, der ferner eine Schlafschaltung umfaßt, um den Taktgeber (32)
in Schlaf zu versetzen.
'&Ggr;&igr;
DE/EP 1 1 34 667 T1
6. Integrierter Schaltkreis nach Anspruch 1, wobei die Unterbrechungsleitung (40) an eine Unterbrechungsleitung eines PCI-Bus (28) gekoppelt ist.
7. Verfahren zum Betrieb eines integrierten UART-Schaltkreises umfassend,
das Starten eines Taktgebers (32) in dem integrierten Schaltkreis;
das Zählen der Ausgabe von Taktgeberzyklen durch den Taktgeber (32);
das Generieren eines Unterbrechungssignals, wenn eine vorher festgelegte Anzahl von Taktgeberzyklen erreicht ist;
das Bestimmen, daß der Taktgeber (32) stabil ist als Antwort auf das Unterbrechungssignal und das Beginnen des Betriebs des integrierten Schaltkreises.
8. Verfahren nach Anspruch 7, das ferner umfaßt, keinen zugewiesenen Unterbrechungscode mit dem Unterbrechungssignal bereitzustellen;
als Antwort auf das Unterbrechungssignal mit keinem zugewiesenem Unterbrechungscode zu bestimmen, daß die Unterbrechung anzeigt, daß der Taktgeber (32) stabil ist.
9. Verfahren nach Anspruch 8, wobei ein Unterbrechungsregister ausschließlich Nullen aufweist, wenn es nicht einen zugewiesenen Unterbrechungscode hat.
10. Verfahren nach Anspruch 7, das ferner umfaßt,
den Taktgeber (32) nur in Schlaf zu versetzen, wenn keine Unterbrechungen anstehen; und
T :\Schriftveri:ehr\41971. a. doc
• · 3 ♦ · ·
einen Zähler (38) auf Null zu setzen, wenn der Taktgeber (32) in Schlaf versetzt wird.
11. Verfahren nach Anspruch 7, wobei der integrierte Schaltkreis ein UART ist und dieser ferner umfaßt, die übertragung und den Empfang von Daten durch den UART nach der Generierung der Unterbrechung zu beginnen.
12. Integrierte Schaltung mit
einem Taktgeber (32) mit Schlafmodus; einem Zähler (38), der an einen Ausgang (36) des Taktgebers (32) angeschlossen ist; eine Unterbrechungsleitung, die an einen Ausgang des Zählers (38) angeschlossen ist;
ein Unterbrechungsregister ohne einen Unterbrechungscode für ein Aufwachen des Taktgebers (32).
T:*Schriftverkehr\41971. a. doc
DE1134667T 2000-03-17 2000-10-06 UART-Taktaufwecksequenz Pending DE1134667T1 (de)

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
US09/528,090 US6754839B1 (en) 2000-03-17 2000-03-17 UART clock wake-up sequence

Publications (1)

Publication Number Publication Date
DE1134667T1 true DE1134667T1 (de) 2002-04-18

Family

ID=24104224

Family Applications (1)

Application Number Title Priority Date Filing Date
DE1134667T Pending DE1134667T1 (de) 2000-03-17 2000-10-06 UART-Taktaufwecksequenz

Country Status (6)

Country Link
US (1) US6754839B1 (de)
EP (1) EP1134667A3 (de)
KR (1) KR20010091867A (de)
DE (1) DE1134667T1 (de)
HK (1) HK1039814A1 (de)
TW (1) TW514790B (de)

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Also Published As

Publication number Publication date
US6754839B1 (en) 2004-06-22
HK1039814A1 (zh) 2002-05-10
EP1134667A2 (de) 2001-09-19
EP1134667A3 (de) 2004-03-10
TW514790B (en) 2002-12-21
KR20010091867A (ko) 2001-10-23

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