DE112017007356T5 - Hohle versiegelte Vorrichtung und Herstellungsverfahren dafür - Google Patents
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- 238000004519 manufacturing process Methods 0.000 title claims description 21
- 239000000758 substrate Substances 0.000 claims abstract description 102
- 238000007789 sealing Methods 0.000 claims abstract description 70
- 239000002184 metal Substances 0.000 claims abstract description 61
- 229910052751 metal Inorganic materials 0.000 claims abstract description 61
- 238000000059 patterning Methods 0.000 claims abstract description 9
- 238000000034 method Methods 0.000 description 11
- 239000000463 material Substances 0.000 description 5
- 235000012431 wafers Nutrition 0.000 description 5
- 239000007787 solid Substances 0.000 description 4
- 229910052737 gold Inorganic materials 0.000 description 3
- 229910052763 palladium Inorganic materials 0.000 description 3
- 229910052697 platinum Inorganic materials 0.000 description 3
- 230000000052 comparative effect Effects 0.000 description 2
- 229910052802 copper Inorganic materials 0.000 description 2
- 238000009826 distribution Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 239000002923 metal particle Substances 0.000 description 2
- 239000011859 microparticle Substances 0.000 description 2
- 239000002245 particle Substances 0.000 description 2
- 229910052709 silver Inorganic materials 0.000 description 2
- 239000002904 solvent Substances 0.000 description 2
- 238000010301 surface-oxidation reaction Methods 0.000 description 2
- 230000007704 transition Effects 0.000 description 2
- 238000007740 vapor deposition Methods 0.000 description 2
- BUHVIAUBTBOHAG-FOYDDCNASA-N (2r,3r,4s,5r)-2-[6-[[2-(3,5-dimethoxyphenyl)-2-(2-methylphenyl)ethyl]amino]purin-9-yl]-5-(hydroxymethyl)oxolane-3,4-diol Chemical compound COC1=CC(OC)=CC(C(CNC=2C=3N=CN(C=3N=CN=2)[C@H]2[C@@H]([C@H](O)[C@@H](CO)O2)O)C=2C(=CC=CC=2)C)=C1 BUHVIAUBTBOHAG-FOYDDCNASA-N 0.000 description 1
- 239000012298 atmosphere Substances 0.000 description 1
- 239000003795 chemical substances by application Substances 0.000 description 1
- 230000007547 defect Effects 0.000 description 1
- 230000006866 deterioration Effects 0.000 description 1
- 238000001312 dry etching Methods 0.000 description 1
- 238000005530 etching Methods 0.000 description 1
- 238000005259 measurement Methods 0.000 description 1
- 238000003801 milling Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 239000002105 nanoparticle Substances 0.000 description 1
- 230000009257 reactivity Effects 0.000 description 1
- 230000003252 repetitive effect Effects 0.000 description 1
- 239000004065 semiconductor Substances 0.000 description 1
- 238000009751 slip forming Methods 0.000 description 1
- 238000004544 sputter deposition Methods 0.000 description 1
- 239000011800 void material Substances 0.000 description 1
- 238000001039 wet etching Methods 0.000 description 1
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- H01L21/50—Assembly of semiconductor devices using processes or apparatus not provided for in a single one of the subgroups H01L21/06 - H01L21/326, e.g. sealing of a cap to a base of a container
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- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/50—Assembly of semiconductor devices using processes or apparatus not provided for in a single one of the subgroups H01L21/06 - H01L21/326, e.g. sealing of a cap to a base of a container
- H01L21/56—Encapsulations, e.g. encapsulation layers, coatings
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- H01L24/11—Manufacturing methods
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- H01L24/12—Structure, shape, material or disposition of the bump connectors prior to the connecting process
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- H01L24/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L24/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
- H01L24/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
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- H01L24/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
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- H01L24/81—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
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- B81B2207/091—Arrangements for connecting external electrical signals to mechanical structures inside the package
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- B81B2207/091—Arrangements for connecting external electrical signals to mechanical structures inside the package
- B81B2207/094—Feed-through, via
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- H01L2224/16135—Disposition the bump connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip
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- H01L2224/16238—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation the bump connector connecting to a bonding area protruding from the surface of the item
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Abstract
Ein ringartiger Versiegelungsrahmen (3) und ein Kontakthöcker (4) werden gleichzeitig auf einer Hauptoberfläche eines ersten Substrats (1) gebildet, indem eine Metallpaste strukturiert wird. Eine ringartige Erhebung (8) mit einer kleineren Breite als eine Breite des Versiegelungsrahmens (3) wird auf einer Hauptoberfläche eines zweiten Substrats (5) gebildet. Die Hauptoberfläche des ersten Substrats (1) und die Hauptoberfläche des zweiten Substrats (5) werden so ausgerichtet, dass sie einander zugewandt sind. Der Versiegelungsrahmen (3) wird an die Erhebung (8) gebondet, und der Kontakthöcker (4) wird elektrisch an das zweite Substrat (5) gebondet. Eine Höhe der Erhebung (8) ist das 0,4- bis 0,7-fache eines Abstands zwischen dem ersten Substrat (1) und dem zweiten Substrat (2) nach einem Bonden.
Description
- Gebiet
- Die vorliegende Erfindung bezieht sich auf eine hohe versiegelte Vorrichtung, die einen Hohlraum zwischen zwei Substraten enthält, und ein Herstellungsverfahren dafür.
- Hintergrund
- Für bessere Zuverlässigkeit und Eigenschaften beziehen einige Herstellungsverfahren eine Hohlraumversiegelung ein, wobei Halbleitervorrichtungen oder MEMS-(mikro-elektromechanische System-)Vorrichtungen in einem zwischen gegenüberliegenden Oberflächen ausgebildeten Hohlraum versiegelt werden (siehe zum Beispiel PTL 1 und PTL 2). In der herkömmlichen Vorrichtung sind zwei Substrate mit einem Versiegelungsrahmen aneinander gebondet, um einen luftdichten Hohlraum zu bilden, und Elektroden einer Schaltung im unteren Substrat sind zum oberen Substrat herausgeführt (siehe zum Beispiel PTL 1). Wenn diese Struktur in Waferprozessen hergestellt wird, werden Kontakthöcker und ein Versiegelungsrahmen gleichzeitig gebildet, indem eine Metallpaste gemustert bzw. strukturiert wird, so dass sie gemeinsam gebondet werden. Dieses Verfahren erlaubt eine gemeinsame Herstellung einer Vielzahl von Vorrichtungen mittels Wafer Level Chip Scale Package (WLCSP) und hat in den letzten Jahren breite Anwendungen gefunden.
- Ein Nachteil besteht darin, dass eine genaue Steuerung einer Muster- bzw. Strukturbreite wegen der schlechten Strukturierungsgenauigkeit der Metallpaste schwierig ist. Die Bondingstruktur weist unvermeidlich eine große Fläche auf, infolge der der für das Bonden angewendete Druck (durch die Strukturfläche dividierte Gesamtlast) unzureichend ist und Versiegelungseigenschaften ungenügend sind. Wenn eine luftdichte Versiegelung mit einer Au-Metallpaste vorgesehen werden soll, ist beispielsweise für das Bonden ein Druck von 100 MPa oder mehr notwendig. Wenn 5000 Chips gleichzeitig mit 4-Zoll-Wafern versiegelt werden, würde ein Versiegelungsrahmen mit einer Breite von 20 µm etwa 10 % der Strukturfläche einnehmen. Um unter dieser Bedingung einen Bondingdruck von 100 MPa sicherzustellen, wäre eine berechnete Last von 78,5 kN pro Wafer notwendig. Da die Obergrenze des durch eine bestehende Druckbeaufschlagungseinrichtung anwendbaren Drucks etwa 60 kN ist, kann keine luftdichte Versiegelung gebildet werden. Als eine Lösung für dieses Problem gab es ein Verfahren, worin eine ringartige Erhebung in einem an den Versiegelungsrahmen zu bondenden Teilbereich vorgesehen wird, um zu ermöglichen, dass Druck konzentriert wird (siehe zum Beispiel PTL 1).
- Zitatliste
- Patentliteratur
-
- [PTL1] offengelegte
japanische Patentanmeldung Nr. 2014-22699 - [PTL2] offengelegte
japanische Patentanmeldung Nr. 2003-188294 - [PTL3] offengelegte
japanische Patentanmeldung Nr. 2016-197664 - Zusammenfassung
- Technisches Problem
- Das Problem war jedoch, dass eine Anwendung des Verfahrens zum Vorsehen einer Erhebung in einem an den Versiegelungsrahmen zu bondenden Teilbereich auf Strukturen, die Kontakthöcker nutzen, wegen einer Lastverteilung auf die Kontakthöcker zu einer noch schlechteren Luftdichtigkeit führen würde. Wenn beispielsweise 5000 Chips der gleichen Größe aus 4-Zoll-Wafern hergestellt werden, wobei jeder Chip sechs Kontakthöcker eines Durchmessers von 100 µm benötigt, würden die Kontakthöcker etwa 12 % der Strukturfläche einnehmen. Um unter dieser Bedingung einen Druck von 100 MPa anzuwenden, wäre auch mit der in einem an den Versiegelungsrahmen zu bondenden Teilbereich vorgesehenen Erhebung eine berechnete Last von 94,2 kN allein für die Kontakthöckerstruktur notwendig. Dementsprechend könnte keine luftdichte Versiegelung mit einer existierenden Druckbeaufschlagungseinrichtung einer maximalen Leistungsfähigkeit von 60 kN gebildet werden.
- Die vorliegende Erfindung wurde gemacht, um die oben beschriebenen Probleme zu lösen, und deren Aufgabe besteht darin, eine hohle versiegelte Vorrichtung und ein Herstellungsverfahren dafür vorzusehen, wodurch, während Substrate durch Kontakthöcker elektrisch verbunden werden, die Versiegelungseigenschaften verbessert werden können.
- Lösung für das Problem
- Ein Verfahren zum Herstellen einer hohlen versiegelten Vorrichtung gemäß der vorliegenden Erfindung beinhaltet: ein gleichzeitiges Ausbilden eines ringartigen Versiegelungsrahmens und eines Kontakthöckers auf einer Hauptoberfläche eines ersten Substrats, indem eine Metallpaste strukturiert wird; ein Ausbilden einer ringartigen Erhebung mit einer kleineren Breite als eine Breite des Versiegelungsrahmens auf einer Hauptoberfläche eines zweiten Substrats; und ein Ausrichten der Hauptoberfläche des ersten Substrats und der Hauptoberfläche des zweiten Substrats, so dass sie einander zugewandt sind, ein Bonden des Versiegelungsrahmens an die Erhebung und ein elektrisches Bonden des Kontakthöckers an das zweite Substrat, wobei eine Höhe der Erhebung das 0,4- bis 0,7-fache eines Abstands zwischen dem ersten Substrat und dem zweiten Substrat nach einem Bonden ist.
- Vorteilhafte Effekte der Erfindung
- In der vorliegenden Erfindung können die Substrate durch den Kontakthöcker elektrisch verbunden werden. Während des Bondens kann ein hoher Druck selektiv und lokal auf die Erhebung statt auf die gesamte Strukturfläche des Versiegelungsrahmens angewendet werden. Folglich kann eine höhere Last beaufschlagt werden. Die Höhe der Erhebung ist das 0,4- bis 0,7-fache des Abstands zwischen dem ersten Substrat und dem zweiten Substrat nach einem Bonden. Folglich kann die Metallpaste des Versiegelungsrahmens direkt unter der Erhebung in ein massives Metall transformiert werden, so dass die Versiegelungseigenschaften verbessert werden können.
- Figurenliste
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-
1 ist eine Draufsicht, die ein Verfahren zum Herstellen einer hohlen versiegelten Vorrichtung gemäß einer Ausführungsform 1 der vorliegenden Erfindung veranschaulicht. -
2 ist eine Querschnittsansicht, die das Verfahren zum Herstellen der hohlen versiegelten Vorrichtung gemäß der Ausführungsform 1 der vorliegenden Erfindung veranschaulicht. -
3 ist eine Querschnittsansicht, die das Verfahren zum Herstellen der hohlen versiegelten Vorrichtung gemäß der Ausführungsform 1 der vorliegenden Erfindung veranschaulicht. -
4 ist eine Querschnittsansicht, die das Verfahren zum Herstellen der hohlen versiegelten Vorrichtung gemäß der Ausführungsform 1 der vorliegenden Erfindung veranschaulicht. -
5 ist eine Querschnittsansicht, die Zustandsübergänge der Metallpastenstruktur, während sie sich unter Druck verformt, veranschaulicht. -
6 ist eine vergrößerte Querschnittsansicht eines Kontakthöckerteilbereichs vor und nach dem Bonden. -
7 ist eine grafische Darstellung, die die Beziehung zwischen dem auf die Au-Paste angewandten Druck und dem Verformungsbetrag zeigt. -
8 ist eine Querschnittsansicht, die ein Variationsbeispiel 1 der hohlen versiegelten Vorrichtung gemäß der Ausführungsform 1 der vorliegenden Erfindung veranschaulicht. -
9 ist eine entlang I-II von8 genommene Querschnittsansicht. -
10 ist eine Querschnittsansicht, die ein Variationsbeispiel 2 der hohlen versiegelten Vorrichtung gemäß der Ausführungsform 1 der vorliegenden Erfindung veranschaulicht. -
11 ist eine Draufsicht, die Variationsbeispiele der Erhebung für den Versiegelungsrahmen der hohlen versiegelten Vorrichtung gemäß der Ausführungsform 1 der vorliegenden Erfindung veranschaulicht. -
12 ist eine Draufsicht, die Variationsbeispiele der Erhebung für den Versiegelungsrahmen der hohlen versiegelten Vorrichtung gemäß der Ausführungsform 1 der vorliegenden Erfindung veranschaulicht. -
13 ist eine Draufsicht, die Variationsbeispiele der Erhebung für den Versiegelungsrahmen der hohlen versiegelten Vorrichtung gemäß der Ausführungsform 1 der vorliegenden Erfindung veranschaulicht. -
14 ist eine Querschnittsansicht, die ein Variationsbeispiel 3 der hohlen versiegelten Vorrichtung gemäß der Ausführungsform 1 der vorliegenden Erfindung veranschaulicht. -
15 ist eine Querschnittsansicht, die ein Variationsbeispiel 4 der hohlen versiegelten Vorrichtung gemäß der Ausführungsform 1 der vorliegenden Erfindung veranschaulicht. -
16 ist eine Querschnittsansicht, die eine hohle versiegelte Vorrichtung gemäß einem Vergleichsbeispiel veranschaulicht. -
17 ist eine Querschnittsansicht, die eine hohle versiegelte Vorrichtung gemäß einer Ausführungsform 2 der vorliegenden Erfindung veranschaulicht. -
18 ist eine Querschnittsansicht, die ein Variationsbeispiel der hohlen versiegelten Vorrichtung gemäß der Ausführungsform 2 der vorliegenden Erfindung veranschaulicht. -
19 ist eine Querschnittsansicht, die eine hohle versiegelte Vorrichtung gemäß der Ausführungsform 3 der vorliegenden Erfindung veranschaulicht. - Beschreibung von Ausführungsformen
- Unter Bezugnahme auf die Zeichnungen werden eine hohle versiegelte Vorrichtung und ein Herstellungsverfahren dafür gemäß den Ausführungsformen der vorliegenden Erfindung beschrieben. Die gleichen Komponenten werden durch die gleichen Symbole bezeichnet, und deren wiederholte Beschreibung kann weggelassen werden.
- Ausführungsform 1
-
1 ist eine Draufsicht, die ein Verfahren zum Herstellen der hohlen versiegelten Vorrichtung gemäß der Ausführungsform 1 der vorliegenden Erfindung veranschaulicht.2 bis4 sind Querschnittsansichten, die das Verfahren zum Herstellen der hohlen versiegelten Vorrichtung gemäß der Ausführungsform 1 der vorliegenden Erfindung veranschaulichen.2 ist eine entlang I-II von1 genommene Querschnittsansicht. - Wie in
1 und2 gezeigt ist, wird zunächst eine Vorrichtungsschaltung2 , die in einem Hohlraum versiegelt werden soll, in einem zentralen Teilbereich auf einer oberen Oberfläche eines Substrats1 gebildet. Ein ringartiger Versiegelungsrahmen3 und Kontakthöcker4 werden durch Strukturieren einer Metallpaste gleichzeitig auf der oberen Oberfläche des Substrats1 gebildet. Der Versiegelungsrahmen3 und die Kontakthöcker4 haben die gleiche Dicke. - Eine Struktur des Versiegelungsrahmens
3 und der Kontakthöcker4 kann beispielsweise gebildet werden, indem zuerst eine Resiststruktur vorgesehen wird, die später unter Verwendung eines Entfernungsmittels oder dergleichen entfernt wird, nachdem vertiefte Formen in der Struktur mit dem Pastenmaterial gefüllt wurden. Alternativ dazu kann die Struktur direkt durch einen Tintenstrahlprozess gebildet werden. Die Strukturhöhe unterscheidet sich je nach Eigenschaftsanforderungen der Vorrichtung. Je größer die Strukturhöhe ist, desto höher ist wegen des größeren Raums die Zuverlässigkeit der Luftdichtigkeit. Auf der anderen Seite muss das Resist für höhere Strukturen dicker sein, was zu einer Verschlechterung einer Strukturgenauigkeit und Gleichmäßigkeit der Höhe führt, und daher muss, um einen Kompromiss zu treffen, eine geeignete Höhe ausgewählt werden. Die Strukturhöhe beträgt hier etwa beispielsweise 20 µm. - Als Nächstes werden, wie in
3 gezeigt ist, Durchgangslöcher6 gebildet, die sich durch ein Gegensubstrat5 erstrecken, und die Ausleitungselektroden7 , die mit den Durchgangslöchern6 verbunden sind, werden auf einer oberen Oberfläche des Gegensubstrats5 gebildet. Eine ringartige Erhebung8 wird auf einer unteren Oberfläche des Gegensubstrats5 an der dem Versiegelungsrahmen3 des Substrats1 gegenüberliegenden Position gebildet. Die Erhebungen9 werden auf der unteren Oberfläche des Gegensubstrats5 an den den Kontakthöckern4 des Substrats1 gegenüberliegenden Positionen gebildet. Die Erhebung8 hat eine kleinere Breite als diejenige des Versiegelungsrahmens3 . Die Erhebungen9 haben eine kleinere Breite als diejenige der Kontakthöcker4 . Die Erhebungen8 und9 werden zum Beispiel gebildet, indem die untere Oberfläche des Gegensubstrats5 unter Verwendung eines Resists oder Metalls als Maske einer Trockenätzung oder Nassätzung unterzogen wird. Alternativ dazu können die Erhebungen8 und9 aus einem mittels Gasphasenabscheidung gebildeten Metallfilm oder plattierten Film gebildet werden. - Als Nächstes wird die Temperatur erhöht, um einen Großteil des Lösungsmittels in der Metallpaste sich verflüchtigen zu lassen, wonach die obere Oberfläche des Substrats
1 und die untere Oberfläche des Gegensubstrats5 so ausgerichtet werden, dass sie einander zugewandt sind, wie in4 gezeigt ist, und beide Substrate werden unter hoher Temperatur und Druck aneinander gebondet. Während dieses Prozesses werden der Versiegelungsrahmen3 und die Erhebung8 aneinander gebondet, und die Kontakthöcker4 und die Erhebungen9 werden aneinander gebondet, ebenso wie die Kontakthöcker4 an die Durchgangslöcher6 des Gegensubstrats5 elektrisch gebondet werden. - Wenn an die Erhebungen
8 und9 gebondet wird, werden Metallmikropartikel des Versiegelungsrahmens3 und der Kontakthöcker4 komprimiert, und benachbarte Mikropartikel verbinden sich miteinander und agglomerieren in ein massives Metall. Die die Erhebungen8 und9 umgebende Metallpastenstruktur wird ebenfalls verformt, wodurch der Versiegelungsrahmen3 und die Kontakthöcker4 an der unteren Oberfläche des Gegensubstrats5 haften. Somit ist die hohle versiegelte Vorrichtung hergestellt. - Elektrische Signale werden zwischen der Vorrichtungsschaltung
2 und der Außenseite bzw. Umgebung der so hergestellten hohlen versiegelten Vorrichtung über die Kontakthöcker4 , Durchgangslöcher6 und Ausleitungselektroden7 eingespeist und abgegeben. Die Vorrichtungsschaltung2 , die Durchgangslöcher6 und so weiter können auf einem des Substrats1 und des Gegensubstrats5 oder beiden oder auch sowohl oberen als auch unteren Oberflächen der Substrate ausgebildet sein. -
5 ist eine Querschnittsansicht, die Zustandsübergänge der Metallpastenstruktur veranschaulicht, während sie sich unter Druck verformt. Wenn die Metallpastenstruktur gebildet wird (a), sind Lücken zwischen Metallpartikeln miteinander verbunden (offene Zelle). Während ein Druck angewendet wird (b), werden Metallpartikel zusammengepresst, so dass benachbarte Partikel beginnen, sich miteinander zu verbinden, und die Lücken isoliert werden (geschlossene Zelle). Wenn sich das Metall vollständig in ein massives wandelt (c), verformt es sich nicht mehr. In Bezug auf die Strukturhöhe h in (a), beträgt die Höhe in Phase (b) 0,4 h bis 0,6 h, und die Höhe in Phase (c) beträgt etwa 0,3 h bis 0,5 h. Um eine Luftdichtigkeit des Hohlraums sicherzustellen, ist der Zustand (b) oder (c) notwendig, da man nicht zulassen darf, dass die Luft durch den Versiegelungsrahmen3 hindurchgeht. -
6 ist eine vergrößerte Querschnittsansicht eines Kontakthöckerteilbereichs vor und nach dem Bonden. Die Höhe m der Erhebung9 und die Höhe h des Kontakthöckers4 sind so geeignet ausgewählt, dass die Erhebung9 nach dem Bonden vollständig im Kontakthöcker4 eingebettet ist. Folglich kann der Kontakthöcker4 zuverlässig an das Durchgangsloch6 elektrisch gebondet werden. Der Abstand zwischen den Substraten wird nach dem Bonden h -δ. - Der Versiegelungsrahmen
3 muss auf der anderen Seite die Gleichung 0,3 h ≤ x ≤ 0,6 h erfüllen, wobei x die Länge direkt unterhalb der Erhebung8 ist, um den oben beschriebenen Zustand (b) oder (c) zu erreichen. Da m + x = h - δ gilt, haben wir 0,4 (h - δ) ≤ m ≤ 0,7 (h - δ). Daher sollte die Höhe m der Erhebung8 das 0,4- bis 0,7-fache des Abstands h - δ zwischen dem Substrat1 und dem Gegensubstrat5 nach dem Bonden sein. Da die Variation δ in der Strukturhöhe alle Teile des Versiegelungsrahmens3 und der Kontakthöcker4 einschließlich der die Erhebungen8 und9 umgebenden Teile betrifft, wird jegliche Variation eine Lastverteilung herbeiführen und eine höhere Last erfordern. Daher sollte δ am bevorzugtesten Null sein oder sollte auf einen minimalen möglichen Wert innerhalb eines Bereichs von 0 ≤ δ, auch unter Berücksichtigung einer für ein elektrisches Bonden erforderlichen Toleranzm eingestellt werden. - Wenn man eine Au-Paste beispielsweise mit einer Strukturhöhe von 20 µm verwendet, kann die Erhebung
8 eine Höhe von 6 µm bis 14 µm aufweisen, und die Höhe nach dem Bonden kann auf etwa 20 µm eingestellt werden.7 ist eine grafische Darstellung, die die Beziehung zwischen dem auf die Au-Paste angewandten Druck und dem Verformungsbetrag zeigt. Die Messungen wurden mit der Paste mit einer Dicke von 20 µm in einer Umgebung bei Raumtemperatur vorgenommen. Wenn beispielsweise 0 ≤ δ ≤ 1 gilt, nimmt schließlich die Erhebung8 einen Druck von 100 MPa oder mehr auf und macht eine Verformung von 10 µm durch. Indes nimmt die Erhebung9 einen Druck von etwa 1 MPa oder weniger auf und macht eine Verformung von nicht mehr als 1 µm durch. Es folgt, dass die angewandte Bondinglast größtenteils durch die Erhebung8 für den Versiegelungsrahmen3 aufgenommen wird. - In dieser Ausführungsform können die Substrate durch die Kontakthöcker
4 elektrisch verbunden werden. Während des Bondens kann ein hoher Druck selektiv und lokal auf die Erhebung8 statt auf die gesamte Strukturfläche des Versiegelungsrahmens3 angewendet werden. Die Höhe der Erhebung8 ist das 0,4- bis 0,7-fache des Abstands zwischen dem Substrat1 und dem Gegensubstrat5 nach dem Bonden. Folglich kann die Metallpaste des Versiegelungsrahmens3 direkt unter der Erhebung8 in ein massives Metall transformiert werden, so dass die Versiegelungseigenschaften verbessert werden können. - Der durch die Erhebungen
8 und9 gelieferte Ankereffekt ermöglicht, dass das Gegensubstrat5 und die Kontakthöcker4 und der Versiegelungsrahmen3 mit einer vorteilhaften Haftung aneinander gebondet werden. Die feste Bindung zwischen den Kontakthöckern4 und dem Gegensubstrat5 bedeutet eine höhere Widerstandsfähigkeit gegen Kontaktdefekte in elektrischen Bindungen, die sich aus einer Substratverformung und dergleichen aufgrund der Vorrichtungsoperationen oder der äußeren Atmosphäre ergeben. - Da es die Erhebung
8 ist, wodurch die Versiegelung während des Bondens geschaffen wird, werden die Versiegelungseigenschaften besser, falls die Erhebung8 breiter ist; aber eine zu große Breite würde zu einer ungenügenden Lastbeaufschlagung während des Bondens führen. Die Erhebung8 muss unter Berücksichtigung dieses Kompromisses ausgelegt werden und kann beispielsweise eine Breite von etwa 5 µm bis 10 µm aufweisen. -
8 ist eine Querschnittsansicht, die ein Variationsbeispiel1 der hohlen versiegelten Vorrichtung gemäß der Ausführungsform1 der vorliegenden Erfindung veranschaulicht.9 ist eine entlang I-II von8 genommene Querschnittsansicht.10 ist eine Querschnittsansicht, die ein Variationsbeispiel2 der hohlen versiegelten Vorrichtung gemäß der Ausführungsform1 der vorliegenden Erfindung veranschaulicht. Während die Kontakthöcker4 in1 innerhalb des Versiegelungsrahmens3 gelegen sind, können die Kontakthöcker4 wie in8 bis10 gezeigt außerhalb des Versiegelungsrahmens3 positioniert sein. Wie in10 veranschaulicht ist, können der Versiegelungsrahmen3 und die Kontakthöcker4 in beliebiger Zahl pro Chip und in jeder beliebigen Anordnung vorgesehen werden. -
11 bis13 sind Draufsichten, die Variationsbeispiele der Erhebung für den Versiegelungsrahmen der hohlen versiegelten Vorrichtung gemäß der Ausführungsform1 der vorliegenden Erfindung veranschaulichen. Es gibt keine Beschränkungen der Erhebung8 für den Versiegelungsrahmen3 , außer dass sie eine ringartige geschlossene Schleife ist. Folglich kann die Erhebung in einer mäandernden Linie wie in11 gezeigt oder in Doppellinien wie in12 gezeigt oder in einer Struktur unterteilter Doppelringe wie in13 gezeigt gebildet werden. All dies ermöglicht, dass eine bessere Luftdichtigkeit erzielt wird. Die Form der Erhebung8 für den Versiegelungsrahmen3 ist auch nicht beschränkt, d.h. die Erhebung kann zylindrisch oder eine viereckige Säule sein. -
14 ist eine Querschnittsansicht, die ein Variationsbeispiel3 der hohlen versiegelten Vorrichtung gemäß der Ausführungsform1 der vorliegenden Erfindung veranschaulicht. Auf dem Substrat1 ist ein Metallfilm10 ausgebildet, und der Versiegelungsrahmen3 und die Kontakthöcker4 werden auf diesem Metallfilm10 durch Strukturieren einer Metallpaste gebildet. Dies hat eine vorteilhafte Haftung zwischen der Metallpaste und dem Substrat1 zur Folge. -
15 ist eine Querschnittsansicht, die ein Variationsbeispiel4 der hohlen versiegelten Vorrichtung gemäß der Ausführungsform1 der vorliegenden Erfindung veranschaulicht.16 ist eine Querschnittsansicht, die eine hohle versiegelte Vorrichtung gemäß einem Vergleichsbeispiel veranschaulicht. Eine unzureichende Verformung der Metallpastenstruktur des Versiegelungsrahmens3 und der Kontakthöcker4 während des Bondens hat eine schlechte Haftung zwischen dem Versiegelungsrahmen3 und den Kontakthöckern4 und dem Gegensubstrat5 zur Folge, wie in16 gezeigt ist, in welchem Fall die Kontakthöcker4 nicht mit den Durchgangslöchern6 verbunden werden können. Daher werden ein Metallfilm11 , der die Erhebung8 bedeckt, und der Metallfilm12 , der die Erhebungen9 bedeckt, auf der unteren Oberfläche des Gegensubstrats5 gebildet, wie in15 gezeigt ist. Die Erhebungen8 und9 werden über die Metallfilme11 und12 an den Versiegelungsrahmen3 bzw. die Kontakthöcker4 gebondet. Auf diese Weise wird die Haftung zwischen dem Versiegelungsrahmen3 und den Kontakthöckern4 und dem Gegensubstrat5 , wenn sie aneinander gebondet sind, vorteilhaft ausgebildet. Da der Metallfilm12 mit den Durchgangslöchern6 elektrisch verbunden ist, können die Kontakthöcker4 über den Metallfilm12 zuverlässig an die Durchgangslöcher6 elektrisch gebondet werden. - Eine äußerste Schicht der Metallfilme
10 bis12 , die einen Kontakt mit der Metallpaste herstellt, besteht aus dem gleichen Material wie die Metallpaste oder einem seltenen Metall, das gegen Oberflächenoxidation beständig ist, während ein Material, das eine hohe Haftung mit der Basis des Substrats1 und anderen zeigt, als die unterste Schicht verwendet wird. Wenn beispielsweise das Substrat1 und das Gegensubstrat5 aus Si bestehen, können die Metallfilme10 bis12 ein 50 nm dicker Ti-Film und ein 200 nm dicker Au-Film sein, die übereinander kontinuierlich ausgebildet sind. Strukturierungsverfahren, die für die Metallfilme10 bis12 anwendbar sind, beinhalten Lift-off-Prozesse einer Gasphasenabscheidung mit Resiststrukturierung und Ätzprozessen, wobei einem Metallsputtern ein Resiststrukturieren und -fräsen folgen, um unnötige Teile zu entfernen. - Als eine Option können das Substrat
1 und das Gegensubstrat5 als Wafer so vorbereitet werden, dass mehrere Vorrichtungen gemeinsam gebondet werden. Bondingbedingungen, wenn eine Au-Metallpaste verwendet wird, umfassen beispielsweise eine Temperatur von 300°C und einen Druck von 100 MPa. Je höher die Temperatur und der Druck sind, desto besser sind die Bondingeigenschaften. Es wird ein Metallpastenmaterial verwendet, das aus Nanopartikeln oder Submikrometerpartikeln aus Au, Ag, Cu, Pd oder Pt besteht, die in einem Lösungsmittel aufgelöst sind. Au, Ag, Cu, Pd und Pt haben eine gute elektrische Leitfähigkeit, so dass die Kontakthöcker4 eine gute elektrische Leitfähigkeit aufweisen können. Au, Pd und Pt haben insbesondere eine geringe Reaktivität und sind gegen eine Modifikation wie etwa eine Oberflächenoxidation beständig, so dass sie sich in vorteilhafter Weise in eine massive Struktur wandeln, wenn gebondet wird, was bedeutet, dass sie vorteilhafte Eigenschaften als ein Material zum Vorsehen einer luftdichten Versiegelung aufweisen. Um eine vorteilhafte Haftung mit der Bondinggrenzfläche zu erzielen, ist es vorzuziehen, vor einem Bonden das Metall einem Prozess mit einem Ar-Plasma oder einem O2-Plasma zu unterziehen. - Ausführungsform 2
-
17 ist eine Querschnittsansicht, die eine hohle versiegelte Vorrichtung gemäß einer Ausführungsform2 der vorliegenden Erfindung veranschaulicht. Im Gegensatz zur Ausführungsform1 sind die an die Kontakthöcker4 zu bondenden Erhebungen9 nicht vorgesehen. Daher kann eine noch höhere Last auf die Erhebung8 angewendet werden, die an den Versiegelungsrahmen3 gebondet wird, so dass die Versiegelungseigenschaften noch mehr verbessert werden können. Während die Erhebungen9 in der Ausführungsform1 so angeordnet werden müssen, dass sie die Durchgangslöcher6 nicht überlappen, erfordert diese Ausführungsform keine derartige Beachtung im Layout. Der Freiheitsgrad des Layouts wird somit erhöht, wodurch eine Vergrößerung der für das Layout erforderlichen Fläche verhindert werden kann. -
18 ist eine Querschnittsansicht, die ein Variationsbeispiel der hohlen versiegelten Vorrichtung gemäß der Ausführungsform2 der vorliegenden Erfindung veranschaulicht. Ein Metallfilm11 , der die Erhebung8 bedeckt, und ein Metallfilm12 , der mit den Durchgangslöchern6 des Gegensubstrats5 elektrisch verbunden ist, sind auf der unteren Oberfläche des Gegensubstrats5 ausgebildet. Die Erhebung8 ist über den Metallfilm11 an den Versiegelungsrahmen3 gebondet, und die Kontakthöcker4 sind über dem Metallfilm12 an die Durchgangslöcher6 elektrisch gebondet. Dies ermöglicht, dass eine vorteilhafte Haftung zwischen der Metallpastenstruktur und dem Gegensubstrat5 erzielt wird, wenn gebondet wird, und ermöglicht, dass die Kontakthöcker4 zuverlässig an die Durchgangslöcher6 elektrisch gebondet werden. - Ausführungsform 3
-
19 ist eine Querschnittsansicht, die eine hohle versiegelte Vorrichtung gemäß einer Ausführungsform3 der vorliegenden Erfindung veranschaulicht. In dieser Ausführungsform sind die Erhebungen8 und9 auf dem Substrat1 ausgebildet. In diesem Fall kann ähnlich der Ausführungsform1 auch ein hoher Druck selektiv und lokal auf die Erhebungen8 und9 angewendet werden, so dass die Versiegelungseigenschaften verbessert werden können. Der anzuwendende Druck wird ähnlich der Ausführungsform1 ebenfalls in Bezug auf den Betrag, um den die Metallpastenstruktur nach unten gedrückt wird, bestimmt. - Bezugszeichenliste
- 1 Substrat; 3 Versiegelungsrahmen; 4 Kontakthöcker; 5 Gegensubstrat; 6 Durchgangsloch; 8, 9 Erhebung; 11, 12 Metallfilm
- ZITATE ENTHALTEN IN DER BESCHREIBUNG
- Diese Liste der vom Anmelder aufgeführten Dokumente wurde automatisiert erzeugt und ist ausschließlich zur besseren Information des Lesers aufgenommen. Die Liste ist nicht Bestandteil der deutschen Patent- bzw. Gebrauchsmusteranmeldung. Das DPMA übernimmt keinerlei Haftung für etwaige Fehler oder Auslassungen.
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Claims (11)
- Verfahren zum Herstellen einer hohlen versiegelten Vorrichtung, umfassend: ein gleichzeitiges Ausbilden eines ringartigen Versiegelungsrahmens und eines Kontakthöckers auf einer Hauptoberfläche eines ersten Substrats, indem eine Metallpaste strukturiert wird; ein Ausbilden einer ringartigen Erhebung mit einer kleineren Breite als eine Breite des Versiegelungsrahmens auf einer Hauptoberfläche eines zweiten Substrats; und ein Ausrichten der Hauptoberfläche des ersten Substrats und der Hauptoberfläche des zweiten Substrats, so dass sie einander zugewandt sind, ein Bonden des Versiegelungsrahmens an die Erhebung und ein elektrisches Bonden des Kontakthöckers an das zweite Substrat, wobei eine Höhe der Erhebung das 0,4- bzw. 0,7-fache eines Abstands zwischen dem ersten Substrat und dem zweiten Substrat nach einem Bonden ist.
- Verfahren zum Herstellen einer hohlen versiegelten Vorrichtung nach
Anspruch 1 , ferner umfassend ein Ausbilden eines ersten Metallfilms, der die Erhebung bedeckt, und eines zweiten Metallfilms, der mit einem Durchgangsloch des zweiten Substrats elektrisch verbunden ist, auf der Hauptoberfläche des zweiten Substrats; ein Bonden der Erhebung an den Versiegelungsrahmen über den ersten Metallfilm; und ein elektrisches Bonden des Kontakthöckers an das Durchgangsloch über den zweiten Metallfilm. - Verfahren zum Herstellen einer hohlen versiegelten Vorrichtung, umfassend: ein gleichzeitiges Ausbilden eines ringartigen Versiegelungsrahmens und eines Kontakthöckers auf einer Hauptoberfläche eines ersten Substrats, indem eine Metallpaste strukturiert wird; ein Ausbilden einer ringartigen ersten Erhebung mit einer kleineren Breite als eine Breite des Versiegelungsrahmens und einer zweiten Erhebung mit einer kleineren Breite als eine Breite des Kontakthöckers auf einer Hauptoberfläche eines zweiten Substrats; und ein Ausrichten der Hauptoberfläche des ersten Substrats und der Hauptoberfläche des zweiten Substrats, so dass sie einander zugewandt sind, ein Bonden des Versiegelungsrahmens an die erste Erhebung, ein Bonden des Kontakthöckers an die zweite Erhebung und ein elektrisches Bonden des Kontakthöckers an das zweite Substrat.
- Verfahren zum Herstellen einer hohlen versiegelten Vorrichtung nach
Anspruch 3 , wobei eine Höhe der ersten Erhebung das 0,4- bis 0,7-fache eines Abstands zwischen dem ersten Substrat und dem zweiten Substrat nach einem Bonden ist. - Verfahren zum Herstellen einer hohlen versiegelten Vorrichtung nach
Anspruch 3 oder4 , wobei die zweite Erhebung in dem Kontakthöcker vollständig eingebettet ist. - Verfahren zum Herstellen einer hohlen versiegelten Vorrichtung nach einem der
Ansprüche 3 bis5 , ferner umfassend ein Ausbilden eines ersten Metallfilms, der die erste Erhebung bedeckt, und eines zweiten Metallfilms, der die zweite Erhebung bedeckt, auf der Hauptoberfläche des zweiten Substrats; ein Bonden der ersten Erhebung an den Versiegelungsrahmen über den ersten Metallfilm; und ein Bonden der zweiten Erhebung an den Kontakthöcker über den zweiten Metallfilm. - Verfahren zum Herstellen einer hohlen versiegelten Vorrichtung nach
Anspruch 6 , ferner umfassend ein elektrisches Bonden des zweiten Metallfilms an ein Durchgangsloch des zweiten Substrats. - Verfahren zum Herstellen einer hohlen versiegelten Vorrichtung nach einem der
Ansprüche 1 bis7 , ferner umfassend: ein Ausbilden eines Metallfilms auf der Hauptoberfläche eines ersten Substrats; und ein Ausbilden des Versiegelungsrahmens und des Kontakthöckers auf dem Metallfilm. - Hohle versiegelte Vorrichtung, umfassend: ein erstes Substrat; einen ringartigen Versiegelungsrahmen, der auf einer Hauptoberfläche eines ersten Substrats vorgesehen ist; einen Kontakthöcker, der auf der Hauptoberfläche des ersten Substrats vorgesehen ist; ein zweites Substrat, das eine der Hauptoberfläche eines ersten Substrats gegenüberliegende Hauptoberfläche aufweist; und eine ringartige Erhebung, die auf der Hauptoberfläche des zweiten Substrats vorgesehen ist und eine kleinere Breite als eine Breite des Versiegelungsrahmens aufweist, wobei der Versiegelungsrahmen an die Erhebung gebondet ist, der Kontakthöcker elektrisch an das zweite Substrat gebondet ist; und eine Höhe der Erhebung das 0,4- bis 0,7-fache eines Abstands zwischen dem ersten Substrat und dem zweiten Substrat ist.
- Hohle versiegelte Vorrichtung, umfassend: ein erstes Substrat; einen ringartigen Versiegelungsrahmen, der auf einer Hauptoberfläche eines ersten Substrats vorgesehen ist; einen Kontakthöcker, der auf der Hauptoberfläche des ersten Substrats vorgesehen ist; ein zweites Substrat, das eine der Hauptoberfläche eines ersten Substrats gegenüberliegende Hauptoberfläche aufweist; eine erste ringartige Erhebung, die auf der Hauptoberfläche des zweiten Substrats vorgesehen ist und eine kleinere Breite als eine Breite des Versiegelungsrahmens aufweist; und eine zweite Erhebung, die auf der Hauptoberfläche des zweiten Substrats vorgesehen ist und eine kleinere Breite als eine Breite des Kontakthöckers aufweist, wobei der Versiegelungsrahmen an die erste Erhebung gebondet ist, der Kontakthöcker an die zweite Erhebung gebondet ist; und der Kontakthöcker an das zweite Substrat elektrisch gebondet ist.
- Hohle versiegelte Vorrichtung nach
Anspruch 10 , wobei eine Höhe der ersten Erhebung das 0,4- bis 0,7-fache eines Abstands zwischen dem ersten Substrat und dem zweiten Substrat ist.
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
PCT/JP2017/012965 WO2018179153A1 (ja) | 2017-03-29 | 2017-03-29 | 中空封止デバイス及びその製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
DE112017007356T5 true DE112017007356T5 (de) | 2019-12-12 |
Family
ID=60477083
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE112017007356.1T Withdrawn DE112017007356T5 (de) | 2017-03-29 | 2017-03-29 | Hohle versiegelte Vorrichtung und Herstellungsverfahren dafür |
Country Status (7)
Country | Link |
---|---|
US (1) | US10950567B2 (de) |
JP (1) | JP6237969B1 (de) |
KR (1) | KR102336096B1 (de) |
CN (1) | CN110494963B (de) |
DE (1) | DE112017007356T5 (de) |
TW (1) | TWI666710B (de) |
WO (1) | WO2018179153A1 (de) |
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KR102336096B1 (ko) | 2021-12-06 |
CN110494963B (zh) | 2023-06-13 |
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