CN210142481U - 像素结构、显示面板及显示装置 - Google Patents
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Abstract
本实用新型涉及一种像素结构、显示面板及显示装置。像素结构包括多个像素组,多个像素组呈阵列式排布形成阵列结构,每个像素组均包括第一子像素、第二子像素及第三子像素;第一子像素、第二子像素及第三子像素的中心连线形成第一虚拟等腰直角三角形;在沿阵列式结构的行方向排布的相邻两个像素组中,其中一个像素组中的第二子像素和第三子像素、及另一个像素组中的第一子像素的中心连线形成第二虚拟等腰直角三角形;在沿阵列式结构的列方向排布的相邻两个像素组中,其中一个像素组中的第一子像素和第二子像素、及另一个像素组中的第三子像素的中心连线形成第三虚拟等腰直角三角形。
Description
技术领域
本实用新型涉及显示元件技术领域,特别是涉及一种像素结构、显示面板及显示装置。
背景技术
目前,市面上的COB(chip on board,板上芯片封装)显示面板的像素点之间的点间距一般是2mm,为提高显示面板的分辨率,需要缩小像素点之间的间距,从而需要增加像素点的用量,导致成本增加。
实用新型内容
基于此,有必要提供一种高分辨率的像素结构、显示面板及显示装置。
其技术方案如下:
一种像素结构,包括多个像素组,所述多个像素组呈阵列式排布形成阵列结构,每个所述像素组均包括第一子像素、第二子像素及第三子像素,且所述第一子像素、所述第二子像素及所述第三子像素的数量比为1∶1∶1;在每一个所述像素组中,所述第一子像素与所述第二子像素沿第一方向排布,所述第二子像素与所述第三子像素沿第二方向排布,所述第一子像素、所述第二子像素及所述第三子像素的中心连线形成第一虚拟等腰直角三角形;其中,在所述阵列式结构的同一行中的相邻两个所述像素组中,其中一个所述像素组中的所述第二子像素和所述第三子像素、及另一个所述像素组中的所述第一子像素的中心连线形成第二虚拟等腰直角三角形;在所述阵列式结构的同一列中的相邻两个所述像素组中,其中一个所述像素组中的所述第一子像素和所述第二子像素、及另一个所述像素组中的所述第三子像素的中心连线形成第三虚拟等腰直角三角形。
上述的像素结构利用了“虚拟像素”技术(即利用人眼的视觉暂留现象,对实像素进行分时复用,复现更多虚像素的技术),上述的像素结构应用到显示面板后,在同等的子像素的数量下,上述显示面板的分辨率是实像素显示面板的4倍,显示面板的分辨率能够得到提升,从而降低显示面板的造价。
下面进一步对技术方案进行说明:
在其中一个实施例中,所述阵列式结构的同一行中的所有的所述像素组均匀间隔设置,所述阵列式结构的同一列中的所有的所述像素组均匀间隔设置。
在其中一个实施例中,所述阵列式结构的同一行中的所有的所述像素组中的所述第一子像素及所述第二子像素处于同一直线,同一行中的所有的所述像素组中的所述第三子像素处于同一直线;所述阵列式结构的同一列中的所有的所述像素组中的所述第二子像素及所述第三子像素处于同一直线,同一列中的所有的所述像素组中的所述第一子像素处于同一直线。
在其中一个实施例中,所述阵列式结构的同一行中的所有的所述第一虚拟等腰直角三角形的外心连线在同一直线;所述阵列式结构的同一列中的所有的所述第一虚拟等腰直角三角形的外心连线在同一直线。
在其中一个实施例中,在所述阵列式结构的同一行中的所有的所述第一虚拟等腰直角三角形中,每相邻两个所述第一虚拟等腰直角三角形的外心连线的长度均一致;在所述阵列式结构的同一列中的所有的所述第一虚拟等腰直角三角形中,每相邻两个所述第一虚拟等腰直角三角形的外心连线的长度均一致。
在其中一个实施例中,在所述阵列式结构的同一行中的所有的所述第一虚拟等腰直角三角形中,每相邻两个所述第一虚拟等腰直角三角形的外心连线的长度等于所述第一虚拟等腰直角三角形的直角边长的两倍;在所述阵列式结构的同一列中的所有的所述第一虚拟等腰直角三角形中,每相邻两个所述第一虚拟等腰直角三角形的外心连线的长度等于所述第一虚拟等腰直角三角形的直角边长的两倍。
在其中一个实施例中,每个所述像素组中的所述第一子像素、所述第二子像素及所述第三子像素均为一个。
在其中一个实施例中,述第一子像素、所述第二子像素及所述第三子像素均为红色发光芯片、蓝色发光芯片或绿色发光芯片中的一种,且所述第一子像素、所述第二子像素及所述第三子像素的的发光颜色各不相同。
本技术方案还提供了一种显示面板,包括如上所述的像素结构。
上述的像素结构利用了“虚拟像素”技术(即利用人眼的视觉暂留现象,对实像素进行分时复用,复现更多虚像素的技术),上述的像素结构应用到显示面板后,在同等的子像素的数量下,上述显示面板的分辨率是实像素显示面板的4倍,显示面板的分辨率能够得到提升,从而降低显示面板的造价。
本技术方案还提供了一种显示装置,包括如上所述的显示面板。
上述的像素结构利用了“虚拟像素”技术(即利用人眼的视觉暂留现象,对实像素进行分时复用,复现更多虚像素的技术),上述的像素结构应用到显示面板后,在同等的子像素的数量下,上述显示面板的分辨率是实像素显示面板的4倍,显示面板的分辨率能够得到提升,从而降低显示面板的造价。
附图说明
图1为本实用新型一实施例中的像素结构的结构示意图;
图2为本实用新型一实施例中的像素组的固焊结构示意图。
附图标记说明:
10、像素结构,100、像素组,110、第一子像素,120、第二子像素,130、第三子像素,200、第一虚拟等腰直角三角形,201、第一像素点,210、第二虚拟等腰直角三角形,211、第二像素点,220、第三虚拟等腰直角三角形,221、第三像素点,230、第四虚拟等腰直角三角形,231、第四像素点,300、公共极,310、第一焊线区,320、第二焊线区,330、第三焊线区,340、第一键合线,350、第二键合线,360、第三键合线。
具体实施方式
为使本实用新型的目的、技术方案及优点更加清楚明白,以下结合附图及具体实施方式,对本实用新型进行进一步的详细说明。应当理解的是,此处所描述的具体实施方式仅用以解释本实用新型,并不限定本实用新型的保护范围。
需要说明的是,当元件被称为“固定于”另一个元件,它可以直接在另一个元件上或者也可以存在居中的元件。当一个元件被认为是“连接”另一个元件,它可以是直接连接到另一个元件或者可能同时存在居中元件。本文所使用的术语“垂直的”、“水平的”、“左”、“右”以及类似的表述只是为了说明的目的,并不表示是唯一的实施方式。
除非另有定义,本文所使用的所有的技术和科学术语与属于本实用新型的技术领域的技术人员通常理解的含义相同。本文中在本实用新型的说明书中所使用的术语只是为了描述具体的实施方式的目的,不是旨在于限制本实用新型。本文所使用的术语“及/或”包括一个或多个相关的所列项目的任意的和所有的组合。
本实用新型中所述“第一”、“第二”不代表具体的数量及顺序,仅仅是用于名称的区分。
如图1所示,一实施例涉及的一种像素结构10,包括多个像素组100,多个像素组100呈阵列式排布,每个像素组100均包括第一子像素110、第二子像素120及第三子像素130,且第一子像素110、第二子像素120及第三子像素130的数量比为1∶1∶1。具体地,在每个像素组100中,第一子像素110、第二子像素120及第三子像素130均为1个,且第一子像素110、第二子像素120及第三子像素130均为红色发光芯片、蓝色发光芯片或绿色发光芯片中的一种,且第一子像素110、第二子像素120及第三子像素130的发光颜色各不相同。当然,第一子像素110、第二子像素120或第三子像素130的发光颜色还可以为红色、蓝色和绿色之外的其他颜色。
在每一个像素组100中,第一子像素110与第二子像素120沿第一方向排布,第二子像素120与第三子像素130沿第二方向排布,第一子像素110、第二子像素120及第三子像素130的中心连线形成第一虚拟等腰直角三角形200。具体地,第一子像素110、第二子像素120及第三子像素130的中心分别为第一虚拟等腰直角三角形200的三个顶点。
其中,在阵列式结构的同一行中的相邻两个像素组100中,其中一个像素组100中的第二子像素120和第三子像素130、及另一个像素组100中的第一子像素110的中心连线形成第二虚拟等腰直角三角形210;在阵列式结构的同一列中的相邻两个像素组100中,其中一个像素组100中的第一子像素110和第二子像素120、及另一个像素组100中的第三子像素130的中心连线形成第三虚拟等腰直角三角形220。自然地,其中一个像素组100的第二子像素120、与该像素组100沿阵列式结构的行方向相邻的一个像素组100的第一子像素110、及与该像素组100沿阵列式结构的列方向相邻的一个像素组100的第三子像素130的中心连线形成第四虚拟等腰直角三角形230。
具体地,以图1所示的像素结构10为例:位于第一行第一列的像素组100中的第一子像素110、第二子像素120及第三子像素130的中心连线形成第一虚拟等腰直角三角形200;位于第一行第一列的像素组100中的第二子像素120和第三子像素130、及位于第一行第二列的像素组100中的第一子像素110的中心连线形成第二虚拟等腰直角三角形210;位于第一行第一列的像素组100中的第一子像素110和第二子像素120、及位于第二行第一列的像素组100中的第三子像素130的中心连线形成第三虚拟等腰直角三角形220;位于第一行第一列的像素组100中的第二子像素120、位于第一行第二列的像素组100中的第一子像素110、及位于第二行第一列的像素组100中的第三子像素130的中心连线形成第四虚拟等腰直角三角形230。
上述的像素结构利用了“虚拟像素”技术(即利用人眼的视觉暂留现象,对实像素进行分时复用,复现更多虚像素的技术),在上述的像素结构10中,第一虚拟等腰直角三角形200的外心会形成一个第一像素点201;第二虚拟等腰直角三角形210的外心会形成一个第二像素点211;第三虚拟等腰直角三角形220的外心会形成一个第三像素点221;第四虚拟等腰直角三角形230的外心会形成一个第四像素点231。如此,上述的像素结构10应用到显示面板后,该显示面板与实像素显示面板在拥有相等数量的子像素的前提下,显示面板的分辨率能够得到提升,从而降低显示面板的造价。
在其中一个实施例中,多个像素组100呈阵列式排布形成阵列结构,阵列式结构的同一行中的所有的像素组100均匀间隔设置,阵列式结构的同一列中的所有的像素组100均匀间隔设置。如此,整个像素结构10中的所有像素组100排列均匀,能够保证发光的均匀性。
具体地,以上所述的第一方向与阵列式结构的行方向一致,第二方向与阵列式结构的列方向一致,阵列式结构的同一行中的所有的像素组100中的第一子像素110及第二子像素120处于同一直线,同一行中的所有的像素组100中的第三子像素130处于同一直线;阵列式结构的同一列中的所有的像素组100中的第二子像素120及第三子像素130处于同一直线,同一列中的所有的像素组100中的第一子像素110处于同一直线。阵列式结构的同一行中的所有的第一虚拟等腰直角三角形200的外心连线在同一直线;阵列式结构的同一列中的所有的第一虚拟等腰直角三角形200的外心连线在同一直线。如此,所有能够在像素结构10上形成的第一像素点201呈阵列式排布,且在像素结构10上处于同一行的第一像素点201在同一直线上,处于同一列的第一像素点201在同一直线上,第一像素点201分布均匀,能够保证发光的均匀性。
进一步地,在阵列式结构的同一行中的所有的第一虚拟等腰直角三角形200中,每相邻两个第一虚拟等腰直角三角形200的外心连线的长度均一致;在阵列式结构的同一列中的所有的第一虚拟等腰直角三角形200中,每相邻两个第一虚拟等腰直角三角形200的外心连线的长度均一致。如此,在像素结构10上处于同一行的所有第一像素点201中,相邻的两个第一像素点201之间的距离一致,在像素结构10上处于同一列的所有第一像素点201中,相邻两个第一像素点201之间的距离一致,能够保证第一像素点201分布的均匀性,从而保证发光的均匀性。
更进一步地,在阵列式结构的同一行中的所有的第一虚拟等腰直角三角形200中,每相邻两个第一虚拟等腰直角三角形200的外心连线的长度等于第一虚拟等腰直角三角形200的直角边长的两倍。因此在同一行的相邻两个像素组100中,左侧的像素组100中的第二子像素120与第三子像素130与右侧的像素组100中的第一子像素110的中心连线能配合形成第二虚拟等腰直角三角形210,且该第二虚拟等腰直角三角形210的外心处能够形成第二像素点211。在阵列式结构的同一列中的所有的第一虚拟等腰直角三角形200中,每相邻两个第一虚拟等腰直角三角形200的外心连线的长度等于第一虚拟等腰直角三角形的直角边长的两倍。因此,在同一列的相邻两个像素组100中,上侧的像素组100中的第一子像素110与第二子像素120与下侧的像素组100中的第三子像素130的中心连线能配合形成第三虚拟等腰直角三角形220,且该第三虚拟等腰直角三角形220的外心处能够形成第三像素点221。
一实施例还涉及一种显示面板,包括如上所述的像素结构10。
上述的像素结构利用了“虚拟像素”技术(即利用人眼的视觉暂留现象,对实像素进行分时复用,复现更多虚像素的技术),在上述的像素结构10中,第一虚拟等腰直角三角形200的外心会形成一个第一像素点201;第二虚拟等腰直角三角形210的外心会形成一个第二像素点211;第三虚拟等腰直角三角形220的外心会形成一个第三像素点221;第四虚拟等腰直角三角形230的外心会形成一个第四像素点231。如此,上述的像素结构10应用到显示面板后,该显示面板与实像素显示面板在拥有相等数量的子像素的前提下,显示面板的分辨率能够得到提升,从而降低显示面板的造价。
可选地,显示面板可以为OLED(Organic Light-Emitting Diode,有机发光二极管)显示面板、COB显示面板、LED(Light Emitting Diode,发光二极管)显示面板等。
具体地,显示面板为COB显示面板,第一子像素110、第二子像素120及第三子像素130可以是正装结构的发光芯片,也可以是倒装结构的发光芯片。
如图2所示,更具体地,在一个像素组100中,第一子像素110、第二子像素120及第三子像素130为正装结构,第一子像素110、第二子像素120及第三子像素130通过固晶胶固定于公共极300,第一焊线区310、第二焊线区320、及第三焊线330区均与公共极300间隔设置,第一子像素110与第一焊线区310通过第一键合线340电性连接,第二子像素120与第二焊线区320通过第二键合线350电性连接,第三子像素130与第三焊线区330通过第三键合线360电性连接。如此,焊线区的位置与固晶胶的位置相间隔,有利于保证焊线质量。
基于与上述像素结构10及显示面板同样的发明构思,一实施例还涉及一种显示装置,包括如上所述的显示面板。
可选地,上述显示装置可以为显示屏、手机、平板、掌上电脑、智能手表等数码设备。
以上所述实施例的各技术特征可以进行任意的组合,为使描述简洁,未对上述实施例中的各个技术特征所有可能的组合都进行描述,然而,只要这些技术特征的组合不存在矛盾,都应当认为是本说明书记载的范围。
以上所述实施例仅表达了本实用新型的几种实施方式,其描述较为具体和详细,但并不能因此而理解为对实用新型专利范围的限制。应当指出的是,对于本领域的普通技术人员来说,在不脱离本实用新型构思的前提下,还可以做出若干变形和改进,这些都属于本实用新型的保护范围。因此,本实用新型专利的保护范围应以所附权利要求为准。
Claims (10)
1.一种像素结构,其特征在于,包括多个像素组,所述多个像素组呈阵列式排布形成阵列结构,每个所述像素组均包括第一子像素、第二子像素及第三子像素,且所述第一子像素、所述第二子像素及所述第三子像素的数量比为1∶1∶1;
在每一个所述像素组中,所述第一子像素与所述第二子像素沿第一方向排布,所述第二子像素与所述第三子像素沿第二方向排布,所述第一子像素、所述第二子像素及所述第三子像素的中心连线形成第一虚拟等腰直角三角形;
其中,在所述阵列式结构的同一行中的相邻两个所述像素组中,其中一个所述像素组中的所述第二子像素和所述第三子像素、及另一个所述像素组中的所述第一子像素的中心连线形成第二虚拟等腰直角三角形;在所述阵列式结构的同一列中的相邻两个所述像素组中,其中一个所述像素组中的所述第一子像素和所述第二子像素、及另一个所述像素组中的所述第三子像素的中心连线形成第三虚拟等腰直角三角形。
2.根据权利要求1所述的像素结构,其特征在于,所述阵列式结构的同一行中的所有的所述像素组均匀间隔设置,所述阵列式结构的同一列中的所有的所述像素组均匀间隔设置。
3.根据权利要求2所述的像素结构,其特征在于,所述阵列式结构的同一行中的所有的所述像素组中的所述第一子像素及所述第二子像素处于同一直线,同一行中的所有的所述像素组中的所述第三子像素处于同一直线;所述阵列式结构的同一列中的所有的所述像素组中的所述第二子像素及所述第三子像素处于同一直线,同一列中的所有的所述像素组中的所述第一子像素处于同一直线。
4.根据权利要求1所述的像素结构,其特征在于,所述阵列式结构的同一行中的所有的所述第一虚拟等腰直角三角形的外心连线在同一直线;所述阵列式结构的同一列中的所有的所述第一虚拟等腰直角三角形的外心连线在同一直线。
5.根据权利要求4所述的像素结构,其特征在于,在所述阵列式结构的同一行中的所有的所述第一虚拟等腰直角三角形中,每相邻两个所述第一虚拟等腰直角三角形的外心连线的长度均一致;在所述阵列式结构的同一列中的所有的所述第一虚拟等腰直角三角形中,每相邻两个所述第一虚拟等腰直角三角形的外心连线的长度均一致。
6.根据权利要求5所述的像素结构,其特征在于,在所述阵列式结构的同一行中的所有的所述第一虚拟等腰直角三角形中,每相邻两个所述第一虚拟等腰直角三角形的外心连线的长度等于所述第一虚拟等腰直角三角形的直角边长的两倍;在所述阵列式结构的同一列中的所有的所述第一虚拟等腰直角三角形中,每相邻两个所述第一虚拟等腰直角三角形的外心连线的长度等于所述第一虚拟等腰直角三角形的直角边长的两倍。
7.根据权利要求1-6任一项所述的像素结构,其特征在于,每个所述像素组中的所述第一子像素、所述第二子像素及所述第三子像素均为一个。
8.根据权利要求1-6任一项所述的像素结构,其特征在于,所述第一子像素、所述第二子像素及所述第三子像素均为红色发光芯片、蓝色发光芯片或绿色发光芯片中的一种,且所述第一子像素、所述第二子像素及所述第三子像素的发光颜色各不相同。
9.一种显示面板,其特征在于,包括如上权利要求1-8任一项所述的像素结构。
10.一种显示装置,其特征在于,包括如上权利要求9所述的显示面板。
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GR01 | Patent grant | ||
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