CN208444287U - 一种处理芯片的仿真器 - Google Patents
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Abstract
本实用新型公开了一种处理芯片的仿真器，其技术方案要点是包括具有第一JTAG接口和SWD接口的J‑link仿真器，SWD接口用于和外部的PC机连接，还包括转接板，所述转接板包括用于和外部***板连接的第二JTAG接口和用于和第一JTAG连接的第三JTAG接口，第二JTAG接口为10P引脚，第三JTAG接口和第一JTAG接口均为20P引脚且通过20P排线连接，所述第二JTAG接口的第一引脚和第二引脚通过2P引脚的排针连接第一电源，从而实现对其接口供电、以及调试过程中的安全和便利。
Description
技术领域
本实用新型涉及仿真器领域，特别地，涉及一种处理芯片的仿真器。
背景技术
J-link仿真器是SEGGER公司推出的支持ARM内核芯片的通用JTAG仿真器。在IAREWARM集成开发环境下用J．Link仿真器进行程序下栽，经常出现下载失败现象。对此进行研究发现其中的问题之一是由于J-link仿真器接线出现问题。
在仿真器工作下载程序时，不能在给***板供电的情况下又用J-Link仿真器对***板供电，否则可能使***板被烧。而现有的J-link仿真器却是在工作情况下默认给***板供电，如果需要使得J-link默认情况下不能进行供电，需要对J—link仿真器进行改装。
实用新型内容
有鉴于此，本实用新型目的是提供一种处理芯片的仿真器，主要是对现有的J—link仿真器进行改装，从而实现对其接口供电、以及调试过程中的安全和便利。
为了解决上述技术问题，本实用新型的技术方案是：一种处理芯片的仿真器，包括具有第一JTAG接口和SWD接口的J-link仿真器，SWD接口用于和外部的PC机连接，还包括转接板，所述转接板包括用于和外部***板连接的第二JTAG接口和用于和第一JTAG连接的第三JTAG接口，第二JTAG接口为10P引脚，第三JTAG接口和第一JTAG接口均为20P引脚且通过20P排线连接，所述第二JTAG接口的第一引脚和第二引脚通过2P引脚的排针连接第一电源，所述排针上设置有跳线帽。
优选的，所述排针上的两个引脚分别连接有电压表。
优选的，所述第二JTAG接口的第一引脚通过电容接地且连接第一电源，第三、五、七、九引脚接地，第二引脚为TMS，第四引脚为TCK引脚，第六引脚为TDO引脚，第八引脚为TDI引脚，第十引脚为RESET引脚。
优选的，所述电容的容值为100uf。
本实用新型技术效果主要体现在以下方面：可以通过控制转接板上排针的跳线帽来实现仿真器上的电源端是否和控制板上的电源端连通，从而便于测试和控制。在下载程序时，可以直接给***板进行供电，也可以通过改装后的J-link仿真器来给***板供电。若采用J-link仿真器供电，需要将J-link仿真器外壳打开，把里面的跳线帽接到第一电源上，也就是3．3V电压上，改装后VTref为3．3V，可用于给***板供电，此电压不会造成电路过载。通过设置了转接板，从而增加了仿真器的端口扩展，能够适用在20P或10P的接口通讯。
附图说明
图1为现有的J-link仿真器的输入接口和输出接口的示意图；
图2为实施例中改造后的结构***使用示意图；
图3为实施例中转接板线路结构图。
附图标记：1、第一JTAG接口；2、SWD接口；3、J-link仿真器；4、转接板；41、第二JTAG接口；42、第三JTAG接口；5、第一电源；6、排针；7、电压表；8、电容。
具体实施方式
以下结合附图，对本实用新型的具体实施方式作进一步详述，以使本实用新型技术方案更易于理解和掌握。
实施例：
一种处理芯片的仿真器，参考图1所示，包括具有第一JTAG接口1和SWD接口2的J-link仿真器3，SWD接口2用于和外部的PC机连接。对于J-link仿真器3是采用现有的并对其进行改进，而改进点在于接口上，所以未对其内部电路作具体说明。而现有的J-link仿真器3可以是JLINK V8仿真器 J-LINK ARM仿真器，淘宝等市场上可以选购，并且其采用的是现有的JTAG接口和SWD接口2，其接口的引脚设置都有说明，在此不再赘述。
本文中所提及的20P示意为20Pin的简称，意思为20个引脚，是本领域技术人员技术上通用的表述。图1示意的是市场上的仿真器接口结构。在上述基础上，进行改造完成本发明的目的。
参考图2所示，本方案的仿真器还包括转接板4，转接板4包括用于和外部***板连接的第二JTAG接口41和用于和第一JTAG连接的第三JTAG接口42。
参考图3所示，第二JTAG接口41为10P引脚，第三JTAG接口42和第一JTAG接口1均为20P引脚且通过20P排线连接，第二JTAG接口41的第一引脚和第二引脚通过2P引脚的排针6连接第一电源5，排针6上设置有跳线帽。排针6上的两个引脚分别连接有电压表7。电压表7可以便于测试两端的电压。
第二JTAG接口41的第一引脚通过电容8接地且连接第一电源5，第三、五、七、九引脚接地，第二引脚为TMS，第四引脚为TCK引脚，第六引脚为TDO引脚，第八引脚为TDI引脚，第十引脚为RESET引脚。电容8的容值为100uf。电容8能够有效去除一些杂波信号，能够使得仿真器工作更加可靠。
JTAG接口电路，其中TMS，TCK，TDO，TDl分别为JTAG接口对外的引脚2、4、6、8，这些引脚分别连接***板。在接线时，J-link仿真器3上的引脚必须和***板上JTAG接口对应，否则导致程序下载失败。***板的工作电压为3.3V。引脚3、5、7、9接地，有一些情况中引脚1和接地的引脚可能短接，导致***板无法供电，***版上电源指示灯不亮，从而导致程序下载失败。改装好J-link仿真器3后，可以通过控制转接板4排针6处的跳线帽，来决定是否采用J-link仿真器3给***板供电。
首先，将本仿真器和PC机连接，若仿真器指示灯亮，则仿真器无故障；用万用表测量转接板4上第一引脚电位，该引脚电位(已经进行了J-link供电设置)正常情况应该是3．3V左右，否则转接板4有故障。最后，检查转接板4和***板上JTAG接口之间的接线，保证转接板4上1、5、7、9、13、15引脚分别和***板上JTAG接口1、8、2、4、6、10引脚一一对应。若以上检查都正常，则本仿真器连线并没有故障，可能是驱动安装或者配置出现问题。
当然，以上只是本实用新型的典型实例，除此之外，本实用新型还可以有其它多种具体实施方式，凡采用等同替换或等效变换形成的技术方案，均落在本实用新型要求保护的范围之内。
Claims (4)
1.一种处理芯片的仿真器，包括具有第一JTAG接口和SWD接口的J-link仿真器，SWD接口用于和外部的PC机连接，其特征是，还包括转接板，所述转接板包括用于和外部***板连接的第二JTAG接口和用于和第一JTAG连接的第三JTAG接口，第二JTAG接口为10P引脚，第三JTAG接口和第一JTAG接口均为20P引脚且通过20P排线连接，所述第二JTAG接口的第一引脚和第二引脚通过2P引脚的排针连接第一电源，所述排针上设置有跳线帽。
2.如权利要求1所述的处理芯片的仿真器，其特征是，所述排针上的两个引脚分别连接有电压表。
3.如权利要求1所述的处理芯片的仿真器，其特征是，所述第二JTAG接口的第一引脚通过电容接地且连接第一电源，第三、五、七、九引脚接地，第二引脚为TMS，第四引脚为TCK引脚，第六引脚为TDO引脚，第八引脚为TDI引脚，第十引脚为RESET引脚。
4.如权利要求3所述的处理芯片的仿真器，其特征是，所述电容的容值为100uf。
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| CN201821138788.2U CN208444287U (zh) | 2018-07-18 | 2018-07-18 | 一种处理芯片的仿真器 |
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Cited By (1)
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| CN112084001A (zh) * | 2020-07-22 | 2020-12-15 | 北京杰创永恒科技有限公司 | 基于stm32芯片的仿真器 |
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2018
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Cited By (2)
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| CN112084001B (zh) * | 2020-07-22 | 2023-05-26 | 北京杰创永恒科技有限公司 | 基于stm32芯片的仿真器 |
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