CN204496890U - 显示驱动电路及显示装置 - Google Patents

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Abstract

本实用新型提供了一种显示驱动电路及显示装置，其包括时间控制器和驱动芯片，所述时间控制器包括第一产生模块和第一计时模块；其中，第一产生模块，分别与第一计时模块和驱动芯片相连，用于产生行开始信号触发第一计时模块开始计时和空闲的驱动芯片开启；第一计时模块，与驱动芯片相连，用于在其当前计时时长等于有效像素显示时长时触发在非有效像素显示时长内空闲的驱动芯片关闭。本实用新型提供的显示驱动电路，可以避免空闲的驱动芯片处于开启状态而产生功耗，从而可以满足目前对显示装置的节能性的要求，提高显示装置的品质。

Description

显示驱动电路及显示装置
技术领域
本实用新型属于液晶显示技术领域，具体涉及一种显示驱动电路及显示装置。
背景技术
Gate-driver On Array(以下简称GOA)技术是目前液晶显示领域的一种广泛使用的技术，具体是将栅极驱动芯片安装在阵列基板上，以节约栅极驱动芯片成本和降低栅极侧的显示像素区到边框的距离。但是，GOA需要电压变化的压差远远大于一般数字电压范围的驱动信号来驱动，为此，需要在时间控制器(Timing Controller，以下简称Tcon)和GOA之间连接电平转换芯片(Level Shift IC)，借助电平转换芯片将时间控制器产生的驱动GOA的驱动信号转换成所需的电压变化压差较大的GOA信号。
然而，采用上述具有电平转换芯片的显示驱动电路在实际应用中发现仍然存在以下问题：由于在每一帧图像显示的过程中，***设定的显示像素(称之为“设定像素”或者v-total)的个数比实际显示的像素(称之为“有效像素”)的个数多，设定像素显示时长为一个帧周期，有效像素显示时长少于一个帧周期，因此，在一帧图像的有效像素显示完成之后且下一帧开始之前存在一定的时间空闲(即，帧周期减去有效像素显示时长)，该时间空闲称之为非有效像素显示时长(或者，称之为Blanking时长)，由于在该Blanking时长内，显示驱动不需要对像素单元充电，但是电平转换芯片仍然出于开启状态，也就是说，电平转换闲篇仍然会产生一定功耗，从而不满足目前对显示装置的节能性的要求，造成显示装置的品质差。
因此，目前亟需一种节能性较好的显示驱动器和显示装置。
实用新型内容
本实用新型旨在至少解决现有技术中存在的技术问题之一，提出了一种显示驱动电路及显示装置，可以避免空闲的驱动芯片处于开启状态而产生功耗，从而可以满足目前对显示装置的节能性的要求，提高显示装置的品质。
为解决上述问题之一，本实用新型提供了一种显示驱动电路，其包括时间控制器和驱动芯片，所述时间控制器包括第一产生模块和第一计时模块；其中，所述第一产生模块，分别与所述第一计时模块和所述驱动芯片相连，用于产生行开始信号触发所述第一计时模块开始计时和空闲的所述驱动芯片开启；所述第一计时模块，与驱动芯片相连，用于在其当前计时时长等于有效像素显示时长时触发在非有效像素显示时长内空闲的所述驱动芯片关闭。
优选地，所述时间控制器还包括第二产生模块和第二计时模块，其中，所述第二产生模块，与所述第二计时模块相连，用于接收数据使能启动跳变信号触发所述第二计时模块开始计时，以及接收所述数据使能关闭跳变信号触发所述第二计时模块停止计时；所述第二计时模块，与所述第一计时模块相连，用于记录在所述第二产生模块触发下的当前计时时长为第一计时模块的当前有效像素显示时长。
其中，所述时间控制器还包括用于输出预设周期的时钟信号的时钟模块；所述时钟模块，分别与所述第一计时模块和所述第二计时模块相连，第一计时模块和所述第二计时模块分别用于在其计时时累积所述时钟信号的周期数作为计时时长。
其中，空闲的所述驱动芯片包括栅极驱动芯片和/或源极驱动芯片和/或电平转换芯片和/或电源管理芯片。
本实用新型还提供一种显示驱动电路，包括时间控制器和驱动芯片，所述时间控制器包括第三产生模块和第三计时模块，其中所述第三产生模块，分别与所述第三计时模块和所述驱动芯片相连，用于产生行开始跳变信号时触发所述第三计时模块开始计时和空闲的所述驱动芯片开启，以及产生行结束跳变信号触发在非有效像素显示时长内空闲的所述驱动芯片关闭；所述第三计时模块，与所述第三产生模块相连，用于在其当前计时时长等于所述有效像素显示时长时触发所述第三产生模块产生所述行结束跳变信号。
优选地，所述时间控制器还包括第四产生模块和第四计时模块，其中，所述第四产生模块，与所述第四计时模块相连，用于接收数据使能启动跳变信号触发所述第四计时模块开始计时，以及接收所述数据使能关闭跳变信号触发所述第四计时模块停止计时；第四计时模块，与所述第三计时模块相连，用于记录在所述第四产生模块触发下的当前计时时长为所述第三计时模块的当前有效像素显示时长。
其中，所述时间控制器还包括用于输出预设周期的时钟信号的时钟模块；所述时钟模块，分别与所述第三计时模块和第四计时模块相连，第三计时模块和所述第四计时模块分别用于在其计时时累积所述时钟信号的周期数作为计时时长。
其中，空闲的所述驱动芯片包括栅极驱动芯片和/或源极驱动芯片和/或电平转换芯片和/或电源管理芯片。
本实用新型还提供一种显示装置，包括显示驱动电路，所述显示驱动电路采用上述第一种显示驱动电路。
本实用新型还提供一种显示装置，包括显示驱动电路，所述显示驱动电路采用上述第二种显示驱动电路。
本实用新型具有以下有益效果：
本实用新型提供的第一种显示驱动电路，其借助第一产生模块分别与第一计时模块和驱动芯片相连，第一产生模块产生行开始信号会触发第一计时模块开始计时和触发空闲的驱动芯片开启，所谓行开始信号是指表示一帧图像开始的触发信号，所谓空闲的驱动芯片是指在非有效像素显示时长内不需要工作的驱动芯片；另外，还借助第一计时模块与驱动芯片相连，第一计时模块在其当前计时时长等于有效像素显示时长时触发在非有效像素显示时长内空闲的驱动芯片关闭。由上可知，采用该显示驱动电路不仅可以在有效像素显示时长内开启空闲的驱动芯片，以保证有效像素正常输出；而且还可以在非有效像素显示时长内关闭空闲的驱动芯片，以避免空闲的驱动芯片处于开启状态而产生功耗，从而可以满足目前对显示装置的节能性的要求，提高显示装置的品质。
本实用新型提供的第二种显示驱动电路，其借助第三产生模块分别与第三计时模块和驱动芯片相连，第三产生模块产生行开始跳变信号触发第三计时模块开始计时和空闲的驱动芯片开启，以及产生行结束跳变信号时触发在非有效像素显示时长内空闲的驱动芯片关闭，所谓行开始跳变信号是指表示一帧图像开始的跳变信号，所谓行结束跳变信号是指表示一帧图像的有效像素显示结束的跳变信号，所谓空闲的驱动芯片是指在非有效像素显示时长内不需要工作的驱动芯片；另外，借助第三计时模块与驱动芯片相连，第三计时模块在其当前计时时长等于有效像素显示时长时触发第三产生模块产生行结束跳变信号。由上可知，采用该显示驱动电路不仅可以在有效像素显示时长内开启驱动芯片，以保证有效像素正常输出；而且还可以在非有效像素显示时长内关闭空闲的驱动芯片，以避免空闲的驱动芯片处于开启状态而产生功耗，从而可以满足目前对显示装置的节能性的要求，提高显示装置的品质。
本实用新型提供第一种显示装置，其采用本实用新型提供的第一种显示驱动电路，可以避免空闲的驱动芯片处于开启状态而产生功耗，从而可以满足目前对显示装置的节能性的要求，提高显示装置的品质。
本实用新型提供第二种显示装置，其采用本实用新型提供的第二种显示驱动电路，可以避免空闲的驱动芯片处于开启状态而产生功耗，从而可以满足目前对显示装置的节能性的要求，提高显示装置的品质。
附图说明
图1为本实用新型第一实施例提供的显示驱动电路的原理框图；
图2为应用图1所示的显示驱动电路的示意图；
图3为图2的时序图；
图4为本实用新型第二实施例提供的显示驱动电路的原理框图；
图5为应用图1所示的显示驱动电路的示意图；以及
图6为图5的时序图。
具体实施方式
为使本领域的技术人员更好地理解本实用新型的技术方案，下面结合附图来对本实用新型提供的显示驱动电路及显示装置进行详细描述。
图1为本实用新型第一实施例提供的显示驱动电路的原理框图；图2为应用图1所示的显示驱动电路的示意图；图3为图2的时序图。请一并参阅图1、图2和图3，本实施例提供的显示驱动电路用于向阵列基板10上的栅极线101和数据线102对应输出扫描电压信号和数据电压信号(如图3中的Data输出信号)。具体地，显示驱动电路包括时间控制器(Tcon)和驱动芯片。其中，驱动芯片包括设置在阵列基板10上的栅极驱动芯片(Gate On Array，以下简称GOA)、设置在柔性线路板上的源极驱动芯片(Source COF)、连接在时间控制器和源极驱动芯片之间的电平转换芯片(level shift IC)和电源管理芯片(PMIC)等；电平转换芯片借助源极驱动芯片和栅极驱动芯片相连，实现将时间控制器产生的驱动GOA的驱动信号转换成所需的电压变化压差较大的GOA信号。
时间控制器包括第一产生模块和第一计时模块。其中，第一产生模块，分别与第一计时模块和驱动芯片相连，用于产生行开始信号触发第一计时模块开始计时和空闲的驱动芯片开启，所谓行开始信号是指表示一帧图像开始的触发信号，又称之为“帧开始信号”。所谓空闲的驱动芯片是指在非有效像素显示时长T2内不需要工作的驱动芯片，在本实施例中，具体地，空闲的驱动芯片包括栅极驱动芯片、源极驱动芯片、电平转换芯片和电源管理芯片，为此，第一计时模块触发栅极驱动芯片和/或源极驱动芯片和/或电平转换芯片和/或电源管理芯片开启或关闭。可以理解，第一计时模块可以根据实际显示驱动电路中各个空闲的驱动芯片的供电线路的连接关系，来实现开启或关闭所有或部分空闲的驱动芯片。例如，若电源管理芯片用于向其他所有的空闲的驱动芯片供电，则仅需要第一计时模块开启或关闭该电源管理芯片即可实现开启或关闭所有空闲的驱动芯片。
第一计时模块，与驱动芯片相连，用于在其当前计时时长等于有效像素显示时长T1时触发在非有效像素显示时长T2内空闲的驱动芯片关闭，其中，T1+T2＝T，T为帧周期。在这种情况下，称第一计时模块触发空闲的驱动芯片关闭的信号为非有效像素显示开始信号，如图3中的SBlankingStart信号。
本实用新型并不限定第一计时模块触发空闲的驱动芯片开启或关闭的方式，不仅可以采用直接触发方式，还可以通过间接触发方式，所谓间接触发方式是指通过其他器件触发。
由上可知，采用该显示驱动电路不仅可以在有效像素显示时长T1内开启空闲的驱动芯片，以保证有效像素正常输出；而且还可以在非有效像素显示时长T2内关闭空闲的驱动芯片，以避免空闲的驱动芯片处于开启状态而产生功耗，从而可以满足目前对显示装置的节能性的要求，提高显示装置的品质。
优选地，在本实施例中，显示驱动电路还包括第二产生模块和第二计时模块。其中，第二产生模块，与第二计时模块相连，用于接收数据使能启动跳变信号触发第二计时模块开始计时，接收数据使能关闭跳变信号触发第二计时模块停止计时。所谓数据使能启动跳变信号是指表示一帧图像的有效像素显示的开始信号，具体为低电平跳变为高电平的信号；所谓数据使能关闭跳变信号是指表示一帧图像的有效像素显示的关闭信号，具体为高电平跳变为低电平的信号。当然，在实际应用中，数据使能启动跳变信号还可以为高电平跳变为低电平的信号，对应地，数据使能关闭跳变信号为低电平跳变为高电平的信号。
第二计时模块，与第一计时模块相连，用于记录在第二产生模块触发下的当前计时时长为第一计时模块的当前有效像素显示时长。由于第二计时模块自接收数据使能启动跳变信号开始计时直至接收数据使能关闭跳变信号停止计时，因此，在一个帧周期中，当前有效像素显示时长自初始值逐渐累积至有效像素显示时长T1。
可以理解，第一产生模块产生的行开始信号相对第二产生模块产生的数据使能启动关闭跳变信号延迟一定时间(该时间可以为至少一个时钟周期或一个帧周期)，以便于先获知当前有效像素显示时长，再第一计时模块开始计时和判断其当前计时时长和有效像素显示时长T1是否相等。
由上可知，借助第二产生模块和第二计时模块可以自动获得有效像素显示时长T1，因此，本实施例提供的显示驱动电路可以应用在有效像素显示时长T1未知的显示装置中，从而可以提高显示驱动电路的适用性和实用性。当然，在实际应用中，还可以不需要借助第二产生模块和第二计时模块自动获得有效像素显示时长T1，而预先直接在第一计时模块内设置已知的有效像素显示时长T1。
另外，为实现第一定时模块和第二定时模块定时，本实施例提供显示驱动电路还包括用于输出预设周期的时钟信号的时钟模块。其中，时钟模块，分别与第一计时模块和第二计时模块相连，第一计时模块和第二计时模块分别用于在其计时时累积时钟信号的周期数作为计时时长。
需要说明的是，尽管在本实施例中第一计时模块用于在非有效像素显示时长T2内触发空闲的驱动芯片关闭；但是，本实用新型并不局限于此，在实际应用中，第一计时模块还可以在非有效像素显示时长T2内触发背光源模组的光源等其他不需要工作的器件关闭。
图4为本实用新型第二实施例提供的显示驱动电路的原理框图；图5为应用图1所示的显示驱动电路的示意图；图6为图5的时序图。请一并参阅图4、图5和图6，本实施例提供的显示驱动电路用于向阵列基板10上的栅极线101和数据线102对应输出扫描电压信号和数据电压信号(如图3中的Data输出信号)。具体地，显示驱动电路包括时间控制器(Tcon)和驱动芯片。其中，驱动芯片包括设置在阵列基板10上的栅极驱动芯片(Gate On Array，以下简称GOA)、设置在柔性线路板上的源极驱动芯片(Source COF)、连接在时间控制器和源极驱动芯片之间的电平转换芯片(level shift IC)和电源管理芯片(PMIC)等；电平转换芯片借助源极驱动芯片和栅极驱动芯片相连，实现将时间控制器产生的驱动GOA的驱动信号转换成所需的电压变化压差较大的GOA信号。
时间控制器包括第三产生模块和第三计时模块。其中，第三产生模块，分别与第三计时模块和驱动芯片相连，用于产生行开始跳变信号时触发第三计时模块开始计时和空闲的驱动芯片开启，以及产生行结束跳变信号触发在非有效像素显示时长T2内空闲的驱动芯片关闭。所谓行开始跳变信号是指表示一帧图像开始的跳变信号；行结束跳变信号是指表示一帧图像的有效像素显示结束的跳变信号；具体地，称第三产生模块触发驱动芯片开启或关闭的信号为“行开始结束跳变信号”，如图3所示，行开始跳变信号具体为低电平跳变为高电平的信号，行结束跳变信号具体为高电平跳变为低电平的信号。当然，在实际应用中，行开始跳变信号还可以为高电平跳变为低电平的信号，对应的，行结束跳变信号为低电平跳变为高电平的信号。
所谓空闲的驱动芯片是指在非有效像素显示时长T2内不需要工作的芯片，包括栅极驱动芯片、源极驱动芯片、电平转换芯片和电源管理芯片，为此，第三产生模块触发栅极驱动芯片和/或源极驱动芯片和/或电平转换芯片和/或电源管理芯片开启或关闭。可以理解，第一计时模块可以根据实际显示驱动电路中各个空闲的驱动芯片的供电线路的连接关系，来实现开启或关闭所有或部分空闲的驱动芯片。例如，若电源管理芯片用于向其他所有的空闲的驱动芯片供电，则仅需要第一计时模块开启或关闭该电源管理芯片即可实现开启或关闭所有空闲的驱动芯片。
第三计时模块，与第三产生模块相连，用于在其当前计时时长等于有效像素显示时长T1时触发第三产生模块产生行结束跳变信号，其中，T1+T2＝T，T为帧周期。
本实用新型并不限定第三产生模块触发空闲的驱动芯片开启或关闭的方式，不仅可以采用直接触发方式，还可以通过间接触发方式，所谓间接触发方式是指通过其他器件触发。
由上可知，采用该显示驱动电路不仅可以在有效像素显示时长T1内开启空闲的驱动芯片，以保证有效像素正常输出；而且还可以在非有效像素显示时长T2内关闭空闲的驱动芯片，以避免空闲的驱动芯片处于开启状态而产生功耗，从而可以满足目前对显示装置的节能性的要求，提高显示装置的品质。
优选地，在本实施例中，显示驱动电路还包括第四产生模块和第四计时模块。其中，第四产生模块，与第四计时模块相连，用于接收数据使能启动跳变信号触发第四计时模块开始计时，以及接收数据使能关闭跳变信号触发第四计时模块停止计时。所谓数据使能启动跳变信号是指表示一帧图像的有效像素显示的开始信号，具体为低电平跳变为高电平的信号；所谓数据使能关闭跳变信号是指表示一帧图像的有效像素显示的关闭信号，具体为高电平跳变为低电平的信号。当然，在实际应用中，数据使能启动跳变信号还可以为高电平跳变为低电平的信号，对应地，数据使能关闭跳变信号为低电平跳变为高电平的信号。
第四计时模块，与第三计时模块相连，用于记录在第四产生模块触发下的当前计时时长为第三计时模块的当前有效像素显示时长。由于第四计时模块自接收数据使能启动跳变信号开始计时直至接收数据使能关闭跳变信号停止计时，因此，在一个帧周期中，当前有效像素显示时长自初始值逐渐累积至有效像素显示时长T1。
可以理解，第三产生模块产生的行开始结束跳变信号相对第四产生模块产生的数据使能启动关闭跳变信号延迟一定时间(该时间可以为至少一个时钟周期)，以便于先获知当前有效像素显示时长，再第三计时模块开始计时和判断其当前计时时长和有效像素显示时长T1是否相等。
由上可知，借助第四产生模块和第四计时模块可以自动获得有效像素显示时长T1，因此，本实施例提供的显示驱动电路可以应用在有效像素显示时长T1未知的显示装置中，从而可以提高显示驱动电路的适用性和实用性。当然，在实际应用中，还可以不需要第四产生模块和第四计时模块自动获取有效像素显示时长T1，而预先直接在第三计时模块内设置已知的有效像素显示时长T1。
另外，为实现第三定时模块和第四定时模块定时，本实施例提供显示驱动电路还包括用于输出预设周期的时钟信号的时钟模块。其中，时钟模块，分别与第一计时模块和第二计时模块相连，第一计时模块和第二计时模块分别用于在其计时时累积时钟信号的周期数作为计时时长。
需要说明的是，尽管在本实施例中第三产生模块用于在非有效像素显示时长T2内触发空闲的驱动芯片关闭；但是，本实用新型并不局限于此，在实际应用中，第三产生模块还可以在非有效像素显示时长T2内触发背光源模组的光源等其他不需要工作的器件关闭。
作为另外一个技术方案，本实用新型还提供一种显示装置，包括显示驱动电路，该显示驱动电路采用上述第一实施例提供的显示驱动电路。
本实施例提供的显示装置，其采用本实用新型第一实施例提供的显示驱动电路，可以避免空闲的驱动芯片处于开启状态而产生功耗，从而可以满足目前对显示装置的节能性的要求，提高显示装置的品质。
再作为另外一个技术方案，本实用新型还提供一种显示装置，包括显示驱动电路，该显示驱动电路采用上述第二实施例提供的显示驱动电路。
本实施例提供的显示装置，其采用本实用新型第二实施例提供的显示驱动电路，可以避免空闲的驱动芯片处于开启状态而产生功耗，从而可以满足目前对显示装置的节能性的要求，提高显示装置的品质。
可以理解的是，以上实施方式仅仅是为了说明本实用新型的原理而采用的示例性实施方式，然而本实用新型并不局限于此。对于本领域内的普通技术人员而言，在不脱离本实用新型的精神和实质的情况下，可以做出各种变型和改进，这些变型和改进也视为本实用新型的保护范围。

Claims (10)

1.一种显示驱动电路，其包括时间控制器和驱动芯片，其特征在于，所述时间控制器包括第一产生模块和第一计时模块；其中，
所述第一产生模块，分别与所述第一计时模块和所述驱动芯片相连，用于产生行开始信号触发所述第一计时模块开始计时和空闲的所述驱动芯片开启；
所述第一计时模块，与驱动芯片相连，用于在其当前计时时长等于有效像素显示时长时触发在非有效像素显示时长内空闲的所述驱动芯片关闭。
2.根据权利要求1所述的显示驱动电路，其特征在于，所述时间控制器还包括第二产生模块和第二计时模块，其中
所述第二产生模块，与所述第二计时模块相连，用于接收数据使能启动跳变信号触发所述第二计时模块开始计时，以及接收所述数据使能关闭跳变信号触发所述第二计时模块停止计时；
所述第二计时模块，与所述第一计时模块相连，用于记录在所述第二产生模块触发下的当前计时时长为所述第一计时模块的当前有效像素显示时长。
3.根据权利要求1或2所述的显示驱动电路，其特征在于，所述时间控制器还包括用于输出预设周期的时钟信号的时钟模块；
所述时钟模块，分别与所述第一计时模块和所述第二计时模块相连，第一计时模块和所述第二计时模块分别用于在其计时时累积所述时钟信号的周期数作为计时时长。
4.根据权利要求1所述的显示驱动电路，其特征在于，空闲的所述驱动芯片包括栅极驱动芯片和/或源极驱动芯片和/或电平转换芯片和/或电源管理芯片。
5.一种显示驱动电路，包括时间控制器和驱动芯片，其特征在于，所述时间控制器包括第三产生模块和第三计时模块，其中
所述第三产生模块，分别与所述第三计时模块和所述驱动芯片相连，用于产生行开始跳变信号时触发所述第三计时模块开始计时和空闲的所述驱动芯片开启，以及产生行结束跳变信号触发在非有效像素显示时长内空闲的所述驱动芯片关闭；
所述第三计时模块，与所述第三产生模块相连，用于在其当前计时时长等于所述有效像素显示时长时触发所述第三产生模块产生所述行结束跳变信号。
6.根据权利要求5所述的显示驱动电路，其特征在于，所述时间控制器还包括第四产生模块和第四计时模块，其中
所述第四产生模块，与所述第四计时模块相连，用于接收数据使能启动跳变信号触发所述第四计时模块开始计时，以及接收所述数据使能关闭跳变信号触发所述第四计时模块停止计时；
第四计时模块，与所述第三计时模块相连，用于记录在所述第四产生模块触发下的当前计时时长为所述第三计时模块的当前有效像素显示时长。
7.根据权利要求5或6所述的显示驱动电路，其特征在于，所述时间控制器还包括用于输出预设周期的时钟信号的时钟模块；
所述时钟模块，分别与所述第三计时模块和第四计时模块相连，第三计时模块和所述第四计时模块分别用于在其计时时累积所述时钟信号的周期数作为计时时长。
8.根据权利要求5所述的显示驱动电路，其特征在于，空闲的所述驱动芯片包括栅极驱动芯片和/或源极驱动芯片和/或电平转换芯片和/或电源管理芯片。
9.一种显示装置，包括显示驱动电路，其特征在于，所述显示驱动电路采用权利要求1-4任意一项所述的显示驱动电路。
10.一种显示装置，包括显示驱动电路，其特征在于，所述显示驱动电路采用权利要求5-8任意一项所述的显示驱动电路。
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