CN103325353A - 用于液晶显示器的电平移位器 - Google Patents
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Abstract
本发明公开了一种用于液晶显示器的电平移位器。所述电平移位器包括下拉晶体管和输出稳定电路,所述下拉晶体管包括提供有栅低电压的源极端和与电平移位器的输出端连接的漏极端,并且所述下拉晶体管将所述电平移位器的输出端的电压放电,所述输出稳定电路与所述下拉晶体管的栅极端连接,并且所述输出稳定电路在通电顺序的过程中控制所述下拉晶体管的栅极电压,并放电所述电平移位器的输出电压。
Description
本申请要求享有于2012年3月23日提交的韩国专利申请No.10-2012-0030091的权益,为了所有目的将该专利申请的全部内容引入本文以供参考,如同在此完全阐述一样。
技术领域
本发明的实施方式涉及一种用于液晶显示器的电平移位器(level shifter)。
背景技术
有源矩阵液晶显示器包括在每个像素中的作为开关元件的薄膜晶体管(TFT)。有源矩阵液晶显示器可制造得比阴极射线管(CRT)小,并因而可应用于便携式信息设备、办公设备和计算机等的显示单元。此外,有源矩阵液晶显示器可应用于电视机,并因而快速地取代阴极射线管。
液晶显示器包括液晶显示面板、给液晶显示面板提供光的背光单元、用于将数据电压提供给液晶显示面板的数据线的数据驱动电路,用于将栅极脉冲(即扫描脉冲)提供给液晶显示面板的栅极线(即扫描线)的栅极驱动电路、用于控制所述数据驱动电路和栅极驱动电路等的操作时序的时序控制器。液晶显示器还包括电源装置,所述电源装置用于产生液晶显示面板的数据电压、TFT的导通电压VGH和截止电压VGL以及数据驱动电路和栅极驱动电路和时序控制器的电源电压VCC。
液晶显示器的电源装置被集成到一个集成电路(IC)中。以下将嵌入有电源装置的IC称为功率IC。当液晶显示器的功率开关打开时,功率IC的输入电压Vin升高。
液晶显示器的功率IC具有欠压锁定(under voltage lock out;UVLO)功能。当功率IC的输入电压Vin达到UVLO的先前预定的电平时,功率IC产生内部逻辑电压VL并启动内部逻辑。当内部逻辑启动时功率IC产生输出电压Vout。
液晶显示器的栅极驱动电路包括电平移位器和移位寄存器。随着面板内栅极(GIP)工艺技术的发展,移位寄存器可与TFT阵列一道形成在基板上,在所述基板上形成有液晶显示面板的TFT阵列。电平移位器可形成在印刷电路板(PCB)上,所述印刷电路板与液晶显示面板的基板电连接。电平移位器在时序控制器的控制下输出在栅高电压VGH与栅低电压VGL之间摆动的时钟信号。栅高电压VGH的电压被设定为等于或大于TFT的阈值电压,所述TFT被包括在液晶显示面板的TFT阵列中。栅低电压VGL的电压被设定为小于TFT的阈值电压,所述TFT被包括在液晶显示面板的TFT阵列中。移位寄存器顺序地移位从电平移位器接收的时钟信号,并将栅极脉冲顺序地提供给液晶显示面板的栅极线。
如图1所示,电平移位器包括逻辑电路50、上拉晶体管PT和下拉晶体管NT等。上拉晶体管PT可以以p型金属氧化物半导体场效应晶体管(MOSFET)来实现,而下拉晶体管NT可以以n型MOSFET来实现。
根据通电顺序(power-on sequence),栅低电压VGL被提供给电平移位器,并且在几毫秒(ms)的一段时间过去之后,栅高电压VGH被提供给电平移位器。在通电顺序的过程中,当提供给电平移位器的栅高电压VGH达到UVLO的预定电平时,电平移位器的逻辑电路50启动并开始操作。当逻辑电路50启动并在通电顺序之后开始正常操作时,逻辑电路50响应于从时序控制器接收的时钟信号而产生用于控制上拉晶体管PT和下拉晶体NT的导通操作和截止操作的输出。上拉晶体管PT响应于逻辑电路50的第一输出而将栅高电压VGH提供给输出端,并且升高时钟信号CLK。下拉晶体管NT响应于逻辑电路50的第二输出而将输出端放电至栅低电压VGL,并且下降时钟信号CLK。
当液晶显示器的功率开关打开时,功率IC顺序地输出与先前确定的通电顺序一致的栅低电压VGL和栅高电压VGH。当栅高电压VGH升高到等于或大于UVLO的预定电平的电压时,电平移位器启动并且可稳定地产生正常输出。
在通电顺序的过程中,在栅高电压VGH被输入到电平移位器之前,逻辑电路50的输出浮置。因此,上拉晶体管PT的栅极电压和下拉晶体管NT的栅极电压可在通电顺序的过程中不稳定地摆动。在这种情况下,如图2所示,在栅高电压VGH被提供给电平移位器之前,电平移位器的输出CLK不稳定地摆动。电平移位器的不稳定的输出可暂时地导致移位寄存器的错误操作以及液晶显示面板的像素处于液晶显示器刚打开的初始状态。
发明内容
本发明的实施方式提供一种用于液晶显示器的电平移位器,所述电平移位器能够防止在通电顺序的过程中液晶显示器的错误操作。
在一个方面,提供一种用于液晶显示器的电平移位器,所述液晶显示器包括显示面板、电平移位器、移位寄存器和功率集成电路(IC),所述显示面板包括数据线、与所述数据线交叉的栅极线和以矩阵形式布置的像素,所述电平移位器输出起始脉冲和时钟信号,所述移位寄存器响应于从所述电平移位器接收的所述起始脉冲和所述时钟信号而顺序地将栅极脉冲提供给所述栅极线,所述功率集成电路在通电顺序的过程中顺序地输出栅低电压、逻辑电源电压和栅高电压,所述电平移位器包括:下拉晶体管,所述下拉晶体管包括提供有所述栅低电压的源极端和与所述电平移位器的输出端连接的漏极端,所述下拉晶体管将所述电平移位器的所述输出端的电压放电;和输出稳定电路,所述输出稳定电路与所述下拉晶体管的栅极端连接,并且所述输出稳定电路在通电顺序的过程中控制所述下拉晶体管的栅极电压,并放电所述电平移位器的输出电压。
附图说明
被包括来提供对本发明的进一步理解且并入并构成本申请文件的一部分的附图图解了本发明的实施方式,并连同说明书一起用于解释本发明的原理,在附图中:
图1是现有技术的电平移位器的电路图;
图2是示出在栅高电压被提供给电平移位器之前,图1所示的电平移位器的输出是不稳定的现象的波形图;
图3是根据本发明示例性实施方式的液晶显示器的方框图;
图4是示出在图3所示的功率IC中的输入信号和输出信号的波形图;
图5是示出图3所示的电平移位器的输入信号和输出信号的波形图;
图6是根据本发明示例性实施方式的电平移位器的构造的方框图;
图7是详细示出图6所示的输出稳定电路的电路图;和
图8是根据本发明示例性实施方式的电平移位器的另一种构造的方框图。
具体实施方式
现在将详细描述本发明的实施方式,这些实施方式的例子在附图中示出。只要有可能,在所有附图中相同的附图标记将用于指代相同或相似的部件。应当注意的是如果确定对某些已知技术的详细描述可能会模糊本发明的要点,那么将省略该详细描述。
根据本发明示例性实施方式的液晶显示器可以以包括透射式液晶显示器、透射反射式液晶显示器和反射式液晶显示器的任何类型的液晶显示器来实现。透射式液晶显示器和透射反射式液晶显示器需要背光单元,所述背光单元在附图中省略。诸如扭曲向列(TN)模式和垂直定向(vertical alignment,VA)模式之类的垂直电场驱动方式或诸如面内切换(IPS)模式和边缘场切换(FFS)模式之类的水平电场驱动方式可应用到本发明实施方式中。目前已知的所有液晶模式都可应用到本发明实施方式中。
如图3所示,根据本发明实施方式的液晶显示器包括显示面板10、数据驱动电路、面板内栅极(GIP)型栅极驱动电路和时序控制器22等。
显示面板10包括像素阵列并显示输入图像数据,所述像素阵列包括以矩阵形式布置的像素。像素阵列包括形成在显示面板10的下基板上的薄膜晶体管(TFT)阵列、形成在显示面板10的上基板上的滤色器阵列和形成在上基板和下基板之间的液晶盒Clc。TFT阵列包括数据线11、与数据线11交叉的栅极线(即扫描线)12、分别形成在数据线11与栅极线12的交叉处的TFT、与TFT连接的像素电极1、存储电容器Cst等。滤色器阵列包括黑矩阵和滤色器。公共电极2可形成在显示面板10的下基板或上基板上。液晶盒Clc由施加了数据电压的像素电极1与施加了公共电压Vcom的公共电极2之间的电场驱动。
光轴彼此垂直的偏振板被分别贴附到显示面板10的上基板和下基板。在显示面板10的上基板和下基板上分别形成有定向层,用于设定在接触液晶层界面处的液晶的预倾角。在显示面板10的上基板与下基板之间设置有间隔物,以保持液晶层恒定的盒间隙(cell gap)。
数据驱动电路包括多个源极驱动器集成电路(IC)24。源极驱动器IC24接收来自时序控制器22的数字视频数据RGB。源极驱动器IC24响应于从时序控制器22接收的源极时序控制信号将数字视频数据RGB转换为正和负模拟数据电压。然后,源极驱动器IC24将数据电压提供给显示面板10的数据线11,使得数据电压与栅极脉冲(即扫描脉冲)同步。源极驱动器IC24可通过玻载芯片(COG)工艺或卷带式自动接合(TAB)工艺而与显示面板10的数据线11连接。图3示出了安装在载带封装(TCP)上的源极驱动器IC24。印刷电路板(PCB)20经由TCP与显示面板10的下基板连接。
GIP型栅极驱动电路包括电平移位器26和移位寄存器30,所述电平移位器26安装在PCB20上,所述移位寄存器30形成在显示面板10的下基板上。
时序控制器22、电平移位器26和功率IC40安装在PCB20上。
电平移位器26接收来自时序控制器22的起始脉冲ST、第一时钟GCLK和第二时钟MCLK等。此外,电平移位器26接收包括栅高电压VGH和栅低电压VGL等的驱动电压。起始脉冲ST、第一时钟GCLK和第二时钟MCLK在0V与3.3V之间摆动(swing)。栅高电压VGH等于或大于包括在显示面板10的TFT阵列中的TFT的阈值电压,并且所述栅高电压VGH为约30V。栅低电压VGL小于包括在显示面板10的TFT阵列中的TFT的阈值电压,并且所述栅低电压VGL为约-5V。
如图5所示,电平移位器26响应于来自时序控制器22的起始脉冲ST、第一时钟GCLK和第二时钟MCLK而输出起始脉冲VST和时钟信号CLK1至CLK6,所述时钟信号CLK1至CLK6的每一个在栅高电压VGH与栅低电压VGL之间摆动。从电平移位器26输出的时钟信号CLK1至CLK6被顺序地移相(phase-shifted)并且被传输至GIP型栅极驱动电路的移位寄存器30。
移位寄存器30与显示面板10的栅极线12连接。移位寄存器30包括多个级联的级(cascade-connected stage)。移位寄存器30响应于时钟信号CLK1至CLK6而将从电平移位器26接收的起始脉冲VST移位,并且顺序地将栅极脉冲提供给栅极线12。
时序控制器22从外部主***(未示出)接收数字视频数据RGB和时序信号,所述时序信号诸如垂直同步信号Vsync、水平同步信号Hsync、数据使能信号DE和主时钟CLK。时序控制器22将数字视频数据RGB传输给源极驱动器IC24。时序控制器22使用时序信号Vsync、Hsync、DE和CLK产生源极时序控制信号和栅极时序控制信号ST、GCLK和MCLK,所述源极时序控制信号用于控制源极驱动器IC24的操作时序,所述栅极时序控制信号ST、GCLK和MCLK用于控制GIP型栅极驱动电路的电平移位器26和移位寄存器30的操作时序。
当从主机***接收的功率IC40的输入电压Vin等于或大于欠压锁定(UVLO)的预定电平时,功率IC40开始操作,并在预定时间过去之后产生输出。功率IC40的输出包括VGH、VGL、VCC、VDD、HVDD和RST等。VCC是用于驱动时序控制器22和源极驱动器IC24的逻辑电源电压,并且VCC可以是约3.3V。VDD和HVDD是高电位电源电压和半高电位电源电压,所述高电位电源电压和半高电位电源电压将被提供给伽马参考电压产生电路的分压器,用于产生正和负伽马参考电压。正和负伽马参考电压被提供给源极驱动器IC24。RST是用于复位时序控制器22的复位信号,并且RST可以是约3.3V。
如图4所示,功率IC40顺序地输出与先前确定的通电顺序一致的液晶显示器的驱动电压。更具体地,功率IC40当它的输入电压Vin升高并达到UVLO的预定电平时开始操作,并且在第一延迟时间DLY0过去之后产生使能信号EN。接下来,功率IC40继使能信号EN之后产生逻辑电源电压VCC,并在第二延迟时间DLY1过去之后输出复位信号RST。接下来,功率IC40继复位信号RST之后产生栅低电压VGL,并在第三延迟时间DLY2过去之后继栅低电压VGL之后产生高电位电源电压VDD和半高电位电源电压HVDD。接下来,功率IC40在第四延迟时间DLY3过去之后继高电位电源电压VDD和半高电位电源电压HVDD之后产生栅高电压VGH。
图5是示出电平移位器26的输入信号和输出信号的波形图。图6是电平移位器26的第一构造例子的方框图。图7是详细示出图6所示的输出稳定电路的电路图。
如图5至图7,电平移位器26包括逻辑电路60、上拉晶体管PT、下拉晶体管NT和输出稳定电路62等。上拉晶体管PT可以以p型金属氧化物半导体场效应晶体管(MOSFET)来实现,并且下拉晶体管NT可以以n型MOSFET来实现。
根据通电顺序,栅低电压VGL被提供给电平移位器26,并且在几毫秒(ms)的一段时间过去之后,栅高电压VGH被提供给电平移位器26。在通电顺序的过程中,当提供给电平移位器26的栅高电压VGH达到UVLO的预定电平时,电平移位器26的逻辑电路60启动并开始操作。当逻辑电路60启动并在通电顺序之后开始正常操作时,逻辑电路60响应于从时序控制器22接收的时钟信号VST、MCLK和GCLK而产生用于控制上拉晶体管PT和下拉晶体NT的导通操作和截止操作的输出。
上拉晶体管PT包括提供有栅高电压VGH的源极端、与电平移位器26的输出端连接的漏极端和与逻辑电路60的第一输出端连接的栅极端。上拉晶体管PT响应于逻辑电路60的第一输出而将栅高电压VGH提供给电平移位器26的输出端,并且升高时钟信号CLK。
下拉晶体管NT包括提供有栅低电压VGL的源极端、与电平移位器26的输出端连接的漏极端和与逻辑电路60的第二输出端连接的栅极端。下拉晶体管NT响应于逻辑电路60的第二输出而将电平移位器26的输出端放电至栅低电压VGL,并且下降时钟信号CLK。
电平移位器26在通电顺序之后开始正常操作,并将起始脉冲ST的电压电平移位至在栅低电压VGL与栅高电压VGH之间摆动的电压,由此输出起始脉冲VST。当第一时钟GCLK升高时,电平移位器26把将要提供给移位寄存器30的时钟信号CLK1至CLK6升高,并且每次输入第一时钟GCLK时移位时钟信号CLK1至CLK6。时钟信号CLK1至CLK6的每一个在栅低电压VGL与栅高电压VGH之间摆动。电平移位器26开始降低与第二时钟MCLK的上升沿同步的栅高电压VGH,而将栅高电压VGH提高到与第二时钟MCLK的下降沿同步的原始电压。因此,栅低电压VGL与栅高电压VGH之间的差降低大约时钟信号CLK1至CLK6的下降沿。结果,时钟信号CLK1至CLK6之间的电压差的降低减少液晶盒的反冲电压ΔVp,由此减少闪烁(flicker)。
输出稳定电路62增加下拉晶体管NT的栅极电压,使得在通电顺序的过程中,在栅高电压VGH被输入到电平移位器26之前,稳定电平移位器26的输出。下拉晶体管NT取决于在通电顺序的过程中由输出稳定电路62增加的栅极电压而导通,由此将电平移位器26的输出电压放电到栅低电压VGL。
如图7所示,输出稳定电路62包括第一二极管ZD和第二二极管D以及第一电阻器R1和第二电阻器R2。在通电顺序的过程中,输出稳定电路62将电平移位器26的输出电压稳定到栅低电压VGL一段初始时间,在此段时间栅低电压VGL被提供给电平移位器26,而栅高电压VGH还没有被提供给电平移位器26。
第一二极管ZD的阳极与下拉晶体管NT的源极端连接,而第一晶体管ZD的阴极与在第一电阻器R1与第二电阻器R2之间的节点连接。第一二极管ZD可以以齐纳二极管来实现。第一电阻器R1连接在接地电平电压源GND(即,零伏)与第一二极管ZD的阴极之间。第二电阻器R2与第二二极管D的阳极连接,并与在第一电阻器R1与第一二极管ZD之间的节点连接。
在通电顺序的过程中,当栅低电压VGL被提供给电平移位器26并且栅低高电压VGH还没有被提供给电平移位器26时,栅低电压VGL(例如,-5V)被施加到第一二极管ZD的阴极,而0V被施加到第一二极管ZD的阳极。因此,因为栅源电压大于下拉晶体管NT的阈值电压,所以下拉晶体管NT导通。结果,电平移位器26的输出端被放电到栅低电压VGL。
第二二极管D的阳极与第二电阻器R2连接,并且第二二极管D的阴极与下拉晶体管NT的栅极端连接。只有当第二二极管D的阳极电压大于第二二极管D的阴极电压并且阳极电压与阴极电压之间的差等于或大于第二二极管D的阈值电压时,第二二极管D导通。第二二极管D在其余情况中保持截止状态。因此,第二二极管D用作开关元件。因此,第二二极管D阻挡从下拉晶体管NT的栅极端流向接地电平电压源GND的反向电流,由此防止当逻辑电路60正常操作时,逻辑电路60的第二输出的电压非正常的放电。
在通电顺序的过程中,在产生栅高电压VGH之前,产生逻辑电源电压VCC。如图8所示,在通电顺序的过程中,输出稳定电路62通过使用这个的开关SW将逻辑电源电压VCC提供给下拉晶体管NT的栅极端,并可将电平移位器26的输出电压放电到栅低电压VGL。开关SW可以以图7中示出的第二二极管D来简单实现。在这种情况下,逻辑电源电压VCC被提供给用作开关SW的二极管的阳极,并且二极管的阴极与下拉晶体管NT的栅极端连接。
如上所述,本发明的实施方式将包括在电平移位器中的下拉晶体管和输出稳定电路彼此连接。在通电顺序的过程中,输出稳定电路将电平移位器的输出电压放电初始时间,在所述初始时间栅低电压被提供给电平移位器而栅高电压还没有被提供给电平移位器。结果,本发明的实施方式可防止在通电顺序的过程中液晶显示器的错误操作。
尽管已经参考多个示例性的实施方式描述了实施方式,但是应当理解的是:可以由所属领域技术人员构思出属于本发明内容的原理范围内的大量其他改型和实施方式。尤其是,可以在本发明说明书、附图和所附权利要求书的范围内对主题组合方案的组成部件和/或布置作出各种变化和修改。除了组成部件和/或结构的变化和修改之外,替代使用对于所属领域技术人员而言也是明显的。
Claims (5)
1.一种用于液晶显示器的电平移位器,所述液晶显示器包括显示面板、电平移位器、移位寄存器和功率集成电路(IC),所述显示面板包括数据线、与所述数据线交叉的栅极线和以矩阵形式布置的像素,所述电平移位器输出起始脉冲和时钟信号,所述移位寄存器响应于从所述电平移位器接收的所述起始脉冲和所述时钟信号而顺序地将栅极脉冲提供给所述栅极线,所述功率集成电路在通电顺序的过程中顺序地输出栅低电压、逻辑电源电压和栅高电压,所述电平移位器包括:
下拉晶体管,所述下拉晶体管包括提供有所述栅低电压的源极端和与所述电平移位器的输出端连接的漏极端,所述下拉晶体管将所述电平移位器的所述输出端的电压放电;和
输出稳定电路,所述输出稳定电路与所述下拉晶体管的栅极端连接,并且所述输出稳定电路在通电顺序的过程中控制所述下拉晶体管的栅极电压,并放电所述电平移位器的输出电压。
2.根据权利要求1所述的用于液晶显示器的电平移位器,其中所述输出稳定电路包括:
第一电阻器,所述第一电阻器与接地电平电压源连接;
第一二极管,所述第一二极管连接在所述第一电阻器与所述下拉晶体管的所述源极端之间;
第二电阻器,所述第二电阻器连接在节点与所述下拉晶体管的所述栅极端之间连接,所述节点在所述第一电阻器与所述第一二极管之间;和
第二二极管,所述第二二极管连接在所述第二电阻器与所述下拉晶体管的栅极端之间。
3.根据权利要求2所述的用于液晶显示器的电平移位器,其中所述第一二极管包括与所述下拉晶体管的所述源极端连接的阳极和与在所述第一电阻器与所述第二电阻器之间的节点连接的阴极,
其中所述第二二极管包括与所述下拉晶体管的所述栅极端连接的阴极和与所述第二电阻器连接的阳极。
4.根据权利要求1所述的用于液晶显示器的电平移位器,其中所述输出稳定电路包括开关,所述开关在通电顺序的过程中将所述逻辑电源电压提供给所述下拉晶体管的所述栅极端。
5.根据权利要求4所述的用于液晶显示器的电平移位器,其中所述输出稳定电路的所述开光包括二极管,所述二极管具有与所述下拉晶体管的所述栅极端连接的阴极和与所述第二电阻器连接的阳极。
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