CN1183536C - 自动控制波形均衡器的带宽的方法 - Google Patents

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Abstract

一种在DVD再现设备中自动控制波形均衡器带宽的方法，该设备包括具有其带宽由带宽控制信号确定的波形均衡器的RF放大器，和解调由RF放大器均衡的EFM信号的数字信号处理器。该设备在一步步改变带宽控制信号的同时，在预定计数周期校验从数字信号处理器接收到的差错信号的差错周期，从而根据带宽控制信号计算差错率。因此该设备从计算出的差错率中为RF放大器产生具有最小差错率的带宽控制信号，以使数据再现期间的差错率最小。

Description

自动控制波形均衡器 的带宽的方法
技术领域
本发明涉及一种数字视(或通用)盘再现设备，尤其涉及一种自动控制波形均衡器的带宽以使脉冲检测期间的数据差错率最小化的方法。
背景技术
数字视(或通用)盘(后文中称为DVD)，即数字运动图象的记录介质，可记录超过2小时的数字MPEG2(运动图象专家组2)信号。用于再现记录在DVD上的音频和视频信号的常规DVD再现设备具有如图1所示的结构。
参照图1，安装在主轴电机12的驱动轴上的DVD 10以恒速旋转。包含在盖板(未示出)内的拾取装置14将激光束照射到DVD 10上，并接收从DVD10反射的光束，以读取记录在DVD 10上的数据。此外，拾取装置14控制DVD 10的旋转和负载以及拾取头(未示出)的移动。RF(射频)放大器16放大由拾取装置14拾取到的信号并对放大信号进行整形。数字信号处理器(DSP)18解调(16-8解调)从RF放大器16输出的信号，并通过同步探测、解扰、检错、纠错、和轨道缓冲器控制功能来执行数据PLL(锁相环)。具体地讲，DSP 18包括16-8解调器(未示出)和纠错电路(未示出)。该16-8解调器检测输入数据的同步，并对输入数据进行16-8解调，以将其存入存储器(即轨道缓冲器)20。该纠错电路读取存储在轨道缓冲器20中的数据，以纠正读出数据的差错，然后将纠错数据存回轨道缓冲器20中。此外，DSP 18搜索存储在轨道缓冲器20中的数据中表示盘位置的ID(标识)数据，以将ID数据提供给***控制器22，并对剩余数据进行解扰以将其存入轨道缓冲器20中。在视频译码器30的请求下，DSP 18读取存储在轨道缓冲器20中的解扰数据并将其传送到视频译码器30。拾取伺服控制器24控制DVD再现设备的总体操作。在***控制器22的控制下，拾取伺服控制器24执行聚焦伺服、跟踪伺服和拾取移动伺服。主轴伺服控制器26控制主轴电机12的转数，从而使从DVD 10读出的EFM(8-14调制的)信号的最大和最小凹坑的周期变成预定值。多路分解器28多路分解从DSP 18读出的信号，以分别将视频信号传送到MPEG2视频译码器30，和将音频信号传送到AC3/MPEG音频译码器34。从视频译码器30和音频译码器34输出的视频和音频信号分别通过NTSC(国家电视标准码)编码器32和数/模转换器(DAC)36被传送到监视器和扬声器。键盘38，即用户接口装置，包括多个按键，用户用其输入数据或指令。显示器40在其上显示有关DVD 10再现的各种状态信息。
这样构成的DVD再现设备的RF放大器16通常包括加法器(未示出)和波形均衡器(未示出)。在操作中，由于由拾取装置14拾取到的信号被分割成用于聚焦的四个信号并被分成两组，因此这些信号执行I-V(电流-电压)转换，并被转换成单组信号。在加法器上放大和整形的EFM(八到十四调制)信号是3-14T脉冲列，因此由于相邻波形的干扰的缘故而使再现信号容易出现差错。因此，长期以来一直希望出现这样一种装置，其可使波形均衡器的带宽尽可能窄，以将干扰降低的最小限度，从而减小脉冲检测期间的差错率。以往是采用抖动仪来减小波形均衡器的带宽。亦即，传统的装置采用抖动仪来测量在波形均衡器上均衡的EFM信号，以确定波形均衡器的带宽。因此，较被动地确定波形均衡器的带宽，使带宽的测量不精确，从而增加了所不希望的数据差错率。
发明内容
因此，本发明的目的在于提供一种自动控制波形均衡器的带宽以使DVD再现***中的数据差错率最小的方法。
为了实现上述和其它目的，本发明提供一种在DVD再现设备中自动控制波形均衡器的带宽的方法。DVD再现设备包括：RF放大器，该RF放大器具有其带宽由带宽控制信号确定的波形均衡器；和数字信号处理器，用于对由RF放大器均衡的EFM信号进行解调。DVD设备在一步步地改变带宽控制信号的同时，在预定计数周期上校验从数字信号处理器接收到的差错信号的差错周期，从而根据带宽控制信号来计算差错率。此后，DVD设备从所计算出的差错率中为RF放大器产生具有最小差错率的带宽控制信号，进而使数据再现期间的差错率达到最小。
按照本发明的一个方面，提供一种在光盘再现设备中自动控制波形均衡器的带宽的方法，所述光盘再现设备包括射频RF放大器，用于放大由光拾取器从所述光盘读出的信号，所述RF放大器具有其带宽由带宽控制信号确定的所述波形均衡器；所述光盘再现设备还包括数字信号处理器，用于对由RF放大器均衡的8-14调制EFM的信号进行解调，并通过同步探测、解扰、检错、纠错、和轨道缓冲器控制功能的方式来执行数据锁相环PLL，所述方法包括如下步骤：
(a)在预定计数周期上校验从所述数字信号处理器接收到的差错信号的差错周期，以计算相应的差错率；
(b)将计算出的差错率存入内部存储器作为起始差错率；
(c)将带宽控制信号增大；
(d)再次校验差错周期以计算相应的差错率；
(e)将在步骤(d)计算出的当前的差错率与存储在内部存储器的先前的差错率进行比较；
(f)如果当前的差错率高于先前的差错率，则将带宽控制信号减小；
(g)校验差错周期，并根据差错周期计算差错率；
(h)再次将在步骤(g)计算出的当前的差错率与中在步骤(d)计算出的先前差错率相比较；和
(i)如果当前的差错率高于先前的差错率，确定计算出的先前的差错率为最小差错率，并为所述RF放大器产生具有所述最小差错率的带宽控制信号，进而使数据再现期间的差错率达到最小。
附图说明
参照附图对本发明实施例的描述，本发明的上述目的和其它优点将变得更加清楚，附图中：
图1是传统的DVD再现设备的框图；
图2是根据本发明优选实施例的关于带宽控制信号的差错率特性曲线；和
图3是根据本发明优选实施例的用于搜索具有最小差错率的带宽控制信号的流程图。
具体实施方式
以下将参照附图详细描述本发明的优选实施例。为了深入理解本发明，本发明将限制在特定实施例进行示意性描述。然而，应注意的是，任何本技术领域内的技术人员可仅依据描述而不是细节便可实现本发明。在下面的描述中，将不详细描述可能使本发明的细节含糊不清的公知的功能或结构。
图2表示根据本发明优选实施例的关于带宽控制信号的差错率特性曲线，而图3表示根据本发明优选实施例的用于搜索具有最小差错率的带宽控制信号的流程图。参照图1，在从DSP 18接收差错信号时，***控制器22在预定计数周期T上对差错信号的差错周期Eг进行计数，以计算差错率(Eг/T)。***控制器22为RF放大器16产生用于将差错率降低至最小的带宽控制信号。图2中，X轴表示从***控制器22产生的带宽控制信号F，而Y轴表示根据带宽控制信号F变化的差错率值。上述差错信号涉及纠错后产生的信号，而差错周期Eг表示维持有效状态的时间。
下面，参照图3，将描述根据本发明***控制器22是如何确定具有最小差错率的带宽控制信号的。
首先，在步骤50，***控制器22在某点例如在带宽控制信号F的点A上校验差错周期Eг。***控制器22在预定计数周期T上校验差错周期Eг，以计算相应的差错率。在步骤52，计算出的差错率被存入内部存储器作为起始差错率。此后在步骤54，***控制器将带宽控制信号F增加α，并在步骤56再次校验差错周期Eг以计算相应的差错率。计算差错率后，***控制器22将在步骤56计算出的当前的差错率与存储在内部存储器中的先前的差错率进行比较。其结果是，如果当前的差错率小于先前的差错率，则***控制器22返回到步骤54以再次将带宽控制信号F增加α，并计算相应的差错率。然而，如图2所示，如果当前的差错率高于先前的差错率，则***控制器22进到步骤60以将带宽控制信号F减小α。减小带宽控制信号F后，***控制器22在步骤62校验差错周期，并根据差错周期计算差错率。随后，***控制器22再次将在步骤62计算出的当前的差错率与在步骤56计算出的先前的差错率进行比较。如果当前的差错率小于先前的差错率，则***控制器22返回到步骤60以再次将带宽控制信号F减少α，并计算相应的差错率。然而，如图2所示，如果当前的差错率γ高于先前的差错率β，则***控制器22确定在B点计算出的先前的差错率β为最小差错率。因此，在步骤66，***控制器22为RF放大器16产生先前的点B的带宽控制信号F。以这种方式，***控制器22可自动控制波形均衡器的带宽。结果，有可能使从DVD10产生的相邻波形之间的干扰达到最小，从而使脉冲检测期间的差错率达到最小。
如上所述，本发明在改变波形均衡器的带宽的同时测量差错率，以确定在具有最小差错率的点上的波形均衡器的带宽。因此，有可能使由抖动引起的数据差错率达到最小。
尽管已参照附图描述的本发明的实施例，但应该了解的是本发明并不局限在这些具体的实施例，在不背离本发明的范围和精神的前提下，本领域内的技术人员可进行各种其它的改变和变型。

Claims (1)

1.一种在光盘再现设备中自动控制波形均衡器的带宽的方法，所述光盘再现设备包括射频RF放大器，用于放大由光拾取器从所述光盘读出的信号，所述RF放大器具有其带宽由带宽控制信号确定的所述波形均衡器；所述光盘再现设备还包括数字信号处理器，用于对由RF放大器均衡的8-14调制EFM的信号进行解调，并通过同步探测、解扰、检错、纠错、和轨道缓冲器控制功能的方式来执行数据锁相环PLL，所述方法包括如下步骤：
(a)在预定计数周期上校验从所述数字信号处理器接收到的差错信号的差错周期，以计算相应的差错率(50)；
(b)将计算出的差错率存入内部存储器作为起始差错率(52)；
(c)将带宽控制信号增大(54)；
(d)再次校验差错周期以计算相应的差错率(56)；
(e)将在步骤(d)计算出的当前的差错率与存储在内部存储器的先前的差错率进行比较(58)；
(f)如果当前的差错率高于先前的差错率，则将带宽控制信号减小(60)；
(g)校验差错周期，并根据差错周期计算差错率(62)；
(h)再次将在步骤(g)计算出的当前的差错率与中在步骤(d)计算出的先前差错率相比较(64)；和
(i)如果当前的差错率高于先前的差错率，确定计算出的先前的差错率为最小差错率，并为所述RF放大器产生具有所述最小差错率的带宽控制信号，进而使数据再现期间的差错率达到最小(66)。
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