CN115836343A - 发光时间可控的led像素封装 - Google Patents

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Abstract

根据本发明的LED像素封装包括：数据信号，其对应于R(红色)、G(绿色)和B(蓝色)LED的单位像素的及单位像素中包括的R、G和B LED的发光时间；以及控制电路，其接收嵌入有包括多个脉冲的时钟信号和激活信号的控制信号而单位像素。

Description

发光时间可控的LED像素封装
技术领域
本发明涉及一种发光时间可控的LED像素封装。
背景技术
近来，在商用户外、室内电子标牌的实施的趋势是，电子显示屏面积不断扩大的同时，显示分辨率不断提高。此外，为了实现高亮度、高对比度和良好的色彩再现性而采用LED作为发光元件。
在使用LED的显示屏中，采用有源矩阵(Active Matrix)的必要性正日益突显。在这种情况下，使用有源元件对水平轴和垂直轴进行控制，而不是使用直接控制构成于像素的LED的方式，从而与无源矩阵方式相比，具有可以显着减少控制引脚的数量的优点。据此，由于用于驱动的驱动电路非常简化而非常有利于减小像素尺寸和像素间距，同时也可以降低功耗。
在LED显示屏中，随着每个LED之间的间距越窄而像素数量就越密集，随着每个LED的亮度增加而整个显示的清晰度增加，从而画面质量得到改善。优选地，如果将LED显示屏用有源矩阵进行实施，则可以在物理尺寸或成本方面更有效地实施LED显示屏。
为此，必须在LED像素封装中配置用于电源供应、数据输入、接地等的引脚。除此之外，LED像素封装中还必须配置分别用于红色LED、绿色LED、蓝色LED的使能和发射操作的开关控制引脚。
发明内容
技术问题
在现有的LED像素封装中，LED的亮度是由充电于电容器的电压控制的。据此，显示驱动电路必须包括用于存储每个像素的亮度信息的电容器，但这对亮度控制的线性是不利的，特别是对低亮度的显示有限制。
本技术所要解决的课题是，通过解决现有技术的问题而提供一种经济的LED像素封装。
技术方案
根据本发明的LED像素封装包括：数据信号，其对应于R(红色)、G(绿色)和B(蓝色)LED的单位像素的及单位像素中包括的R、G和B LED的发光时间；以及控制电路，其接收嵌入(embed)有包括多个脉冲的时钟信号和激活信号的控制信号以控制单位像素，其中，控制电路包括：信号分离部，其分离输出激活信号和所述时钟信号；数据控制部，其通过激活信号被激活，并且由数据信号形成R驱动时间数据、G驱动时间数据和B驱动时间数据，而且将R驱动时间数据、G驱动时间数据和B驱动时间数据闩锁(latch up)之后作为负载信号输出；以及驱动电路部，其被输入R、G、B发射信号，并且为了在对应于输入的R、G和B发射信号的脉冲宽度期间使R、G和B LED发光而进行驱动。
作为根据本发明的LED像素封装的一例，控制信号被嵌入有：激活信号，其在第一电平和大于第一电平的第二电平之间摆动(swing)；以及时钟信号，其包括在第二电平和大于第二电平的第三电平之间摆动的多个脉冲，并且信号分离部包括：激活信号分离电路，其包括具有第一电平和第二电平之间的阈值电压的晶体管，以分离激活信号并将其输出以在第一电平和第三电平之间摆动；以及时钟信号分离电路，其包括第二电平和第三电平之间的阈值电压的晶体管，以分离时钟信号并将其输出以在第一电平和第三电平之间摆动。
作为根据本发明的LED像素封装的一例，数据信号是R驱动时间数据、G驱动时间数据、B驱动时间数据串行连续的信号，并且数据控制部将R驱动时间数据、G驱动时间数据和B驱动时间数据分离之后按每个比特进行并行分离而将其输出。
作为根据本发明的LED像素封装的一例，其数据控制部包括：移位寄存器，其按每个比特接收串行连续的数据信号；以及闩锁器，其用于将移位寄存器输出的R驱动时间数据、G驱动时间数据和B驱动时间数据闩锁。
作为根据本发明的LED像素封装的一例，移位寄存器输出的R驱动时间数据、G驱动时间数据和B驱动时间数据被并行输出。
作为根据本发明的LED像素封装的一例，发光控制部包括：计数器，其接收时钟信号并对时钟信号中包含的脉冲数进行计数；以及运算部，其R驱动时间数据与脉冲数匹配时输出R匹配信号，G驱动时间数据与所述脉冲数匹配时输出G匹配信号，B驱动时间数据与脉冲数匹配时输出G匹配信号脉冲匹配B输出匹配信号，其中，发光控制部还包括：R发射闩锁器，其接收负载信号而形成R发射信号的第一边沿，并且用R匹配信号形成而输出R发射信号的第二边沿；G发射闩锁器，其接收负载信号而形成G发射信号的第一边沿；G发射闩锁器，其用G匹配信号形成并输出G发射信号的第二边沿；以及B发射闩锁器，其接收负载信号并形成B发射信号的第一边沿，并且用B匹配信号形成并输出B发射信号的第二边沿。
作为根据本发明的LED像素封装的一例，R发射信号的第一边沿到第二边沿的脉冲宽度对应于R驱动时间数据，G发射信号的第一边沿到第二边沿的脉冲宽度对应于G驱动时间数据，B发射信号的第一边缘到第二边缘的宽度对应于B驱动时间数据。
作为根据本发明的LED像素封装的一例，驱动电路部包括分别用于驱动部像素中包含的R、G和B LED的R驱动电路、G驱动电路和B驱动电路，并且R驱动电路、G驱动电路和B驱动电路分别包括：驱动开关，其与LED的一个电极连接的LED；以及发光控制开关，其被提供发射信号以控制LED驱动开关导通。
作为根据本发明的LED像素封装的一例，还包括：运算放大器，其作为一输入而分别向R驱动电路、G驱动电路和B驱动电路提供驱动电压，并且将被复制成另一输入端的驱动电压提供给LED驱动开关的另一电极，同时，输出端连接到LED驱动开关的控制电极；以及发射控制开关，其运算放大器的输出端与一电极相连，并且接地电压连接到另一电极，发射信号提供给控制电极，从而随着发射信号而被导通。其中，如果发射控制开关关断，则LED驱动开关被导通。
作为根据本发明的LED像素封装的一例，R驱动电路、G驱动电路、B驱动电路分别还包括：电流限制电阻，其连接在LED驱动开关的另一电极和接地电压之间，以限制提供给LED的电流。
作为根据本发明的LED像素封装的一例，LED像素封装以有源矩阵形态被连接。
发明效果
根据本发明，可以通过调整R、G和B LED的发光时间以对应于输入信号来调整每个像素的亮度。
附图说明
图1是示出根据本实施例的LED像素封装的概要的图；
图2是根据示出本实施例的控制电路的概要的图；
图3(A)是信号分离部的示意电路图，图3(B)是示出从信号分离部输出的控制信号、激活信号和脉冲串的概要的图；
图4是示出数据控制部的概要的图；
图5是输入和输出到数据控制部的信号的示意时序图；
图6(a)是示出发光控制部的概要的图，图6(b)是示出向发光控制部输入输出信号的概要的时序图；
图7是示意性地示出用于驱动包括在驱动电路部中的R LED的R驱动电路的电路图；
图8是示出根据本实施例的LED像素封装被配置成阵列并被实现为有源矩阵的状态的图。
最优实施方式
根据本发明的实施例的发光时间可控的LED像素封装，其特征在于，包括：数据信号，其对应于R(红色)、G(绿色)和B(蓝色)LED的单位像素的及单位像素中包括的R、G和BLED的发光时间；以及控制电路，其接收嵌入(embed)有包括多个脉冲的时钟信号和激活信号的控制信号而单位像素。
具体实施方式
由于关于本发明的描述仅为结构或功能描述的实施例，因此本发明的范围不应被解释为受限于这里描述的实施例。即，实施例能够进行各种变更,并且可以具有各种形态，因此应当理解为，本发明的范围包括能够实现技术宗旨的等效物。
图1是示出根据本实施例的LED像素封装的概要的图。参照图1，本实施例的LED像素封装1包括：单位像素10，其包含阳极(anode)共同连接的R(红色)、G(绿色)和B(蓝色)LED；以及控制电路20，其控制单位像素10。
图2是示出根据本实施例的控制电路的概要的图。参照图2，根据本实施例的控制电路20接收数据信号(DATA)和控制信号(S_SIG)并控制单位像素。
控制电路部20包括：信号分离部100，其分离并输出分别嵌入在控制信号(S_SIG)中的激活信号(ON)和时钟信号(CLK)；数据控制部，其由激活信号(ON)激活，并且从数据信号(DATA)形成R驱动时间数据(R[9:0])、G驱动时间数据(G[9:0])和B驱动时间数据(B[9:0])，用负载(LOAD)信号闩锁(latch up)R驱动时间数据(R[9:0])、G驱动时间数据(G[9:0])和B驱动时间数据(B[9:0])之后输出；发光控制部300，其接收时钟信号(CLK)、负载信号(LOAD)和R驱动时间数据(R[9:0])、G驱动时间数据(G[9:0])和B驱动时间数据(B[9:0])而形成具有对应于R、G和BLED的发光时间的脉冲宽度的R、G和B发射信号(/EMI_R、/EMI_G、/EMI_B)；以及驱动电路部400，其被输入R、G和B发射信号(/EMI_R、/EMI_G、/EMI_B)，并且驱动R、G和B LED以在与输入R、G和B发射信号(/EMI_R、/EMI_G、/EMI_B)对应的时间内发光。
图3(A)是信号分离部的示意电路图，图3(B)是示出从信号分离部输出的控制信号、激活信号和脉冲串的概要的图。
参照图3(A)和图3(B)，控制信号(S_SIG)可以在第一电平、第二电平和第三电平之间摆动(swing)。作为一例，第一电平可以是接地电压电平，第三电平可以是驱动电压(VCC)电平，第二电平大于信号分离部100中包括的NMOS晶体管的阈值电压而低于第三电平，并且可以小于NMOS晶体管的阈值电压的两倍。
控制信号(S_SIG)是嵌入有包括在接地电压和第二电平之间摆动的激活信号和在第二电平和作为驱动电压(VCC)的第三电平之间摆动的脉冲的脉冲串。
信号分离部100包括：激活信号分离电路112，其将激活信号(ON)与控制信号(S_SIG)分离；以及钟信号分离电路114，其将时钟信号(CLK)与控制信号(S_SIG)分离。
激活信号分离电路112的包括电阻(Ra)和具有在第一电平和第二电平之间的阈值电压的晶体管(N1)和施密特触发器(ST)及反相器(I2)级联。晶体管(N1)的阈值电压大于第一电平但小于第二电平。据此，如果第一电平控制信号(S_SIG)输入到反相器(N1)，则晶体管(N1)关断，从而输出第三电平逻辑高信号。然而，如果第二电平或第三电平控制信号(S_SIG)输入到晶体管(N1)，则被导通。据此，反相器(N1)输出第一电平的逻辑低信号。
施密特触发器(schmitt trigger)是一种不响应瞬间噪音的电路，因为根据输入大小和方向的输出响应具有滞后曲线的特性。当输入上升时，输出的响应具有相对较高的阈值电压，而当输入下降时，输出的响应具有相对较低的阈值电压。
施密特触发器(ST)的输出是提供给反相器(I2)并在第一电平和第三电平之间摆动的信号。反相器(I2)的输出是用于控制发光控制部120的后续激活的激活信号(ON)。
时钟信号分离电路114可以包括级联的反相器(I3、I4)，并且第一级的反相器(I3)与接地电压隔着二极管连接的NMOS晶体管(N3)而连接。反相器(I3)中包括的NMOS晶体管(N4)在通过将二极管接法的NMOS晶体管(N3)的阈值电压和晶体管(N4)的阈值电压相加而获得的电压下导通。
如上所述，通过将N3的阈值电压和N4的阈值电压相加得到的电压大于第二电平。据此，如果具有第一和第二电平的控制信号(S_SIG)提供给反相器(I3)，则NMOS晶体管(N4)不被导通并反相器(I3)输出第三电平的逻辑高信号。然而，如果具有第三电平的控制信号(S_SIG)提供给反相器(I3)，则NMOS晶体管(N4)被导通并反相器(I3)输出第一电平的逻辑低信号。据此，可以分离嵌入在控制信号(S_SIG)中的脉冲串。反相器(I4)将反相器(I3)的输出信号反相之后作为在第一电平和第三电平之间摆动的时钟信号(CLK)而输出。
图4是示出数据控制部的概要的图，图5是输入和输出到数据控制部的信号的示意时序图。参照图4和图5，数据控制部200包括:移位寄存器240,其按每个比特接收串行连续的数据信号(DATA)；以及闩锁部250，其通过负载信号而将从移位寄存器240输出的R驱动时间数据(R[9:0])、G驱动时间数据(G[9:0])和B驱动时间数据(B[9:0])闩锁。
在图4和图5所示的实施例中，输入到数据控制部200的数据信号(DATA)可以包括：与R LED的驱动时间对应R[9:0]的10比特、与G LED的驱动时间对应的G[9:0]的10比特及与B LED的驱动时间对应B[9:0]的10比特。
数据控制部200包括：计数器210，其被复位(reset)为激活信号(ON)之后接收时钟信号(CLK)并对包括在时钟中的脉冲进行计数；以及负载信号形成部220，其当计数器210的计数结果达到预定值时，输出负载信号(LOAD)。预定值可以对应于数据信号(DATA)的所有比特都存储在移位寄存器240中的值。
另外，数据控制部200包括：SR闩锁器230，其接收激活信号(ON)而形成时钟激活信号(EN)的第一边沿，并且接收负载信号(LOAD)而形成时钟激活信号的第二边沿。
下面描述具有这种构成的数据控制部200的操作。随着信号分离部100输出激活信号(ON)而包括在数据控制部200中的计数器210被复位，并且从SR闩锁器230输出的时钟激活信号(EN)转换为逻辑高状态。
随着时钟激活信号(EN)被转换到逻辑高状态，CLK_EN信号被提供给移位寄存器240，并且数据信号(DATA)信号的每一比特按顺序被存储在移位寄存器240中。
复位的计数器210对信号分离部100提供的时钟(CLK)中包含的脉冲数进行计数并输出。如果计数器210输出的计数结果对应于预定值，则负载信号形成部220输出负载信号(LOAD)。作为一例，负载信号形成部在数据信号(DATA)的所有比特被存储在移位寄存器240中的状态下，可以输出负载信号(LOAD)。在图4所示的示例中，R、G和B驱动时间数据均为10比特。负载信号形成部220接收计数器从[0000 0]到[11111]计数的结果并输出负载信号(LOAD)。
随着输出负载信号(LOAD)，向SR闩锁器的设置输入端提供的输入被转换为逻辑低(未图示)，并且时钟激活信号(EN)被转换为逻辑低，同时，时钟不输入到移位寄存器240。另外，闩锁部250随着负载信号(LOAD)被输出而分别将R驱动时间数据(R[9:0])、G驱动时间数据(G[9:0])和B驱动时间数据(B[9:0])闩锁并输出。
图6(a)是示出发光控制部的概要的图，图6(b)是示出向发光控制部输入输出信号的概要的时序图。参照图6(a)和图6(b)，发光控制部300包括：计数器310，其负载信号(LOAD)复位之后对时钟信号(CLK)中包括的脉冲数进行计数；运算部320，其运算计数器310输出的计数结果与R驱动时间数据(R[9:0])、G驱动时间数据(G[9:0])、B驱动时间数据(B[9:0])是否相匹配；以及根据负载信号(LOAD)与运算部320输出的匹配信号形成R发射信号(EMI_R)的SR闩锁器332、根据负载信号(LOAD)与运算部320输出的匹配信号形成G发射信号(EMI_G)的SR闩锁器334、根据负载信号(LOAD)和从运算部320输出的匹配信号形成B发射信号(EMI_B)的SR闩锁器336。
随着数据控制部200输出负载信号(LOAD)而计数器310被复位。计数器310对时钟信号(CLK)中包含的脉冲数进行计数并输出。另外，SR闩锁器332、334、336输出的R发射信号(EMI_R)、发射信号(EMI_G)和B发射信号(EMI_B)形成上升边沿并从逻辑低状态变为逻辑高状态。
随着数据控制部200输出负载信号(LOAD)而将R驱动时间数据R[9:0]、G驱动时间数据G[9:0]和B驱动时间数据B[9:0]提供给匹配信号计算部320。如果R驱动时间数据(R[9:0])、G驱动时间数据(G[9:0])和B驱动时间数据(B[9:0])，与计数器310的计数的结果匹配，则输出匹配信号。
作为一例，当R驱动时间数据(R[9:0])对应于[1111 1111 01]，G驱动时间数据(G[9:0])对应于[1111 1111 11]以及B驱动时间数据(B[9:0])对应于[1111 1111 10]时，如果计数器310计数的时钟(CLK)的数目达到1024个(？)，则运算部320向SR闩锁器332的复位输入端输出R匹配信号。SR闩锁器332形成第二边缘以改变R发射信号(EMI_R)的状态。
如果计数器310计数的时钟(CLK)的数目达到1024(？)个，则运算部320向SR闩锁器334复位输入端输出G匹配信号。SR闩锁器334形成G发射信号的第二边沿以改变G发射信号(EMI_G)的状态。同样地，如果计数器310计数的时钟(CLK)数目达到1023(？)个，则运算部320B将匹配信号输出到SR闩锁器336以改变B发射信号(EMI_B)的状态。
据此，如图6(b)所示，R发射信号(EMI_R)、G发射信号(EMI_G)和B发射信号(EMI_B)分别具有与R驱动时间数据(R[9:0])、G驱动时间数据(B[9:0])、B驱动时间数据(B[9:0])对应的脉冲宽度。
图7是示意性地示出用于驱动包括在驱动电路部中的R LED的R驱动电路的电路图。如图2所示，驱动电路部400包括：用于驱动R LED的R驱动电路(410R)、用于驱动G LED的G驱动电路(410G)和用于驱动BLED的B驱动电路(410B)。R驱动电路(410R)、G驱动电路(410G)和B驱动电路可以具有相同的构成，为了便于理解，下面示例性地描述R驱动电路(410R)。
参照图7，R驱动电路(410R)可以包括LED驱动开关412、发射控制开关414和运算放大器416。随着R发射信号(/EMI_R)维持在逻辑高状态而发射控制开关414导通以将运算放大器416的输出节点的电压维持为接地电压(GND)。据此，LED驱动开关412关断而R LED不发光。
随着提供逻辑低R发射信号(/EMI_R)而发射控制开关414被关断。据此，运算放大器416输出节点处的电压保持在逻辑高状态，并且LED驱动开关412被导通。另外，驱动电压(Vref)被复制成运算放大器416的非反相输入之后提供给LED驱动开关412的源极。由此，电流(i)通过限流电阻(Rlimit)红色LED而被提供驱动电力。
LED上流动的电流(i)可以像下面的等式1所示显示。
【等式1】
Figure BDA0003181805930000091
如等式1所示，可以通过调节限流电阻(Rlimit)的阻值来限制电流(i)的值，由此可以控制R LED的发光亮度。
在本实施例中,通过调整作为数据信号(DATA)提供的R驱动时间数据(R[9:0])、G驱动时间数据(G[9:0])和B驱动时间数据(B[9:0])而可以控制R发射信号(EMI_R)、G发射信号(EMI_G)和B发射信号(EMI_B)的脉冲宽度。由此可以控制R LED、G LED、B LED发光的时间，从而控制R、G和B的发光亮度。
图8是示出根据本实施例的LED像素封装被配置成阵列且被实现为有源矩阵的状态的图。参照图8，相同的控制信号(S_SIG)提供给配置在同一行的LED像素封装，并且相同的数据信号(DATA)提供给配置在同一列中的LED像素封装。
据此，实现为有源矩阵的根据本实施例的LED像素封装阵列可以被控制为通过提供控制信号(S_SIG)和数据信号(DATA)而单独地被提供发光数据的同时,发光。
为了帮助理解本发明而已经参照附图中所示的实施例进行了描述，但这是用于实施的实施例，并且仅是示例性的。本领域所述普通技术人员可以理解为，由此可以实施各种变形和等效的其他实施例。据此，本发明真正的技术保护范围应以所附权利要求书为准。

Claims (5)

1.一种LED像素封装，其特征在于，包括：
根据本发明的LED像素封装包括：
数据信号，其对应于R(红色)、G(绿色)和B(蓝色)LED的单位像素的及单位像素中包括的R、G和B LED的发光时间；以及
控制电路，其接收嵌入有包括多个脉冲的时钟信号和激活信号的控制信号而控制所述单位像素，
其中，所述控制电路包括：
信号分离部，其分离所述输出激活信号和所述时钟信号；
数据控制部，其通过所述激活信号激活，并且由所述数据信号形成R驱动时间数据、G驱动时间数据和B驱动时间数据，而且将R驱动时间数据、G驱动时间数据和B驱动时间数据闩锁之后作为负载信号输出；
发光控制部，其接收所述时钟信号、所述负载信号和所述R驱动时间数据、G驱动时间数据及所述B驱动时间数据而形成具有对应于所述R、G和B LED的发光时间的脉冲宽度的R、G和B发射信号；以及
驱动电路部，其被输入所述R、G、B发射信号，并且为了在对应于输入的所述R、G和B发射信号的脉冲宽度期间使R、G和B LED发光而进行驱动，
其中，所述控制信号被嵌入有：
所述激活信号，其在第一电平和大于所述第一电平的第二电平之间摆动；以及
所述时钟信号，其包括在所述第二电平和大于所述第二电平的第三电平之间摆动的多个脉冲，
其中，所述信号分离部包括：
激活信号分离电路，其包括具有所述第一电平和所述第二电平之间的阈值电压的晶体管，以分离所述激活信号并将其输出以在所述第一电平和所述第三电平之间摆动；以及
时钟信号分离电路，其包括所述第二电平和所述第三电平之间的阈值电压的晶体管，以所述分离时钟信号并将其输出以在所述第一电平和所述第三电平之间摆动，
其中，所述发光控制部配置有：
计数器，其接收所述时钟信号并对所述时钟信号中包含的脉冲数进行计数；以及
运算部，其所述R驱动时间数据与所述脉冲数匹配时输出R匹配信号，所述G驱动时间数据与所述脉冲数匹配时输出G匹配信号，所述B驱动时间数据与脉冲数匹配时输出G匹配信号脉冲匹配B输出匹配信号，
其中，所述发光控制部还包括：
R发射闩锁器，其接收所述负载信号而形成R发射信号的第一边沿，并且用所述R匹配信号形成并输出所述R发射信号的第二边沿；
G发射闩锁器，其接收所述负载信号而形成G发射信号的第一边沿，并且用所述G匹配信号形成并输出所述G发射信号的第二边沿；以及
B发射闩锁器，其接收所述负载信号而形成B发射信号的第一边沿，并且用所述B匹配信号形成并输出所述B发射信号的第二边沿，
其中，所述R发射信号的第一边沿到第二边沿的脉冲宽度对应于所述R驱动时间数据，所述G发射信号的第一边沿到第二边沿的脉冲宽度为对应的所述G驱动时间数据，所述B发射信号的第一边沿到第二边沿的脉冲宽度对应于所述B驱动时间数据，
其中，所述驱动电路部包括用于分别驱动包括在单位像素中的R、G和B LED的R驱动电路、G驱动电路和B驱动电路，
其中，R驱动电路、G驱动电路和B驱动电路分别包括：LED驱动开关，其与LED的一电极连接；发射控制开关，其被提供所述发射信号以控制LED驱动开关的导通；运算放大器，其被提供驱动电压作为一输入，并且将被复制成另一输入的所述驱动电压提供给LED驱动开关的另一电极，而且输出端连接到所述LED驱动开关的控制电极；发射控制开关，其连接所述运算放大器的所述输出端和一电极，并且接地电压连接到另一电极，所述发射信号提供给控制电极而根据发射信号而被导通；以及限流电阻，其连接在所述LED驱动开关的另一极与接地电压之间，以限制提供给所述LED的电流，并且当发光控制开关断时，所述LED驱动开关被导通。
2.根据权利要求1所述的LED像素封装，其特征在于，
所述数据信号是所述R驱动时间数据、G驱动时间数据和B驱动时间数据串联的信号，
所述数据控制部将所述R驱动时间数据、G驱动时间数据和B驱动时间数据分离之后按每个比特进行并行分离而将其输出。
3.根据权利要求2所述的LED像素封装，其特征在于，
所述数据控制部包括：
移位寄存器，其按每个比特接收串行连续的所述数据信号；以及
闩锁部，其将所述移位寄存器输出的R驱动时间数据、G驱动时间数据和B驱动时间数据闩锁。
4.根据权利要求3所述的LED像素封装，其特征在于，
所述移位寄存器输出的R驱动时间数据、G驱动时间数据和B驱动时间数据被并行输出。
5.根据权利要求1所述的LED像素封装，其特征在于，
所述LED像素封装以有源矩阵形态被连接。
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