CN115188314B - 异形屏的显示电路及显示设备 - Google Patents

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Abstract

本申请公开了异形屏的显示电路及显示设备，该异形屏的显示电路包括异形屏的异形区域中以非矩形方式阵列排布的多个像素电路；将位于每一行像素电路的两端处的像素电路作为边缘像素电路，其中相邻的两个边缘像素电路中的一个边缘像素电路连接第N级栅极信号线，另一个边缘像素电路连接第N+1级栅极信号线，N为大于0的自然数；分压电路，分别与相邻的两个边缘像素电路连接，以使相邻的两个边缘像素电路的储存电压相等，分压电路的控制端与第N+M级栅极信号线连接，M为大于2的自然数。基于上述方式，可有效弱化异形屏进行显示时的锯齿效应，改善异形屏的显示效果。

Description

异形屏的显示电路及显示设备
技术领域
本申请涉及显示技术领域，特别是涉及异形屏的显示电路及显示设备。
背景技术
随着时代的发展，人们对于显示屏的要求越来越高，在一些特定应用场合，就需要采用具备异形画面显示功能的异形屏作为显示屏，以满足用户的特定需求。
现有技术的缺陷在于，由于异形屏通常会具有弧形或其它非常规形的边缘，而异形屏中的显示区域通常也是由阵列排布的像素电路构成，这使得异形屏边缘处所对应的显示画面的锯齿效应相对于矩形屏更加严重，进而使得异形屏的显示效果较差。
发明内容
本申请主要解决的技术问题是如何弱化异形屏进行显示时的锯齿效应，改善异形屏的显示效果。
为了解决上述技术问题，本申请采用的第一个技术方案是：一种异形屏的显示电路，包括异形屏的异形区域中以非矩形方式阵列排布的多个像素电路；将位于每一行像素电路的两端处的像素电路作为边缘像素电路，其中相邻的两个边缘像素电路中的一个边缘像素电路连接第N级栅极信号线，另一个边缘像素电路连接第N+1级栅极信号线，N为大于0的自然数；分压电路，分别与相邻的两个边缘像素电路连接，以使相邻的两个边缘像素电路的储存电压相等，分压电路的控制端与第N+M级栅极信号线连接，M为大于2的自然数。
其中，显示电路包括异形屏的矩形区域中以矩形方式阵列排布的多个像素电路，以及异形屏中以非矩形方式阵列排布的多个像素电路。
其中，位于每一行像素电路的每一端处的边缘像素电路包括第一边缘像素电路和第二边缘像素电路，第一边缘像素电路和第二边缘像素电路相邻；第一边缘像素电路连接第N级栅极信号线，第二边缘像素电路连接第N+1级栅极信号线。
其中，将多个像素电路中除边缘像素电路外的像素电路作为非边缘像素电路，将与第一边缘像素电路或第二边缘像素电路位于同一行且相邻的非边缘像素电路作为近边缘像素电路；相邻的第一边缘像素电路、第二边缘像素电路和近边缘像素电路连接同一级数据信号线。
其中，将位于第N行像素电路的一端处的像素电路作为第一边缘像素电路，将位于第N+1行像素电路的一端处且与第一边缘像素电路相邻的像素电路作为第二边缘像素电路；第一边缘像素电路连接第N级栅极信号线，第二边缘像素电路连接第N+1级栅极信号线。
其中，将多个像素电路中除边缘像素电路外的像素电路作为非边缘像素电路，将与第一边缘像素电路位于同一行且相邻的非边缘像素电路作为第一近边缘像素电路，将与第二边缘像素电路位于同一行且相邻的非边缘像素电路作为第二近边缘像素电路；相邻的第一边缘像素电路、第二边缘像素电路、第一近边缘像素电路和第二近边缘像素电路连接同一级数据信号线。
其中，M等于2。
其中，像素电路包括第一开关管和储存电容，第一开关管的驱动端连接相应栅极信号线，第一开关管的第一端连接相应数据信号线，第一开关管的第二端连接储存电容的第一端，储存电容的第二端连接相应公共电极。
其中，分压电路包括第二开关管，第二开关管的第一端连接相邻的两个边缘像素电路中的一个边缘像素电路中的储存电容的第一端，第二开关管的第二端连接相邻的两个边缘像素电路中的另一个边缘像素电路中的储存电容的第一端，第二开关管的驱动端连接第N+M级栅极信号线。
为了解决上述技术问题，本申请采用的第二个技术方案是：一种显示设备，包括背光模组和上述显示电路。
本申请的有益效果在于：区别于现有技术，本申请的技术方案中，将位于每一行像素电路的两端处的像素电路作为边缘像素电路，使得相邻两个边缘像素电路中的一个边缘像素电路连接第N级栅极信号线以接收第N级栅极信号，并使得相邻两个边缘像素电路中的另一个边缘像素电路连接第N+1级栅极信号线以接收第N+1级栅极信号，通过控制端连接第N+M级栅极信号线的分压电路，在接收到第N+M级栅极信号时，使得该相邻两个边缘像素电路中的储存电容中的电压进行中和，进而使得该相邻两个边缘像素电路的储存电压相等，并使得该相邻两个边缘像素电路均能够以电压中和后的储存电压所对应的亮度进行显示，从而弱化异形屏边缘处的像素电路在显示时所出现的锯齿效应，改善异形屏的显示效果。
附图说明
为了更清楚地说明本发明实施例中的技术方案，下面将对实施例描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1是本申请异形屏的显示电路的一实施例结构示意图；
图2是本申请异形屏的显示电路的另一实施例结构示意图；
图3是本申请显示设备的一实施例的结构示意图；
图4是本申请异形屏的一实施例的显示区域示意图。
具体实施方式
下面结合附图和实施例，对本申请作进一步的详细描述。特别指出的是，以下实施例仅用于说明本申请，但不对本申请的范围进行限定。同样的，以下实施例仅为本申请的部分实施例而非全部实施例，本领域普通技术人员在没有作出创造性劳动前提下所获得的所有其它实施例，都属于本申请保护的范围。
在本文中提及“实施例”意味着，结合实施例描述的特定特征、结构或特性可以包含在本申请的至少一个实施例中。在说明书中的各个位置出现该短语并不一定均是指相同的实施例，也不是与其他实施例互斥的独立的或备选的实施例。本领域技术人员显式地和隐式地理解的是，本文所描述的实施例可以与其他实施例相结合。
本申请的描述中，需要说明书的是，除非另外明确的规定和限定，术语“安装”、“设置”、“相连”、“连接”应做广义理解，例如，可以是固定连接，可以是可拆卸连接，或一体地连接；可以是机械来能接，也可以是电连接；可以是直接相连，也可以通过中间媒介间隔相连。对于本领域的普通技术人员而言，可以具体情况连接上述属于在本申请的具体含义。
首先需要说明的是，在异形屏的全部显示区域D可包括异形区域和矩形区域，参见图4，图4是本申请异形屏的一实施例的显示区域示意图，如图4所示，异形屏的全部显示区域D可包括图中示出的异形区域A，异形区域A内阵列排布的像素电路构成了一非矩形的显示区域，异形屏的全部显示区域D还可包括图中示出的矩形区域B，矩形区域B内阵列排布的像素电路构成了一矩形的显示区域。
本申请首先公开了一种异形屏的显示电路，参见图1，图1是本申请异形屏的显示电路的一实施例结构示意图，如图1所示，显示电路包括异形屏的异形区域中以非矩形方式阵列排布的多个像素电路10，图中未示出与像素电路10对应的液晶层、电极层等结构。
可将位于每一行像素电路10的两端处的像素电路10记作边缘像素电路，也即，边缘像素电路均为位于异形屏的边缘处的像素电路。
所有行像素电路10中相邻的两个边缘像素电路中的一个边缘像素电路连接第N级栅极信号线，且该相邻的两个边缘像素电路中的另一个边缘像素电路连接第N+1级栅极信号线，N为大于0的自然数，从而使得该相邻的两个边缘像素电路能够分别基于相应栅极信号线上传输的栅极信号进行显示。
具体地，每个像素电路10均可包括第一开关管101和储存电容102。
第一开关管101的驱动端连接相应栅极信号线，第一开关管101的第一端连接相应数据信号线，第一开关管101的第二端连接储存电容的第一端，储存电容102的第二端连接相应公共电极。
第一开关管101的驱动端用于接收相应的栅极信号（如图1中的第N级栅极信号线传输的信号），第一开关管101的第一端用于接收相应的数据信号（如图1中的第M+2级数据信号线传输的信号），第一开关管101的第二端连接储存电容102的第一端，储存电容102的第二端用于接收相应的共电极电压信号（如图1中的公共电极传输的信号）。储存电容102可基于接收到的数据信号与共电极电压信号之间的电压差进行电能的存储，进而可使像素电路10中的液晶层基于存储的电能进行运作，进而使得像素电路10进行相应的显示作业。其中，数据信号也可称为像素电压信号。
此处需要说明的是，可将上述相邻的两个边缘像素电路中的一个边缘像素电路记作第一边缘像素电路11，并将上述相邻的两个边缘像素电路中的另一个边缘像素电路记作第二边缘像素电路12，第一边缘像素电路11和第二边缘像素电路12均为像素电路10，也即，如图1所示，在第一边缘像素电路11或第二边缘像素电路12中，所示出的开关管即为第一边缘像素电路11或第二边缘像素电路12中的第一开关管101，所示出的电容即为第一边缘像素电路11或第二边缘像素电路12中的储存电容102。
显示电路还包括分压电路13，分别与上述相邻的两个边缘像素电路连接，分压电路的控制端与第N+M级栅极信号线连接，M为大于2的自然数，分压电路可用于在接收到第N+M级栅极信号线中的栅极信号时，使上述相邻的两个边缘像素电路中的储存电容102上的电压进行中和，以使上述相邻的两个边缘像素电路的储存电压相等，进而能够使上述相邻的两个边缘像素电路均以中和后的电压所对应的亮度进行显示。
具体地，在显示电路中，所有栅极信号线中的栅极信号通常会依据级号，从小到大逐个输出，以使得显示屏（如异形屏）中每一行像素电路能够逐次接收到相应的栅极信号，以使多个像素电路逐行进行显示，直至完成显示屏中一次画面的显示，也即，第N级栅极信号线传输的信号、第N+1级栅极信号线传输的信号、第N+M级栅极信号线传输的信号按照从前往后的顺序依次输出。
分压电路13包括第二开关管131，第二开关管131的第一端连接相邻的两个边缘像素电路中的一个边缘像素电路中的储存电容102的第一端，第二开关管131的第二端连接相邻的两个边缘像素电路中的另一个边缘像素电路中的储存电容102的第一端，第二开关管131的驱动端连接第N+M级栅极信号线。
基于上述栅极信号的输出方式，能够先使第一边缘像素电路11接收到第N级栅极信号线传输的信号并基于相应的数据信号对第一边缘像素电路11中的储存电容102进行充电，再使第二边缘像素电路12接收到第N+1级栅极信号线传输的信号并基于相应的数据信号对第二边缘像素电路12中的储存电容102进行充电，然后使第二开关管131在接收到第N+M级栅极信号线传输的信号后导通，以使第一边缘像素电路11中的储存电容102与第二边缘像素电路12中的储存电容102并联，以使该两个储存电容102中电压较高的电容向电压较低的电容进行放电/充电，使得该两个储存电容102的电压能够在并联后发生中和。
假设第一边缘像素电路11基于其中的储存电容102充电后的初始电压进行显示的显示亮度为第一亮度，而第一边缘像素电路11基于其中的储存电容102充电后的初始电压进行显示的显示亮度为第二亮度，则基于上述显示电路及栅极信号的输出方式，能够使第一边缘像素电路11和第二边缘像素电路12均以第三亮度进行显示，其中，第三亮度处于第一亮度与第二亮度之间。
具体地，如图1所示，M可以为2，也即第N+M级栅极信号线传输的信号为第N+2级栅极信号线传输的信号，第N+2级栅极信号线传输的信号的输出顺序在第N+1级栅极信号线传输的信号之后，第N+1级栅极信号线传输的信号的输出顺序在第N级栅极信号线传输的信号之后。
基于上述方式，能够在第一边缘像素电路11和第二边缘像素电路12中的储存电容102均完成充电作业后，第一时间促成该两个储存电容102的并联，进而完成电容间的电压中和，避免因时间过长而导致第一边缘像素电路11和第二边缘像素电路12已基于相应储存电容102的初始电压显示过久的情况发生，进一步减少异形屏出现锯齿效应的时长，改善了异形屏的显示效果。
具体地，第一开关管101和第二开关管131均为薄膜场效应晶体管。
薄膜场效应晶体管具体可包括基板层、第一金属层、第一绝缘层、半导体层、第二金属层、第二绝缘层和电极层。
区别于现有技术，本申请的技术方案中，将位于每一行像素电路的两端处的像素电路作为边缘像素电路，使得相邻两个边缘像素电路中的一个边缘像素电路连接第N级栅极信号线以接收第N级栅极信号，并使得相邻两个边缘像素电路中的另一个边缘像素电路连接第N+1级栅极信号线以接收第N+1级栅极信号，通过控制端连接第N+M级栅极信号线的分压电路，在接收到第N+M级栅极信号时，使得该相邻两个边缘像素电路中的储存电容中的电压进行中和，进而使得该相邻两个边缘像素电路的储存电压相等，并使得该相邻两个边缘像素电路均能够以电压中和后的储存电压所对应的亮度进行显示，从而弱化异形屏边缘处的像素电路在显示时所出现的锯齿效应，改善异形屏的显示效果。
在一实施例中，显示电路不仅可包括异形屏的异形区域中以非矩形方式阵列排布的多个像素电路10，还可包括异形屏的矩形区域中以矩形方式阵列排布的多个像素电路10。
具体地，如图4所示，显示电路不仅可包括位于异形区域A中的像素电路10，还可包括位于矩形区域B中的像素电路10，也即，无论是异形区域A中的相邻的两个边缘像素电路，还是矩形区域B中的相邻的两个边缘像素电路，均可以使其中的一个连接第N级栅极信号线，而其中的另一个边缘像素电路连接第N+1级栅极信号线，以改善异形屏的显示效果。
在一实施例中，如图1所示，多个像素电路10中，位于第N行像素电路10的一端处的边缘像素电路包括第一边缘像素电路11和第二边缘像素电路12，第一边缘像素电路11和第二边缘像素电路12相邻。
第一边缘像素电路11连接第N级栅极信号线，第二边缘像素电路12连接第N+1级栅极信号线。
具体地，在异形屏中，每一行像素电路中位于一端处（例如左端）的边缘像素电路可包括第一边缘像素电路11和第二边缘像素电路12，第一边缘像素电路11和第二边缘像素电路12之间可以是上下排布关系，第一边缘像素电路11与上一行像素电路10相邻，而第二边缘像素电路12与下一行像素电路10相邻。
基于上述方式，能够使所有像素电路10中的每组第一边缘像素电路11和第二边缘像素电路12均以相应的上述第三亮度进行显示，基于此弱化异形屏边缘处的锯齿效应，改善异形屏的显示效果。
可选地，将多个像素电路10中除边缘像素电路外的像素电路10作为非边缘像素电路，将与第一边缘像素电路11或第二边缘像素电路12位于同一行且相邻的非边缘像素电路作为近边缘像素电路14。
相邻的第一边缘像素电路11、第二边缘像素电路12和近边缘像素电路14连接同一级数据信号线。
近边缘像素电路14位于异形屏的非边缘处。
具体地，相邻的第一边缘像素电路11、第二边缘像素电路12和近边缘像素电路14的上述第一开关管101的第一端，均连接同一数据线，以接收相应的数据信号（如图1所示第M+1级数据信号线传输的信号）。
基于上述方式，能使第一边缘像素电路11/第二边缘像素电路12、近边缘像素电路14分别以不同但相近的亮度进行显示，进一步弱化异形屏的锯齿效应，改善异形屏的显示效果。
在一实施例中，如图1所示，多个像素电路10中，将位于第N行像素电路10的一端处的边缘像素电路作为第一边缘像素电路11，将位于第N+1行像素电路的一端处且与第一边缘像素电路11相邻的边缘像素电路作为第二边缘像素电路12。
第一边缘像素电路11连接第N级栅极信号线，第二边缘像素电路12连接第N+1级栅极信号线。
具体地，在异形屏中，每一行像素电路中位于一端处（例如左侧）的像素电路仅有一个。
参见图2，图2是本申请异形屏的显示电路的另一实施例结构示意图，如图2所示，在所有像素电路10中，位于第N行的左端处的边缘像素电路为第一边缘像素电路11，而位于第N+1行的左端处的边缘像素电路为第二边缘像素电路12，该第一边缘像素电路11与该第二边缘像素电路12相邻。
基于上述方式，能够使所有像素电路10中的每组第一边缘像素电路11和第二边缘像素电路12均以相应的上述第三亮度进行显示，基于此弱化异形屏边缘处的锯齿效应，改善异形屏的显示效果。
可选地，将多个像素电路10中除边缘像素电路外的像素电路10作为非边缘像素电路，将与第一边缘像素电路11位于同一行且相邻的非边缘像素电路作为第一近边缘像素电路15，将与第二边缘像素电路12位于同一行且相邻的非边缘像素电路作为第二近边缘像素电路16。
相邻的第一边缘像素电路11、第二边缘像素电路12、第一近边缘像素电路15和第二近边缘像素电路16连接同一级数据信号线。
举例说明，如图2所示，与第N行像素电路的左端处的边缘像素电路位于同一行且相邻的像素电路即为第一近边缘供电电路15，与第N+1行像素电路的左端处的边缘像素电路位于同一行且相邻的像素电路即为第二近边缘供电电路16。第一近边缘供电电路15和第二近边缘供电电路16均位于异形屏的非边缘处。
具体地，第一边缘像素电路11、第二边缘像素电路12、第一近边缘供电电路15和第二近边缘供电电路16的第一开关管101的第一端，均连接同一数据线，以接收相应的数据信号（如图2所示的第M+1级数据信号线传输的信号）。
基于上述方式，能够使第一近边缘供电电路15以第一亮度进行显示，并使第二近边缘供电电路16以第二亮度进行显示，以及使第一边缘像素电路11/第二边缘像素电路12以第三亮度进行显示，其中，第三亮度处于第一亮度与第二亮度之间，进一步弱化异形屏的锯齿效应，改善异形屏的显示效果。
本申请还公开了一种显示设备，参见图3，图3是本申请显示设备的一实施例的结构示意图，如图3所示，显示设备20包括背光模组21和显示电路22，显示电路22可以是前文实施例所述的任意一种显示电路，此处不再赘述。
区别于现有技术，本申请的技术方案中，将位于每一行像素电路的两端处的像素电路作为边缘像素电路，使得相邻两个边缘像素电路中的一个边缘像素电路连接第N级栅极信号线以接收第N级栅极信号，并使得相邻两个边缘像素电路中的另一个边缘像素电路连接第N+1级栅极信号线以接收第N+1级栅极信号，通过控制端连接第N+M级栅极信号线的分压电路，在接收到第N+M级栅极信号时，使得该相邻两个边缘像素电路中的储存电容中的电压进行中和，进而使得该相邻两个边缘像素电路的储存电压相等，并使得该相邻两个边缘像素电路均能够以电压中和后的储存电压所对应的亮度进行显示，从而弱化异形屏边缘处的像素电路在显示时所出现的锯齿效应，改善异形屏的显示效果。
在本申请的描述中，参考术语“一个实施例”、“一些实施例”、“示例”、“具体示例”、或“一些示例”等的描述意指结合该实施例或示例描述的具体特征、结构、材料或者特点包含于本申请的至少一个实施例或示例中。在本说明书中，对上述术语的示意性表述不必须针对的是相同的实施例或示例。而且，描述的具体特征、结构、材料或者特点可以在任一个或多个实施例或示例中以合适的方式结合。此外，在不相互矛盾的情况下，本领域的技术人员可以将本说明书中描述的不同实施例或示例以及不同实施例或示例的特征进行结合和组合。
此外，术语“第一”、“第二”仅用于描述目的，而不能理解为指示或暗示相对重要性或者隐含指明所指示的技术特征的数量。由此，限定有“第一”、“第二”的特征可以明示或者隐含地包括至少一个该特征。在本申请的描述中，“多个”的含义是至少两个，例如两个，三个等，除非另有明确具体的限定。
流程图中或在此以其他方式描述的任何过程或方法描述可以被理解为，表示包括一个或更多个用于实现特定逻辑功能或过程的步骤的可执行指令的代码的模块、片段或部分，并且本申请的优选实施方式的范围包括另外的实现，其中可以不按所示出或讨论的顺序，包括根据所涉及的功能按基本同时的方式或按相反的顺序，来执行功能，这应被本申请的实施例所属技术领域的技术人员所理解。
在流程图中表示或在此以其他方式描述的逻辑和/或步骤，例如，可以被认为是用于实现逻辑功能的可执行指令的定序列表，可以具体实现在任何计算机可读介质中，以供指令执行***、装置或设备(可以是个人计算机，服务器，网络设备或其他可以从指令执行***、装置或设备取指令并执行指令的***)使用，或结合这些指令执行***、装置或设备而使用。就本说明书而言，"计算机可读介质"可以是任何可以包含、存储、通信、传播或传输程序以供指令执行***、装置或设备或结合这些指令执行***、装置或设备而使用的装置。计算机可读介质的更具体的示例(非穷尽性列表)包括以下：具有一个或多个布线的电连接部(电子装置)，便携式计算机盘盒(磁装置)，随机存取存储器( RAM )，只读存储器(ROM )，可擦除可编辑只读存储器( EPROM或闪速存储器)，光纤装置，以及便携式光盘只读存储器( CDROM )。另外，计算机可读介质甚至可以是可在其上打印所述程序的纸或其他合适的介质，因为可以例如通过对纸或其他介质进行光学扫描，接着进行编辑、解译或必要时以其他合适方式进行处理来以电子方式获得所述程序，然后将其存储在计算机存储器中。
以上所述仅为本申请的实施方式，并非因此限制本申请的专利范围，凡是利用本申请说明书及附图内容所作的等效结构或等效流程变换，或直接或间接运用在其他相关的技术领域，均同理包括在本申请的专利保护范围内。

Claims (10)

1.一种异形屏的显示电路，其特征在于，包括：
所述异形屏的异形区域中以非矩形方式阵列排布的多个像素电路，将位于每一行所述像素电路的两端处的像素电路作为边缘像素电路，其中相邻的两个所述边缘像素电路中的一个所述边缘像素电路连接第N级栅极信号线，另一个所述边缘像素电路连接第N+1级栅极信号线，所述N为大于0的自然数；
分压电路，分别与相邻的两个所述边缘像素电路连接，以使相邻的两个所述边缘像素电路的储存电压相等，所述分压电路的控制端与第N+M级栅极信号线连接，所述M为大于2的自然数；
其中，所述第N级栅极信号线传输的信号、所述第N+1级栅极信号线传输的信号、所述第N+M级栅极信号线传输的信号按照从前往后的顺序依次输出。
2.根据权利要求1所述的显示电路，其特征在于，所述显示电路包括所述异形屏的矩形区域中以矩形方式阵列排布的多个像素电路，以及所述异形屏中以非矩形方式阵列排布的多个像素电路。
3.根据权利要求1或2所述的显示电路，其特征在于，位于第N行所述像素电路的一端处的边缘像素电路包括第一边缘像素电路和第二边缘像素电路，所述第一边缘像素电路和所述第二边缘像素电路相邻；
所述第一边缘像素电路连接所述第N级栅极信号线，所述第二边缘像素电路连接所述第N+1级栅极信号线。
4.根据权利要求3所述的显示电路，其特征在于，将所述多个像素电路中除所述边缘像素电路外的像素电路作为非边缘像素电路，将与所述第一边缘像素电路或所述第二边缘像素电路位于同一行且相邻的非边缘像素电路作为近边缘像素电路；
相邻的所述第一边缘像素电路、所述第二边缘像素电路和所述近边缘像素电路连接同一级数据信号线。
5.根据权利要求1或2所述的显示电路，其特征在于，将位于第N行所述像素电路的一端处的边缘像素电路作为第一边缘像素电路，将位于第N+1行所述像素电路的一端处且与所述第一边缘像素电路相邻的边缘像素电路作为第二边缘像素电路；
所述第一边缘像素电路连接所述第N级栅极信号线，所述第二边缘像素电路连接所述第N+1级栅极信号线。
6.根据权利要求5所述的显示电路，其特征在于，将所述多个像素电路中除所述边缘像素电路外的像素电路作为非边缘像素电路，将与所述第一边缘像素电路位于同一行且相邻的非边缘像素电路作为第一近边缘像素电路，将与所述第二边缘像素电路位于同一行且相邻的非边缘像素电路作为第二近边缘像素电路；
相邻的所述第一边缘像素电路、所述第二边缘像素电路、所述第一近边缘像素电路和所述第二近边缘像素电路连接同一级数据信号线。
7.根据权利要求1或2所述的显示电路，其特征在于，所述M等于2。
8.根据权利要求1或2所述的显示电路，其特征在于，所述像素电路包括第一开关管和储存电容，所述第一开关管的驱动端连接相应栅极信号线，所述第一开关管的第一端连接相应数据信号线，所述第一开关管的第二端连接所述储存电容的第一端，所述储存电容的第二端连接相应公共电极。
9.根据权利要求8所述的显示电路，其特征在于，所述分压电路包括第二开关管，所述第二开关管的第一端连接所述相邻的两个所述边缘像素电路中的一个所述边缘像素电路中的所述储存电容的第一端，所述第二开关管的第二端连接所述相邻的两个所述边缘像素电路中的另一个所述边缘像素电路中的所述储存电容的第一端，所述第二开关管的驱动端连接所述第N+M级栅极信号线。
10.一种显示设备，其特征在于，包括背光模组和如权利要求1-9任一项所述的显示电路。
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