CN111797668A - 显示装置 - Google Patents

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CN111797668A
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刘敏钻
李冠锋
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Abstract

一种显示装置，具有一显示区域及相邻于该显示区域的一侧边区域。显示装置包括多个显示单元、多个感测单元、显示驱动器及感测驱动器。多个显示单元及多个感测单元设置于显示区域。显示驱动器耦接于多个显示单元的至少一部分，及包括多个第一薄膜晶体管。多个第一薄膜晶体管具有第一通道层。感测驱动器耦接于多个感测单元的至少一部分，及包括多个第二薄膜晶体管。多个第二薄膜晶体管具有第二通道层。多个第一薄膜晶体管的至少一部分及多个第二薄膜晶体管的至少一部分设置于侧边区域。

Description

显示装置
技术领域
本发明关于触控装置，特别是一种具有生物识别传感器的显示装置。
背景技术
信息安全和信息保密需求的持续成长推动如智能手机，笔记本计算机，平板计算机，银行设备和游戏机等电子装置使用生物识别。指纹识别为一种普遍用于生物识别的方式。近年来，各种电子装置已采用指纹传感器以由装置拥有者通过指纹认证来解锁电子装置，保护电子装置免受未经授权的存取。
传统上，指纹传感器与显示装置上的显示屏幕分开设置，所以在屏幕锁定显示装置上可以直接触摸指纹传感器而解锁显示装置。然而，显示装置制造商及用户都对于将指纹传感器结合至显示屏幕上有极大的兴趣，可增加显示装置的显示区域，及提供具有窄框或无框设计的显示装置。
因此需要一种结合在显示装置的生物识别传感器，减低显示装置的框尺寸同时提供生物识别来防止对显示装置的未授权访问。
发明内容
本发明实施例提供一种显示装置，具有一显示区域及相邻于该显示区域的一侧边区域。显示装置包括多个显示单元、多个感测单元、显示驱动器及感测驱动器。多个显示单元及多个感测单元设置于显示区域。显示驱动器耦接于多个显示单元的至少一部分，及包括多个第一薄膜晶体管。多个第一薄膜晶体管具有第一通道层。感测驱动器耦接于多个感测单元的至少一部分，及包括多个第二薄膜晶体管。多个第二薄膜晶体管具有第二通道层。多个第一薄膜晶体管的至少一部分及多个第二薄膜晶体管的至少一部分设置于侧边区域。
附图说明
图1为本发明实施例中一种显示装置的方块图。
图2显示图1中显示装置的电路布局实施例的俯视图。
图3显示图2中显示装置的电路布局实施例沿切线3-3’的剖面图。
图4显示图1中显示装置的另一电路布局实施例的俯视图。
图5显示图1中显示装置的另一电路布局实施例的俯视图。
图6显示图1中显示装置的另一电路布局实施例的俯视图。
图7显示图6中显示装置的电路布局实施例沿切线7-7’的剖面图。
图8显示图6中显示装置的电路布局实施例沿切线8-8’的剖面图。
图9为本发明实施例中栅极驱动器的电路图。
图10显示图1中重叠晶体管的另一电路布局实施例的俯视图。
图11显示图10中显示装置的电路布局实施例沿切线11-11’的剖面图。
图12显示图1中重叠晶体管的另一电路布局实施例的俯视图。
图13显示图12中显示装置的电路布局实施例沿切线13-13’的剖面图。
图14显示图1中显示装置的选定装置的剖面图。
图15至17显示图1中显示装置的电路布局实施例的三个剖面图。
附图标记说明：1-显示装置；10-显示区域；100-显示单元；102-显示驱动单元；102a、102b-显示驱动单元；104-感测单元；106-感测驱动单元；11-底边；12-侧边区域；12a至12c-侧边子区域；120-显示栅极驱动器；120a、120b-显示子栅极驱动器；122-感测栅极驱动器；122a、122b-感测子栅极驱动器；124-显示数据驱动器；126-感测数据驱动器；128-控制电路；14、70、1160、1400、Sa、Sb-基底；30-第二绝缘层；32-第一绝缘层；3-3’、7-7’、8-8’、11-11’、13-13’-切线；400、401、420、421、500、501、520、521-连接件；628-集成电路；71a,71b、110-屏蔽层；72,74,76-绝缘层；80-异方性导电胶；81-第一绝缘层；82-接触垫；83-第二绝缘层；84-异方性导电胶颗粒；85-连接件；9-栅极驱动器；110a、110b-屏蔽图样；1120a、1120b、1140a、1140b-通道区域；1122a至1122d、1142a至1142d-半导体层；1124、1144-连接件；1126a至1126d、1146a至1146d-源极/栅极件；1128a、1128b、1148a、1148b-栅极绝缘器；1162、1402-缓冲层；1164-第一绝缘层；1166-第一栅极绝缘层；1168-第一中间层介电质；1170-第二中间层介电质；1172-第二绝缘层；1174-第二栅极绝缘层；1176-第三中间层介电质；1178-第四中间层介电质；1180-第三绝缘层；1404-第一栅极绝缘体；1406-中间层介电质；1408-第一背部钝化层；1410-第二栅极绝缘体；1412-第二背部钝化层；1414-平面化层；1416-像素定位层；1418-阴极层；1419-无机层；1420-有机层；1421-无机层；1422-N+掺杂层；1424-P掺杂层；1426-第二栅极电极；1428-第二半导体层；1430-源极/漏极件；1432-光屏蔽层；1434-半导体层；1436-第二源极/漏极件；1438-栅极电极；1440-阳极层；1442-无机发光二极管层；Cc-电容；Ldd[1]至Ldd[3]-显示数据线；Ldr[1]及Ldr[2]-显示栅极线；Lsd[1]及Lsd[2]-感测数据线；Lsr[1]及Lsr[2]-感测栅极线；M1至M4、112a、112b、114a、114b、112a至112d、；114a至114d-晶体管；Pd(1,1)至Pd(2,3)-显示子像素；Ps(1,1)至Ps(2,2)-感测像素；Q(1)-节点；STV、CKV、GL1、GL2及VGL-信号；X、Y、Z-方向。
具体实施方式
以下实施例结合附图可清楚显示上述及其他技术内容、特征及本发明的效果。通过装置的具体实施方式将可进一步了解达到上述目的的技术手段及效果。此外应当理解本发明可由本领域技术人员来实施，所有等效变化或更改没有脱离权利要求所涵盖的本发明的概念。
此外，在说明书及权利要求中所使用的编号，例如“第一”、“第二”至“第六”等仅用于描述要求保护的元件，并非暗示或表示要求保护的元件具有先前编号，也并非暗示或表示权利要求的元件与另一要求保护的元件之间的序列或制造方法的步骤之间的序列。使用这些编号仅为了区分权利要求中具有相同名称的元件。当元件或层称为被“设置在”另一元件或层时，它可以被直接设置在另一元件或层或可存在中间元件。相反地，当一个元件称为被“直接设置在”另一元件或层时，中间元件或层不存在。实施例所用“耦接于”的术语是等同于本发明中“电连接”。
图1为本发明实施例中一种显示装置1的方块图。显示装置1具有显示区域10及相邻于显示区域10的侧边区域12。显示装置1具有生物识别传感器，生物识别传感器将影像显示及影像感测的功能结合于显示区域10之上。在一实施例中，显示装置1可以是液晶显示(liquid-crystal display，LCD)装置、有机发光二极管(organic light-emitting diode，OLED)显示装置、无机发光二极管显示装置、迷你发光二极管显示装置(例如迷你发光二极管面板装置、微发光二极管面板装置或量子点发光二极管面板装置)，但不限于此。在另一实施例中，显示区域10或显示装置1的形状可为正方形、方形、圆形或任意形状，但不限于此。显示区域10可为显示装置1的显示屏幕区域，及侧边区域12可为显示区域10之外的非显示区域的至少一部分。具体而言，显示装置1包括多个显示单元100、多个显示驱动单元102、多个感测单元104及多个感测驱动单元106，设置于显示区域10，及显示栅极驱动器120、感测栅极驱动器122、显示数据驱动器124、感测数据驱动器126及控制电路128，设置于侧边区域12。
多个显示驱动单元102可为薄膜晶体管，分别用于驱动多个显示单元100以在显示区域10上显示影像。多个感测驱动单元106可为薄膜晶体管，分别用于驱动多个感测单元104以在显示区域10上侦测影像，例如指纹。在一实施例中，至少一薄膜晶体管包括非晶硅(amorphous)薄膜晶体管、低温多晶硅(low-temperature polycrystalline silicon)薄膜晶体管或金属氧化物薄膜晶体管，但不限于此。显示栅极驱动器120可耦接于多个显示单元100的一部分，及可包括多个第一薄膜晶体管以通过对应显示驱动单元102选定显示单元100。显示数据驱动器124可耦接于多个显示单元100的该部分，及可包括多个多任务器或开关以将影像数据加载至选定的显示单元100。相似地，感测栅极驱动器122可耦接于多个感测单元104的一部分，及可包括多个第二薄膜晶体管以通过对应感测驱动单元106选定感测单元104。感测数据驱动器126可耦接于多个感测单元104的该部分，及可包括多个多任务器或开关以从选定的感测单元104读取侦测信号。控制电路128可为图像处理器、数字信号处理器、中央处理单元或微处理器。控制电路128可耦接于显示栅极驱动器120、感测栅极驱动器122、显示数据驱动器124及感测数据驱动器126以控制多个显示单元100及多个感测单元104。多个第一薄膜晶体管的至少一部分及多个第二薄膜晶体管的至少一部分设置于侧边区域12。
在本发明中，显示驱动器可为显示栅极驱动器120或显示数据驱动器124，而感测驱动器可为感测栅极驱动器122或感测数据驱动器126。图2至5及7至10提供显示装置1的多种电路布局实施例以显示显示驱动器及感测驱动器如何有效共享侧边区域12同时提供所需的信号质量。
图2显示显示装置1的电路布局实施例的俯视图，图3显示显示装置1的电路布局实施例沿切线3-3’的剖面图。图2显示显示装置1还包括阵列基底14。显示数据驱动器124、感测数据驱动器126及控制电路128共享侧边区域12。侧边区域12为环绕显示区域10的非显示区域的一部分，例如邻近设置于显示区域10的底边11的部分。从显示装置1的俯视方向，感测数据驱动器126可设置于显示数据驱动器124之上。图3显示显示装置1还包括第一绝缘层32及第二绝缘层30，依序设置于阵列基底14之上。图3的剖面图也显示感测数据驱动器126及显示数据驱动器124设置于阵列基底14之上，及从显示装置1的俯视方向至少部分重叠。第一绝缘层32及第二绝缘层30可包括氮化硅(silicon nitrides，SiNx)、氧化硅(siliconoxides，SiOx)或其组合，及可具有多层。
在图2中，俯视图显示显示子像素Pd(1,1)、Pd(1,2)、Pd(1,3)、Pd(2,1)、Pd(2,2)、Pd(2,3)及感测像素Ps(1,1)、Ps(1,2)、Ps(2,1)、Ps(2,2)可在显示区域10中以阵列形式、自由形式或其结合设置。每个显示子像素Pd(M,N)可包括显示单元100及显示驱动单元102，及可为红、绿、蓝(red，green，blue，RGB)子像素中的一者，其中M及N为正整数且分别表示显示子像素阵列的行(row)及列(column)索引。具体而言，RGB子像素可依据固定的交替子像素布局设置。控制电路128及显示数据驱动器124可通过显示数据线Ldd[1]耦接于第一列的显示子像素Pd(1,1)、Pd(2,1)，通过显示数据线Ldd[2]耦接于第二列的显示子像素Pd(1,2)、Pd(2,2)，及通过显示数据线Ldd[3]耦接于第三列的显示子像素Pd(1,3)、Pd(2,3)。相似地，每个感测像素Ps(P,Q)可包括感测单元104及感测驱动单元106，P及Q为正整数且分别表示感测子像素阵列的行及列索引。控制电路128及感测数据驱动器126可通过感测数据线Lsd[1]耦接于第一列的感测像素Ps(1,1)、Ps(2,1)，及通过感测数据线Lsd[2]耦接于第二列的感测像素Ps(1,2)、Ps(2,2)。显示子像素Pd(M,N)及感测像素Ps(P,Q)可沿阵列的每行交替设置，但不限于此。
感测数据驱动器126及显示数据驱动器124的重叠设置减少侧边区域12的面积，以降低显示装置1的大小。注意显示装置1的电路布局不限于图2及3的重叠设置，从显示装置1的俯视方向感测数据驱动器126及显示数据驱动器124也可不互相重叠。俯视方向为图2的观察方向。另外，从显示装置1的俯视方向观察，感测数据驱动器126及显示数据驱动器124可设置于显示区域10及控制电路128之间。除了用于传输显示数据的数据线切换电路及读取感测数据的读取切换电路，显示数据驱动器124及感测数据驱动器126的其他电路可与控制电路128整合以形成集成电路。显示数据驱动器124的数据线切换电路及感测数据驱动器126的读取切换电路可设置于显示区域10之上。显示子像素Pd(M,N)的数量及感测像素素Ps(P,Q)的数量不限于第2及3图所示，显示装置1可采用其他数量的显示子像素Pd(M,N)及感测像素Ps(P,Q)，及显示子像素Pd(M,N)阵列及感测像素Ps(P,Q)阵列的面积可相同或不同。
图4及5显示显示装置1的二种电路布局实施例，其中显示栅极驱动器120及感测栅极驱动器122共享侧边区域12及不互相重叠，及侧边区域12设置于显示装置1的一边(例如左边)。显示子像素Pd(M,N)及感测像素Ps(P,Q)的内部电路设置与图2相似，在此不再赘述。显示装置1的俯视面具有x方向(例如第一方向)及垂直于x方向的y方向(例如第二方向)。x方向与y方向大致上垂直，则可以视为垂直，x方向与y方向的夹角可以在80度到100度之间。俯视面为图4及5的观察面。
在图4中，显示栅极驱动器120及感测栅极驱动器122沿y方向设置。显示栅极驱动器120可通过显示栅极线Ldr[1]耦接至第一行的显示子像素Pd(M,N)，及通过显示栅极线Ldr[2]耦接至第二行的显示子像素Pd(M,N)。相似地，感测栅极驱动器122可通过感测栅极线Lsr[1]耦接于第一行的感测像素Ps(P,Q)，及通过感测栅极线Lsr[2]耦接于第二行的感测像素Ps(P,Q)。控制电路128通过连接件400、401、420、421耦接于显示栅极驱动器120及感测栅极驱动器122以分别选择每行显示子像素Pd(M,N)及每行感测像素Ps(P,Q)。
在一些实施例中，显示栅极线Ldr可以是扫描线。在一些实施例中，显示栅极线Ldr可以沿x方向(第一方向)沿伸，在另一实施例中，显示栅极线Ldr可以沿y方向(第二方向)沿伸。在图5中，显示栅极驱动器120及感测栅极驱动器122分别分为显示子栅极驱动器120a、120b及感测子栅极驱动器122a、122b。显示子栅极驱动器120a、120b及感测子栅极驱动器122a、122b沿y方向交替设置及对齐。在一些实施例中，显示子栅极驱动器120a、120b及感测子栅极驱动器122a、122b沿x方向(第一方向)交替设置及对齐。显示子栅极驱动器120a、120b及感测子栅极驱动器122a、122b可以数量不等的方式交替设置。例如3个显示子栅极驱动器及2个感测子栅极驱动器可交替设置。显示子栅极驱动器120a可通过显示栅极线Ldr[1]耦接至第一行的显示子像素Pd(M,N)，及显示子栅极驱动器120b可通过显示栅极线Ldr[2]耦接至第二行的显示子像素Pd(M,N)。相似地，感测子栅极驱动器122a可通过感测栅极线Lsr[1]耦接于第一行的感测像素Ps(P,Q)，及感测子栅极驱动器122b可通过感测栅极线Lsr[2]耦接于第二行的感测像素Ps(P,Q)。控制电路128分别通过连接件500、501、520、521耦接于显示子栅极驱动器120a、120b及感测子栅极驱动器122a、122b以分别选择每行显示子像素Pd(M,N)及每行感测像素Ps(P,Q)。
图4及5的感测数据驱动器126及显示数据驱动器124的电路布局提供显示装置1的窄框设计(较小的非显示区域或侧边区域12)。注意显示装置1的电路布局不限于图4及5，而显示栅极驱动器120及感测栅极驱动器122也可堆栈设置。另外，侧边区域12可分为第一侧边子区域及第二侧边子区域，分别设置于显示区域10的相对边，及显示栅极驱动器120及感测栅极驱动器122可分别分为2部分，以使显示栅极驱动器120的第一部分及感测栅极驱动器122的第一部分可设置于第一侧边子区域之内以控制一半显示单元100及一半感测单元104的扫描数据，及显示栅极驱动器120的第二部分及感测栅极驱动器122的第二部分可设置于第二侧边子区域之内以控制另一半显示单元100及另一半感测单元104的扫描数据。显示栅极驱动器120及感测栅极驱动器122的分开部分的电路布局设置于2侧边子区域的一者，且可以图4及5的布局形式设置。另外，除了数据线切换电路及读取切换电路，显示数据驱动器124及感测数据驱动器126的其他电路可与控制电路128整合为集成电路。显示数据驱动器124的数据线切换电路及感测数据驱动器126的读取切换电路可设置于显示区域10之上。显示子像素Pd(M,N)的数量及感测像素Ps(P,Q)的数量不限于图4及5，显示装置1可采用其他数量的显示子像素Pd(M,N)及感测像素Ps(P,Q)，及显示子像素Pd(M,N)阵列及感测像素Ps(P,Q)阵列的面积可相同或不同。显示装置1可采用图2至5中显示栅极驱动器120、感测栅极驱动器122、显示数据驱动器124及感测数据驱动器126的电路布局的任意结合。
图6显示显示装置1的另一电路布局实施例的俯视图。图7显示图6中显示装置1的电路布局实施例沿切线7-7’的剖面图。图8显示图6中显示装置1的电路布局实施例沿切线8-8’的剖面图。侧边子区域12a及12b沿x方向对齐及设置于显示区域10的相对边，及侧边子区域12c及显示区域10沿y方向对齐。在图6中，显示子栅极驱动器120a及感测子栅极驱动器122a于侧边子区域12a互相重叠，显示子栅极驱动器120b及感测子栅极驱动器122b于侧边子区域12b互相重叠。显示数据驱动器124、感测数据驱动器126及控制电路128整合为集成电路628，及集成电路628设置于侧边子区域12c。集成电路628可通过显示数据线Ldd[1]耦接于显示子像素Pd(1,1)、Pd(2,1)，通过显示数据线Ldd[2]耦接于显示子像素Pd(1,2)、Pd(2,2)，及通过显示数据线Ldd[3]耦接于显示子像素Pd(1,3)、Pd(2,3)。另外，集成电路628可通过感测数据线Lsd[1]耦接于感测像素Ps(1,1)、Ps(2,1)，及通过感测数据线Lsd[2]耦接于感测像素Ps(1,2)、Ps(2,2)。显示子像素Pd(M,N)及感测像素Ps(P,Q)的内部电路设置与图2相似，在此不再赘述。
虽然重叠的电路布局可产生紧凑的电路构造，但当重叠的电路切换状态时可能造成干扰及降低信号质量。如图7所示，为了减低干扰而在重叠的显示子栅极驱动器120a及感测子栅极驱动器122a之间及显示子栅极驱动器120b及感测子栅极驱动器122b之间提供屏蔽层71a,71b及/或绝缘层72,74,76。绝缘层76,74,72可依序设置在基底70之上，及包括有机材料、无机材料或其结合。屏蔽层71a设置于显示子栅极驱动器120a内之多个第一薄膜晶体管的至少一部分及感测子栅极驱动器122a内的多个第二薄膜晶体管的至少一部分之间。相似地，屏蔽层71b设置于显示子栅极驱动器120b内的多个第一薄膜晶体管的至少一部分及感测子栅极驱动器122b内的多个第二薄膜晶体管的至少一部分之间。具体而言，屏蔽层71a，71b可分别延伸遍布于显示子栅极驱动器120a,120b内的多个第一薄膜晶体管的至少一部分及感测子栅极驱动器122a,122b内的多个第二薄膜晶体管的至少一部分之间。另外，屏蔽层71a，71b可与显示子栅极驱动器120a,120b及感测子栅极驱动器122a,122b在图7的z方向重叠。在其他实施例中，屏蔽层71a，71b可设置于多个第一薄膜晶体管的至少一部分的每一者及其对应第二薄膜晶体管之间。在其他实施例中，屏蔽层71a，71b可设置于多个第一薄膜晶体管的至少一部分的通道区域及其多个第二薄膜晶体管的至少一部分的通道区域之间。在图8中，显示装置1可还包括异方性导电胶(anisotropic conductive film，ACF)80、第一绝缘层81、第二绝缘层83及连接件85。第二绝缘层83、第一绝缘层81、异方性导电胶80及集成电路628可依序设置于基底70上。第一绝缘层81及第二绝缘层83可包括氮化硅(silicon nitrides，SiNx)、氧化硅(silicon oxides，SiOx)或其组合，及可具有多层。
显示数据线Ldd[1],Ldd[2],Ldd[3]及感测数据线Lsd[1],Lsd[2]穿过不同层并通过通孔中的连接件85、接触垫82及ACF颗粒84耦接至集成电路628。接触垫82包括金属材料，例如铜、钨、银、锡、镍、铬、钛、铅、金、铋、锑、锌、锆、镁、铟、碲、镓、其他合适的金属材料、合金或其组合，但不受限于此。每个ACF颗粒84包括核心及外壳，核心由巨分子(macromolecule)形成，及外壳由金属或金属合金形成。外壳的金属可与接触垫82的金属相同。
图9为本发明实施例中栅极驱动器9的电路图。栅极驱动器9可做为显示栅极驱动器120或感测栅极驱动器122，可为当前行的显示单元100或感测单元104产生栅极线信号，及可包括晶体管M1至M4及电容Cc。信号STV、CKV、GL1、GL2及VGL分别为先前行栅极线信号、频率信号、当前行栅极线信号、后续行栅极线信号及接地参考信号。晶体管M1的源极或漏极经由节点Q(1)耦接于晶体管M2的栅极。在晶体管M1接收信号STV的高电压准位后，节点Q(1)被预充电至高电压准位。接着当信号CKV切换至逻辑高状态时晶体管M2被打开以将信号GL1拉到高电压准位，同时经由电容Cc将节点Q(1)的电压推至更高的电压。信号GL1的高电压被送到下个栅极驱动器9以让后续行将信号GL2拉至高电压准位。在侦测到信号GL2的高电压准位后，晶体管M3及M4被打开以将节点Q(1)的电压及信号GL1的电压拉至低电压准位，以完成信号GL1的脉冲。信号GL1可用以选定当前行的显示单元100或感测单元104。
图10及12显示另一电路布局实施例的重叠晶体管的俯视图。图11显示图10中显示装置1的电路布局实施例沿切线11-11’的颇面图。图13显示图12中显示装置1的电路布局实施例沿切线13-13’的剖面图。第10及11图显示屏蔽层110在重叠电路之间，及第12及13图显示重叠电路稍微交错且重叠电路之间没有屏蔽层。
在图10中，屏蔽层110***于显示栅极驱动器120及感测栅极驱动器122之间，且显示栅极驱动器120包括二晶体管114a,114b，感测栅极驱动器122包括二晶体管112a,112b。
在图11中，晶体管112a设置于晶体管114a之上，屏蔽图样110a直接设置于晶体管112a的通道区域1120a及晶体管114a的通道区域1140a之间，用以屏蔽晶体管112a及晶体管114a之间的信号耦合。晶体管112b设置于晶体管114b之上，屏蔽图样110b直接设置于晶体管112b的通道区域1120b及晶体管114b的通道区域1140b之间，用以屏蔽晶体管112b及晶体管114b之间的信号耦合。感测栅极驱动器122的所有晶体管的通道区域形成第一通道层，及显示栅极驱动器120的所有晶体管的通道区域形成第二通道层。另外，感测栅极驱动器122的通道区域及显示栅极驱动器120的通道区域之间的所有屏蔽图样110a/110b形成屏蔽层110。晶体管112a包括源极/漏极1126a,1126b、栅极绝缘层1128a及半导体层1122a,1122b。晶体管112b包括源极/漏极1126c,1126d、栅极绝缘层1128b及半导体层1122c,1122d。源极/漏极1126b经由连接件1124耦接于源极/漏极1126c。连接件1124可包括铝、铜、氧化铟锡(indium tin oxide，ITO)、钛及其结合。晶体管114a包括源极/漏极1146a,1146b、栅极绝缘层1148a及半导体层1142a,1142b。晶体管114b包括源极/漏极1146c,1146d、栅极绝缘层1148b及半导体层1142c,1142d。源极/漏极1146b经由连接件1144耦接于源极/漏极1146c。连接件1144可包括铝、铜、氧化铟锡、钛及其结合。显示装置1还包括依序设置的基底1160、缓冲层1162、第一绝缘层1164、第一栅极绝缘层1166、第一中间层介电质1168、第二中间层介电质1170、第二绝缘层1172、第二栅极绝缘层1174、第三中间层介电质1176、第四中间层介电质1178及第三绝缘层1180。第三绝缘层1180可包括有机材料。
在图12中，感测栅极驱动器122的4个晶体管112a,112b,112c,112d和显示栅极驱动器120的4个晶体管114a,114b,114c,114d交错。除了图13的晶体管112a,112b分别与晶体管114a,114b交错，图13和图11的晶体管112a,112b,114a,114b及显示装置1具有相似构造，因此晶体管112a,112b及晶体管114a,114b的信号切换不会互相造成干扰，也不需屏蔽层。此外，感测栅极驱动器122的所有晶体管的通道区域形成第一通道层，及显示栅极驱动器120的所有晶体管的通道区域形成第二通道层可以不互相重叠，也可以互相重叠，但不以此为限。
图14显示显示装置1的选定装置的剖面图，包括显示区域10及侧边区域12。显示单元100、显示驱动单元102a,102b、感测单元104及感测驱动单元106位于显示区域10内。显示数据驱动器124及感测数据驱动器126位于侧边区域12内。显示驱动单元102a或102b的第三通道层，及显示数据驱动器124的第一通道层及感测数据驱动器126的第二通道层的至少一者以相同程序形成，以简化制程及减低制造费用。例如显示驱动单元102a或102b的第三通道层的材料包括氧化铟镓锌(indium gallium zinc oxide，IGZO)、低温多晶硅或其结合。显示数据驱动器124的第一通道层的材料包括低温多晶硅。感测数据驱动器126的第二通道层的材料包括氧化铟镓锌。显示装置1包括基底1400、缓冲层1402、第一栅极绝缘体1404、中间层介电质1406、第一背部钝化层1408、第二栅极绝缘体1410、第二背部钝化层1412、平面化(planarization)层1414、像素定位层1416、阴极层1418、无机层1419、有机层1420、无机层1421、N+掺杂层1422、P掺杂层1424、第二栅极电极1426、第二半导体层1428、源极/漏极1430、光屏蔽层1432、半导体层1434、第二源极/漏极1436、栅极电极1438、阳极层1440及无机发光二极管(organic light-emitting diode，OLED)层1442。
图15至17显示显示装置1的电路布局实施例的三个剖面图，显示薄膜晶体管阵列相对于基底的三种电路布局。在图15中，多个显示单元100、多个感测单元104、显示子栅极驱动器120a,120b及感测子栅极驱动器122a,122b是设置于第一基底Sa之上及于第一基底Sa及第二基底Sb之间。在图16中，多个感测单元104、多个显示单元100、显示子栅极驱动器120a,120b及感测子栅极驱动器122a,122b是设置于第一基底Sa之上。在图17中，多个感测单元104设置于多个显示单元100之上，及显示子栅极驱动器120a,120b设置于感测子栅极驱动器122a,122b的下方，多个显示单元100、多个感测单元104、显示子栅极驱动器120a,120b及感测子栅极驱动器122a,122b设置于于二基底Sa，Sb之间。
图2至8、10至17的显示装置1的设置可将生物识别传感器整合入显示装置的显示面板，增加显示装置的显示区域或减低显示装置的边框大小，同时提供生物识别认证。
以上所述仅为本发明的实施例而已，并不用于限制本发明，对于本领域的技术人员来说，本发明可以有各种更改和变化。凡在本发明的精神和原则之内，所作的任何修改、等同替换、改进等，均应包含在本发明的保护范围之内。

Claims (20)

1.一种显示装置，具有一显示区域及相邻于该显示区域的一侧边区域，其特征在于，该显示装置包括:
多个显示单元及多个感测单元，设置于该显示区域；
一显示驱动器，耦接于该多个显示单元的至少一部分，及包括多个第一薄膜晶体管，该多个第一薄膜晶体管具有一第一通道层；及
一感测驱动器，耦接于该多个感测单元的至少一部分，及包括多个第二薄膜晶体管，该多个第二薄膜晶体管具有一第二通道层；
其中该多个第一薄膜晶体管的至少一部分及该多个第二薄膜晶体管的至少一部分设置于该侧边区域。
2.如权利要求1所述的显示装置，其特征在于，从该显示装置的一俯视方向该显示驱动器及该感测驱动器互相重叠。
3.如权利要求2所述的显示装置，其特征在于，还包括一屏蔽层，从该显示装置的一剖面方向设置于该多个第一薄膜晶体管的该至少一部分及该多个第二薄膜晶体管的该至少一部分之间。
4.如权利要求3所述的显示装置，其特征在于，从该显示装置的该剖面方向该屏蔽层延伸遍布该多个第一薄膜晶体管的该至少一部分及该多个第二薄膜晶体管的该至少一部分之间。
5.如权利要求3所述的显示装置，其特征在于，从该显示装置的该剖面方向该屏蔽层设置于该多个第一薄膜晶体管的该至少一部分的每一者及其对应第二薄膜晶体管之间。
6.如权利要求3所述的显示装置，其特征在于，该屏蔽层设置于该第一通道层及该第二通道层之间。
7.如权利要求1所述的显示装置，其特征在于，从该显示装置的一俯视方向该第一通道层及该第二通道层不互相重叠。
8.如权利要求1所述的显示装置，其特征在于，还包括多个第三薄膜晶体管，设置于该显示区域及包括一第三通道层，其中该第三通道层与该第一通道层及该第二通道层的至少一者以一相同程序形成。
9.如权利要求8所述的显示装置，其特征在于，该第一通道层及该第三通道层的一材料包括低温多晶硅。
10.如权利要求1所述的显示装置，其特征在于，还包括多条扫描线的至少一条，耦接于该多个显示单元的该至少一部分及该显示驱动器，及该多条扫描线的该至少一条沿一第一方向延伸，其中该显示驱动器及该感测驱动器沿垂直于该第一方向的一第二方向对齐。
11.如权利要求1所述的显示装置，其特征在于，还包括多条扫描线的至少一条，沿一第一方向耦接于该多个显示单元的该至少一部分及该显示驱动器，其中该显示驱动器及该感测驱动器沿该第一方向对齐。
12.如权利要求1所述的显示装置，其特征在于，该显示装置的一俯视面具有一第一方向及垂直于该第一方向的一第二方向，该侧边区域及该显示区域沿该第一方向对齐，该显示驱动器为一显示闸极驱动器，及该感测驱动器为一感测栅极驱动器。
13.如权利要求1所述的显示装置，其特征在于，该侧边区域包括二侧边子区域，分别设置于该显示区域的相对边。
14.如权利要求1所述的显示装置，其特征在于，该显示装置的一俯视面具有一第一方向及垂直于该第一方向的一第二方向，该侧边区域及该显示区域沿该第二方向对齐，该显示驱动器为一显示数据驱动器，及该感测驱动器为一感测数据驱动器。
15.如权利要求1所述的显示装置，其特征在于，还包括一控制电路，耦接于该显示驱动器及该感测驱动器，其中该控制电路包括一图像处理器、一数字信号处理器、一中央处理单元或一微处理器。
16.如权利要求15所述的显示装置，其特征在于，该显示驱动器及该感测驱动器分别为一显示数据驱动器及一感测数据驱动器，及该控制电路、该显示数据驱动器及该感测数据驱动器结合为一集成电路。
17.如权利要求1所述的显示装置，其特征在于，该多个显示单元及该多个感测单元交替设置于该显示区域。
18.如权利要求1所述的显示装置，其特征在于，该显示驱动器及该感测驱动器设置于一第一基底上。
19.如权利要求1所述的显示装置，其特征在于，该多个显示单元、该多个感测单元、该显示驱动器及该感测驱动器设置于一第一基底之上及于该第一基底及一第二基底之间。
20.如权利要求1所述的显示装置，其特征在于，该多个感测单元设置于该多个显示单元之上，该感测驱动器设置于该显示驱动器之上，及该多个显示单元、该多个感测单元、该显示驱动器及该感测驱动器设置于二基底之间。
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