CN110322843B - 一种goa单元、goa电路及显示面板 - Google Patents

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Abstract

本发明揭露了一种GOA单元、GOA电路及显示面板，所述GOA单元包括一上拉模块、一上拉维持模块、一反相模块、一下拉维持模块以及一下拉模块，各模块可以采用n型TFT实现；所述GOA单元可以产生显示面板内部补偿所需要的负向脉冲波形，且采用的结构、电路实现方式具有普适性。

Description

一种GOA单元、GOA电路及显示面板
技术领域
本发明涉及显示技术领域，尤其是涉及一种可以产生内部补偿所需要的负向脉冲时序的GOA单元、GOA电路及显示面板。
背景技术
随着显示面板的发展，人们追求更大屏幕、更高的分辨率、更刺激的视觉效果，这无疑对面板制程、材料以及工艺提出了更高的要求。OLED(organic light emittingdiode，有机电致发光二极管)显示面板是一种自发光的显示技术，具有视角宽、对比度高、功耗低、色彩鲜艳等优点。由于这些优势，AMOLED(active matrix organic lightemitting diode，有源有机电致发光二极管)显示面板在显示行业所占的比重正在逐年增加。TFT(Thin Film Transistor，薄膜晶体管)具有高空间利用效率、低消耗功率、无辐射以及低电磁干扰等优越特性。GOA(Gate Driver on Array，阵列基板栅极驱动)技术，是利用现有TFT的阵列(Array)基板制程将栅极驱动电路制作在阵列基板上，实现对栅极逐行扫描的驱动方式的一项技术。
由于GOA电路代替了外接芯片，从而可减少显示装置的制作程序，降低成本；同时，可以节省栅极芯片(Gate IC)，提高显示装置的集成度。IGZO(indium gallium zincoxide，铟镓锌氧化物)是用于新一代薄膜晶体管技术中的沟道层材料。IGZO由于迁移率高，均匀性好等优点而在大尺寸AMOLED显示面板中广泛使用。但由于其稳定性不佳，因此AMOLED显示面板上通常会使用补偿电路以保证显示面板的亮度均匀性。
请参阅图1A-图1B，其中，图1A为常规的5T2C内部补偿电路示意图，图1B为图1A所示电路的时序波形。
如图1A所示，所述内部补偿电路包括：一第一薄膜晶体管T11、一第二薄膜晶体管T12、一第三薄膜晶体管T13、一第四薄膜晶体管T14、一第五薄膜晶体管T15，一第一电容C11以及一第二电容C12。其中，所述第一薄膜晶体管T11的栅极与一第一发光控制信号EM1相连接，其第一极连接所述第二薄膜晶体管T12的第一极，其第二极与一第一电源电压VDD相连接；所述第二薄膜晶体管T12的栅极连接所述第五薄膜晶体管T15的第一极，其第二极连接所述第三薄膜晶体管T13的第一极以及所述第四薄膜晶体管T14的第二极；所述第三薄膜晶体管T13的栅极与一第二发光控制信号EM2相连接，其第二极连接一发光二极管OLED1的阳极，所述发光二极管OLED1的阴极与一第二电源电压VSS相连接；所述第四薄膜晶体管T14的栅极与一数据读控制信号RD相连接，其第一极与一感测信号Sensing相连接；所述第五薄膜晶体管T15的栅极与一数据写控制信号WR相连接，其第二极与一数据信号Data相连接；所述第一电容C11连接在所述第二薄膜晶体管T12的栅极与其第二极之间；所述第二电容C12连接在所述第一薄膜晶体管T11的第二极与所述第二薄膜晶体管T12的第二极之间。
如图1B所示，要完成AMOLED显示面板内部补偿，需要向所述内部补偿电路提供两种脉冲波形：一种为正向脉冲波形(WR/RD)，这种波形可以使用常规的IGZO_TFT的GOA电路产生；而另一种为负向脉冲波形(EM1/EM2)，这种波形通常需要使用p型的GOA电路才能正常生成，普适性不高。
因此，如何实现采用具有普适性的结构、电路实现方式，产生显示面板内部补偿所需要的负向脉冲波形，成为显示面板内部补偿亟待解决的技术问题。
发明内容
本发明的目的在于，解决现有技术存在的问题，提供一种GOA单元、GOA电路及显示面板，可以采用具有普适性的结构、电路实现方式，产生显示面板内部补偿所需要的负向脉冲波形。
为实现上述目的，本发明提供了一种GOA单元，所述GOA单元包括一上拉模块、一上拉维持模块、一反相模块、一下拉维持模块以及一下拉模块；所述上拉模块与一时钟信号端、一控制信号端以及一第一节点相连接，用于在所述时钟信号端的一第一电位信号的控制下，将所述控制信号端的信号输出至所述第一节点；所述上拉维持模块与一第一电压端、一第一输出端、一第二输出端以及所述第一节点相连接，用于在所述第一节点的控制下，将所述第一电压端的信号输出至所述第一输出端以及所述第二输出端；所述反相模块与一第二电压端、一第二节点、所述第一电压端以及所述第一节点相连接，用于在所述第一节点的控制下，将所述第一电压端或所述第二电压端的信号输出至所述第二节点；所述下拉维持模块与所述第二电压端、所述第二节点以及所述第一节点相连接，用于在所述第二节点的控制下，将所述第二电压端的信号输出至所述第一节点；所述下拉模块与所述时钟信号端、所述第二节点、所述第一输出端以及所述第二输出端相连接，用于在所述第二节点的控制下，将所述时钟信号端的一第二电位信号输出至所述第一输出端以及所述第二输出端。
为实现上述目的，本发明还提供了一种GOA电路，包括：级联的多个GOA单元；所述GOA单元采用本发明所述的GOA单元；除了第一级GOA单元以外，相邻两级GOA单元中的下一级GOA单元的控制信号端与上一级GOA单元的第二输出端相连接，所述第一级GOA单元的控制信号端与一控制信号源相连接；所有所述GOA单元中奇数级GOA单元中的一GOA单元的时钟信号端与一第一时钟信号源相连接，偶数级GOA单元的时钟信号端与一第二时钟信号源相连接，其中，所述第一时钟信号源的信号与所述第二时钟信号源的信号相位相反；所有所述GOA单元的第一电压端与一第一电压源相连接，所有所述GOA单元的第二电压端与一第二电压源相连接。
为实现上述目的，本发明还提供了一种显示面板，所述显示面板包括本发明所述GOA电路。
本发明的优点在于，本发明所述的GOA电路可以向显示面板内部补偿电路提供负向脉冲波形，且所述GOA单元可以基于N型薄膜晶体管制备，采用的结构、电路实现方式具有普适性。
附图说明
为了更清楚地说明本发明实施例中的技术方案，下面将对实施例描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其它的附图。
图1A为常规的5T2C内部补偿电路示意图；
图1B为图1A所示电路的时序波形。
图2，本发明GOA单元的架构示意图；
图3，本发明GOA单元一实施例的电路示意图；
图4A，本发明GOA电路一实施例的架构示意图；
图4B为图4A所示电路的工作时序图；
图5为图4A所示电路的输出波形仿真图。
具体实施方式
下面详细描述本发明的实施方式，所述实施方式的示例在附图中示出，其中自始至终相同或类似的标号表示相同或类似的元件或具有相同或类似功能的元件。下面通过参考附图描述的实施方式是示例性的，仅用于解释本发明，而不能理解为对本发明的限制。此外，本发明在不同例子中重复参考数字和/或参考字母，这种重复是为了简化和清楚的目的，其本身不指示所讨论各种实施方式和/或设置之间的关系。
请参阅图2，本发明GOA单元的架构示意图。所述GOA单元20包括一上拉模块21、一上拉维持模块22、一反相模块23、一下拉维持模块24以及一下拉模块25。
具体的，所述上拉模块21与一时钟信号端CK、一控制信号端Cout(n-1)以及一第一节点Qb相连接，用于在所述时钟信号端CK的一第一电位信号的控制下，将所述控制信号端Cout(n-1)的信号输出至所述第一节点Qb。所述控制信号端Cout(n-1)接收的信号可以为一控制信号源STV提供的信号，或为级联的GOA单元中的上一级GOA单元的第二输出端Cout(n-1)输出的信号。其中，n为大于1的正整数。其中，所述时钟信号端CK的第一电位信号为高电位(电位高于一预设电位值)信号。例如，当所述上拉模块21在所述时钟信号端CK的高电位信号的控制下导通时，所述控制信号端Cout(n-1)的信号为高电位，则所述第一节点Qb的信号为高电位；所述控制信号端Cout(n-1)的信号为低电位，则所述第一节点Qb的信号为低电位。
所述上拉维持模块22与一第一电压端VGH、一第一输出端G(n)、一第二输出端Cout(n)以及所述第一节点Qb相连接，用于在所述第一节点Qb的控制下，将所述第一电压端VGH的信号输出至所述第一输出端G(n)以及所述第二输出端Cout(n)。其中，所述第一电压端VGH提供高电位信号(电位高于一预设电位值)。例如，当所述上拉维持模块22在所述第一节点Qb的控制下导通时，所述第一电压端VGH的高电位信号通过所述上拉维持模块22传递到所述第一输出端G(n)以及所述第二输出端Cout(n)，使其输出高电位信号。其中，所述第一输出端G(n)以及所述第二输出端Cout(n)输出的信号相同，所述第一输出端G(n)输出的信号输入显示面板内，所述第二输出端Cout(n)输出的信号输入级联的GOA单元中的下一级GOA单元的控制信号端Cout(n+1)。
所述反相模块23与一第二电压端VGL、一第二节点Q、所述第一电压端VGH以及所述第一节点Qb相连接，用于在所述第一节点Qb的控制下，将所述第一电压端VGH或所述第二电压端VGL的信号输出至所述第二节点Q。其中，所述第二电压端VGL提供低电位信号(电位低于一预设电位值)。例如，当所述第一节点Qb为低电位时，所述第一电压端VGH的高电位信号通过所述反相模块23传递到所述第二节点Q，使其输出高电位信号；当所述第一节点Qb为高电位时，所述第二电压端VGL的低电位信号通过所述反相模块23传递到所述第二节点Q，使其输出低电位信号。
所述下拉维持模块24与所述第二电压端VGL、所述第二节点Q以及所述第一节点Qb相连接，用于在所述第二节点Q的控制下，将所述第二电压端VGL的信号输出至所述第一节点Qb。例如，当所述第二节点Q为高电位时，所述第二电压端VGL的低电位信号通过所述下拉维持模块24传递到所述第一节点Qb，使其维持低电位。
所述下拉模块25与所述时钟信号端CK、所述第二节点Q、所述第一输出端G(n)以及所述第二输出端Cout(n)相连接，用于在所述第二节点Q的控制下，将所述时钟信号端CK的一第二电位信号输出至所述第一输出端G(n)以及所述第二输出端Cout(n)。其中，所述时钟信号端CK的第二电位信号为低电位(电位低于一预设电位值)信号。例如，当所述时钟信号端CK输出低电位信号时，所述第一节点Qb维持低电位；此时当所述第二节点Q为高电位时，所述时钟信号端CK的低电位信号通过所述下拉模块25传递到所述第一输出端G(n)以及所述第二输出端Cout(n)，拉低其电位，从而使得所述第一输出端G(n)向显示面板内部补偿电路提供负向脉冲波形。其中，所述第一节点Qb的信号与所述第二节点Q的信号相位相反。
优选的，所述GOA单元可以基于N型薄膜晶体管制备，从而可以实现采用具有普适性结构、电路实现方式，向显示面板内部补偿电路提供负向脉冲波形。
请参阅图3，本发明GOA单元一实施例的电路示意图。
在本实施例中，所述上拉模块21包括：一第一晶体管T31；所述第一晶体管T31的栅极与所述时钟信号端CK相连接，其第一极与所述控制信号端Cout(n-1)相连接，其第二极与所述第一节点Qb相连接。当所述时钟信号端CK输出高电位信号时，控制所述第一晶体管T31导通，所述控制信号端Cout(n-1)的信号通过所述第一晶体管T31传递至所述第一节点Qb。若所述控制信号端Cout(n-1)的信号为高电位，则所述第一节点Qb的信号为高电位；若所述控制信号端Cout(n-1)的信号为低电位，则所述第一节点Qb的信号为低电位。
在本实施例中，所述上拉维持模块22包括：一第二晶体管T32以及一第三晶体管T33；所述第二晶体管T32的栅极与所述第一节点Qb相连接，其第一极与所述第一输出端G(n)相连接，其第二极与所述第一电压端VGH相连接；所述第三晶体管T33的栅极与所述第一节点Qb相连接，其第一极与所述第二输出端Cout(n)相连接，其第二极与所述第一电压端VGH相连接。其中，所述第一电压端VGH提供直流高压信号(电压高于一预设电压值)。在所述第一节点Qb输出高电位信号时，所述第二晶体管T32以及第三晶体管T33均导通；所述直流高压信号通过所述第二晶体管T32传递到所述第一输出端G(n)，使其输出高电位信号；所述直流高压信号同时通过所述第三晶体管T33传递到所述第二输出端Cout(n)，使其输出高电位信号。在其它实施例中，所述上拉维持模块22也可以仅采用一个晶体管，该晶体管的栅极与所述第一节点Qb相连接，其第一极同时与所述第一输出端G(n)及所述第二输出端Cout(n)相连接，其第二极与所述第一电压端VGH相连接，以在所述第一节点Qb的控制下，将所述第一电压端VGH的信号同时输出至所述第一输出端G(n)以及所述第二输出端Cout(n)。
在本实施例中，所述反相模块23包括：一第四晶体管T34、一第五晶体管T35、一第六晶体管T36以及一第七晶体管T37。所述第四晶体管T34的栅极与所述第一节点Qb相连接，其第一极与所述第二电压端VGL相连接，其第二极连接所述第六晶体管T36的第一极以及所述第七晶体管T37的栅极；所述第五晶体管T35的栅极与所述第一节点Qb相连接，其第一极与所述第二电压端VGL相连接，其第二极与所述第二节点Q相连接；所述第六晶体管T36的栅极和第二极均与所述第一电压端VGH相连接；所述第七晶体管T37的第二极与所述第一电压端VGH相连接。其中，所述第二电压端VGL提供直流低压信号(电压低于一预设电压值)。在所述第一节点Qb输出低电位信号时，所述第四晶体管T34、所述第五晶体管T35均关闭，所述直流高压信号通过所述第六晶体管T36、所述第七晶体管T37拉高所述第二节点Q的电位，使其输出高电位信号；在所述第一节点Qb输出高电位信号时，所述第四晶体管T34、所述第五晶体管T35均导通，所述直流低压信号通过所述第四晶体管T34、所述第五晶体管T35拉低所述第二节点Q的电位，使其输出低电位信号。
在本实施例中，所述下拉维持模块24包括：一第八晶体管T38；所述第八晶体管T38的栅极与所述第二节点Q相连接，其第一极与所述第二电压端VGL相连接，其第二极与所述第一节点Qb相连接。当所述第二节点Q为高电位时，所述第八晶体管T38导通，所述直流低压信号通过所述第八晶体管T38传递到所述第一节点Qb，使其维持低电位。
在本实施例中，所述下拉模块25包括：一第九晶体管T39以及一第十晶体管T30；所述第九晶体管T39的栅极与所述第二节点Q相连接，其第一极与所述时钟信号端CK相连接，其第二极与所述第一输出端G(n)相连接；所述第十晶体管T30的栅极与所述第二节点Q相连接，其第一极与所述时钟信号端CK相连接，其第二极与所述第二输出端Cout(n)相连接。当所述时钟信号端CK输出低电位信号时，所述第一节点Qb维持低电位；此时当所述第二节点Q为高电位时，所述第九晶体管T39、所述第十晶体管T30均导通，所述时钟信号端CK的低电位信号通过所述第九晶体管T39传递到所述第一输出端G(n)，拉低其电位，从而使得所述第一输出端G(n)向显示面板内部补偿电路提供负向脉冲波形；所述时钟信号端CK的低电位信号通过所述第十晶体管T30传递到所述第二输出端Cout(n)，拉低其电位。在其它实施例中，所述下拉模块25也可以仅采用一个晶体管，该晶体管的栅极与所述第二节点Q相连接，其第一极与所述时钟信号端CK相连接，其第二极同时与所述第一输出端G(n)及所述第二输出端Cout(n)相连接，以在所述第二节点Q的控制下，将所述时钟信号端CK的第二电位信号同时输出至所述第一输出端G(n)以及所述第二输出端Cout(n)。
优选的，上述第一～第十晶体管均采用N型薄膜晶体管。因此，当将上述GOA单元级联构成GOA电路时，可以向显示面板内部补偿电路提供负向脉冲波形，且结构、电路实现方式具有普适性。
请一并参阅图4A-图4B，其中，图4A为本发明GOA电路一实施例的架构示意图，图4B为图4A所示电路的工作时序图。
所述GOA电路包括级联的多个GOA单元，所述GOA单元采用本发明上述GOA单元；如图4A所示，以n+1个GOA单元级联为例进行说明，其中n为大于1的正整数。具体的，除了第一级GOA单元GOA(1)以外，相邻两级GOA单元中的下一级GOA单元GOA(n)的控制信号端Cout(n-1)与上一级GOA单元GOA(n-1)的第二输出端Cout(n-1)相连接；所述第一级GOA单元GOA(1)的控制信号端STV与一控制信号源STV1相连接。即所述GOA电路的最初一级GOA单元需要输入由控制信号源STV1提供的启动信号代替级传信号，作为GOA单元开启信号，之后的GOA单元由第二输出端Cout(n)输出的信号完成级联。所有所述GOA单元中奇数级GOA单元的时钟信号端CK与一第一时钟信号源CK1相连接，偶数级GOA单元的时钟信号端CK与一第二时钟信号源CK2相连接，其中，所述第一时钟信号源CK1的信号与所述第二时钟信号源CK2的信号相位相反。所有所述GOA单元的第一电压端VGH与一第一电压源VGH1相连接，所有所述GOA单元的第二电压端VGL与一第二电压源VGL1相连接。
以下采用如图4B所示工作时序驱动如图4A所述GOA电路。将所述GOA电路的运行分为1、2、3共计三个阶段。
阶段1：时钟信号端CK接收高电位，第一晶体管T31导通，控制信号源STV1通过第一晶体管T31对第一节点Qb输入低电位；第二晶体管T32、第三晶体管T33、第四晶体管T34、第五晶体管T35均关闭，第六晶体管T36、第七晶体管T37导通，第二节点Q经由第七晶体管T37被直流高压信号VGH1拉到高电位；第八晶体管T38、第九晶体管T39、第十晶体管T30均导通，时钟信号端CK的高电位维持第一输出端G(n)和第二输出端Cout(n)的高电位。
阶段2：时钟信号端CK接收的电位由高电位变为低电位，第一晶体管T31关闭；由于第二节点Q维持高电位，第八晶体管T38、第九晶体管T39、第十晶体管T30维持导通，第一节点Qb由直流低压信号VGL1通过第八晶体管T38继续维持低电位；时钟信号端CK的低电位通过第九晶体管T39、第十晶体管T30分别向第一输出端G(n)和第二输出端Cout(n)输出低电位，使得第一输出端G(n)输出负向脉冲波形。
阶段3：时钟信号端CK接收的电位由低电位变为高电位，第一晶体管T31导通，第一节点Qb被上一级GOA单元的第二输出端Cout(n-1)输出的高电位信号上拉到高电位；第二晶体管T32、第三晶体管T33、第四晶体管T34、第五晶体管T35均导通，第二节点Q被直流低压信号VGL1拉为低电位，第一输出端G(n)和第二输出端Cout(n)被直流高压信号VGH1拉为高电位；之后第一晶体管T31不断被时钟信号端CK的高电位信号打开，以维持第一节点Qb的高电位，保证GOA单元长时间输出高电位。
请参阅图5，其为图4A所示电路的输出波形仿真图。图中示意出61级GOA单元的三帧输出波形仿真图，由图5可以看出过了第一帧之后，每一级GOA单元都能正常的输出负向脉冲波形。
基于同一发明构思，本发明还提供了一种显示面板，包括如上所述的GOA电路，其具有与前述实施例提供的GOA电路相同的结构和有益效果。由于前述实施例已经对GOA电路的结构和有益效果进行了详细的描述，此处不再赘述。
需要说明的是，在本发明实施例中，所述显示面板具体至少可以包括液晶显示面板Micro-LED显示面板、OLED显示面板或AMOLED显示面板。例如，所述显示面板可以应用至液晶显示器、液晶电视、数码相框、手机或平板电脑等任何具有显示功能的产品或者部件中。
以上所述仅是本发明的优选实施方式，应当指出，对于本技术领域的普通技术人员，在不脱离本发明原理的前提下，还可以做出若干改进和润饰，这些改进和润饰也应视为本发明的保护范围。

Claims (10)

1.一种GOA单元，其特征在于，所述GOA单元包括一上拉模块、一上拉维持模块、一反相模块、一下拉维持模块以及一下拉模块；
所述上拉模块与一时钟信号端、一控制信号端以及一第一节点相连接，用于在所述时钟信号端的一第一电位信号的控制下，将所述控制信号端的信号输出至所述第一节点；
所述上拉维持模块与一第一电压端、一第一输出端、一第二输出端以及所述第一节点相连接，用于在所述第一节点的控制下，将所述第一电压端的信号输出至所述第一输出端以及所述第二输出端；
所述反相模块与一第二电压端、一第二节点、所述第一电压端以及所述第一节点相连接，用于在所述第一节点的控制下，将所述第一电压端或所述第二电压端的信号输出至所述第二节点；
所述下拉维持模块与所述第二电压端、所述第二节点以及所述第一节点相连接，用于在所述第二节点的控制下，将所述第二电压端的信号输出至所述第一节点；
所述下拉模块与所述时钟信号端、所述第二节点、所述第一输出端以及所述第二输出端相连接，用于在所述第二节点的控制下，将所述时钟信号端的一第二电位信号输出至所述第一输出端以及所述第二输出端。
2.如权利要求1所述的GOA单元，其特征在于，所述上拉模块包括：一第一晶体管；
所述第一晶体管的栅极与所述时钟信号端相连接，其第一极与所述控制信号端相连接，其第二极与所述第一节点相连接。
3.如权利要求1所述的GOA单元，其特征在于，所述上拉维持模块包括：一第二晶体管以及一第三晶体管；
所述第二晶体管的栅极与所述第一节点相连接，其第一极与所述第一输出端相连接，其第二极与所述第一电压端相连接；
所述第三晶体管的栅极与所述第一节点相连接，其第一极与所述第二输出端相连接，其第二极与所述第一电压端相连接。
4.如权利要求1所述的GOA单元，其特征在于，所述反相模块包括：一第四晶体管、一第五晶体管、一第六晶体管以及一第七晶体管；
所述第四晶体管的栅极与所述第一节点相连接，其第一极与所述第二电压端相连接，其第二极连接所述第六晶体管的第一极以及所述第七晶体管的栅极；
所述第五晶体管的栅极与所述第一节点相连接，其第一极与所述第二电压端相连接，其第二极与所述第二节点相连接；
所述第六晶体管的栅极和第二极均与所述第一电压端相连接；
所述第七晶体管的第二极与所述第一电压端相连接。
5.如权利要求1所述的GOA单元，其特征在于，所述下拉维持模块包括：一第八晶体管；
所述第八晶体管的栅极与所述第二节点相连接，其第一极与所述第二电压端相连接，其第二极与所述第一节点相连接。
6.如权利要求1所述的GOA单元，其特征在于，所述下拉模块包括：一第九晶体管以及一第十晶体管；
所述第九晶体管的栅极与所述第二节点相连接，其第一极与所述时钟信号端相连接，其第二极与所述第一输出端相连接；
所述第十晶体管的栅极与所述第二节点相连接，其第一极与所述时钟信号端相连接，其第二极与所述第二输出端相连接。
7.如权利要求1所述的GOA单元，其特征在于，所述GOA单元基于N型薄膜晶体管制备。
8.一种GOA电路，包括：级联的多个GOA单元；其特征在于，所述GOA单元采用如权利要求1-7任一项所述的GOA单元；
除了第一级GOA单元以外，相邻两级GOA单元中的下一级GOA单元的控制信号端与上一级GOA单元的第二输出端相连接，所述第一级GOA单元的控制信号端与一控制信号源相连接；
所有所述GOA单元中奇数级GOA单元中的一GOA单元的时钟信号端与一第一时钟信号源相连接，偶数级GOA单元的时钟信号端与一第二时钟信号源相连接，其中，所述第一时钟信号源的信号与所述第二时钟信号源的信号相位相反；
所有所述GOA单元的第一电压端与一第一电压源相连接，所有所述GOA单元的第二电压端与一第二电压源相连接。
9.一种显示面板，其特征在于，所述显示面板包括如权利要求8所述的GOA电路。
10.如权利要求9所述的显示面板，其特征在于，所述显示面板为液晶显示面板、Micro-LED显示面板、OLED显示面板或AMOLED显示面板。
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