CN109074778A - 像素感测装置及面板驱动装置 - Google Patents
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Abstract
本发明提供一种像素感测装置,用于感测布置于显示面板上的像素的特性,将像素的特性处理及转换成有效感测数据,以及将有效感测数据发射到外部装置。
Description
技术领域
本公开涉及用于感测布置于显示面板上的像素的特性及用于驱动这种显示面板的技术。
背景技术
显示装置可包括用于控制布置于面板上的像素的亮度的面板驱动装置,例如包括源驱动器及定时控制器的驱动装置。所述面板驱动装置可根据图像数据确定数据电压。此外,所述面板驱动装置可通过将所确定的数据电压供应到像素来控制每一像素的亮度。
同时,即使将相同数据电压供应到所述像素,每一像素的亮度也可能取决于每一像素的特性而不同。举例来说,像素可包括驱动晶体管,且当驱动晶体管的阈值电压变化时,即使将相同数据电压供应到所述像素,对应像素的亮度也会发生变化。如果面板驱动装置并不反映每一像素的这类特性,那么可能存在像素在用户并不想要的亮度下驱动的问题,且这可能降低显示面板的图像质量。
每一像素的特性可能随着时间推移或取决于周围环境而变化。然而,如果面板驱动装置供应数据电压而不反映每一像素的经改变特性,那么可能存在图像质量降低的问题,例如线缺陷(line defect)。
为了补救图像质量的降低,显示装置可更包括用于感测像素的特性的像素感测装置。像素感测装置可周期性地或非周期性地检查每一像素的特性且将所述特性发射到面板驱动装置。面板驱动装置取决于从像素感测装置发射的每一像素的特性值补偿数据电压,且这可能解决图像质量响应于每一像素的特性的变化而降低的问题。
顺便提一下,常规像素感测装置发射实际上通过感测像素产生的原始感测数据(raw sensing data)。然而,这种常规方法具有若干问题。
首先,常规方法归因于感测速率(rate)与数据发射速率之间的差异具有数据丢失或数据发射低效的问题。
具体地说,当指示每单位时间发射到面板驱动装置的数据的数目的数据发射速率低于指示每单位时间产生的原始感测数据的数目的感测速率时,所产生的原始感测数据的部分无法发射到面板驱动装置,即数据丢失。
相反地,当指示每单位时间发射到面板驱动装置的数据的数目的数据发射速率高于指示每单位时间产生的原始感测数据的数目的感测速率时,原始感测数据的部分可能双重地发射到面板驱动装置,即数据发射低效。
其次,根据常规方法,由于实际上所产生的原始感测数据发射到面板驱动装置,面板驱动装置具有移除包含于原始感测数据中的噪声或再处理原始感测数据以便获得仅所需信息的数据后处理的负荷。确切地说,由于像素数目随着显示装置的清晰度近年来变得更高而增加,且像素感测装置的数目也随着像素数目增加而增加,一个面板驱动装置,例如一个定时控制器必须处理从多个像素感测装置发射的所有原始感测数据。因此,面板驱动装置的数据后处理的负荷变得更大。
发明内容
技术问题
为此目的,本公开的方面在于提供用于关于像素提高高速地感测到的数据的利用率的技术。
本公开的另一方面在于提供用于关于像素补救因感测速率与数据发射速率之间的差异所致的数据丢失或数据发射低效的问题的技术。
本公开的另一方面在于提供用于减少面板驱动装置的操作负荷或数据后处理负荷的技术。
问题解决方案
为了实现上文所描述的一个方面,本公开提供一种像素感测装置,包括:感测部分,用于感测像素的亮度以及将原始感测数据(raw sensing data)存储到存储器,所述像素的亮度响应于对应于图像数据的数据电压受控制以产生所述原始感测数据;处理部分,用于通过处理或选择从存储器读取的至少一个原始感测数据产生有效感测数据(validsensing data);以及输出部分,用于使用关于所述像素的所述感测数据(sensing data)算出所述像素的特性值以及将至少一个有效感测数据发射到驱动控制电路,所述驱动控制电路响应于所述像素的所述特性值补偿应用于所述像素的所述图像数据。
在这种像素感测装置中,所述感测部分可能通过感测包含于所述像素中的有机发光二极管的电流、包含于所述像素中的驱动晶体管的电流或所述有机发光二极管与所述驱动晶体管的接触点处的电压产生所述原始感测数据。
另外,所述驱动控制电路可使用所述有效感测数据算出包含于所述像素中的所述驱动晶体管的阈值电压或迁移率作为所述像素的特性值。
为了实现上文所描述的另一方面,本公开提供一种面板驱动装置,包括:L个(L为2或更高的自然数)像素感测电路,各自用于感测像素以产生原始感测数据以及发射通过处理或选择至少一个原始感测数据产生的有效感测数据;以及驱动控制电路,通过一个总线与所述L个像素感测电路连接,所述驱动控制电路通过所述一个总线接收从每一像素感测电路依序发射的所述有效感测数据,使用所述有效感测数据算出所述像素的特性值,以及响应于所述特性值补偿应用于所述像素的所述图像数据。
本发明的效果
如上文所描述,本公开允许提高关于像素的特性高速地感测到的数据的利用率。此外,本公开允许补救因关于像素的感测速率与数据发射速率之间的差异所致的数据丢失或数据发射低效的问题。此外,本公开允许减少用于驱动像素的装置的操作负荷或数据后处理负荷。
附图说明
图1是本公开的实施例的显示装置的框图。
图2示出图1的每一像素的结构。
图3是像素感测电路及驱动控制电路的实例的框图。
图4是根据本公开的实施例的像素感测电路及驱动控制电路的内部的框图。
图5示出图4中示出的像素感测电路的感测到输出的处理流程。
图6及图7示出对包含于像素中的驱动晶体管的阈值电压的测量。
图8示出像素感测电路对噪声执行数据抑制。
图9是像素感测电路的一个发射周期中的操作序列的第一实例的定时图。
图10是像素感测电路的一个发射周期中的操作序列的第三实例的定时图。
图11是像素感测电路的一个发射周期中的操作序列的第二实例的定时图。
图12是根据本公开的另一实施例的像素感测电路的内部的框图。
图13是根据本公开的另一实施例的面板驱动装置的框图。
图14是示出根据本公开的另一实施例的感测及发射序列的定时图。
图15是使用进位信号控制发射定时的面板驱动装置的框图。
具体实施方式
在下文中,将参考附图详细描述本公开的实施例。在将参考标号添加到每一附图中的元件时,相同元件尽管在不同附图中示出也将尽可能由相同参考标号指定。另外,在本公开的以下描述中,当确定并入本文中的已知功能和配置的详细描述可能使本公开的主题相当不清晰时,将省略此描述。
另外,在描述本公开的组件时,可能在本文中使用例如第一、第二、A、B、(a)、(b)等的术语。这些术语仅用于区分一个结构元件与其它结构元件,并且对应结构元件的性质、次序、顺序等不受所述术语限制。当在说明书中描述一个组件“连接”、“耦合”或“接合”到另一组件时,应理解,第一组件可以直接连接、耦合或接合到第二组件,而且第三组件可以“连接”、“耦合”以及“接合”在第一组件与第二组件之间。
图1是本公开的实施例的显示装置的框图。
参考图1,显示装置(100)包括面板(110)、栅极驱动电路(120)、数据驱动电路(132)、像素感测电路(134)以及驱动控制电路(140)。
多个数据线(DL)、多个栅极线(GL)、多个感测线(SL)以及多个像素(P)可能安置在面板(110)上。
栅极驱动电路(120)可通过栅极线(GL)供应接通电压或断开电压的扫描信号。当将接通电压的这种扫描信号供应到像素(P)时,对应像素(P)连接到数据线(DL),且当将断开电压的扫描信号供应到像素(P)时,对应像素(P)从数据线(DL)断开。
栅极驱动电路(120)可被称作栅极驱动器,但本公开并不限于这一名称。
数据驱动电路(132)通过数据线(DL)供应数据电压。可取决于扫描信号将通过数据线(DL)供应的数据电压供应到与数据线(DL)连接的像素(P)。
像素感测电路(134)可感测每一像素(P)。具体地说,像素感测电路(134)可感测电特性值,例如形成于每一像素(P)中的电压、电流等。像素感测电路(134)可根据扫描信号与每一像素(P)连接或根据单独的感测信号与每一像素(P)连接。此处,感测信号可由栅极驱动电路(120)产生。
数据驱动电路(132)及像素感测电路(134)可以集成电路的形式实现,例如源极驱动器(130)。然而,本公开不限于此。
驱动控制电路(140)可将每一种类的控制信号供应到栅极驱动电路(120)、数据驱动电路(132)以及像素感测电路(130)。驱动控制电路(140)可响应于在每一帧中实现的定时产生使得扫描开始的栅极控制信号(GCS)且将所述控制信号发射到栅极驱动电路(120)。此外,驱动控制电路(140)可将从外部输入的图像数据转换成符合数据驱动电路(132)中所使用的数据信号形式的图像数据(RGB),且将其输出到数据驱动电路(132)。另外,驱动控制电路(140)可发射控制数据驱动电路(132)的数据控制信号(DCS)以使用正确定时将数据电压供应到每一像素(P)。另外,驱动控制电路(140)可将确定像素感测电路(134)的感测定时及发射定时的控制信号(未示出)发射到像素感测电路(134)。
驱动控制电路(140)可响应于每一像素(P)的特性补偿图像数据(RGB)且发射所述图像数据。此处,驱动控制电路(140)可从像素感测电路(134)接收感测数据(SENSE)以算出每一像素(P)的特性。
驱动控制电路(140)可被称作定时控制器,但本公开并不限于这一名称。
面板(110)可以是有机发光显示面板。此处,安置在面板(110)上的每一像素(P)可包括有机发光二极管(OLED:Organic Light Emitting Diode)及一或多个晶体管。这种有机发光二极管(OLED)及晶体管的特性可随着时间推移或响应于周围环境而变化,且像素感测电路(134)可感测包括在每一像素(P)中的这类元件的特性并将所述特性发射到驱动控制电路(140)。
图2示出图1的每一像素的结构。
参考图2,每一像素(P)可包括有机发光二极管(OLED)、驱动晶体管(DRT)、开关晶体管(SWT)、感测晶体管(SENT)以及存储电容器(Cstg)。
有机发光二极管(OLED)可由阳极电极、有机层以及阴极电极组成。有机发光二极管(OLED)根据驱动晶体管(DRT)的控制通过连接阳极电极与驱动电压(EVDD)且连接阴极电极与基极电压(EVSS)而发光。
驱动晶体管(DRT)可通过控制供应到有机发光二极管(OLED)的驱动电流来控制有机发光二极管(OLED)的亮度。
驱动晶体管(DRT)的第一节点(N1)可与有机发光二极管(OLED)的阳极电极电连接,且可以是源极节点或漏极节点。驱动晶体管(DRT)的第二节点(N2)可与开关晶体管(SWT)的源极节点或漏极节点电连接,且可以是栅极节点。驱动晶体管(DRT)的第三节点(N3)可与用于供应驱动电压(EVDD)的驱动电压线(DVL)电连接,且可以是漏极节点或源极节点。
开关晶体管(SWT)电连接在数据线(DL)与驱动晶体管(DRT)的第二节点(N2)之间,且可通过利用栅极线(GL)接收扫描信号来接通。
当开关晶体管(SWT)接通时,通过数据线(DL)供应的数据电压(Vdata)发射到驱动晶体管(DRT)的第二节点(N2)。
存储电容器(Cstg)可电连接在驱动晶体管(DRT)的第一节点(N1)与第二节点(N2)之间。
存储电容器(Cstg)可以是现存于驱动晶体管(DRT)的第一节点(N1)与第二节点(N2)之间的寄生电容器或有意地安置于驱动晶体管(DRT)外部的外部电容器。
感测晶体管(SENT)可电连接驱动晶体管(DRT)的第一节点(N1)及感测线(SL)以用于将参考电压(Vref)供应到第一节点(N1)且感测电特性值,例如第一节点(N1)的电压。
当感测到第一节点(N1)的电压时,可算出驱动晶体管(DRT)的阈值电压和迁移率(mobility)。另外,当感测到第一节点(N1)的电压时,可算出有机发光二极管(OLED)的劣化程度,例如有机发光二极管(OLED)的寄生电容。
参考图1描述的像素感测电路(参见图1中的134)可感测图2中所示出的第一节点(N1)的电压且将所述电压发射到驱动控制电路(140)。另外,驱动控制电路(140)可分析第一节点(N1)的电压且算出每一像素(P)的特性。
图3是像素感测电路及驱动控制电路的实例的框图。
参考图3,像素感测电路(10)可包括感测部分(11)、存储器(12)以及输出部分(13)。此外,驱动控制电路(20)可包括感测数据接收部分(21)、图像数据接收部分(22)、图像数据补偿部分(23)、查找表(24)以及图像数据输出部分(25)。
在像素感测电路(10)中,感测部分(11)可通过感测线(SL)感测像素并将感测到的原始感测数据(raw sensing data;rSENSE)存储在存储器(12)中。输出部分(13)可将存储在存储器(12)中的原始感测数据(rSENSE)发射到驱动控制电路(20)。
在驱动控制电路(20)中,感测数据接收部分(21)接收原始感测数据(rSENSE),且图像数据接收部分(22)从例如视频控制装置的外部装置接收原始图像数据(RGB′)。
在驱动控制电路(20)中,图像数据补偿部分(23)可使用关于每一像素的感测数据(sensing data)算出每一像素的特性值且响应于每一像素的特性值通过补偿原始图像数据(RGB′)产生图像数据(RGB)。
在另一方面,在驱动控制电路(20)中,感测数据接收部分(21)从像素感测电路(10)接收原始感测数据(rSENSE),且还执行原始感测数据(rSENSE)到图像数据补偿部分(23)中可使用的有效感测数据(valid sensing data;SENS)的转换。原始感测数据可含有噪声数据或不合适的数据。当这类噪声数据或不合适的数据实际上在图像数据补偿部分(23)中使用时,图像数据补偿部分(23)中所产生的图像数据的质量可能较差。因此,感测数据接收部分(21)通过处理或选择原始感测数据(rSENSE)产生适用于图像数据补偿部分(23)的有效感测数据(SENSE)。
图像数据补偿部分(23)可通过将这类有效感测数据(SENSE)应用到查找表(24)以检查将应用于每一像素的补偿值并将这一补偿值应用到原始图像数据(RGB′)来产生将发射到数据驱动电路(参见图1中的132)的图像数据(RGB)。图像数据输出部分(25)可将这类图像数据(RGB)发射到数据驱动电路(参见图1中的132)。
同时,在像素感测电路(10)中,指示每单位时间输出部分(13)发射的数据(图3中的原始感测数据rSENSE)的数目的数据发射速率可能低于指示每单位时间在感测部分(11)中所产生的原始感测数据(rSENSE)的数目的感测速率。相应地,尽管感测部分(11)高速地感测像素,但输出部分(13)无法高速地发射原始感测数据(rSENSE),因此,驱动控制电路(20)接收原始感测数据(rSENSE)的速率限于输出部分(13)的数据发射速率。
相反地,当数据发射速率高于感测速率时,感测数据的发射速率比产生原始感测数据(rSENSE)的速率更快。相应地,存在原始感测数据(rSENSE)的部分可能双重地发射的问题。
另外,由于像素感测电路(10)发射所有感测到的原始感测数据(rSENSE)而不管例如驱动控制电路(20)的其它装置接收原始感测数据(rSENSE)的必要性,存在其它装置的操作负荷增加的问题。
作为一实例,即使在驱动控制电路(20)可能仅需要感测到的数据当中具有最高值或最大值的数据时,像素感测电路(10)也发射所有原始感测数据(rSENSE),且驱动控制电路(20)从感测数据接收部分(21)接收的原始感测数据(rSENSE)选择所需的数据。相应地,数据发射负荷增加,且驱动控制电路(20)的操作负荷归因于数据选择而增加。另外,由于像素感测电路(10)发射实际上感测到的原始感测数据(rSENSE),驱动控制电路(20)的感测数据接收部分(21)具有去除包含于所接收的原始感测数据(rSENSE)中的噪声的数据后处理的负荷。
为了解决这些问题,本公开的实施例提供像素感测电路处理原始感测数据以产生有效感测数据并将所述有效感测数据发射到驱动控制电路的技术。
图4是根据本公开的实施例的像素感测电路及驱动控制电路的内部的框图。
参考图4,像素感测电路(134)可包括感测部分(410)、存储器(420)、输出部分(430)以及处理部分(440),且驱动控制电路(140)可包括感测数据接收部分(141)、图像数据接收部分(22)、图像数据补偿部分(23)、查找表(24)以及图像数据输出部分(25)。
在像素感测电路(134)中,感测部分(410)通过感测线(SL)感测像素的电特性值,例如图2中的第一节点(N1)的电压或电流。感测部分(410)可通过感测线(SL)接收模拟电信号,且感测部分(410)包含用以将这类模拟电信号转换成数字数据的模数转换器(ADC:Analog-Digital Converter)。感测部分(410)可通过模数转换器产生为数字数据的原始感测数据(rSENSE),且将所述原始感测数据存储在存储器(420)中。
在像素感测电路(134)中,处理部分(440)可读取存储于存储器(420)中的原始感测数据(rSENSE),处理所述原始感测数据(rSENSE)以产生有效感测数据(SENSE)。此处,所产生的有效感测数据(SENSE)的数目可能小于原始感测数据(rSENSE)的数目。当通过从原始感测数据(rSENSE)过滤噪声或去除数据的部分来产生有效感测数据(SENSE)时,有效感测数据(SENSE)的数目可能如上文所描述小于原始感测数据(rSENSE)的数目。
取决于实施例,有效感测数据(SENSE)的数目可能大于原始感测数据(rSENSE)的数目。当处理部分(440)分析原始感测数据(rSENSE)且从其导出较详细信息时,有效感测数据(SENSE)的数目可能大于原始感测数据(rSENSE)的数目。
作为数据后处理的一实例,处理部分(440)可通过过滤原始感测数据(rSENSE)产生有效感测数据(SENSE)。处理部分(440)可通过将移动平均(moving-average)法应用于原始感测数据(rSENSE)来产生有效感测数据(SENSE)。或者,处理部分(440)可通过使用低频带过滤、中频带过滤或高频带过滤从原始感测数据(rSENSE)过滤仅所要数据来产生有效感测数据(SENSE)。
处理部分(440)可再次将所产生的有效感测数据(SENSE)存储在存储器(420)中,且输出部分(430)可将存储于存储器(420)中的有效感测数据(SENSE)发射到例如驱动控制电路(140)的其它装置。
同时,感测部分(410)可以第一速率感测像素的电特性值。举例来说,感测部分(410)可以10MHz的速率感测像素的电特性值。当所有感测到的信号转换成原始感测数据(rSENSE)时,原始感测数据rSENSE可以10MHz的速率存储于存储器(420)中。
另外,处理部分(440)可对原始感测数据(rSENSE)执行后处理且产生可以第二速率发射的有效感测数据(SENSE)。此处,第二速率意指每单位时间发射的有效感测数据(SENSE)的数目。输出部分(430)可以第二速率发射这类有效感测数据(SENSE)。
此处第二速率可能比第一速率更慢。在此情况下,像素感测电路(134)可执行通过感测部分(410)以第一速率感测到的原始感测数据(rSENSE)的后处理,且以输出部分(430)的发射速率范围内的第二速率产生有效感测数据(SENSE)。以此方式,像素感测电路(134)可将高度可靠感测数据,即有效感测数据(SENSE)发射到例如驱动控制电路(140)的其它装置同时维持高速感测。
另外,根据像素的特性值补偿将应用于像素的图像数据的驱动控制电路(140)可接收有效感测数据(SENSE)而非原始感测数据(rSENSE),以便最小化因例如噪声过滤的额外操作所致的负荷。
具体地说,参考图4,驱动控制电路(140)的感测数据接收部分(141)可发射实际上从像素感测电路(134)接收到的有效感测数据(SENSE)而无对图像数据补偿部分(23)的额外操作。另外,其它元件(22、23、24、25)可执行与上文参考图3所描述的相同的功能。
如关于图4中示出的实施例所描述,像素感测电路(134)其内部操作将原始感测数据(rSENSE)转换成有效感测数据(SENSE)且将其发射到驱动控制电路(140),且这允许减少发射数据的负荷以及数据丢失并且最小化驱动控制电路(140)的操作负荷。
图5示出图4中示出的像素感测电路的感测到输出的处理流程。
参看图5,感测部分(410)可通过利用感测线(SL)感测像素,即感测像素的电特性值,产生原始感测数据(rDATA),且将所产生的原始感测数据(rDATA)存储在存储器(420)的第一块(424)中。
处理部分(440)可从第一块(424)读取原始感测数据(rDATA)且处理原始感测数据(rDATA)以产生有效感测数据(pDATA)。另外,处理部分(440)可将有效感测数据(pDATA)存储在存储器(420)的第二块(426)中。
输出部分(430)可将从第二块(426)读取的有效感测数据(pDATA)发射到驱动控制电路(140)。
举例来说,感测部分(410)每秒可产生A个原始感测数据(rDATA),且以每秒A个的速率将原始感测数据(rDATA)存储在第一块(424)中。处理部分(440)可关于原始感测数据(rDATA)执行数据后处理,且每秒产生B个有效感测数据(pDATA)。另外,处理部分(440)可以每秒B个的速率将有效感测数据(pDATA)存储在第二块(426)中。输出部分(430)可以每秒C个的速率读取有效感测数据(pDATA),且将所述有效感测数据发射到驱动控制电路(140)。
在此过程中,处理部分(440)的数据后处理可能类似于驱动控制电路(例如,在其功能方面为定时控制器)的数据后处理。举例来说,当像素感测电路如在常规方法中将实际上原始感测数据发射到驱动控制电路时,驱动控制电路执行过滤以去除噪声,且这类过滤可类似于由处理部分(440)执行的数据后处理。相应地,由于通过由处理部分(440)去除噪声获得的有效感测数据发射到驱动控制电路(140),驱动控制电路(140)并不需要执行噪声过滤,因此,驱动控制电路(140)的操作负荷减少。另外,由于输出部分(430)并不发射噪声数据,而是在无噪声的情况下发射有效感测数据,所以其数据发射负荷也减少。
感测部分(410)、处理部分(440)以及输出部分(140)可通过与从驱动控制电路(140)接收到的控制信号(CTR1、CTR2、CTR3)同步而操作。
感测部分(410)可根据由从驱动控制电路(140)接收到的第一控制信号(CTR1)引导的第一周期产生原始感测数据(rDATA)。第一控制信号(CTR1)可以是时钟信号,然而,其并不限于此。此处,第一周期可与指示每单位时间所产生的原始感测数据的数目的感测速率的倒数相同。
输出部分(140)可根据由从驱动控制电路(140)接收到的第二控制信号(CTR2)引导的第二周期发射有效感测数据(pDATA)。第二控制信号(CTR2)可以是时钟信号,然而,其并不限于此。此处,第二周期可与指示每单位时间所发射的有效感测数据的数目的数据发射速率的倒数相同。
处理部分(440)可根据由从驱动控制电路(140)接收到的第三控制信号(CTR3)引导的第三周期产生有效感测数据(pDATA)。第三周期可能长于或等于第一周期。第二周期可能长于或等于第三周期。
同时,处理部分可通过从在特定持续时间期间所产生的原始感测数据选择仅符合特定条件的数据来产生有效感测数据。
此处,可使用最大值或最小值的条件作为特定条件。举例来说,处理部分可通过从原始感测数据选择具有最大值或最小值的数据来产生有效感测数据。
可使用数据与其前一数据之间的差值在某一范围内的条件作为特定条件的另一实例。
举例来说,当驱动控制电路测量包含于像素中的驱动晶体管的阈值电压时,其在驱动晶体管的源极电压不存在变化时使用感测数据测量阈值电压。此处,处理部分可仅从原始感测数据选择数据以产生有效感测数据,所述数据与先前数据的差值在某一范围内,换句话说,此时不存在值变化的数据。在此情况下,驱动控制电路可仅接收所需数据,且这允许减少因不必要的数据所致的发射负荷及因数据选择所致的操作负荷。
下文参考图6及图7描述更多细节。
图6及图7示出对包含于像素中的驱动晶体管的阈值电压的测量。
参考图6及图7,当感测驱动晶体管(DRT)的阈值电压时,驱动晶体管(DRT)的源极电压(Vs)及栅极电压(Vg)分别初始化成用于感测阈值电压的参考电压(Vref)及数据电压(Vdata)。
随后,当停止供应参考电压(Vref)且驱动晶体管(DRT)的源极节点浮动(floating)时,源极电压(Vs)增大。驱动晶体管(DRT)的源极电压(Vs)的增大逐渐减轻,且随后源极电压在栅极-源极电压变成阈值电压(Vth)时饱和。
像素感测电路(134)可通过感测驱动晶体管(DRT)的源极电压(Vs)产生原始感测数据,从所述原始感测数据选择与先前数据的差值在某一范围内的数据,且发射到驱动控制电路。
像素感测电路(134)可不仅选择与先前数据的差值几乎接近0的数据(在图7中描述为T(n)及T(n-1)),而且选择与先前数据的差值对应于第一差值(Δv)的数据(在图7中描述为T(m)及T(m-1))且发射所述数据。在后一种情况下,尽管即使在接收有效感测数据的驱动控制电路中也存在用于选择数据的一些操作负荷,但在所述驱动控制电路中用于选择数据的自由度可有利地增大。
同时,像素感测电路,例如处理部分,可通过对原始感测数据当中满足特定条件的数据抑制(data rejection)产生有效感测数据。
图8示出像素感测电路对噪声执行数据抑制。
如图8中所示,在第一时间点(T(1))处感测到的数据与在先前时间点(即第二时间点(T(l-1)))处感测到的数据具有特定差值。此外,在第二时间点(T(l-1))处感测到的数据与在先前时间点(即第三时间点(T(1-2)))处感测到的数据具有特定差值(Δv)。在第二时间点(T(l-1))处感测到的数据是一次性噪声的数据。
像素感测电路可通过利用用于从原始感测数据去除与先前数据的差值在特定范围之外的数据的数据抑制产生有效感测数据以去除一次性噪声。
像素感测电路可通过原始感测数据的后处理产生有效感测数据,且随后将所述有效感测数据发射到驱动控制电路。由于像素感测电路首先处理处于原始数据状态的原始感测数据,因数据后处理所致的驱动控制电路的操作负荷可能减少。另外,由于像素感测电路通过后处理原始感测数据去除不必要的数据,例如噪声数据,且仅选择所需数据来产生有效感测数据,所以像素感测电路与驱动控制电路之间的发射负荷可能减少。
驱动控制电路使用从像素感测电路接收到的有效感测数据执行像素的补偿处理,且将通过补偿处理校正的图像数据发射到源极驱动器,例如数据驱动电路。顺便提一下,如上文所描述,由于在像素感测电路中执行例如噪声过滤或数据选择的数据后处理,所以驱动控制电路的操作负荷减少且更多操作资源可分配给像素补偿。
图9是像素感测电路的一个发射周期中的操作序列的第一实例的定时图。
参考图9,感测部分在一个发射周期中可依序产生N个(N为自然数)原始感测数据,且处理部分可依序产生N个有效感测数据。此处,原始感测数据及有效感测数据可交替地产生。举例来说,当感测部分产生一个原始感测数据时,处理部分可使用所产生的这一个原始感测数据产生一个有效感测数据。
输出部分可将在一个发射周期期间最后产生的有效感测数据,即第N个有效感测数据发射到驱动控制电路。
使用这种操作序列,存储器的大小可最小化。也就是说,由于原始感测数据及有效感测数据可能不断地由新产生的数据取代,所以其中存储有原始感测数据及有效感测数据的存储器的大小可最小化。此外,由于输出部分可发射实际上存储于存储器中的有效感测数据,所以发射周期可容易地改变。
图10是像素感测电路的一个发射周期中的操作序列的第三实例的定时图。
参考图10,感测部分在一个发射周期期间可依序产生N个(N为自然数)原始感测数据,且处理部分在一个发射周期期间可依序产生N个有效感测数据。与图9中的序列不同,原始感测数据的产生及有效感测数据的产生可并行处理。举例来说,当感测部分产生原始感测数据时,处理部分可产生有效感测数据。然而,由于产生有效感测数据需要至少一个原始感测数据,处理部分可仅在至少一个原始感测数据产生之后产生有效感测数据。相应地,在一个发射周期期间,感测部分的序列最先终止,且随后,处理部分的序列可终止。
输出部分可将在一个发射周期期间最后产生的有效感测数据,即第N个有效感测数据发射到驱动控制电路。
使用这种操作序列,存储器的大小可最小化,且一个发射周期可归因于并行处理而缩短。也就是说,由于原始感测数据及有效感测数据可能不断地由新产生的数据取代,所以其中存储有原始感测数据及有效感测数据的存储器的大小可最小化。此外,由于输出部分可发射实际上存储于存储器中的有效感测数据,所以发射周期可容易地改变。另外,由于感测部分及处理部分并行操作,所以一个发射周期可能缩短,或在一个发射周期期间,感测部分及处理部分的操作时间可能增加。
图11是像素感测电路的一个发射周期中的操作序列的第二实例的定时图。
参考图11,感测部分可在一个发射周期期间依序产生M个(M为2或更高的自然数)原始感测数据,且在一个发射周期期间在M个原始感测数据产生之后,处理部分可处理M个原始感测数据以产生有效感测数据。输出部分可将所产生的有效感测数据发射到驱动控制电路。
使用这种操作序列,处理部分的操作负荷可最小化。处理部分可关于M个原始感测数据利用仅一个操作产生有效感测数据,因此,处理部分的操作负荷可最小化。
图12是根据本公开的另一实施例的像素感测电路的内部的框图。
参考图12,像素感测电路(1200)可包括感测部分(1210)、存储器(1220)、输出部分(1230)以及处理部分(1240)。
感测部分(1210)通过感测线(SL)感测像素的特性值,例如图2中的第一节点(N1)的电压或电流。感测部分(1210)可通过感测线(SL)接收模拟电信号,且感测部分(1210)可包括用于将模拟电信号转换成数字数据的模数转换器(ADC:Analog-Digital Converter)。感测部分(1210)可通过模数转换器产生为数字数据的原始感测数据(rDATA),且将所述原始感测数据存储在存储器(1220)中。
处理部分(1240)可读取存储于存储器(1220)中的原始感测数据(rDATA),处理所述原始感测数据(rDATA),且产生有效感测数据(pDATA)。
处理部分(1240)可将所产生的有效感测数据(pDATA)发射到输出部分(1230)。
输出部分(1230)可将从处理部分(1240)直接接收到的有效感测数据(pDATA)发射到例如驱动控制电路(140)的其它装置。
感测部分(1210)可根据由从驱动控制电路(140)接收到的第一控制信号(CTR1)引导的第一周期产生原始感测数据(rDATA)。
处理部分(1240)可根据由从驱动控制电路(140)接收到的第二控制信号(CTR2)引导的第二周期产生有效感测数据(pDATA)。输出部分(1230)发射从处理部分(1240)直接接收到的有效感测数据(pDATA),因此,可实际上与第二控制信号(CTR2)结合操作。
图13是根据本公开的另一实施例的面板驱动装置的框图。
参考图13,面板驱动装置(1300)可包括驱动控制电路(1340)及L个(L为2或更高的自然数)像素感测电路(1334a、1334b、……、13341)。
驱动控制电路1340可通过一个接收总线(RXL)及一个发射总线(TXL)与L个像素感测电路(1334a、1334b、……、13341)连接。
驱动控制电路1340可通过接收总线(RXL)发射用于像素感测电路(1334a、1334b、……、13341)的控制信号。这类控制信号可包括前述第一控制信号(CTR1)、第二控制信号(CTR2)、第三控制信号(CTR3)等,且根据一实施例,第一控制信号(CTR1)、第二控制信号(CTR2)以及第三控制信号(CTR3)可通过与接收总线(RXL)分隔开的线发射。
每一像素感测电路(1334a、1334b、……、13341)可通过感测像素产生原始感测数据,且通过一个发射总线(TXL)将通过处理至少一个原始感测数据获得的有效感测数据发射到驱动控制电路(1340)。此外,每一像素感测电路(1334a、1334b、……、13341)可依序发射有效感测数据以防止数据在一个发射总线(TXL)中发生冲突。
作为一实例,第一像素感测电路(1334a)可首先将有效感测数据发射到驱动控制电路(1340),且第K个(K为2或更高的自然数,其小于或等于L)像素感测电路可在第(K-1)个像素感测电路发射有效感测数据之后发射有效发送数据。
驱动控制电路(1340)可通过比较像素感测电路的预定数目(L个)与有效感测数据的数目来检查是否所有L个像素感测电路(1334a、1334b、……、13341)均发射有效感测数据。
同时,显示装置可区分显示时间段与空白时间段且通过在显示时间段中驱动像素来显示图像。L个像素感测电路(1334a、1334b、……、13341)可在像素未经驱动的空白时间段中感测像素。L个像素感测电路(1334a、1334b、……、13341)可在空白时间段中发射有效感测数据。然而,在一些情况下,L个像素感测电路(1334a、1334b、……、13341)中的至少一个可在像素经驱动的显示时间段中发射有效感测数据。
L个像素感测电路(1334a、1334b、……、13341)可在同一感测时间段中感测像素,且分别在彼此不同的时间段中发射有效感测数据。
图14是示出根据本公开的另一实施例的感测及发射序列的定时图。
参看图14,L个像素感测电路(1334a、1334b、……、13341)可在同一感测时间段中感测像素N次。此外,L个像素感测电路(1334a、1334b、……、13341)可通过后处理在同一时间段中N次产生的原始感测数据来产生有效感测数据。
同时,L个像素感测电路(1334a、1334b、……、13341)可分别在彼此不同的时间段中发射有效感测数据,以便防止数据在发射总线中发生冲突。
此处,其中感测到像素的感测时间段可包含于空白时间段中,且当有效感测数据产生的持续时间及当有效感测数据发射的持续时间的一部分或所有可包含于显示时间段中。
每一像素感测电路(1334a、1334b、……、13341)可通过与进位(carry)信号同步发射有效感测数据。
图15是使用进位信号控制发射定时的面板驱动装置的框图。
参看图15,面板驱动装置(1500)可包括驱动控制电路(1540)及L个像素感测电路(1534a、1534b、……、15341)。
另外,驱动控制电路(1540)可通过一个接收总线(RXL)及一个发射总线(TXL)与L个像素感测电路(1534a、1534b、……、15341)连接。
驱动控制电路(1540)可通过接收总线(RXL)发射用于像素感测电路(1534a、1534b、……、15341)的控制信号。
此外,每一像素感测电路(1534a、1534b、……、15341)可通过感测像素产生原始感测数据,且通过一个发射总线(TXL)将通过处理至少一个原始感测数据产生的有效感测数据发射到驱动控制电路(1540)。此外,每一像素感测电路(1534a、1534b、……、15341)可依序发射有效感测数据以防止数据在一个发射总线(TXL)中发生冲突。
每一像素感测电路(1534a、1534b、……、15341)的发射定时可通过进位信号(CR)确定。
第一像素感测电路(1534a)可从驱动控制电路(1540)接收进位信号(CR),且第K个像素感测电路可从第(K-1)个像素感测电路接收进位信号(CR)。
第一像素感测电路(1534a)可通过进位信号线与驱动控制电路(1540)连接。第一像素感测电路(1534a)可通过这一进位信号线从驱动控制电路(1540)接收进位信号(CR)。
第K个像素感测电路可通过进位信号线与第(K-1)个像素感测电路连接。第K个像素感测电路可通过这一进位信号线从第(K-1)个像素感测电路接收进位信号(CR)。
在通过从第(K-1)个像素感测电路接收进位信号(CR)来发射有效感测数据之后,第K个像素感测电路可将进位信号(CR)发射到第(k+1)个像素感测电路以使下一像素感测电路可发射有效感测数据。
每一像素感测电路(1534a、1534b、……、15341)以这一次序发射进位信号(CR),且最后接收进位信号(CR)的第L个像素感测电路(15341)可将进位信号(CR)发射到驱动控制电路(140)。驱动控制电路(140)可检查所有像素感测电路(1534a、1534b、……、15341)是否通常通过所接收的进位信号(CR)发射有效感测数据。
同时,最后接收进位信号(CR)的第L个像素感测电路(15341)可能不将进位信号(CR)发射到外部。此处,驱动控制电路(140)可通过比较像素感测电路的预定数目(L个)与有效感测数据的数目来检查是否所有L个像素感测电路(1534a、1534b、……、15341)均发射有效感测数据。
如上文所描述,本公开允许提高关于像素的特性高速地感测到的数据的利用率。此外,本公开允许补救因关于像素的感测速率与数据发射速率之间的差异所致的数据丢失或数据发射低效的问题。此外,本公开允许减少用于驱动像素的装置的操作负荷或数据后处理负荷。
由于除非特意相反地描述,否则例如“包含”、“包括”以及“具有”的术语意味着对应元件可能存在,所以应理解,可另外包含其它元件,而非省略这类元件。所有技术、科学或其它术语与如本领域的技术人员所理解的含义一致地使用,除非有相反定义。如词典中所见的普通术语应在有关技术著作的上下文中加以解释,而不应过于理想化或脱离实际,除非本公开明确地对其那样定义。
尽管为了说明性目的而描述了本公开的优选实施例,但本领域的技术人员应了解,在不脱离所附权利要求所公开的实施例的范围和精神的情况下,各种修改、添加和替换都是可能的。因此,在本公开中公开的实施例旨在说明本公开的技术理念的范围,且本公开的范围不受所述实施例限制。本公开的范围应基于所附权利要求进行解释,其方式为使得包含在与权利要求等效的范围内的所有技术理念属于本公开。
相关申请案的交叉引用
本申请案要求于2016年4月26日提交的韩国专利申请案第10-2016-0050639号及于2017年4月21日提交的韩国专利申请案第10-2017-0051366号的优先权,所述专利申请案通过引用以其全文结合在此。
Claims (15)
1.一种像素感测装置,包括:
感测部分,用于感测像素的亮度以及将原始感测数据(raw sensing data)存储到存储器,所述像素的亮度响应于对应于图像数据的数据电压受控制以产生所述原始感测数据;
处理部分,用于通过处理或选择从所述存储器读取的至少一个原始感测数据产生有效感测数据(valid sensing data);以及
输出部分,用于使用关于所述像素的感测数据(sensing data)算出所述像素的特性值以及将至少一个有效感测数据发射到驱动控制电路,所述驱动控制电路响应于所述像素的所述特性值补偿应用于所述像素的所述图像数据。
2.根据权利要求1所述的像素感测装置,其中所述驱动控制电路使用所述有效感测数据算出包含于所述像素中的驱动晶体管的阈值电压或迁移率作为所述像素的特性值。
3.根据权利要求1所述的像素感测装置,其中所述感测部分通过感测包含于所述像素中的有机发光二极管的电流、包含于所述像素中的驱动晶体管的电流或所述有机发光二极管与所述驱动晶体管的接触点处的电压产生所述原始感测数据。
4.根据权利要求1所述的像素感测装置,其中每单位时间由所述感测部分产生的原始感测数据的数目大于每单元时间由所述输出部分发射的有效感测数据的数目。
5.根据权利要求1所述的像素感测装置,其中所述感测部分将所述原始感测数据存储在所述存储器的第一块中,所述处理部分将所述有效感测数据存储在所述存储器的第二块中,以及所述输出部分将从所述第二块读取的所述有效感测数据发射到所述驱动控制电路。
6.根据权利要求1所述的像素感测装置,其中所述输出部分从所述处理部分直接接收所述有效感测数据以及将所述有效感测数据发射到所述驱动控制电路。
7.根据权利要求1所述的像素感测装置,其中所述感测部分根据由从所述驱动控制电路接收到的第一控制信号引导的第一周期产生所述原始感测数据,以及所述输出部分根据由从所述驱动控制电路接收到的第二控制信号引导的第二周期发射所述有效感测数据。
8.根据权利要求7所述的像素感测装置,其中所述处理部分根据由从所述驱动控制电路接收到的第三控制信号引导的第三周期产生所述有效感测数据,以及所述第三周期长于或等于所述第一周期,以及所述第二周期长于或等于所述第三周期。
9.根据权利要求1所述的像素感测装置,其中所述感测部分在一个发射周期中依序产生N个(N为自然数)原始感测数据,所述处理部分在所述一个发射周期中依序产生N个有效感测数据,以及所述输出部分在所述一个发射周期中将第N个有效感测数据发射到所述驱动控制电路。
10.根据权利要求1所述的像素感测装置,其中所述感测部分在一个发射周期中依序产生M个(M为2或更高的自然数)原始感测数据,以及所述处理部分在所述一个发射周期中通过处理或选择所述M个原始感测数据产生所述有效感测数据。
11.一种面板驱动装置,包括:
L个(L为2或更高的自然数)像素感测电路,各自用于感测像素以产生原始感测数据以及发射通过处理或选择至少一个原始感测数据产生的有效感测数据;以及
驱动控制电路,通过一个总线与所述L个像素感测电路连接,所述驱动控制电路通过所述一个总线接收从每一像素感测电路依序发射的所述有效感测数据,使用所述有效感测数据算出所述像素的特性值,以及响应于所述特性值补偿应用于所述像素的图像数据。
12.根据权利要求11所述的面板驱动装置,其中所述L个像素感测电路在同一感测时间段中感测像素以及分别在彼此不同的时间段中发射所述有效感测数据。
13.根据权利要求11所述的面板驱动装置,其中所述L个像素感测电路通过与进位(carry)信号同步发射所述有效感测数据,第一像素感测电路从所述驱动控制电路接收所述进位信号,以及第K个(K为2或更高的自然数,其小于或等于L)像素感测电路从第(K-1)个像素感测电路接收所述进位信号。
14.根据权利要求13所述的面板驱动装置,其中所述驱动控制电路通过比较所述像素感测电路的预定数目与所述有效感测数据的数目检查是否所有所述L个像素感测电路均发射所述有效感测数据。
15.根据权利要求11所述的面板驱动装置,其中所述L个像素感测电路在所述像素未经驱动的空白时间段中感测所述像素,以及所述L个像素感测电路中的至少一个在所述像素经驱动的显示时间段中发射所述有效感测数据。
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