CN108269542A - 显示装置 - Google Patents
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Abstract
显示装置的显示面板的子像素电连接对应行的栅极线,数据线分别电连接同一个像素的两相邻子像素,在第一像素组中,第一栅极线与第三栅极线分别电连接同一列的子像素,第二栅极线与第四栅极线电连接同一列的子像素,在第二像素组中,第一栅极线与第四栅极线分别电连接同一列子像素,第二栅极线与第三栅极线分别电连接同一列子像素。在一个帧时间内,数据信号通过第n条数据线及第n+1条数据线驱动同一个像素的极性为相反,数据信号通过第n条数据线与第n+1条数据线驱动同一像素组的列方向相邻两个子像素的极性为相同。本申请可改善垂直串扰问题。
Description
技术领域
本申请关于一种显示装置,特别关于一种可改善垂直串扰问题的显示装置。
背景技术
随着科技的进步,平面显示装置已经广泛的被运用在各种领域,以液晶显示装置为例,因具有体型轻薄、低功率消耗及无辐射等优越特性,已经渐渐地取代传统阴极射线管显示装置,而应用至许多种类之电子产品中,例如行动电话、可携式多媒体装置、笔记型计算机、液晶电视及液晶屏幕等等。
液晶显示装置主要是利用电场控制液晶分子的旋转,让光线可穿过液晶分子而显示影像。其中,一个像素包含四种颜色的子像素排列(例如WRGB或其它颜色)因具有高穿透率的优势,目前已被市场所接受,各家厂商也都在这个基础上着手进行新技术的开发。随着显示器分辨率与扫描频率不断的提高,为了降低源极驱动IC的数量,在设计时有许多产品已将像素的排列由一条栅极线搭配一条数据线(1G1D)的垂直排列,改为二条栅极线搭配一条数据线:半源极驱动(half source driving,HSD)的方式,HSD技术除了可降低源极驱动IC的数量,也有助于产能的提升。
另外,为了提升开口率与视角,目前的产品倾向使用4区域(domain)的双像素呈现(two pixel rendering)技术,此技术是利用两个子像素的组合分别用不同电压来控制不同转向的液晶,以呈现一暗一亮的两个子像素。此外,为了使显示画面更均匀,习知技艺中也通过暗区的4区域子像素采用棋盘格方式排列且亮区的4个区域子像素在整体显示下包含正负两种不同极性的设计方式,来降低显示画面的闪烁。但是,这种像素设计的最大问题是,同颜色的子像素因寄生电容耦合无法在一个帧时间(frame time)内相互抵消,因此会造成显示画面的垂直串扰(crosstalk),导致画面品味的降低。
发明内容
有鉴于先前技术的不足,发明人经研发后得本申请。本申请的目的为提供一种显示装置,可改善垂直串扰所导致显示画面品味降低的问题。
本申请提出一种显示装置,显示装置包括一显示面板,显示面板包括多条栅极线、多条数据线、沿行方向与列方向排列的多个像素以及一驱动电路。多条数据线与多条栅极线交错设置,多条数据线包括一第n条数据线与一第n+1条数据线,n为奇数。沿行方向排列的多个子像素分别电连接对应行的两相邻栅极线,每一数据线分别电连接同一个像素的两相邻子像素,沿列方向排列的两个相邻像素分别形成一像素组,沿列方向排列的两个相邻像素组为一第一像素组与一第二像素组,第一像素组与第二像素组分别依序连接一第一栅极线、一第二栅极线、一第三栅极线和一第四栅极线,在第一像素组中,第一栅极线与第三栅极线分别电连接同一列的子像素,第二栅极线与第四栅极线分别电连接同一列的子像素,在第二像素组中,第一栅极线与第四栅极线分别电连接同一列的子像素,第二栅极线与第三栅极线分别电连接同一列的子像素,且第一像素组的第四栅极线和第二像素组的第一栅极线分别电连接的子像素位于同一列。驱动电路通过多条数据线传送一数据信号驱动多个像素;其中,在一个帧时间内,数据信号通过第n条数据线或第n+1条数据线驱动同一个像素的两相邻子像素的极性为相反,数据信号通过第n条数据线及第n+1条数据线驱动同一个像素的极性为相反,且数据信号通过第n条数据线与第n+1条数据线驱动同一像素组的列方向相邻的两个子像素的极性为相同。
在一实施例中,每一像素的多种颜色的子像素的颜色排列顺序相同。
在一实施例中,第n条数据线与第n+1条数据线连接同一个像素。
在一实施例中,在不同的像素组中,数据信号通过第n条数据线或第n+1条数据线驱动第一像素组与第二像素组沿列方向相邻的两个子像素的极性为相反。
在一实施例中,在每一个像素组中,与第n条数据线及第n+1条数据连接的同一个像素的两个相邻子像素的极性相同。
在一实施例中,同一行的每一个像素的多个子像素所呈现的电压极性顺序相同。
在一实施例中,每一像素包括沿行方向排列的四种颜色的子像素。
在一实施例中,第n条数据线所连接的子像素的颜色依序为WRWRRWWR,并重复此顺序,第n+1条数据线所连接的子像素的颜色依序为GBGBBGGB,并重复此顺序,其中W为白色、R为红色、G为绿色、B为蓝色。
在一实施例中,在一个帧时间内,驱动电路使列方向相邻两个像素中的其中一个像素为亮区,另一个像素为暗区,且沿列方向排列的同一种颜色的亮区子像素所呈现的正负极性比例为1:1。
本申请另提出一种显示装置,显示装置包括一显示面板,显示面板包括多组栅极线、多条数据线、沿行方向与列方向排列的多个像素以及一驱动电路。多条数据线与多条栅极线交错设置,多条数据线包括一第n条数据线与一第n+1条数据线,n为奇数。每一像素包括沿行方向排列的四种颜色的子像素,每一像素的多种颜色的子像素的颜色排列顺序相同,沿行方向排列的多个子像素分别电连接对应行的两相邻栅极线,每一数据线分别电连接同一个像素的两相邻子像素,沿列方向排列的两个相邻像素分别形成一像素组,列方向排列的两个相邻像素组为一第一像素组与一第二像素组,第一像素组与第二像素组分别依序连接一第一栅极线、一第二栅极线、一第三栅极线和一第四栅极线,在第一像素组中,第一栅极线与第三栅极线分别电连接同一列的子像素,第二栅极线与第四栅极线分别电连接同一列的子像素,在第二像素组中,第一栅极线与第四栅极线分别电连接同一列的子像素,第二栅极线与第三栅极线分别电连接同一列的子像素,且第一像素组的第四栅极线和第二像素组的第一栅极线分别电连接的子像素位于同一列。驱动电路通过多条数据线传送一数据信号驱动多个像素;其中,在一个帧时间内,数据信号通过第n条数据线或第n+1条数据线驱动同一个像素的两相邻子像素的极性为相反,数据信号通过第n条数据线及第n+1条数据线驱动同一个像素的极性为相反,且数据信号通过第n条数据线与第n+1条数据线驱动同一像素组的列方向相邻的两个子像素的极性为相同,驱动电路使列方向相邻两个像素中的其中一个像素为亮区,另一个像素为暗区,且沿列方向排列的同一种颜色的亮区子像素所呈现的正负极性比例为1:1。
承上所述,本申请的显示装置提出一种新的像素驱动排列方式,而且在多种颜色子像素与半源极驱动技术的连接架构下,可使一帧时间内沿列方向(垂直方向)排列的同一种颜色的亮区子像素所呈现的正负极性比例为1:1,以此正负极性相互抵消显示面板因寄生电容耦合所造成的垂直串扰问题,借此使显示画面更均匀,提升画面品味。
附图说明
所包括的附图用来提供对本申请实施例的进一步的理解,其构成了说明书的一部分,用于例示本申请的实施方式,并与文字描述一起来阐释本申请的原理。显而易见地,下面描述中的附图仅仅是本申请的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动性的前提下,还可以根据这些附图获得其他的附图。在附图中:
图1为本申请一实施例之一种显示装置的功能方块图。
图2A与图2B分别为本申请一实施例的显示面板的像素与栅极线和数据线的连接示意图。
图3为图2B的子像素与栅极线和数据线的连接架构中,一个帧时间内的数据信号对应栅极线的波形示意图。
图4A至图4D分别为一实施例的显示装置的四种颜色滤光层的制作工序示意图。
具体实施方式
这里所公开的具体结构和功能细节仅仅是代表性的,并且是用于描述本申请的示例性实施例的目的。但是本申请可以通过许多替换形式来具体实现,并且不应当被解释成仅仅受限于这里所阐述的实施例。
在本申请的描述中,需要理解的是,术语“中心”、“横向”、“上”、“下”、“左”、“右”、“竖直”、“水平”、“顶”、“底”、“内”、“外”等指示的方位或位置关系为基于附图所示的方位或位置关系,仅是为了便于描述本申请和简化描述,而不是指示或暗示所指的装置或元件必须具有特定的方位、以特定的方位构造和操作,因此不能理解为对本申请的限制。此外,术语“第一”、“第二”仅用于描述目的,而不能理解为指示或暗示相对重要性或者隐含指明所指示的技术特征的数量。由此,限定有“第一”、“第二”的特征可以明示或者隐含地包括一个或者更多个该特征。在本申请的描述中,除非另有说明,“多个”的含义是两个或两个以上。另外,术语“包括”及其任何变形,意图在于覆盖不排他的包含。
在本申请的描述中,需要说明的是,除非另有明确的规定和限定,术语“安装”、“相连”、“连接”应做广义理解,例如,可以是固定连接,也可以是可拆卸连接,或一体地连接;可以是机械连接,也可以是电连接;可以是直接相连,也可以通过中间媒介间接相连,可以是两个元件内部的连通。对于本领域的普通技术人员而言,可以具体情况理解上述术语在本申请中的具体含义。
这里所使用的术语仅仅是为了描述具体实施例而不意图限制示例性实施例。除非上下文明确地另有所指,否则这里所使用的单数形式“一个”、“一项”还意图包括复数。还应当理解的是,这里所使用的术语“包括”和/或“包含”规定所陈述的特征、整数、步骤、操作、单元和/或组件的存在,而不排除存在或添加一个或更多其他特征、整数、步骤、操作、单元、组件和/或其组合。
以下将参照相关图式,说明依本申请一些实施例之显示装置,其中相同的组件将以相同的参照符号加以说明。
图1为本申请一实施例之一种显示装置1的功能方块图。如图1所示,本实施例的显示装置1为一液晶显示装置,并可包括一显示面板11以及一驱动电路12。显示面板11上包括有沿行方向与列方向排列的多个像素(pixels)、多条栅极线(G1、G2、…)及多条数据线(或称源极线,D1、D2、D3、…),多条栅极线和多条数据线交错设置并分别电连接多个像素,每一像素可包括沿行方向排列的多种颜色的子像素(Sub-pixels)。
驱动电路12和显示面板11电性连接,并可驱动显示面板11的多个像素显示影像。本实施例的驱动电路12可包含一扫描驱动单元121、一数据驱动单元122及一时序控制单元123。扫描驱动单元121可通过该些栅极线和显示面板11耦接,而数据驱动单元122可通过该些数据线和显示面板11耦接。扫描驱动单元121可分别输出扫描信号导通该些栅极线,而数据驱动单元122可输出与该些数据线对应的多个数据信号驱动对应的该些像素。另外,显示装置1更可包括一时序控制单元123,时序控制单元123可传送垂直同步信号及水平同步信号至扫描驱动单元121,并将自外部接口所接收的视讯信号转换成数据驱动单元122所用的数据信号,并传送数据信号及水平同步信号至数据驱动单元122。在一个帧时间(frametime)内,当该些栅极线分别依序被该些扫描信号导通时,数据驱动单元122可将对应每一行子像素的数据信号通过该些数据线传送至各子像素,使显示面板11显示影像。
请参照图2A与图2B所示,其分别为一实施例的显示面板的像素与栅极线和数据线的连接示意图。图2A和图2B显示了相同的连接架构,但是,图2B还显示各像素的子像素的亮暗状况(虚线呈现的子像素为暗区)。在图2A和图2B中显示了8条栅极线G1~G8、4条数据线D1~D4和4行(横)共8个像素(32个子像素P)为例,然并不以此为限,在不同的实施例中,可依据实际需求设计更多的栅极线、数据线和像素数量。
在图2A中,8条栅极线G1~G8可区分成4组栅极线组(以虚线围起来),每一组有二条栅极线,即(G1,G2)、(G3,G4)、…(G7,G8),而4条数据线分别以D1~D4表示,而且显示面板11具有沿行方向(水平方向)与列方向(垂直方向)排列的多个像素,其中,每一个像素具有沿行方向排列的多个子像素P,且沿行方向排列的多个子像素P分别电连接对应行的两相邻栅极线(栅极线组),每一数据线分别电连接同一个像素的两相邻子像素P。具体来说,例如栅极线(G1、G2),其可同时驱动第一行的两个像素(每一像素包含白色(W)、红色(R)、绿色(G)与蓝色(B)共4个子像素P),而栅极线(G3、G4)可同时驱动第二行的两个像素,数据线D1、D2、D3、D4分别电连接同一个像素的两相邻子像素P,即每一像素也分别和二条数据线电连接,以此类推。如图2A所示,每一条数据线连接同一个像素中的两个相邻的子像素P,因此,本实施例的显示装置1采用的是半源极驱动(HSD)技术,除了可降低源极驱动IC的数量,也有助于产能的提升。
本实施例的每一像素包括沿行方向排列的四种颜色(WRGB)的子像素P,而每一像素的多种颜色的子像素P的颜色排列顺序都相同,且同一列的子像素P的颜色皆相同。此外,在连接同一个像素的相邻的两条数据线:第n条数据线与第n+1条数据线中,以D(n)与D(n+1)表示(n为奇数),数据线D(n)连接的子像素P的颜色由上到下依序为WRWRRWWR,并重复此顺序;而数据线D(n+1)连接的子像素P的颜色由上而下依序为GBGBBGGB,并重复此顺序。
另外,沿列方向排列的两个相邻像素可分别形成一像素组T(以虚线围起来)。以左上角的像素组(标示为T1)为例,上半部像素的子像素P依序具有WRGB的直条式(Stripe)排列,且下半部像素的子像素P与上半部相同,也依序具有WRGB的排列。另外,在像素组T1中,上半部的四个子像素P分别电连接对应行的同一组的栅极线G1、G2与对应列的相邻两条数据线D1、D2,而下半部的四个子像素P分别电连接对应行的同一组的栅极线G3、G4与对应列的相邻两条数据线D1、D2。上述每一像素的颜色是以WRGB为例,然不以此为限,在不同的实施例中,也可为不同的四种颜色,例如RGBY、RGBC,或其它,并不限制。
沿列方向排列的两个相邻像素组可为一第一像素组T1与一第二像素组T2,而第一像素组T1与第二像素组T2分别依序连接一第一栅极线、一第二栅极线、一第三栅极线和一第四栅极线。换句话说,在本实施例中,如图2A所示,第一像素组T1依序连接第一栅极线(G1)、第二栅极线(G2)、第三栅极线(G3)和第四栅极线(G4),第二像素组T2也依序连接第一栅极线(G5)、第二栅极线(G6)、第三栅极线(G7)和第四栅极线(G8)。在第一像素组T1中,第一栅极线(G1)与第三栅极线(G3)分别电连接同一列的子像素P,第二栅极线(G2)与第四栅极线(G4)分别电连接同一列的子像素P。在第二像素组T2中,第一栅极线(G5)与第四栅极线(G8)分别电连接同一列的子像素P,第二栅极线(G6)与第三栅极线(G7)分别电连接同一列的子像素P,且第一像素组T1的第四栅极线(G4)和第二像素组T2的第一栅极线(G5)分别电连接的子像素P位于同一列上,同时与同一条数据线(D1)电连接。
在本实施例中,第一像素组T1的第一栅极线(G1)分别电连接第一行像素的奇数子像素P,第二栅极线(G2)分别电连接第一行像素的偶数子像素P,第三栅极线(G3)分别电连接第二行像素的奇数子像素P,第四栅极线(G4)分别电连接第二行像素的偶数子像素P;在第二像素组T2中,第一栅极线(G5)分别电连接第三行像素的偶数子像素P,第二栅极线(G6)分别电连接第三行像素的奇数子像素,第三栅极线(G7)分别电连接第四行像素的奇数子像素P,且第四栅极线(G8)分别电连接第四行像素的偶数子像素P,以此类推。但本申请不以上述为限,在不同的实施例中,第一像素组T1的第一栅极线(G1)可分别电连接第一行像素的偶数子像素P,第二栅极线(G2)可分别电连接第一行像素的奇数子像素P(奇数和偶数是由左到右算起),第三栅极线(G3)可分别电连接第二行像素的偶数子像素P,第四栅极线(G4)可分别电连接第二行像素的奇数子像素P;而第二像素组T2的第一栅极线(G5)可分别电连接第三行像素的奇数子像素P,第二栅极线(G6)可分别电连接第三行像素的偶数子像素,第三栅极线(G7)可分别电连接第四行像素的偶数子像素P,且第四栅极线(G8)可分别电连接第四行像素的奇数子像素P。
此外,每一个像素可包括一第一子像素P、一第二子像素P、一第三子像素P与一第四子像素P,每一个像素中的第一个子像素P和第二个子像素P与对应的第n条数据线与第n+1条数据线的其中一条电连接,第三个子像素P和第四个子像素P与对应的第n条数据线与第n+1条数据线的其中另一条电连接(第一至第四同样是由左到右算起)。在本实施例中,以数据线D1(D3)与D2(D4)为例,数据线D1(D3)分别与垂直方向的各像素的第一个子像素P与第二个子像素P电连接,且数据线D2(D4)分别与垂直方向的各像素的第三个子像素P与第四个子像素P电连接,以此类推。
请参照图2A、图2B并配合图3所示,其中,图3为图2B的子像素与栅极线和数据线的连接架构中,一个帧时间内的数据线传送的数据信号对应栅极线的波形示意图。本实施例的显示装置的驱动中,是在上述的连接架构下,借由驱动电路12通过多条数据线传送数据信号驱动显示面板11的多个像素,其中,在一个帧时间内,数据信号通过第n条数据线或第n+1条数据线驱动同一个像素的两相邻子像素P的极性为相反,数据信号通过第n条数据线及第n+1条数据线驱动同一个像素的极性为相反(即同一时间下,若第n条数据线为正极性,则第n+1条数据线为负极性;或者相反),且数据信号通过第n条数据线与第n+1条数据线驱动同一像素组的列方向相邻的两个子像素P的极性为相同。
在本实施例中,如图2A所示,数据信号通过第n条数据线或第n+1条数据线驱动同一个像素的两相邻子像素P分别包括二种极性(正极性与负极性),且在一个帧时间内,数据信号通过第n条数据线驱动的子像素P的极性顺序在列方向上为负、正、负、正、负、正、正、负,数据信号通过第n+1条数据线驱动的子像素P的极性顺序在列方向上为正、负、正、负、正、负、负、正,且在同一个帧时间内,通过第n条数据线与第n+1条数据线驱动的子像素P的极性在列方向上分别重复上述顺序,也就是第n条数据线重复负、正、负、正、负、正、正、负的顺序,且第n+1条数据线重复正、负、正、负、正、负、负、正的顺序。,使得在一个帧时间内,数据信号通过第n条数据线或第n+1条数据线驱动同一个像素的两相邻子像素P的极性为相反,数据信号通过第n条数据线及第n+1条数据线驱动同一个像素的极性为相反,且数据信号通过第n条数据线与第n+1条数据线驱动同一像素组的列方向相邻的两个子像素P的极性则相同。于此,数据信号驱动每一个像素的多种颜色的子像素P包含二种电压极性。另外,与第n条数据线及第n+1条数据连接的同一个像素的两个相邻子像素P的极性相同,且数据信号通过第n条数据线或第n+1条数据线驱动第一像素组T1与第二像素组T2沿列方向相邻的两个子像素P的极性为相反。
此外,在下一个帧时间时,数据信号的驱动极性则是采用极性反转驱动模式,使液晶分子的特性不会被破坏。换言之,在本实施例中,在下一个帧时间时,数据信号通过第n条数据线与第n+1条数据线驱动的子像素P的极性顺序在列方向上分别为正、负、正、负、正、负、负、正与负、正、负、正、负、正、正、负,且在下一个帧时间内,通过第n条数据线与第n+1条数据线驱动的子像素P的极性在列方向上分别重复正、负、正、负、正、负、负、正与负、正、负、正、负、正、正、负的顺序。
通过上述栅极线、数据线与子像素P的连接架构及驱动方式,如图2B所示,驱动电路12可使一个帧时间内的第一像素组T1中,两个像素的多种颜色的子像素P的电压极性分别为负、正、正、负(-++-),而在第二像素组T2中,两个像素的多种颜色的子像素P的电压极性分别为正、负、负、正(+--+);或者也可相反,也就是在第一像素组T1中,两个像素的多种颜色的子像素P的电压极性分别为正、负、负、正(+--+),且在第二像素组T2中,两个像素的多种颜色的子像素P的电压极性分别为负、正、正、负(-++-)。此外,同一行的每一个像素的多个子像素P所呈现的电压极性顺序相同,而且在不同的像素组中,沿列方向相邻的两个子像素P所呈现的电压极性则相反。在下一个帧时间时,所有子像素P的所呈现的电压极性则与前一个帧时间时相反。
另外,在一个帧时间内,驱动电路12也使列方向相邻两个像素中的其中一个像素为亮区,另一个像素为暗区。如图2B所示,本实施例的列方向相邻两个像素中的其中一个像素为亮区,另一个像素为暗区,而且在每一个像素组T中,也是一个像素为暗区,另一个像素为亮区。也就是说,本实施例的显示面板是使用四种颜色子像素搭配双像素呈现(twopixel rendering)技术。
因此,如图3所示,在上述连接架构下,可使沿列方向排列的同一种颜色的亮区子像素P所呈现的正负极性比例为1:1。例如以数据线D1来说,白色(W)子像素P的正极性数量与负极性数量都是1个;红色(R)子像素P的正极性数量与负极性数量都是1个。再以数据线D2来说,绿色(G)子像素P的正极性数量与负极性数量都是1个;蓝色(B)子像素P的正极性数量与负极性数量都是1个。其它数据线D3、D4所对应的正负极性数量可参照图3,不再说明。
承上,在本实施例的显示装置中,提出一种新的像素驱动排列方式,而且在四种颜色子像素与半源极驱动技术的连接架构下,可使一帧时间内沿列方向(垂直方向)排列的同一种颜色的亮区子像素P所呈现的正负极性比例为1:1,以此正负极性相互抵消显示面板因寄生电容耦合所造成的垂直串扰问题,借此使显示画面更均匀,提升画面品味。
请参照图4A至图4D所示,其分别为一实施例的显示装置的四种颜色滤光层的制作工序示意图。
如图4A所示,本实施例的显示装置的四种颜色滤光层的第一制作工序是:在一基材111上间隔形成一黑色矩阵层112,并在基材111与黑色矩阵层112上例如以涂布方式形成第一种颜色的滤光层(例如R);接着,如图4B所示,第二工序是:以一光罩2进行曝光制程,其中光罩2的开口21对应于第一种颜色子像素的设置位置;接着,如图4C所示,第三工序是:进行显影制程,以于基材111上定义出第一种颜色(R)滤光层的位置;之后,重复第一工序、第二工序与第三工序,以于基材111上定义出四种颜色(R、G、B、W)滤光层的位置,借此得到四种颜色的子像素P排列,其中,黑色矩阵层112可分别围绕四种颜色的滤光层而设置。
综上所述,本申请的显示装置提出一种新的像素驱动排列方式,而且在多种颜色子像素与半源极驱动技术的连接架构下,可使一帧时间内沿列方向(垂直方向)排列的同一种颜色的亮区子像素所呈现的正负极性比例为1:1,以此正负极性相互抵消显示面板因寄生电容耦合所造成的垂直串扰问题,借此使显示画面更均匀,提升画面品味。
以上所述仅为举例性,而非为限制性者。任何未脱离本申请的精神与范畴,而对其进行的等效修改或变更,均应包括于权利要求书范围中。
Claims (10)
1.一种显示装置,其特征在于,所述显示装置包括一显示面板,所述显示面板包括:
多条栅极线;
多条数据线,与所述多条栅极线交错设置,所述多条数据线包括一第n条数据线与一第n+1条数据线,n为奇数;
沿行方向与列方向排列的多个像素,每一所述像素包括沿行方向排列的多种颜色的子像素,沿行方向排列的多个所述子像素分别电连接对应行的两相邻所述栅极线,每一所述数据线分别电连接同一个所述像素的两相邻子像素,沿列方向排列的两个相邻所述像素分别形成一像素组,沿列方向排列的两个相邻像素组为一第一像素组与一第二像素组,所述第一像素组与所述第二像素组分别依序连接一第一栅极线、一第二栅极线、一第三栅极线和一第四栅极线,在所述第一像素组中,所述第一栅极线与所述第三栅极线分别电连接同一列的所述子像素,所述第二栅极线与所述第四栅极线分别电连接同一列的所述子像素,在所述第二像素组中,所述第一栅极线与所述第四栅极线分别电连接同一列的所述子像素,所述第二栅极线与所述第三栅极线分别电连接同一列的所述子像素,且所述第一像素组的所述第四栅极线和所述第二像素组的所述第一栅极线分别电连接的所述子像素位于同一列;以及
一驱动电路,通过所述多条数据线传送一数据信号驱动所述多个像素;
其中,在一个帧时间内,所述数据信号通过所述第n条数据线或所述第n+1条数据线驱动同一个所述像素的两相邻子像素的极性为相反,所述数据信号通过所述第n条数据线及所述第n+1条数据线驱动同一个所述像素的极性为相反,且所述数据信号通过所述第n条数据线与所述第n+1条数据线驱动同一所述像素组的列方向相邻的两个子像素的极性为相同。
2.如权利要求1所述的显示装置,其特征在于,其中,每一所述像素的所述多种颜色的子像素的颜色排列顺序相同。
3.如权利要求1所述的显示装置,其特征在于,其中,所述第n条数据线与所述第n+1条数据线连接同一个所述像素。
4.如权利要求1所述的显示装置,其特征在于,其中,所述数据信号通过所述第n条数据线或所述第n+1条数据线驱动所述第一像素组与所述第二像素组沿列方向相邻的两个子像素的极性为相反。
5.如权利要求1所述的显示装置,其特征在于,其中,与所述第n条数据线及所述第n+1条数据连接的同一个所述像素的两个相邻所述子像素的极性相同。
6.如权利要求1所述的显示装置,其特征在于,其中,同一行的每一个所述像素的所述多个子像素所呈现的电压极性顺序相同。
7.如权利要求1所述的显示装置,其特征在于,其中,每一所述像素包括沿行方向排列的四种颜色的子像素。
8.如权利要求1所述的显示装置,其特征在于,其中,所述第n条数据线所连接的所述子像素的颜色依序为WRWRRWWR,并重复此顺序,所述第n+1条数据线所连接的所述子像素的颜色依序为GBGBBGGB,并重复此顺序,其中W为白色、R为红色、G为绿色、B为蓝色。
9.如权利要求1所述的显示装置,其特征在于,其中,在一个帧时间内,所述驱动电路使列方向相邻两个所述像素中的其中一个像素为亮区,另一个像素为暗区,且沿列方向排列的同一种颜色的亮区子像素所呈现的正负极性比例为1:1。
10.一种显示装置,其特征在于,所述显示装置包括一显示面板,所述显示面板包括:
多条栅极线;
多条数据线,与所述多条栅极线交错设置,所述多条数据线包括一第n条数据线与一第n+1条数据线,n为奇数;
沿行方向与列方向排列的多个像素,每一所述像素包括沿行方向排列的多种颜色的子像素,每一所述像素的四种颜色的子像素的颜色排列顺序相同,沿行方向排列的多个所述子像素分别电连接对应行的两相邻所述栅极线,每一所述数据线分别电连接同一个所述像素的两相邻子像素,沿列方向排列的两个相邻所述像素分别形成一像素组,沿列方向排列的两个相邻像素组为一第一像素组与一第二像素组,所述第一像素组与所述第二像素组分别依序连接一第一栅极线、一第二栅极线、一第三栅极线和一第四栅极线,在所述第一像素组中,所述第一栅极线与所述第三栅极线分别电连接同一列的所述子像素,所述第二栅极线与所述第四栅极线分别电连接同一列的所述子像素,在所述第二像素组中,所述第一栅极线与所述第四栅极线分别电连接同一列的所述子像素,所述第二栅极线与所述第三栅极线分别电连接同一列的所述子像素,且所述第一像素组的所述第四栅极线和所述第二像素组的所述第一栅极线分别电连接的所述子像素位于同一列;以及
一驱动电路,通过所述多条数据线传送一数据信号驱动所述多个像素;
其中,在一个帧时间内,所述数据信号通过所述第n条数据线或所述第n+1条数据线驱动同一个所述像素的两相邻子像素的极性为相反,所述数据信号通过所述第n条数据线及所述第n+1条数据线驱动同一个所述像素的极性为相反,且所述数据信号通过所述第n条数据线与所述第n+1条数据线驱动同一所述像素组的列方向相邻的两个子像素的极性为相同,所述驱动电路使列方向相邻两个所述像素中的其中一个像素为亮区,另一个像素为暗区,且沿列方向排列的同一种颜色的亮区子像素所呈现的正负极性比例为1:1。
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
PB01 | Publication | ||
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SE01 | Entry into force of request for substantive examination | ||
SE01 | Entry into force of request for substantive examination | ||
GR01 | Patent grant | ||
GR01 | Patent grant |