CN107888976A - 一种基于lvds信号线的程序升级装置及升级方法 - Google Patents
一种基于lvds信号线的程序升级装置及升级方法 Download PDFInfo
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Abstract
本发明公开了一种基于LVDS信号线的程序升级装置及升级方法，包括信号发生装置和内置于待升级对象中的信号接收装置，所述信号发生装置通过LVDS信号线和信号接收装置相连；所述信号发生装置用于接收升级文件，并将所述升级文件在LVDS信号线上的控制信号进入帧消隐区时转换为图像数据；并用于计算每一帧消隐区能够发送的数据个数，根据所述数据个数将升级文件的图像数据分割为若干段；利用每一帧消隐区将各段升级文件数据通过LVDS信号线依次发送至信号接收装置；所述信号接收装置将接收的各段升级文件数据进行整合得到完整的升级文件，并根据升级文件进行程序升级操作。本发明对程序进行升级不影响设备正常的图像显示，具有升级速率快，稳定性和可靠性高等优点。
Description
技术领域
本发明属于LVDS信号源通信技术领域，更具体地，涉及一种基于LVDS信号线的程序升级装置及升级方法。
背景技术
扩展盒是将信号发生器PG输出的LVDS视频信号转换成液晶显示模组所需的视频信号，如转换成DP、VbyOne信号，使得信号发生器PG能够适应不同类型液晶显示模组，降低对信号源的需求。一般在使用中，如发现扩展盒程序出现错误或液晶显示模组无法正常显示，或液晶显示模组需要其它不同类型视频信号以满足显示需要时，需要对扩展盒内的程序进行升级。
现有的升级方法主要通过IIC/SPI/RS484/RS232等通讯升级接口进行，或者采用LVDS视频信号线对扩展盒中的程序进行升级，但是存在以下缺点：LVDS视频信号线主要用于传输显示图像和数据，利用LVDS视频信号线传输升级文件会占用显示图像和数据的传输带宽，因此在程序升级过程中扩展盒无法进行正常的图像显示，只有在升级完成后扩展盒才能正常工作。
发明内容
针对现有技术的以上缺陷或改进需求，本发明提供了一种基于LVDS信号线的程序升级装置及升级方法，对程序进行升级不影响设备正常的图像显示，且具有升级速率快，稳定性和可靠性高的优点。
为实现上述目的，按照本发明的一个方面，提供了一种基于LVDS信号线的程序升级装置，包括信号发生装置和内置于待升级对象中的信号接收装置，信号发生装置通过LVDS信号线和信号接收装置相连；
信号发生装置用于接收升级文件，并将升级文件在LVDS信号线上的控制信号进入帧消隐区时转换为图像数据；并用于计算每一帧消隐区能够发送的数据个数，根据所述数据个数将升级文件的图像数据分割为若干段；利用每一帧消隐区将各段升级文件数据通过LVDS信号线依次发送至信号接收装置；
信号接收装置将接收的各段升级文件数据进行整合得到完整的升级文件，并根据升级文件进行程序升级操作。
优选的，上述基于LVDS信号线的程序升级装置，还包括第一内存和第二内存；第一内存与信号发生装置相互通讯，用于存储信号发生装置接收的升级文件；第二内存与信号接收装置相互通讯，用于存储信号接收装置整合后的升级文件。
优选的，上述基于LVDS信号线的程序升级装置，其信号发生装置包括相互通讯的处理器和第一FPGA，所述第一FPGA通过LVDS信号线与信号接收装置相互通讯，第一内存与第一FPGA相连；
所述处理器用于依次接收外部上位机以多个数据包形式发送的升级文件，并将其转发给第一FPGA，并用于控制第一FPGA执行缓存、读取和解包操作；
所述第一FPGA用于将接收的多个数据包进行解包处理，将各数据包中的数据拼接得到升级文件；并用于将升级文件转换为图像数据的位宽形式，在LVDS信号线上的控制信号进入帧消隐区时将其替换为图像数据；并用于计算每一帧消隐区能够发送的数据个数，根据所述数据个数将升级文件的图像数据分割为若干段；利用每帧消隐区将各段升级文件数据通过LVDS信号线依次发送至信号接收装置。
优选的，上述基于LVDS信号线的程序升级装置，其处理器还用于计算接收的数据包是否正确；若是，则发送回包信息给外部上位机，要求发送下一个数据包；若否，则发送回包信息给外部上位机，要求重发该数据包，并控制第一FPGA清除错误数据包并缓存重发的数据包；待全部数据包接收完毕后，向外部上位机发送接收完成的回包信息；
第一FPGA在发送升级文件数据之前，首先发送起始标志数据、该段升级文件数据的序号标志数据和数据个数，然后逐一发送该段升级文件数据的各个数据；该段升级文件数据发送完毕后，发送完结标志和校验数据。
优选的，上述基于LVDS信号线的程序升级装置，其信号接收装置包括第二FPGA和MCU，第二FPGA通过LVDS信号线与第一FPGA相互通讯，MCU分别与第二FPGA和处理器建立通讯连接，第二内存与第二FPGA相连；
第二FPGA用于依次在每帧消隐区时接收第一FPGA发送的各段升级文件数据，并将接收的各段升级文件数据进行整合得到完整的升级文件；并用于并计算接收的各段升级文件数据是否正确，若是，则通过MCU告知处理器发送下一段升级文件数据；若否，则通过MCU告知处理器重新发送该段升级文件数据；待全部升级文件数据接收完毕后，通过MCU向处理器反馈接收完成状态。
优选的，上述基于LVDS信号线的程序升级装置，其信号接收装置还包括与第二FPGA相连的FLASH芯片；
第二FPGA包括依次相连的LVDS信号接收模块、内存控制逻辑模块和升级模块，LVDS信号接收模块、升级模块和第二内存均与内存控制逻辑模块相互通讯，FLASH芯片与升级模块相连；
LVDS信号接收模块用于接收第一FPGA传输的升级文件图像数据；内存控制逻辑模块用于将接收的升级文件图像数据缓存至第二内存中；升级模块用于读取第二内存中的升级文件图像数据并将其转换为FLASH芯片所需的信号形式和时序；
其升级模块包括ASMI控制子模块、ASMI缓存子模块和升级接口子模块，所述ASMI缓存子模块和升级接口子模块均与ASMI控制子模块相互通讯；FLASH芯片与所述升级接口子模块相连。
优选的，上述基于LVDS信号线的程序升级装置，当对待升级对象中的FPGA程序进行升级时，第二FPGA将升级文件转换为升级模块所需的配置格式，并将文件大小、升级使能信号和文件地址发送给ASMI控制子模块，将对应地址的升级数据写入ASMI缓存子模块中，并控制升级接口子模块将升级数据转换为FLASH芯片所需的信号形式和时序，将其烧录入FLASH芯片中；
当对待升级对象中的MCU程序进行升级时，第二FPGA将升级文件转换为MCU程序的文件格式和数据编码形式，根据升级时序将转换后的升级文件烧录至MCU自带的EEPROM中。
按照本发明的另一个方面，提供了一种基于LVDS信号线的程序升级方法，包括以下步骤：
S1：获取升级文件，将升级文件转换为图像数据的位宽形式，并在LVDS信号线上的控制信号进入帧消隐区时将其替换为图像数据；
S2：计算每一帧消隐区能够发送的数据个数，根据所述数据个数将升级文件的图像数据分割为若干段；
S3：利用每一帧消隐区将各段升级文件数据通过LVDS信号线依次发送至待升级对象；
S4：将接收的各段升级文件数据进行整合得到完整的升级文件，待升级对象根据接收的升级文件进行程序升级操作。
优选的，上述程序升级方法，步骤S1之前还包括以下步骤：
S01：获取升级文件，将所述升级文件分成多个数据包并输出；
S02：依次接收所述多个数据包并对其进行解包处理，将各数据包中的数据拼接得到完整的升级文件。
优选的，上述程序升级方法，当待升级对象为FPGA程序时，将升级文件转换为FPGA所需的配置格式；依次将转换后的升级文件的文件大小、升级使能信号、升级地址和升级数据写入FPGA。
优选的，上述程序升级方法，当待升级对象为MCU程序时，将升级文件转换为MCU所需的文件格式和数据编码形式，根据升级时序将转换后的升级文件烧录至MCU。
优选的，上述程序升级方法，步骤S02中包括以下步骤：计算接收的数据包是否正确，若是，继续发送下一个数据包；若否，清除错误数据包并重新发送；全部数据包接收完毕后发出接收完成状态信息。
优选的，上述程序升级方法，步骤S3中包括以下步骤：每段升级文件数据发送前，首先发送起始标志数据、该段升级文件数据的序号标志数据和数据个数，然后逐一发送该段升级文件的各个数据；该段升级文件数据发送完毕后，发送完结标志和校验数据。
优选的，上述程序升级方法，步骤S4之前还包括以下步骤：计算接收的各段升级文件数据是否正确，若是，则发送下一段升级文件数据；若否，则重新发送该段升级文件数据；待全部升级文件数据接收完毕后，发送接收完成状态。
总体而言，通过本发明所构思的以上技术方案与现有技术相比，能够取得下列有益效果：
(1)本发明提供的一种基于LVDS信号线的程序升级装置及升级方法，利用LVDS信号线进行程序升级，在升级文件发送之前，信号发生器先将升级文件转换成图像数据的位宽形式，并且在LVDS信号线中每一帧控制信号进入消隐区时进行升级文件传输，此时LVDS信号线上没有图像数据发送，充分利用了传输带宽和空隙，又避免传输升级文件影响到扩展盒正常的图像数据传输，不影响扩展盒的正常点屏显示；利用LVDS信号接口进行显示图像数据传输的间隙进行升级文件的传输，提高了LVDS信号接口的利用率，且不占用IIC/SPI/RS484/RS232等通讯接口；
(2)本发明提供的一种基于LVDS信号线的程序升级装置及升级方法，采用多个数据包的形式将升级文件从计算机输送至信号发生器，信号发生器对接收的各个数据包均进行计算校验，保证了升级文件的正确性；采用多个数据段的形式将升级文件从信号发生器发送至扩展盒，扩展盒对接收的各个数据段均进行计算校验，保证了升级文件的可靠性；避免了因传输出错导致升级失败或死机的问题；
(3)本发明提供的一种基于LVDS信号线的程序升级装置及升级方法，升级开始前信号发生器中的FPGA会下发前导码数据，扩展盒中的FPGA接收的前导码数据与用户指定的内容完全一致时才会启动升级程序，避免了扩展盒升级结束后信号发生器又下发重新升级命令造成了已经烧写完的数据被破坏，极大地防止了信号发生器对扩展盒的误烧，提高了升级可靠性。
附图说明
图1是本发明实施例提供的一种基于LVDS信号线的程序升级装置的模块框图；
图2是本发明实施例提供的A5芯片的内部模块框图；
图3是本发明实施例提供的A5芯片中升级模块的内部模块框图。
具体实施方式
为了使本发明的目的、技术方案及优点更加清楚明白，以下结合附图及实施例，对本发明进行进一步详细说明。应当理解，此处所描述的具体实施例仅仅用以解释本发明，并不用于限定本发明。此外，下面所描述的本发明各个实施方式中所涉及到的技术特征只要彼此之间未构成冲突就可以相互组合。
图1是本发明提供的一种基于LVDS信号线的程序升级装置的模块框图；本发明实施例所提供的一种基于LVDS信号线的程序升级装置，用于对扩展盒中的FPGA或MCU程序进行升级，包括通过网线相连的计算机和信号发生器，信号发生器和扩展盒通过LVDS信号线相连，还包括分别与信号发生器和扩展盒相连的第一内存和第二内存；
计算机用于获取原始升级文件，将原始升级文件分成多个数据包，并通过网线将其依次发送至信号发生器；
信号发生器用于将接收的多个数据包进行解包处理，将各数据包中的数据拼接得到原始升级文件，并存储在与信号发生器相连的第一内存中；并用于将原始升级文件在LVDS信号线上的控制信号进入帧消隐区时转换为图像数据；并用于发出测试标志数据并计数，得到每一帧消隐区能够发送的数据个数，根据数据个数将原始升级文件的图像数据分割为若干段；利用帧消隐区将各段图像数据通过LVDS信号线依次发送至扩展盒；
扩展盒将接收的各段图像数据进行整合得到原始升级文件，并将其存储在与扩展盒相连的第二内存中，扩展盒中的待升级对象根据接收的原始升级文件进行程序升级操作。
信号发生器包括处理器和第一FPGA，所述处理器的一端通过网线与计算机相连，另一端通过EBI总线与第一FPGA的第一端相连，所述第一FPGA的第二端通过LVDS信号线与扩展盒相连，第三端与第一内存相连；本实施例选用型号PG108E的信号发生器，处理器为ARM芯片，第一FPGA选用Spartan6芯片(以下简称S6)；第一内存选用DDR3内存颗粒；
扩展盒的型号为AMEX01B，扩展盒中具有K60芯片、ArriaV芯片(以下简称A5)和Flash EPCQ256芯片，A5芯片的第一端通过LVDS信号线与S6芯片的第二端相连，第二端通过EBI总线与K60芯片的第一端相连，第三端与第二内存相连，第四端与Flash EPCQ256芯片相连；K60芯片的第二端通过485串口线与信号发生器中的ARM芯片相连；第二内存选用DDR3内存颗粒。
图2是本发明实施例提供的A5芯片的内部模块框图；如图2所示，A5芯片包括依次相连的LVDS信号接收模块、内存控制逻辑模块和升级模块，LVDS信号接收模块通过LVDS信号线与S6芯片相连，用于接收经LVDS信号线传输的升级文件图像数据；内存控制逻辑模块与第二内存DDR3相连，用于将LVDS信号接收模块接收的升级文件图像数据缓存至第二内存DDR3中；升级模块与FLASH EPCQ256芯片相连，用于读取第二内存DDR3中的升级文件图像数据并将其转换为FLASH EPCQ256芯片所需的信号形式和时序。
图3是本发明实施例提供的A5芯片中升级模块的内部模块框图；RSU升级模块包括ASMI控制模块、ASMI缓存模块和升级接口子模块，ASMI缓存模块和升级接口子模块的一端均与ASMI控制模块相连，升级接口子模块的另一端与FLASH芯片相连；
当用户要远程升级K60芯片中的MCU程序或A5芯片中的FPGA程序时，通过计算机中的上层控制软件读取升级文件，例如FPGA或MCU的bin文件，将升级文件组成若干个数据包，依次通过网线发送给ARM芯片，当ARM芯片收到数据包后，给计算机的上层控制软件发送回包信息。
为了提高升级文件在传输过程中的完整性和正确性，计算机和ARM芯片采用边发包边回包的方式，即计算机每发送一个数据包给ARM芯片，ARM芯片通过EBI总线将接收的数据包转发给S6芯片，S6芯片将数据包缓存到第一内存DDR3中后，则返回状态标志给ARM芯片；ARM芯片通过EBI总线控制S6芯片读取该数据包中的包头、长度和校验码等参数，并经过计算确认接收的数据包是否正确，若是，则发送回包给计算机要求下发下一个数据包；当ARM芯片经过计算发现此次收到的数据包有错误，则发送回包给计算机要求重发此数据包；计算机重新发送当前数据包，ARM芯片控制S6芯片清除上次缓存的错误数据包，并重新缓存重发的数据包，同样的，ARM芯片需重新计算此数据包是否正确。待全部数据包被ARM芯片接收并缓存到第一内存DDR3中，ARM芯片给计算机发送接收完成状态的回包信息，用户科通过计算机获取发送完成信息。如此操作，可以确保升级文件在传输过程中的可靠性，避免因传输出错导致升级失败或死机的问题。
ARM芯片控制S6芯片对缓存到第一内存DDR3中的各升级文件数据包进行解包操作，再将各个数据包中的数据拼接在一起，还原得到原始的升级文件，并将原始升级文件再次缓存至第一内存DDR3中；采用FPGA进行解包和和并数据操作，大大提高了对原始升级文件进行还原的速度。
S6芯片通过LVDS信号线将升级文件发送给扩展盒，以对扩展盒中的FPGA或MCU程序进行升级。由于LVDS信号线用于实时地传输图像数据和时序，升级过程不能影响扩展盒的正常点屏显示，因此，在升级文件发送之前，S6芯片先将升级文件转换成图像数据的位宽形式，图像数据按R、G、B每个颜色为10bit位宽，S6芯片将升级文件转换为30bit位宽的并行数据形式，并且在LVDS信号线中每一帧控制信号进入消隐区时，将转换后的原始文件替换为图像数据，此时LVDS信号线上没有图像数据发送，LVDS信号线上每一帧消隐区内传输的数据即为升级文件数据。
在发送升级文件数据前，当VSync进入一帧消隐区时，S6芯片连续发出测试标志数据，不超过8bit，如F0F0、FAFA等，并对发送的测试标志的个数进行计数，当VSync退出一帧消隐区时，则得到当前显示图像中每一帧消隐区内所能发送的数据量。由于扩展盒AMEX01B能支持显示不同类型、参数、分辨率的图像，每种显示图像的帧消隐区长度存在差异，为了能充分利用传输带宽和空隙，又避免传输升级文件影响到扩展盒正常的图像数据传输，故必须先确认不同帧消隐区能发送多少个数据，当帧消隐区结束后，根据每帧消隐区内能够发送的数据个数将升级文件的图像数据分割成若干段，在后续的每个帧消隐区里依次发送每一段升级文件的图像数据。
当进入下一帧的消隐区时，S6芯片开始发送第一段升级文件，在发送前，先发一个起始标志数据，如55AA，但必须与测试标志数据的数据位数不同，以确保接收端能正确分辨测试标志数据和起始标志数据；再发一个序号标志数据，即表示当前发送的数据段是升级文件的第几段数据，再发送本段升级文件的数据个数，再逐一发送本段升级文件的各个数据，发送完毕后再发送升级文件是否全部发完的标志，若是最后一段升级文件，则该标志表示升级文件数据全部发完，否则表示升级文件数据还未发完；最后发送校验数据，即根据本次发送的全部标志和图像数据进行计算得到的校验数据；需要说明的是，本段升级文件的数据个数应该是本次发送的数据总个数减去发出的标志和校验的个数；当每帧的VSync的消隐区结束时，S6芯片已经将当前段升级文件全部发出，此时LVDS信号线仍用于继续传输显示图像数据和时序，并不影响扩展盒的点屏显示。当下一帧消隐区开始时，S6芯片发送下一段升级文件及其相应的标志和校验数据。
扩展盒中的A5芯片在进入帧消隐区时检测是否有升级文件输入，当收到测试标志数据后则进行准备工作，包括清零第二内存DDR3中用于缓存升级文件的区域位置，告知K60芯片准备，初始化内部升级模块RSU；当进入下一帧的帧消隐区时，确认收到起始标志数据后依次接收第一段升级文件和结束标志、检验数据，并将其缓存到第二内存DDR3中的指定区域位置。接收完成后，A5芯片进行正常的图像接收、解码和显示操作，同时取出第二内存DDR3缓存的当前段升级文件，进行计算并和校验数据比较，若确认此次接收的数据正确，则告知K60芯片接收正确，K60芯片通过485串口线告知ARM芯片传送下一段升级文件数据，ARM芯片命令S6芯片在下一帧消隐区时下发下一段升级文件发送给A5芯片；若A5芯片发现当前段升级文件数据出现错误，则通过K60芯片告知ARM芯片重发此段升级文件数据，则S6芯片在下一帧消隐区时重发本段升级文件数据。
当A5芯片正确地接收到全部升级文件数据并将其缓存到第二内存DDR3中后，通过K60芯片向ARM芯片反馈接收完成状态，ARM芯片一方面命令S6芯片停止发送，另一方面将接收完成状态上报给计算机的上层控制软件，用户通过计算机即可获得接收完成状态。
A5芯片将接收的各段升级文件数据整合在一起恢复成完整的升级文件，当待升级对象为A5芯片中的FPGA程序时，A5芯片对升级模块执行写操作，先将第二内存DDR3中的升级文件转换成升级模块所需的配置格式，如升级数据、升级地址、升级文件大小等数据形式；然后将升级文件的大小告知升级模块中的ASMI控制子模块，再发送升级使能信号给ASMI控制子模块，然后将升级地址和对应地址的升级数据分别写入到升级模块内部的ASMI控制和ASMI缓存子模块中；ASMI控制子模块自动控制ASMI升级接口子模块将升级数据转换成Flash EPCQ256芯片所需的信号形式和时序，并将其烧入到该芯片中。当全部升级文件数据烧录完成后，A5芯片发送状态信息告知K60芯片烧录完成，K60芯片在接收到A5芯片发送的状态信息后延迟一段时间控制A5芯片的供电电路将其断电，以确保EPCQ256芯片内部的烧录过程全部结束，A5芯片重新上电和复位并初始化FPGA内部逻辑，初始化完成后A5芯片向K60芯片反馈完成状态，K60芯片读取A5芯片新的器件标识号和程序版本号并反馈给ARM芯片，ARM芯片通过计算机告知用户新的版本号和器件标号，FPGA程序升级完成。
当待升级对象为K60芯片中的MCU程序时，A5芯片先将第二内存DDR3中的升级文件转换成K60芯片所需的文件格式和数据编码形式，并通过K60芯片告知ARM芯片，ARM芯片则通过K60芯片向A5芯片反馈延迟若干时间再升级的命令，A5芯片开始延迟，在此期间ARM芯片控制K60芯片进入升级状态，控制和完成此升级状态一般需要几百个ms，当延迟到期后，A5芯片根据K60芯片的升级时序将升级文件数据烧录到K60芯片自带的E2PROM中；升级前，ARM芯片首先对K60芯片升级所需时间进行预估，此预估时间一般略大于K60芯片实际的升级时间，升级过程中，ARM芯片一方面查询K60芯片的状态，另一方面对升级时间计时，当ARM芯片的计时时间达到预估时间后，此时A5芯片已经完成升级处于等待状态，则ARM芯片重启K60芯片，并将版本号和器件编号通过ARM芯片反馈给计算机，K60芯片完成升级。
本发明还提供了一种基于上述程序升级装置的程序升级方法，包括以下步骤：
S1：通过计算机中的上层控制软件读取升级文件，将升级文件分成多个数据包，并通过网线依次发送至信号发生器；
S2：信号发生器依次接收数据包，并存储在与其相连的第一内存中；计算接收的数据包是否正确，若是，继续发送下一个数据包；若否，清除错误数据包并重新发送；全部数据包接收完毕后发出接收完成状态信息；并对全部数据包进行解包处理，将各数据包中的数据拼接得到完整的升级文件；
S3：信号发生器将升级文件转换为图像数据的位宽形式，并在LVDS信号线上的控制信号进入帧消隐区时将其替换为图像数据；
S4：发出测试标志数据并计数，得到每一帧消隐区能够发送的数据个数，根据所述数据个数将升级文件的图像数据分割为若干段；
S5：利用每一帧消隐区将各段升级文件数据通过LVDS信号线依次发送待升级对象；每段升级文件数据发送前，首先发送起始标志数据、该段升级文件数据的序号标志数据和数据个数，然后逐一发送该段升级文件的各个数据；该段升级文件数据发送完毕后，发送完结标志和校验数据；
S6：扩展盒依次接收各段升级文件数据，并计算接收的数据是否正确，若是，则发送下一段升级文件数据；若否，则重新发送该段升级文件数据；待全部升级文件数据接收完毕后，发送接收完成状态；将接收的各段升级文件数据进行整合得到完整的升级文件，并存储在于扩展盒相连的第二内存中；
S7：当对扩展盒中的FPGA程序进行升级时，第二FPGA将升级文件转换为升级模块所需的配置格式，并将文件大小、升级使能信号和文件地址发送给ASMI控制子模块，将对应地址的升级数据写入ASMI缓存子模块中，并控制升级接口子模块将升级数据转换为FLASH芯片所需的信号形式和时序，将其烧录入FLASH芯片中；烧录结束后，FPGA进行内部逻辑初始化，并将FPGA的器件标志号和程序版本号反馈给用户，升级完成。
S8：当对扩展盒中的MCU程序进行升级时，第二FPGA将原始升级文件转换为MCU程序的文件格式和数据编码形式，根据升级时序将转换后的原始升级文件烧录至MCU自带的EEPROM中，烧录结束后，重启MCU并将版本号和器件编号反馈给用户，升级完成。
相比于现有的程序升级方法，本发明提供的一种基于LVDS信号线的程序升级装置及升级方法，对程序进行升级不影响设备正常的图像显示，具有升级速率快，稳定性高，可靠性高等优点。
本领域的技术人员容易理解，以上所述仅为本发明的较佳实施例而已，并不用以限制本发明，凡在本发明的精神和原则之内所作的任何修改、等同替换和改进等，均应包含在本发明的保护范围之内。
Claims (10)
1.一种基于LVDS信号线的程序升级装置，其特征在于，包括信号发生装置和内置于待升级对象中的信号接收装置，所述信号发生装置通过LVDS信号线和信号接收装置相连；
所述信号发生装置用于接收升级文件，并将所述升级文件在LVDS信号线上的控制信号进入帧消隐区时转换为图像数据；并用于计算每一帧消隐区能够发送的数据个数，根据所述数据个数将升级文件的图像数据分割为若干段；利用每一帧消隐区将各段升级文件数据通过LVDS信号线依次发送至信号接收装置；
所述信号接收装置将接收的各段升级文件数据进行整合得到完整的升级文件，并根据升级文件进行程序升级操作。
2.如权利要求1所述的基于LVDS信号线的程序升级装置，其特征在于，还包括第一内存和第二内存；所述第一内存与信号发生装置相互通讯，用于存储信号发生装置接收的升级文件；所述第二内存与信号接收装置相互通讯，用于存储信号接收装置整合后的升级文件。
3.如权利要求1或2所述的基于LVDS信号线的程序升级装置，其特征在于，所述信号发生装置包括相互通讯的处理器和第一FPGA，所述第一FPGA通过LVDS信号线与信号接收装置相互通讯，第一内存与第一FPGA相连；
所述处理器用于依次接收外部上位机以多个数据包形式发送的升级文件并将其转发给第一FPGA，并用于控制第一FPGA执行缓存、读取和解包操作；
所述第一FPGA用于将接收的多个数据包进行解包处理，将各数据包中的数据拼接得到升级文件；并用于将升级文件转换为图像数据的位宽形式，在LVDS信号线上的控制信号进入帧消隐区时将其替换为图像数据；并用于计算每一帧消隐区能够发送的数据个数，根据所述数据个数将升级文件的图像数据分割为若干段；利用每帧消隐区将各段升级文件数据通过LVDS信号线依次发送至信号接收装置。
4.如权利要求3所述的基于LVDS信号线的程序升级装置，其特征在于，所述信号接收装置包括第二FPGA和MCU，所述第二FPGA通过LVDS信号线与第一FPGA相互通讯，所述MCU分别与第二FPGA和处理器建立通讯连接，第二内存与所述第二FPGA相连；
所述第二FPGA用于依次在每帧消隐区时接收第一FPGA发送的各段升级文件数据，并将接收的各段升级文件数据进行整合得到完整的升级文件；并用于并计算接收的各段升级文件数据是否正确，若是，则通过MCU告知处理器发送下一段升级文件数据；若否，则通过MCU告知处理器重新发送该段升级文件数据；待全部升级文件数据接收完毕后，通过MCU向处理器反馈接收完成状态。
5.如权利要求4所述的基于LVDS信号线的程序升级装置，其特征在于，所述信号接收装置还包括与第二FPGA相连的FLASH芯片；
所述第二FPGA包括依次相连的LVDS信号接收模块、内存控制逻辑模块和升级模块，所述LVDS信号接收模块、升级模块和第二内存均与内存控制逻辑模块相互通讯，所述FLASH芯片与升级模块相连；
所述LVDS信号接收模块用于接收第一FPGA传输的升级文件图像数据；所述内存控制逻辑模块用于将接收的升级文件图像数据缓存至第二内存中；所述升级模块用于读取第二内存中的升级文件图像数据并将其转换为FLASH芯片所需的信号形式和时序；
所述升级模块包括ASMI控制子模块、ASMI缓存子模块和升级接口子模块，所述ASMI缓存子模块和升级接口子模块均与ASMI控制子模块相互通讯；FLASH芯片与所述升级接口子模块相连。
6.一种基于LVDS信号线的程序升级方法，其特征在于，包括以下步骤：
S1：获取升级文件，将升级文件转换为图像数据的位宽形式，并在LVDS信号线上的控制信号进入帧消隐区时将其替换为图像数据；
S2：计算每一帧消隐区能够发送的数据个数，根据所述数据个数将升级文件的图像数据分割为若干段；
S3：利用每一帧消隐区将各段升级文件数据通过LVDS信号线依次发送至待升级对象；
S4：将接收的各段升级文件数据进行整合得到完整的升级文件，待升级对象根据接收的升级文件进行程序升级操作。
7.如权利要求6所述的程序升级方法，其特征在于，步骤S1之前还包括以下步骤：
S01：获取升级文件，将所述升级文件分成多个数据包并输出；
S02：依次接收所述多个数据包并对其进行解包处理，将各数据包中的数据拼接得到完整的升级文件。
8.如权利要求6或7所述的程序升级方法，其特征在于，当待升级对象为FPGA程序时，将升级文件转换为FPGA所需的配置格式；依次将转换后的升级文件的文件大小、升级使能信号、升级地址和升级数据写入FPGA；
当待升级对象为MCU程序时，将升级文件转换为MCU所需的文件格式和数据编码形式，根据升级时序将转换后的升级文件烧录至MCU。
9.如权利要求7所述的程序升级方法，其特征在于，步骤S02中包括以下步骤：计算接收的数据包是否正确，若是，继续发送下一个数据包；若否，清除错误数据包并重新发送；全部数据包接收完毕后发出接收完成状态信息。
10.如权利要求6所述的程序升级方法，其特征在于，步骤S3中包括以下步骤：每段升级文件数据发送前，首先发送起始标志数据、该段升级文件数据的序号标志数据和数据个数，然后逐一发送该段升级文件的各个数据；该段升级文件数据发送完毕后，发送完结标志和校验数据。
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