CN107633801A - 显示面板和显示装置 - Google Patents

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Abstract

本发明公开了一种显示面板和显示装置，包括：多根扫描线，各扫描线分别在第一方向上延伸且在第二方向上依次排列；扫描驱动电路，用于驱动扫描线，包括至少三个扫描驱动子电路，三个扫描驱动子电路为第一扫描驱动子电路、第二扫描驱动子电路和第三扫描驱动子电路，第一扫描驱动子电路与第二扫描驱动子电路级联；其中，显示面板具有在第二方向上相邻设置的第一区域和第二区域，第一扫描驱动子电路采用逐行扫描的方式驱动第一区域内的扫描线，第二扫描驱动子电路和第三扫描驱动子电路用于分别采用隔行扫描的方式驱动第二区域内的扫描线。通过本发明，能够简化采用隔行扫描的方式进行扫描的异形显示面板走线方式，更利于实现窄边框。

Description

显示面板和显示装置
技术领域
本发明涉及显示技术领域，更具体地，涉及一种显示面板和显示装置。
背景技术
目前，源于用户对显示装置屏占比要求的提高，部分显示装置采用异形显示面板作为显示屏幕，对于异形显示面板，一般是在顶部、底部或中部等位置通过切割去掉部分区域，在显示面板被切割后产生的空间内设置显示装置的其他配件，例如听筒、摄像头等，达到显示装置增加显示区域的目的。
在一类异形显示面板中，部分边框为弧形，该弧形边框的位置空间通常较小，为了实现隔行扫描(interlace)的扫描驱动方式，需要在该弧形边框处设置扫描驱动电路，为弧形边框处的走线设计带来了难题，不利于实现窄边框。另一种情况下，如图1所示，显示面板的顶部被切割两部分，形成左异形区域P1和右异形区域P2，在现有的设计中，为了实现隔行扫描(interlace)的扫描驱动方式，即左异形区域的L1行和右异形区域的L1行一起被扫描，左异形区域的R2行和右异形区域的R2行一起扫描开启，需要左边的扫描驱动电路VSRZ必须绕过左异形区域P1上部至右异形区域P2左侧，左边的扫描驱动电路VSRY必须绕过右异形区域P2上部至左异形区域P1右侧，同样增加了异形区域的边框处走线的复杂性，不利于实现窄边框。
因此，提供一种显示面板和显示装置，简化异形显示面板中扫描驱动电路的走线是本领域亟待解决的问题。
发明内容
有鉴于此，本发明提供了一种显示面板和显示装置，解决了现有技术中异形显示面板中扫描驱动电路的走线复杂，不利于实现窄边框的技术问题。
为了解决上述技术问题，本发明提出一种显示面板，包括：多根扫描线，各所述扫描线分别在第一方向上延伸且在第二方向上依次排列，所述第一方向与所述第二方向交叉；扫描驱动电路，用于驱动所述扫描线，包括至少三个扫描驱动子电路，三个所述扫描驱动子电路为第一扫描驱动子电路、第二扫描驱动子电路和第三扫描驱动子电路，所述第一扫描驱动子电路与所述第二扫描驱动子电路级联；其中，所述显示面板具有在所述第二方向上相邻设置的第一区域和第二区域，所述第一扫描驱动子电路采用逐行扫描的方式驱动所述第一区域内的所述扫描线，所述第二扫描驱动子电路和所述第三扫描驱动子电路用于分别采用隔行扫描的方式驱动所述第二区域内的所述扫描线。
为了解决上述技术问题，本发明还提出一种显示装置，该显示装置包括本发明提供的任意一种显示面板。
与现有技术相比，本发明的显示面板和显示装置，实现了如下的有益效果：
显示面板的部分区域采用逐行扫描的方式进行扫描，在这部分区域，仅需要在一侧设置扫描器驱动电路；另外部分区域采用隔行扫描的方式进行扫描，对于异形显示面板而言，使异形区域采用逐行扫描的方式进行扫描，大部分正常区域仍可采用隔行扫描的方式进行扫描，能够简化采用隔行扫描的方式进行扫描的异形显示面板走线方式，更利于实现窄边框。
通过以下参照附图对本发明的示例性实施例的详细描述，本发明的其它特征及其优点将会变得清楚。
附图说明
被结合在说明书中并构成说明书的一部分的附图示出了本发明的实施例，并且连同其说明一起用于解释本发明的原理。
图1为现有技术所述的一种显示面板的结构示意图；
图2为本发明实施例所述的显示面板结构示意图；
图3为本发明实施例所述的显示面板的扫描驱动子电路的原理图；
图4为本发明实施例所述的显示面板的时钟周期和时刻的示意图；
图5为本发明实施例所述的显示面板的第一扫描驱动子电路中移位寄存器的时序图；
图6为本发明实施例所述的显示面板的第二和第三扫描驱动子电路中移位寄存器的时序图；
图7为本发明实施例所述的显示面板的移位寄存器的原理图；
图8为本发明实施例所述的显示面板的第一扫描驱动子电路中移位寄存器的时钟信号时序图；
图9为本发明实施例所述的显示面板的第二和第三扫描驱动子电路中移位寄存器的时钟信号时序图；
图10为本发明实施例所述的显示面板的第一扫描驱动子电路的原理图；
图11为本发明实施例所述的显示面板的第二扫描驱动子电路的原理图；
图12为本发明实施例所述的显示面板的第三扫描驱动子电路的原理图；
图13为本发明实施例所述的显示面板的时钟信号时序图；
图14为本发明实施例所述的显示面板的第一扫描驱动子电路的时序图；
图15为本发明实施例所述的显示面板的第二扫描驱动子电路的时序图；
图16为本发明实施例所述的显示面板的第三扫描驱动子电路的时序图；
图17为本发明实施例所述的另一种显示面板的第一扫描驱动子电路的原理图；
图18为本发明实施例所述的另一种显示面板的第二扫描驱动子电路的原理图；
图19为本发明实施例所述的另一种显示面板的第三扫描驱动子电路的原理图；
图20为本发明实施例所述的另一种显示面板的时钟信号时序图；
图21为本发明实施例所述的另一种显示面板的第一扫描驱动子电路的时序图；
图22为本发明实施例所述的另一种显示面板的第二扫描驱动子电路的时序图；
图23为本发明实施例所述的另一种显示面板的第三扫描驱动子电路的时序图；
图24为本发明实施例所述的显示面板的移位寄存器的内部电路图；
图25为本发明实施例所述的显示面板的第一扫描驱动子电路中的图24所示移位寄存器的时序图；
图26为本发明实施例所述的显示面板的第二和第三扫描驱动子电路中的图24所示移位寄存器的时序图；
图27为本发明实施例所述的一种显示面板的时序图；
图28为本发明实施例所述的另一种显示面板的时序图；
图29为本发明实施例所述的另一种显示面板的结构示意图；
图30为本发明实施例所述的另一种显示面板的结构示意图；
图31为本发明实施例所述的另一种显示面板的结构示意图；
图32为本发明实施例所述的另一种显示面板的结构示意图。
具体实施方式
现在将参照附图来详细描述本发明的各种示例性实施例。应注意到：除非另外具体说明，否则在这些实施例中阐述的部件和步骤的相对布置、数字表达式和数值不限制本发明的范围。
以下对至少一个示例性实施例的描述实际上仅仅是说明性的，决不作为对本发明及其应用或使用的任何限制。
对于相关领域普通技术人员已知的技术、方法和设备可能不作详细讨论，但在适当情况下，所述技术、方法和设备应当被视为说明书的一部分。
在这里示出和讨论的所有例子中，任何具体值应被解释为仅仅是示例性的，而不是作为限制。因此，示例性实施例的其它例子可以具有不同的值。
应注意到：相似的标号和字母在下面的附图中表示类似项，因此，一旦某一项在一个附图中被定义，则在随后的附图中不需要对其进行进一步讨论。
本发明实施例提供了一种显示面板，该显示面板包括扫描驱动电路和多根扫描线。其中，各扫描线分别在第一方向上延伸且在第二方向上依次排列，第一方向与第二方向交叉。扫描驱动电路用于驱动扫描线，包括至少三个扫描驱动子电路，该三个扫描驱动子电路也即第一扫描驱动子电路、第二扫描驱动子电路和第三扫描驱动子电路，其中，第一扫描驱动子电路与第二扫描驱动子电路级联。
其中，显示面板具有在第二方向上相邻设置的第一区域和第二区域，第一扫描驱动子电路采用逐行扫描的方式驱动第一区域内的扫描线，第二扫描驱动子电路和第三扫描驱动子电路用于分别采用隔行扫描的方式驱动第二区域内的扫描线，也就是说，当第一区域为异形区域时，对该第一区域采用逐行扫描的方式进行扫描，第二区域作为正常的区域，仍然进行隔行扫描的方式驱动。
对于异形区域来说，仅需要在一侧边框设置第一扫描驱动子电路，对于异形区域具有非弧形边框的显示面板，可以选择仅设置在异形区域的非弧形边框，而在弧形边框不设置驱动子电路；对于异形区域的两侧都是弧形边框的显示面板，不需要两侧均设置扫描驱动电路；对于包括多个异性区域的显示面板，不需要在各个异形区域之间设置扫描驱动电路的连接线。对于显示面板的大部分区域而言，也即正常的区域而言，仍然能够采用隔行扫描的方式驱动。与现有技术的异形显示面板中扫描驱动电路的走线方式相比，简化了走线方式，更利于实现窄边框。
当然，本发明并不限于异形显示面板，基于实际需要，也可以为常规显示面板，例如矩形或圆角矩形的显示面板，本发明并不对面板的实际形状进行限定。
以上是本发明的核心思想，下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述。
图2为本发明实施例所述的一种显示面板结构示意图，如图2所示，显示面板具有在第二方向b上相邻设置的第一区域AA1和第二区域AA2。
显示面板包括多根扫描线G，各扫描线G分别在第一方向a上延伸且在第二方向b上依次排列，其中，第一方向a与第二方向b交叉。
显示面板还包括扫描驱动电路，用于驱动扫描线G。在一种实施例中，如图2所示，显示面板还包括多个呈阵列排布的子像素SP、多根数据线D，以及集成电路芯片IC，其中，子像素SP包括像素电极P和薄膜晶体管T，扫描线G与薄膜晶体管T的控制端、与扫描驱动电路分别相连接，数据线D与薄膜晶体管T的第一端、与集成电路芯片IC分别相连接，薄膜晶体管T的第二端与像素电极P相连接，集成电路芯片IC用于向像素电极P施加像素电压,扫描驱动电路通过扫描线G控制一行子像素SP的薄膜晶体管T打开，集成电路芯片IC将像素电压经由数据线D加入至薄膜晶体管T的第一端，再经薄膜晶体管T的第二端到达像素电极P，点亮子像素SP，完成显示。
继续参考图2，该实施例提供的显示面板的扫描驱动电路包括三个扫描驱动子电路，该三个扫描驱动子电路为第一扫描驱动子电路VSR1、第二扫描驱动子电路VSR2和第三扫描驱动子电路VSR3。其中，第一扫描驱动子电路VSR1和第二扫描驱动子电路VSR2设置于显示面板同一侧边框，第三扫描驱动子电路VSR3设置于显示面板的另一侧边框，与第一扫描驱动子电路VSR1和第二扫描驱动子电路VSR2相对设置于显示面板的两侧，在该图2所示的实施例中，第一扫描驱动子电路VSR1和第二扫描驱动子电路VSR2均设置于显示面板的右侧边框，具体地，第一扫描驱动子电路VSR1设置于第一区域AA1的右侧边框，第二扫描驱动子电路VSR2设置于第二区域AA2右侧边框，第三扫描驱动子电路VSR3设置于第二区域AA2左侧边框，并且第一扫描驱动子电路VSR1与第二扫描驱动子电路VSR2级联。
扫描驱动电路在工作过程中，先由第一扫描驱动子电路VSR1采用逐行扫描的方式驱动第一区域AA1内的扫描线G，然后由第二扫描驱动子电路VSR2和第三扫描驱动子电路VSR3分别采用隔行扫描的方式驱动第二区域AA2内的扫描线G，例如，第一扫描驱动子电路VSR1驱动显示面板中第1至第x-1根扫描线，第二扫描驱动子电路VSR2驱动显示面板的第x+2m根扫描线，第三扫描驱动子电路VSR3驱动显示面板的第x+2m+1根扫描线，其中，x为大于2的整数，m为大于或等于0的整数，通过第一扫描驱动子电路VSR1、第二扫描驱动子电路VSR2和第三扫描驱动子电路VSR3，实现在一个扫描周期内对显示面板上所有扫描线G的扫描。
以图2中的显示面板为例，第一扫描驱动子电路VSR1驱动显示面板中第1至第2根扫描线，第二扫描驱动子电路VSR2驱动显示面板的第3、第5和第7根扫描线，第三扫描驱动子电路VSR3驱动显示面板的第4根和第6根扫描线，通过第一扫描驱动子电路VSR1、第二扫描驱动子电路VSR2和第三扫描驱动子电路VSR3，实现在一个扫描周期内对显示面板上第1至第7根扫描线的扫描，实现对第1至第7行子像素SP中薄膜晶体管T逐行依次打开。
在该实施例中，第一区域为异形区域，仅需要在第一区域的一侧边框设置第一扫描驱动子电路，不需要在第一区域的两侧均设置扫描驱动电路，对于显示面板的大部分区域而言，也即正常的第二区域而言，仍然能够采用隔行扫描的方式驱动。与现有技术的异形显示面板中扫描驱动电路的走线方式相比，简化了走线方式，更利于实现窄边框。
进一步地，图3为本发明实施例所述的显示面板的扫描驱动子电路的原理图，在一种实施例中，如图3所示，各扫描驱动子电路均包括若干依次级联的移位寄存器SRn，移位寄存器SRn包括输入端INn、输出端OUTn和输出信号控制端C2，其中，输出端OUTn连接扫描线G，n为大于或等于1的整数。
对于任意一个扫描驱动子电路中，若该扫描驱动子电路的第1级移位寄存器SR1连接显示面板的第一根扫描线，则第1级移位寄存器SR1的输入端IN1接收显示面板的起始移位信号STV，其余情况下，按照扫描顺序，该扫描驱动子电路的第1级移位寄存器SR1的输入端IN1，连接该扫描驱动子电路前一个扫描驱动子电路中移位寄存器的输出端，也即，将前一个扫描驱动子电路中移位寄存器的输出端输出的信号作为该扫描驱动子电路的起始移位信号STV。对于任意一个扫描驱动子电路，第2级移位寄存器SR2至第N级移位寄存器SRN中，的每一级移位寄存器SRx的输入端INx连接上一级移位寄存器SRx-1的输出端OUTx-1，实现同一扫描驱动子电路中移位寄存器的级联，其中，N和x均为大于等于2的整数。
扫描驱动电路中，移位寄存器输入或输出的信号均为时钟信号，通过控制输入的时钟信号的频率控制一个单位时间内时刻的个数，图4为本发明实施例所述的显示面板的时钟周期和时刻的示意图，如图4所示，单位时间长度为T0，第一时钟信号SZ1的频率大于第二时钟信号SZ2的频率，第一时钟信号SZ1单位时间长度内共包括5个时刻t1，第二时钟信号SZ2单位时间长度内共包括4个时刻t2。
同一移位寄存器SRn中，在输入端INn接收到有效电平之后，输出端OUTn输出有效电平的时序与输出信号控制端OUTn接收到的第一个有效电平的时序同步，也就是说，在输入端INn接收到有效电平之后，输出信号控制端OUTn接收到的第一个有效电平的同时，输出端OUTn输出有效电平，通过控制输出信号控制端OUTn接收到有效电平的时序，即可控制输出端OUTn输出有效电平的时序和输入端INn接收到有效电平的时序之间的关系。
图5为本发明实施例所述的显示面板的第一扫描驱动子电路中移位寄存器的时序图，对于实现逐行扫描方式的第一扫描驱动子电路中的移位寄存器，如图5所示，在输入端INn接收到有效电平之后相邻的一个时刻，给输出信号控制端OUTn输入第一个有效电平，使得输出端OUTn输出有效电平的时刻晚于输入端INn接收到有效电平一个时刻，也即，输出信号控制端OUTn接收到有效电平的时序与输入端INn接收到有效电平的时序相差一个时刻，也即，输出端OUTn输出有效电平的时刻晚于输出端OUTn-1输出有效电平一个时刻，从而实现逐行扫描。
图6为本发明实施例所述的显示面板的第二和第三扫描驱动子电路中移位寄存器的时序图，对于实现隔行扫描方式的第二和第三扫描驱动子电路中的移位寄存器，如图6所示，在输入端INn接收到有效电平之后相隔一个时刻之后，给输出信号控制端OUTn输入第一个有效电平，使得输出端OUTn输出有效电平的时刻晚于输入端INn接收到有效电平两个时刻，也即，输出信号控制端OUTn接收到有效电平的时序与输入端INn接收到有效电平的时序相差两个时刻，也即，输出端OUTn输出有效电平的时刻晚于输出端OUTn-1输出有效电平两个时刻，从而第二和第三扫描驱动子电路能够分别实现隔行扫描，而控制第二和第三扫描驱动子电路中同一级移位寄存器SRn的输出信号控制端OUTn接收到有效电平的时序相差一个时刻，即可控制第二和第三扫描驱动子电路中同一级移位寄存器SRn的输出端OUTn输出有效电平的时刻相差一个时刻，使得第二和第三扫描驱动子电路中同一级移位寄存器SRn扫描相邻行。
在该实施例中，通过控制各移位寄存器的输出信号控制端的有效电平的时序，能够控制各移位寄存器的输出端的有效电平的时序，进而实现第一扫描驱动子电路采用逐行扫描的方式驱动第一区域的扫描线，第二扫描驱动子电路和第三扫描驱动子电路采用隔行扫描的方式驱动第二区域的扫描线。
进一步地，图7为本发明实施例所述的显示面板的移位寄存器的原理图，在一种实施例中，如图7所示，移位寄存器SRn包括起始信号输入端C1、输出信号控制端C2、复位信号输入端C3、输入端INn和输出端OUTn，其中，起始信号输入端C1、输出信号控制端C2和复位信号输入端C3均为时钟信号。
图8为本发明实施例所述的显示面板的第一扫描驱动子电路中移位寄存器的时钟信号时序图，对于第一扫描驱动子电路而言，同一移位寄存器中，起始信号输入端C1、输出信号控制端C2和复位信号输入端C3接收到有效电平的时间依次相差一个时刻，也即，对于第一扫描驱动子电路中的移位寄存器，在第一时刻起始信号输入端C1接收到有效电平，移位寄存器处于输出端可输出有效电平的状态，在第二时刻输出信号控制端C2接收到有效电平时，移位寄存器的输出端输出有效电平，在第三时刻，复位信号输入端C3接收到有效电平，移位寄存器结束可输出有效电平的状态，在下一个起始信号输入端C1到来之前，移位寄存器均处于不可输出有效电平的状态。通过起始信号输入端C1使移位寄存器处于输出端可输出有效电平的状态，然后，在经过一个时刻后，移位寄存器输出端输出有效电平，最后由复位信号输入端C3对该状态进行复位，输出端不再输出有效电平。
图9为本发明实施例所述的显示面板的第二和第三扫描驱动子电路中移位寄存器的时钟信号时序图，对于第二和第三扫描驱动子电路而言，同一移位寄存器中，起始信号输入端与C1输出信号控制端C2接收到有效电平的时间相差两个时刻，输出信号控制端C2与复位信号输入端C3接收到有效电平的时间依次相差一个时刻，也即，对于第二和第三扫描驱动子电路中的移位寄存器，在第一时刻起始信号输入端C1接收到有效电平，移位寄存器处于输出端可输出有效电平的状态，在第三时刻输出信号控制端C2接收到有效电平时，移位寄存器的输出端输出有效电平，在第四时刻，复位信号输入端C3接收到有效电平，移位寄存器结束可输出有效电平的状态，在下一个起始信号输入端C1到来之前，移位寄存器均处于不可输出有效电平的状态。通过起始信号输入端C1使移位寄存器处于输出端可输出有效电平的状态，然后，在经过两个时刻后，移位寄存器输出端输出有效电平，最后由复位信号输入端C3对该状态进行复位，输出端不再输出有效电平。
进一步地，在一种实施例中，显示面板还包括第一时钟信号线、第二时钟信号线、第三时钟信号线和第四时钟信号线，用于向扫描驱动电路提供时钟信号，图10为本发明实施例所述的显示面板的第一扫描驱动子电路的原理图，图11为本发明实施例所述的显示面板的第二扫描驱动子电路的原理图，图12为本发明实施例所述的显示面板的第三扫描驱动子电路的原理图，如图10至图12所示，第一时钟信号线L1、第二时钟信号线L2、第三时钟信号线L3和第四时钟信号线L4向移位寄存器的起始信号输入端C1、输出信号控制端C2和复位信号输入端C3提供时钟信号。图13为本发明实施例所述的显示面板的时钟信号时序图，同时参考图10至图13，在一个扫描周期内，第一时钟信号线L1提供第一时钟信号CKV1，第二时钟信号线L2提供第二时钟信号CKV2，第三时钟信号线L3提供第三时钟信号CKV3，第四时钟信号线L4提供第四时钟信号CKV4，每个时钟信号的一个时钟周期均包括四个时刻，在一个时钟周期内，第一时钟信号CKV1仅在第一个时刻内为有效电平，第二时钟信号CKV2仅在第二个时刻内为有效电平，第三时钟信号CKV3仅在第三个时刻内为有效电平，第四时钟信号CKV4仅在第四个时刻内为有效电平。
如图10所示，在第一扫描驱动子电路中，从第1级移位寄存器开始，每4级移位寄存器构成一个第一循环组，每个第一循环组中，第4X+1级移位寄存器SR4X+1的起始信号输入端C1连接第一时钟信号线L1，第4X+1级移位寄存器SR4X+1的输出信号控制端C2连接第二时钟信号线L2，第4X+1级移位寄存器SR4X+1的复位信号输入端C3连接第三时钟信号线L3。
第4X+2级移位寄存器SR4X+2的起始信号输入端C1连接第二时钟信号线L2，第4X+2级移位寄存器SR4X+2的输出信号控制端C2连接第三时钟信号线L3，第4X+2级移位寄存器SR4X+2的复位信号输入端C3连接第四时钟信号线L4。
第4X+3级移位寄存器SR4X+3的起始信号输入端C1连接第三时钟信号线L3，第4X+3级移位寄存器SR4X+3的输出信号控制端C2连接第四时钟信号线L4，第4X+3级移位寄存器SR4X+3的复位信号输入端C3连接第一时钟信号线L1。
第4X+4级移位寄存器SR4X+4的起始信号输入端C1连接第四时钟信号线L4，第4X+4级移位寄存器SR4X+4的输出信号控制端C2连接第一时钟信号线L1，第4X+4级移位寄存器SR4X+4的复位信号输入端C3连接第二时钟信号线L2，其中，X大于或等于0。
图14为本发明实施例所述的显示面板的第一扫描驱动子电路的时序图，参考图13和图14，描述图10中第一扫描驱动子电路的第一循环组的工作时序如下：
在第一个时钟周期T1的第一时刻t1，第4X+1级移位寄存器SR4X+1的起始信号输入端C1接收第一时钟信号CKV1为有效电平，第4X+1级移位寄存器SR4X+1处于输出端OUT4X+1可输出有效电平的状态；在第一个时钟周期T1的第二时刻t2，第4X+1级移位寄存器SR4X+1的输出信号控制端C2接收第二时钟信号CKV2为有效电平，若第4X+1级移位寄存器SR4X+1的输入端IN4X+1在上述第一时刻t1接收到有效电平，则第4X+1级移位寄存器SR4X+1的输出端OUT4X+1在该第二时刻t2输出有效电平；在第一个时钟周期T1的第三时刻t3，第4X+1级移位寄存器SR4X+1的复位信号输入端C3接收第三时钟信号CKV3为有效电平，第4X+1级移位寄存器SR4X+1输出端OUT4X+1可输出有效电平的状态被复位，在下一个时钟周期T2内，第4X+1级移位寄存器SR4X+1还可以处于输出端OUT4X+1可输出有效电平的状态，但由于一个扫描周期内第4X+1级移位寄存器SR4X+1的输入端IN4X+1仅能够接收到一次有效电平，所以，在一个扫描周期内，第4X+1级移位寄存器SR4X+1的输出端OUT4X+1仅在第一个时钟周期T1的第二时刻t2输出有效电平。
同理，对于第4X+2级移位寄存器SR4X+2，在第一个时钟周期T1的第二时刻t2，处于输出端OUT4X+2可输出有效电平的状态，并且输入端IN4X+2接收到有效电平，在第一个时钟周期T1的第三时刻t3，输出信号控制端C2为有效电平，输出端OUT4X+2输出有效电平。
同理，对于第4X+3级移位寄存器SR4X+3，在第一个时钟周期T1的第三时刻t3，处于输出端OUT4X+3可输出有效电平的状态，并且输入端IN4X+3接收到有效电平，在第一个时钟周期T1的第四时刻t4，输出信号控制端C2为有效电平，输出端OUT4X+3输出有效电平。
同理，对于第4X+4级移位寄存器SR4X+4，在第一个时钟周期T1的第四时刻t4，处于输出端OUT4X+4可输出有效电平的状态，并且输入端IN4X+4接收到有效电平，在第二个时钟周期T2的第一时刻t1，输出信号控制端C2为有效电平，输出端OUT4X+4输出有效电平。
综上所述，在第一个时钟周期T1的第二时刻t2、第三时刻t3、第四时刻t4和第二个时钟周期T2的第一时刻t1，第一扫描驱动子电路的第一循环组中的四个移位寄存器依次输出有效电平，实现了逐行扫描。
如图11所示，在第二扫描驱动子电路中，寄存第2X+1级移位寄存器SR2X+1的起始信号输入端C1连接第一时钟信号线L1，第2X+1级移位寄存器SR2X+1的输出信号控制端C2连接第三时钟信号线L3，第2X+1级移位寄存器SR2X+1的复位信号输入端C3连接第四时钟信号线L4。
第2X+2级移位寄存器SR2X+2的起始信号输入端C1连接第三时钟信号线L3，第2X+2级移位寄存器SR2X+2的输出信号控制端C2连接第一时钟信号线L1，第2X+2级移位寄存器SR2X+2的复位信号输入端C3连接第二时钟信号线L2。
图15为本发明实施例所述的显示面板的第二扫描驱动子电路的时序图，参考图13和图15，描述图11中第二扫描驱动子电路的第二循环组的工作时序如下：
在第一个时钟周期T1的第一时刻t1，第2X+1级移位寄存器SR2X+1的起始信号输入端C1接收第一时钟信号CKV1为有效电平，第2X+1级移位寄存器SR2X+1处于输出端OUT2X+1可输出有效电平的状态；在第一个时钟周期T1的第三时刻t3，第2X+1级移位寄存器SR4X+1的输出信号控制端C2接收第三时钟信号CKV3为有效电平，若第2X+1级移位寄存器SR2X+1的输入端IN2X+1在上述第一时刻t1接收到有效电平，则第2X+1级移位寄存器SR2X+1的输出端OUT2X+1在该第三时刻t3输出有效电平；在第一个时钟周期T1的第四时刻t4，第2X+1级移位寄存器SR2X+1的复位信号输入端C3接收第四时钟信号CKV4为有效电平，第2X+1级移位寄存器SR2X+1输出端OUT2X+1可输出有效电平的状态被复位，在下一个时钟周期T2内，第2X+1级移位寄存器SR2X+1还可以处于输出端OUT2X+1可输出有效电平的状态，但由于一个扫描周期内第2X+1级移位寄存器SR2X+1的输入端IN2X+1仅能够接收到一次有效电平，所以，在一个扫描周期内，第2X+1级移位寄存器SR2X+1的输出端OUT2X+1仅在第一个时钟周期T1的第三时刻t3输出有效电平。
同理，对于第2X+2级移位寄存器SR2X+2，在第一个时钟周期T1的第三时刻t3，处于输出端OUT2X+2可输出有效电平的状态，并且输入端IN2X+2接收到有效电平，在第二个时钟周期T2的第一时刻t1，输出信号控制端C2为有效电平，输出端OUT2X+2输出有效电平。
综上所述，在第一个时钟周期T1的第三时刻t1和第二个时钟周期T2的第一时刻t3，第二扫描驱动子电路的第二循环组中的两个移位寄存器依次输出有效电平。
如图12所示，在第三扫描驱动子电路中，从第1级移位寄存器开始，每2级移位寄存器构成一个第三循环组，每个第三循环组中，第2X+1级移位寄存器SR2X+1的起始信号输入端C1连接第二时钟信号线L2，第2X+1级移位寄存器SR2X+1的输出信号控制端C2连接第四时钟信号线L4，第2X+1级移位寄存器SR2X+1的复位信号输入端C3连接第一时钟信号线L1。
第2X+2级移位寄存器SR2X+2的起始信号输入端C1连接第四时钟信号线L4，第2X+2级移位寄存器SR2X+2的输出信号控制端C2连接第二时钟信号线L2，第2X+2级移位寄存器SR2X+2的复位信号输入端C3连接第三时钟信号线L3。
图16为本发明实施例所述的显示面板的第三扫描驱动子电路的时序图，参考图13和图16，描述图12中第三扫描驱动子电路的第三循环组的工作时序如下：
在第一个时钟周期T1的第二时刻t2，第2X+1级移位寄存器SR2X+1的起始信号输入端C1接收第二时钟信号CKV2为有效电平，第2X+1级移位寄存器SR2X+1处于输出端OUT2X+1可输出有效电平的状态；在第一个时钟周期T1的第四时刻t4，第2X+1级移位寄存器SR4X+1的输出信号控制端C2接收第四时钟信号CKV4为有效电平，若第2X+1级移位寄存器SR2X+1的输入端IN2X+1在上述第二时刻t2接收到有效电平，则第2X+1级移位寄存器SR2X+1的输出端OUT2X+1在该第四时刻t4输出有效电平；在第二个时钟周期T2的第一时刻t1，第2X+1级移位寄存器SR2X+1的复位信号输入端C3接收第一时钟信号CKV1为有效电平，第2X+1级移位寄存器SR2X+1输出端OUT2X+1可输出有效电平的状态被复位，在第二个时钟周期T2的下一个时钟周期内，第2X+1级移位寄存器SR2X+1还可以处于输出端OUT2X+1可输出有效电平的状态，但由于一个扫描周期内第2X+1级移位寄存器SR2X+1的输入端IN2X+1仅能够接收到一次有效电平，所以，在一个扫描周期内，第2X+1级移位寄存器SR2X+1的输出端OUT2X+1仅在第一个时钟周期T1的第四时刻t4输出有效电平。
同理，对于第2X+2级移位寄存器SR2X+2，在第一个时钟周期T1的第四时刻t4，处于输出端OUT2X+2可输出有效电平的状态，并且输入端IN2X+2接收到有效电平，在第二个时钟周期T2的第二时刻t2，输出信号控制端C2为有效电平，输出端OUT2X+2输出有效电平。
综上所述，在第一个时钟周期T1的第四时刻t4和第二个时钟周期T2的第二时刻t2，第三扫描驱动子电路的第三循环组中的两个移位寄存器依次输出有效电平。
综合第二扫描驱动子电路和第三扫描驱动子电路，在第一个时钟周期T1的第三时刻t3，第二扫描驱动子电路输出有效电平，在第一个时钟周期T1的第四时刻t3，第三扫描驱动子电路输出有效电平，在第二个时钟周期T2的第一时刻t1，第二扫描驱动子电路输出有效电平，在第二个时钟周期T2的第二时刻t2，第三扫描驱动子电路输出有效电平，也即，第二扫描驱动子电路和第三扫描驱动子电路相配合实现了隔行扫描。
进一步地，在另一种实施例中，显示面板还包括第五时钟信号线、第六时钟信号线、第七时钟信号线和第八时钟信号线，图17为本发明实施例所述的另一种显示面板的第一扫描驱动子电路的原理图，图18为本发明实施例所述的另一种显示面板的第二扫描驱动子电路的原理图，图19为本发明实施例所述的另一种显示面板的第三扫描驱动子电路的原理图，如图17至图19所示，第五时钟信号线L5、第六时钟信号线L6、第七时钟信号线L7和第八时钟信号线L8向移位寄存器的起始信号输入端C1、输出信号控制端C2和复位信号输入端C3提供时钟信号。
图20为本发明实施例所述的另一种显示面板的时钟信号时序图，同时参考图17至图20，在一个扫描周期内，包括第一时间段和第二时间段，第一时间段为驱动第一区域内的扫描线的时间，第二时间段为驱动第二区域内的扫描线的时间。
在第一时间段内，即，在驱动第一区域内的扫描线时，第五时钟信号线L5提供第五时钟信号CKV5，第六时钟信号线L6提供第六时钟信号CKV6，第七时钟信号线L7提供第七时钟信号CKV7，第八时钟信号线L8提供第八时钟信号CKV8，每个时钟信号的一个时钟周期均包括三个时刻，在一个时钟周期内，第五时钟信号CKV5仅在第一个时刻内为有效电平，第六时钟信号CKV6仅在第二个时刻内为有效电平，第七时钟信号CKV7仅在第三个时刻内为有效电平，第八时钟信号CKV8持续为非有效电平。
在第二时间段内，即，在驱动二区域内的扫描线时，第五时钟信号线L5提供第九时钟信号CKV9，第六时钟信号线L6提供第十时钟信号CKV10，第七时钟信号线L7提供第十一时钟信号CKV11，第八时钟信号线L8提供第十二时钟信号CKV12，每个时钟信号的一个时钟周期均包括四个时刻，在一个时钟周期内，第五时钟信号CKV5仅在第一个时刻内为有效电平，第六时钟信号CKV6仅在第二个时刻内为有效电平，第七时钟信号CKV7仅在第三个时刻内为有效电平，第八时钟信号CKV8仅在第四个时刻有效电平。
如图17所示，在第一扫描驱动子电路中，从第1级移位寄存器开始，每3级移位寄存器构成一个第四循环组，每个第四循环组中，第3X+1级移位寄存器SR3X+1的起始信号输入端C1连接第五时钟信号线L5，第3X+1级移位寄存器SR3X+1的输出信号控制端C2连接第六时钟信号线L6，第3X+1级移位寄存器SR3X+1的复位信号输入端C3连接第七时钟信号线L7。
第3X+2级移位寄存器SR3X+1的起始信号输入端C1连接第六时钟信号线L6，第3X+2级移位寄存器SR3X+2的输出信号控制端C2连接第七时钟信号线L7，第3X+2级移位寄存器SR3X+2的复位信号输入端C3连接第五时钟信号线L5。
第3X+3级移位寄存器SR3X+3的起始信号输入端C1连接第七时钟信号线L7，第3X+3级移位寄存器SR3X+3的输出信号控制端C2连接第五时钟信号线L5，第3X+3级移位寄存器SR3X+3的复位信号输入端C3连接第六时钟信号线L6，第一扫描驱动子电路不与第八时钟信号线L8相连接，其中，X大于或等于0。
图21为本发明实施例所述的另一种显示面板的第一扫描驱动子电路的时序图，参考图20和图21，描述图17中第一扫描驱动子电路的第四循环组的工作时序如下：
在第一时间段内，第一扫描驱动子电路扫描第一区域，第二时间段内，第一扫描驱动子电路不输出有效电平，该处仅描述第一时间段内的第一扫描驱动子电路的时序。
在第一个时钟周期T1的第一时刻t1，第3X+1级移位寄存器SR3X+1的起始信号输入端C1接收第五时钟信号CKV5为有效电平，第3X+1级移位寄存器SR3X+1处于输出端OUT3X+1可输出有效电平的状态；第一个时钟周期T1的第二时刻t2，第3X+1级移位寄存器SR3X+1的输出信号控制端C2连接第六时钟信号CKV6为有效电平，若第3X+1级移位寄存器SR3X+1的输入端IN3X+1在上述第一时刻t1接收到有效电平，则第3X+1级移位寄存器SR3X+1的输出端OUT43X+1在该第二时刻t2输出有效电平；在第一个时钟周期T1的第三时刻t3，第3X+1级移位寄存器SR3X+1的复位信号输入端C3接收第七时钟信号CKV7有效电平，第3X+1级移位寄存器SR3X+1输出端OUT3X+1可输出有效电平的状态被复位，在下一个时钟周期T2内，第3X+1级移位寄存器SR3X+1还可以处于输出端OUT3X+1可输出有效电平的状态，但由于一个扫描周期内第3X+1级移位寄存器SR3X+1的输入端IN3X+1仅能够接收到一次有效电平，所以，在一个扫描周期内，第3X+1级移位寄存器SR3X+1的输出端OUT3X+1仅在第一个时钟周期T1的第二时刻t2输出有效电平。
同理，对于第3X+2级移位寄存器SR3X+2，在第一个时钟周期T1的第二时刻t2，处于输出端OUT3X+2可输出有效电平的状态，并且输入端IN3X+2接收到有效电平，在第一个时钟周期T1的第三时刻t3，输出信号控制端C2为有效电平，输出端OUT3X+2输出有效电平。
同理，对于第3X+3级移位寄存器SR3X+3，在第一个时钟周期T1的第三时刻t3，处于输出端OUT3X+3可输出有效电平的状态，并且输入端IN3X+3接收到有效电平，在第二个时钟周期T2的第一时刻t1，输出信号控制端C2为有效电平，输出端OUT3X+3输出有效电平。
综上所述，在第一个时钟周期T1的第二时刻t2和第三时刻t3，第二个时钟周期T2的第一时刻t1，第一扫描驱动子电路的第四循环组中的三个移位寄存器依次输出有效电平，实现了逐行扫描。
如图18所示，在第二扫描驱动子电路中，从第1级移位寄存器开始，每2级移位寄存器构成一个第五循环组，每个第五循环组中，第2X+1级移位寄存器SR2X+1的起始信号输入端C1连接第五时钟信号线L5，第SR2X+1级移位寄存器2X+1的输出信号控制端C2连接第七时钟信号线L7，第SR2X+1级移位寄存器2X+1的复位信号输入端C3连接第八时钟信号线L8。
第2X+2级移位寄存器SR2X+2的起始信号输入端C1连接第七时钟信号线L7，第2X+2级移位寄存器SR2X+2的输出信号控制端C2连接第五时钟信号线L5，第2X+2级移位寄存器SR2X+2的复位信号输入端C3连接第六时钟信号线L6。
图22为本发明实施例所述的另一种显示面板的第二扫描驱动子电路的时序图，参考图20和图22，描述图18中第二扫描驱动子电路的第五循环组的工作时序如下：
在第二时间段内，第二扫描驱动子电路扫描第二区域，第一时间段内，第二扫描驱动子电路不输出有效电平，该处仅描述第二时间段内第二扫描驱动子电路的时序。
在第一个时钟周期T1的第一时刻t1，第2X+1级移位寄存器SR2X+1的起始信号输入端C1接收第九时钟信号CKV9为有效电平，第2X+1级移位寄存器SR2X+1处于输出端OUT2X+1可输出有效电平的状态；在第一个时钟周期T1的第三时刻t3，第2X+1级移位寄存器SR2X+1的输出信号控制端C2接收第十一时钟信号CKV11为有效电平，若第2X+1级移位寄存器SR2X+1的输入端IN2X+1在上述第一时刻t1接收到有效电平，则第2X+1级移位寄存器SR2X+1的输出端OUT2X+1在该第三时刻t3输出有效电平；在第一个时钟周期T1的第四时刻t4，第2X+1级移位寄存器2X+1的复位信号输入端C3接收第十二时钟信号CKV12为有效电平，第2X+1级移位寄存器SR2X+1输出端OUT2X+1可输出有效电平的状态被复位，在下一个时钟周期T2内，第2X+1级移位寄存器SR2X+1还可以处于输出端OUT2X+1可输出有效电平的状态，但由于一个扫描周期内第2X+1级移位寄存器SR2X+1的输入端IN2X+1仅能够接收到一次有效电平，所以，在一个扫描周期内，第2X+1级移位寄存器SR2X+1的输出端OUT2X+1仅在第一个时钟周期T1的第三时刻t3输出有效电平。。
同理，对于第2X+2级移位寄存器2X+2，在第一个时钟周期T1的第三时刻t3，处于输出端OUT2X+2可输出有效电平的状态，并且输入端IN2X+2接收到有效电平，在第二个时钟周期T2的第一时刻t1，输出信号控制端C2为有效电平，输出端OUT2X+2输出有效电平。
综上所述，在第一个时钟周期T1的第三时刻t3和第二个时钟周期T2的第一时刻13，第二扫描驱动子电路的第五循环组中的两个移位寄存器依次输出有效电平。
如图19所示，在第三扫描驱动子电路中，从第1级移位寄存器开始，每2级移位寄存器构成一个第六循环组，每个第六循环组中，第2X+1级移位寄存器SR2X+1的起始信号输入端C1连接第六时钟信号线L6，第2X+1级移位寄存器SR2X+1的输出信号控制端C2连接第八时钟信号线L8，第2X+1级移位寄存器SR2X+1的复位信号输入端C3连接第五时钟信号线L5。
第2X+2级移位寄存器SR2X+2的起始信号输入端C1连接第八时钟信号线L8，第2X+2级移位寄存器SR2X+2的输出信号控制端C2连接第六时钟信号线L6，第2X+2级移位寄存器SR2X+2的复位信号输入端C3连接第七时钟信号线L7。
图23为本发明实施例所述的另一种显示面板的第三扫描驱动子电路的时序图，参考图20和图23，描述图18中第三扫描驱动子电路的第六循环组的工作时序如下：
在第二时间段内，第三扫描驱动子电路扫描第二区域，第一时间段内，第三扫描驱动子电路不输出有效电平，该处仅描述第二时间段内第三扫描驱动子电路的时序。
在第一个时钟周期T1的第二时刻t2，第2X+1级移位寄存器SR2X+1的起始信号输入端C1接收第十时钟信号CKV10为有效电平，第2X+1级移位寄存器SR2X+1处于输出端OUT2X+1可输出有效电平的状态；在第一个时钟周期T1的第四时刻t4，第2X+1级移位寄存器SR2X+1的输出信号控制端C2接收第十二时钟信号CKV12为有效电平，若第2X+1级移位寄存器SR2X+1的输入端IN2X+1在上述第二时刻t2接收到有效电平，则第2X+1级移位寄存器SR2X+1的输出端OUT2X+1在该第四时刻t4输出有效电平；在第二个时钟周期T2的第一时刻t1，第2X+1级移位寄存器SR2X+1的复位信号输入端C3接收第九时钟信号CKV9为有效电平，第2X+1级移位寄存器SR2X+1输出端OUT2X+1可输出有效电平的状态被复位，在第二个时钟周期T2的下一个时钟周期内，第2X+1级移位寄存器SR2X+1还可以处于输出端OUT2X+1可输出有效电平的状态，但由于一个扫描周期内第2X+1级移位寄存器SR2X+1的输入端IN2X+1仅能够接收到一次有效电平，所以，在一个扫描周期内，第2X+1级移位寄存器SR2X+1的输出端OUT2X+1仅在第一个时钟周期T1的第四时刻t4输出有效电平。
同理，对于第2X+2级移位寄存器SR2X+2，在第一个时钟周期T1的第四时刻t4，处于输出端OUT2X+2可输出有效电平的状态，并且输入端IN2X+2接收到有效电平，在第二个时钟周期T1的第二时刻t2，输出信号控制端C2为有效电平，输出端OUT2X+2输出有效电平。
综上所述，在第一个时钟周期T1的第四时刻t4和第二个时钟周期T2的第二时刻t2，第三扫描驱动子电路的第三循环组中的两个移位寄存器依次输出有效电平。
综合第二扫描驱动子电路和第三扫描驱动子电路，在第一个时钟周期T1的第三时刻t3，第二扫描驱动子电路输出有效电平，在第一个时钟周期T1的第四时刻t3，第三扫描驱动子电路输出有效电平，在第二个时钟周期T2的第一时刻t1，第二扫描驱动子电路输出有效电平，在第二个时钟周期T2的第二时刻t2，第三扫描驱动子电路输出有效电平，也即，第二扫描驱动子电路和第三扫描驱动子电路相配合实现了隔行扫描。
进一步地，图24为本发明实施例所述的显示面板的移位寄存器的内部电路图，在一种实施例中，显示面板中的所有移位寄存器均采用图24所示的移位寄存器，如图24所示，该移位寄存器包括输入端INn、输出端OUTn、起始信号输入端C1、输出信号控制端C2、复位信号输入端C3、关断电压输入端VGL、开启电压输入端VGH、九个N型晶体管和两个电容，其中：
第一晶体管Tr1的第一端与第二晶体管Tr2的第一端相连接，第一晶体管Tr1的第二端连接关断电压输入端VGL，第一晶体管Tr1的控制端连接第五晶体管Tr5的控制端，其中，第一晶体管Tr1的第一端与第二晶体管Tr2的第一端之间设置第一节点P1，第一晶体管Tr1的第二端与关断电压输入端VGL之间依次具有第二节点P2、第三节点P3、第四节点P4和第五节点P5，第一晶体管Tr1的控制端和第五晶体管Tr5的控制端之间依次具有第六节点P6、第七节点P7和第八节点P8；
第二晶体管Tr2的第二端连接输入端INn，第二晶体管Tr2的控制端连接起始信号输入端C1，其中，第二晶体管Tr2的第二端与输入端INn的第一端之间具有第九节点P9；
第三晶体管Tr3的第一端连接第三节点P3，第三晶体管Tr3的第二端连接第七节点P7；
第四晶体管Tr4的第一端连接第七节点P7，第四晶体管Tr4的第二端连接开启电压输入端VGH，第四晶体管Tr4的控制端连接第九晶体管Tr9的控制端，其中，第四晶体管Tr4的第二端与开启电压输入端VGH之间具有第十节点P10，第四晶体管Tr4的控制端与第九晶体管Tr9的控制端之间具有第十一节点P11，第十一节点P11连接复位信号输入端C3；
第五晶体管Tr5的第一端连接第五节点P5，第五晶体管Tr5的第二端连接第六晶体管Tr6的第一端，其中，第五晶体管Tr5的第二端与第六晶体管Tr6的第一端之间具有第十二节点P12，第十二节点P12连接输出端OUTn；
第六晶体管Tr6的第二端连接输出信号控制端C2；
第七晶体管Tr7的第一端连接第一节点P1，第七晶体管Tr7的控制端连接第十节点P10，其中，第七晶体管Tr7的第一端与第一节点P1之间依次具有第十三节点P13和第十四节点P14，第十三节点P13连接第三晶体管Tr3的控制端；
第八晶体管Tr8的第一端连接第二节点P2，第八晶体管Tr8的第二端连接第六节点P6；
第九晶体管Tr9的第一端连接第十四节点P14，第九晶体管Tr9的第二端连接第九节点P9，其中，第九晶体管Tr9的第二端与第九节点P9之间具有第十五节点P15，第十五节点P15连接第八晶体管Tr8的控制端；
第一电容C1'的第一端连接第四节点P4，第一电容C1'的第二端连接第八节点P8；
第二电容C2'的第一端连接第十二节点P12，第二电容C2'的第二端连接第七晶体管Tr7的第二端，其中，第二电容C2'的第二端与第七晶体管Tr7的第二端之间具有第十六节点P16，第十六节P16连接第六晶体管Tr6的控制端。
图25为本发明实施例所述的显示面板的第一扫描驱动子电路中的图24所示移位寄存器的时序图，结合图24与图25，图24所示移位寄存器用在第一扫描驱动子电路时，时序说明如下：
在第一时刻t1，移位寄存器的输入端INn为有效电平(也即高电平)，起始信号输入端C1为高电平，此时，第二晶体管Tr2导通，节点N2a为高电平；第七晶体管Tr7导通，节点N2b为高电；节点N1为低电平，第五晶体管Tr5关断，输出端OUTn输出低电平。
在第二时刻t2，输出信号控制端C2为高电平，此时，第二晶体管Tr2关断，节点N2b仍为高电平，节点N1为低电平，第五晶体管Tr5关断，第六晶体管导通，输出端OUTn输出高电平，实现输出端OUTn对输入端INn的高电平的移位。
在第三时刻t3，复位信号输入端C3为高电平，此时，第四晶体管Tr4导通，节点N1为高电平，第五晶体管Tr5导通，输出端OUTn输出低电平。
图26为本发明实施例所述的显示面板的第二和第三扫描驱动子电路中的图24所示移位寄存器的时序图，结合图24与图26，图24所示移位寄存器用在第二和第三扫描驱动子电路时，时序说明如下：
在第一时刻t1，移位寄存器的输入端INn为有效电平(也即高电平)，起始信号输入端C1为高电平，此时，第二晶体管Tr2导通，节点N2a为高电平；第七晶体管Tr7导通，节点N2b为高电平；节点N1为低电平，第五晶体管Tr5关断，输出端OUTn输出低电平。
在第二时刻t2，输出信号控制端C2为低电平，此时，第二晶体管Tr2关断，节点N2b仍为高电平，节点N1为低电平，第五晶体管Tr5关断，第六晶体管导通，输出端OUTn输出低电平。
在第三时刻t3，输出信号控制端C2为高电平，此时，第二晶体管Tr2关断，第二电容C2'放电，节点N2b仍为高电平，节点N1为低电平，第五晶体管Tr5关断，第六晶体管导通，输出端OUTn输出高电平，实现输出端OUTn对输入端INn的高电平的移位。
在第四时刻t3，复位信号输入端C3为高电平，此时，第四晶体管Tr4导通，节点N1为高电平，第五晶体管Tr5导通，输出端OUTn输出低电平。
以上部分内容描述了第一扫描驱动子电路如何实现逐行扫描，第二和第三扫描驱动子电路如何实现隔行扫描，以及移位寄存器单元的实现和时序，对于显示面板整体，第一扫描驱动子电路与第二扫描驱动子电路如何级联，与扫描周期内先扫描第一区域还是先扫描第二区域相关。
进一步地，在一种实施例中，图27为本发明实施例所述的一种显示面板的时序图，显示面板的一个扫描周期内，先扫描第一区域后扫描第二区域，第一区域中最先被扫描的一行子像素为第1行子像素，第一区域中最后被扫描的一行子像素为第N行子像素，第二区域中最先被扫描的一行子像素为第N+1行子像素，第二区域中最后被扫描的一行子像素为第N+M行子像素。需要说明的是，该处的第1行子像素并不限定为显示面板上的第1行子像素，仅用于表达第一区域和第二区域的扫描顺序。
先扫描第一区域，第一扫描驱动子电路的第1级移位寄存器的输出端1-OUT1至最后一级移位寄存器的输出端1-OUTN依次输出有效信号，逐行依次打开显示面板的第1至第N行子像素的薄膜晶体管，完成第一区域的扫描。
然后扫描第二区域，第三扫描驱动子电路的第1级移位寄存器的输入端3-IN1接收的信号与第一扫描驱动子电路的倒数第2级移位寄存器的输出端1-OUTN-1输出的信号相同，使得第三扫描驱动子电路的第1级移位寄存器的输出端3-OUT1的信号能够打开显示面板的第N+1行子像素的薄膜晶体管。第二扫描驱动子电路的第1级移位寄存器的输入端2-IN1连接第一扫描驱动子电路的最后一级移位寄存器的输出端1-OUTN，也即，第二扫描驱动子电路的第1级移位寄存器的输入端2-IN1接收第一扫描驱动子电路的最后一级移位寄存器的输出端1-OUTN输出的信号，使得第二扫描驱动子电路的第1级移位寄存器的输出端2-OUT1的信号能够打开显示面板的第N+2行子像素的薄膜晶体管，然后，再由第三扫描驱动子电路的第2级移位寄存器的输出端3-OUT2的信号打开显示面板的第N+3行子像素的薄膜晶体管，第二扫描驱动子电路的第2级移位寄存器的输出端2-OUT2的信号能够打开显示面板的第N+4行子像素的薄膜晶体管，依次类推，直到第二扫描驱动子电路的最后一级移位寄存器2-OUTM/2打开显示面板的第N+M行子像素的薄膜晶体管，完成第二区域的扫描，完成一个扫描周期。
进一步地，在另一种实施例中，图28为本发明实施例所述的另一种显示面板的时序图，显示面板的一个扫描周期内，先扫描第二区域后扫描第一区域。第二区域中最先被扫描的一行子像素为第1行子像素，第二区域中最后被扫描的一行子像素为第N行子像素，第一区域中最先被扫描的一行子像素为第N+1行子像素，第一区域中最后被扫描的一行子像素为第N+M行子像素。需要说明的是，该处的第1行子像素并不限定为显示面板上的第1行子像素，仅用于表达第一区域和第二区域的扫描顺序。
先扫描第二区域时，第三扫描驱动子电路的第1级移位寄存器的输入端先于第四扫描驱动子电路的第1级移位寄存器的输入端一个时刻接收到有效电平，则第三扫描驱动子电路的第1级移位寄存器的输出端3-OUT1的信号能够打开显示面板的第1行子像素的薄膜晶体管，第二扫描驱动子电路的第1级移位寄存器的输出端2-OUT1的信号能够打开显示面板的第2行的薄膜晶体管，第三扫描驱动子电路的第2级移位寄存器的输出端3-OUT2的信号能够打开显示面板的第3行子像素的薄膜晶体管，第二扫描驱动子电路的第2级移位寄存器的输出端2-OUT2的信号能够打开显示面板的第4行子像素的薄膜晶体管，依次类推，直到第二扫描驱动子电路的最后一级移位寄存器2-OUTN/2打开显示面板的第N行子像素的薄膜晶体管，完成第二区域的扫描。
然后扫描第一区域，第一扫描驱动子电路的第1级移位寄存器的输入端1-IN1连接第二扫描驱动子电路的最后一级移位寄存器的输出端，使得第一扫描驱动子电路的第1级移位寄存器的输出端1-OUT1的信号能够打开显示面板的第N+1行子像素的薄膜晶体管，第一扫描驱动子电路的第1级移位寄存器的输出端1-OUT1至最后一级移位寄存器的输出端1-OUTM依次输出有效信号，逐行依次打开显示面板的第N+1至第N+M行子像素的薄膜晶体管，完成第一区域的扫描，完成一个扫描周期。
具体地，依据异形显示面板的具体形状，可以相应设置显示面板的扫描驱动电路。
在一种实施例中，图29为本发明实施例所述的另一种显示面板的结构示意图，如图29所示，显示面板的左上角的部分区域被切割，使得显示面板具有在第二方向b上相邻设置的异形区域(也即第一区域)AA1和正常区域(也即第二区域AA2)。
其中，显示面板的扫描驱动电路包括：设置于异形区域AA1的右侧边框的第一扫描驱动子电路VSR1、设置于正常区域AA2的右侧边框的第二扫描驱动子电路VSR1和设置于正常区域AA2的左侧边框的第三扫描驱动子电路VSR3。第一扫描驱动子电路VSR1与第二扫描驱动子电路VSR2级联，第一扫描驱动子电路VSR1对异形区域AA1内子像素进行逐行扫描，第二扫描驱动子电路VSR2和第三扫描驱动子电路VSR3对正常区域AA2内子像素进行隔行扫描。
在第二种实施例中，图30为本发明实施例所述的另一种显示面板的结构示意图，如图30所示，显示面板的右上角的部分区域被切割，使得显示面板具有在第二方向b上相邻设置的异形区域(也即第一区域)AA1和正常区域(也即第二区域AA2)。
其中，显示面板的扫描驱动电路包括：设置于异形区域AA1的左侧边框的第一扫描驱动子电路VSR1、设置于正常区域AA2的左侧边框的第二扫描驱动子电路VSR2和设置于正常区域AA2的右侧边框的第三扫描驱动子电路VSR3。
第一扫描驱动子电路VSR1与第二扫描驱动子电路VSR2级联，第一扫描驱动子电路VSR1对异形区域AA1内子像素进行逐行扫描，第二扫描驱动子电路VSR2和第三扫描驱动子电路VSR3对正常区域AA2内子像素进行隔行扫描。
在第三种实施例中，图31为本发明实施例所述的另一种显示面板的结构示意图，如图31所示，显示面板的上部部分边缘的中间部分区域被切割，形成缺口，使得显示面板具有在第二方向b上相邻设置的异形区域和正常区域(也即第二区域AA2)，其中，异形区域包括在第一方向a上依次设置的第一异形区域(也即第一区域AA1)和第二异形区域(也即第三区域AA3)，在第一方向上第一异形区域AA1与第二异形区域AA3分别位于缺口的两侧。
其中，显示面板的扫描驱动电路包括：设置于第一异形区域AA1的右侧边框的第一扫描驱动子电路VSR1、设置于第二异形区域AA3的左侧边框的第四扫描驱动子电路VSR4、设置于正常区域AA2的右侧边框的第二扫描驱动子电路VSR2和设置于正常区域AA2的左侧边框的第三扫描驱动子电路VSR3。
第一扫描驱动子电路VSR1与第二扫描驱动子电路VSR2级联，第四扫描驱动子电路VSR1与第三扫描驱动子电路VSR2级联，第一扫描驱动子电路VSR1对第一异形区域AA1内子像素进行逐行扫描，第四扫描驱动子电路VSR4对第二异形区域AA3内子像素进行逐行扫描，并且，第四扫描驱动子电路VSR4与第一扫描驱动子电路VSR1相同。第二扫描驱动子电路VSR2和第三扫描驱动子电路VSR3对正常区域AA2内子像素进行隔行扫描。
在第四种实施例中，图32为本发明实施例所述的另一种显示面板的结构示意图，如图32所示，显示面板的中部部分区域被切割形成镂空部LQ，使得显示面板具有在第二方向b上相邻设置的第一正常区域AA4、异形区域和第二正常区域(也即第二区域AA2)，其中，异形区域包括在第一方向a上依次设置的第一异形区域(也即第一区域AA1)和第二异形区域(也即第三区域AA3)，在第一方向上第一异形区域AA1与第二异形区域AA3分别位于镂空部LQ的两侧。
其中，显示面板的扫描驱动电路包括：设置于第一正常区域AA4的左侧边框的第五扫描驱动子电路VSR5、设置于第一正常区域AA4的右侧边框的第六扫描驱动子电路VSR6、设置于第一异形区域AA1的左侧边框的第一扫描驱动子电路VSR1、设置于第二异形区域AA3的右侧边框的第一四扫描驱动子电路VSR4、设置于第二正常区域AA2的左侧边框的第二扫描驱动子电路VSR2和设置于第二正常区域AA2的右侧边框的第三扫描驱动子电路VSR3。
第五扫描驱动子电路VSR5、第一扫描驱动子电路VSR1与第二扫描驱动子电路VSR2依次级联，第六扫描驱动子电路VSR6、第四扫描驱动子电路VSR1与第三扫描驱动子电路VSR2级联。第五扫描驱动子电路VSR5和第六扫描驱动子电路VSR6对第一正常区域AA4内子像素进行隔行扫描。第一扫描驱动子电路VSR1对第一异形区域AA1内子像素进行逐行扫描，第四扫描驱动子电路VSR4对第二异形区域AA3内子像素进行逐行扫描，第二扫描驱动子电路VSR2和第三扫描驱动子电路VSR3对第二正常区域AA2内子像素进行隔行扫描。
第四扫描驱动子电路VSR4与第一扫描驱动子电路VSR1相同。第一正常区域AA4与第二正常区域AA2大小相同时，第五扫描驱动子电路VSR5与第二扫描驱动子电路VSR2相同，第六扫描驱动子电路VSR6与第三扫描驱动子电路VSR3相同；第一正常区域AA4大于第二正常区域AA2时，第五扫描驱动子电路VSR5的一部分与第二扫描驱动子电路VSR2相同，第六扫描驱动子电路VSR6的一部分与第三扫描驱动子电路VSR3相同；第一正常区域AA4小于第二正常区域AA2时，第五扫描驱动子电路VSR5与第二扫描驱动子电路VSR2的一部分相同，第六扫描驱动子电路VSR6与第三扫描驱动子电路VSR3的一部分相同。
以上为对本发明提供的显示面板的实施例进行的描述，本发明还提供了一种显示装置，该显示装置可以为手机、PAD或平板电脑等，包括本发明提供的任意一种显示面板，具有上述显示面板的效果，此处不再赘述。
通过上述实施例可知，本发明的显示面板和显示装置，达到了如下的有益效果：
部分区域采用逐行扫描的方式进行扫描，在这部分区域，仅需要在一侧设置扫描器驱动电路；另外部分区域采用隔行扫描的方式进行扫描，对于异形显示面板而言，使异形区域采用逐行扫描的方式进行扫描，大部分正常区域仍可采用隔行扫描的方式进行扫描，能够简化采用隔行扫描的方式进行扫描的异形显示面板走线方式，更利于实现窄边框。
虽然已经通过例子对本发明的一些特定实施例进行了详细说明，但是本领域的技术人员应该理解，以上例子仅是为了进行说明，而不是为了限制本发明的范围。本领域的技术人员应该理解，可在不脱离本发明的范围和精神的情况下，对以上实施例进行修改。本发明的范围由所附权利要求来限定。

Claims (10)

1.一种显示面板，其特征在于，包括：
多根扫描线，各所述扫描线分别在第一方向上延伸且在第二方向上依次排列，所述第一方向与所述第二方向交叉；
扫描驱动电路，用于驱动所述扫描线，包括至少三个扫描驱动子电路，三个所述扫描驱动子电路为第一扫描驱动子电路、第二扫描驱动子电路和第三扫描驱动子电路，所述第一扫描驱动子电路与所述第二扫描驱动子电路级联；
其中，所述显示面板具有在所述第二方向上相邻设置的第一区域和第二区域，所述第一扫描驱动子电路采用逐行扫描的方式驱动所述第一区域内的所述扫描线，所述第二扫描驱动子电路和所述第三扫描驱动子电路用于分别采用隔行扫描的方式驱动所述第二区域内的所述扫描线。
2.根据权利要求1所述的显示面板，其特征在于，
所述扫描驱动子电路包括若干依次级联的移位寄存器，所述移位寄存器包括输入端、输出端和输出信号控制端，所述输出端连接所述扫描线；
同一所述扫描驱动子电路中，第1级所述移位寄存器的输入端接收所述显示面板的起始移位信号或连接其他所述扫描驱动子电路中所述移位寄存器的输出端，第2级所述移位寄存器至第N级所述移位寄存器中的每一级所述移位寄存器的输入端连接上一级所述移位寄存器的输出端，其中，N为大于1的正整数；
同一所述移位寄存器中，在所述输入端接收到有效电平之后，所述输出端输出有效电平的时序与所述输出信号控制端接收到第一个有效电平的时序同步。
3.根据权利要求2所述的显示面板，其特征在于，
所述移位寄存器还包括起始信号输入端和复位信号输入端；
所述第一扫描驱动子电路的同一所述移位寄存器中，所述起始信号输入端、所述输出信号控制端和所述复位信号输入端接收到有效电平的时间依次相差一个时刻；
在所述第二扫描驱动子电路和所述第三扫描驱动子电路的同一所述移位寄存器中，所述起始信号输入端与所述输出信号控制端接收到有效电平的时间相差两个时刻，所述输出信号控制端与所述复位信号输入端接收到有效电平的时间依次相差一个时刻。
4.根据权利要求3所述的显示面板，其特征在于，
所述显示面板还包括：第一时钟信号线、第二时钟信号线、第三时钟信号线和第四时钟信号线；
在一个扫描周期内，所述第一时钟信号线提供第一时钟信号，所述第二时钟信号线提供第二时钟信号，所述第三时钟信号线提供第三时钟信号，所述第四时钟信号线提供第四时钟信号，每个时钟信号的一个时钟周期均包括四个时刻；
在一个所述时钟周期内，所述第一时钟信号仅在第一个时刻内为有效电平，所述第二时钟信号仅在第二个时刻内为有效电平，所述第三时钟信号仅在第三个时刻内为有效电平，所述第四时钟信号仅在第四个时刻内为有效电平；
在所述第一扫描驱动子电路中，第4X+1级移位寄存器的起始信号输入端连接所述第一时钟信号线，第4X+1级移位寄存器的输出信号控制端连接所述第二时钟信号线，第4X+1级移位寄存器的复位信号输入端连接所述第三时钟信号线，第4X+2级移位寄存器的起始信号输入端连接所述第二时钟信号线，第4X+2级移位寄存器的输出信号控制端连接所述第三时钟信号线，第4X+2级移位寄存器的复位信号输入端连接所述第四时钟信号线，第4X+3级移位寄存器的起始信号输入端连接所述第三时钟信号线，第4X+3级移位寄存器的输出信号控制端连接所述第四时钟信号线，第4X+3级移位寄存器的复位信号输入端连接所述第一时钟信号线，第4X+4级移位寄存器的起始信号输入端连接所述第四时钟信号线，第4X+4级移位寄存器的输出信号控制端连接所述第一时钟信号线，第4X+4级移位寄存器的复位信号输入端连接所述第二时钟信号线，其中，X大于或等于0；
在所述第二扫描驱动子电路中，第2X+1级移位寄存器的起始信号输入端连接所述第一时钟信号线，第2X+1级移位寄存器的输出信号控制端连接所述第三时钟信号线，第2X+1级移位寄存器的复位信号输入端连接所述第四时钟信号线，第2X+2级移位寄存器的起始信号输入端连接所述第三时钟信号线，第2X+2级移位寄存器的输出信号控制端连接所述第一时钟信号线，第2X+2级移位寄存器的复位信号输入端连接所述第二时钟信号线；
在所述第三扫描驱动子电路中，第2X+1级移位寄存器的起始信号输入端连接所述第二时钟信号线，第2X+1级移位寄存器的输出信号控制端连接所述第四时钟信号线，第2X+1级移位寄存器的复位信号输入端连接所述第一时钟信号线，第2X+2级移位寄存器的起始信号输入端连接所述第四时钟信号线，第2X+2级移位寄存器的输出信号控制端连接所述第二时钟信号线，第2X+2级移位寄存器的复位信号输入端连接所述第三时钟信号线。
5.根据权利要求3所述的显示面板，其特征在于，
所述显示面板还包括：第五时钟信号线、第六时钟信号线、第七时钟信号线和第八时钟信号线；
在一个扫描周期内，在第一时间段内，所述第五时钟信号线提供第五时钟信号，所述第六时钟信号线提供第六时钟信号，所述第七时钟信号线提供第七时钟信号，所述第八时钟信号线提供第八时钟信号，每个时钟信号的一个时钟周期均包括三个时刻，所述第五时钟信号仅在第一个时刻内为有效电平，所述第六时钟信号仅在第二个时刻内为有效电平，所述第七时钟信号仅在第三个时刻内为有效电平，所述第八时钟信号持续非有效电平；
在一个扫描周期内，在第二时间段内，所述第五时钟信号线提供第九时钟信号，所述第六时钟信号线提供第十时钟信号，所述第七时钟信号线提供第十一时钟信号，所述第八时钟信号线提供第十二时钟信号，每个时钟信号的一个时钟周期均包括四个时刻，所述第九时钟信号仅在第一个时刻内为有效电平，所述第十时钟信号仅在第二个时刻内为有效电平，所述第十一时钟信号仅在第三个时刻内为有效电平，所述第十二时钟信号仅在第四个时刻内为有效电平；
在所述第一扫描驱动子电路中，第3X+1级移位寄存器的起始信号输入端连接所述第五时钟信号线，第3X+1级移位寄存器的输出信号控制端连接所述第六时钟信号线，第3X+1级移位寄存器的复位信号输入端连接所述第七时钟信号线，第3X+2级移位寄存器的起始信号输入端连接所述第六时钟信号线，第3X+2级移位寄存器的输出信号控制端连接所述第七时钟信号线，第3X+2级移位寄存器的复位信号输入端连接所述第五时钟信号线，第3X+3级移位寄存器的起始信号输入端连接所述第七时钟信号线，第3X+3级移位寄存器的输出信号控制端连接所述第五时钟信号线，第3X+3级移位寄存器的复位信号输入端连接所述第六时钟信号线，其中，X大于或等于0；
在所述第二扫描驱动子电路中，第2X+1级移位寄存器的起始信号输入端连接所述第五时钟信号线，第2X+1级移位寄存器的输出信号控制端连接所述第七时钟信号线，第2X+1级移位寄存器的复位信号输入端连接所述第八时钟信号线，第2X+2级移位寄存器的起始信号输入端连接所述第七时钟信号线，第2X+2级移位寄存器的输出信号控制端连接所述第五时钟信号线，第2X+2级移位寄存器的复位信号输入端连接所述第六时钟信号线；
在所述第三扫描驱动子电路中，第2X+1级移位寄存器的起始信号输入端连接所述第六时钟信号线，第2X+1级移位寄存器的输出信号控制端连接所述第八时钟信号线，第2X+1级移位寄存器的复位信号输入端连接所述第五时钟信号线，第2X+2级移位寄存器的起始信号输入端连接所述第八时钟信号线，第2X+2级移位寄存器的输出信号控制端连接所述第六时钟信号线，第2X+2级移位寄存器的复位信号输入端连接所述第七时钟信号线。
6.根据权利要求3所述的显示面板，其特征在于，所述移位寄存器还包括关断电压输入端、开启电压输入端、九个N型晶体管和两个电容，其中：
第一晶体管的第一端与第二晶体管的第一端相连接，所述第一晶体管的第二端连接所述关断电压输入端，所述第一晶体管的控制端连接第五晶体管的控制端，其中，所述第一晶体管的第一端与所述第二晶体管的第一端之间设置第一节点，所述第一晶体管的第二端与所述关断电压输入端之间依次具有第二节点、第三节点、第四节点和第五节点，所述第一晶体管的控制端和所述第五晶体管的控制端之间依次具有第六节点、第七节点和第八节点；
所述第二晶体管的第二端连接所述输入端，所述第二晶体管的控制端连接所述起始信号输入端，其中，所述第二晶体管的第二端与所述输入端的第一端之间具有第九节点；
第三晶体管的第一端连接所述第三节点，所述第三晶体管的第二端连接所述第七节点；
第四晶体管的第一端连接所述第七节点，所述第四晶体管的第二端连接所述开启电压输入端，所述第四晶体管的控制端连接第九晶体管的控制端，其中，所述第四晶体管的第二端与所述开启电压输入端之间具有第十节点，所述第四晶体管的控制端与所述第九晶体管的控制端之间具有第十一节点，所述第十一节点连接所述复位信号输入端；
所述第五晶体管的第一端连接所述第五节点，所述第五晶体管的第二端连接第六晶体管的第一端，其中，所述第五晶体管的第二端与所述第六晶体管的第一端之间具有第十二节点，所述第十二节点连接所述输出端；
所述第六晶体管的第二端连接所述输出信号控制端；
第七晶体管的第一端连接所述第一节点，所述第七晶体管的控制端连接所述第十节点，其中，所述第七晶体管的第一端与所述第一节点之间依次具有第十三节点和第十四节点，所述第十三节点连接所述第三晶体管的控制端；
第八晶体管的第一端连接所述第二节点，所述第八晶体管的第二端连接所述第六节点；
所述第九晶体管的第一端连接所述第十四节点，所述第九晶体管的第二端连接所述第九节点，其中，所述第九晶体管的第二端与所述第九节点之间具有第十五节点，所述第十五节点连接所述第八晶体管的控制端；
第一电容的第一端连接所述第四节点，所述第一电容的第二端连接所述第八节点；
第二电容的第一端连接所述第十二节点，所述第二电容的第二端连接所述第七晶体管的第二端，其中，所述第二电容的第二端与所述第七晶体管的第二端之间具有第十六节点，所述第十六节点连接所述第六晶体管的控制端。
7.根据权利要求2所述的显示面板，其特征在于，
在一个扫描周期内，若先扫描所述第一区域后扫描所述第二区域时，则所述第二扫描驱动子电路的第1级移位寄存器的输入端连接所述第一扫描驱动子电路的最后一级移位寄存器的输出端，所述第三扫描驱动子电路的第1级移位寄存器的输入端接收的信号与所述第一扫描驱动子电路的倒数第2级移位寄存器的输出端输出的信号相同；
在一个扫描周期内，若先扫描所述第二区域后扫描所述第一区域时，则所述第一扫描驱动子电路的第1级移位寄存器的输入端连接所述第二扫描驱动子电路的最后一级移位寄存器的输出端，所述第三扫描驱动子电路的第1级移位寄存器的输入端先于所述第四扫描驱动子电路的第1级移位寄存器的输入端一个时刻接收到有效电平。
8.根据权利要求1所述的显示面板，其特征在于，
所述扫描驱动电路还包括第四扫描驱动子电路，所述第四扫描驱动子电路与所述第三扫描驱动子电路级联；
其中，所述显示面板具有缺口和第三区域，在所述第一方向上所述第一区域与所述第三区域分别位于所述缺口的两侧，且在所述第二方向上所述第三区域与所述第二区域也相邻设置的第一区域，所述第三扫描驱动子电路采用逐行扫描的方式驱动所述第三区域内的所述扫描线。
9.根据权利要求8所述的显示面板，其特征在于，
在所述第一方向上，所述第一扫描驱动子电路、所述第二扫描驱动子电路与所述第一区域设置于所述缺口的第一侧，所述第四扫描驱动子电路、所述第三扫描驱动子电路与所述第三区域设置于所述缺口的第二侧。
10.一种显示装置，其特征在于，包括权利要求1至9中任一项所述的显示面板。
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