CN107367874B - 显示面板 - Google Patents

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Abstract

一种显示面板，具有多个像素单元、多条源极线、多条栅极线以及多条共用电极线。像素单元以阵列方式排列，阵列包括多行及多列。源极线分别耦接设置于同一列的像素单元。栅极线分别耦接至设置于同一行的像素单元。共用电极线与栅极线彼此平行延伸。源极线、栅极线以及共用电极线的至少其中一个在其延伸方向上具有大小不等的线宽。

Description

显示面板
技术领域
本发明涉及一种平面显示技术，且特别涉及一种具有不同金属线宽的显示面板。
背景技术
随着显示科技的进步，液晶显示装置已被大量地使用在笔记型计算机(notebookpersonal computer)、个人计算机(personal computer；PC)以及电视等消费性电子产品中。此外，一般人对于液晶显示装置的画面质量的要求也不断提高。因此，高像素及大尺寸的液晶显示装置产品不断地推陈出新。
在目前液晶显示面板尺寸越来越大的发展趋势之下，在显示面板上金属线路距离源极驱动芯片及漏极驱动芯片越远的地方，充电时间常数也会越大。图1为已知的显示面板50的示意图。在图1的显示面板50中，这些像素单元至源极驱动芯片SD及栅极驱动芯片GD相距不同距离。每一个像素单元，其源极线51(用以传输源极驱动信号)、栅极线52(用以传输栅极驱动信号)以及共用电极线53(用以提供参考电压)的布局方式皆相同，亦即其具有相同的等效电路。图2为图1的显示面板50的等效电路图，其包含金属线路(例如源极线、栅极线和/或是共用电极线)的等效电阻与在金属线路之间的寄生电容。在图2中，RL表示部分金属线路的等效电阻，而CL表示在不同金属线路之间(例如在源极线51与栅极线52之间，或是在源极线51与共用电极线53之间)的寄生电容。图2忽略了在此面板中的一些等效电阻与寄生电容，因为它们相对较小。
在图2中，A点表示图1中距离源极驱动芯片SD或栅极驱动芯片GD较近的像素单元P1的位置，而图2中的B点表示距离源极驱动芯片SD或栅极驱动芯片GD较远的像素单元P2的位置。在此以一条源极线(或栅极线)的5个等效部分作为说明范例，由近似推导可得知图2的A点的充放电时间常数为RL*CL，而B点的充放电时间常数为15RL*CL(等于RL*CL+2RL*CL+3RL*CL+4RL*CL+5RL*CL)。像素单元P2的位置(例如B点)距离源极驱动芯片(或栅极驱动芯片)越远，意谓着时间常数(充电/放电时间)也会越来越大。因此，远离源极驱动芯片(或栅极驱动芯片)的像素单元可能具有不足的充电/放电时间，致使面板无法以额定的画质显示数据。
针对前述的问题，目前已知的解决方式是改变金属线的工艺，将一般使用的铝线改变为铜线。或者，将源极/栅极驱动芯片由单端驱动改为双端驱动。然而，即使应用了已知的解决方案，当显示面板的尺寸越大时，上述问题仍然存在。
发明内容
本发明提供一种显示面板，其于面板的不同位置上的金属线具有不同的线宽大小，以使面板不同位置的金属线路充电时间常数趋于接近，以提升大尺寸高像素显示面板的显示画质。
本发明的显示面板具有多个像素单元、多条源极线、多条栅极线、多条共用电极线。像素单元以阵列方式排列，阵列包括多行及多列。源极线分别耦接设置于同一列的像素单元。栅极线分别耦接至设置于同一行的像素单元。共用电极线与栅极线彼此平行延伸。源极线、栅极线以及共用电极线的至少其中一个在其延伸方向上具有大小不等的线宽。
在本发明的一实施例中，上述的源极线的线宽由所述源极线靠近源极驱动芯片的一端部朝所述源极线的另一端部逐渐缩小。
在本发明的一实施例中，上述的源极线中的至少一个包括多个部分，在这些部分中，具有较大线宽的第一部分更靠近源极驱动芯片，而具有较小线宽的第二部分更远离源极驱动芯片。
在本发明的一实施例中，上述的栅极线的线宽由所述栅极线靠近栅极驱动芯片的一端部朝所述栅极线的另一端部逐渐缩小。
在本发明的一实施例中，上述的栅极线中的至少一个包括多个部分，在这些部分中，具有较大线宽的第一部分更靠近栅极驱动芯片，而具有较小线宽的第二部分更远离该栅极驱动芯片。
在本发明的一实施例中，上述具有不同线宽的源极线中的至少一个源极线包括多个部分，这些部分其中一个包括非相交部和相交部。相交部与栅极线或共用电极线相交，并且相交部的线宽小于非相交部的线宽。
在本发明的一实施例中，与源极线交会的栅极线或共用电极线包括不与源极线相交的第一部分和与源极线的相交部相交的第二部分。第二部分的线宽小于第一部分的线宽。
在本发明的一实施例中，上述的源极线中的至少一个包括多个部分。在这些部分中，更接近源极驱动芯片的第一部分至栅极线的距离是一更小距离，而远离源极驱动芯片的第二部分至栅极线的距离是一更大距离。
本发明的显示面板具有多个像素单元、多条源极线、多条栅极线、多条共用电极线。像素单元以阵列方式排列，其中该阵列包括多行(row)及多列(column)。这些源极线的每一个耦接至设置于这些列中的一同列中的像素单元。这些栅极线的每一个耦接至设置于这些行中的一同行中的像素单元。这些共用电极线与这些栅极线彼此平行延伸。这些源极线、这些栅极线以及这些共用电极线的至少其中一个在其延伸方向上具有大小不等的线厚度。
在本发明的一实施例中，上述的源极线的厚度由所述源极线靠近源极驱动芯片的一端部朝所述源极线的另一端部逐渐增加。
在本发明的一实施例中，上述的源极线中的至少一个包括多个部分。在这些部分中，具有较小厚度的第一部分更靠近源极驱动芯片，而具有较大厚度的第二部分更远离源极驱动芯片。
在本发明的一实施例中，上述的源极线中的至少一个包括多个部分。在这些部分中，更接近源极驱动芯片的第一部分至栅极线的距离是一更小距离，而远离源极驱动芯片的第二部分至栅极线的距离是一更大距离。
在本发明的一实施例中，上述的栅极线或共用电极线的厚度由所述栅极线或所述共用电极线靠近栅极驱动芯片的一端部朝所述栅极线或所述共用电极线的另一端部逐渐增加。
在本发明的一实施例中，上述的栅极线中的至少一个包括多个部分。在这些部分中，具有较小厚度的第一部分更靠近栅极驱动芯片，而具有较大厚度的第二部分更远离栅极驱动芯片。
基于上述，本发明的显示面板经由源极线、栅极线以及共用电极线在其延伸方向的线宽大小或线厚大小的变化，而造成其等效电阻以及其之间寄生电容大小的改变。此外，经由前述等效电阻以及寄生电容大小的改变，可进一步减少源极线、栅极线或者共用电极线的不同部分的充电时间常数的落差。因此，藉由前述使不同部分的充电时间常数彼此趋近，可改善部分的源极线、栅极线以及共用电极线由于充电不足而导致显示面板画面质量不佳的问题。
为让本发明的上述特征和优点能更明显易懂，下文特举实施例，并配合附图作详细说明如下。
附图说明
图1是一种已知的显示面板的示意图。
图2是图1的已知的显示面板的等效电路图。
图3是依照本发明的一实施例的显示面板的示意图。
图4是图3的显示面板的等效电路图。
图5是依照本发明的另一实施例的显示面板的示意图。
图6是图5的显示面板的等效电路图。
图7是依照本发明的另一实施例的显示面板的示意图。
图8是依照本发明的另一实施例的显示面板的示意图。
图9是依照本发明的另一实施例的显示面板的示意图。
图10是依照本发明的另一实施例的显示面板的等效电路图。
图11是依照本发明的另一实施例的显示面板的示意图。
图12是依照本发明的另一实施例的显示面板的示意图。
【符号说明】
50、300、500、700、800、900、1100、1200：显示面板
51：源极线
52：栅极线
53：共用电极线
120：源极驱动芯片
130：栅极驱动芯片
A：距驱动芯片较近的像素单元的位置
A11、A1m、A1n、Amn：第一重叠区域
A21、A2m、A2n、A2mn：第二重叠区域
B：距驱动芯片较远的像素单元的位置
C：电容初始值
CL：寄生电容
CL1～CLn：共用电极线
CL1_1、CL1_i：共用电极线的一部分
GD：栅极驱动芯片
GL1～GLn：栅极线
GL1_1、GL1_i：栅极线的一部分
P1、P2、P11～Pmn：像素单元
R：电阻初始值
RL：等效电阻
SEC1：相交部
SEC2：非相交部
SD：源极驱动芯片
SL1～SLm：源极线
SL1_1、SL1_i、SL1_k、SLm_i：源极线的一部分
W、W1、WC1、WCi、WG1、WGi、Wi、Wk、WL、WS：线宽
具体实施方式
在本申请说明书全文(包括权利要求书)中所使用的“耦接(或连接)”一词可指任何直接或间接的连接手段。举例而言，若文中描述第一装置耦接(或连接)于第二装置，则应该被解释成该第一装置可以直接连接于该第二装置，或者该第一装置可以通过其他装置或某种连接手段而间接地连接至该第二装置。另外，凡可能之处，在附图及实施方式中使用相同标号的元件/构件/步骤代表相同或类似部分。不同实施例中使用相同标号或使用相同用语的元件/构件/步骤可以相互参照相关说明。
图3是依照本发明的一实施例的显示面板300的示意图。图4是图3的显示面板300的等效电路图。在本实施例中，显示面板300包括多个像素单元P11～Pmn，并且像素单元P11～Pmn以阵列的方式排列，其中阵列包括m行与n列，并且m、n为正整数。此外，显示面板300还包括多条源极线SL1～SLm、多条栅极线GL1～GLn以及多条共用电极线CL1～CLn。在本实施例中，源极线SL1～SLm、栅极线GL1～GLn以及共用电极线CL1～CLn分别围绕像素单元P11～Pmn，并且分别耦接同一行或同一列的像素单元P11～Pmn。源极驱动信号被传输于源极线SL1～SLm而经由开关晶体管(TFT)驱动像素单元。栅极驱动信号被传输于栅极线GL1～GLn而控制开关晶体管(TFT)的启闭状态。参考电压被传输于共用电极线CL1～CLn。此外，栅极线GL1～GL与源极线SL1～SLm彼此垂直相交，而共用电极线CL1～CLn则是与栅极线GL1～GL彼此平行延伸。源极线SL1～SLm或是栅极线GL1～GL的每一个可以視為包含了多个部分，而每一部分对应于多个像素单元。值得一提的是，本实施例的源极线SL1～SLm、栅极线GL1～GLn以及共用电极线CL1～CLn其中一个在其延伸方向上可具有大小不等的线宽，其导致了源极线SL1～SLm、栅极线GL1～GLn以及共用电极线CL1～CLn其中至少一个的不同部分可以具有不同的等效电阻，甚至是，每一部分内部可以具有不同的等效电阻。此外，在本实施例中，源极线SL1～SLm、栅极线GL1～GLn以及共用电极线CL1～GLn可以是任何导电线(例如铝或铜)，本发明对于上述电极线的材料并不加以限制。
详细而言，在本实施例中，显示面板300可配置多个源极驱动芯片120以及多个栅极驱动芯片130。源极驱动芯片120分别耦接源极线SL1～SLm，并且栅极驱动芯片130分别耦接栅极驱动线GL1～GLn。在图3所示实施例中，源极线SL1包括i个部分(从SL1_1到SL1_i)，而源极线SL1的线宽可由靠近源极驱动芯片120的端部SL1_1开始朝远离源极驱动芯片120的另一端部SL1_i以i个阶段逐渐缩小，使得源极线SL1呈现不同线宽W1～Wi。关于线宽，其他源极线SL2～SLm可以有相似配置。如图3所示，源极线SL1与栅极线GL1的相交处具有第一重叠区域A11，并且源极线SL1与共用电极线CL1的相交处具有第二重叠区域A21。通过第一重叠区域A11与第二重叠区域A21的源极线SL1的部分SL1_1具有线宽W1。源极线SL1与图3中最下方的栅极线GLn及共用电极线CLn的相交处分别具有第一重叠区域A1n以及第二重叠区域A2n。此外，通过第一重叠区域A1n与第二重叠区域A2n的源极线SL1的部分SL1_i具有线宽Wi，其中i为正整数，i随着从源极驱动芯片120的延伸方向而增加。换句话说，此源极线包括较靠近源极驱动芯片的第一部分(例如SL1_1，具有最大宽度)，以及较远离源极驱动芯片的第二部分(例如SL1_i，具有最小宽度)。在本实施例中，源极线SL1可以分i个阶段渐次地缩减其线宽。请参考图4，上述的i可例如等于5，也就是源极线SL1的线宽例如是以5阶段的方式依序缩减。在每一阶段，源极线SL1的线宽缩减为前一阶段的线宽的二分之一。本实施例的源极线SL1的线宽可以下列的关系式表示。
W(j+1)＝(1/2)*Wj，j＝1，2，3…(i-2)，(i-1)…等式(1)
其中整数j从靠近源极驱动芯片的一个端部朝向另一端部增大，i是线宽度的阶段数量。因此，在图3与图4所示实施例中，源极线SL1远离源极驱动芯片120的一端部具有作为第5阶的线宽W5，而源极线SL1靠近源极驱动芯片120的一端部具有作为第一阶的线宽W1，其中基于等式(1)获得W5＝(1/16)W1。假设一个像素列(pixel column)有1000个像素单元而源极线具有5个不同线宽为例，在第一个阶段中，源极线SL1的像素单元1～200具有相同线宽W1；在第二个阶段中，源极线SL1的像素单元201～400具有相同线宽W2＝(1/2)W1；以此类推，在第五个阶段中，源极线SL1的像素单元801～1000具有相同线宽W5＝(1/16)W1。在其他实施例中，每一个阶段不一定对应于相同数量的部。承上述，部分通过第一重叠区域A1n及第二重叠区域A2n的源极线SL1具有线宽W5，线宽W5为线宽W1的十六分之一。因此，在金属线路的等效电阻与线宽成反比例增减的情形下，具有线宽W5的部分源极线SL1的等效电阻为具有线宽W1的部分源极线SL1的等效电阻的十六倍。也就是说，在图3与图4的实施例中，部分源极线SL1的等效电阻可依照下述等式(2)而缩减：
R(j+1)＝2Rj，j＝1，2，3…(i-2)，(i-1)…等式(2)
亦即，在当前阶段中的一部分源极线的等效电阻是双倍于在先前阶段中的另一部分源极线的等效电阻。对于具有宽度不是以1/2比率递减但以另一比率减少的源极线，其线宽和等效电阻的关系式不同于等式(1)和等式(2)，并且也可以推导而知。
此外，如图3的等效电路图所示，在第一重叠区域A11及第二重叠区域A21中，寄生电容分别产生于源极线SL1与栅极线GL1以及源极线SL1与共用电极线CL1之间。如图4所示，当以源极线的5个部分以及用5个阶段线宽作为说明范例时，CL表示靠近源极驱动芯片的源极线的近端部与数条栅极线与共用电极线之间的寄生电容，而(1/16)CL表示远离源极驱动芯片的源极线的远端部与数条栅极线与共用电极线之间的寄生电容。所述寄生电容是由重叠区域面积来决定。详细而言，在图4所示实施例中，在第一重叠区域An与第二重叠区域A2n中的部分源极线SL1具有线宽W5＝(1/16)W1，而W1为在第一重叠区域A11与第二重叠区域A21中的部分源极线SL1的线宽。此外，栅极线GLn与GL1的线宽相等，且共用电极线CLn与CL1的线宽相等。因此，源极线SL1与栅极线GLn及源极线SL1与共用电极线CLn之间的寄生电容的大小是随着源极线SL1的线宽改变而改变，其中寄生电容的大小与在重叠区域中的源极线SL1的线宽大小呈正相关。因此，产生于源极线SL1与栅极线GLn及共用电极线CLn之间的寄生电容大小可随源极线SL1～SLm的线宽减少而跟着变小。相对于不同线宽阶段的寄生电容可表现为类似于等式(1)，在本文中不再赘述。
如图4的等效电路图所示，上述源极线SL1的线宽以5阶段顺序减半的方式递减，因此，源极线SL1的5个部分的等效电阻为RL至16RL(基于等式(2))。此外，如同上述，源极线SL1与栅极线GL1～GLn及共用电极线CL1之间的寄生电容则是与随源极线SL1的线宽等比例减少，所以对应于，源极线SL1的5个部分的寄生电容为CL至(1/16)CL。因此，在本实施例中，可近似推得图4中的B点的时间常数为8.0625*RL*CL，即RL*CL+3RL*(1/2)CL+7RL*(1/4)CL+15RL*(1/8)CL+31RL*(1/16)CL。
本实施例的源极线SL1的线宽配置方式，使得图4中的B点的时间常数为8.0625*RL*CL，其可显著减少图2中已知的显示面板的B点的时间常数(15RL*CL)近半大小。因此，本实施例可大幅减少源极线SL1靠近源极驱动芯片120的一端部与源极线SL1远离源极驱动芯片120的一端部之间的时间常数的落差。因此，远端部分的源极线SL1由于充电不足进而导致画面质量不佳的问题可以被改善。除此之外，在本实施例中，源极线SL1线宽是以5阶段递减的方式举例做说明。然而，本发明的源极线SL1的线宽缩减的比例或阶段数并不以前述的实施例为限。源极线SL1的线宽配置方式可以依实际需要做改变与调整。
再者，本实施例上述仅是以源极线SL1为例作说明，在其他未绘示的实施例中，其他的源极线SL2～SLm、栅极线GL1～GLn以及共用电极线CL1～CLn也可采取与上述源极线SL1的线宽相同或相似的方式进行配置，以减少远离源极驱动芯片的部分源极线的RC时间常数，并且从而减少源极线的不同部分的时间常数落差。
图5是依照本发明的另一实施例的显示面板500的示意图。图6是图5的显示面板500的等效电路图。图5及图6的实施例与图3及图4的实施例具有类似的结构，因此相同或相似的元件以相同或相似的符号标示，并且不再重复说明。在本实施例中，如图3所示，源极线SL1的线宽可由靠近源极驱动芯片120的一端部SL1_1开始朝向源极线SL1远离源极驱动芯片120的另一端部SL1_i分阶段逐渐缩减。在另一些实施例中，源极线SL1的线宽也可由源极线SL1远离源极驱动芯片120的一端部SL1_i朝靠近源极驱动芯片150的端部SL1_1以多阶段的方式两倍递增。如图6的等效电路图所示，其以5阶段线宽作为说明范例，源极线SL1的等效电阻由图6中距驱动芯片较远的像素单元(例如是图5中的像素单元P1n)的位置B向距驱动芯片较近的像素单元(例如是图5中的像素单元P11)的位置A的方向随着源极线SL1的线宽分阶段渐增而减少。相对地，源极线SL1与栅极线GL1～GLn以及共用电极线CL1～CLn之间的寄生电容则是随着线宽的增加而等比例增加。在本实施例中，从源极线SL1的靠近端部SL1_1至源极线SL1的远离端部SL1_i，其等效电阻是从(1/16)RL至RL，而其寄生电容是从16CL至CL。
本实施例经由上述的线宽配置方式，可使源极线SL1远离源极驱动芯片120的一端部的时间常数大小为(1/16)RL*16CL+(3/16)RL*8CL+(7/16)RL*4CL+(15/16)RL*2CL+(31/16)RL*CL，也就是8.0625*RL*CL，这相同于上述图3和图4实施例中远离端部所对应的时间常数。相较已知的线宽配置方式，源极线SL1远离源极驱动芯片120的一端部的时间常数可以被减少约为图2所示已知显示面板50中的B点的时间常数(其为15RL*CL)的一半。
在上述图5及图6的实施例中，仅是以源极线SL1的线宽配置方式为例作说明。在另一个未绘示的实施例中，源极线SL2～SLm、栅极线GL1～GLn以及共用电极线CL1～CLn的线宽也可以采取与上述源极线SL1相似的方式进行配置，并且可同样达到上述在远离源极驱动芯片位置上减少充电时间常数的效果，且使得源极线的不同部分的时间常数的差异最小化。请注意，图3和图5是对于所述源极线的线宽的不同观点(即，减小远离端部的线宽，或加大靠近端部的线宽)，并且它们基本上是相同的。如果最靠近源极驱动芯片的端部被取为线宽变化的起始参考点，则设计者可以配置源极线逐渐减小宽度；或者，如果最远离源极驱动芯片的端部被取为线宽变化的起始参考点，则设计者可以配置源极线逐渐增加宽度。
图7是依照本发明的另一实施例的显示面板700的示意图。在本实施例中。图7与图3的实施例具有类似的结构，因此相同或相似的元件以相同或相似的符号标示，并且不再重复说明。在本实施例中，源极线SL1的多数部分依循着(从靠近源极驱动芯片的近端部)逐渐减小宽度或(从远离源极驱动芯片的远端部朝向源极驱动芯片)逐渐增大宽度的趋势，并且源极线SL1的几个部分不依循此趋势。如图7所示，中间部分的线宽Wk是不小于且大于先前部分的线宽Wk-1(未示出)。在本实施例中，只要其不遵循宽度变化趋势的部分不過多，对应于所述源极线远离源极驱动芯片的部分的RC时间常数也可以被降低。
图8是依照本发明的另一实施例的显示面板800的示意图。图8与图3的实施例具有类似的结构，因此相同或相似的元件以相同或相似的符号标示，并且不再重复说明。在本实施例中，源极线SL1的一部分包括一个相交部SEC1与非相交部SEC2。相交部SEC1包括源极线SL1与栅极线GL1相交的重叠区域(例如A11)，以及源极线SL1与共用电极线CL1相交的重叠区域(例如A21)。非相交部分SEC2为除了相交部SEC1的其他区域。源极线SL1或其他源极线SL2～SLm的其它部分可以具有类似的相交部及非相交部。相交部SEC1具有线宽W(类似于在已知显示面板50中源极线的固定线宽)，以使源极线和栅极线之间的寄生电容或电源线和共用电极线之间的寄生电容可以相同于在已知显示面板50中的寄生电容。藉由增加非相交部SEC2的线宽(为比在已知显示面板50的源极线的固定宽度大)，非相交部SEC2具有大于W的线宽WL，以便减少源极线
Figure BDA0001027072750000101
的每个部分的等效电阻。相比于已知的RC时间常数。基于此，经缩小的等效电阻和保持相同的寄生电容，RC时间常数可被减少。因此，在源极线的不同部分的时间常数之间的差异被最小化。注意，图8所示相交部SEC1的面积比所述重叠区域稍大，而在另一实施例中，相交部SEC1的尺寸也可能近似相同于所述重叠区域的尺寸。
图9是依照本发明的另一实施例的显示面板900的示意图。图9与图8的实施例具有类似的结构，因此相同或相似的元件以相同或相似的符号标示，并且不再重复说明。
不同于图8之处在于，图9的实施例是关于减小相交部SEC1的线宽。在图9中相交部SEC1具有线宽WS，而线宽WS小于在已知显示面板50中的源极线的固定宽度，使得源极线和栅极线之间的寄生电容线或源极线和共用电极线之间的寄生电容线可以被降低，且小于已知显示面板50中的寄生电容。非相交部SEC2具有大于WS的线宽W，并且线宽W可以是类似于在已知显示面板50中的源极线的固定宽度。同时考虑的相交部SEC1和非相交部SEC2，较小宽度WS可以稍微增加等效电阻。相较于已知RC时间常数，基于经缩小的寄生电容和稍微增加的等效电阻，RC时间常数也可以被减少了。因此，在源极线的远离端部的时间常数也可以被减小。
基于图8和图9，在另一个实施例中，藉由减少相交部SEC1的线宽度并且增加非相交部SEC2的线宽，所述经减小的寄生电容和经减小的等效电阻都可被实现在电极线的每个部分。在另一个实施例中，不仅源极线的线宽，而且在重叠区域中栅极线的线宽和共用电极线的线宽也可以被减少，使得寄生电容可以被进一步降低。
此外，上述改变线宽的实施例还可以有附加特征，藉由改变源极线和栅极线之间的距离以在源极线的不同部分形成不同的距离(亦即改变源极线层和栅极线层之间的距离)，所述源极线和栅极线(或共用电极线)之间的寄生电容可以从源极线靠近源极驱动芯片的靠近端部，至源极线远离源极驱动芯片的远离端部逐渐减小。源极线的接近端部与相关的栅极线之间的距离小于源极线的远离端部与相关的栅极线之间的距离。源极线和栅极线之间的材料是绝缘材料，并且本实施例中表示源极线和栅极线之间的绝缘材料的厚度从源极线的接近端部至远离端部逐渐增大。其结果是，源极线的远离端部和栅极线之间的寄生电容小于源极线的接近端部与栅极线之间的寄生电容。较小的寄生电容有助于减小在源极线的远离端部的RC时间常数。
在上述的图1到图9所示实施例中，通过改变源极线的线宽而影响等效电阻和/或寄生电容来实现所述经减小的RC时间常数。
在其他实施例中，藉由改变源极线SL1-SLm的线厚度可以实现改变所述等效电阻，来达到降低RC时间常数。在一个实施例中，源极线的厚度从源极线接近源极驱动芯片的一个端部至源极线远离源极驱动芯片的另一端部逐渐地增加。源极线的厚度和等效电阻可表达为下述等式：
T(j+1)＝2*Tj，j＝1，2，3…(i-2)，(i-1)…等式(3)；
R(j+1)＝(1/2)Rj，j＝1，2，3…(i-2)，(i-1)…等式(4)；
其中Tj为厚度，Rj是等效电阻，整数j从靠近源极驱动芯片的一个端部朝向另一端部增大，i是线厚度的阶段数量，并且在等式(3)中的系数2是基于“当前阶段的源极线的厚度两倍于前阶段的厚度”。藉由显示面板的制造过程中确定此系数。在这个例子中，在当前阶段中的一部分的源极线的等效电阻是两倍于前阶段中的另一部分的源极线的等效电阻。图10绘示了具有不同厚度的源极线的显示面板的等效电路示意图。在图10中，5阶段厚度作为一个例子，根据等式(4)，源极线的五个部分的等效电阻是从RL到(1/16)RL，而相对于这些部分的寄生电容是相同的(因为源极线的线宽是固定的)。在本实施例中，B点(作为远离端部)的时间常数近似于8.0625*RL*CL，即RL*CL+(3/2)RL*CL+(7/4)RL*CL+(15/8)RL*CL+(31/16)RL*CL，这等于是图2所示现有的显示面板50中B点的时间常数(15RL*CL)的近一半大小。在另一个实施例中，尽管源极线的少数部分不跟随逐渐增加厚度的趋势，对应于远离源极驱动芯片的这些部分的RC时间常数仍然可以被减小。
图11是依照本发明的另一实施例的显示面板1100的示意图。在本实施例中，图11与图3的实施例具有类似的结构，因此相同或相似的元件以相同或相似的符号标示，并且不再重复说明。图11所示实施例与上述实施例相异之处在于，显示面板100可通过改变栅极线GL1～GLn及共用电极线CL1～CLn的线宽大小，并且固定源极线SL1～SLm的线宽大小的方式来减少寄生电容，从而实现在栅极线与共用电极线的不同位置的RC时间常数之间的差异最小化的影响。如图11所示，栅极线GL1靠近栅极驱动芯片130的靠近端部GL1_1以及共用电极线CL1靠近栅极驱动芯片130的靠近端部CL1_1分别与源极线SL1彼此相交，并且分别具有第一重叠区域A11与第二重叠区域A21；而栅极线GL1远离栅极驱动芯片130的远离端部GL1_i和共用电极线CL1远离栅极驱动芯片130的远离端部CL1_i分别与源极线SLm彼此相交，并且分别具有第一和第二重叠区域A1m和A2m。在图11所示实施例中，靠近端部GL1_1和CL1_1的线宽WG1与WC1可以相同于已知显示面板50的栅极线的线宽和共用电极线的线宽度，而和栅极线GL1的线宽与共用电极线CL1的线宽可以从靠近端部朝向远离端部以多阶段方式逐渐减小，因此通过第一重叠区域A11与第二重叠区域A21的栅极线GL1及共用电极线CL1的靠近端部GL1_1与CL1_1可分别具有较大线宽WG1与WC1(作为第一阶段)，而通过第一重叠区域A1m与第二重叠区域A2m的栅极线GL1及共用电极线CL1的远离端部GL1_i与CL1_i分别具有较小线宽WGi与WCi(作为第i阶段)。本实施例中栅极线及共用电极线的不同线宽的配置方式可达成与图3的实施例相同的效果。栅极线和共用电极线的不同线宽的等效电路图可以相同于图4所示，故在此省略。因此，显示面板1100的栅极线和共用电极线的不同部分的充电时间常数的落差可以被减少。
图12是本发明另一实施例的显示面板1200的示意图。在本实施例中，图12与图11的实施例具有类似的结构，因此相同或相似的元件以相同或相似的符号标示，并且不再重复说明。图12与图11的差异在于，图12的栅极线GL1～GLn及共用电极线CL1～CLn的线宽是从远离栅极驱动芯片130的一端部开始朝栅极驱动芯片130以多阶段(例如为5阶段)的方式渐增。在图12所示实施例中，远离端部GL1_i的线宽WGi和远离端部CL1_i的线宽WCi可以是相同于已知显示面板50的栅极线和共用电极线的线宽。通过第一和第二重叠区域A11和A21的栅极线GL1和共用电极线CL1的靠近端部GL1_1与CL1_1分别具有较大的线宽WG1和WC1，而通过第一重叠区域A1m及第二重叠区域A2m的栅极线GL1与共用电极线CL1的远离端部GL1_i与CL1_i分别具有较小的线宽WGi与WCi。以5阶段作为说明范例，线宽WG5是线宽WG1的16分之1，而线宽WC5是线宽WC1的16分之1。然而，本实施例前述的栅极电极线GL1与共用电极线CL1的线宽配置方式仅是举例做说明，在其他未绘示的实施例中，栅极电极线GL1与共用电极线CL1的线宽配置方式可依实施例的需求进行调整。
在另一个实施例中，在相交部或非相交部中的栅极线或共用电极线的线宽也可以改变，类似于图8或图9所示的源极线的线宽的结构。此外，在另一个实施例中，栅极线或共用电极线的线厚度可以类似于上述的源极线的线厚度的配置方式来进行改变。也就是，栅极线或共用电极线的线厚度由栅极线或共用电极线靠近栅极驱动芯片的端部朝栅极线或共用电极线的另一端部逐渐增加，并具有类似于图10的等效电路。
综上所述，本发明以改变源极线、栅极线以及共用电极线等金属线的线宽或是线厚度的方式来改变显示面板的不同区域的金属线的等效电阻或是金属线之间的寄生电容。经由前述金属线的等效电阻和/或不同金属线之间的寄生电容的改变，在金属线远离源/栅极驱动芯片的部分的时间常数可以被降低，以便尽量减少显示面板中不同区域的时间常数的落差。因此，远离源极和栅极驱动芯片的那些像素单元的充电时间不充分的问题可以得到改善，从而提升大尺寸显示面板的显示画面质量。
虽然本发明已以实施例公开如上，然其并非用以限定本发明，本领域技术人员在不脱离本发明的精神和范围内，当可作些许的更动与润饰，故本发明的保护范围当视所附权利要求书界定范围为准。

Claims (9)

1.一种显示面板，包括：
多个像素单元，以阵列方式排列，所述阵列包括多行及多列；
多条源极线，分别耦接至设置于同一列的所述多个像素单元；
多条栅极线，所述多条栅极线的延伸方向与所述多条源极线的延伸方向垂直，且所述栅极线分别耦接至设置于同一行的所述多个像素单元；以及
多条共用电极线，与所述多条栅极线彼此平行延伸且所述多条共用电极线的延伸方向与所述多条源极线的延伸方向垂直，所述多条源极线和所述多条栅极线的其中一种电极线具有渐变线宽样式，所述渐变线宽样式是以下二个线宽渐变样式中相对应的一个：
所述多条源极线其中至少一条源极线包括第一部分与第二部分，所述第一部分与所述第二部分各包括所述源极线中未与所述多条栅极线相交也未与所述多条共用电极线相交的部分，且所述源极线的线宽从所述第一部分朝向所述第二部分逐渐缩小，其中所述源极线的所述第一部分更靠近源极驱动芯片，而所述第二部分更远离所述源极驱动芯片；以及
所述多条栅极线其中至少一条栅极线包括第一部分与第二部分，所述第一部分与所述第二部各包括所述栅极线中未与所述多条源极线相交的部分，且所述栅极线的线宽从所述第一部分朝向所述第二部分逐渐缩小，其中所述栅极线的第一部分更靠近栅极驱动芯片，而所述第二部分更远离所述栅极驱动芯片。
2.如权利要求1所述的显示面板，其中所述第一部分与所述第二部分为所述源极线或所述栅极线的端部。
3.如权利要求1所述的显示面板，其中所述源极线的更接近源极驱动芯片的所述第一部分至所述栅极线的距离是小于远离所述源极驱动芯片的所述第二部分至所述栅极线的距离。
4.一种显示面板，包括：
多个像素单元，以阵列方式排列，其中所述阵列包括多行及多列；
多条源极线，其中所述多条源极线的每一个耦接至设置于所述多个列中的同列中的所述多个像素单元；
多条栅极线，其中所述多条栅极线的每一个耦接至设置于所述多个行中的同行中的所述多个像素单元；以及
多条共用电极线，与所述多条栅极线彼此平行延伸，其中所述多条源极线、所述多条栅极线以及所述多条共用电极线的至少其中一个在其延伸方向上具有大小不等的线厚度。
5.如权利要求4所述的显示面板，其中所述多条源极线的厚度由所述源极线靠近源极驱动芯片的一端部朝所述源极线的另一端部逐渐增加。
6.如权利要求4所述的显示面板，其中所述多条源极线中的至少一个包括多个部分，在所述多个部分中，具有较小厚度的第一部分更靠近源极驱动芯片，而具有较大厚度的第二部分更远离所述源极驱动芯片。
7.如权利要求4所述的显示面板，其中所述多条源极线中的至少一个包括多个部分，在所述多个部分中，更接近源极驱动芯片的第一部分至所述栅极线的距离小于远离所述源极驱动芯片的第二部分至所述栅极线的距离。
8.如权利要求4所述的显示面板，其中所述多条栅极线或所述多条共用电极线的厚度由所述栅极线或所述共用电极线靠近栅极驱动芯片的一端部朝所述栅极线或所述共用电极线的另一端部逐渐增加。
9.如权利要求4所述的显示面板，其中所述多条栅极线中的至少一个包括多个部分，在所述多个部分中，具有较小厚度的第一部分更靠近栅极驱动芯片，而具有较大厚度的第二部分更远离所述栅极驱动芯片。
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