CN106910484B - 一种显示装置及其驱动电路和方法 - Google Patents
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Abstract
本发明属于显示面板技术领域，提供了一种显示装置及其驱动电路和方法。本公开通过采用包括输入模块、输出模块、控制模块、下拉维持模块、反馈模块及上拉模块的驱动电路，使得输入模块根据栅极扫描信号Gn‑2将控制端电压信号Qn拉高至第一高电平，上拉模块根据时钟信号CLKn‑2、时钟信号CLKn‑1以及控制端电压信号Qn‑1将控制端电压信号Qn从第一高电平拉高至第二高电平，输出模块根据时钟信号CLKn将控制端电压信号Qn从第二高电平耦合至第三高电平，且根据控制端电压信号Qn与时钟信号CLKn输出栅极扫描信号Gn，反馈模块将控制端电压信号Qn拉低，控制模块控制下拉维持模块维持控制端电压信号Qn的低电压，解决了现有的阵列基板栅极驱动电路存在不利于LCD的窄边框化的问题。
Description
技术领域
本发明属于显示面板技术领域，尤其涉及一种显示装置及其驱动电路和方法。
背景技术
近年来，液晶显示器(Liquid Crystal Display，LCD)因其图像清晰精确、平面显示、厚度薄、重量轻、无辐射、低能耗、工作电压低等优点已被广泛应用于各行各业。传统的LCD在进行栅极驱动时，主要采用栅极驱动芯片(Gate Driver IC)来实现，而由于栅极驱动芯片需要通过连接器与LCD的显示面板(Panel)绑定，并且在一个LCD中需要多个栅极驱动芯片，因此传统的LCD成本和功耗高。
为了解决上述问题，现有技术主要采用阵列基板栅极驱动(Gate Driver onArray，GOA)电路来实现。GOA电路主要是将LCD Panel的栅极驱动电路通过曝光显影的方式集成在玻璃基板上，以此形成对面板栅极讯号线的扫描驱动，具体的，GOA电路在对面板栅极讯号线进行扫描驱动时，其栅极电压点将接收一个预充信号，该预充信号对栅极电压点进行预充，以使该点电压在时钟信号的作用下达到高电压准位，进而使得输出晶体管打开，讯号顺利传递，进而驱动面板栅极讯号线。然而，虽然现有的GOA电路免去了栅极驱动芯片，进而降低了成本和功耗、且集成度高，但是其在LCD窄边框化时影响信号传递，进而影响了LCD的窄边框化。
综上所述，现有LCD的GOA电路存在不利于LCD的窄边框化的问题。
发明内容
本发明的目的在于提供一种显示装置及其驱动电路和方法，旨在解决现有LCD的GOA电路存在不利于LCD的窄边框化的问题。
本发明提供一种驱动电路，用于驱动显示面板，包括：
n个级联的栅极驱动单元，n为大于2的正整数；其中，第n个栅极驱动单元包括：
输入模块，用于接收第n-2级栅极驱动单元输出的栅极扫描信号Gn-2，并根据所述栅极扫描信号Gn-2，将控制端电压信号Qn拉高至第一高电平；
上拉模块，用于接收所述第n-2级栅极驱动单元的时钟信号CLKn-2、第n-1级栅极驱动单元的时钟信号CLKn-1，以及所述第n-1级栅极驱动单元的控制端电压信号Qn-1，并根据所述时钟信号CLKn-2、所述时钟信号CLKn-1以及所述控制端电压信号Qn-1，将所述控制端电压信号Qn从第一高电平拉高至第二高电平；
输出模块，用于接收时钟信号CLKn，并根据所述时钟信号CLKn将所述控制端电压信号Qn从第二高电平耦合至第三高电平，且根据耦合后的控制端电压信号Qn与所述时钟信号CLKn输出栅极扫描信号Gn；
反馈模块，用于接收反馈信号，并根据所述反馈信号将所述耦合后的控制端电压信号Qn拉低；
控制模块，用于控制所述下拉维持模块维持所述控制端电压信号Qn的低电压。
本发明的另一目的还在于提供一种显示装置，所述显示装置包括背光模组、显示面板以及控制装置，在某些实施方式中，所述控制装置包括上述驱动电路。
本发明的又一目的还在于提供一种基于上述驱动电路的驱动方法，所述驱动方法包括：
利用所述输入模块接收第n-2级栅极驱动单元输出的栅极扫描信号Gn-2，并根据所述栅极扫描信号Gn-2，将所述输出模块的控制端电压信号Qn拉高至第一高电平；
利用所述上拉模块接收所述第n-2级栅极驱动单元的时钟信号CLKn-2、第n-1级栅极驱动单元的时钟信号CLKn-1，以及所述第n-1级栅极驱动单元的控制端电压信号Qn-1，并根据所述时钟信号CLKn-2、所述时钟信号CLKn-1以及所述控制端电压信号Qn-1，将所述控制端电压信号Qn从第一高电平拉高至第二高电平；
利用所述输出模块接收时钟信号CLKn，并根据所述时钟信号CLKn将所述控制端电压信号Qn从第二高电平耦合至第三高电平，且根据耦合后的控制端电压信号Qn与所述时钟信号CLKn输出栅极扫描信号Gn；
利用所述反馈模块接收反馈信号，并根据所述反馈信号将所述耦合后的控制端电压信号Qn拉低；
利用所述控制模块控制所述下拉维持模块维持所述控制端电压信号Qn的低电压。
本发明通过采用包括输入模块、输出模块、控制模块、下拉维持模块、反馈模块以及上拉模块的驱动电路，使得输入模块接收第n-2级栅极驱动单元输出的栅极扫描信号Gn-2，并根据栅极扫描信号Gn-2将输出模块的控制端电压信号Qn拉高至第一高电平，上拉模块接收第n-2级栅极驱动单元的时钟信号CLKn-2、第n-1级栅极驱动单元的时钟信号CLKn-1以及第n-1级栅极驱动单元的控制端电压信号Qn-1，并根据时钟信号CLKn-2、时钟信号CLKn-1以及控制端电压信号Qn-1将控制端电压信号Qn从第一高电平拉高至第二高电平，输出模块接收时钟信号CLKn，并根据时钟信号CLKn将控制端电压信号Qn从第二高电平耦合至第三高电平，且根据耦合后的控制端电压信号Qn与时钟信号CLKn输出栅极扫描信号Gn，反馈模块接收反馈信号，并根据反馈信号将耦合后的控制端电压信号Qn拉低，控制模块控制下拉维持模块维持控制端电压信号Qn的低电压，以此将控制端电压信号Qn的电平进行三次拉升，增强了控制端电压信号Qn的强度，解决了现有LCD的GOA电路存在不利于LCD的窄边框化的问题。
附图说明
图1是本发明一实施例所提供的驱动电路的模块结构示意图；
图2是本发明另一实施例所提供的驱动电路的模块结构示意图；
图3是本发明一实施例所提供的驱动电路的电路结构示意图；
图4是本发明一实施例所提供的驱动电路的工作时序示意图；
图5是本发明一实施例所提供的显示装置的模块结构示意图；
图6是本发明一实施例所提供的驱动方法的流程示意图。
具体实施方式
为了使本发明的目的、技术方案及优点更加清楚明白，以下结合附图及实施例，对本发明进行进一步详细说明。应当理解，此处所描述的具体实施例仅仅用以解释本发明，并不用于限定本发明。
以下结合具体附图对本发明的实现进行详细的描述：
图1示出了本发明一实施例所提供的驱动电路的模块结构，为了便于说明，仅示出了与本实施例相关的部分，详述如下：
如图1所示，本实施例所提供的驱动电路用于驱动显示面板，具体用于驱动显示面板的栅极扫描线。
其中，驱动电路包括n个级联的栅极驱动单元1(图中以一个为例)，n为大于2的正整数，第n个栅极驱动单元1包括输入模块10、输出模块11、控制模块12、下拉维持模块13、反馈模块14以及上拉模块15。
具体的，输入模块10，用于接收第n-2级栅极驱动单元输出的栅极扫描信号Gn-2，并根据栅极扫描信号Gn-2，将控制端电压信号Qn拉高至第一高电平。
上拉模块15，用于接收第n-2级栅极驱动单元的时钟信号CLKn-2、第n-1级栅极驱动单元的时钟信号CLKn-1，以及第n-1级栅极驱动单元的控制端电压信号Qn-1，并根据时钟信号CLKn-2、时钟信号CLKn-1以及控制端电压信号Qn-1，将控制端电压信号Qn从第一高电平拉高至第二高电平。
输出模块11，用于接收时钟信号CLKn，并根据时钟信号CLKn将控制端电压信号Qn从第二高电平耦合至第三高电平，且根据耦合后的控制端电压信号Qn与时钟信号CLKn输出栅极扫描信号Gn。
反馈模块14，用于接收反馈信号，并根据反馈信号将耦合后的控制端电压信号Qn拉低。
控制模块12，用于控制下拉维持模块13维持控制端电压信号Qn的低电压。
需要说明的是，在本发明实施例中，由于本发明实施例提供的驱动电路同样采用GOA电路实现，只是其内部的具体电路结构相较于现有的GOA电路有所改变，因此其具有GOA电路的所有优点，并且驱动电路中的n个栅极驱动单元1的电路结构均相同，此处仅以一个实施例进行说明；此外，本发明中的控制模块12和下拉维持模块13可采用现有的控制电路和下拉维持电路实现，其只需保证控制端电压信号Qn在被拉低之后维持低电平即可，此处不对其结构和工作原理进行详细描述。
进一步地，作为本发明一实施方式，如图2所示，上拉模块15包括上拉单元150与上拉控制单元151。
具体的，上拉单元150接收时钟信号CLKn-2与时钟信号CLKn-1，并根据时钟信号CLKn-2与时钟信号CLKn-1生成第一上拉信号至上拉控制单元151，上拉控制单元151接收控制端电压信号Qn-1，并根据控制端电压信号Qn-1与第一上拉信号生成第二上拉信号Pun-1，以将控制端电压信号Qn从第一高电平拉高至第二高电平。
进一步地，作为本发明一实施方式，如图3所示，上拉单元150包括第一开关元件Q1，第一开关元件Q1的输入端接收时钟信号CLKn-2，第一开关元件Q1的控制端接收时钟信号CLKn-1，第一开关元件Q1根据时钟信号CLKn-2与时钟信号CLKn-1生成第一上拉信号，第一开关元件Q1的输出端将第一上拉信号输出至上拉控制单元151。
具体实施时，第一开关元件Q1可以采用NMOS晶体管实现，该NMOS晶体管的栅极、漏极以及源极分别为第一开关元件Q1的控制端、输入端以及输出端，可以理解的是，第一开关元件Q1也可以采用PMOS晶体管实现，此处不作具体限制，而当采用PMOS晶体管实现时，该PMOS晶体管的栅极、源极以及漏极分别为第一开关元件Q1的控制端、输入端以及输出端。
进一步地，作为本发明一实施方式，如图3所示，上拉控制单元151包括第二开关元件Q2，第二开关元件Q2的输入端接收第一上拉信号，第二开关元件Q2的控制端接收控制端电压信号Qn-1，第二开关元件Q2根据第一上拉信号与控制端电压信号Qn-1生成第二上拉信号Pun-1。
具体实施时，第二开关元件Q2可以采用NMOS晶体管实现，该NMOS晶体管的栅极、漏极以及源极分别为第二开关元件Q2的控制端、输入端以及输出端，可以理解的是，第二开关元件Q2也可以采用PMOS晶体管实现，此处不作具体限制，而当采用PMOS晶体管实现时，该PMOS晶体管的栅极、源极以及漏极分别为第二开关元件Q2的控制端、输入端以及输出端。
进一步地，作为本发明一实施方式，如图3所示，输入模块10包括晶体管Q3，该晶体管Q3的控制端和输入端共接，并接收栅极扫描信号Gn-2，该晶体管Q3的输出端与输出模块11的控制端连接；需要说明的是，在本发明实施例中，晶体管Q3可以为NMOS晶体管，该NMOS晶体管的栅极、漏极以及源极分别为晶体管Q3的控制端、输入端以及输出端，可以理解的是，晶体管Q3也可以是PMOS晶体管，此处不作具体限制。
进一步地，作为本发明一实施方式，如图3所示，输出模块11包括晶体管Q4，该晶体管Q4的控制端为输出模块11的控制端，该晶体管Q4的输入端接收时钟信号CLKn，该晶体管Q4的输出端输出栅极扫描信号Gn；需要说明的是，在本发明实施例中，晶体管Q4为NMOS晶体管，该NMOS晶体管的栅极、漏极以及源极分别为晶体管Q4的控制端、输入端以及输出端，可以理解的是，晶体管Q4也可以是PMOS晶体管，此处不作具体限制。
进一步地，作为本发明一实施方式，如图3所示，反馈模块14包括晶体管Q5和晶体管Q6。
具体的，晶体管Q5的控制端和晶体管Q6的控制端接收反馈信号FB，晶体管Q5的输入端和晶体管Q4的输出端连接，晶体管Q6的输入端和晶体管Q4的控制端连接，晶体管Q5和晶体管Q6的输出端均接收低电平VSS。
需要说明的是，在本发明实施例中，反馈信号FB可以采用第n-2级栅极驱动单元输出的栅极扫描信号Gn-2实现，也可以采用第n-1级栅极驱动单元输出的栅极扫描信号Gn-1实现，此处不作具体限制，其只需实现将耦合后的控制端电压信号Qn拉低的目的即可；此外，晶体管Q5和晶体管Q6均为NMOS晶体管，该NMOS晶体管的栅极、漏极以及源极分别为晶体管Q5和晶体管Q6的控制端、输入端以及输出端，可以理解的是，晶体管Q5和晶体管Q6也可以是PMOS晶体管，此处不作具体限制。
下面以图3所示的电路和图4所示的时序图为例，对本发明提供的驱动电路的工作原理作具体说明，详述如下：
需要说明的是，驱动电路的每一个栅极驱动单元自接收到栅极扫描信号Gn-2起到输出栅极扫描信号Gn的期间，即图4所示的t1-t3，称之为扫描期间，其余时间称为非扫描期间，而扫描期间又分为预充电期间与输出脉冲期间，其中，t1为第一预充电时间，t2为第二预充电时间，t3为输出脉冲时间。
具体的，在时段t1，当晶体管Q3的控制端和输入端接收高电平的栅极扫描信号Gn-2时，晶体管Q3将高电平的栅极扫描信号Gn-2传送至晶体管Q4的控制端，使得晶体管Q4的控制端电压Qn拉高至第一高电平，实现对晶体管Q4控制端的第一次充电，即实现对栅极驱动单元的Q点的第一次预充电，此时晶体管Q4导通，从而将低电平的时钟信号CLKn输出至输出端，所以栅极扫描信号Gn处于低电平。
在时段t2，当晶体管Q1的控制端接收高电平的时钟信号CLKn-1时，晶体管Q1导通，从而将输入端接收的高电平的时钟信号CLKn-2输出至晶体管Q2的输入端，即晶体管Q1输出第一上拉信号至晶体管Q2；当晶体管Q2的控制端接收高电平的控制端电压信号Qn-1时，晶体管Q2导通，并将高电平的第一上拉信号传送至晶体管Q4的控制端，即晶体管Q2输出第二上拉信号至晶体管Q4，以使晶体管Q4的控制端电压Qn从第一高电平拉高至第二高电平，实现对晶体管Q4控制端的第二次充电，即实现对栅极驱动单元的Q点的第二次预充电，此时晶体管Q4导通，从而将低电平的时钟信号CLKn输出至输出端，所以栅极扫描信号Gn处于低电平。
在时段t3，由于在时段t2时晶体管Q4的控制端为高电平，因此，此时晶体管Q1持续导通，当晶体管Q4的输入端接收高电平的时钟信号CLKn时，晶体管Q4根据高电平的时钟信号CLKn将控制端电压Qn从第二高电平耦合至第三高电平，即将栅极驱动单元的Q点电压再次拉高，同时晶体管Q4将高电平的时钟信号CLKn输出至输出端，所以栅极扫描信号Gn处于高电平。
需要说明的是，在本实施例中，通过对栅极驱动单元的Q点的第一次预充电、第二次预充电以及耦合处理，使得Q点电压从第一高电平拉高至第二高电平，从第二高电平拉高至第三高电平，实现了Q点波形的拉高，进而增强了Q点信号强度，有利于LCD的窄边框化。
在时段t4，晶体管Q1-Q3皆不导通，当晶体管Q5和晶体管Q6接收高电平的反馈信号FB(图中未示出)时，晶体管Q6根据高电平的反馈信号FB导通，并将控制端电压信号Qn从第三高电平拉低，晶体管Q4截止，同时，晶体管Q5根据高电平的反馈信号FB导通，并将输出端的扫描控制信号Gn从高电平拉低至低电平，所以此时扫描控制信号Gn处于低电平；需要说明的是，在本实施例中，晶体管Q6对控制端电压信号Qn的拉低分为两个过程，该两个拉低过程与现有技术相同，此处不再赘述。
在时段t4之后，控制模块12和下拉维持模块13工作，控制模块12控制下拉维持模块13维持控制端电压信号Qn的低电平，从而使得晶体管Q4一直处于截止状态，进而使得在时段t4后，栅极扫描单元1输出的栅极扫描信号Gn一直处于低电平，从而防止了栅极扫描信号Gn在下一个高电平的时钟信号CLKn来临时进行跳变，保证了对LCD栅极线的正常扫描。
进一步地，图5示出了本发明一实施例所提供的显示装置100，该显示装置100包括背光模组2、显示面板3以及包括上述驱动电路1的控制装置4。需要说明的是，由于本发明实施例所提供的显示装置100的驱动电路和图1至图4所的驱动电路相同，因此，本发明实施例所提供的显示装置100中的驱动电路的具体工作原理，可参考前述关于图1至图4的详细描述，此处不再赘述。
进一步地，图6示出了本发明一实施例提供的驱动方法的实现流程，为了便于说明，仅示出了与本发明实施例相关的部分，详述如下：
如图6所示，本发明实施例提供的驱动方法包括：
S61：利用输入模块接收第n-2级栅极驱动单元输出的栅极扫描信号Gn-2，并根据栅极扫描信号Gn-2，将输出模块的控制端电压信号Qn拉高至第一高电平。
S62：利用上拉模块接收第n-2级栅极驱动单元的时钟信号CLKn-2、第n-1级栅极驱动单元的时钟信号CLKn-1，以及第n-1级栅极驱动单元的控制端电压信号Qn-1，并根据时钟信号CLKn-2、时钟信号CLKn-1以及控制端电压信号Qn-1，将控制端电压信号Qn从第一高电平拉高至第二高电平。
S63：利用输出模块接收时钟信号CLKn，并根据时钟信号CLKn将控制端电压信号Qn从第二高电平耦合至第三高电平，且根据耦合后的控制端电压信号Qn与时钟信号CLKn输出栅极扫描信号Gn。
S64：利用反馈模块接收反馈信号，并根据反馈信号将耦合后的控制端电压信号Qn拉低。
S65：利用控制模块控制下拉维持模块维持控制端电压信号Qn的低电压。
进一步地，由于上拉模块包括上拉单元与上拉控制单元，因此，利用上拉模块接收第n-2级栅极驱动单元的时钟信号CLKn-2、第n-1级栅极驱动单元的时钟信号CLKn-1，以及第n-1级栅极驱动单元的控制端电压信号Qn-1，并根据时钟信号CLKn-2、时钟信号CLKn-1以及控制端电压信号Qn-1，将控制端电压信号Qn从第一高电平拉高至第二高电平具体为：
利用上拉单元接收时钟信号CLKn-2与时钟信号CLKn-1，并根据时钟信号CLKn-2与时钟信号CLKn-1生成第一上拉信号至上拉控制单元；
利用上拉控制单元接收控制端电压信号Qn-1，并根据控制端电压信号Qn-1与第一上拉信号生成第二上拉信号，以将控制端电压信号Qn从第一高电平拉高至第二高电平。
需要说明的是，本发明实施例提供的驱动方法是基于图1至图4所示的驱动电路实现的，因此，关于本发明实施例提供的驱动方法的具体工作原理，可参考图1至图4中驱动电路的相关描述，此处不再赘述。
在本发明中，通过采用包括输入模块、输出模块、控制模块、下拉维持模块、反馈模块以及上拉模块的驱动电路，使得输入模块接收第n-2级栅极驱动单元输出的栅极扫描信号Gn-2，并根据栅极扫描信号Gn-2将输出模块的控制端电压信号Qn拉高至第一高电平，上拉模块接收第n-2级栅极驱动单元的时钟信号CLKn-2、第n-1级栅极驱动单元的时钟信号CLKn-1以及第n-1级栅极驱动单元的控制端电压信号Qn-1，并根据时钟信号CLKn-2、时钟信号CLKn-1以及控制端电压信号Qn-1将控制端电压信号Qn从第一高电平拉高至第二高电平，输出模块接收时钟信号CLKn，并根据时钟信号CLKn将控制端电压信号Qn从第二高电平耦合至第三高电平，且根据耦合后的控制端电压信号Qn与时钟信号CLKn输出栅极扫描信号Gn，反馈模块接收反馈信号，并根据反馈信号将耦合后的控制端电压信号Qn拉低，控制模块控制下拉维持模块维持控制端电压信号Qn的低电压，以此将控制端电压信号Qn的电平进行三次拉升，增强了控制端电压信号Qn的强度，解决了现有LCD的GOA电路存在不利于显示面板的窄边框化的问题
在某些实施方式中，显示面板可例如为液晶显示面板，然不限于此，亦可为OLED、曲面面板或其他显示面板。
以上所述仅为本发明的较佳实施例而已，并不用以限制本发明，凡在本发明的精神和原则之内所作的任何修改、等同替换和改进等，均应包含在本发明的保护范围之内。
Claims (9)
1.一种驱动电路，用于驱动显示面板，其特征在于，包括：
n个级联的栅极驱动单元，n为大于2的正整数；其中，第n个栅极驱动单元包括：
输入模块，用于接收第n-2级栅极驱动单元输出的栅极扫描信号Gn-2，并根据所述栅极扫描信号Gn-2，将控制端电压信号Qn拉高至第一高电平；
上拉模块，用于接收所述第n-2级栅极驱动单元的时钟信号CLKn-2、第n-1级栅极驱动单元的时钟信号CLKn-1，以及所述第n-1级栅极驱动单元的控制端电压信号Qn-1，并根据所述时钟信号CLKn-2、所述时钟信号CLKn-1以及所述控制端电压信号Qn-1，将所述控制端电压信号Qn从第一高电平拉高至第二高电平；
输出模块，用于接收时钟信号CLKn，并根据所述时钟信号CLKn将所述控制端电压信号Qn从第二高电平耦合至第三高电平，且根据耦合后的控制端电压信号Qn与所述时钟信号CLKn输出栅极扫描信号Gn；
反馈模块，用于接收反馈信号，并根据所述反馈信号将所述耦合后的控制端电压信号Qn拉低；
下拉维持模块；
控制模块，用于控制所述下拉维持模块维持所述控制端电压信号Qn的低电压。
2.根据权利要求1所述的驱动电路，其特征在于，所述上拉模块包括：
上拉单元，用于接收所述时钟信号CLKn-2与所述时钟信号CLKn-1，并根据所述时钟信号CLKn-2与所述时钟信号CLKn-1生成第一上拉信号；
上拉控制单元，用于接收所述控制端电压信号Qn-1和所述第一上拉信号，并根据所述控制端电压信号Qn-1与所述第一上拉信号生成第二上拉信号，以将所述控制端电压信号Qn从第一高电平拉高至第二高电平。
3.根据权利要求2所述的驱动电路，其特征在于，所述上拉单元包括第一开关元件；
所述第一开关元件的输入端接收所述时钟信号CLKn-2，所述第一开关元件的控制端接收所述时钟信号CLKn-1；
所述第一开关元件根据所述时钟信号CLKn-2与所述时钟信号CLKn-1，生成所述第一上拉信号，所述第一开关元件的输出端将所述第一上拉信号输出至所述上拉控制单元。
4.根据权利要求2所述的驱动电路，其特征在于，所述上拉控制单元包括第二开关元件；
所述第二开关元件的输入端接收所述第一上拉信号，所述第二开关元件的控制端接收所述控制端电压信号Qn-1；
所述第二开关元件根据所述第一上拉信号与所述控制端电压信号Qn-1生成所述第二上拉信号。
5.根据权利要求3所述的驱动电路，其特征在于，所述第一开关元件为第一晶体管，所述第一晶体管的栅极、漏极以及源极分别为所述第一开关元件的控制端、输入端以及输出端。
6.根据权利要求4所述的驱动电路，其特征在于，所述第二开关元件为第二晶体管，所述第二晶体管的栅极和漏极分别为所述第二开关元件的控制端与输入端。
7.一种显示装置，其特征在于，所述显示装置包括：
背光模组、显示面板以及控制装置，所述控制装置包括如权利要求1至6任一项所述的驱动电路。
8.一种基于权利要求1所述的驱动电路的驱动方法，其特征在于，所述驱动方法包括：
利用所述输入模块接收第n-2级栅极驱动单元输出的栅极扫描信号Gn-2，并根据所述栅极扫描信号Gn-2，将所述输出模块的控制端电压信号Qn拉高至第一高电平；
利用所述上拉模块接收所述第n-2级栅极驱动单元的时钟信号CLKn-2、第n-1级栅极驱动单元的时钟信号CLKn-1，以及所述第n-1级栅极驱动单元的控制端电压信号Qn-1，并根据所述时钟信号CLKn-2、所述时钟信号CLKn-1以及所述控制端电压信号Qn-1，将所述控制端电压信号Qn从第一高电平拉高至第二高电平；
利用所述输出模块接收时钟信号CLKn，并根据所述时钟信号CLKn将所述控制端电压信号Qn从第二高电平耦合至第三高电平，且根据耦合后的控制端电压信号Qn与所述时钟信号CLKn输出栅极扫描信号Gn；
利用所述反馈模块接收反馈信号，并根据所述反馈信号将所述耦合后的控制端电压信号Qn拉低；
利用所述控制模块控制所述下拉维持模块维持所述控制端电压信号Qn的低电压。
9.根据权利要求8所述的驱动方法，其特征在于，所述上拉模块包括：
上拉单元和上拉控制单元；
所述利用上拉模块接收所述第n-2级栅极驱动单元的时钟信号CLKn-2、第n-1级栅极驱动单元的时钟信号CLKn-1，以及所述第n-1级栅极驱动单元的控制端电压信号Qn-1，并根据所述时钟信号CLKn-2、所述时钟信号CLKn-1以及所述控制端电压信号Qn-1，将所述控制端电压信号Qn从第一高电平拉高至第二高电平具体为：
利用所述上拉单元接收所述时钟信号CLKn-2与所述时钟信号CLKn-1，并根据所述时钟信号CLKn-2与所述时钟信号CLKn-1生成第一上拉信号至所述上拉控制单元；
利用所述上拉控制单元接收所述控制端电压信号Qn-1，并根据所述控制端电压信号Qn-1与所述第一上拉信号生成第二上拉信号，以将所述控制端电压信号Qn从第一高电平拉高至第二高电平。
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