CN105281885A - 用于网络设备的时间同步方法、装置及时间同步服务器 - Google Patents

用于网络设备的时间同步方法、装置及时间同步服务器 Download PDF

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Abstract

本发明提供一种用于网络设备的时间同步方法、装置及时间同步服务器，涉及通信技术领域，用以解决现有技术中时间同步报文处理不够及时，无法大容量集中进行时间同步的问题。所述方法包括：可编程逻辑器件在物理层对来自待同步设备的时间同步报文进行接收和解析，所述时间同步报文中携带有同步参数；可编程逻辑器件根据本地基准时间和所述同步参数的更新配置，生成所述时间同步报文的回复报文；可编程逻辑器件将所述回复报文以及来自CPU的建链和通信报文，按照预设顺序向所述待同步设备发送。

Description

用于网络设备的时间同步方法、装置及时间同步服务器
技术领域
本发明涉及通信技术领域，特别是涉及一种用于网络设备的时间同步方法、装置及时间同步服务器。
背景技术
随着互联网技术和应用的发展，网络设备之间对时间同步提出了越来越严格的要求。例如各种实时的网上交易、制造过程控制、通信网络的时间配置、网络安全性设计、分布性的网络计算和处理、交通航班航路管理以及数据库文件管理和呼叫记录等多种涉及时间戳的应用，都需要精确、可靠和公认的时间。
网络设备之间可以通过各种时间同步协议进行时间同步，其中，NTP(NetworkTimeProtocol，网络时间协议)是比较常用的一种。NTP可以通过估算NTP数据包在以太网网络的往返延迟时间使网络设备对服务器或时钟源(如石英钟，铷钟，GPS等)同步，从而为网络设备提供高精准度的时间校正。SNTP是NTP的简化版本。
按照***的网络架构，NTP/SNTP报文一般在应用层内进行接收、参数更新及发送。而应用层的接收和发送报文操作都需要由CPU(CentralProcessingUnit，中央处理器)的软件中断驱动实现。因此，受限于CPU***的中断响应速度和频率，NTP/SNTP报文处理也较为缓慢。CPU这种处理NTP/SNTP报文能力不足问题在femto(家庭基站)/微基站的大规模组网应用上显得尤为突出，无法大容量集中进行时间同步，导致现有的femto/微基站组网方案无法最大程度地降低NTP/SNTP同步成本。
发明内容
本发明要解决的技术问题是提供一种用于网络设备的时间同步方法、装置及时间同步服务器，用以解决现有技术中时间同步报文处理不够及时，无法大容量集中进行时间同步的问题。
一方面，本发明提供一种用于网络设备的时间同步方法，包括：可编程逻辑器件在物理(PHY)层对来自待同步设备的时间同步报文进行接收和解析，所述时间同步报文中携带有同步参数；可编程逻辑器件根据本地基准时间和所述同步参数的更新配置，生成所述时间同步报文的回复报文；可编程逻辑器件将所述回复报文以及来自CPU的建链和通信报文，按照预设顺序向所述待同步设备发送。
可选的，所述可编程逻辑器件在物理层对来自待同步设备的时间同步报文进行接收和解析包括：所述可编程逻辑器件通过至少两个通信通道，在物理层对来自不同待同步设备的时间同步报文进行接收和解析。
可选的，所述可编程逻辑器件根据本地基准时间和所述同步参数的更新配置，生成所述时间同步报文的回复报文包括：所述可编程逻辑器件通过各所述通信通道分别根据本地基准时间和CPU对各所述同步参数的更新配置，生成相应的回复报文；所述可编程逻辑器件将所述回复报文以及来自CPU的建链和通信报文，按照预设顺序向所述待同步设备发送包括：所述可编程逻辑器件通过各所述通信通道分别接收来自CPU的建链和通信报文；所述可编程逻辑器件通过各所述通信通道分别将生成的所述回复报文以及接收的所述建链和通信报文按照预设顺序向所述待同步设备发送。
可选的，所述可编程逻辑器件根据本地基准时间和所述同步参数的更新配置，生成所述时间同步报文的回复报文包括：所述可编程逻辑器件从主时钟板或备时钟板获取本地基准时间；所述可编程逻辑器件将所述本地基准时间转化为授时基准时间；所述可编程逻辑器件根据所述授时基准时间和所述更新配置，生成所述时间同步报文的回复报文。
可选的，所述同步参数包括所述时间同步报文的源地址、目的地址；对所述同步参数的更新配置包括：对所述源地址和所述目的地址的更新配置，以及对所述基准时间的精度更新配置。
另一方面，本发明还提供一种用于网络设备的时间同步装置，包括：接收解析单元，用于在物理层对来自待同步设备的时间同步报文进行接收和解析，所述时间同步报文中携带有同步参数；生成单元，用于根据本地基准时间和所述同步参数的更新配置，生成所述时间同步报文的回复报文；发送单元，用于将所述回复报文以及来自CPU的建链和通信报文，按照预设顺序向所述待同步设备发送。
可选的，所述接收解析单元，具体用于通过至少两个通信通道在物理层对来自不同待同步设备的时间同步报文进行接收和解析。
可选的，所述生成单元，具体用于根据本地基准时间和CPU对所述同步参数的更新配置，通过所述至少两个通信通道生成所述时间同步报文的回复报文；所述发送单元具体包括：接收模块，用于通过各所述通信通道分别接收来自CPU的建链和通信报文；发送模块，用于通过各所述通信通道分别将生成的所述回复报文以及接收的所述建链和通信报文按照预设顺序向所述待同步设备发送。
可选的，所述生成单元包括：获取模块，用于从主时钟板或备时钟板获取本地基准时间；转化模块，用于将所述本地基准时间转化为授时基准时间；生成模块，用于根据所述授时基准时间和所述更新配置，生成所述时间同步报文的回复报文。
另一方面，本发明还提供一种时间同步服务器，包括主时钟板、备时钟板和至少一个扩展板，每个所述扩展板包括CPU和本发明提供的任一种时间同步装置。
本发明实施例提供的时间同步方法、装置及时间同步服务器，通过可编程逻辑实现了在PHY层进行时间同步报文的接收、参数更新及回复报文的发送，并由CPU对时间同步报文进行简单的配置和***建链。这样，时间同步报文的各种处理过程都无需通过CPU的中断程序进行，有效规避了CPU架构限制带来的处理报文能力不足问题，从而有利于进行大容量集中时间同步，大大降低了时间同步成本。
附图说明
图1是本发明实施例提供的用于网络设备的时间同步方法的一种流程图；
图2是本发明实施例提供的用于网络设备的时间同步装置的一种结构示意图；
图3是本发明实施例提供的时间同步服务器的一种结构示意图；
图4是本发明实施例提供的时间同步服务器中的扩展板的一种结构示意图。
具体实施方式
以下结合附图对本发明进行详细说明。应当理解，此处所描述的具体实施例仅仅用以解释本发明，并不限定本发明。
实施例一：
如图1所示，本发明的实施例提供一种用于网络设备的时间同步方法，包括：
S11，可编程逻辑器件在物理层对来自待同步设备的时间同步报文进行接收和解析，所述时间同步报文中携带有同步参数；
S12，可编程逻辑器件根据本地基准时间和所述同步参数的更新配置，生成所述时间同步报文的回复报文；
S13，可编程逻辑器件将所述回复报文以及来自CPU的建链和通信报文，按照预设顺序向所述待同步设备发送。
本发明实施例提供的时间同步方法，通过可编程逻辑实现了在PHY层进行时间同步报文的接收、参数更新及回复报文的发送，并由CPU对时间同步报文进行简单的配置和***建链。这样，时间同步报文的各种处理过程都无需通过CPU的中断程序进行，有效规避了CPU架构限制带来的处理报文能力不足问题，从而有利于进行大容量集中时间同步，大大降低了时间同步成本。
具体而言，在步骤S11中，需要对来自待同步设备的时间同步报文进行接收和解析。但与传统方式不同，本实施例中，对时间同步报文的接收和解析不是由CPU完成的，而是由可编程逻辑器件完成。可选的，可编程逻辑器件可以为各种具有数据处理功能的芯片或电路模块，如CPLD(ComplexProgrammableLogicDevice，复杂可编程逻辑器件)、FPGA(Field－ProgrammableGateArray，现场可编程门阵列)、DSP(digitalsignalprocessor，数字信号处理器)等。这些可编程逻辑器件往往都具有并行处理数据的能力，能够在具体的电路设计层面和协议的物理层对时间同步报文进行高效处理。同时，在接收的时间同步报文中还携带有一些同步参数，例如以待同步设备的时间为基准的报文发送时间、报文的源地址、目的地址等，从而将待同步设备的一些基本信息传递给可编程逻辑器件。
在步骤S12中，可编程逻辑器件要将步骤S11中解析好的时间同步报文进行同步参数更新，并生成时间同步报文的回复报文。可选的，回复报文的数据结构可以与时间同步报文相同，只是在一些具体的参数设置上有所区别。例如，时间同步报文中可以携带有以待同步设备的时间为基准的报文发送时间、报文的源地址、目的地址等，而回复报文中，可以携带有以本地基准时间为准的时间同步报文接收时间、以本地基准时间为准的回复报文发送时间，回复报文的源地址和目的地址等。其中，本地基准时间也就是在网络设备中认为准确的那个时间，其他网络设备的时间都要与这个时间进行校准。可选的，本地基准时间既可以是本地准确的晶振时间，也可以是来自GNSS(GlobalNavigationSatelliteSystem，全球导航卫星***)或BITS(BuildingIntegratedTimingSupply，大楼综合定时供给***)的时间，本发明的实施例对此不作限制。然而，可编程逻辑器件从主时钟板或备时钟板上获取到的本地基准时间并不直接发送给待同步设备，而是首先需要转化成授时基准时间，如NTP时间等，才可以作为时间同步的标准。当然，时间同步报文也可以是NTP/SNTP以外的其他形式的报文，本发明的实施例对此不做限制。举例说明，在本发明的一个实施例中，可编程逻辑器件根据本地基准时间和所述同步参数的更新配置，生成所述时间同步报文的回复报文包括如下步骤：可编程逻辑器件从主时钟板或备时钟板获取本地基准时间；可编程逻辑器件将所述本地基准时间转化为授时基准时间；可编程逻辑器件根据所述授时基准时间和所述更新配置，生成所述时间同步报文的回复报文。
可编程逻辑器件可以从主时钟板或备时钟板上获取本地基准时间，再将本地基准时间转化为授时基准时间，然后将授时基准时间更新到同步参数中，作为回复报文中的内容。对于一组时间同步报文及其对应的回复报文来讲，时间同步报文的源地址也就是回复报文的目的地址，而时间同步报文的目的地址也就是回复报文的源地址。
进一步的，可编程逻辑器件还可以根据需要在同步参数中增加新的字段来完善时间同步操作。例如，在本发明的一个实施例中，可编程逻辑器件在获取本地基准时间的同时还获知了该基准时间的精度，那么在进行同步参数的更新时，就可以将本地基准时间的精度作为一个附加字段添加到同步参数中，以便使待同步设备获知其时间精度。
需要说明的是，虽然可编程逻辑器件能够处理有关报文收发和参数更新等事务，但有关参数的更新配置以及与待同步设备的定期建链和通信还需要CPU的参与。也就是说，除了可编程逻辑器件会向待同步设备发送回复报文外，CPU也会定时向待同步设备发送少量的建链和通信报文。这就需要对这些报文的发送先后顺序进行仲裁，以便进一步优化时间同步报文处理能力。
上述实施例描述了可编程逻辑器件处理时间同步报文的整体流程，但更为具体的，可编程逻辑器件可以设置有两个或更多通信通道，可编程逻辑器件可以通过这些通信通道，在物理层对来自不同待同步设备的时间同步报文进行接收和解析，这样就能对多个待同步设备并行进行时间同步，从而大大提高了时间同步报文的接收和解析效率。
相应的，步骤S12中，所述可编程逻辑器件根据本地基准时间和所述同步参数的更新配置，生成所述时间同步报文的回复报文可以包括：所述可编程逻辑器件通过各所述通信通道分别根据本地基准时间和CPU对各所述同步参数的更新配置，生成相应的回复报文；相应的，步骤S13中，所述可编程逻辑器件将所述回复报文以及来自CPU的建链和通信报文，按照预设顺序向所述待同步设备发送可以包括：所述可编程逻辑器件通过各所述通信通道分别接收来自CPU的建链和通信报文；所述可编程逻辑器件通过各所述通信通道分别将生成的所述回复报文以及接收的所述建链和通信报文按照预设顺序向所述待同步设备发送。例如，在本发明的一个实施例中，CPU每隔5分钟需要向各个待同步设备发送一次建联和通信报文，那么，可编程逻辑器件的各个通信通道就可以先接收来自CPU的建联和通信报文，然后每隔5分钟向各待同步设备发送一次建联和通信报文，而在其他时间里则都可以发送时间同步报文。这样，由于CPU没有处理时间同步报文而仅仅处理建联和通信报文，工作量大大减少，因此可以利用CPU资源支持多通道的NTP/SNTP发包功能，使多条通道的信令报文通过交换汇聚给CPU进行建链和通信，***对NTP/SNTP发包能力也相应增加多倍，有效提高了大容量集中进行时间同步的能力。
相应的，本发明的实施例还提供一种用于网络设备的时间同步装置，如图2所示，该装置包括：
接收解析单元20，用于在物理层对来自待同步设备的时间同步报文进行接收和解析，所述时间同步报文中携带有同步参数；
生成单元22，用于根据本地基准时间和所述同步参数的更新配置，生成所述时间同步报文的回复报文；
发送单元24，用于将所述回复报文以及来自CPU的建链和通信报文，按照预设顺序向所述待同步设备发送。
本发明实施例提供的时间同步装置，接收解析单元20、生成单元22和发送单元24通过可编程逻辑器件分别实现了在PHY(物理)层进行时间同步报文的接收、参数更新及回复报文的发送，并由CPU对时间同步报文进行简单的配置和***建链。这样，时间同步报文的各种处理过程都无需通过CPU的中断程序进行，有效规避了CPU架构限制带来的处理报文能力不足问题，从而有利于进行大容量集中时间同步，大大降低了时间同步成本。
可选的，接收解析单元20，可具体用于通过至少两个通信通道在物理层对来自不同待同步设备的时间同步报文进行接收和解析。生成单元22，可具体用于根据本地基准时间和CPU对所述同步参数的更新配置，通过所述至少两个通信通道生成所述时间同步报文的回复报文。发送单元24具体可包括：接收模块，用于通过各所述通信通道分别接收来自CPU的建链和通信报文；发送模块，用于通过各所述通信通道分别将生成的所述回复报文以及接收的所述建链和通信报文按照预设顺序向所述待同步设备发送。
可选的，生成单元22可包括：获取模块，用于从主时钟板或备时钟板获取本地基准时间；转化模块，用于将所述本地基准时间转化为授时基准时间；生成模块，用于根据所述授时基准时间和所述更新配置，生成所述时间同步报文的回复报文。
相应的，本发明的实施例还提供一种时间同步服务器，如图3所示，包括主时钟板、备时钟板和至少一个扩展板，每个所述扩展板包括CPU和上述任一种时间同步装置，扩展板的结构可如图4所示。
结合图3和图4，主备时钟板上的本地基准时间可以通过机框内走线传递给各个扩展板，每个扩展板又可以有N个通道，通过这样的单板扩展和通道扩展，本实施例提供的时间同步服务器能够供大量用户接入。
其中，接收报文解析模块11完成对当前接收报文的解析，并提取NTP报文信息。将提取的NTP报文信息作为待回复的报文的基本信息，供NTP报文组帧模块14完成NTP报文组帧。
NTP基准时间模块12，通过本地时钟及时钟源(GNSS或BITS等)，完成NTP基准时间的运算，并将基准时间提供给发送报文处理模块14，作为NTP报文的接收时间戳和发送时间戳信息，完成发送。
NTP报文参数配置模块13，通过CPU适配接口，完成NTP报文参数的下发和配置。配置信息供NTP报文组帧模块14完成NTP报文组帧。
NTP报文组帧模块14根据接收报文解析模块11解析的NTP报文信息，NTP基准时间模块12产生的NTP基准时间，NTP报文参数配置模块13产生的NTP报文信息，并根据协议要求进行组帧。
CPU报文缓存模块15用来缓存CPU用来建链和通信的报文，供报文仲裁模块16仲裁发送。
报文仲裁模块16根据优先级等信息，对NTP/SNTP报文组帧模块14和CPU报文缓存模块15的报文进行仲裁，按照优先级完成报文的发送。
通过交换模块完成N条以太网通道和CPU连接，构成各通道和CPU***的建链和通信；
每条通道接收的建链和通信报文通过交换模块汇聚后的由CPU处理，CPU响应的信令报文通过交换模块分发给各个通道。
主时钟板利用GNSS或BITS时钟和本地的高精度时钟，产生基准NTP时间，通过机框内部走线，将NTP基准时间传递给扩展板。并通过各个通道的以太网接口，发送NTP/SNTP报文给接入***的各个用户。
备时钟板通过各个通道的以太网接口，作为NTP/SNTP时钟给接入***的用户授时。并在主时钟板出现功能异常时，给扩展板提供基准NTP时间。
扩展板在负载用户较多时候，提供扩展功能。扩展板可提供单板扩展和通道扩展功能，扩展板需要的NTP基准时间由主时钟板或备时钟板通过机框走线传递获取。扩展板可以灵活应用选择是否配置，配置多少块以及使用什么样机框配置。
实施例二：
如图3为本发明实施例二提供的机框单板扩展应用设计的结构示意图，如图3所示，单板包括主时钟板、备时钟板、扩展板，通过机框内走线将基准时间信息从主备时钟板传递给扩展板，提供单板扩展及通道扩展功能，供接入大容量的用户。
在主时钟板中，将GNSS或BITS时钟作为时钟源，利用该时钟源和本地的高精度时钟，产生基准时间信息，通过机框内部走线，将基准时间信息传递给扩展板，并通过各个通道的以太网接口，作为NTP/SNTP时钟给接入的终端提供基准时间信息。
在备时钟板中，将GNSS或BITS时钟作为时钟源，利用该时钟源和本地的高精度时钟，产生基准时间信息，通过各个通道的以太网接口，作为NTP/SNTP时钟给接入的终端提供时间信息，并在主时钟板出现功能异常时，给扩展板提供基准时间信息。
扩展板在负载用户较多时候，提供NTP/SNTP时间同步功能，扩展板只提供单板扩展和通道扩展功能，扩展板需要的基准时间信息由主时钟板或者备时钟板通过机框走线传递获取，扩展板可以灵活应用选择是否配置，配置多少块以及使用什么样机框配置。
针对主时钟板与备时钟板，其结构基本相同，其区别仅在于当主时钟板出现异常时，由备时钟板向扩展板提供基准时间信息。针对扩展板，其与主时钟板或备时钟板的区别在于，主时钟板或备时钟板中包括GNSS或BITS时钟，将GNSS或BITS时钟作为时钟源，与本地的高精度时钟产生基准时间信息，而扩展板中不包括时钟源，其基准时间信息基本来源于主时钟板或备时钟板，即主时钟板或备时钟板将基准时间信息通过机框走线传输至扩展板，以供扩展板使用。
实施例三：
如图4为本发明实施例二提供的单板的结构示意图，如图4所示，该单板包括上述可编程逻辑器件，该可编程逻辑器件位于物理层。
在该单板中，还包括CPU、以太网接口，可编程逻辑器件通过以太网端口与终端相连接，利用CPU仅处理少量建链通信报文的优势，可编程逻辑器件与CPU完成建链通信报文的交互，从而使得CPU与外接终端建立链接和通信。该可编程逻辑器件包括N(N≥1且为正整数)个通道，每个通道通过以太网接口外接终端，从而完成终端的时间同步功能，需要说明的是，对于实施例二提供的全新架构，其包括但不局限于以下方式存在于可编程逻辑器件中：
其一、可以存在于每一个通道中，即在可编程逻辑器件中包括N个架构，每一个通道内部的架构完全相同，使每一个通过以太网接口接入可编程逻辑器件的终端通过与其以太网接口对应的通道，完成相应的功能；
其二、可以为所有通道所共用，即在可编程逻辑器件中只包括一个架构，所有以太网接口接入同一个架构中，因而每一个终端通过以太网接口接入可编程逻辑器件中的同一个架构中，完成相应的功能；
其三、可以存在于M(1＜M＜N，且为正整数)个通道中，根据以太网接口与存在架构的通道之间的连接，使每一个终端通过以太网接口接入可编程逻辑器件中的存在架构的通道，完成相应的功能。
实施例四：
通过上述可编程逻辑器件和CPU器件协同处理的全新架构设计，完全由***的链路带宽来决定报文收发包能力，下面分别从10M/100M/1000M/10G几种以太网接口描述其收发包能力：
(1)若***间的接口为1000M以太网接口：单通道链路带宽为1000Mbps。若将每条链路的带宽1％作为信令报文建链和通信专用，则NTP/SNTP报文可供利用的带宽为990Mbps，即123.75MBps。如果NTP/SNTP报文基于IPV4的UDP报文，则每个报文包长为90Byte，外加帧间隔12Byte，同时再考虑特殊情况下的8Byte的VLAN要求，每条链路通道每秒钟可以回复的报文为123.75M/(90+12+8)＝1.124*106，单通道每秒回复的报文能力达到100万个以上。由于通道可以扩展多路(如常见的8通道、4通道、12通道、16通道等)，加上机框的扩展能力(标准的1U机框扩展4块单板，2U机框扩展8块单板，3U机框扩展12块单板)，本发明的装置在1000M以太网接口***中，每秒的发包流量能够达到几千万甚至上亿；
(2)若***间的接口为100M以太网接口：单通道链路带宽为100Mbps。若将每条链路的带宽1％作为信令报文建链和通信专用，则NTP/SNTP报文可供利用的带宽为99Mbps，即12.375MBps。如果NTP/SNTP报文基于IPV4的UDP报文，则每个报文包长为90Byte，外加帧间隔12Byte，同时再考虑特殊情况下的8Byte的VLAN要求，每条链路通道每秒钟可以回复的报文为12.375M/(90+12+8)＝0.1124*106，单通道每秒回复的报文能力达到10万个以上。由于通道可以扩展多路(如常见的8通道、4通道、12通道、16通道等)，加上机框的扩展能力(标准的1U机框扩展4块单板，2U机框扩展8块单板，3U机框扩展12块单板)，本发明的装置在100M以太网接口***中，每秒的发包流量能够达到几百万甚至上千万；
(3)若***间的接口为10M以太网接口：单通道链路带宽为10Mbps。若将每条链路的带宽1％作为信令报文建链和通信专用，则NTP/SNTP报文可供利用的带宽为9.9Mbps，即1.2375MBps。如果NTP/SNTP报文基于IPV4的UDP报文，则每个报文包长为90Byte，外加帧间隔12Byte，同时再考虑特殊情况下的8Byte的VLAN要求，每条链路通道每秒钟可以回复的报文为1.2375M/(90+12+8)＝1.124*104，单通道每秒回复的报文能力达到1万个以上。由于通道可以扩展多路(如常见的8通道、4通道、12通道、16通道等)，加上机框的扩展能力(标准的1U机框扩展4块单板，2U机框扩展8块单板，3U机框扩展12块单板)，本发明的装置在10M以太网接口***中，每秒的发包流量能够达到几十万甚至上百万；
(4)若***间的接口为10G以太网接口：单通道链路带宽为10Gbps。若将每条链路的带宽1％作为信令报文建链和通信专用，则NTP/SNTP报文可供利用的带宽为9.9Gbps，即1.2375GBps。如果NTP/SNTP报文基于IPV4的UDP报文，则每个报文包长为90Byte，外加帧间隔12Byte，同时再考虑特殊情况下的8Byte的VLAN要求，每条链路通道每秒钟可以回复的报文为1.2375G/(90+12+8)＝1.124*107，单通道每秒回复的报文能力达到1000万个以上。由于通道可以扩展多路(如常见的8通道、4通道、12通道、16通道等)，加上机框的扩展能力(标准的1U机框扩展4块单板，2U机框扩展8块单板，3U机框扩展12块单板)，本发明的装置在100M以太网接口***中，每秒的发包流量能够达到数亿甚至数十亿。
本发明的NTP/SNTP报文从PHY层直接完成接收和发送处理，避免了应用层报文组帧到PHY层可能出现的阻塞及时延等因素，时间精度更高。同时，相较CPU依靠中断驱动接收发送报文方式，可编程逻辑高频率的响应速度，进一步优化了NTP/SNTP同步性能。
尽管为示例目的，已经公开了本发明的优选实施例，本领域的技术人员将意识到各种改进、增加和取代也是可能的，因此，本发明的范围应当不限于上述实施例。

Claims (10)

1.一种用于网络设备的时间同步方法，其特征在于，包括：
可编程逻辑器件在物理层对来自待同步设备的时间同步报文进行接收和解析，所述时间同步报文中携带有同步参数；
可编程逻辑器件根据本地基准时间和所述同步参数的更新配置，生成所述时间同步报文的回复报文；
可编程逻辑器件将所述回复报文以及来自CPU的建链和通信报文，按照预设顺序向所述待同步设备发送。
2.根据权利要求1所述的方法，其特征在于，所述可编程逻辑器件在物理层对来自待同步设备的时间同步报文进行接收和解析包括：
所述可编程逻辑器件通过至少两个通信通道，在物理层对来自不同待同步设备的时间同步报文进行接收和解析。
3.根据权利要求2所述的方法，其特征在于，所述可编程逻辑器件根据本地基准时间和所述同步参数的更新配置，生成所述时间同步报文的回复报文包括：
所述可编程逻辑器件通过各所述通信通道分别根据本地基准时间和CPU对各所述同步参数的更新配置，生成相应的回复报文；
所述可编程逻辑器件将所述回复报文以及来自CPU的建链和通信报文，按照预设顺序向所述待同步设备发送包括：
所述可编程逻辑器件通过各所述通信通道分别接收来自CPU的建链和通信报文；
所述可编程逻辑器件通过各所述通信通道分别将生成的所述回复报文以及接收的所述建链和通信报文按照预设顺序向所述待同步设备发送。
4.根据权利要求1所述的方法，其特征在于，所述可编程逻辑器件根据本地基准时间和所述同步参数的更新配置，生成所述时间同步报文的回复报文包括：
所述可编程逻辑器件从主时钟板或备时钟板获取本地基准时间；
所述可编程逻辑器件将所述本地基准时间转化为授时基准时间；
所述可编程逻辑器件根据所述授时基准时间和所述更新配置，生成所述时间同步报文的回复报文。
5.根据权利要求1至4中任一项所述的方法，其特征在于，所述同步参数包括所述时间同步报文的源地址、目的地址；
对所述同步参数的更新配置包括：对所述源地址和所述目的地址的更新配置，以及对所述基准时间的精度更新配置。
6.一种用于网络设备的时间同步装置，其特征在于，包括：
接收解析单元，用于在物理层对来自待同步设备的时间同步报文进行接收和解析，所述时间同步报文中携带有同步参数；
生成单元，用于根据本地基准时间和所述同步参数的更新配置，生成所述时间同步报文的回复报文；
发送单元，用于将所述回复报文以及来自CPU的建链和通信报文，按照预设顺序向所述待同步设备发送。
7.根据权利要求6所述的装置，其特征在于，所述接收解析单元，具体用于通过至少两个通信通道在物理层对来自不同待同步设备的时间同步报文进行接收和解析。
8.根据权利要求7所述的装置，其特征在于，所述生成单元，具体用于根据本地基准时间和CPU对所述同步参数的更新配置，通过所述至少两个通信通道生成所述时间同步报文的回复报文；
所述发送单元具体包括：
接收模块，用于通过各所述通信通道分别接收来自CPU的建链和通信报文；
发送模块，用于通过各所述通信通道分别将生成的所述回复报文以及接收的所述建链和通信报文按照预设顺序向所述待同步设备发送。
9.根据权利要求6所述的装置，其特征在于，所述生成单元包括：
获取模块，用于从主时钟板或备时钟板获取本地基准时间；
转化模块，用于将所述本地基准时间转化为授时基准时间；
生成模块，用于根据所述授时基准时间和所述更新配置，生成所述时间同步报文的回复报文。
10.一种时间同步服务器，其特征在于，包括主时钟板、备时钟板和至少一个扩展板，每个所述扩展板包括CPU和权利要求6至9中任一项所述的时间同步装置。
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