CN104679211A - 降频控制装置 - Google Patents
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Abstract
一种降频控制装置,连接于一电源的超载检测模块用以控制CPU降频,该降频控制装置包括一嵌入式控制器,嵌入式控制器包括一输入端及一第一输出端,该输入端连接超载检测模块,该第一输出端连接CPU,当超载检测模块检测到电源超载时,嵌入式控制器控制CUP降频。本发明降频控制装置可以在接收到电源的超载信号时控制CPU频率,进而防止的电源超载发生。
Description
技术领域
本发涉及一种降频控制装置。
背景技术
现有电脑的主板上连接设备较多,过多的设备容易造成电源超载,电源超载而产生电脑异常关机。
发明内容
有鉴于此,有必要提供一种防止电源超载的降频控制装置。
一种降频控制装置,连接于一电源的超载检测模块用以控制CPU降频,该降频控制装置包括一嵌入式控制器,嵌入式控制器包括一输入端及一第一输出端,该输入端连接超载检测模块,该第一输出端连接CPU,当超载检测模块检测到电源超载时,嵌入式控制器控制CUP降频。
相较现有技术,本发明降频控制装置可以在接收到电源的超载信号时控制CPU降率,进而以防止的电源超载发生。
附图说明
图1是本发明降频控制装置的电路方框图。
主要元件符号说明
如下具体实施方式将结合上述附图进一步说明本发明。
具体实施方式
请参考图1,本发明降频控制装置100连接于一电源200的超载检测电路120以控制一CPU 200降频及通过CPU 200控制一连接于CPU 200的存储器300降频。
本发明降频控制装置100包括一嵌入式控制器130。
超载检测电路120包括一输出端OUT。该超载检测电路120用以检测电源110是否超载(即电源110内部电流或电压是否超过一设定阀值(该阀值小于电源110的额定值))。当该超载检测电路120侦测到电源110超载时,该超载检测电路120的输出端OUT输出一超载信号。
该嵌入式控制器130包括一输入端GPIO0、一输出端GPIO1及一输出端GPIO2。
CPU200包括一第一控制端C0及一第二控制端C1。该第一控制端C0可接收方波形式的控制信号或持续高电平的控制信号,以控制CPU 200自身降频。该第二控制端C1可接收方波形式的控制信号或持续高电平的控制信号以使CPU 200控制存储器300降频。
电源110的超载检测电路120的输出端OUT连接嵌入式控制器130的输入端GPIO0,该嵌入式控制器130的输出端GPIO1连接CPU 200的第一控制端C0,输出端GPIO2连接第二控制端C1。
当电源110的超载检测电路120检测到电源110超载时,该超载检测电路120的输出端OUT输出超载信号至嵌入式控制器130的输入端GPIO0,嵌入式控制器130的输出端GIPO1及输出端GPIO2同时输出控制信号至CPU 200的第一控制端C0及第二控制端C1以使CPU 200分别控制其自身与存储器300降频。
本发明降频控制装置100可以在接收到电源110的超载信号时控制CPU 200及存储器300降率,进而以防止的电源超载发生。
Claims (4)
1.一种降频控制装置,连接于一电源的超载检测模块用以控制CPU降频,该降频控制装置包括一嵌入式控制器,嵌入式控制器包括一输入端及一第一输出端,该输入端连接超载检测模块,该第一输出端连接CPU,当超载检测模块检测到电源超载时,嵌入式控制器控制CUP降频。
2.如权利要求1所述的降频控制装置,其特征在于:该CUP连接一存储器,该嵌入式控制器还包括一第二输出端,该第二输出端连接CPU,当超载检测模块检测到电源超载时,CUP控制存储器降频。
3.如权利要求2所述的降频控制装置,其特征在于:当超载检测模块检测到电源超载时,嵌入式控制器的第一输出端及第二输出端输出方波形式的控制信号至CPU。
4.如权利要求2所述的降频控制装置,其特征在于:当超载检测模块检测到电源超载时,嵌入式控制器的第一输出端及第二输出端输出输出高电平的控制信号至CPU。
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