CN103149757A - 液晶显示装置及其制造方法 - Google Patents
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Abstract
公开了一种可减小由静电放电冲击导致的对信号线和开关器件的损害的液晶显示装置及其制造方法。所述液晶显示装置包括：通过多条栅极线与多条数据线之间的交叉界定的多个像素；沿所述像素的周边设置的多个虚拟像素；与所述栅极线平行设置的多条公共线，所述公共线与所述像素和所述虚拟像素连接；接收外部公共电压的第一栅极金属；从所述公共线延伸到一侧的多个第二栅极金属，所述第二栅极金属具有焊盘形状；在与所述数据线平行的方向上设置在所述第二栅极金属一侧的源极-漏极金属；将所述第一栅极金属与所述源极-漏极金属电连接的第一连接图案；和将所述源极-漏极金属与所述第二栅极金属电连接的第二连接图案。
Description
本申请要求2011年12月7日提交的韩国专利申请No.10-2011-0130497的优先权，在此援引该专利申请作为参考，如同在这里完全阐述一样。
技术领域
本发明涉及一种液晶显示装置，尤其涉及一种可减小由静电放电冲击导致的对信号线和开关器件的损害的液晶显示装置及其制造方法。
背景技术
一般来说，为了防止静电放电（ESD）引入像素中，液晶显示装置包括设置在不显示图像的非显示区域中的抗静电放电电路。抗静电放电电路设置在给像素提供扫描信号的栅极线的引入部和给像素提供数据电压的数据线的引入部中。这种抗静电放电电路将引入数据线或栅极线中的静电放电传递到公共线，被引入公共线的静电放电流入栅极线或数据线。
同时，近年来，随着高分辨率和尺寸增加的趋势，液晶显示装置被设计成具有较小宽度的栅极线和数据线以及较小尺寸的开关器件。这些行为意味着栅极线和数据线以及开关器件对静电放电冲击变得更加脆弱。因此，需要能更有效地保护像素中的栅极线和数据线以及开关器件免于静电放电冲击的技术。
发明内容
因此，本发明涉及一种基本上克服了由于现有技术的限制和缺点而导致的一个或多个问题的液晶显示装置及其制造方法。
本发明的一个目的是提供一种可减小由静电放电冲击导致的对信号线和开关器件的损害的液晶显示装置及其制造方法。
在下面的描述中将列出本发明的其它优点、目的和特征，这些优点、目的和特征的一部分从下面的描述对于本领域普通技术人员来说是显而易见的，或者可从本发明的实施领会到。通过说明书、权利要求以及附图中特别指出的结构可实现和获得本发明的这些目的和其他优点。
为了实现这些目的和其他优点并根据本发明的目的，如在此具体和概括描述的，一种液晶显示装置，包括：通过多条栅极线与多条数据线之间的交叉界定的多个像素；沿所述像素的周边设置的多个虚拟像素；与所述栅极线平行设置的多条公共线，所述公共线与所述像素和所述虚拟像素连接；接收外部公共电压的第一栅极金属；从所述公共线延伸到一侧的多个第二栅极金属，所述第二栅极金属具有焊盘形状；在与所述数据线平行的方向上设置在所述第二栅极金属一侧的源极-漏极金属；将所述第一栅极金属与所述源极-漏极金属电连接的第一连接图案；和将所述源极-漏极金属与所述第二栅极金属电连接的第二连接图案。
所述液晶显示装置可进一步包括：从所述公共线延伸到另一侧的多个第三栅极金属，所述第三栅极金属具有焊盘形状；和将所述第一栅极金属与所述第三栅极金属电连接的第三连接图案。
所述第一到第三栅极金属以及所述公共线与所述栅极线由相同的材料形成在同一层中。
所述源极-漏极金属与所述数据线由相同的材料形成在同一层中。
所述第一到第三连接图案与所述像素中设置的像素电极由相同的材料形成在同一层中。
所述液晶显示装置可进一步包括：与所述数据线平行形成的虚拟数据线，从而所述虚拟数据线与第一条和最后一条数据线相邻；在与所述栅极线平行的方向上从所述第一栅极金属分支的虚拟公共线，所述虚拟公共线与所述数据线和所述虚拟数据线交叉；设置和连接在所述数据线与所述虚拟公共线之间的第一抗静电放电电路；设置和连接在所述虚拟公共线与所述第一栅极金属之间的第二抗静电放电电路；和设置和连接在所述虚拟数据线与所述虚拟公共线之间的第三抗静电放电电路，其中所述虚拟数据线设置在所述第二和第三抗静电放电电路之间。
所述液晶显示装置可进一步包括：设置和连接在所述栅极线与所述源极-漏极金属之间的第四抗静电放电电路。
在本发明的另一个方面中，一种制造液晶显示装置的方法，包括：在基板上形成彼此交叉的多条栅极线和多条数据线，以界定多个像素区域；在所述像素区域中形成多个像素，每个像素都包括薄膜晶体管和像素电极；沿所述像素的周边形成多个虚拟像素；形成多条公共线和多个第二栅极金属，所述公共线与所述栅极线平行设置并与所述像素和所述虚拟像素连接，所述第二栅极金属从所述公共线延伸到一侧并具有焊盘形状；形成与焊盘单元电连接的、接收外部公共电压的第一栅极金属；在所述第二栅极金属一侧形成设置在与所述数据线平行的方向上的源极-漏极金属；形成第一连接图案和第二连接图案，所述第一连接图案将所述第一栅极金属与所述源极-漏极金属电连接，所述第二连接图案将所述源极-漏极金属与所述第二栅极金属电连接。
所述方法可进一步包括：形成多个第三栅极金属，所述第三栅极金属从所述公共线延伸到另一侧并具有焊盘形状；和形成第三连接图案，所述第三连接图案将所述第一栅极金属与所述第三栅极金属电连接。
所述第一到第三栅极金属以及所述公共线与所述栅极线由相同的材料形成在同一层中。
所述源极-漏极金属与所述数据线由相同的材料形成在同一层中。
所述第一到第三连接图案与所述像素电极由相同的材料形成在同一层中。
所述方法可进一步包括：形成与所述数据线平行的虚拟数据线，从而所述虚拟数据线与第一条和最后一条数据线相邻；形成虚拟公共线，从而所述虚拟公共线在与所述栅极线平行的方向上从所述第一栅极金属分支并与所述数据线和所述虚拟数据线交叉；形成第一抗静电放电电路，从而所述第一抗静电放电电路设置和连接在所述数据线与所述虚拟公共线之间；形成第二抗静电放电电路，从而所述第二抗静电放电电路设置和连接在所述虚拟公共线与所述第一栅极金属之间；和形成第三抗静电放电电路，从而所述第三抗静电放电电路设置和连接在所述虚拟数据线与所述虚拟公共线之间，其中所述虚拟数据线设置在所述第二和第三抗静电放电电路之间。
所述方法可进一步包括：形成第四抗静电放电电路，从而所述第四抗静电放电电路设置和连接在所述栅极线与所述源极-漏极金属之间。
所述第一到第四抗静电放电电路与所述像素区域中设置的所述薄膜晶体管同时形成。
应当理解，本发明前面的一般性描述和下面的详细描述都是例示性的和解释性的，意在对要求保护的内容提供进一步的解释。
附图说明
给本发明提供进一步理解并组成说明书一部分的附图图解了本发明的实施方式并与说明书一起用于说明本发明的原理。在附图中：
图1是显示根据本发明一个实施方式的液晶显示装置的构造的示图；
图2是显示图1中所示的液晶面板2的区域A的放大图；
图3是显示图1中所示的液晶面板的区域B的放大图；
图4是显示本发明效果的比较例；
图5显示了其中静电放电冲击集中在特定公共线中，从而导致数据线断裂的一个例子；
图6是显示像素区域中包含的薄膜晶体管TFT的示意性剖面图，并且是沿图2中所示的TFT的线X-Y的剖面图。
具体实施方式
现在详细描述本发明的优选实施方式，附图中图解了这些实施方式的一些例子。只要可能，在整个附图中将使用相同的参考数字表示相同或相似的部件。
之后，将参照附图详细描述根据本发明一个实施方式的液晶显示装置及其制造方法。
图1是显示根据本发明一个实施方式的液晶显示装置的构造的示图。
图1中所示的液晶显示装置包括液晶面板2、栅极驱动器4、数据驱动器6和公共电压供应器8。
液晶面板2界定有显示图像的显示区域AA、以及虚拟区域DA，即显示区域AA外部的区域。
在显示区域AA中设置有以矩阵形式排列的多个像素P。像素P设置在像素区域中。通过多条栅极线GL与多条数据线DL之间的交叉界定像素区域。每个像素P包括薄膜晶体管TFT、液晶电容器Clc和存储电容器Cst。液晶电容器Clc根据通过薄膜晶体管TFT提供给像素电极的数据电压与通过公共线CL提供给公共电极的公共电压Vcom之间的电压差产生的电场驱动液晶。存储电容器Cst将提供给像素电极的数据电压保持预定的时间周期。
在虚拟区域DA中设置有不显示图像的多个虚拟像素DP1和DP2。虚拟像素DP1和DP2沿像素区域AA中设置的多个像素P的周边设置。同时，在虚拟区域DA中，设置有将来自公共电压供应器8的公共电压Vcom提供给多条公共线CL的第一到第三栅极金属10，12和14、源极-漏极金属16以及保护像素P中设置的信号线和薄膜晶体管TFT免于外部静电放电的多个抗静电放电电路（见图2和3）。
栅极驱动器4依次给栅极线GL提供扫描信号。扫描信号是脉冲信号，具有导通像素区域中包含的薄膜晶体管TFT的栅极导通电压和关断薄膜晶体管TFT的栅极关断电压中的一个值。
数据驱动器6使用标准伽马电压将从外部提供的图像数据转换为数据电压，并将转换后的数据电压提供给数据线DL。
公共电压供应器8通过设置在虚拟区域DA中的第一到第三栅极金属10，12和14、以及源极-漏极金属16，将公共电压Vcom提供给公共线CL（见图2和3）。
特别是，在该实施方式中，减小了给公共线CL提供公共电压Vcom的路径之间的电阻偏差，因而可防止由于高压静电放电的集中提供而导致的线断裂或对薄膜晶体管TFT的损害。
之后，将详细描述提供公共电压Vcom到多条公共线CL的路径。
图2是显示图1中所示的液晶面板2的区域A的放大图。图3是显示图1中所示的液晶面板的区域B的放大图。
参照图2和3，多条栅极线GL排列在第一方向（例如水平方向）上，多条数据线DL排列在垂直于第一方向的第二方向（例如纵向方向）上。此外，多条公共线CL排列在第一方向，从而公共线CL平行于栅极线GL。
多个虚拟像素（DP）包括排列在第一方向上的多个第一虚拟像素DP1、以及排列在第二方向上的多个第二虚拟像素DP2。
第一虚拟像素DP1设置在显示区域AA的上部和下部中，从而第一虚拟像素DP1与排列在第一行和最后一行中的像素P相邻。第二虚拟像素DP2设置在显示区域AA的左部和右部，从而第二虚拟像素DP2与排列在第一列和最后一列中的像素P相邻。尽管图2和3中显示了第二虚拟像素DP2设置三列的例子，但第二虚拟像素DP2可设置数列。作为参考，第一虚拟像素DP1与公共线CL连接，但不与栅极线GL连接。
同时，如上所述，第一到第三栅极金属10，12和14以及源极-漏极金属16设置在虚拟区域DA中，这将在下面描述。
第一栅极金属10形成在虚拟区域DA的***并与焊盘单元（未示出）电连接，所述焊盘单元与公共电压供应器8电连接。第二栅极金属12从公共线CL延伸到一侧（例如左侧），以形成焊盘形状。第三栅极金属14从公共线延伸到另一侧（例如右侧），以形成焊盘形状。第一到第三栅极金属10，12和14以及公共线CL可与栅极线GL由相同的材料形成在同一层中。
参照图2，源极-漏极金属16在第二方向上设置在第二栅极金属12的一侧。源极-漏极金属16例如可设置在栅极焊盘单元（未示出）与第二栅极焊盘12之间。在该情形中，为了防止源极-漏极金属16与栅极线GL之间的短路，源极-漏极金属16可与数据线DL由相同的材料形成在同一层中。
同时，第一栅极金属10与源极-漏极金属16电连接，源极-漏极金属16与第二栅极金属12电连接，第一栅极金属10与第三栅极金属14电连接。因此，从公共电压供应器8施加到第一栅极金属10的公共电压Vcom被施加到公共线CL，结果公共电压Vcom可施加到第一和第二虚拟像素DP1和DP2以及像素P。
具体来说，由于分别暴露第一栅极金属10和源极-漏极金属16的第一和第二接触孔H1和H2被第一连接图案18覆盖，第一栅极金属10和源极-漏极金属16彼此电连接。其中，第一接触孔H1穿过保护膜和栅极绝缘膜并暴露一部分第一栅极金属10，第二接触孔H2穿过保护膜并暴露一部分源极-漏极金属16。第一连接图案18可与像素电极由相同的材料形成在同一层中。
此外，由于分别暴露源极-漏极金属16和第二栅极金属12的第三和第四接触孔H3和H4被第二连接图案20覆盖，源极-漏极金属16和第二栅极金属12彼此电连接。其中，第三接触孔H3穿过保护膜并暴露一部分源极-漏极金属16，第四接触孔H4穿过保护膜和栅极绝缘膜并暴露一部分第二栅极金属12。第二连接图案20可与像素区域的像素电极由相同的材料形成在同一层中。
如图3中所示，由于分别暴露第一栅极金属10和第三栅极金属14的第五和第六接触孔H5和H6被第三连接图案22覆盖，第一栅极金属10和第三栅极金属14彼此电连接。其中，第五接触孔H5穿过保护膜和栅极绝缘膜并暴露一部分第一栅极金属10，第六接触孔H6穿过保护膜和栅极绝缘膜并暴露一部分第三栅极金属14。第三连接图案22可与像素区域的像素电极由相同的材料形成在同一层中。
就是说，将在下面概述将公共电压Vcom引入公共线CL中的路径。公共电压Vcom按顺序通过第一栅极金属10、第一连接图案18、源极-漏极金属16、第二连接图案20和第二栅极金属12而施加到每条公共线CL的一侧。此外，公共电压Vcom按顺序通过第一栅极金属10、第三连接图案22和第三栅极金属14施加到每条公共线CL的另一侧。
这样，在该实施方式中，公共电压Vcom通过第一到第三栅极金属10，12和14以及极-漏极金属16跳动（jump），且因此被提供给公共线CL。因此，可减小将公共电压引入公共线CL的路径之间的电阻偏差，和可防止静电放电被集中地引入公共线CL的问题。
作为参考，静电放电会流到具有相对低电阻的部分。因为第一栅极金属10具有较大面积，所以静电放电容易被引入第一栅极金属10。被引入第一栅极金属10的静电放电被引入与第一栅极金属10电连接的公共线CL。当第一栅极金属10与公共线CL之间的电连接路径不同时，在第一栅极金属10与公共线CL之间产生电阻偏差。结果，被引入第一栅极金属10的静电放电会集中地流到具有相对低电阻的公共线CL。这样，当静电放电冲击集中在特定公共线CL中时，相应公共线CL会被损害，或者与公共线CL交叉的数据线DL被损害。图5显示了静电放电冲击集中在特定公共线CL中，从而导致数据线DL断裂的例子。根据本发明，第一栅极金属10与公共线CL之间的电连接路径相同，可防止静电放电冲击集中在特定公共线CL中，结果，可防止线的断裂或对薄膜晶体管TFT的损害。
同时，在该实施方式中，为了减小静电放电对信号线和薄膜晶体管的损害，液晶显示装置包括多个抗静电放电电路，将详细描述该构造。
参照图2和3，虚拟区域DA进一步包括虚拟数据线DDL、虚拟公共线DCL和多个抗静电放电电路。
虚拟数据线DDL设置在第一方向上，从而虚拟数据线DDL与第一条和最后一条数据线DL相邻。虚拟数据线DDL分支为三条虚拟数据线DDL，从而虚拟数据线与设置在三列中的第二虚拟像素DP2对应，并因而与第二虚拟像素DP2连接。
虚拟公共线DCL在第二方向上从第一栅极金属10分支，并与虚拟数据线DDL和数据线DL交叉。这种虚拟公共线DCL的数量至少为一条。
抗静电放电电路包括第一到第四抗静电放电电路24a到24d。
第一抗静电放电电路24a保护数据线DL免受静电放电冲击的损害。为此，第一抗静电放电电路24a设置并连接在数据线DL与虚拟公共线DCL之间。
第二抗静电放电电路24b保护虚拟公共线DCL免受静电放电冲击的损害。为此，第二抗静电放电电路24b设置并连接在虚拟公共线DCL与第一栅极金属10之间。
第三抗静电放电电路24c保护虚拟数据线DDL免受静电放电冲击的损害。为此，第三抗静电放电电路24c设置并连接在虚拟数据线DDL与虚拟公共线DCL之间。
第四抗静电放电电路24d保护栅极线GL免受静电放电冲击的损害。为此，第四抗静电放电电路24d设置并连接在栅极线GL与源极-漏极金属16之间。
特别是，该实施方式特征在于，虚拟数据线DDL设置在第二和第三抗静电放电电路24b和24c之间。当虚拟数据线DDL设置在第一栅极金属10与第二抗静电放电电路24b之间时，如图4中所示，由于静电放电从第一栅极金属10引入虚拟公共线DCL，虚拟数据线DDL很容易受到损害。根据本发明，通过将虚拟数据线DDL设置在第二和第三抗静电放电电路24b和24c之间，可防止虚拟数据线DDL的损害。
之后，将详细描述根据本发明一个实施方式的制造液晶显示装置的方法。
在根据本实施方式的液晶面板2的薄膜晶体管阵列基板中，如上所述，多条栅极线GL、多条公共线CL和第一到第三栅极金属10，12和14由相同的材料形成在同一层中。此外，数据线DL和源极-漏极金属16由相同的材料形成在同一层中，像素电极和第一到第三连接图案18，20和22由相同的材料形成在同一层中。
就是说，根据该实施方式的第一到第三栅极金属10，12和14、源极-漏极金属16和第一到第三连接图案18，20和22与像素区域中设置的薄膜晶体管同时形成，因而不需要用于形成这些元件的单独掩模工艺。之后，为了便于描述，提供了制造像素区域中包含的薄膜晶体管TFT的工艺。图6是显示像素区域中包含的薄膜晶体管TFT的示意性剖面图，并且是沿图2中所示的TFT的线X-Y的剖面图。下面将参照图6描述制造液晶显示装置的方法。
首先，使用金属在基板50上形成栅极金属层，然后将栅极金属层构图，以形成多个栅极图案。栅极图案包括多条栅极线GL和对应于像素区域从栅极线GL突出的栅极电极26。栅极图案进一步包括第一到第三栅极金属10，12，14、公共线CL和虚拟公共线DCL。
接着，使用诸如氮化硅（SiNx）或氧化硅（SiO2）的无机绝缘材料在包含栅极图案的基板50上形成栅极绝缘膜60。
此外，在栅极绝缘膜60上层叠包含纯非晶硅的半导体层28和包含掺杂非晶硅的欧姆接触层34。此时，半导体层28和欧姆接触层34在与栅极电极26重叠的区域中形成为岛状。
接着，使用从导电金属组选出的一种材料在包含半导体层28和欧姆接触层34的基板50上形成源极-漏极金属层，然后将源极-漏极金属层构图，以形成多个源极-漏极图案。源极-漏极图案包括多条数据线DL、对应于像素区域与多条数据线连接的源极电极30、以及与源极电极30隔开的漏极电极32，从而栅极电极26设置在漏极电极32与源极电极30之间。源极-漏极图案进一步包括源极-漏极金属16和虚拟数据线DDL。
接着，去除暴露在源极电极和漏极电极30和32之间的欧姆接触层34，以暴露出半导体层28。
接着，使用从氮化硅（SiNx）或氧化硅（SiO2）组成的组选出的无机绝缘材料或者从苯并环丁烯（BCB）和压克力树脂选出的有机绝缘材料，在包含源极-漏极图案的基板50上形成保护膜70。
选择性地去除保护膜70和栅极绝缘膜60，以形成暴露漏极电极32的像素接触孔以及前述第一到第六接触孔H1到H6。
接着，在所得结构上沉积从氧化铟锡（ITO）和氧化铟锌（IZO）组成的组选出的透明导电金属，并将透明导电金属构图，以形成多个透明图案。透明图案包括覆盖像素接触孔的像素电极36和与像素电极36形成电场的公共电极（未示出）。透明图案进一步包括前述的第一到第三连接图案18，20和22。
同时，前述的第一到第四抗静电放电电路24a到24d包括多个薄膜晶体管。这些薄膜晶体管也与像素区域中设置的薄膜晶体管同时形成。
这样，在该实施方式中，第一到第三栅极金属10，12和14、源极-漏极金属16和第一到第三连接图案18，20和22与像素区域中设置的薄膜晶体管同时形成，因而不需要用于形成这些元件的单独掩模工艺。
同时，根据图2和3中所示的构造，该实施方式可减小在薄膜晶体管阵列基板的制造过程中产生的静电放电导致的产品缺陷，因而提高了产率。具体来说，在制造薄膜晶体管的工艺中，通过化学气相沉积（CVD）进行无机绝缘材料或纯非晶硅的沉积，并使用干蚀刻构图各个金属层。在CVD或干蚀刻过程中，会产生大量静电放电。如上所述，静电放电会高度集中在公共线CL之中的特定线中。特别是，在选择性去除沉积的保护膜70的蚀刻工艺或者形成透明图案的工艺过程中，因为是在形成栅极图案之后进行这些工艺，静电放电冲击很容易集中在特定公共线CL中。根据本发明，根据图2和3中所示的构造，可减小在诸如CVD或干蚀刻的制造工艺过程中产生的静电放电导致的产品缺陷。
从前面描述显而易见，本发明可减小将公共电压提供到多条公共线的路径之间的电阻偏差，因而可防止由于高压静电放电集中地提供到特定公共线而导致的线的断裂或对薄膜晶体管的损害。此外，本发明改变了虚拟数据线的设计，因而减小了对虚拟数据线的静电放电冲击，并防止线的断裂或对薄膜晶体管的损害。
本发明提高了在产品驱动过程中的产品可靠性并减小了由于在制造薄膜晶体管过程中产生的大量静电放电而导致的产品缺陷，因而有利地提高了产品产率并降低了制造成本。
在不脱离本发明的精神或范围的情况下，在本发明中可进行各种修改和变化，这对于本领域技术人员来说是显而易见的。因而，本发明意在覆盖落入所附权利要求范围及其等价范围内的本发明的修改和变化。
Claims (15)
1.一种液晶显示装置，包括：
通过多条栅极线与多条数据线之间的交叉界定的多个像素；
沿所述像素的周边设置的多个虚拟像素；
与所述栅极线平行设置的多条公共线，所述公共线与所述像素和所述虚拟像素连接；
接收外部公共电压的第一栅极金属；
从所述公共线延伸到一侧的多个第二栅极金属，所述第二栅极金属具有焊盘形状；
在与所述数据线平行的方向上设置在所述第二栅极金属一侧的源极-漏极金属；
将所述第一栅极金属与所述源极-漏极金属电连接的第一连接图案；和
将所述源极-漏极金属与所述第二栅极金属电连接的第二连接图案。
2.根据权利要求1所述的液晶显示装置，进一步包括：
从所述公共线延伸到另一侧的多个第三栅极金属，所述第三栅极金属具有焊盘形状；和
将所述第一栅极金属与所述第三栅极金属电连接的第三连接图案。
3.根据权利要求2所述的液晶显示装置，其中所述第一到第三栅极金属以及所述公共线与所述栅极线由相同的材料形成在同一层中。
4.根据权利要求2所述的液晶显示装置，其中所述源极-漏极金属与所述数据线由相同的材料形成在同一层中。
5.根据权利要求2所述的液晶显示装置，其中所述第一到第三连接图案与所述像素中设置的像素电极由相同的材料形成在同一层中。
6.根据权利要求1所述的液晶显示装置，进一步包括：
与所述数据线平行形成的虚拟数据线，从而所述虚拟数据线与第一条和最后一条数据线相邻；
在与所述栅极线平行的方向上从所述第一栅极金属分支的虚拟公共线，所述虚拟公共线与所述数据线和所述虚拟数据线交叉；
设置和连接在所述数据线与所述虚拟公共线之间的第一抗静电放电电路；
设置和连接在所述虚拟公共线与所述第一栅极金属之间的第二抗静电放电电路；和
设置和连接在所述虚拟数据线与所述虚拟公共线之间的第三抗静电放电电路，
其中所述虚拟数据线设置在所述第二和第三抗静电放电电路之间。
7.根据权利要求6所述的液晶显示装置，进一步包括：
设置和连接在所述栅极线与所述源极-漏极金属之间的第四抗静电放电电路。
8.一种制造液晶显示装置的方法，包括：
在基板上形成彼此交叉的多条栅极线和多条数据线，以界定多个像素区域；
在所述像素区域中形成多个像素，每个像素都包括薄膜晶体管和像素电极；
沿所述像素的周边形成多个虚拟像素；
形成多条公共线和多个第二栅极金属，所述公共线与所述栅极线平行设置并与所述像素和所述虚拟像素连接，所述第二栅极金属从所述公共线延伸到一侧并具有焊盘形状；
形成与焊盘单元电连接的、接收外部公共电压的第一栅极金属；
在所述第二栅极金属一侧形成设置在与所述数据线平行的方向上的源极-漏极金属；
形成第一连接图案和第二连接图案，所述第一连接图案将所述第一栅极金属与所述源极-漏极金属电连接，所述第二连接图案将所述源极-漏极金属与所述第二栅极金属电连接。
9.根据权利要求8所述的方法，进一步包括：
形成多个第三栅极金属，所述第三栅极金属从所述公共线延伸到另一侧并具有焊盘形状；和
形成第三连接图案，所述第三连接图案将所述第一栅极金属与所述第三栅极金属电连接。
10.根据权利要求8所述的方法，其中所述第一到第三栅极金属以及所述公共线与所述栅极线由相同的材料形成在同一层中。
11.根据权利要求9所述的方法，其中所述源极-漏极金属与所述数据线由相同的材料形成在同一层中。
12.根据权利要求9所述的方法，其中所述第一到第三连接图案与所述像素电极由相同的材料形成在同一层中。
13.根据权利要求8所述的方法，进一步包括：
形成与所述数据线平行的虚拟数据线，从而所述虚拟数据线与第一条和最后一条数据线相邻；
形成虚拟公共线，从而所述虚拟公共线在与所述栅极线平行的方向上从所述第一栅极金属分支并与所述数据线和所述虚拟数据线交叉；
形成第一抗静电放电电路，从而所述第一抗静电放电电路设置和连接在所述数据线与所述虚拟公共线之间；
形成第二抗静电放电电路，从而所述第二抗静电放电电路设置和连接在所述虚拟公共线与所述第一栅极金属之间；和
形成第三抗静电放电电路，从而所述第三抗静电放电电路设置和连接在所述虚拟数据线与所述虚拟公共线之间，
其中所述虚拟数据线设置在所述第二和第三抗静电放电电路之间。
14.根据权利要求13所述的方法，进一步包括：
形成第四抗静电放电电路，从而所述第四抗静电放电电路设置和连接在所述栅极线与所述源极-漏极金属之间。
15.根据权利要求14所述的方法，其中所述第一到第四抗静电放电电路与所述像素区域中设置的所述薄膜晶体管同时形成。
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| Date | Code | Title | Description |
|---|---|---|---|
| C06 | Publication | ||
| PB01 | Publication | ||
| C10 | Entry into substantive examination | ||
| SE01 | Entry into force of request for substantive examination | ||
| C14 | Grant of patent or utility model | ||
| GR01 | Patent grant |