CN101876847A - 微控制器中的功率降低 - Google Patents
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Abstract
本发明涉及微控制器中的功率降低。所揭示的实施方案通过响应于内部或外部触发事件而针对一个或一个以上***设备模块重新启动微控制器中的时钟来实现所述微控制器中的功率降低,因此允许所述一个或一个以上***设备模块对事件做出响应同时以低功率睡眠模式操作。在一些实施方案中,微控制器中的一个或一个以上***设备模块将时钟请求信号提供到所述微控制器中的时钟产生器。响应于所述时钟请求信号,所述时钟产生器重新启动一个或一个以上振荡器源。所述时钟产生器仅针对所述一个或一个以上请求***设备模块恢复时钟产生,从而使所述微控制器中的功率消耗保持为最小值且不干扰所述微控制器中的其它模块。
Description
技术领域
此标的物一般来说涉及微控制器中的功率消耗,且更特定来说涉及用于以低功率操作模式实施时钟控制的构件及方法。
背景技术
低功率消耗对微控制器***来说是越来越重要的参数。微控制器***中的有效功率消耗通常由电路中的切换活动来支配且与施加到数字逻辑的时钟频率成正比。模拟模块还贡献大致固定的电流消耗,此可在低频率下或在低功率模式中占支配地位。微控制器***中的经时钟计时的***设备模块通常在超低功率、未经时钟计时的睡眠模式中不可用,从而迫使应用依赖于较高功率经时钟计时的模式。
用于在微控制器中节省功率的常规功率降低解决方案需要通常通过在所述微控制器中实施一种或一种以上睡眠模式来关断去往中央处理单元(CPU)或***设备模块的时钟。可扩展此解决方案直去往已关断所有时钟及模拟模块,且仅保持泄漏电流,泄漏电流通常比有效电流小几个数量级。此常规方法的缺点是降低了装置的功能性,因为最***设备经设计以在时钟运行的情况下操作。
发明内容
所揭示的实施方案通过响应于内部或外部触发事件而针对一个或一个以上***设备模块重新启动微控制器中的时钟来实现所述微控制器中的功率降低,因此允许所述一个或一个以上***设备模块对事件做出响应同时以低功率睡眠模式操作。在一些实施方案中,微控制器中的一个或一个以上***设备模块将时钟请求信号提供到所述微控制器中的时钟产生器。响应于所述时钟请求信号,所述时钟产生器重新启动一个或一个以上振荡器源。所述时钟产生器仅针对所述一个或一个以上请求***设备模块恢复时钟产生,从而使所述微控制器中的功率消耗保持为最小值且不干扰所述微控制器中的其它模块。
所揭示的功率降低方案提供胜于常规功率降低技术的几个优点。所揭示的功率降低方案允许微控制器***中的***设备模块保持对超低功率睡眠模式做出响应,从而导致使用较小功率的应用。所揭示的功率降低方案可与大多数现有***设备模块一起使用。所揭示的功率降低方案具有低实施方案成本及复杂性。
附图说明
图1是以低功率操作模式实施时钟控制的实例性微控制器***的框图。
图2是图解说明图1的微控制器***中的异步逻辑的使用的概念性框图。
图3是针对低功率模数转换器(ADC)操作实施时钟控制的实例性微控制器***的框图。
图4是针对低功率I2C地址匹配检测实施时钟控制的实例性微控制器***的框图。
图5是用于功率降低的实例性时钟控制过程的流程图。
具体实施方式
***概观
图1是以低功率操作模式实施时钟控制的实例性微控制器***100的框图。在一些实施方案中,***100可包含振荡器源102、时钟产生器104、一个或一个以上***设备模块106(仅显示一个***设备模块)、事件处置器108、CPU 110、一个或一个以上超低功率模块112、实时计数器(RTC)114及一个或一个以上外部中断116。
时钟产生器104控制(例如,启用)振荡器源102,所述振荡器源产生用于CPU110的源时钟(例如,CLK_CPU)及用于一个或一个以上***设备模块106(此后也称为“***设备”)的源时钟(例如,CLK0)。振荡器源102可以是任何类型的振荡器源,包含(但不限于)高速晶体振荡器、内部阻—容式(RC)振荡器及锁相回路(PLL)。
用于CPU 110的源时钟及用于***设备模块106的源时钟可以低功率睡眠模式停止,从而允许微控制器***100的极低功率消耗。虽然以低功率睡眠模式操作,但事件处置器108仍允许经时钟计时的***设备106在***设备时钟停止时对内部及/或外部事件做出响应。在一些实施方案中,事件处置器108包含可添加到每一***设备模块106且添加到时钟产生器104以促进触发事件及时钟请求的产生、发送及接收的电路。
在超低功率模式中,给定***设备模块106(例如,***设备模块0)可将WAKE信号发送到事件处置器108以指示***设备模块106请求时钟来运行应用及/或执行操作。响应于所述WAKE信号,事件处置器108将时钟请求信号(例如,CLK_REQ0)发送到时钟产生器104。响应于所述时钟请求信号,时钟产生器104控制或启用振荡器源102以将源时钟提供到时钟产生器104。所述源时钟由时钟产生器104用于产生用于请求***设备模块106(例如,***设备模块0)的具有想要频率的时钟。在一些实施方案中,所述时钟产生器包含用于处理由振荡器源102提供的源时钟的电路(例如,放大器、时钟划分电路)以为所述请求***设备模块提供具有想要特性(例如,想要频率)时钟。
***设备模块106可使用所述时钟来执行操作。在所述操作完成时,***设备模块106可使用中断信号(IRQ0)唤醒CPU 110。由于振荡器源102已经正在运行,因此可迅速地启动微控制器***100中的所有时钟。
图2是图解说明图1的微控制器***100中的异步逻辑的使用的概念性框图。图2图解说明由***100用于降低功率消耗的时钟控制功能。所述时钟控制功能可使用多种配置及电路装置实施。在一些实施方案中,可借助振荡器源102、时钟产生器104、***设备模块106及事件处置器108来在概念上描述与功率降低相关的微控制器***100功能。可借助触发器118(例如,SR触发器)及OR门120来在概念上描述事件处置器108功能。可借助门122及门124来在概念上描述时钟产生器104功能。
在超低睡眠模式中,可由***设备106及事件处置器108接收内部或外部触发事件。所述触发事件需要***设备106执行操作。由于***设备106为经时钟计时的***设备,且微控制器***100处于睡眠模式中,因此重新启动振荡器源102及时钟产生器以产生用于***设备106的时钟。在常规***中,重新启动用于所有***设备模块及CPU的所有源时钟,即使仅单个***设备模块正请求时钟。此导致不必要的功率消耗。然而,对于***100来说,仅请求***设备106将接收时钟,从而导致降低的功率消耗。
在一些实施方案中,事件处置器108为异步逻辑块,所述异步逻辑块可连同用于***设备模块106的电路一起用硬件描述语言(例如,寄存器传送语言(RTL))来描述。事件处置器108记录事件何时发生。所述记录触发去往时钟产生器104的时钟请求信号(CLK_REQ),所述时钟请求信号指示***设备106(***设备0)需要其时钟正***作。在所示实例性配置中,事件信号连同由***设备106产生的OPERATION_STARTED信号一起被输入到OR门120中以指示***设备106正使用其时钟。因此,***设备106的触发事件或操作设定触发器118。触发器118的输出为用于***设备模块106的CLK_REQ0。CLK_REQ0连同来自振荡器源102的CLK一起被输入到AND门124中。在两个信号均被断言为高(例如,逻辑‘1’)时,将CLK0提供到***设备106。注意,图2中所示的异步逻辑块可扩展为任何数目个经时钟计时的***设备模块。
时钟产生器104经扩展而具有类似于事件处置器108的异步逻辑块,所述异步逻辑块确保重新启动当前所选的振荡器源102。时钟产生器104恢复时钟产生,但仅针对请求***设备106,从而使功率消耗操持为最小值,且不干扰***100中的其它模块。在所示实例性配置中,时钟产生器104中的OR门122从事件处置器108接收时钟请求信号并产生ENABLE信号作为响应。所述ENABLE信号由振荡器源102接收并致使振荡器源102重新启动且提供CLK。
在CLK0重新启动之后,***设备106可恢复操作。在此时间期间,可断言去往事件处置器108的一个或一个以上信号及/或使所述信号无效以指示CLK0正被使用。举例来说,可断言OPERATION_STARTED信号且可使OPERATION_DONE信号无效以指示***设备0已开始操作且正使用CLK0。在所述操作完成之后,***设备106可借助中断信号(IRQ)唤醒CPU 110,此可迅速地启动所有时钟,因为振荡器源102已经正在运行。另一选择为,如果所述操作的结果不产生中断,那么***设备106可断言其去往事件处置器108的OPERATION_DONE信号,此又使去往时钟产生器104的时钟请求CLK_REQ0无效。时钟产生器104接着移除去往***设备106的CLK0且停用振荡器源102,从而使***100返回到低功率睡眠模式,而一直不唤醒CPU 110。***100保持处于低功率睡眠模式中直到另一触发事件发生。
***100允许任何数目个***设备模块同时请求时钟。振荡器源102将在至少一个***设备模块正请求其时钟开始时活动。
实例性ADC应用
图3是针对低功率ADC操作实施时钟控制的实例性微控制器***300的框图。此实例中的***设备为ADC 308,其由来自由超低功率32KHz振荡器时钟计时的RTC314的事件触发。ADC 308监视芯片上温度传感器304,且经设定以在温度高于特定用户可编程阈值的情况下唤醒CPU 310。由于温度改变缓慢,因此RTC 314经设立以每秒产生若干触发事件(例如,若干WAKE信号)。在RTC 314及32KHz运行的情况下,低功率模式具有1μA的功率消耗。在此实例性应用中,振荡器源302、时钟产生器306及事件处置器312如参考图2中所描述地操作。
在此实例性应用中,ADC 308在操作(包含时钟产生器306及振荡器源302)时具有500μA的功率消耗及10μA的转换时间。在事件处置器312及时钟产生器306不为时钟控制提供异步逻辑的情况下,使ADC 308以响应睡眠模式操作,从而导致约501μA的功率消耗。在事件处置器312及时钟产生器306为时钟控制提供异步逻辑的情况下,ADC 308仅每秒操作10μA,从而导致1μA+500μA*10μs=1.005μA的平均功率消耗。因此,可忽略ADC 308的所添加功率消耗。
实例性I2C应用
图4是针对低功率I2C地址匹配检测实施时钟控制的实例性微控制器***400的框图。I2C(内置集成电路)是用于将低速***设备附接到母板、嵌入式***或蜂窝电话的多主控串行计算机总线。
在此实例性应用中,触发事件可以是I2C总线上的开始条件。所述开始条件领先于所述总线上的任一地址,从而允许I2C从动***设备406保持不经时钟计时直到开始条件发生。事件处置器410可经扩展而具有异步电路以将时钟驱动为低,同时等待***设备时钟CLK0开始。所述开始条件触发事件处置器410,所述事件处置器将时钟请求(CLK_REQ0)传递到时钟产生器404。一旦振荡器源402已重新启动便启用CLK0。I2C从动***设备406发信号通知需要时钟直到从所述总线接收到完成地址,且其可由开始条件检测器412检测所述地址是否匹配从动***设备406的地址。如果地址匹配,那么唤醒CPU 408,否则使时钟请求无效或移除时钟请求,且***400返回到低功率模式并等待下一开始条件。在此实例性应用中,振荡器源402、时钟产生器404及事件处置器412如参考图2中所描述地操作。
如由这些实例所示,所揭示的功率降低方案可允许任一***设备模块以低功率模式活动,而不显著增加低功率模式的功率消耗或使软件变复杂。此允许更多应用在无前述功率节省的情况下以低功率睡眠模式操作。因其设计简单,上文所描述的异步逻辑块可集成到现有***设备模块及时钟产生器中,而不使其设计变复杂或不需要改变设计方法。在大多数现有微控制器***中可以最小成本实施异步逻辑块,从而使得设计多用途且有价值。
用于功率降低的实例性时钟控制过程
图5是用于功率降低的实例性时钟控制过程500的流程图。在一些实施方案中,过程500在***设备模块的事件处置器记录与所述***设备模块相关联的内部或外部触发事件时开始(502)。响应于所述所记录的触发事件,由事件处置器使用(例如)异步逻辑块产生时钟请求信号(504)。响应于所述时钟请求信号,重新启动振荡器源(506)。使用所述经重新启动的时钟源(508)产生用于所述请求***设备模块的***设备时钟。
虽然此文档涵盖许多具体实施方案细节,但这些细节不应被视为对可主张的范畴的限制,而是视为对特定实施例可特有的特征的描述。在此说明书中在单独实施例的背景中描述的一些特征还可以组合形式实施于单个实施例中。相反地,在单个实施例的背景中描述的各种特征也可分开地或以任何适合的子组合形式实施于多个实施例中。此外,虽然上文可将特征描述为以一些组合起作用且甚至最初主张如此,但来自一所主张组合的一个或一个以上特征在一些情况下可从所述组合去除,且所述所主张组合可针对一子组合或一子组合的变型。
Claims (8)
1.一种由具有能够进行低功率操作的数个***设备模块的微控制器执行的方法,所述方法包括:
记录与***设备模块相关联的触发事件;
响应于所述触发事件,产生与所述***设备模块相关联的时钟请求信号;
响应于所述时钟请求信号,
重新启动振荡器源;及
使用所述经重新启动的振荡器源产生用于所述***设备模块的时钟。
2.如权利要求1所述的方法,其进一步包括:
将所述时钟施加到所述***设备以启用所述***设备来执行操作;
确定所述操作何时完成;及
响应于操作完成,使所述时钟请求信号无效。
3.一种微控制器***,其包括:
振荡器源,其可操作以用于产生源时钟;
时钟产生器,其耦合到所述振荡器源且可操作以用于基于所述源时钟产生***设备时钟,其中所述振荡器源响应于由所述时钟产生器提供的时钟请求信号而启动;及
***设备模块,其耦合到所述时钟产生器且可操作以用于接收所述***设备时钟,所述***设备模块包含用于检测触发事件且用于响应于所述触发事件产生所述时钟请求信号的电路。
4.如权利要求3所述的微控制器***,其进一步包括:
处理器,其耦合到所述***设备模块以用于在所述***设备模块完成操作时从所述***设备模块接收中断信号。
5.如权利要求3所述的微控制器***,其中所述用于检测触发事件的电路包含异步逻辑。
6.如权利要求3所述的微控制器***,其中所述用于检测触发事件的电路可操作以用于检测由所述经时钟计时的***设备模块执行的操作何时完成,且其中所述电路响应于所述检测使所述时钟请求信号无效。
7.如权利要求3所述的微控制器***,其中所述***设备模块为模数转换器。
8.如权利要求3所述的微控制器***,其中所述***设备模块执行总线地址匹配检测。
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