利用可显影填充材料的两次图形曝光方法
技术领域
本发明涉及一种半导体集成电路的制造方法,尤其涉及一种在集成电路衬底上利用可显影材料的两次图形曝光方法。
背景技术
随着芯片尺寸的缩小,传统的单次光刻成像技术已经不能满足半导体技术发展的需求,为了进一步发掘并利用现有生产设备的潜力、乃至实现更为细小的芯片线宽,两次图形曝光技术(Double Patterning)应运而生。
但是目前的两次图形曝光技术还存在较多的问题,如图1a-1d所示,在现有技术中,使用正性光刻胶曝光显影实现两次图形曝光技术的基本流程如下:
(1)待刻蚀衬底101上淀积一层硬掩模(Hard Mask,HM)102(例如二氧化硅,氮化硅,金属硅化物);
(2)第一抗反射层(Bottom Anti-Reflection Coating,BARC)103的涂覆及第一光刻胶(Photo Resist,PR)104的涂覆;
(3)进行第一次光刻,这时硅片的剖面结构如图1a所示;
(4)进行第一次刻蚀,首先刻蚀到非光刻胶保护区域的第一抗反射涂层103,随后利用第一光刻胶104作为刻蚀掩蔽层,完成硬掩模102刻蚀,该刻蚀停止于待刻蚀衬底101表面;
(5)剥离第一抗反射层103和第一光刻胶104,这时硅片的剖面结构如图1b所示;
(6)第二抗反射层105的涂覆,第二光刻胶106的涂覆;
(7)进行第二次光刻,这时硅片的剖面结构如图1c所示;
(8)进行第二次刻蚀,首先刻蚀掉覆盖在硬掩模102以及非光刻胶保护区域的第二抗反射涂层105,随后利用硬掩模102和第二光刻胶106共同作为刻蚀掩蔽层,刻蚀暴露的衬底101。
(9)剥离剩余的第二抗反射层105和第二光刻胶106,然后进行清洗,这时硅片的剖面结构如图1d所示;
(10)剥离剩余的硬掩模102。
在这个工艺过程中,存在如下缺点:由于硬掩模层与衬底材料的刻蚀选择比不高,因此其厚度较厚,引起第二抗反射涂层的涂覆厚度在图形密集区域和图形疏松区域差异较大,进而会影响后续光刻、刻蚀工艺,导致难于进行精确、可重复性的工艺生产。而且,由于需要涂覆一层硬掩模层,以在进行第二次刻蚀时与第二光刻胶一同作为刻蚀掩蔽层,形成芯片线宽,由此提高了工艺的复杂性;而且所述硬掩模层的加入,对最终制成的芯片的导电性能也会造成一定的影响。
发明内容
本发明要解决的技术问题是提供一种利用可显影填充材料的两次图形曝光方法,可避免产生第二次抗反射涂层的涂覆厚度在图形密集区域和图形疏松区域差异较大的问题,从而提高第二次光刻和刻蚀工艺的稳定性,提高两次图形曝光技术的表现;而且可不用涂覆硬掩模层,从而降低了实现两次图形曝光工艺的复杂性,并且提高了芯片的导电性能。
为解决上述技术问题,本发明提供了一种利用可显影填充材料的两次图形曝光方法,包括以下步骤:
(1)在待刻蚀衬底(201)上涂覆一层第一抗反射层(202),然后涂覆第一光刻胶(203);
(2)进行第一次光刻;
(3)进行第一次刻蚀;
(4)剥离第一光刻胶(203)和剩余的第一抗反射层(202);
(5)用湿法将可显影的填充材料(204)涂覆在硅片表面,填充待刻蚀衬底(201)之间的间隙;
(6)显影经过填充材料(204)涂覆后的硅片,去除待刻蚀衬底(201)表面上方的填充材料(204),实现硅片表面的平整表现;
(7)涂覆第二抗反射层(205),然后涂覆第二光刻胶(206);
(8)进行第二次光刻;
(9)进行第二次刻蚀;
(10)剥离第二光刻胶(206)和剩余的第二抗反射层(205)及填充材料(204),然后进行清洗。
本发明由于采用了上述技术方案,具有这样的有益效果,即通过完成第一次光刻、刻蚀,并剥离了剩余的第一抗反射层、第一光刻胶之后,采用湿法可显影填充性材料涂覆在硅片表面,以填充待刻蚀衬底之间的间隙,然后通过对所述填充材料进行显影的方式移除待刻蚀衬底表面上的所述填充性材料,从而形成平整的界面,然后再进行第二次光刻、刻蚀等工艺,从而消除了传统两次图形曝光技术工艺中由于表面形貌台阶的高度变化而引入的第二次光刻、刻蚀工艺的不稳定性,提高了两次图形曝光技术的表现。而且,由于本发明所述方法不需要在衬底上覆盖一层硬掩模层,因此降低了两次图形曝光工艺的复杂性,并且从一定程度上提高了所制成芯片的导电性能。
附图说明
下面结合附图与具体实施方式对本发明作进一步详细的说明:
图1a至图1d为利用现有技术实现两次图形曝光的硅片结构剖面图;
图2为根据本发明利用可显影填充材料实现两次图形曝光的流程示意图;
图3a至图3f为根据本发明利用可显影填充材料实现两次图形曝光的硅片结构剖面图。
具体实施方式
如图2所示,为本发明所述利用可显影填充材料实现两次图形曝光的流程示意图,其具体过程如下:
在待刻蚀衬底201上,涂覆第一抗放射层(Bottom Anti-ReflectionCoating)202,涂覆厚度为10纳米至10000纳米,烘烤温度为50℃至250℃、烘烤时间为10秒至1000秒。所述第一抗反射层可采用如下材料:非晶硅、氮化硅、氧氮化硅、氧化硅、掺杂氧化硅、氧碳化硅、氮化物、氮化硅、钛、氧化钛等。然后,在涂覆了第一抗反射层202的硅片上涂覆第一光刻胶(Photo Resist,PR)203,涂覆厚度为10纳米至10000纳米,烘烤温度为50℃至250℃、烘烤时间为10秒至1000秒。
对硅片进行第一次光刻,从而形成如图3a所示的剖面结构。随后,对所述硅片进行第一次刻蚀,利用第一光刻胶203作为刻蚀掩蔽层,刻蚀掉位于非第一光刻胶203保护区域内的第一抗反射层202和待刻蚀衬底201。当所述第一次刻蚀完成后,剥离第一光刻胶203和剩余的第一抗反射层202,从而形成如图3b所示的硅片剖面结构。
用湿法将可显影的填充材料204涂覆在硅片表面,以填充待刻衬底201之间的间隙。在本发明中,所述填充材料204可由酮类,醚类,烷烃类等有机溶剂、抗反射吸收材料、可与标准四甲基氢氧化铵显影液反应的有机酸基团树脂以及含氧、氟元素的有机基团树脂构成,交联树脂构成,其分子量在1000到50000之间,折射率在1.0到3.0之间,消光系数在0.1到3.0之间。为了确保填充材料204能够有效地填充待刻蚀衬底201之间的间隙,可根据实际情况进行1~3次填充材料204的涂覆,每进行完一次填充材料204的涂覆后,都应对涂覆表现进行检测,以检查其是否满足填充待刻蚀衬底201之间的间隙的要求,如果未满足要求,则可第2~3次涂覆,直至满足要求为止。在一个实施例中,每次所涂覆的填充材料204的涂布剂量均为0.5ml到5ml,烘烤温度均为60℃到250℃,烘烤时间均为10秒到120秒。完成填充材料涂覆后的硅片剖面结构可参见图3c。
显影经过填充材料204涂覆后的硅片,以去除待刻蚀衬底201表面上方的填充材料204,实现硅片表面的平整表现。显影过程中,所用显影液的温度为10℃到30℃,显影浸泡时间为10秒到120秒,随后再使用去离子水冲洗硅片表面,以移除显影液,冲洗时间为10到120秒。为了能够将待刻蚀衬底201表面上方的填充材料204去除干净,实现平整的硅片表面,可根据实际情况进行1~3次显影,每进行完一次显影后,都应对显影表现进行检测,如果发现衬底201表面上方还残留有填充材料,则可进行第2~3次显影,直至衬底201表面上方的填充材料全部去除,硅片表面较为平整。在一个实施例中,每次显影的显影液用量均为1ml到100ml,温度均为10℃到30℃,显影浸泡时间均为10秒到120秒。经过显影后的硅片剖面结构可参考图3d。
在经过显影后的硅片表面涂覆第二抗反射层205,涂覆厚度为10纳米至10000纳米,烘烤温度为50℃至250℃、烘烤时间为10秒至1000秒。其中,所述第二抗反射层205可采用如下材料:非晶硅、氮化硅、氧氮化硅、氧化硅、掺杂氧化硅、氧碳化硅、氮化物、氮化硅、钛、氧化钛等。然后,在涂覆了第二抗反射层205的硅片表面再涂覆第二光刻胶206,涂敷厚度为10纳米至10000纳米、烘烤温度为50℃至250℃、烘烤时间为10秒至1000秒。
对硅片进行第二次光刻,形成如图3e所示的剖面结构。随后,对所述硅片进行第二次刻蚀,利用第二光刻胶206作为刻蚀掩蔽层,刻蚀掉位于非第二光刻胶206保护区域内的第二抗反射层205和待刻蚀衬底201。当所述第二次刻蚀完成之后,剥离第二光刻胶206及剩余的第二抗反射层205和湿法可显影填充材料204,并对硅片进行清洗,从而完成了整个两次图形曝光过程,最终所形成的硅片的剖面结构如图3f所示,从图中可以看出最后所形成的芯片具有较小的线宽。
综上所述,本发明所述方法,不仅通过利用可显影填充材料,避免了产生第二次抗反射涂层的涂覆厚度在图形密集区域和图形疏松区域差异较大的问题,因此提高了两次图形曝光技术中第二次光刻、刻蚀工艺的稳定性;而且,不需要涂覆硬掩模层来作为第二次刻蚀时的刻蚀掩蔽层,因此降低的工艺实现的复杂度,并且由于没有硬掩模层的参与,使得最终制成芯片的导电性能从一定程度得到了提高。