WO2010143403A1 - プラズマディスプレイパネルの駆動方法およびプラズマディスプレイ装置 - Google Patents

プラズマディスプレイパネルの駆動方法およびプラズマディスプレイ装置 Download PDF

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    • G09G3/2925Details of priming

Definitions

  • the present invention relates to an AC surface discharge type plasma display panel driving method and a plasma display apparatus.
  • a plasma display panel (hereinafter abbreviated as “panel”) includes a plurality of discharge cells each having a scan electrode, a sustain electrode, and a data electrode. Red, green, and blue light are generated by ultraviolet rays generated by gas discharge in the discharge cell. Color display is performed by exciting and emitting phosphors of each color.
  • a subfield method that is, a method in which a single field is formed using a plurality of subfields having an initialization period, an address period, and a sustain period, and gradation display is performed by combining subfields that emit light. Is common.
  • An initialization operation is performed during the initialization period of each subfield, a write operation is performed during the write period, and a maintenance operation is performed during the sustain period.
  • the initialization operation is an operation that generates initialization discharge and forms wall charges necessary for the subsequent address operation.
  • the initializing operation includes a forced initializing operation that generates an initializing discharge regardless of the operation of the immediately preceding subfield, and a selective initializing operation that generates an initializing discharge in a discharge cell that has performed an address discharge in the immediately preceding subfield.
  • the address operation is an operation in which an address discharge is selectively generated in the discharge cells in accordance with an image to be displayed to form wall charges
  • the sustain operation is to generate a sustain discharge by alternately applying a sustain pulse to the display electrode pair, This is an operation of causing the phosphor layer of the corresponding discharge cell to emit light.
  • the light emission of the phosphor layer due to the sustain discharge is light emission related to gradation display, and the other light emission is light emission not related to gradation display.
  • Patent Document 1 discloses a driving method in which the forced initialization operation is performed once per field and the forced initialization operation is performed using a slowly changing ramp waveform voltage.
  • Patent Document 2 the display electrode pair is divided into n, the number of times of forced initialization operation is set to once per n fields, light emission not related to gradation display is further reduced, black luminance is further reduced, and contrast is further increased.
  • An improved driving method is disclosed.
  • the forced initialization operation since the forced initialization operation is performed, light emission not related to gradation display occurs. This means that even a discharge cell displaying black emits light, and thus there is a limit to improving the contrast.
  • the forced initialization operation has a function of accumulating wall charges necessary for generating an address discharge in the subsequent address period, and in addition, a priming for surely generating an address discharge by shortening the discharge delay time. It also has the function of generating. Therefore, if the forced initializing operation is simply omitted, there is a problem that the address discharge does not occur, or the address delay becomes too long for the address discharge to become unstable, and normal image display cannot be performed.
  • the present invention provides a panel driving method and a plasma display apparatus that perform stable writing operation and improve contrast without using forced initialization operation.
  • the panel driving method includes a plurality of sub-fields having an address period, a sustain period, and an erase period to form one field, and a plurality of discharge cells having scan electrodes, sustain electrodes, and data electrodes.
  • a panel driving method for driving a panel wherein an erasing period is a sustaining period in which an erasing discharge is selectively generated only in a discharge cell that has generated an address discharge in the immediately preceding address period and applied to a scan electrode in a sustain period
  • the voltage obtained by subtracting the voltage applied to the data electrode from the low-voltage side voltage of the pulse is set as the first voltage
  • the voltage obtained by subtracting the voltage applied to the data electrode from the high-voltage side voltage of the sustain pulse applied to the scan electrode in the sustain period is set as the first voltage.
  • the voltage obtained by subtracting the low-voltage side voltage of the data pulse applied to the data electrode from the low-voltage side voltage of the scan pulse applied to the scan electrode during the address period is equal to or higher than the discharge start voltage using the data electrode as the anode and the scan electrode as the cathode, and the second voltage to the third voltage. Is less than the sum of the discharge start voltage with the data electrode as the anode and the scan electrode as the cathode and the discharge start voltage with the data electrode as the cathode and the scan electrode as the anode.
  • the panel driving method of the present invention it is desirable to apply a voltage not lower than the low voltage on the scanning pulse and not higher than the high voltage on the sustain pulse to the scan electrode.
  • the absolute value of the low voltage side voltage of the scan pulse is preferably larger than the absolute value of the high voltage side voltage of the sustain pulse.
  • the plasma display apparatus of the present invention uses a panel having a plurality of discharge cells each having a scan electrode, a sustain electrode, and a data electrode, and a plurality of subfields each having an address period, a sustain period, and an erase period.
  • a driving circuit that generates a driving voltage waveform and applies the driving voltage waveform to each electrode of the panel, wherein the driving circuit is a discharge cell that has generated an address discharge in the immediately preceding address period in the erasing period
  • the panel is driven by selectively generating an erasing discharge alone, and the first voltage is maintained by subtracting the voltage applied to the data electrode from the low-voltage side voltage of the sustain pulse applied to the scan electrode during the sustain period.
  • the voltage obtained by subtracting the voltage applied to the data electrode from the high-voltage side voltage of the sustain pulse applied to the scan electrode during the period is the second voltage.
  • the voltage obtained by subtracting the low-voltage side voltage of the data pulse applied to the data electrode from the low-voltage side voltage of the scan pulse applied to the scan electrode in the address period is set as the third voltage
  • the voltage obtained by subtracting the third voltage from the second voltage has the data electrode as the anode and the scan electrode as the cathode.
  • the voltage is set so as not to exceed the sum of the discharge start voltage and the discharge start voltage using the data electrode as a cathode and the scan electrode as an anode.
  • the panel driving method of the present invention is a panel driving method for driving a panel having a plurality of discharge cells each having a scan electrode, a sustain electrode, and a data electrode, and applies a scan pulse to the scan electrode and data.
  • An address period in which an address pulse is applied to the electrode to generate an address discharge a sustain period in which a sustain pulse corresponding to the luminance weight is alternately applied to the scan electrode and the sustain electrode to generate a sustain discharge, and the scan electrode and the sustain electrode
  • a single field is formed by using a plurality of subfields having an erasing period in which an erasing discharge is generated by applying a predetermined voltage to the erasing period, and the erasing period includes only discharge cells that have generated an address discharge in the immediately preceding address period.
  • An erasing discharge is selectively generated, and a plurality of scan electrodes arranged in a plurality of fields in the address period of the subfield having the smallest luminance weight are From the other scan electrode to the one scan electrode in the address period of the first field in which the scan pulse is sequentially applied from the one scan electrode to the other scan electrode and the subfield having the smallest luminance weight Both are provided with a second field to which the scan pulse is applied in order.
  • the plasma display device of the present invention also includes a panel having a plurality of discharge cells each having a scan electrode, a sustain electrode, and a data electrode, a scan pulse applied to the scan electrode, and an address pulse applied to the data electrode for address discharge.
  • a plasma display apparatus comprising: a driving circuit that forms a single field using a plurality of subfields having a generated erasing period; and that generates a driving voltage waveform and applies the driving voltage waveform to each electrode of the panel.
  • the erase discharge is selectively generated only in the discharge cells that have generated the address discharge in the immediately preceding address period, and the discharge is performed.
  • a first field that sequentially applies a scan pulse from one scan electrode to the other scan electrode of the plurality of scan electrodes arranged in the address period of the subfield with the smallest luminance weight.
  • a second field in which a scan pulse is sequentially applied from the other scan electrode of the plurality of scan electrodes arranged in the address period of the subfield with the smallest luminance weight to the one scan electrode.
  • FIG. 1 is an exploded perspective view of a panel used in the plasma display device in accordance with the first exemplary embodiment of the present invention.
  • FIG. 2 is an electrode array diagram of a panel used in the plasma display device.
  • FIG. 3 is a waveform diagram of driving voltage applied to each electrode of the plasma display device.
  • FIG. 4 is a diagram for explaining the definitions of the first voltage, the second voltage, and the third voltage.
  • FIG. 5 is a diagram illustrating an example of a method for simply measuring the discharge start voltage.
  • FIG. 6 is a circuit block diagram of the plasma display device in accordance with the first exemplary embodiment of the present invention.
  • FIG. 7 is a circuit diagram of a scan electrode driving circuit of the plasma display device.
  • FIG. 1 is an exploded perspective view of a panel used in the plasma display device in accordance with the first exemplary embodiment of the present invention.
  • FIG. 2 is an electrode array diagram of a panel used in the plasma display device.
  • FIG. 3 is a waveform diagram of driving voltage
  • FIG. 8 is a circuit diagram of a sustain electrode driving circuit of the plasma display device.
  • FIG. 9 is a circuit diagram of a data electrode driving circuit of the plasma display device.
  • FIG. 10 is a drive voltage waveform diagram in the first field applied to each electrode of the plasma display device in accordance with the second exemplary embodiment of the present invention.
  • FIG. 11 is a drive voltage waveform diagram in the second field applied to each electrode of the plasma display device.
  • FIG. 1 is an exploded perspective view of panel 10 used in the plasma display device in accordance with the first exemplary embodiment of the present invention.
  • a plurality of display electrode pairs 24 each including a scanning electrode 22 and a sustaining electrode 23 are formed on a glass front substrate 21.
  • a dielectric layer 25 is formed so as to cover the display electrode pair 24, and a protective layer 26 is formed on the dielectric layer 25.
  • the protective layer 26 is formed using magnesium oxide, which is a material having high electron emission performance, in order to easily generate discharge.
  • a plurality of data electrodes 32 are formed on the back substrate 31, a dielectric layer 33 is formed so as to cover the data electrodes 32, and a grid-like partition wall 34 is formed thereon.
  • a phosphor layer 35 that emits red, green, and blue light is provided on the side surface of the partition wall 34 and on the dielectric layer 33.
  • (Y, Gd) BO 3 : Eu is used as the red phosphor
  • Zn 2 SiO 4 : Mn is used as the green phosphor
  • BaMgAl 10 O 17 Eu is used as the blue phosphor.
  • a phosphor as a main component.
  • the front substrate 21 and the rear substrate 31 are arranged to face each other so that the display electrode pair 24 and the data electrode 32 intersect each other with a minute discharge space interposed therebetween, and the outer periphery thereof is sealed with a sealing material such as glass frit.
  • a sealing material such as glass frit.
  • a mixed gas of neon and xenon is sealed as a discharge gas.
  • the discharge space is partitioned into a plurality of sections by partition walls 34, and discharge cells are formed at the intersections between the display electrode pairs 24 and the data electrodes 32. These discharge cells discharge and emit light to display an image.
  • the structure of the panel 10 is not limited to the above-described structure, and may be, for example, provided with a stripe-shaped partition wall.
  • FIG. 2 is an electrode array diagram of panel 10 used in the plasma display device in accordance with the first exemplary embodiment of the present invention.
  • the panel 10 includes n scan electrodes SC1 to SCn (scan electrodes 22 in FIG. 1) and n sustain electrodes SU1 to SUn (sustain electrodes 23 in FIG. 1) that are long in the row direction.
  • M data electrodes D1 to Dm data electrodes 32 in FIG. 1) that are long in the column direction are arranged.
  • M ⁇ n are formed.
  • the plasma display apparatus displays an image by subfield method, that is, by dividing one field into a plurality of subfields and controlling light emission / non-light emission of each discharge cell for each subfield.
  • each subfield has an address period, a sustain period, and an erase period.
  • the forced initializing operation for forcibly generating the initializing discharge is not performed regardless of the presence or absence of the previous discharge.
  • an address operation is performed in which address discharge is selectively generated in the discharge cells to emit light to form wall charges.
  • a sustain operation is performed in which a sustain pulse of the number corresponding to the luminance weight determined in advance for each subfield is alternately applied to the display electrode pair to generate a sustain discharge in the discharge cell that generated the address discharge. I do.
  • the maintenance period may be omitted in order to keep the emission luminance low.
  • an erasing discharge is selectively generated only in the discharge cells that generated the address discharge in the immediately preceding address period, and the history of wall charges formed by the address discharge or the subsequent sustain discharge is erased, and the subsequent address discharge is performed. An erasing operation is performed to form necessary wall charges on each electrode.
  • subfield configuration for example, one field is divided into 10 subfields (SF1, SF2,..., SF10), and each subfield is (1, 2, 3, 6, 11, 18, 30). , 44, 60, 80).
  • the present invention is not limited to the subfield configuration such as the number of subfields and the luminance weight.
  • FIG. 3 is a waveform diagram of driving voltage applied to each electrode of the plasma display device in accordance with the first exemplary embodiment of the present invention.
  • voltage 0 (V) is applied to data electrode D1 through data electrode Dm
  • voltage Ve is applied to sustain electrode SU1 through sustain electrode SUn
  • voltage Vc is applied to scan electrode SC1 through scan electrode SCn.
  • a scan pulse of voltage Va is applied to scan electrode SC1 in the first row
  • an address pulse of voltage Vd is applied to data electrode Dk corresponding to the discharge cell to emit light.
  • the voltage difference at the intersection between the data electrode Dk and the scan electrode SC1 is because the positive wall voltage on the data electrode Dk is added to the difference (Vd ⁇ Va) of the externally applied voltage and exceeds the discharge start voltage VFds.
  • Discharge occurs between data electrode Dk and scan electrode SC1.
  • the discharge generated between data electrode Dk and scan electrode SC1 extends between scan electrode SC1 and sustain electrode SU1, and an address discharge occurs.
  • a positive wall voltage is accumulated on scan electrode SC1, a negative wall voltage is accumulated on sustain electrode SU1, and a negative wall voltage is also accumulated on data electrode Dk.
  • the wall voltage on the electrode represents a voltage generated by wall charges accumulated on the dielectric layer covering the electrode, the protective layer, the phosphor layer, and the like.
  • a scan pulse is applied to the scan electrode SC2 in the second row, and an address pulse is applied to the data electrode Dk corresponding to the discharge cell to emit light.
  • an address discharge occurs between data electrode Dk and scan electrode SC2 and between sustain electrode SU2 and scan electrode SC2, a positive wall voltage is accumulated on scan electrode SC2, and a negative wall voltage is applied on sustain electrode SU2. And a negative wall voltage is also accumulated on the data electrode Dk.
  • an address operation is performed in which an address discharge is caused in the discharge cell to be lit in the second row and wall voltage is accumulated on each electrode.
  • the voltage at the intersection between the data electrode Dh and the scan electrode SC2 to which no address pulse is applied does not exceed the discharge start voltage VFds, no address discharge occurs.
  • the first voltage V1, the second voltage V2, and the third voltage V3 are defined as shown in FIG.
  • a voltage obtained by subtracting the voltage applied to the data electrode Dj from the low-voltage side voltage of the sustain pulse applied to the scan electrode SCi in the sustain period to be described later is defined as a first voltage V1, and the high voltage of the sustain pulse applied to the scan electrode SCi in the sustain period.
  • the voltage obtained by subtracting the voltage applied to the data electrode Dj from the side voltage is the second voltage V2, and the low voltage side voltage of the data pulse applied to the data electrode Dj from the low voltage side voltage of the scan pulse applied to the scan electrode SCi in the address period
  • the voltage obtained by subtracting is set as the third voltage V3.
  • the discharge start voltage with the data electrode Dj as the anode and the scan electrode SCi as the cathode is the discharge start voltage VFds
  • the discharge start voltage with the data electrode Dj as the cathode and the scan electrode SCi as the anode is the discharge start voltage VFsd.
  • the discharge with the data electrode Dj as the anode and the scan electrode SCi as the cathode is a discharge in which the electric field in the discharge cell when the discharge occurs is a high potential side on the data electrode Dj side and a low potential side on the scan electrode SCi side. It is.
  • the discharge with the data electrode Dj as the cathode and the scan electrode SCi as the anode is a discharge in which the electric field in the discharge cell when the discharge occurs is a low potential side on the data electrode Dj side and a high potential side on the scan electrode SCi side. is there. Since the protective layer 26 of magnesium oxide having high electron emission performance is formed on the scan electrode SCi side, the discharge start voltage VFds is lower than the discharge start voltage VFsd.
  • the voltage Va of the scan pulse applied to the scan electrode SCi is set so as to satisfy the following two conditions (condition 1) and (condition 2).
  • a voltage obtained by subtracting the third voltage V3 from the second voltage V2 is a discharge start voltage VFds and a data electrode Dj with the data electrode Dj as an anode and the scan electrode SCi as a cathode.
  • a negative wall voltage is accumulated on scan electrode SCi, and a positive wall voltage is accumulated on sustain electrode SUi. Further, a positive wall voltage is accumulated on the data electrode Dk.
  • the sustain discharge does not occur in the discharge cells in which the address discharge has not occurred, and the wall voltage at the end of the initialization operation is maintained.
  • V voltage 0
  • a sustain pulse of voltage Vs is applied to sustain electrode SU1 through sustain electrode SUn.
  • the sustain discharge occurs again in the discharge cell in which the sustain discharge has occurred, and the phosphor layer 35 emits light.
  • a negative wall voltage is accumulated on sustain electrode SUi
  • a positive wall voltage is accumulated on scan electrode SCi.
  • sustain pulses of the number corresponding to the luminance weight are alternately applied to scan electrode SC1 through scan electrode SCn and sustain electrode SU1 through sustain electrode SUn, and the sustain discharge is continued in the discharge cells that have caused the address discharge. generate.
  • voltage 0 (V) is applied to sustain electrode SU1 through sustain electrode SUn, and an upward ramp waveform voltage that gradually rises to voltage Vr is applied to scan electrode SC1 through scan electrode SCn.
  • the voltage Vr is set to the same voltage as the voltage Vs. Then, a weak erasing discharge is generated between scan electrode SCi and sustain electrode SUi in the discharge cell in which the sustain discharge has been performed (the discharge cell in which the address discharge has been performed when the sustain period is omitted). Then, the wall voltage on scan electrode SCi and sustain electrode SUi is weakened.
  • voltage Ve is applied to sustain electrode SU1 through sustain electrode SUn, and a downward ramp waveform voltage that gradually decreases from voltage 0 (V) toward voltage Vi is applied to scan electrode SC1 through scan electrode SCn.
  • the voltage Vi is set to be equal to or slightly higher than the voltage Va of the scanning pulse.
  • the voltage Vi is ⁇ 260 (V), the voltage Vc is ⁇ 145 (V), the voltage Va is ⁇ 280 (V), the voltage Vs is 200 (V), the voltage Vr is 200 (V), The voltage Ve is 20 (V), and the voltage Vd is 60 (V).
  • these voltage values are not limited to the values described above, and are desirably set optimally based on the discharge characteristics of the panel and the specifications of the plasma display device.
  • the discharge start voltage VFds and the discharge start voltage VFsd of the panel 10 used in the present embodiment are measured by a method described later, and their values are as follows.
  • the discharge start voltage varies depending on the phosphor, and the discharge start voltage VFds between the “data electrode and the scan electrode” for the discharge cell coated with the red phosphor is 200 ⁇ 10 (V), and the discharge start voltage VFsd is 320 ⁇ 10 ( V), the discharge start voltage VFds between the “data electrode and the scan electrode” for the discharge cell coated with the green phosphor is 220 ⁇ 10 (V), the discharge start voltage VFsd is 350 ⁇ 10 (V), and the blue fluorescence
  • the discharge start voltage VFds between the “data electrode and the scan electrode” for the discharge cell coated with the body was 200 ⁇ 10 (V), and the discharge start voltage VFsd was 330 ⁇ 10 (V).
  • the discharge start voltage VFss between the “scan electrode and sustain electrode” is 250 ⁇ 10 (V
  • the voltage on the low voltage side of the sustain pulse is voltage 0 (V)
  • the voltage applied to the data electrode in the sustain period is voltage 0 (V)
  • the first voltage V1 is voltage 0 (V ).
  • the third voltage V3 is the voltage Va.
  • the second voltage V2 is the voltage Vs.
  • a voltage lower than the low voltage side voltage Va of the scan pulse is applied to the scan electrode by applying a voltage not lower than the low voltage side voltage Va of the scan pulse and not higher than the high voltage side voltage Vs of the sustain pulse.
  • a voltage exceeding the high voltage Vs of the sustain pulse is not applied. Therefore, a discharge cell that has not performed address discharge does not emit light.
  • of the low-voltage side voltage Va of the scan pulse is the absolute value of the high-voltage side voltage Vs of the sustain pulse. It becomes larger than the value
  • the forcibly initializing operation is performed by setting the drive voltage waveform applied to each electrode, in particular, the voltage Va of the scan pulse so as to satisfy (Condition 1) and (Condition 2). Even if it is not used, the write operation can be generated stably. The reason is considered as follows.
  • the wall voltage accumulated in this way will be described.
  • a large amount of charged particles are generated in the discharge cell that generates the sustain discharge, and when these particles diffuse, a small amount of charged particles are supplied to the space inside the discharge cell that displays black without causing the sustain discharge. It is thought that.
  • wall voltages are slowly accumulated so as to alleviate the potential difference between the electrodes by the voltages applied to scan electrode SCi, sustain electrode SUi, and data electrode Dj.
  • the voltage at which the wall voltage gradually approaches (finally settles) is defined as the neglected wall voltage
  • the neglected wall voltage when the sustain pulse is continuously applied alternately to the scan electrode SCi and the sustain electrode SUi is the high voltage of the sustain pulse.
  • the voltage is between the side voltage and the low voltage.
  • a drive voltage waveform other than the sustain pulse is also applied, it can be considered that the neglected wall voltage of each discharge cell is substantially close to the low voltage of the sustain pulse.
  • the neglected wall voltage is greatly affected by the charging characteristics of the phosphor applied inside the discharge cell.
  • the charging characteristics of the phosphor are +20 ( ⁇ C / g) for the red phosphor, ⁇ 30 ( ⁇ C / g) for the green phosphor, and +10 ( ⁇ C / g) for the blue phosphor, respectively. Since only the green phosphor is charged to a negative potential, the neglected wall voltage is lower than that of the red and blue phosphors.
  • the voltage inside the discharge cell during the address period will be described.
  • the wall voltage is gradually accumulated toward the low voltage of the sustain pulse or the neglected wall voltage higher than that.
  • the voltage Va of the scan pulse in the present embodiment is a voltage that satisfies (Condition 1). Therefore, a positive wall voltage sufficient to generate the address discharge is accumulated on the data electrode Dj, and the address discharge can be generated without performing any forced initialization operation.
  • the wall voltage of the discharge cell displaying black slowly approaches the left wall voltage, and when the voltage obtained by adding the wall voltage to the voltage between the “data electrode-scan electrode” approaches the discharge start voltage during the erasing period, the dark current is increased. The wall voltage on the data electrode Dj is lowered. And since the dark current flowing at this time plays a role of priming to assist the address discharge, it is considered that a stable address discharge can be generated without causing a large discharge delay even in a discharge cell displaying black. be able to.
  • the drive voltage waveform is set so as to satisfy (Condition 1) and (Condition 2) in all the discharge cells. Therefore, it is possible to display an image without light emission not related to gradation display by omitting the forced initialization operation while stably generating the writing operation.
  • the discharge start voltage VFsd, the discharge start voltage VFds, and the wall voltage are, for example, IEEE TRANSACTIONS ON ELECTRON DEVICES, VOL. ED-24, NO. 7, JULY, 1977 “Measurement of a Plasma in the AC Plasma Display panel Usage RF Capacitance and Microwave Techniques”. Or you may measure simply as follows. An example of a method for simply measuring the discharge start voltage will be described with reference to FIG.
  • the wall charge is erased. Specifically, as shown in the wall charge erasing period of FIG. 5, a pulsed voltage Vers sufficiently higher than the expected discharge start voltage is alternately applied between the electrodes to be measured, for example, the data electrode and the scan electrode. To do.
  • the discharge start is observed. Specifically, as shown in the measurement period of FIG. 5, a pulsed voltage Vmsr lower than the expected discharge start voltage is applied to one electrode, for example, the data electrode, and the light emission associated with the discharge at that time is photogenerated. Detection is performed using a light detection sensor such as Maru. When no discharge is observed, after performing an operation of erasing wall charges during the wall charge erasing period, light emission is observed by applying a pulsed voltage Vmsr with a slightly increased absolute value of voltage during the measurement period.
  • the voltage Vmsr with the minimum absolute value at which light emission is observed in the measurement period is the discharge start voltage.
  • the voltage Vmsr applied in the measurement period is a positive voltage
  • the discharge start voltage VFds with the data electrode as the anode and the scan electrode as the cathode can be measured.
  • the voltage Vmsr applied during the measurement period is a negative voltage
  • the discharge start voltage VFsd with the data electrode as the cathode and the scan electrode as the anode can be measured.
  • the discharge start voltage is known, the voltage at which discharge starts is measured for the discharge cell in which the wall voltage is accumulated, and the wall voltage can be known as the difference between the voltage value and the discharge start voltage measured in advance. .
  • FIG. 6 is a circuit block diagram of plasma display device 40 in accordance with the first exemplary embodiment of the present invention.
  • the plasma display device 40 includes the panel 10 and its drive circuit.
  • the drive circuit includes an image signal processing circuit 41, a data electrode drive circuit 42, a scan electrode drive circuit 43, a sustain electrode drive circuit 44, a timing generation circuit 45, and each of them.
  • a power supply circuit (not shown) for supplying necessary power to the circuit block is provided.
  • the image signal processing circuit 41 converts the input image signal into image data indicating light emission / non-light emission for each subfield.
  • the data electrode driving circuit 42 converts the image data for each subfield into address pulses corresponding to the data electrodes D1 to Dm and applies them to the data electrodes D1 to Dm.
  • the timing generation circuit 45 generates various timing signals for controlling the operation of each circuit block on the basis of the vertical and horizontal synchronization signals, and supplies them to the respective circuit blocks.
  • Scan electrode drive circuit 43 generates the drive voltage waveform described above based on the timing signal and applies it to each of scan electrode SC1 through scan electrode SCn.
  • Sustain electrode drive circuit 44 generates the drive voltage waveform described above based on the timing signal and applies it to sustain electrode SU1 through sustain electrode SUn.
  • FIG. 7 is a circuit diagram of scan electrode drive circuit 43 of plasma display device 40 in accordance with the first exemplary embodiment of the present invention.
  • Scan electrode drive circuit 43 includes sustain pulse generation circuit 50, ramp waveform voltage generation circuit 60, and scan pulse generation circuit 70.
  • Sustain pulse generation circuit 50 has power recovery circuit 51, switching element Q55, switching element Q56, and switching element Q59, and generates sustain pulses to be applied to scan electrode SC1 through scan electrode SCn.
  • the power recovery circuit 51 recovers and reuses power when driving the scan electrodes SC1 to SCn.
  • Switching element Q55 clamps scan electrode SC1 through scan electrode SCn to voltage Vs
  • switching element Q56 clamps scan electrode SC1 through scan electrode SCn to voltage 0 (V).
  • the switching element Q59 is a separation switch, and is provided to prevent a current from flowing backward through a parasitic diode or the like of the switching element constituting the scan electrode driving circuit 43.
  • Scan pulse generation circuit 70 includes switching element Q71H1 to switching element Q71Hn, switching element Q71L1 to switching element Q71Ln, and switching element Q72. Then, a scan pulse is generated based on the power source of voltage Va and the power source E71 of voltage (Vc ⁇ Va) superimposed on the reference potential of the scan pulse generating circuit 70 (the potential of the node A shown in FIG. 7). Scan pulses are sequentially applied to each of scan electrode SC1 through scan electrode SCn at the timing shown in FIG. Scan pulse generation circuit 70 outputs the output voltage of sustain pulse generation circuit 50 as it is during the sustain operation. That is, the voltage at node A is output to scan electrode SC1 through scan electrode SCn.
  • the ramp waveform voltage generation circuit 60 includes a Miller integration circuit 61 and a Miller integration circuit 63, and generates the ramp waveform voltage shown in FIG.
  • Miller integrating circuit 61 includes transistor Q61, capacitor C61, and resistor R61.
  • Miller integrating circuit 61 By applying a constant voltage to input terminal IN61, Miller integrating circuit 61 generates an upward ramp waveform voltage that gradually increases toward voltage Vr.
  • Miller integrating circuit 63 includes transistor Q63, capacitor C63, and resistor R63, and applies a constant voltage to input terminal IN63 to generate a downward ramp waveform voltage that gradually decreases toward voltage Vi.
  • the switching element Q69 is also a separation switch, and is provided to prevent a current from flowing backward through a parasitic diode or the like of the switching element constituting the scan electrode drive circuit 43.
  • switching elements and transistors can be configured by using generally known elements such as MOSFETs and IGBTs. These switching elements and transistors are controlled by timing signals corresponding to the switching elements and transistors generated by the timing generation circuit 45.
  • FIG. 8 is a circuit diagram of sustain electrode drive circuit 44 of plasma display device 40 in accordance with the first exemplary embodiment of the present invention.
  • Sustain electrode drive circuit 44 includes sustain pulse generation circuit 80 and constant voltage generation circuit 85.
  • Sustain pulse generation circuit 80 includes power recovery circuit 81, switching element Q83, and switching element Q84, and generates sustain pulses to be applied to sustain electrode SU1 through sustain electrode SUn.
  • the power recovery circuit 81 recovers and reuses electric power when driving the sustain electrodes SU1 to SUn.
  • Switching element Q83 clamps sustain electrode SU1 through sustain electrode SUn to voltage Vs
  • switching element Q84 clamps sustain electrode SU1 through sustain electrode SUn to voltage 0 (V).
  • the constant voltage generation circuit 85 includes a switching element Q86 and a switching element Q87, and applies the voltage Ve to the sustain electrodes SU1 to SUn.
  • switching elements can also be configured by using generally known elements such as MOSFETs and IGBTs. These switching elements are also controlled by timing signals corresponding to the respective switching elements generated by the timing generation circuit 45.
  • FIG. 9 is a circuit diagram of the data electrode drive circuit 42 of the plasma display device 40 according to Embodiment 1 of the present invention.
  • the data electrode drive circuit 42 includes switching elements Q91H1 to Q91Hm and switching elements Q91L1 to Q91Lm.
  • the voltage 0 (V) is applied to the data electrode Dj by turning on the switching element Q91Lj, and the voltage Vd is applied to the data electrode Dj by turning on the switching element Q91Hj.
  • the drive voltage waveform of the panel shown in FIG. 3 can be generated using such a drive circuit.
  • the drive circuits shown in FIGS. 6 to 9 are examples, and the present invention is not limited to the circuit configurations of these drive circuits.
  • a scan pulse that satisfies the above (Condition 1) and (Condition 2) is applied to the scan electrode without using the forced initialization operation.
  • FIG. 10 shows the drive voltage waveform in the first field
  • FIG. The drive voltage waveform in the field is shown.
  • voltage 0 (V) is applied to data electrode D1 through data electrode Dm
  • voltage Ve is applied to sustain electrode SU1 through sustain electrode SUn
  • voltage is applied to scan electrode SC1 through scan electrode SCn.
  • Vc is applied.
  • a scan pulse of voltage Va is applied to scan electrode SC1 in the first row
  • an address pulse of voltage Vd is applied to data electrode Dk corresponding to the discharge cell to emit light.
  • the voltage difference at the intersection between the data electrode Dk and the scan electrode SC1 is because the positive wall voltage on the data electrode Dk is added to the difference (Vd ⁇ Va) of the externally applied voltage and exceeds the discharge start voltage VFds.
  • Discharge occurs between data electrode Dk and scan electrode SC1.
  • the discharge generated between data electrode Dk and scan electrode SC1 extends between scan electrode SC1 and sustain electrode SU1, and an address discharge occurs.
  • a positive wall voltage is accumulated on scan electrode SC1, a negative wall voltage is accumulated on sustain electrode SU1, and a negative wall voltage is also accumulated on data electrode Dk.
  • the wall voltage on the electrode represents a voltage generated by wall charges accumulated on the dielectric layer covering the electrode, the protective layer, the phosphor layer, and the like.
  • a scan pulse is applied to the scan electrode SC2 in the second row, and an address pulse is applied to the data electrode Dk corresponding to the discharge cell to emit light.
  • an address discharge occurs between data electrode Dk and scan electrode SC2 and between sustain electrode SU2 and scan electrode SC2, a positive wall voltage is accumulated on scan electrode SC2, and a negative wall voltage is applied on sustain electrode SU2. And a negative wall voltage is also accumulated on the data electrode Dk.
  • an address operation is performed in which an address discharge is caused in the discharge cell to be lit in the second row and wall voltage is accumulated on each electrode.
  • the voltage at the intersection between the data electrode Dh and the scan electrode SC2 to which no address pulse is applied does not exceed the discharge start voltage, and therefore no address discharge occurs.
  • the scan pulse is sequentially applied to the scan electrode SC2 in the second row, the scan electrode SC3 in the third row, ..., the scan electrode SCn-1 in the (n-1) th row, and the scan electrode SCn in the nth row.
  • the address operation is performed in the order of the discharge cell in the first row, the discharge cell in the second row, the discharge cell in the third row,..., The discharge cell in the (n ⁇ 1) row, and the discharge cell in the n row.
  • the wall charges necessary for the subsequent sustain discharge are formed.
  • the first voltage V1, the second voltage V2, and the third voltage V3 are defined as shown in FIG.
  • a voltage obtained by subtracting the voltage applied to the data electrode Dj from the low-voltage side voltage of the sustain pulse applied to the scan electrode SCi in the sustain period to be described later is defined as a first voltage V1, and the high voltage of the sustain pulse applied to the scan electrode SCi in the sustain period.
  • the voltage obtained by subtracting the voltage applied to the data electrode Dj from the side voltage is the second voltage V2, and the low voltage side voltage of the data pulse applied to the data electrode Dj from the low voltage side voltage of the scan pulse applied to the scan electrode SCi in the address period
  • the voltage obtained by subtracting is set as the third voltage V3.
  • the discharge start voltage with the data electrode Dj as the anode and the scan electrode SCi as the cathode is the discharge start voltage VFds
  • the discharge start voltage with the data electrode Dj as the cathode and the scan electrode SCi as the anode is the discharge start voltage VFsd.
  • the discharge with the data electrode Dj as the anode and the scan electrode SCi as the cathode is a discharge in which the electric field in the discharge cell when the discharge occurs is a high potential side on the data electrode Dj side and a low potential side on the scan electrode SCi side. It is.
  • the discharge with the data electrode Dj as the cathode and the scan electrode SCi as the anode is a discharge in which the electric field in the discharge cell when the discharge occurs is a low potential side on the data electrode Dj side and a high potential side on the scan electrode SCi side. is there. Since the protective layer 26 of magnesium oxide having high electron emission performance is formed on the scan electrode SCi side, the discharge start voltage VFds is lower than the discharge start voltage VFsd.
  • the voltage Va of the scan pulse applied to the scan electrode SCi is set so as to satisfy the following two conditions (condition 1) and (condition 2).
  • a voltage obtained by subtracting the third voltage V3 from the second voltage V2 is a discharge start voltage VFds and a data electrode Dj with the data electrode Dj as an anode and the scan electrode SCi as a cathode.
  • a negative wall voltage is accumulated on scan electrode SCi, and a positive wall voltage is accumulated on sustain electrode SUi. Further, a positive wall voltage is accumulated on the data electrode Dk.
  • the sustain discharge does not occur in the discharge cells in which the address discharge has not occurred, and the wall voltage at the end of the initialization operation is maintained.
  • V voltage 0
  • a sustain pulse of voltage Vs is applied to sustain electrode SU1 through sustain electrode SUn.
  • the sustain discharge occurs again in the discharge cell in which the sustain discharge has occurred, and the phosphor layer 35 emits light.
  • a negative wall voltage is accumulated on sustain electrode SUi
  • a positive wall voltage is accumulated on scan electrode SCi.
  • sustain pulses of the number corresponding to the luminance weight are alternately applied to scan electrode SC1 through scan electrode SCn and sustain electrode SU1 through sustain electrode SUn, and the sustain discharge is continued in the discharge cells that have caused the address discharge. generate.
  • voltage 0 (V) is applied to sustain electrode SU1 through sustain electrode SUn, and an upward ramp waveform voltage that gradually rises to voltage Vr is applied to scan electrode SC1 through scan electrode SCn.
  • the voltage Vr is set to the same voltage as the voltage Vs. Then, a weak erasing discharge is generated between scan electrode SCi and sustain electrode SUi in the discharge cell in which the sustain discharge has been performed (the discharge cell in which the address discharge has been performed when the sustain period is omitted). Then, the wall voltage on scan electrode SCi and sustain electrode SUi is weakened.
  • voltage Ve is applied to sustain electrode SU1 through sustain electrode SUn, and a downward ramp waveform voltage that gradually decreases from voltage 0 (V) toward voltage Vi is applied to scan electrode SC1 through scan electrode SCn.
  • the voltage Vi is set to be equal to or slightly higher than the voltage Va of the scanning pulse.
  • a scan pulse of voltage Va is applied to the (n ⁇ 1) th scan electrode SCn ⁇ 1, and an address pulse of voltage Vd is applied to the data electrode Dk corresponding to the discharge cell to emit light.
  • An address operation for accumulating wall voltage on each electrode of the discharge cells in the row is performed.
  • a scan pulse is sequentially applied to the (n-2) -th scan electrode SCn-2, the (n-3) -th scan electrode SCn-3,. The same write operation is performed until the scan electrode SC1 is reached.
  • the nth scan electrode SCn In this manner, in the address period of the subfield belonging to the second field, the nth scan electrode SCn, the (n-1) th scan electrode SCn-1, and the (n-2) th scan electrode SCn. ⁇ 2,...
  • a scan pulse is sequentially applied to the scan electrode SC2 in the second row and the scan electrode SC1 in the first row. Then, the discharge cell in the nth row, the discharge cell in the (n-1) th row, the discharge cell in the (n-2) th row, ..., the discharge cell in the second row, the discharge cell in the first row. Perform a write operation.
  • the order of the write operations in the write period of the subfield belonging to the second field is the reverse of the order of the write operations in the write period of the subfield belonging to the first field.
  • the operation of the sustain period and erase period of SF1 in the subsequent second field is the same as the operation of the sustain period and erase period of SF1 in the first field.
  • the operations in SF2 to SF10 in the second field are the same as those in SF2 to SF10 in the first field except that the order of the write operations in the write period is reversed.
  • the panel 10 is driven by alternately using the first field and the second field.
  • the erasing discharge is generated only in the discharge cells that have generated the address discharge in the immediately preceding address period.
  • no discharge occurs in the discharge cells that did not generate the address discharge. Therefore, no light emission occurs in the discharge cell displaying black.
  • the voltage Vi is ⁇ 260 (V), the voltage Vc is ⁇ 145 (V), the voltage Va is ⁇ 280 (V), the voltage Vs is 200 (V), the voltage Vr is 200 (V), The voltage Ve is 20 (V), and the voltage Vd is 60 (V).
  • these voltage values are not limited to the values described above, and are desirably set optimally based on the discharge characteristics of the panel and the specifications of the plasma display device.
  • the discharge start voltage VFds and the discharge start voltage VFsd of the panel 10 used in the present embodiment are measured by the same method as in the first embodiment, and their values are as follows.
  • the discharge start voltage varies depending on the phosphor, and the discharge start voltage VFds between the “data electrode and the scan electrode” for the discharge cell coated with the red phosphor is 200 ⁇ 10 (V), and the discharge start voltage VFsd is 320 ⁇ 10 ( V), the discharge start voltage VFds between the “data electrode and the scan electrode” for the discharge cell coated with the green phosphor is 220 ⁇ 10 (V), the discharge start voltage VFsd is 350 ⁇ 10 (V), and the blue fluorescence
  • the discharge start voltage VFds between the “data electrode and the scan electrode” for the discharge cell coated with the body was 200 ⁇ 10 (V), and the discharge start voltage VFsd was 330 ⁇ 10 (V).
  • the discharge start voltage VFss between the “scan electrode and sustain electrode” is 250 ⁇
  • the voltage on the low voltage side of the sustain pulse is voltage 0 (V)
  • the voltage applied to the data electrode in the sustain period is voltage 0 (V)
  • the first voltage V1 is voltage 0 (V ).
  • the third voltage V3 is the voltage Va.
  • the second voltage V2 is the voltage Vs.
  • a voltage lower than the low voltage side voltage Va of the scan pulse is applied to the scan electrode by applying a voltage not lower than the low voltage side voltage Va of the scan pulse and not higher than the high voltage side voltage Vs of the sustain pulse.
  • a voltage exceeding the high voltage Vs of the sustain pulse is not applied. Therefore, a discharge cell that has not performed address discharge does not emit light.
  • of the low-voltage side voltage Va of the scan pulse is the absolute value of the high-voltage side voltage Vs of the sustain pulse. It becomes larger than the value
  • the drive voltage waveform applied to each electrode in particular, the voltage Va of the scan pulse is set so as to satisfy (Condition 1) and (Condition 2). That is, in the erasing period, the erasing discharge is selectively generated only in the discharge cells that have generated the address discharge in the immediately preceding address period, and the data electrode Dj is applied from the low-voltage side voltage of the sustain pulse applied to the scan electrode SCi in the sustain period.
  • the voltage obtained by subtracting the voltage applied to the first electrode V1 is defined as the first voltage V1
  • the voltage obtained by subtracting the voltage applied to the data electrode Dj from the high voltage on the sustain pulse applied to the scan electrode SCi in the sustain period is defined as the second voltage V2.
  • the first voltage V1 to the first voltage 3 is equal to or higher than the discharge start voltage VFds having the data electrode Dj as the anode and the scan electrode SCi as the cathode, and the voltage V3 is reduced from the second voltage V2. 3 is less than the sum of the discharge start voltage VFds with the data electrode Dj as the anode and the scan electrode SCi as the cathode and the discharge start voltage VFsd with the data electrode Dj as the cathode and the scan electrode SCi as the anode. Absent. By setting in this way, the same write operation as in the first embodiment can be stably generated without using the forced initialization operation.
  • a first field in which scan pulses are sequentially applied from one scan electrode SC1 to the other scan electrode SCn of the plurality of scan electrodes arranged in the address period, and the other scan electrode SCn in the address period.
  • a second field for sequentially applying a scan pulse to one scan electrode SC1.
  • the panel 10 is driven by alternately using the first field and the second field. The reason for driving in this way will be described below.
  • the scan pulse is always applied in order from the scan electrode SC1 at the top of the display screen to the scan electrode SCn at the bottom of the display screen in the address period.
  • the discharge cells located under the discharge cells that have succeeded in the address discharge and the discharge cells located obliquely below can succeed in the address discharge one after another, and can be switched to white display.
  • the priming is not supplied from any discharge cell above the discharge cell that succeeded in the address discharge, the probability that the address discharge fails remains high. Therefore, it takes time to switch to white display at the top of the display screen, and the image display quality is degraded.
  • the scan pulse is always applied in order from the scan electrode SCn at the lower part of the display screen to the scan electrode SC1 at the upper part of the display screen in the address period. Therefore, it takes time to switch to white display at the bottom of the display screen, and the image display quality is degraded.
  • the discharge delay can be reduced over the entire screen, and the display can be quickly switched to white display. it can.
  • scan pulses are sequentially applied from one scan electrode SC1 of the scan electrodes to the other scan electrode SCn in the address period of all subfields in the first field, and the other scan is performed in the second field. It has been described that scan pulses are sequentially applied from electrode SCn to one scan electrode SC1. However, in the writing period of SF1 with the smallest luminance weight, which is a subfield with a high probability of performing the writing operation, a field in which the writing operation from one to the other and a field in which the writing operation is performed from the other are used alternately. By driving 10, the same effect can be obtained.
  • the scan pulse satisfying the above-described condition is applied to the scan electrode, so that the discharge delay is reduced and stable writing can be performed without using the forced initialization operation. It is possible to provide a panel driving method and a plasma display device which can operate and have improved contrast.
  • the present invention eliminates the forced initializing operation while stably generating the writing operation, eliminates the light emission not related to the gradation display, and can greatly improve the contrast. Therefore, the panel driving method and the plasma display device are provided. Useful as.

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Abstract

書込み動作を安定に発生させつつ強制初期化動作を省略して、階調表示に関係しない発光をなくし、コントラストを大幅に向上する。 消去期間は、直前の書込み期間で書込み放電を発生した放電セルのみで選択的に消去放電を発生し、かつ、維持パルスの低圧側電圧からデータ電極に印加する電圧を減じた電圧を第1の電圧とし、維持パルスの高圧側電圧からデータ電極に印加する電圧を減じた電圧を第2の電圧とし、走査パルスの低圧側電圧からデータ電極に印加するデータパルスの低圧側電圧を減じた電圧を第3の電圧とするとき、第1の電圧から第3の電圧を減じた電圧が、データ電極を陽極とし走査電極を陰極とする放電開始電圧以上であり、第2の電圧から第3の電圧を減じた電圧が、データ電極を陽極とし走査電極を陰極とする放電開始電圧とデータ電極を陰極とし走査電極を陽極とする放電開始電圧との和を超えない。

Description

プラズマディスプレイパネルの駆動方法およびプラズマディスプレイ装置
 本発明は、交流面放電型のプラズマディスプレイパネルの駆動方法およびプラズマディスプレイ装置に関する。
 プラズマディスプレイパネル(以下、「パネル」と略記する)は、走査電極と維持電極とデータ電極とを有する放電セルを複数備え、放電セル内でガス放電により発生させた紫外線で赤色、緑色および青色の各色の蛍光体を励起発光させてカラー表示を行っている。
 パネルを駆動する方法としてはサブフィールド法、すなわち初期化期間と書込み期間と維持期間とを有するサブフィールドを複数用いて1つのフィールドを構成し、発光させるサブフィールドの組み合わせによって階調表示を行う方法が一般的である。各サブフィールドの初期化期間には初期化動作、書込み期間には書込み動作、維持期間には維持動作を行う。初期化動作は初期化放電を発生し、続く書込み動作に必要な壁電荷を形成する動作である。初期化動作には、直前のサブフィールドの動作にかかわらず初期化放電を発生させる強制初期化動作と、直前のサブフィールドで書込み放電を行った放電セルで初期化放電を発生させる選択初期化動作とがある。書込み動作は表示する画像に応じて放電セルで選択的に書込み放電を発生し壁電荷を形成する動作であり、維持動作は表示電極対に交互に維持パルスを印加して維持放電を発生させ、対応する放電セルの蛍光体層を発光させる動作である。この維持放電による蛍光体層の発光は階調表示に関係する発光であり、その他の発光は階調表示に関係しない発光である。
 サブフィールド法の中でも最も低い階調である黒を表示する際の輝度(以下、「黒輝度」と略記する)を下げ、階調表示に関係しない発光を極力減らしてコントラストを向上させる駆動方法が検討されている。例えば特許文献1には、強制初期化動作を行う回数を1フィールドに1回とし、緩やかに変化する傾斜波形電圧を用いて強制初期化動作を行う駆動方法が開示されている。
 また特許文献2には、表示電極対をn分割し、強制初期化動作を行う回数をnフィールドに1回とし、階調表示に関係しない発光をさらに減らして黒輝度をさらに下げ、コントラストをさらに向上させた駆動方法が開示されている。
 しかしながら、特許文献1および特許文献2に記載の駆動方法であっても強制初期化動作を行うため、階調表示に関係しない発光が発生する。これは黒を表示する放電セルであっても発光が発生することを意味しており、そのためコントラストの向上には限界があった。また、強制初期化動作には、続く書込み期間において書込み放電を発生させるために必要な壁電荷を蓄積する働きがあり、加えて放電遅れ時間を短くして書込み放電を確実に発生させるためのプライミングを発生するという働きも持っている。そのため単純に強制初期化動作を省略すると、書込み放電が発生しない、あるいは書込み放電の放電遅れ時間が長くなりすぎて書込み動作が不安定となり、正常な画像表示ができなくなるという課題があった。
特開2000-242224号公報 特開2006-091295号公報
 本発明は、強制初期化動作を使用しなくても、安定した書込み動作を行い、コントラストを向上させたパネルの駆動方法およびプラズマディスプレイ装置を提供する。
 本発明のパネルの駆動方法は、書込み期間と維持期間と消去期間とを有するサブフィールドを複数用いて1つのフィールドを構成し、走査電極と維持電極とデータ電極とを有する放電セルを複数備えたパネルを駆動するパネルの駆動方法であって、消去期間は、直前の書込み期間で書込み放電を発生した放電セルのみで選択的に消去放電を発生し、かつ、維持期間において走査電極に印加する維持パルスの低圧側電圧からデータ電極に印加する電圧を減じた電圧を第1の電圧とし、維持期間において走査電極に印加する維持パルスの高圧側電圧からデータ電極に印加する電圧を減じた電圧を第2の電圧とし、書込み期間において走査電極に印加する走査パルスの低圧側電圧からデータ電極に印加するデータパルスの低圧側電圧を減じた電圧を第3の電圧とするとき、第1の電圧から第3の電圧を減じた電圧が、データ電極を陽極とし走査電極を陰極とする放電開始電圧以上であり、第2の電圧から第3の電圧を減じた電圧が、データ電極を陽極とし走査電極を陰極とする放電開始電圧とデータ電極を陰極とし走査電極を陽極とする放電開始電圧との和を超えないことを特徴とする。この方法により、書込み動作を安定に発生させつつ強制初期化動作を省略して、階調表示に関係しない発光をなくし、コントラストを大幅に向上したパネルの駆動方法を提供することができる。
 また本発明のパネルの駆動方法は、走査電極には、走査パルスの低圧側電圧以上、維持パルスの高圧側電圧以下の電圧を印加することが望ましい。
 また本発明のパネルの駆動方法は、走査パルスの低圧側電圧の絶対値は、維持パルスの高圧側電圧の絶対値よりも大きいことが望ましい。
 また本発明のプラズマディスプレイ装置は、走査電極と維持電極とデータ電極とを有する放電セルを複数備えたパネルと、書込み期間と維持期間と消去期間とを有するサブフィールドを複数用いて1つのフィールドを構成するとともに駆動電圧波形を発生してパネルの各電極に印加する駆動回路とを備えたプラズマディスプレイ装置であって、駆動回路は、消去期間において、直前の書込み期間で書込み放電を発生した放電セルのみで選択的に消去放電を発生させてパネルを駆動するとともに、維持期間において走査電極に印加する維持パルスの低圧側電圧からデータ電極に印加する電圧を減じた電圧を第1の電圧とし、維持期間において走査電極に印加する維持パルスの高圧側電圧からデータ電極に印加する電圧を減じた電圧を第2の電圧とし、書込み期間において走査電極に印加する走査パルスの低圧側電圧からデータ電極に印加するデータパルスの低圧側電圧を減じた電圧を第3の電圧とするとき、第1の電圧から第3の電圧を減じた電圧が、データ電極を陽極とし走査電極を陰極とする放電開始電圧以上であり、第2の電圧から第3の電圧を減じた電圧が、データ電極を陽極とし走査電極を陰極とする放電開始電圧とデータ電極を陰極とし走査電極を陽極とする放電開始電圧との和を超えない電圧に設定したことを特徴とする。この構成により、書込み動作を安定に発生させつつ強制初期化動作を省略して、階調表示に関係しない発光をなくし、コントラストを大幅に向上したプラズマディスプレイ装置を提供することが可能となる。
 さらに、本発明のパネルの駆動方法は、走査電極と維持電極とデータ電極とを有する放電セルを複数備えたパネルを駆動するパネルの駆動方法であって、走査電極に走査パルスを印加するとともにデータ電極に書込みパルスを印加して書込み放電を発生する書込み期間と、走査電極および維持電極に輝度重みに応じた維持パルスを交互に印加して維持放電を発生する維持期間と、走査電極および維持電極に所定の電圧を印加して消去放電を発生する消去期間と、を有するサブフィールドを複数用いて1つのフィールドを構成し、消去期間は、直前の書込み期間で書込み放電を発生した放電セルのみで選択的に消去放電を発生し、複数のフィールドには、最も輝度重みの小さいサブフィールドの書込み期間において複数配置された走査電極の一方の走査電極から他方の走査電極へ順に走査パルスを印加する第1のフィールドと、最も輝度重みの小さいサブフィールドの書込み期間において複数配置された走査電極の他方の走査電極から一方の走査電極へ順に走査パルスを印加する第2のフィールドとのいずれも備えることを特徴とする。この方法により、放電遅れを小さくかつ書込み動作を安定に発生させつつ強制初期化動作を省略して、階調表示に関係しない発光をなくし、コントラストを大幅に向上したパネルの駆動方法を提供することができる。
 また本発明のパネルの駆動方法は、第1のフィールドと第2のフィールドとを交互に用いることが望ましい。
 また本発明のプラズマディスプレイ装置は、走査電極と維持電極とデータ電極とを有する放電セルを複数備えたパネルと、走査電極に走査パルスを印加するとともにデータ電極に書込みパルスを印加して書込み放電を発生する書込み期間と、走査電極および維持電極に輝度重みに応じた維持パルスを交互に印加して維持放電を発生する維持期間と、走査電極および維持電極に所定の電圧を印加して消去放電を発生する消去期間と、を有するサブフィールドを複数用いて1つのフィールドを構成するとともに駆動電圧波形を発生してパネルの各電極に印加する駆動回路とを備えたプラズマディスプレイ装置であって、駆動回路は、消去期間において、直前の書込み期間で書込み放電を発生した放電セルのみで選択的に消去放電を発生させてパネルを駆動するとともに、複数のフィールドには、最も輝度重みの小さいサブフィールドの書込み期間において複数配置された走査電極の一方の走査電極から他方の走査電極へ順に走査パルスを印加する第1のフィールドと、最も輝度重みの小さいサブフィールドの書込み期間において複数配置された走査電極の他方の走査電極から一方の走査電極へ順に走査パルスを印加する第2のフィールドとのいずれも備えることを特徴とする。この構成により、放電遅れを小さくかつ書込み動作を安定に発生させつつ強制初期化動作を省略して、階調表示に関係しない発光をなくし、コントラストを大幅に向上したプラズマディスプレイ装置を提供することができる。
 本発明によれば、強制初期化動作を使用しなくても、安定した書込み動作を行い、コントラストを向上させたパネルの駆動方法およびプラズマディスプレイ装置を提供することが可能となる。
図1は、本発明の実施の形態1におけるプラズマディスプレイ装置に用いるパネルの分解斜視図である。 図2は、同プラズマディスプレイ装置に用いるパネルの電極配列図である。 図3は、同プラズマディスプレイ装置の各電極に印加する駆動電圧波形図である。 図4は、第1の電圧、第2の電圧、第3の電圧の定義を説明するための図である。 図5は、放電開始電圧を簡易的に測定する方法の一例を示す図である。 図6は、本発明の実施の形態1におけるプラズマディスプレイ装置の回路ブロック図である。 図7は、同プラズマディスプレイ装置の走査電極駆動回路の回路図である。 図8は、同プラズマディスプレイ装置の維持電極駆動回路の回路図である。 図9は、同プラズマディスプレイ装置のデータ電極駆動回路の回路図である。 図10は、本発明の実施の形態2におけるプラズマディスプレイ装置の各電極に印加する第1のフィールドにおける駆動電圧波形図である。 図11は、同プラズマディスプレイ装置の各電極に印加する第2のフィールドにおける駆動電圧波形図である。
 以下、本発明の実施の形態におけるプラズマディスプレイ装置について、図面を用いて説明する。
 (実施の形態1)
 図1は、本発明の実施の形態1におけるプラズマディスプレイ装置に用いるパネル10の分解斜視図である。ガラス製の前面基板21上には、走査電極22と維持電極23とからなる表示電極対24が複数形成されている。そして表示電極対24を覆うように誘電体層25が形成され、その誘電体層25上に保護層26が形成されている。保護層26は、放電を発生しやすくするために、電子放出性能の高い材料である酸化マグネシウムを用いて形成されている。背面基板31上にはデータ電極32が複数形成され、データ電極32を覆うように誘電体層33が形成され、さらにその上に井桁状の隔壁34が形成されている。そして、隔壁34の側面および誘電体層33上には赤色、緑色および青色の各色に発光する蛍光体層35が設けられている。赤の蛍光体としては、例えば(Y,Gd)BO:Euを、緑の蛍光体としては、例えばZnSiO:Mnを、青の蛍光体としては、例えばBaMgAl1017:Euをそれぞれ主成分とする蛍光体を用いている。
 これら前面基板21と背面基板31とは、微小な放電空間を挟んで表示電極対24とデータ電極32とが交差するように対向配置され、その外周部をガラスフリット等の封着材によって封着されている。そして放電空間には、放電ガスとして、例えばネオンとキセノンとの混合ガスが封入されている。放電空間は隔壁34によって複数の区画に仕切られており、表示電極対24とデータ電極32とが交差する部分に放電セルが形成されている。そしてこれらの放電セルが放電、発光することにより画像が表示される。
 なお、パネル10の構造は上述したものに限られるわけではなく、例えばストライプ状の隔壁を備えたものであってもよい。
 図2は、本発明の実施の形態1におけるプラズマディスプレイ装置に用いるパネル10の電極配列図である。パネル10には、行方向に長いn本の走査電極SC1~走査電極SCn(図1の走査電極22)およびn本の維持電極SU1~維持電極SUn(図1の維持電極23)が配列され、列方向に長いm本のデータ電極D1~データ電極Dm(図1のデータ電極32)が配列されている。そして、1対の走査電極SCi(i=1~n)および維持電極SUiと1つのデータ電極Dj(j=1~m)とが交差した部分に放電セルが形成され、放電セルは放電空間内にm×n個形成されている。
 次に、パネル10を駆動するための駆動電圧波形とその動作について説明する。プラズマディスプレイ装置は、サブフィールド法、すなわち1フィールドを複数のサブフィールドに分割し、サブフィールド毎に各放電セルの発光・非発光を制御することによって画像を表示する。
 本実施の形態においては、それぞれのサブフィールドは、書込み期間、維持期間および消去期間を有する。本実施の形態においてはそれまでの放電の有無にかかわらず強制的に初期化放電を発生させる強制初期化動作を行わない。
 書込み期間では、発光させるべき放電セルで選択的に書込み放電を発生し壁電荷を形成する書込み動作を行う。維持期間では、サブフィールド毎にあらかじめ決められた輝度重みに応じた数の維持パルスを表示電極対に交互に印加して、書込み放電を発生した放電セルで維持放電を発生させて発光させる維持動作を行う。なお、発光輝度を低く抑えるために維持期間を省略してもよい。消去期間では、直前の書込み期間において書込み放電を発生した放電セルのみで選択的に消去放電を発生し、書込み放電またはそれに続く維持放電で形成された壁電荷の履歴を消去し、続く書込み放電に必要な壁電荷を各電極上に形成する消去動作を行う。
 サブフィールド構成としては、例えば、1フィールドを10のサブフィールド(SF1、SF2、・・・、SF10)に分割し、各サブフィールドはそれぞれ、(1、2、3、6、11、18、30、44、60、80)の輝度重みを持つものとする。しかし、本発明は上記のサブフィールド数、輝度重み等のサブフィールド構成に限定されるものではない。
 図3は、本発明の実施の形態1におけるプラズマディスプレイ装置の各電極に印加する駆動電圧波形図である。
 SF1の書込み期間では、データ電極D1~データ電極Dmに電圧0(V)を、維持電極SU1~維持電極SUnには電圧Veを印加し、走査電極SC1~走査電極SCnに電圧Vcを印加する。次に、1行目の走査電極SC1に電圧Vaの走査パルスを印加するとともに発光すべき放電セルに対応するデータ電極Dkに電圧Vdの書込みパルスを印加する。
 するとデータ電極Dk上と走査電極SC1上との交差部の電圧差は、外部印加電圧の差(Vd-Va)にデータ電極Dk上の正の壁電圧が加算され、放電開始電圧VFdsを超えるためデータ電極Dkと走査電極SC1との間で放電が発生する。そしてデータ電極Dkと走査電極SC1との間で発生した放電が走査電極SC1と維持電極SU1との間に伸展して書込み放電が起こる。そして走査電極SC1上に正の壁電圧が蓄積され、維持電極SU1上に負の壁電圧が蓄積され、データ電極Dk上にも負の壁電圧が蓄積される。ここで電極上の壁電圧とは、電極を覆う誘電体層上、保護層上、蛍光体層上等に蓄積された壁電荷により生じる電圧を表す。
 このようにして、1行目に発光させるべき放電セルで書込み放電を起こして各電極上に壁電圧を蓄積する書込み動作が行われる。一方、書込みパルスを印加しなかったデータ電極Dhと走査電極SC1との交差部の電圧は放電開始電圧VFdsを超えないので、書込み放電は発生しない。
 次に、2行目の走査電極SC2に走査パルスを印加するとともに、発光すべき放電セルに対応するデータ電極Dkに書込みパルスを印加する。するとデータ電極Dkと走査電極SC2との間および維持電極SU2と走査電極SC2との間で書込み放電が起こり、走査電極SC2上に正の壁電圧が蓄積され、維持電極SU2上に負の壁電圧が蓄積され、データ電極Dk上にも負の壁電圧が蓄積される。このようにして、2行目に発光させるべき放電セルで書込み放電を起こして各電極上に壁電圧を蓄積する書込み動作が行われる。一方、書込みパルスを印加しなかったデータ電極Dhと走査電極SC2との交差部の電圧は放電開始電圧VFdsを超えないので、書込み放電は発生しない。
 以下、n行目の走査電極SCnに至るまで同様の書込み動作を行い、続く維持放電に必要な壁電荷を形成する。
 ここで、以下の説明のために、第1の電圧V1、第2の電圧V2、第3の電圧V3を、図4に示すように定義する。後述する維持期間において走査電極SCiに印加する維持パルスの低圧側電圧からデータ電極Djに印加する電圧を減じた電圧を第1の電圧V1とし、維持期間において走査電極SCiに印加する維持パルスの高圧側電圧からデータ電極Djに印加する電圧を減じた電圧を第2の電圧V2とし、書込み期間において走査電極SCiに印加する走査パルスの低圧側電圧からデータ電極Djに印加するデータパルスの低圧側電圧を減じた電圧を第3の電圧V3とする。
 さらに、データ電極Djを陽極とし走査電極SCiを陰極とする放電開始電圧を放電開始電圧VFdsとし、データ電極Djを陰極とし走査電極SCiを陽極とする放電開始電圧を放電開始電圧VFsdとする。なお、データ電極Djを陽極とし走査電極SCiを陰極とする放電とは、放電が発生するときの放電セル内の電界が、データ電極Dj側が高電位側、走査電極SCi側が低電位側となる放電である。またデータ電極Djを陰極とし走査電極SCiを陽極とする放電とは、放電が発生するときの放電セル内の電界が、データ電極Dj側が低電位側、走査電極SCi側が高電位側となる放電である。そして走査電極SCi側には電子放出性能の高い酸化マグネシウムの保護層26が形成されているため、放電開始電圧VFdsは放電開始電圧VFsdよりも低くなる。
 このとき走査電極SCiに印加する走査パルスの電圧Vaは、次の2つの条件(条件1)、(条件2)を満たすように設定されている。
 (条件1)全ての放電セルに対して、第1の電圧V1から第3の電圧V3を減じた電圧が、データ電極Djを陽極とし走査電極SCiを陰極とする放電開始電圧VFds以上、すなわち、
(V1-V3)≧VFdsを満たす。
 (条件2)全ての放電セルに対して、第2の電圧V2から第3の電圧V3を減じた電圧が、データ電極Djを陽極とし走査電極SCiを陰極とする放電開始電圧VFdsとデータ電極Djを陰極とし走査電極SCiを陽極とする放電開始電圧VFsdとの和を超えないこと、すなわち、
(V2-V3)≦(VFds+VFsd)を満たす。
 書込み期間の後に続くSF1の維持期間では、維持電極SU1~維持電極SUnに電圧0(V)を印加するとともに走査電極SC1~走査電極SCnに電圧Vsの維持パルスを印加する。すると書込み放電を起こした放電セルでは、走査電極SCi上と維持電極SUi上との電圧差が電圧Vsに走査電極SCi上の壁電圧と維持電極SUi上の壁電圧との差を加算したものとなり走査電極SCiと維持電極SUiとの間の放電開始電圧VFssを超える。そして、走査電極SCiと維持電極SUiとの間に維持放電が起こり、このとき発生した紫外線により蛍光体層35が発光する。そして走査電極SCi上に負の壁電圧が蓄積され、維持電極SUi上に正の壁電圧が蓄積される。さらにデータ電極Dk上にも正の壁電圧が蓄積される。一方、書込み放電が起きなかった放電セルでは維持放電は発生せず、初期化動作の終了時における壁電圧が保たれる。
 続いて、走査電極SC1~走査電極SCnに電圧0(V)を印加するとともに維持電極SU1~維持電極SUnに電圧Vsの維持パルスを印加する。すると、維持放電を起こした放電セルでは再び維持放電が起こり、蛍光体層35が発光する。そして維持電極SUi上に負の壁電圧が蓄積され走査電極SCi上に正の壁電圧が蓄積される。以降同様に、走査電極SC1~走査電極SCnと維持電極SU1~維持電極SUnとに交互に輝度重みに応じた数の維持パルスを印加し、書込み放電を起こした放電セルで維持放電を継続して発生させる。
 続くSF1の消去期間では、維持電極SU1~維持電極SUnに電圧0(V)を印加するとともに走査電極SC1~走査電極SCnには電圧Vrまで緩やかに上昇する上り傾斜波形電圧を印加する。なお本実施の形態においては電圧Vrは電圧Vsと同じ電圧に設定されている。すると維持放電を行った放電セル(維持期間が省略されている場合は書込み放電を行った放電セル)では走査電極SCiと維持電極SUiとの間で微弱な消去放電が発生する。そして走査電極SCi上および維持電極SUi上の壁電圧が弱められる。
 その後、維持電極SU1~維持電極SUnに電圧Veを印加し、走査電極SC1~走査電極SCnには電圧0(V)から電圧Viに向かって緩やかに下降する下り傾斜波形電圧を印加する。なお電圧Viは、走査パルスの電圧Vaと等しいか電圧Vaよりわずかに高い電圧に設定されている。
 すると、微弱な消去放電を発生した放電セルで再び微弱な放電が発生し、走査電極SCi上、維持電極SUi上の壁電圧、およびデータ電極Dk上の壁電圧の過剰な部分が放電され、書込み動作に適した壁電圧に調整される。このようにして消去動作が完了する。
 続くSF2~SF10における動作は、維持パルス数を除きSF1の動作と同様である。
 本実施の形態においては、電圧Viは-260(V)、電圧Vcは-145(V)、電圧Vaは-280(V)、電圧Vsは200(V)、電圧Vrは200(V)、電圧Veは20(V)、電圧Vdは60(V)である。しかしこれらの電圧値は上述した値に限定されるものではなく、パネルの放電特性やプラズマディスプレイ装置の仕様にもとづき最適に設定することが望ましい。
 なお、本実施の形態において用いたパネル10の放電開始電圧VFdsや放電開始電圧VFsdは、後述する方法により測定されており、それらの値は以下のとおりである。放電開始電圧は蛍光体によって異なり、赤の蛍光体を塗布した放電セルに対する「データ電極-走査電極」間の放電開始電圧VFdsは200±10(V)、同放電開始電圧VFsdは320±10(V)、緑の蛍光体を塗布した放電セルに対する「データ電極-走査電極」間の放電開始電圧VFdsは220±10(V)、同放電開始電圧VFsdは350±10(V)、青の蛍光体を塗布した放電セルに対する「データ電極-走査電極」間の放電開始電圧VFdsは200±10(V)、同放電開始電圧VFsdは330±10(V)であった。また、「走査電極-維持電極」間の放電開始電圧VFssは、赤および青の蛍光体を塗布した放電セルに対しては250±10(V)、緑の蛍光体を塗布した放電セルでは、280±10(V)であった。
 本実施の形態においては、維持パルスの低圧側の電圧は電圧0(V)、維持期間においてデータ電極に印加する電圧は電圧0(V)であるため、第1の電圧V1は電圧0(V)である。また、走査パルスの低圧側は電圧Va、データパルスの低圧側電圧は電圧0(V)であるため、第3の電圧V3は電圧Vaである。また、放電開始電圧VFdsの最大値は、ばらつきを考慮すると電圧230(V)である。従って、(第1の電圧V1-第3の電圧V3)=-Va>(VFdsの最大値)、すなわち280(V)>230(V)となり、全ての放電セルで(条件1)を満足していることがわかる。
 また維持パルスの高圧側は電圧Vsであり、維持期間においてデータ電極に印加する電圧は電圧0(V)であるため、第2の電圧V2は電圧Vsである。また、放電開始電圧VFsdと放電開始電圧VFdsとの和の最小値は電圧500(V)である。従って、(第2の電圧V2-第3の電圧V3)=Vs-Va<(VFds+VFsd)の最小値、すなわち480(V)<500(V)となり、(条件2)についても全ての放電セルで満足していることがわかる。
 また、上記の電圧から明らかなように、走査電極には、走査パルスの低圧側電圧Va以上、維持パルスの高圧側電圧Vs以下の電圧を印加し、走査パルスの低圧側電圧Vaより低い電圧または維持パルスの高圧側電圧Vsを超える電圧を印加することはない。そのため書込み放電を行わなかった放電セルが発光することはない。
 また、上記の電圧から明らかなように、(条件1)を満たすように電圧Vaを低く設定すると、走査パルスの低圧側電圧Vaの絶対値|Va|は、維持パルスの高圧側電圧Vsの絶対値|Vs|よりも大きくなる。
 このように本実施の形態においては、各電極に印加する駆動電圧波形、特に走査パルスの電圧Vaを、(条件1)および(条件2)を満たすように設定することにより、強制初期化動作を使用しなくても、書込み動作を安定に発生させることができる。その理由は以下のように考えられる。
 まず、(条件1)について説明する。書込み放電を発生させるためには、データ電極Djと走査電極SCiとの間で放電を開始する必要がある。データ電極Djに比較的低い電圧Vdaを印加して放電を開始するためには、走査電極SCiに走査パルスを印加したときに放電開始電圧VFdsにほぼ等しい電圧がデータ電極Djと走査電極SCiとの間に印加されるように、データ電極Dj上に十分な正の壁電圧を蓄積しておかなければならない。上述したように本実施の形態においては強制初期化動作を行わず、黒を表示する放電セルでは放電を発生させない。そのため壁電圧を能動的に制御することができず、黒を表示する放電セルの壁電圧は不定となる。しかしながらこのような放電セルであっても放電空間内にわずかな荷電粒子が存在すれば、それらが放電空間内部の電界を緩和するように各々の電極に移動して放電セルの壁に付着して壁電圧を蓄積する。
 まず、このようにして蓄積される壁電圧について説明する。維持期間では維持放電を発生する放電セルで多量の荷電粒子が発生するので、これらが拡散することにより、維持放電を起こさずに黒を表示する放電セル内部の空間にもわずかながら荷電粒子が供給されていると考えられる。そして黒を表示する放電セルでは、走査電極SCi、維持電極SUiおよびデータ電極Djのそれぞれに印加される電圧により、電極間の電位差を緩和するようにゆっくりと壁電圧が蓄積されていく。このとき壁電圧が漸近する(最終的に落ち着く)電圧を放置壁電圧と定義すると、仮に走査電極SCiおよび維持電極SUiに交互に維持パルスを印加し続けた場合の放置壁電圧は維持パルスの高圧側電圧と低圧側電圧との間の電圧となる。実際には維持パルス以外の駆動電圧波形も印加されるので、各放電セルの放置壁電圧は概ね維持パルスの低圧側電圧に近いと考えてよい。
 また放置壁電圧は、放電セル内部に塗布されている蛍光体の帯電特性の影響を大きく受ける。本実施の形態においては、蛍光体の帯電特性はそれぞれ赤の蛍光体が+20(μC/g)、緑の蛍光体が-30(μC/g)、青の蛍光体が+10(μC/g)であり、緑の蛍光体のみ負電位に帯電する特性を持つため、赤および青の蛍光体に比べて放置壁電圧は低くなる。
 次に、書込み期間における放電セル内部の電圧について説明する。黒を表示する放電セルのデータ電極Dj上には概ね維持パルスの低圧側電圧またはそれよりも高い放置壁電圧に向かって徐々に壁電圧が蓄積される。一方、本実施の形態における走査パルスの電圧Vaは、(条件1)を満たす電圧である。そのため、データ電極Dj上には書込み放電を発生させるに十分な正の壁電圧が蓄積され、強制初期化動作を全く行わなくても書込み放電を発生させることができる。
 また黒を表示する放電セルの壁電圧はゆっくりと放置壁電圧に漸近し、消去期間において「データ電極-走査電極」間の電圧に壁電圧を加算した電圧が放電開始電圧に近づくと暗電流が流れ、データ電極Dj上の壁電圧を低下させる。そしてこのとき流れる暗電流が書込み放電を助けるプライミングの役割を果たすため、黒を表示していた放電セルであっても、大きな放電遅れを生じることなく安定した書込み放電を発生させることができると考えることができる。
 このように、(条件1)を満たすように各電極に印加する駆動電圧、特に(条件1)を満たすように走査パルスの電圧Vaを低く設定することにより、強制初期化動作を行うことなく、書込みに必要な壁電圧を蓄積することができ、かつ書込み放電を安定させるプライミングも発生させることができる。
 次に、(条件2)について説明する。走査パルスの電圧Vaを低くしすぎると、維持期間において走査電極SCnに維持パルスの電圧Vsを印加した時点で書込み動作の有無に関係なく放電が発生して画像を表示できなくなる。この誤放電を抑制するためには、維持パルスの電圧Vsを印加した時点で「データ電極-走査電極」間の電圧が放電開始電圧VFsd以下となるように設定しなければならない。この条件が(条件2)である。
 このように本実施の形態においては、全ての放電セルで(条件1)および(条件2)を満たすように駆動電圧波形が設定されている。そのため書込み動作を安定に発生させつつ強制初期化動作を省略して、階調表示に関係しない発光をなくした画像表示が可能となる。
 次に、放電開始電圧VFsdと放電開始電圧VFds、および壁電圧は、例えばIEEE TRANSACTIONS ON ELECTRON DEVICES,VOL.ED-24,NO.7,JULY,1977“Measurement of a Plasma in the AC Plasma Display panel Using RF Capacitance and Microwave Techniques”に記載されている方法により測定できる。あるいは、以下のようにして簡易的に測定してもよい。放電開始電圧を簡易的に測定する方法の一例を図5を用いて説明する。
 まず壁電荷を消去する動作を行う。具体的には図5の壁電荷消去期間に示したように、予想される放電開始電圧よりも十分高いパルス状の電圧Versを、測定したい電極間、例えばデータ電極と走査電極とに交互に印加する。次に、放電開始を観測する。具体的には図5の測定期間に示したように、予想される放電開始電圧よりも低いパルス状の電圧Vmsrを一方の電極、例えばデータ電極に印加し、そのときの放電にともなう発光をフォトマル等の光検出センサを用いて検出する。放電が観測されない場合には、壁電荷消去期間で壁電荷を消去する動作を行った後、測定期間で電圧の絶対値を少しあげたパルス状の電圧Vmsrを印加して発光を観測する。
 この動作を繰り返し、測定期間において発光が観測される絶対値が最小の電圧Vmsrが放電開始電圧である。このとき測定期間で印加する電圧Vmsrを正の電圧とすると、データ電極を陽極とし走査電極を陰極とする放電開始電圧VFdsを測定することができる。また、測定期間で印加する電圧Vmsrを負の電圧とすると、データ電極を陰極とし走査電極を陽極とする放電開始電圧VFsdを測定することができる。
 放電開始電圧がわかれば、壁電圧が蓄積している放電セルに対して、放電が開始する電圧を測定し、その電圧値とあらかじめ測定した放電開始電圧との差として壁電圧を知ることができる。
 次に、パネル10を駆動するための駆動回路について説明する。図6は、本発明の実施の形態1におけるプラズマディスプレイ装置40の回路ブロック図である。プラズマディスプレイ装置40は、パネル10とその駆動回路とを備え、駆動回路は、画像信号処理回路41、データ電極駆動回路42、走査電極駆動回路43、維持電極駆動回路44、タイミング発生回路45および各回路ブロックに必要な電源を供給する電源回路(図示せず)を備えている。
 画像信号処理回路41は、入力された画像信号をサブフィールド毎の発光・非発光を示す画像データに変換する。データ電極駆動回路42はサブフィールド毎の画像データを各データ電極D1~データ電極Dmに対応する書込みパルスに変換し各データ電極D1~データ電極Dmに印加する。タイミング発生回路45は垂直および水平同期信号をもとにして各回路ブロックの動作を制御する各種のタイミング信号を発生し、それぞれの回路ブロックへ供給する。走査電極駆動回路43は、タイミング信号にもとづいて上述した駆動電圧波形を発生し各走査電極SC1~走査電極SCnのそれぞれに印加する。維持電極駆動回路44は、タイミング信号にもとづいて上述した駆動電圧波形を発生し維持電極SU1~維持電極SUnに印加する。
 図7は、本発明の実施の形態1におけるプラズマディスプレイ装置40の走査電極駆動回路43の回路図である。走査電極駆動回路43は、維持パルス発生回路50と、傾斜波形電圧発生回路60と、走査パルス発生回路70とを備えている。
 維持パルス発生回路50は、電力回収回路51と、スイッチング素子Q55と、スイッチング素子Q56と、スイッチング素子Q59とを有し、走査電極SC1~走査電極SCnに印加する維持パルスを発生する。電力回収回路51は走査電極SC1~走査電極SCnを駆動するときの電力を回収して再利用する。スイッチング素子Q55は走査電極SC1~走査電極SCnを電圧Vsにクランプし、スイッチング素子Q56は走査電極SC1~走査電極SCnを電圧0(V)にクランプする。スイッチング素子Q59は分離スイッチであり、走査電極駆動回路43を構成するスイッチング素子の寄生ダイオード等を介して電流が逆流するのを防止するために設けられている。
 走査パルス発生回路70は、スイッチング素子Q71H1~スイッチング素子Q71Hn、スイッチング素子Q71L1~スイッチング素子Q71Ln、スイッチング素子Q72を有する。そして電圧Vaの電源、および走査パルス発生回路70の基準電位(図7に示した節点Aの電位)に重畳された電圧(Vc-Va)の電源E71をもとにして走査パルスを発生し、走査電極SC1~走査電極SCnのそれぞれに、図3に示したタイミングで走査パルスを順次印加する。なお、走査パルス発生回路70は、維持動作時には維持パルス発生回路50の出力電圧をそのまま出力する。すなわち、節点Aの電圧を走査電極SC1~走査電極SCnへ出力する。
 傾斜波形電圧発生回路60は、ミラー積分回路61、ミラー積分回路63を備え、図3に示した傾斜波形電圧を発生させる。ミラー積分回路61は、トランジスタQ61とコンデンサC61と抵抗R61とを有し、入力端子IN61に一定の電圧を印加することにより、電圧Vrに向かって緩やかに上昇する上り傾斜波形電圧を発生する。ミラー積分回路63は、トランジスタQ63とコンデンサC63と抵抗R63とを有し、入力端子IN63に一定の電圧を印加することにより、電圧Viに向かって緩やかに低下する下り傾斜波形電圧を発生する。なおスイッチング素子Q69も分離スイッチであり、走査電極駆動回路43を構成するスイッチング素子の寄生ダイオード等を介して電流が逆流するのを防止するために設けられている。
 なお、これらのスイッチング素子およびトランジスタは、MOSFETやIGBT等の一般に知られた素子を用いて構成することができる。またこれらのスイッチング素子およびトランジスタは、タイミング発生回路45で発生したそれぞれのスイッチング素子およびトランジスタに対応するタイミング信号により制御される。
 図8は、本発明の実施の形態1におけるプラズマディスプレイ装置40の維持電極駆動回路44の回路図である。維持電極駆動回路44は、維持パルス発生回路80と、一定電圧発生回路85とを備えている。
 維持パルス発生回路80は、電力回収回路81と、スイッチング素子Q83と、スイッチング素子Q84とを有し、維持電極SU1~維持電極SUnに印加する維持パルスを発生する。電力回収回路81は維持電極SU1~維持電極SUnを駆動するときの電力を回収して再利用する。スイッチング素子Q83は維持電極SU1~維持電極SUnを電圧Vsにクランプし、スイッチング素子Q84は維持電極SU1~維持電極SUnを電圧0(V)にクランプする。
 一定電圧発生回路85は、スイッチング素子Q86、スイッチング素子Q87を有し、維持電極SU1~維持電極SUnに電圧Veを印加する。
 なお、これらのスイッチング素子も、MOSFETやIGBT等の一般に知られた素子を用いて構成することができる。またこれらのスイッチング素子も、タイミング発生回路45で発生したそれぞれのスイッチング素子に対応するタイミング信号により制御される。
 図9は、本発明の実施の形態1におけるプラズマディスプレイ装置40のデータ電極駆動回路42の回路図である。データ電極駆動回路42は、スイッチング素子Q91H1~スイッチング素子Q91Hm、スイッチング素子Q91L1~スイッチング素子Q91Lmを有する。そしてスイッチング素子Q91Ljをオンにすることでデータ電極Djに電圧0(V)を印加し、スイッチング素子Q91Hjをオンにすることでデータ電極Djに電圧Vdを印加する。
 このような駆動回路を用いて、図3に示したパネルの駆動電圧波形を発生させることができる。しかし図6~図9に示した駆動回路は一例であって、本発明がこれらの駆動回路の回路構成に限定されるものではない。
 以上のように本実施の形態のパネルの駆動方法では、上述の(条件1)と(条件2)とを満たす走査パルスを走査電極に印加することで、強制初期化動作を使用しなくても、安定した書込み動作を行うことができるとともに、コントラストを向上させたパネルの駆動方法およびプラズマディスプレイ装置を提供することできる。
 (実施の形態2)
 図10および図11は、本発明の実施の形態2におけるプラズマディスプレイ装置の各電極に印加する駆動電圧波形図であり、図10は第1のフィールドにおける駆動電圧波形を示し、図11は第2のフィールドにおける駆動電圧波形を示している。
 第1のフィールドのSF1の書込み期間では、データ電極D1~データ電極Dmに電圧0(V)を、維持電極SU1~維持電極SUnには電圧Veを印加し、走査電極SC1~走査電極SCnに電圧Vcを印加する。次に、1行目の走査電極SC1に電圧Vaの走査パルスを印加するとともに発光すべき放電セルに対応するデータ電極Dkに電圧Vdの書込みパルスを印加する。
 するとデータ電極Dk上と走査電極SC1上との交差部の電圧差は、外部印加電圧の差(Vd-Va)にデータ電極Dk上の正の壁電圧が加算され、放電開始電圧VFdsを超えるためデータ電極Dkと走査電極SC1との間で放電が発生する。そしてデータ電極Dkと走査電極SC1との間で発生した放電が走査電極SC1と維持電極SU1との間に伸展して書込み放電が起こる。そして走査電極SC1上に正の壁電圧が蓄積され、維持電極SU1上に負の壁電圧が蓄積され、データ電極Dk上にも負の壁電圧が蓄積される。ここで電極上の壁電圧とは、電極を覆う誘電体層上、保護層上、蛍光体層上等に蓄積された壁電荷により生じる電圧を表す。
 このようにして、1行目に発光させるべき放電セルで書込み放電を起こして各電極上に壁電圧を蓄積する書込み動作が行われる。一方、書込みパルスを印加しなかったデータ電極Dhと走査電極SC1との交差部の電圧は放電開始電圧VFdsを超えないので、書込み放電は発生しない。
 次に、2行目の走査電極SC2に走査パルスを印加するとともに、発光すべき放電セルに対応するデータ電極Dkに書込みパルスを印加する。するとデータ電極Dkと走査電極SC2との間および維持電極SU2と走査電極SC2との間で書込み放電が起こり、走査電極SC2上に正の壁電圧が蓄積され、維持電極SU2上に負の壁電圧が蓄積され、データ電極Dk上にも負の壁電圧が蓄積される。このようにして、2行目に発光させるべき放電セルで書込み放電を起こして各電極上に壁電圧を蓄積する書込み動作が行われる。一方、書込みパルスを印加しなかったデータ電極Dhと走査電極SC2との交差部の電圧は放電開始電圧を超えないので、書込み放電は発生しない。
 以下、2行目の走査電極SC2、3行目の走査電極SC3、・・・、(n-1)行目の走査電極SCn-1、n行目の走査電極SCnに走査パルスを順次印加する。そして、1行目の放電セル、2行目の放電セル、3行目の放電セル、・・・、(n-1)行目の放電セル、n行目の放電セルの順に書込み動作を行い、続く維持放電に必要な壁電荷を形成する。
 ここでも実施の形態1と同様に、第1の電圧V1、第2の電圧V2、第3の電圧V3を、図4に示すように定義する。後述する維持期間において走査電極SCiに印加する維持パルスの低圧側電圧からデータ電極Djに印加する電圧を減じた電圧を第1の電圧V1とし、維持期間において走査電極SCiに印加する維持パルスの高圧側電圧からデータ電極Djに印加する電圧を減じた電圧を第2の電圧V2とし、書込み期間において走査電極SCiに印加する走査パルスの低圧側電圧からデータ電極Djに印加するデータパルスの低圧側電圧を減じた電圧を第3の電圧V3とする。
 さらに、データ電極Djを陽極とし走査電極SCiを陰極とする放電開始電圧を放電開始電圧VFdsとし、データ電極Djを陰極とし走査電極SCiを陽極とする放電開始電圧を放電開始電圧VFsdとする。なお、データ電極Djを陽極とし走査電極SCiを陰極とする放電とは、放電が発生するときの放電セル内の電界が、データ電極Dj側が高電位側、走査電極SCi側が低電位側となる放電である。またデータ電極Djを陰極とし走査電極SCiを陽極とする放電とは、放電が発生するときの放電セル内の電界が、データ電極Dj側が低電位側、走査電極SCi側が高電位側となる放電である。そして走査電極SCi側には電子放出性能の高い酸化マグネシウムの保護層26が形成されているため、放電開始電圧VFdsは放電開始電圧VFsdよりも低くなる。
 このとき走査電極SCiに印加する走査パルスの電圧Vaは、次の2つの条件(条件1)、(条件2)を満たすように設定されている。
 (条件1)全ての放電セルに対して、第1の電圧V1から第3の電圧V3を減じた電圧が、データ電極Djを陽極とし走査電極SCiを陰極とする放電開始電圧VFds以上、すなわち、
(V1-V3)≧VFdsを満たす。
 (条件2)全ての放電セルに対して、第2の電圧V2から第3の電圧V3を減じた電圧が、データ電極Djを陽極とし走査電極SCiを陰極とする放電開始電圧VFdsとデータ電極Djを陰極とし走査電極SCiを陽極とする放電開始電圧VFsdとの和を超えないこと、すなわち、
(V2-V3)≦(VFds+VFsd)を満たす。
 書込み期間の後に続くSF1の維持期間では、維持電極SU1~維持電極SUnに電圧0(V)を印加するとともに走査電極SC1~走査電極SCnに電圧Vsの維持パルスを印加する。すると書込み放電を起こした放電セルでは、走査電極SCi上と維持電極SUi上との電圧差が電圧Vsに走査電極SCi上の壁電圧と維持電極SUi上の壁電圧との差を加算したものとなり走査電極SCiと維持電極SUiとの間の放電開始電圧VFssを超える。そして、走査電極SCiと維持電極SUiとの間に維持放電が起こり、このとき発生した紫外線により蛍光体層35が発光する。そして走査電極SCi上に負の壁電圧が蓄積され、維持電極SUi上に正の壁電圧が蓄積される。さらにデータ電極Dk上にも正の壁電圧が蓄積される。一方、書込み放電が起きなかった放電セルでは維持放電は発生せず、初期化動作の終了時における壁電圧が保たれる。
 続いて、走査電極SC1~走査電極SCnに電圧0(V)を印加するとともに維持電極SU1~維持電極SUnに電圧Vsの維持パルスを印加する。すると、維持放電を起こした放電セルでは再び維持放電が起こり、蛍光体層35が発光する。そして維持電極SUi上に負の壁電圧が蓄積され走査電極SCi上に正の壁電圧が蓄積される。以降同様に、走査電極SC1~走査電極SCnと維持電極SU1~維持電極SUnとに交互に輝度重みに応じた数の維持パルスを印加し、書込み放電を起こした放電セルで維持放電を継続して発生させる。
 続くSF1の消去期間では、維持電極SU1~維持電極SUnに電圧0(V)を印加するとともに走査電極SC1~走査電極SCnには電圧Vrまで緩やかに上昇する上り傾斜波形電圧を印加する。なお本実施の形態においては電圧Vrは電圧Vsと同じ電圧に設定されている。すると維持放電を行った放電セル(維持期間が省略されている場合は書込み放電を行った放電セル)では走査電極SCiと維持電極SUiとの間で微弱な消去放電が発生する。そして走査電極SCi上および維持電極SUi上の壁電圧が弱められる。
 その後、維持電極SU1~維持電極SUnに電圧Veを印加し、走査電極SC1~走査電極SCnには電圧0(V)から電圧Viに向かって緩やかに下降する下り傾斜波形電圧を印加する。なお電圧Viは、走査パルスの電圧Vaと等しいか電圧Vaよりわずかに高い電圧に設定されている。
 すると、微弱な消去放電を発生した放電セルで再び微弱な放電が発生し、走査電極SCi上、維持電極SUi上の壁電圧、およびデータ電極Dk上の壁電圧の過剰な部分が放電され、書込み動作に適した壁電圧に調整される。このようにして消去動作が完了する。
 続く第1のフィールドのSF2~SF10における動作は、維持パルス数を除きSF1の動作と同様である。
 続く第2のフィールドのSF1の書込み期間では、データ電極D1~データ電極Dmに電圧0(V)を、維持電極SU1~維持電極SUnには電圧Veを印加し、走査電極SC1~走査電極SCnに電圧Vcを印加する。次に、n行目の走査電極SCnに電圧Vaの走査パルスを印加するとともに発光すべき放電セルに対応するデータ電極Dkに電圧Vdの書込みパルスを印加する。ここでも電圧Vaは、(条件1)と(条件2)とを満たすように設定されている。
 するとデータ電極Dkと走査電極SCnとの間、および走査電極SCnと維持電極SUnとの間で書込み放電が起こり、n行目の発光すべき放電セルの各電極上に壁電圧を蓄積する書込み動作が行われる。
 次に、(n-1)番目の走査電極SCn-1に電圧Vaの走査パルスを印加するとともに発光すべき放電セルに対応するデータ電極Dkに電圧Vdの書込みパルスを印加して、(n-1)行目の放電セルの各電極上に壁電圧を蓄積する書込み動作を行う。以下、(n-2)行目の走査電極SCn-2、(n-3)行目の走査電極SCn-3、・・・、に走査パルスを順次印加して書込み動作を行い、1行目の走査電極SC1に至るまで同様の書込み動作を行う。
 このように第2のフィールドに属するサブフィールドの書込み期間においては、n行目の走査電極SCn、(n-1)行目の走査電極SCn-1、(n-2)行目の走査電極SCn-2、・・・、2行目の走査電極SC2、1行目の走査電極SC1に走査パルスを順次印加する。そして、n行目の放電セル、(n-1)行目の放電セル、(n-2)行目の放電セル、・・・、2行目の放電セル、1行目の放電セルの順に書込み動作を行う。このように第2のフィールドに属するサブフィールドの書込み期間における書込み動作の順番は、第1のフィールドに属するサブフィールドの書込み期間における書込み動作の順番の逆である。
 続く第2のフィールドのSF1の維持期間、消去期間の動作は、第1のフィールドのSF1の維持期間、消去期間の動作と同様である。また第2のフィールドのSF2~SF10における動作は、書込み期間における書込み動作の順番が逆であることを除き、第1のフィールドのSF2~SF10における動作と同様である。
 以下同様に、第1のフィールドと第2のフィールドとを交互に用いてパネル10を駆動している。
 このように本実施の形態においては、全てのサブフィールドの消去期間で、直前の書込み期間において書込み放電を発生した放電セルのみで消去放電を発生する。そして本実施の形態においては、書込み放電を発生しなかった放電セルで放電が発生することはない。そのため黒を表示する放電セルで発光が発生することはない。
 本実施の形態においても、電圧Viは-260(V)、電圧Vcは-145(V)、電圧Vaは-280(V)、電圧Vsは200(V)、電圧Vrは200(V)、電圧Veは20(V)、電圧Vdは60(V)である。しかしこれらの電圧値は上述した値に限定されるものではなく、パネルの放電特性やプラズマディスプレイ装置の仕様にもとづき最適に設定することが望ましい。
 なお、本実施の形態において用いたパネル10の放電開始電圧VFdsや放電開始電圧VFsdは、実施の形態1と同様の方法により測定されており、それらの値は以下のとおりである。放電開始電圧は蛍光体によって異なり、赤の蛍光体を塗布した放電セルに対する「データ電極-走査電極」間の放電開始電圧VFdsは200±10(V)、同放電開始電圧VFsdは320±10(V)、緑の蛍光体を塗布した放電セルに対する「データ電極-走査電極」間の放電開始電圧VFdsは220±10(V)、同放電開始電圧VFsdは350±10(V)、青の蛍光体を塗布した放電セルに対する「データ電極-走査電極」間の放電開始電圧VFdsは200±10(V)、同放電開始電圧VFsdは330±10(V)であった。また、「走査電極-維持電極」間の放電開始電圧VFssは、赤および青の蛍光体を塗布した放電セルに対しては250±10(V)、緑の蛍光体を塗布した放電セルでは、280±10(V)であった。
 本実施の形態においては、維持パルスの低圧側の電圧は電圧0(V)、維持期間においてデータ電極に印加する電圧は電圧0(V)であるため、第1の電圧V1は電圧0(V)である。また、走査パルスの低圧側は電圧Va、データパルスの低圧側電圧は電圧0(V)であるため、第3の電圧V3は電圧Vaである。また、放電開始電圧VFdsの最大値は、ばらつきを考慮すると電圧230(V)である。従って、(第1の電圧V1-第3の電圧V3)=-Va>(VFdsの最大値)、すなわち280(V)>230(V)となり、全ての放電セルで(条件1)を満足していることがわかる。
 また維持パルスの高圧側は電圧Vsであり、維持期間においてデータ電極に印加する電圧は電圧0(V)であるため、第2の電圧V2は電圧Vsである。また、放電開始電圧VFsdと放電開始電圧VFdsとの和の最小値は電圧500(V)である。従って、(第2の電圧V2-第3の電圧V3)=Vs-Va<(VFds+VFsd)の最小値、すなわち480(V)<500(V)となり、(条件2)についても全ての放電セルで満足していることがわかる。
 また、上記の電圧から明らかなように、走査電極には、走査パルスの低圧側電圧Va以上、維持パルスの高圧側電圧Vs以下の電圧を印加し、走査パルスの低圧側電圧Vaより低い電圧または維持パルスの高圧側電圧Vsを超える電圧を印加することはない。そのため書込み放電を行わなかった放電セルが発光することはない。
 また、上記の電圧から明らかなように、(条件1)を満たすように電圧Vaを低く設定すると、走査パルスの低圧側電圧Vaの絶対値|Va|は、維持パルスの高圧側電圧Vsの絶対値|Vs|よりも大きくなる。
 このように本実施の形態においては、各電極に印加する駆動電圧波形、特に走査パルスの電圧Vaを、(条件1)および(条件2)を満たすように設定している。すなわち、消去期間は、直前の書込み期間で書込み放電を発生した放電セルのみで選択的に消去放電を発生し、かつ、維持期間において走査電極SCiに印加する維持パルスの低圧側電圧からデータ電極Djに印加する電圧を減じた電圧を第1の電圧V1とし、維持期間において走査電極SCiに印加する維持パルスの高圧側電圧からデータ電極Djに印加する電圧を減じた電圧を第2の電圧V2とし、書込み期間において走査電極SCiに印加する走査パルスの低圧側電圧からデータ電極Djに印加するデータパルスの低圧側電圧を減じた電圧を第3の電圧V3とするとき、第1の電圧V1から第3の電圧V3を減じた電圧が、データ電極Djを陽極とし走査電極SCiを陰極とする放電開始電圧VFds以上であり、第2の電圧V2から第3の電圧V3を減じた電圧が、データ電極Djを陽極とし走査電極SCiを陰極とする放電開始電圧VFdsとデータ電極Djを陰極とし走査電極SCiを陽極とする放電開始電圧VFsdとの和を超えない。このように設定することにより、強制初期化動作を使用しなくても、実施の形態1と同様の書込み動作を安定に発生させることができる。
 また本実施の形態においては、書込み期間において複数配置された走査電極の一方の走査電極SC1から他方の走査電極SCnへ順に走査パルスを印加する第1のフィールドと、書込み期間において他方の走査電極SCnから一方の走査電極SC1へ順に走査パルスを印加する第2のフィールドとを有する。そして第1のフィールドと第2のフィールドとを交互に用いてパネル10を駆動している。このように駆動する理由について以下に説明する。
 画像信号が画面全体の黒の表示から画面全体の白の表示に切り換わった場合の動作について考える。
 本実施の形態においては、上述したように黒を表示する放電セルでは放電を発生させない。従って各放電セル内部にはプライミングは少なく、放電遅れの大きい状態となっている。この状態で書込み動作を行うと放電遅れが大きくなり書込み放電に失敗する放電セルが多数発生する可能性がある。しかしある放電セルで書込み放電に成功したとすると、その放電セルで発生したプライミングが隣接する放電セルに供給される。従ってその直後に書込み動作を行う放電セルでは放電遅れが小さくなり書込み放電に成功する確率が格段に高くなる。
 第1のフィールドのみを用いてパネルを駆動したと仮定すると、書込み期間において、常に表示画面上部の走査電極SC1から表示画面下部の走査電極SCnへ順に走査パルスが印加される。そのため、書込み放電に成功した放電セルの下に位置する放電セルおよび斜め下に位置する放電セルでは次々に書込み放電に成功し、白の表示に切り換えることができる。しかしながら書込み放電に成功した放電セルの上の放電セルはどこからもプライミングが供給されないので、書込み放電に失敗する確率が高いままである。そのため表示画面の上部では白の表示に切り換えるまでに時間がかかり、画像表示品質が低下する。
 また第2のフィールドのみを用いてパネルを駆動したと仮定すると、書込み期間において、常に表示画面下部の走査電極SCnから表示画面上部の走査電極SC1へ順に走査パルスが印加される。そのため、表示画面の下部では白の表示に切り換えるまでに時間がかかり、画像表示品質が低下する。
 しかし本実施の形態においては、第1のフィールドと第2のフィールドとを交互に用いてパネルを駆動するため、全画面にわたって放電遅れを小さくすることができ、速やかに白の表示に切り換えることができる。
 本実施の形態においては、第1のフィールドでは全てのサブフィールドの書込み期間で走査電極の一方の走査電極SC1から他方の走査電極SCnへ順に走査パルスを印加し、第2のフィールドでは他方の走査電極SCnから一方の走査電極SC1へ順に走査パルスを印加するとして説明した。しかし書込み動作を行う確率の高いサブフィールドである最も輝度重みの小さいSF1の書込み期間において、一方から他方へ書込み動作を行うフィールドと、他方から一方へ書込み動作を行うフィールドとを交互に用いてパネル10を駆動することにより、同様の効果を得ることができる。
 以上のように本実施の形態のパネルの駆動方法では、上述の条件を満たす走査パルスを走査電極に印加することで、強制初期化動作を使用しなくても、放電遅れを小さくかつ安定した書込み動作を行うことができるとともに、コントラストを向上させたパネルの駆動方法およびプラズマディスプレイ装置を提供することできる。
 なお、(実施の形態1)、(実施の形態2)において示した具体的な数値等は単に一例を示したに過ぎず、パネルの特性やプラズマディスプレイ装置の仕様等にあわせて最適に設定することが望ましい。
 本発明は、書込み動作を安定に発生させつつ強制初期化動作を省略して、階調表示に関係しない発光をなくし、コントラストを大幅に向上することができるので、パネルの駆動方法およびプラズマディスプレイ装置として有用である。
 10  パネル
 22  走査電極
 23  維持電極
 24  表示電極対
 32  データ電極
 35  蛍光体層
 40  プラズマディスプレイ装置
 41  画像信号処理回路
 42  データ電極駆動回路
 43  走査電極駆動回路
 44  維持電極駆動回路
 45  タイミング発生回路
 50,80  維持パルス発生回路
 51,81  電力回収回路
 60  傾斜波形電圧発生回路
 61,63  ミラー積分回路
 70  走査パルス発生回路
 85  一定電圧発生回路

Claims (7)

  1. 書込み期間と維持期間と消去期間とを有するサブフィールドを複数用いて1つのフィールドを構成し、走査電極と維持電極とデータ電極とを有する放電セルを複数備えたプラズマディスプレイパネルを駆動するプラズマディスプレイパネルの駆動方法であって、
    前記消去期間は、直前の書込み期間で書込み放電を発生した放電セルのみで選択的に消去放電を発生し、
    かつ、前記維持期間において前記走査電極に印加する維持パルスの低圧側電圧から前記データ電極に印加する電圧を減じた電圧を第1の電圧とし、前記維持期間において前記走査電極に印加する前記維持パルスの高圧側電圧から前記データ電極に印加する電圧を減じた電圧を第2の電圧とし、前記書込み期間において前記走査電極に印加する走査パルスの低圧側電圧から前記データ電極に印加するデータパルスの低圧側電圧を減じた電圧を第3の電圧とするとき、
    前記第1の電圧から前記第3の電圧を減じた電圧が、前記データ電極を陽極とし前記走査電極を陰極とする放電開始電圧以上であり、
    前記第2の電圧から前記第3の電圧を減じた電圧が、前記データ電極を陽極とし前記走査電極を陰極とする放電開始電圧と前記データ電極を陰極とし前記走査電極を陽極とする放電開始電圧との和を超えないことを特徴とするプラズマディスプレイパネルの駆動方法。
  2. 前記走査電極には、前記走査パルスの低圧側電圧以上、前記維持パルスの高圧側電圧以下の電圧を印加することを特徴とする請求項1に記載のプラズマディスプレイパネルの駆動方法。
  3. 前記走査パルスの低圧側電圧の絶対値は、前記維持パルスの高圧側電圧の絶対値よりも大きいことを特徴とする請求項1に記載のプラズマディスプレイパネルの駆動方法。
  4. 走査電極と維持電極とデータ電極とを有する放電セルを複数備えたプラズマディスプレイパネルと、書込み期間と維持期間と消去期間とを有するサブフィールドを複数用いて1つのフィールドを構成するとともに駆動電圧波形を発生して前記プラズマディスプレイパネルの各電極に印加する駆動回路とを備えたプラズマディスプレイ装置であって、
    前記駆動回路は、
    前記消去期間において、直前の書込み期間で書込み放電を発生した放電セルのみで選択的に消去放電を発生させて前記プラズマディスプレイパネルを駆動するとともに、
    前記維持期間において前記走査電極に印加する維持パルスの低圧側電圧から前記データ電極に印加する電圧を減じた電圧を第1の電圧とし、前記維持期間において前記走査電極に印加する前記維持パルスの高圧側電圧から前記データ電極に印加する電圧を減じた電圧を第2の電圧とし、前記書込み期間において前記走査電極に印加する走査パルスの低圧側電圧から前記データ電極に印加するデータパルスの低圧側電圧を減じた電圧を第3の電圧とするとき、
    前記第1の電圧から前記第3の電圧を減じた電圧が、前記データ電極を陽極とし前記走査電極を陰極とする放電開始電圧以上であり、
    前記第2の電圧から前記第3の電圧を減じた電圧が、前記データ電極を陽極とし前記走査電極を陰極とする放電開始電圧と前記データ電極を陰極とし前記走査電極を陽極とする放電開始電圧との和を超えない電圧に設定したことを特徴とするプラズマディスプレイ装置。
  5. 走査電極と維持電極とデータ電極とを有する放電セルを複数備えたプラズマディスプレイパネルを駆動するプラズマディスプレイパネルの駆動方法であって、
    前記走査電極に走査パルスを印加するとともに前記データ電極に書込みパルスを印加して書込み放電を発生する書込み期間と、前記走査電極および前記維持電極に輝度重みに応じた維持パルスを交互に印加して維持放電を発生する維持期間と、前記走査電極および前記維持電極に所定の電圧を印加して消去放電を発生する消去期間と、を有するサブフィールドを複数用いて1つのフィールドを構成し、
    前記消去期間は、直前の書込み期間で書込み放電を発生した放電セルのみで選択的に消去放電を発生し、
    前記複数のフィールドには、最も輝度重みの小さいサブフィールドの書込み期間において複数配置された走査電極の一方の走査電極から他方の走査電極へ順に走査パルスを印加する第1のフィールドと、最も輝度重みの小さいサブフィールドの書込み期間において複数配置された走査電極の前記他方の走査電極から前記一方の走査電極へ順に走査パルスを印加する第2のフィールドとのいずれも備えることを特徴とするプラズマディスプレイパネルの駆動方法。
  6. 前記第1のフィールドと前記第2のフィールドとを交互に用いることを特徴とする請求項5に記載のプラズマディスプレイパネルの駆動方法。
  7. 走査電極と維持電極とデータ電極とを有する放電セルを複数備えたプラズマディスプレイパネルと、前記走査電極に走査パルスを印加するとともに前記データ電極に書込みパルスを印加して書込み放電を発生する書込み期間と、前記走査電極および前記維持電極に輝度重みに応じた維持パルスを交互に印加して維持放電を発生する維持期間と、前記走査電極および前記維持電極に所定の電圧を印加して消去放電を発生する消去期間と、を有するサブフィールドを複数用いて1つのフィールドを構成するとともに駆動電圧波形を発生して前記プラズマディスプレイパネルの各電極に印加する駆動回路とを備えたプラズマディスプレイ装置であって、
    前記駆動回路は、
    前記消去期間において、直前の書込み期間で書込み放電を発生した放電セルのみで選択的に消去放電を発生させて前記プラズマディスプレイパネルを駆動するとともに、
    前記複数のフィールドには、最も輝度重みの小さいサブフィールドの書込み期間において複数配置された走査電極の一方の走査電極から他方の走査電極へ順に走査パルスを印加する第1のフィールドと、最も輝度重みの小さいサブフィールドの書込み期間において複数配置された走査電極の前記他方の走査電極から前記一方の走査電極へ順に走査パルスを印加する第2のフィールドとのいずれも備えることを特徴とするプラズマディスプレイ装置。
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