TWI717855B - 畫素電路及顯示裝置 - Google Patents

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Abstract

一種畫素電路包含發光單元、驅動電晶體、重置電路、補償電路及資料電路。發光單元用以根據驅動電流發光。驅動電晶體用以提供驅動電流至發光單元。重置電路包含耦接於第一電源端之第一重置開關及用以提供第一電壓之第一節點。補償電路用以偵測驅動電晶體之臨界電壓，且補償電路包含耦接於第一節點及第二電源端之間的第一補償開關。當發光單元發光時，第一重置開關與第一補償開關關斷，且第一重置開關、第一節點及第一補償開關形成第一電源端與第二電源端之間的一漏電流路徑以平衡第一電壓。第一電源端與第二電源端用於提供不同電壓。

Description

畫素電路及顯示裝置
本揭示文件是有關於顯示技術，特別是一種適用於低畫面更新頻率的畫素電路及相關的顯示裝置。
現代人注重個人的健康管理，經常使用穿戴式裝置(例如，智慧型手環和手錶)量測各種生理指數。穿戴式裝置通常會長時間在沒有外部電源供應的情況下，執行資料蒐集、儲存與無線通訊等等功能。因此，穿戴式裝置的設計要求之一，是在電力總量受限的情況下盡可能降低電力消耗。降低顯示模組的更新頻率為省電的有效手段之一，但畫素電路的亮度在低更新頻率下會因漏電而逐漸改變，因而降低顯示品質。另外，顯示模組中不同位置的畫素電路還可能因為製程因素而具有不同的元件特性，使得顯示畫面的亮度不均勻。
本揭示文件提供一種畫素電路，包含發光單元、驅動電晶體、重置電路、補償電路以及資料電路。發光單元用以根據驅動電流發光。驅動電晶體包含控制端， 其中驅動電晶體用以提供驅動電流至發光單元。重置電路包含第一重置開關及用以提供第一電壓之第一節點，其中第一重置開關耦接於第一節點與第一電源端之間，且第一節點耦接於驅動電晶體的控制端該補償電路耦接第一節點及驅動電晶體，用以偵測驅動電晶體之臨界電壓，且補償電路包含第一補償開關，其中第一補償開關耦接於第一節點及第二電源端之間。資料電路耦接補償電路，用以提供資料電壓至補償電路。當發光單元發光時，第一重置開關與第一補償開關關斷，且第一重置開關、第一節點及第一補償開關形成第一電源端與第二電源端之間的漏電流路徑以平衡第一電壓，且第一電源端與第二電源端用於提供不同電壓。
本揭示文件亦提供一種顯示裝置，包含閘極驅動器、閘極驅動器、源極驅動器以及多個畫素電路。每個畫素電路耦接於源極驅動器與閘極驅動器。每個畫素電路包含發光單元、驅動電晶體、重置電路、補償電路以及資料電路。發光單元用以根據驅動電流發光。驅動電晶體包含控制端，其中驅動電晶體用以提供驅動電流至發光單元。重置電路包含第一重置開關及用於接收第一電壓的第一節點，其中第一重置開關耦接於第一節點與第一電源端之間，且第一節點耦接於驅動電晶體的控制端。補償電路耦接第一節點及驅動電晶體，用以偵測驅動電晶體之臨界電壓，且補償電路包含第一補償開關，其中第一補償開關耦接於第一節點及第二電源端之間。資料電路耦接補償電 路，用以提供資料電壓至補償電路。當發光單元發光時，第一重置開關與第一補償開關關斷，且第一重置開關、第一節點及第一補償開關形成第一電源端與第二電源端之間的漏電流路徑以平衡第一電壓，且第一電源端與第二電源端用於提供不同電壓。
上述之畫素電路及顯示裝置適用於對漏電量要求嚴格的相關應用，並能產生均勻的亮度。
100‧‧‧畫素電路
110‧‧‧發光單元
120‧‧‧驅動電晶體
130‧‧‧重置電路
140‧‧‧補償電路
150‧‧‧資料電路
PW1‧‧‧第一電源端
PW2‧‧‧第二電源端
PW3‧‧‧第三電源端
PW4‧‧‧第三電源端
PW5‧‧‧第五電源端
SW1‧‧‧第一重置開關
SW2‧‧‧第二重置開關
SW3‧‧‧第一補償開關
SW4‧‧‧第二補償開關
SW5‧‧‧第三補償開關
SW6‧‧‧第四補償開關
SW7‧‧‧資料開關
C1‧‧‧第一補償電容
C2‧‧‧第二補償電容
n1‧‧‧第一節點
n2‧‧‧第二節點
n3‧‧‧第三節點
S1‧‧‧第一驅動訊號
S2‧‧‧第二驅動訊號
S3‧‧‧第三驅動訊號
S4‧‧‧第四驅動訊號
OVDD‧‧‧系統高電壓
OVSS‧‧‧系統低電壓
Vref1‧‧‧第一參考電壓
Vref2‧‧‧第二參考電壓
Vdata‧‧‧資料電壓
T1‧‧‧重置階段
T2‧‧‧補償階段
T3‧‧‧寫入階段
T4‧‧‧發光階段
200‧‧‧畫素電路
210‧‧‧閘極驅動器
220‧‧‧源極驅動器
230‧‧‧畫素電路
240[1]~240[n]‧‧‧資料線
250[1]~250[n]‧‧‧閘極線
CT1[1]~CT1[n]、CT2[1]~CT2[n]、CT3[1]~CT3[n]‧‧‧ 控制訊號
R[1]~R[n]‧‧‧畫素列
第1圖繪示根據本揭示文件之一實施例之畫素電路之電路示意圖。
第2圖繪示根據第1圖之畫素電路工作時之驅動訊號簡化後之時序圖。
第3A圖繪示根據第2圖之畫素電路於重置階段之電路操作示意圖。
第3B圖繪示根據第2圖之畫素電路於補償階段之電路操作示意圖。
第3C圖繪示根據第2圖之畫素電路於寫入階段之電路操作示意圖。
第3D圖繪示根據第2圖之畫素電路於發光階段之電路操作示意圖。
第4圖繪示根據本揭示文件之一實施例之顯示裝置簡化後之功能方塊圖。
下文係舉實施例配合所附圖式作詳細說明，以更好地理解本揭示文件的態樣，但所提供之實施例並非用以限制本揭露所涵蓋的範圍，而結構操作之描述非用以限制其執行之順序，任何由元件重新組合之結構，所產生具有均等功效的裝置，皆為本揭露所涵蓋的範圍。此外，根據業界的標準及慣常做法，圖式僅以輔助說明為目的，並未依照原尺寸作圖，實際上各種特徵的尺寸可任意地增加或減少以便於說明。下述說明中相同元件將以相同之符號標示來進行說明以便於理解。
第1圖為根據本揭示文件之一實施例之畫素電路100之電路示意圖。畫素電路100包含發光單元110、驅動電晶體120、重置電路130、補償電路140以及資料電路150。畫素電路100亦包含第一電源端PW1、第二電源端PW2、第三電源端PW3、第四電源端PW4及第五電源端PW5。重置電路130透過第一電源端PW1接收系統高電壓OVDD；補償電路140透過第二電源端PW2及第三電源端PW3分別接收第一參考電壓Vref1與系統低電壓OVSS；資料電路150透過第四電源端PW4接收資料電壓Vdata或第二參考電壓Vref2。
如第1圖所示，驅動電晶體120包含第一端、第二端與控制端。驅動電晶體120的第二端用於提供驅動電流(如第3D圖所示之驅動電流idri)至發光單元110，使發 光單元110依據驅動電流的大小產生對應的亮度。驅動電晶體120的第一端與控制端耦接補償電路140。
發光單元110之第一端耦接驅動電晶體120之第二端；發光單元110之第二端耦接第五電源端PW5。一些實施例中，發光單元110為有機發光二極體(organic light-emitting diode，簡稱OLED)，且發光單元110之第一端及第二端分別為陽極端及陰極端。一些實施例中，發光單元110為微發光二極體(micro light-emitting diode，簡稱Micro LED)。
一些實施例中，驅動電晶體120為P型或N型薄膜電晶體(thin-film transistor，簡稱TFT)。一些實施例中，驅動電晶體120為P型或N型金屬氧化物半導體場效電晶體(metal-oxide-semiconductor field-effect transistor，簡稱MOSFET)。在本揭示文件之實施例中，驅動電晶體120以P型電晶體為示例說明。驅動電晶體120之第一端為源極，第二端為汲極，且控制端為閘極。
由於驅動電晶體120因材料或製程等因素會有不同的臨界電壓，當使用多個畫素電路100的顯示裝置中，驅動電晶體120之間的臨界電壓可能各不相同。因此，在每一個畫素電路100中，透過補償電路140偵測驅動電晶體120之臨界電壓，能補償驅動電晶體120之變異。藉此，能不影響驅動電晶體120所輸出的驅動電流值，進而使每個發光單元110之亮度達到一致。
如第1圖所示，補償電路140包含多個開關、 電容及節點，分別為第一補償開關SW3、第二補償開關SW4、第三補償開關SW5及第四補償開關SW6；第一補償電容C1及第二補償電容C2；以及第二節點n2及第三節點n3。第一補償開關SW3之第一端耦接驅動電晶體120之控制端，且透過第一節點n1耦接於第一補償電容C1之第二端；第一補償開關SW3之第二端耦接第二電源端PW2。第二補償開關SW4之第一端耦接第一補償電容C1之第一端及第二補償電容之第二端，同時亦耦接於第二節點n2；第二補償開關SW4之第二端耦接驅動電晶體120之第一端。第三補償開關SW5之第一端耦接驅動電晶體120之第二端，同時亦耦接發光單元110之第一端；第三補償開關SW5之第二端耦接第四補償開關SW6之第二端以及第三電源端PW3。第四補償開關SW6之第一端耦接第二補償電容C2之第一端，同時亦耦接於第三節點n3。
重置電路130包含第一重置開關SW1、第二重置開關SW2及第一節點n1。第一重置開關SW1之第一端耦接第一電源端PW1；第一重置開關SW1之第二端透過第一節點n1耦接第一補償電容C1之第一端、第一補償開關SW3之第一端及驅動電晶體120之控制端。第二重置開關SW2之第一端亦耦接第一電源端PW1；第二重置開關SW2之第二端透過第二節點n2耦接第一補償電容C1之第一端、第二補償電容C2之第二端以及第二補償開關SW4之第一端。
資料電路150包含資料開關SW7。資料開關SW7之第一端耦接第四電源端PW4；資料開關SW7之第二 端透過第三節點n3耦接第四補償開關SW6之第一端及第二補償電容C2之第一端。
一些實施例中，第一重置開關SW1、第二重置開關SW2、第一補償開關SW3、第二補償開關SW4、第三補償開關SW5、第四補償開關SW6及資料開關SW7是以P型電晶體來實現。第一重置開關SW1、第二重置開關SW2、第一補償開關SW3、第二補償開關SW4、第三補償開關SW5、第四補償開關SW6及資料開關SW7分別具有第一端、第二端及控制端，其中第一端為源極，第二端為汲極，且控制端為閘極。
第2圖為提供至第1圖的畫素電路100的多個驅動訊號簡化後的時序圖。
多個驅動訊號包含第一驅動訊號S1、第二驅動訊號S2、第三驅動訊號S3及第四驅動訊號S4。請同時參考第2圖與第1圖，第一驅動訊號S1提供至第一重置開關SW1的控制端。第二驅動訊號S2提供至第一補償開關SW3的控制端、第三補償開關SW5的控制端及資料開關SW7的控制端。第三驅動訊號S3提供至第二補償開關SW4的控制端。第四驅動訊號S4提供至第二重置開關SW2的控制端及第四補償開關SW6的控制端。
第3A圖至第3D圖為第1圖之畫素電路100分別於第2圖中的各個操作階段之電路示意圖。如第3A圖至第3D圖所示，第一節點n1用於提供第一電壓V1；第二節點n2用於提供第二電壓V2；第三節點n3用於提供第三電壓 V3，更詳細之說明如下。
在重置階段T1中，第一驅動訊號S1、第三驅動訊號S3及第四驅動訊號S4會提供邏輯高準位(Logic High level，例如可使P型電晶體導通的低電壓)，使對應之第一重置開關SW1、第二重置開關SW2、第二補償開關SW4及第四補償開關SW6為導通狀態。第二驅動訊號S2會提供邏輯低準位(Logic High level，例如可使P型電晶體關斷的高電壓)，使對應之第一補償開關SW3、第三補償開關SW5及資料開關SW7為關斷狀態。
如第3A圖所示，第一重置開關SW1透過第一電源端PW1接收系統高電壓OVDD，且系統高電壓OVDD會經由第一節點n1傳遞至驅動電晶體120之控制端。
第二重置開關SW2透過第一電源端PW1接收系統高電壓OVDD，且系統高電壓OVDD會經由第二節點n2傳遞至驅動電晶體120之第一端。
第四補償開關SW6透過第三電源端PW3接收系統低電壓OVSS，且系統低電壓OVSS會傳遞至第三節點n3。
由於驅動電晶體120之控制端之準位與驅動電晶體120之第一端之準位相同，驅動電晶體120在重置階段中為關斷狀態。
在補償階段T2中，第二驅動訊號S2及第三驅動訊號S3會提供邏輯高準位，使對應之第一補償開關SW3、第二補償開關SW4、第三補償開關SW5及資料開關 SW7為導通狀態；第一驅動訊號S1及第四驅動訊號S4會提供邏輯低準位，使對應之第一重置開關SW1、第二重置開關SW2及第四補償開關SW6為關斷狀態。
如第3B圖所示，第一補償開關SW3透過第二電源端PW2接收第一參考電壓Vref1，使得第一節點n1提供之第一電壓V1之準位由系統高電壓OVDD變化為第一參考電壓Vref1。
此時，驅動電晶體120之控制端之準位為第一參考電壓Vref1，且驅動電晶體120之第一端之準位為系統高電壓OVDD。在補償階段中，第一參考電壓Vref1低於系統高電壓OVDD，驅動電晶體120為導通狀態。
第一補償電容C1經由第二補償開關SW4、驅動電晶體120以及第四補償開關SW5向第三電源端PW3放電。
第一補償電容C1會持續放電，直到當驅動電晶體120之第一端準位(等同於第二節點n2之第二電壓V2)與驅動電晶體120之控制端準位(等同於第一節點n1之第一電壓V1)之差值達到驅動電晶體120的臨界電壓為止。此時，驅動電晶體120之控制端與第一端之電壓差達到臨界電壓，使得驅動電晶體120由原本導通狀態改變為關斷狀態。
換言之，第二節點n2提供之第二電壓V2具有下列《公式1》所示的準位：V2=Vref1+|Vth| 《公式1》
《公式1》中的Vth代表驅動電晶體120之臨界電壓。另外，資料開關SW7會透過第四電源端PW4接收第二參考電壓Vref2，且第二參考電壓Vref2會傳遞至第三節點n3。
另外，第三補償開關SW5透過第三電源端PW3接收系統低電壓OVSS，使得發光單元110之第一端透過第三補償開關SW5接收系統低電壓OVSS，藉以將發光單元110本身之寄生電容之殘存電荷清除。因此，在後續發光階段時，發光單元110能提供較佳的對比度。
在寫入階段T3中，第二驅動訊號S2會提供邏輯高準位，使對應之第一補償開關SW3、第三補償開關SW5及資料開關SW7為導通狀態；第一驅動訊號S1、第三驅動訊號S3及第四驅動訊號S4會提供邏輯低準位，使對應之第一重置開關SW1、第二重置開關SW2、第二補償開關SW4及第四補償開關SW6為關斷狀態。
如第3C圖所示，資料開關SW7透過第四電源端PW4接收資料電壓Vdata，且資料電壓Vdata會傳遞至第三節點n3。
此時，由於第二節點n2處於浮接(floating)狀態，且第一補償電容C1與第二補償電容C2為串聯，使得第二節點n2提供之第二電壓V2變為下列《公式2》所示的準位：
Figure 108136191-A0101-12-0010-1
在發光階段T4中，第三驅動訊號S3及第四驅 動訊號S4會提供邏輯高準位，使對應之第二重置開關SW2、第二補償開關SW4及第四補償開關SW6為導通狀態；第一驅動訊號S1及第二驅動訊號S2會提供邏輯低準位，使對應之第一重置開關SW1、第一補償開關SW3、第三補償開關SW5及資料開關SW7為關斷狀態。
如第3D圖所示，第二重置開關SW2透過第一電源端PW1接收系統高電壓OVDD，且系統高電壓OVDD會傳遞至第二節點n2。驅動電流idri會從第一電源端PW1流經第二重置開關SW2、第二補償開關SW4、驅動電晶體120以及發光單元110而至第五電源端PW5。
此時，由於第一節點n1處於浮接狀態。第一節點n1提供之第一電壓V1(亦即，驅動電晶體120之控制端電壓)會改變為下列《公式3》所示的準位：
Figure 108136191-A0101-12-0011-2
在發光階段中，第一電壓V1低於第二電壓V2，使得驅動電晶體120為導通狀態，進而使得畫素電路100提供如以下《公式4》所示大小的驅動電流idri至發光單元110：
Figure 108136191-A0101-12-0011-3
《公式4》中k代表驅動電晶體120的載子遷移率(carrier mobility)、閘極單位電容大小、以及寬長比三者的乘積。
由於《公式4》不包含驅動電晶體120之臨界電壓參數(Vth)，驅動電晶體120之臨界電壓變異不會影響驅動電流idri之大小。藉此，發光單元110之亮度得以準確控制，使得利用畫素電路100的顯示裝置能產生均勻的亮度，進而提供高品質的顯示畫面。
在畫素電路100之各個開關SW1~SW7皆以電晶體實現之實施例的發光階段中，第一重置開關SW1及第一補償開關SW3可能存在漏電現象。
例如，在發光階段中，第一參考電壓Vref1低於第一電壓V1，因此第一重置開關SW1、第一節點n1與第一補償開關SW3會形成第一電源端PW1及第二電源端PW2之間的一漏電流路徑。第一重置開關SW1之漏電流L1會由第一重置開關SW1流經第一節點n1，並流至第一補償開關SW3。第一補償開關SW3之漏電流L2會由第一補償開關SW3流至第二電源端PW2。
在一些實施例中，漏電流L1與漏電流L2的大小被設計為相等。因此，在發光階段時，即使第一重置開關SW1及第一補償開關SW3存在漏電現象，驅動電晶體120之控制端之電壓準位會平衡於第一電壓V1，使得驅動電晶體120之工作狀態不受影響。
另外，第四補償開關SW6透過第三電源端PW3接收系統低電壓OVSS，使得第三節點n3提供之第三電壓V3固定於系統低電壓OVSS，因此第三節點n3不會處於浮接狀態。藉此，第三節點n3不會影響第二節點n2之電壓值 (第二電壓V2)，進而不影響驅動電流idri之大小。
在某些需要較高設計靈活度的實施例中，第一驅動訊號S1、第二驅動訊號S2、第三驅動訊號S3及第四驅動訊號S4可以具有不同的電壓範圍。
一些實施例中，依據第2圖之驅動訊號提供至第1圖之畫素電路100，並實現第3A圖至第3D圖之操作。表一為畫素電路100的驅動電晶體120的控制端電壓在長度為66.67微秒(ms)的一圖框期間(frame period)的變化量。
Figure 108136191-A0101-12-0013-4
如《表一》所示，在低灰階、中灰階及高灰階顯示條件中，驅動電晶體120之控制端之電壓準位之變異皆很低，表示漏電流L1、L2不會影響驅動電晶體120之工作狀態。因此，畫素電路100適用於對於漏電量要求嚴格的低畫面更新頻率之相關應用。
第4圖為依據本揭示文件一實施例的顯示裝置200簡化後的功能方塊圖。顯示裝置200包含閘極驅動器210、源極驅動器220、多個畫素電路230、多個資料線240[1]~240[n]以及多個閘極線250[1]~250[n]，且多個畫素 電路230排列成多個畫素列R[1]~R[n]，其中n為正整數。
閘極驅動器210用於透過閘極線250[1]~250[n]提供多個控制訊號CT1[1]~CT1[n]、CT2[1]~CT2[n]、CT3[1]~CT3[n]至畫素電路230。源極驅動器220用於透過資料線240[1]~240[n]提供資料電壓(例如，第1圖之資料電壓Vdata)至畫素電路230。
上述元件編號及訊號編號中的索引1~n只是為了方便指稱各別的元件和訊號，並非有意將前述元件和訊號的數量侷限在特定數目。例如，控制訊號CT1[1]會被提供至畫素矩陣230的第一列R[1]，而控制訊號CT1[2]會被提供至畫素矩陣230的第二列R[2]，依此類推。
一些實施例中，畫素電路230是由第1圖的畫素電路100來實現。位於畫素列R[i]的畫素電路230會以控制訊號CT1[i-1]、CT1[i]、CT2[i]與CT3[i]分別作為對應的第一驅動訊號S1、第二驅動訊號S2、第三驅動訊號S3及第四驅動訊號S4，其中i為小於或等於n的正整數。相似地，位於畫素列R[i+1]的畫素電路230會以控制訊號CT1[i]、CT1[i+1]、CT2[i+1]與CT3[i+1]分別作為對應的第一驅動訊號S1、第二驅動訊號S2、第三驅動訊號S3及第四驅動訊號S4，依此類推。
亦即，位於畫素列R[i]的畫素電路230的第一補償開關SW3與位於畫素列R[i+1]的畫素電路230的第一重置開關SW1接收相同的控制訊號CT1[i]。
另外，位於畫素列R[1]的畫素電路230則以控 制訊號CT1[1]、CT2[1]與CT3[1]分別作為對應的第二驅動訊號S2、第三驅動訊號S3及第四驅動訊號S4，並以另一條閘極線(圖中未示)提供的控制訊號CT1[0]作為對應的第一驅動訊號S1。
由上述可知，畫素矩陣230之前後列可以共用控制訊號CT1[1]~CT1[n]中對應的一者。藉此，能簡化閘極驅動器210之電路架構。
在說明書及申請專利範圍中使用了某些詞彙來指稱特定的元件。然而，所屬技術領域中具有通常知識者應可理解，同樣的元件可能會用不同的名詞來稱呼。說明書及申請專利範圍並不以名稱的差異做為區分元件的方式，而是以元件在功能上的差異來做為區分的基準。在說明書及申請專利範圍所提及的「包含」為開放式的用語，故應解釋成「包含但不限定於」。另外，「耦接」在此包含任何直接及間接的連接手段。因此，若文中描述第一元件耦接於第二元件，則代表第一元件可通過電性連接或無線傳輸、光學傳輸等訊號連接方式而直接地連接於第二元件，或者通過其他元件或連接手段間接地電性或訊號連接至該第二元件。
另外，除非說明書中特別指明，否則任何單數格的用語都同時包含複數格的涵義。
雖然本揭示文件已以實施例揭露如上，然其並非用以限定本揭示文件，任何熟習此技藝者，在不脫離本揭示文件之精神和範圍內，當可作各種之更動與潤飾， 因此本揭示文件之保護範圍當視後附之申請專利範圍所界定者為準。
100‧‧‧畫素電路
110‧‧‧發光單元
120‧‧‧驅動電晶體
130‧‧‧重置電路
140‧‧‧補償電路
150‧‧‧資料電路
PW1‧‧‧第一電源端
PW2‧‧‧第二電源端
PW3‧‧‧第三電源端
PW4‧‧‧第三電源端
PW5‧‧‧第五電源端
SW1‧‧‧第一重置開關
SW2‧‧‧第二重置開關
SW3‧‧‧第一補償開關
SW4‧‧‧第二補償開關
SW5‧‧‧第三補償開關
SW6‧‧‧第四補償開關
SW7‧‧‧資料開關
C1‧‧‧第一補償電容
C2‧‧‧第二補償電容
OVDD‧‧‧系統高電壓
OVSS‧‧‧系統低電壓
Vref1‧‧‧第一參考電壓
Vdata‧‧‧資料電壓
n1‧‧‧第一節點
n2‧‧‧第二節點
n3‧‧‧第三節點
S1‧‧‧第一驅動訊號
S2‧‧‧第二驅動訊號
S3‧‧‧第三驅動訊號
S4‧‧‧第四驅動訊號

Claims (9)

  1. 一種畫素電路，包含：一發光單元，用以根據一驅動電流發光；一驅動電晶體，包含一控制端，其中該驅動電晶體用以提供該驅動電流至該發光單元；一重置電路，包含：一第一節點，用以提供一第一電壓，耦接於該驅動電晶體的該控制端；一第一重置開關，包含一第一端、一第二端及一控制端，其中該第一重置開關之該控制端用以接收一第一驅動訊號，該第一重置開關之該第一端用以透過一第一電源端接收一系統高電壓，該第一重置開關之該第二端耦接該第一節點；以及一第二重置開關，包含一第一端、一第二端及一控制端，其中該第二重置開關之該控制端用以接收一第四驅動訊號，該第二重置開關之該第一端用以透過該第一電源端接收該系統高電壓；一補償電路，耦接該第一節點、該第二重置開關之該第二端及該驅動電晶體，用以偵測該驅動電晶體之一臨界電壓，且該補償電路包含一第一補償開關，其中該第一補償開關耦接於該第一節點及一第二電源端之間；以及一資料電路，耦接該補償電路，用以提供一資料電壓至該補償電路；其中當該發光單元發光時，該第一重置開關與該第一 補償開關關斷，且該第一重置開關、該第一節點及該第一補償開關形成該第一電源端與該第二電源端之間的一漏電流路徑以平衡該第一電壓，且該第一電源端與該第二電源端用於提供不同電壓。
  2. 如申請專利範圍第1項所述之畫素電路，其中該第一補償開關包含一第一端、一第二端及一控制端，該第一補償開關之該控制端用以接收一第二驅動訊號，該第一補償開關之該第一端耦接該第一節點，該第一補償開關之該第二端透過該第二電源端接收一預設電壓，其中該補償電路更包含：一第二節點，耦接於該重置電路，用以接收一第二電壓；一第二補償開關，包含一第一端、一第二端及一控制端，其中該第二補償開關之該控制端用以接收一第三驅動訊號，該第二補償開關之該第一端耦接該第二節點，該第二補償開關之該第二端耦接該驅動電晶體之該第一端；一第一補償電容，包含一第一端及一第二端，該補償電容之該第一端耦接該第二節點，該補償電容之該第二端耦接該第一節點；一第三節點，耦接該資料電路，用以接收一第三電壓；一第三補償開關，包含一第一端、一第二端及一 控制端，其中該第三補償開關之該控制端用以接收該第二驅動訊號，該第三補償開關之該第一端用以接收該系統低電壓，該第三補償開關之第二端耦接該驅動電晶體之該第二端；一第四補償開關，包含一第一端、一第二端及一控制端，其中該第四補償開關之該控制端用以接收該第四驅動訊號，該第四補償開關之該第一端耦接該第三節點，該第四補償開關之該第二端用以接收一系統低電壓；以及一第二補償電容，耦接於該第二節點與該第三節點之間。
  3. 如申請專利範圍第2項所述之畫素電路，其中當該發光單元發光時，該第一補償開關與該第三補償開關關斷，該第二補償開關與該第四補償開關導通，且該第三電壓等於該系統低電壓。
  4. 如申請專利範圍第1項所述之畫素電路，其中當該發光單元發光時，該第一重置開關關斷，該第二重置開關導通，且該系統高電壓高於該第一節點之一第一電壓。
  5. 如申請專利範圍第1項所述之畫素電路，其中： 當該發光單元不發光，且該第一重置開關與該第二重置開關導通時，該第一電壓等於該系統高電壓。
  6. 如申請專利範圍第1項所述之畫素電路，其中該資料電路更包含：一資料開關，包含一第一端、一第二端及一控制端，其中該資料開關之該控制端用以接收一第二驅動訊號，該資料開關之該第一端用以接收該資料電壓，該資料開關之該第二端耦接該補償電路。
  7. 一種顯示裝置，包含：一閘極驅動器；一源極驅動器；以及多個畫素電路，耦接於該源極驅動器與該閘極驅動器，且每個該等畫素電路包含：一發光單元，用以根據一驅動電流發光；一驅動電晶體，包含一控制端，其中該驅動電晶體用以提供該驅動電流至該發光單元；一重置電路，包含：一第一節點，用於接收一第一電壓，耦接於該驅動電晶體的該控制端；一第一重置開關，包含一第一端、一第二端及一控制端，其中該第一重置開關之該控制端用以接收一第一驅動訊號，該第一重置開關之該第一端用 以透過一第一電源端接收一系統高電壓，該第一重置開關之該第二端耦接該第一節點；以及一第二重置開關，包含一第一端、一第二端及一控制端，其中該第二重置開關之該控制端用以接收相異於該第一驅動訊號之另一驅動訊號，該第二重置開關之該第一端用以透過該第一電源端接收該系統高電壓；一補償電路，耦接該第一節點、該第二重置開關之該第二端及該驅動電晶體，用以偵測該驅動電晶體之一臨界電壓，且該補償電路包含一第一補償開關，其中該第一補償開關耦接於該第一節點及一第二電源端之間；以及一資料電路，耦接該補償電路，用以提供一資料電壓至該補償電路；其中當該發光單元發光時，該第一重置開關與該第一補償開關關斷，且該第一重置開關、該第一節點及該第一補償開關形成該第一電源端與該第二電源端之間的一漏電流路徑以平衡該第一電壓，且該第一電源端與該第二電源端用於提供不同電壓。
  8. 如申請專利範圍第7項所述之顯示裝置，其中該多個畫素電路包含位於第i列的一第一畫素電路與位於第i+1列的一第二畫素電路，其中i為一正整數，且該第一畫素電路的該第一補償開關的一控制端與該第二畫素 電路的該第一重置開關的一控制端用於接收相同的控制訊號。
  9. 如申請專利範圍第7項所述之顯示裝置，其中當該發光單元發光時，該第一重置開關關斷，該第二重置開關導通，且該系統高電壓高於該第一電壓；其中當該發光單元不發光，且該第一重置開關與該第二重置開關導通時，該第一電壓等於該系統高電壓。
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