TWI632462B - 開關裝置及偵測積體電路匯流排之方法 - Google Patents

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Abstract

本發明係提供一種偵測一積體電路匯流排(I2C)之方法，該方法係利用一基板管理控制器及一硬體監視電路(Hardware Watchdog Circuit)，該方法包括：利用該硬體監視電路偵測一I2C匯流排失效(failure)；判斷該硬體監視電路是否可自動重置在該I2C匯流排上之複數個I2C裝置；若判斷該硬體監視電路可自動重置在該I2C匯流排上之該複數個I2C裝置，利用該硬體監視電路重置該複數個I2C裝置；以及若判斷該硬體監視電路無法自動重置在該I2C匯流排上之該複數個I2C裝置，利用該硬體監視電路回報所偵測到之該I2C匯流排失效至該基板管理控制器，並利用該基板管理控制器處理該I2C匯流排失效。

Description

開關裝置及偵測積體電路匯流排之方法
本發明係有關於匯流排當機偵測(bus hang detection)，特別是有關於利用基板管理控制器(baseboard management controller、BMC)與硬體監視電路(hardware watchdog circuit)以進行匯流排當機偵測，其中硬體監視電路為一複雜可程式化邏輯裝置(complex programmable logic device、CPLD)。
積體電路匯流排(Inter-Integrated Circuit Bus、I2C Bus)之當機(hang)之發生會有幾個原因，例如是高乙太網路傳輸量或伺服器當機(server crash)。一般而言，I2C匯流排之當機偵測係利用一I2C裝置之軟體所執行。然而，這種方法之速度相當緩慢且會花費巨量的系統記憶體及中央處理器之資源。
一般的I2C架構，如第1圖所示，具有一基板管理控制器(BMC)以直接監控I2C裝置。雖有這種組態並不需要系統資源及中央處理器之資源，但這種方法仍會消耗基板管理控制器之資源。此外，軟體之解決方法會讓網路曝露於網路攻擊之下。
因此，需要另一種方法以偵測及處理I2C匯流排之當機。
下列段落係提供本發明一或多個實施例中之簡單摘要以提供本發明技術之基本理解。此摘要並非本發明技術之所有考慮之實施例的延伸概觀，且不是用以分辨所有例子之關鍵或重要元件也不是描述本發明中任何或所有方面的範圍。其目的是以一簡單形式呈現一或多個實施例中之一些概念以做為本發明後述詳細說明部分之前言。
在本發明之第一實施例中，本發明係提供一種偵測一積體電路匯流排(I2C)之方法，該方法係利用一基板管理控制器及一硬體監視電路，該方法包括：利用該硬體監視電路偵測一I2C匯流排失效；判斷該硬體監視電路是否可自動重置在該I2C匯流排上之複數個I2C裝置；若判斷該硬體監視電路可自動重置在該I2C匯流排上之該複數個I2C裝置，利用該硬體監視電路重置該複數個I2C裝置；以及若判斷該硬體監視電路無法自動重置在該I2C匯流排上之該複數個I2C裝置，利用該硬體監視電路回報所偵測到之該I2C匯流排失效至該基板管理控制器，並利用該基板管理控制器處理該I2C匯流排失效。
在本發明之第二實施例中，本發明係提供一種開關裝置，包括：一基板管理控制器；一硬體監視電路；一積體電路匯流排(I2C)，用以連接複數個I2C裝置；以及一中央處理器；其中該硬體監視電路係用以偵測該I2C匯排流之一I2C匯流 排失效，並判斷該硬體監視電路是否可自動重置在該I2C匯流排上之複數個I2C裝置；其中若判斷該硬體監視電路可自動重置在該I2C匯流排上之該複數個I2C裝置，該硬體監視電路係重置該複數個I2C裝置，其中若判斷該硬體監視電路無法自動重置在該I2C匯流排上之該複數個I2C裝置，該硬體監視電路係回報所偵測到之該I2C匯流排失效至該基板管理控制器，且該基板管理控制器係處理該I2C匯流排失效。
100、200‧‧‧系統
101‧‧‧基板管理控制器
102‧‧‧I2C開關
103‧‧‧切換中央處理器
104‧‧‧I2C擴充器
105‧‧‧SFP+模組
106‧‧‧QSFP+模組
107‧‧‧zQSFP+模組
108‧‧‧SFP+模組
201‧‧‧基板管理控制器
202‧‧‧I2C開關
203‧‧‧切換中央處理器
204‧‧‧I2C擴充器
205‧‧‧SFP+模組
206‧‧‧QSFP+模組
207‧‧‧zQSFP+模組
208‧‧‧SFP+模組
209‧‧‧硬體監視電路
301-305‧‧‧步驟
401-409‧‧‧步驟
500‧‧‧電腦系統
510‧‧‧基本輸入/輸出系統
520‧‧‧記憶體
530‧‧‧儲存裝置
540‧‧‧處理器
550‧‧‧網路介面
560‧‧‧北橋
570‧‧‧南橋
580‧‧‧管理控制器
reset_EN‧‧‧重置致能信號
Hang_Alert‧‧‧當機警告信號
I2C Monitor‧‧‧監控信號
BMC_I2C‧‧‧BMC_I2C信號
Hang_Inform‧‧‧當機通知信號
SFP+_I2C_1、SFP+_I2C_2、SFP+_I2C_3、SFP+_I2C_4‧‧‧信號
第1圖係顯示傳統技術中利用基板管理控制器以直接偵測I2C匯流排當機之系統的方塊圖。
第2圖係顯示依據本發明一實施例中利用基板管理控制器及硬體監視電嗄以監控I2C匯流排狀態之系統。
第3圖係顯示依據本發明一實施例中利用硬體監視電路以偵測I2C匯流排狀態之一流程圖。
第4圖係顯示依據本發明另一實施例中利用硬體監視電路以偵測I2C匯流排狀態之一流程圖。
第5圖係顯示本發明中一示範性的電腦系統500之方塊圖。
本揭露係提供了在一伺服器系統中用於管理網路組態之技術，其與本發明之技術有關。在本案技術之多個實施方法係參考圖式並進行說明。在後述說明之實施方式中，為了 便於說明，闡述了許多特定細節以提供一或多個實施方式之充份理解。然而，亦可證明本發明之技術亦可在不具備這些特定細節而實現。在其他例子中，習知之架構與裝置係以方塊圖之方式呈現以增進這些實施例之說明。
本發明之多個實施例係配合所附圖式作詳細說明如下。在後述實施例中，為了便於說明，提出了許多特定細節以提供一或多個實施例之完整理解。然而，本發明在不具備此特定細節的情況下亦可實施。在另一些例子中，在方塊圖中所示的習知的結構及裝置係為了便於說明這些實施例。
如上面之討論，具有極大利益以發展在軟體基礎式或是BMC基礎式外的替代解決方法以偵測及處理I2C匯流排當機(hang)，並可用更快的速度且不需要大量的記憶體及處理資源。綜上所述，本發明係利用在第1~4圖以說明匯流排當機偵測。
第1圖係顯示傳統技術中利用基板管理控制器(BMC)以直接偵測I2C匯流排當機之系統的方塊圖。
第1圖中之開關系統(switch system)100包括一基板管理控制器101、一I2C開關(I2C switch)102、一切換中央處理器(switch CPU)103、I2C擴充器/隔離器(I2C Expander/Isolator))裝置104、及多個與I2C擴充器/隔離器裝置104有關之通道的小封裝熱插拔模組(small-form factor pluggable module、SFC模組)105-108(例如分別為SFP+模組、QSFP+模組、zQSFP+模組、及SFP+模組)。在I2C擴充器裝置104與小封裝熱插拔模組105-108之間的通訊係分別經由I2C信號 SFP+_I2C_1、SFP+_I2C_2、SFP+_I2C_3、SFP+_I2C_4。
依據傳統之技術，基板管理控制器101係利用BMC_I2C信號與I2C開關102進行溝通，並利用Hang_Inform當機通知信號以提供當機資訊(hang information)至切換中央處理器103，如第1圖所示。
在第1圖中之系統，基板管理控制器101係利用監控信號I2C_Monitor連續地監控I2C擴充器裝置104(例如I2C匯流排)以及在I2C擴充器裝置104上之裝置(105-108)。在發生I2C匯流排當機時，基板管理控制器101係可利用重置信號RESET_Device以重置I2C擴充器裝置104。
然而，因為基板管理控制器101直接監控I2C擴充器裝置104以偵測I2C裝置之當機，並判斷何時要發送重置信號以重置這些當機的I2C裝置，此方法係使用基板管理控制器之資源。此亦可能會使用I2C裝置之軟體而將需要駐廠之技術人員來支援。更進一步而言，如上述所，這種利用I2C裝置之軟體的方法之速度相當緩慢，且會花費大量的記憶體及處理資源。
為了表明傳統之偵測方法及處理I2C匯流排當機事件的問題，本發明中之多個實施例係提供一增強系統，其中部份之偵測及處理I2C匯流排當機可移至一硬體監視電路(hardware watchdog circuit)。這種系統可讓偵測及處理I2C匯流排當機事件的速度更快，例如第2圖所示。
第2圖係顯示依據本發明一實施例中利用基板管理控制器及硬體監視電路以監控I2C匯流排狀態之系統。
類似於第1圖中之系統100，第2圖中之系統200(例如為一開關系統)包括一基板管理控制器201、一I2C開關202、一切換中央處理器203、I2C擴充器(或隔離器)裝置204、及多個與I2C擴充器/隔離器裝置204有關之通道的小封裝熱插拔模組205-208(例如分別為SFP+模組、QSFP+模組、zQSFP+模組、及SFP+模組)。在一實施例中，在I2C擴充器裝置204與小封裝熱插拔模組205-208之間的通訊係經由I2C信號SFP+_I2C_1、SFP+_I2C_2、SFP+_I2C_3、SFP+_I2C_4。
然而，不同於第1圖之系統100，第2圖中之系統200更包括一硬體監視電路209，且至少有部份之I2C匯流排當機之偵測及處理會被轉至硬體監視電路209。如第2圖之實施例，基板管理控制器201係利用BMC_I2C信號以與I2C開關202進行溝通，並利用Hang_Inform當機通知信號以提供當機資訊至切換中央處理器203。然而，在第1圖中係利用基板管理控制器101直接監控I2C擴充器裝置104，在本發明第2圖中之硬體監視電路209係取代了基板管理控制器201以監控I2C擴充器裝置204。基板管理控制器201係用以利用一重置致能信號reset_EN，其可致能或授權硬體監視電路209以自動重置I2C擴充器裝置204。依據重置致能信號reset_EN，硬體監視電路209可利用其本身的重置信號RESET_Device在適當延遲下以自動重置I2C裝置204。
若硬體監視電路209並未被致能以自動重置I2C擴充器裝置204，取而代之地，基板管理控制器201會利用一Hang_Alert當機警告信號從硬體監視電路209接收當機資訊。
硬體監視電路209更可利用I2C Monitor監控信號以偵測SM/I2C匯流排之時鐘線/資料線(clock line/data line)及SCL/SDA腳位以判斷一I2C匯流排鎖定(I2C bus lock)是否發生。此資訊亦會即時地被硬體監視電路209所接收。依據所接收到的資訊，Hang_Alert當機警告信號會被傳送至基板管理控制器201，就算硬體監視電路209已被授權可重置I2C擴充器裝置204。
在另一實施例中，硬體監視電路209可依據所接收到之信號以接收一區域網路喚醒(wake on LAN、WOL)信號，其中該區域網路喚醒信號可觸發硬體監視電路209以傳送一警告信號至基板管理控制器201以重置當機的I2C裝置。
在硬體監視電路209無法清除或解決I2C匯流排當機或是硬體監視電路209未被致能以產生重置信號RESET_Device信號之情形下，基板管理控制器201接著會繼續搜尋程序(以尋找造成當機或鎖定的裝置或原因)以決定其損害並透過Hang_Inform當機通知信號以回報資訊至切換中央處理器203。
因此，依此方式，基板管理控制器201並不需要持續地監控I2C擴充器裝置204，並取而代之地讓硬體監視電路209監控I2C擴充器裝置204並提供任何當機警告至基板管理控制器201以進行更進一步的處理。在一實施例中，雖然第2圖中之系統200係繪示了一分開的硬體監視電路209，這個硬體監視電路209可被整合至系統200中之其他元件，例如是基板管理控制器201。
第3圖係顯示依據本發明一實施例中利用硬體監視電路以偵測I2C匯流排狀態之一流程圖。
第3圖之流程係由步驟301開始，其中硬體監視電路209係偵測一I2C匯流排鎖定(lock)。舉例來說，請再參考第2圖，硬體監視電路209可偵測與I2C_Monitor監控信號有關之不正常情況。在偵測到I2C匯流排鎖定之後，硬體監視電路209係判斷是否可自動重置I2C擴充器裝置204。舉例來說，請再參考第2圖，硬體監視電路209係決定是否從基板管理控制器201接收到一重置致能信號reset_EN。
若判斷硬體監視電路209可自動重置I2C擴充器裝置204，硬體監視電路209係傳送重置信號(步驟303)，且該流程係回到步驟301以監控未來的I2C匯流排是否產生鎖定。然而，若判斷硬體監視電路209無法自動重置I2C擴充器裝置204，硬體監視電路209回報I2C匯流排鎖定之情形至基板管理控制器201(步驟304)。舉例而言，如上所述，硬體監視電路209可傳送一當機警告信號Hang_Alert至基板管理控制器201。
最後，在步驟305，I2C匯流排失效的進一步處理會被移交至基板管理控制器201。上述處理可包括利用基板管理控制器201對連接至I2C匯流排之任何I2C裝置進行重置或故障排除。
在步驟305中之處理更包括利用基板管理控制器以通知處理結果至一中央處理器並記錄失效通道(failed channels)至中央處理器。關於利用基板管理控制器以處理I2C匯流排失效之細節，將於第4圖之實施例中進行說明。
第4圖係顯示依據本發明另一實施例中利用硬體監視電路以偵測I2C匯流排狀態之一流程圖。
第4圖之流程係開始於步驟401，其中在系統200中之硬體監視電路209例如為一複雜可程式化邏輯裝置(CPLD)，係偵測I2C匯流排狀態。在步驟402，判斷是否發生一I2C/SM匯流排鎖定(lock)。若未發生，則返回執行步驟401，且硬體監視電路209係持續監控I2C匯流排狀態。
然而，若在步驟402偵測到I2C/SM匯流排鎖定，流程係前進至步驟403以判斷硬體監視電路209是否已致能而可執行自動重置I2C擴充器裝置204。若硬體監視電路209已被致能以自動重置I2C擴充器裝置204，I2C擴充器裝置204會被釋放(release)或重置(步驟404)，流程會回到步驟401，且硬體監視電路209係重新偵測I2C匯流排狀態。此處理係類似於第3圖。
然而，若在步驟403中硬體監視電路209未被致能以自動重置I2C擴充器裝置204，該流程係前進至步驟405，且硬體監視電路209係傳送一警告信號至基板管理控制器201，基板管理控制器201接著執行I2C/SM匯流排失效搜尋程序(以尋找造成當機或鎖定的裝置或原因)。
由基板管理控制器201所執行之失效搜尋程序係經由一迴圈執行，其中各I2C擴充器204、I2C裝置及任何有關之通道，會被一一選擇(步驟407)並隔離，而後其對應之I2C/SM匯流排狀態會被檢查以判斷該通道是否正常(代表其並非導致I2C匯流排當機)(步驟408)。若在步驟408中判斷該通道是正常的(代表並非導致I2C匯流排當機)，該流程係回到步驟407，選 擇下一個I2C裝置及/或通道。在一些實施例中，基板管理控制器201係用以嘗試並重置I2C裝置，並藉由重置該導致I2C匯流排鎖定之I2C裝置及/或通道以清除I2C匯流排鎖定。
此處理係用於所有的I2C擴充器或隔離器裝置及其所有的通道。當在步驟408判斷一裝置或其通道並不正常，此資訊會被傳送至切換中央處理器203並記錄(步驟409)。此資訊可被維持在一記錄檔中以供未來使用。選擇性地，此資訊可被中央處理器所使用以產生給使用者之警告。
第5圖係顯示本發明中一示範性的電腦系統500之方塊圖。電腦系統500係包括一處理器540、一網路介面550、一管理控制器580、一記憶體520、一儲存裝置530、一基本輸入/輸出系統(BIOS)510、一北橋560、及一南橋570。
舉例來說，電腦系統500可為一伺服器(例如在資料中心中之許多機架式伺服器中之一者)或一個人電腦。處理器(例如為中央處理器)540可為在一主機板上之一晶片，其可接收並執行儲存於記憶體520中之可程式化之指令。處理器540可為具有單一處理核心之一單一中央處理器、具有多處理核心之單一中央處理器、或多個中央處理器。一或多個匯流排(未繪示)可傳送在多個電腦元件之間的指令及應用程式資料，例如是處理器540、記憶體520、儲存裝置530、及網路介面550。
記憶體520可包括用以暫時地或永久地儲存資料或程式之任何物理性裝置，例如是多種形式之隨機存取記憶體(RAM)。儲存裝置530可包括用於非揮發性資料儲存之任何物理性裝置，例如是硬碟機或快閃磁碟機。儲存裝置530比記憶 體520具有較大的容量，且可在每單元之儲存更具有經濟效益，但亦會具有較慢的傳輸速度。
基本輸入/輸出系統510可包括一基本輸入/輸出系統或其繼承者或等效元件，例如是可延伸韌體介面(Extensible Firmware Interface、EFI)或是統一可延伸韌體介面(Unified Extensible Firmware Interface、UEFI)。基本輸入/輸出系統510可包括位於電腦系統500中一主機板上之一BIOS晶片，其係用以儲存一BIOS軟體程式。基本輸入/輸出系統510係儲存了當電腦系統500第一次啟動時所需執行的組態集合。BIOS韌體及BIOS組態係儲存於一非揮發性隨機存取記憶體512或是一唯讀記憶體，例如是快閃記憶體。快閃記憶體係為一非揮發性電腦儲存媒體，其可電性地抹除及重新程式化。
每當電腦系統500啟動時，BIOS 510可被載入並執行一程式序列。BIOS 510可依據組態集合以辨識、初始化、及測試目前電腦系統中之硬體。BIOS 510可在電腦系統500執行自我測試，例如是開機自我測試(Power-on-Self-Test)。該自我測試可測試許多硬體元件之功能性，例如是硬體、光碟讀取裝置、散熱裝置、記憶體模組、或擴充卡等等。BIOS 510可在記憶體320中進行定址及分配一區域以儲存一作業系統。BIOS 510可將電腦系統之控制權交給作業系統。
電腦系統500中之BIOS 510可包括一BIOS組態設定，其係定義了BIOS 510如何控制電腦系統500中之不同硬體元件。BIOS組態設定可決定在電腦系統500中之那些硬體元件需要啟動。BIOS 510可提供一介面(例如是BIOS設定工具)，可 供設定不同的參數，其可與一BIOS預設組態之參數不同。舉例來說，使用者(例如是管理者)，可使用BIOS 510以指定時脈及匯流排之速度、指定與電腦系統連接之週邊裝置、指定監控電腦系統之健康狀態(例如是風扇轉速及CPU溫度限制)、以及指定其他不同參數，其可影響電腦系統之整體效能及功耗使用。
管理控制器580可為一特別微控制器(microcontroller)嵌入至電腦系統500之主機板。舉例來說，管理控制器580可為一基板管理控制器或一機架式伺服器管理控制器(rack server management controller、RMC)。管理控制器580可管理在系統管理軟體及平台硬體之間的介面。建置於在電腦系統500中之不同類型的感測器可回報參數至管理控制器580，例如是溫度、散熱風扇轉速、電源狀態、作業系統狀態等等。管理控制器580可監控這些感測器，並在若有任何參數不在預設限制內時，並可利用網路傳送警告至管理者，藉以通知電腦系統中可能的失誤(failure)。管理者亦可遠端與基板管理控制器580進行溝通以採取一些正確的行動，例如是重新啟動或是關閉再啟動電腦系統以回復功能。
北橋560可為在主機板上之一晶片，且可直接連接至處理器540或整合至處理器540中。在一些實施例中，北橋560及南橋570可合併至單一晶片。北橋560及南橋570可管理在處理器540及在主機板上之其他元件之通訊。相較於南橋570，北橋560可管理需要較高效能之工作(task)。北橋560可管理在處理器540、記憶體520、及視訊控制器(未繪示)之間的通訊。在一些實施例中，北橋560可包括一視訊控制器。
南橋570可為在連接至北橋560之主機板上的一晶片，但不同於北橋560，南橋570並非直接連接至處理器540。南橋570可管理電腦系統500之輸入/輸出功能(例如：音訊功能、BIOS、USB、SATA、PCI、PCI-X、PCI Express匯流排、ISA匯流排、SPI匯流排、eSPI匯流排、系統管理匯流排等等)。南橋570可連接至或可包括管理控制器580、直接記憶體存取(DMA)控制器、程式中斷控制器、及即時時鐘。
在本發明中所繪示的邏輯方塊、模組、及電路可由一般用途處理器、數位信號處理器(DSP)、特殊應用積體電路(ASIC)、現場可程式化的閘陣列(FPGA)或其他可程式化邏輯裝置、離散閘或電晶體邏輯、離散硬體元件、或其任意組合用以設計來執行本發明之函式或功能。一般用途處理器可為一微處理器、亦可為任意傳統的處理器、控制器、微控制器或狀態機。處理器亦可用運算裝置之一組合所實現，例如是一數位信號處理器及一微處理器之組合、複數個微處理器、一或多個微處理器再加上一數位信號處理核心、或其他此類組合。
在本發明中之方法或演算法之運算可直接用硬體、由一處理器所執行之一軟體模組、或其組合所實現。軟體模組可儲存於隨機存取記憶體、快閃記憶體、唯讀記憶體、EPROM、EEPROM、暫存器、硬碟、可移除式磁碟、CD-ROM、或其他已知類型的儲存媒體。一示範性的儲存媒體係耦接至處理器，使得該處理器可由該儲存媒體讀取或寫入資訊。在另一實施例中，儲存媒體可被整合至處理器。該處理器及儲存媒體可在一應用導向積體電路(ASIC)中。該應用導向積體電路可位 於使用者終端裝置中。另一方面，該處理器及儲存媒體可位於使用者終端裝置之離散元件中。
在一或多個示範性的設計中，所揭露之功能可由硬體、軟體、韌體、或其任意組合所實現。若由軟體所實現，該功能可被儲存或以在一非暫態性(non-transitory)之電腦可讀取媒體上之一或多個指令或程式碼進行傳送。非揮發性電腦可讀取媒體包括任意媒體可將一電腦程式由一處傳送至另一處。儲存媒體可為任意可取得之媒體，其可由一般用途處理器或特殊用途處理器所取。在一非限定之實施例中，這類的電腦可讀取媒體包括隨機存取記憶體、唯讀記憶體、EEPROM、CD-ROM、或其他光學磁碟儲存裝置、磁性磁碟儲存裝置、或其他類型之媒體可用以攜帶或儲存以指令或資料結構之形式的程式碼，其可由一一般用途處理器或一特殊用途處理器所存取。在此處所揭露之磁碟(disk)及碟片(disc)可包括CD、雷射碟(laser disc)、光學碟、DVD、軟碟、藍光碟(blue ray disc)，其中當這些碟用雷射光學讀取資料時，這些碟片通常可磁性地重製資料。上述所揭示之任意組合亦包括於非暫態性之電腦可讀取媒體中。
本發明雖以較佳實施例揭露如上，然其並非用以限定本發明的範圍，任何所屬技術領域中具有通常知識者，在不脫離本發明之精神和範圍內，當可做些許的更動與潤飾，因此本發明之保護範圍當視後附之申請專利範圍所界定者為準。

Claims (8)

  1. 一種偵測一積體電路匯流排(I2C)之方法，該方法係利用一基板管理控制器及一硬體監視電路，該方法包括：利用該硬體監視電路偵測一I2C匯流排失效；判斷該硬體監視電路是否可自動重置在該I2C匯流排上之複數個I2C裝置；若判斷該硬體監視電路可自動重置在該I2C匯流排上之該複數個I2C裝置，利用該硬體監視電路重置該複數個I2C裝置；以及若判斷該硬體監視電路無法自動重置在該I2C匯流排上之該複數個I2C裝置，利用該硬體監視電路回報所偵測到之該I2C匯流排失效至該基板管理控制器，並利用該基板管理控制器處理該I2C匯流排失效，其中該處理步驟包括：利用該基板管理控制器重置該複數個I2C裝置；若重置該複數個I2C裝置無法解決該I2C匯流排失效，測試該複數個I2C裝置以判斷該I2C匯流排失效之原因；以及回報一處理結果至一中央處理器。
  2. 如申請專利範圍第1項所述之方法，其中該判斷步驟包括：在該硬體監視電路偵測是否從該基板管理控制器接收到一重置致能信號；以及若接收到該重置致能信號，判斷該硬體監視電路可自動重置該複數個I2C裝置。
  3. 如申請專利範圍第1項所述之方法，其中該偵測步驟包括：利用該硬體監視電路偵測該I2C匯流排之一時鐘線及一資料線(SCL/SDA腳位)。
  4. 如申請專利範圍第1項所述之方法，其中該測試步驟包括：依據下列步驟以依序評估該複數個I2C裝置中之每一者：隔離在該複數個I2C裝置中所選擇之一者；在隔離後檢查該I2C匯流排狀態；以及若判斷在該複數個I2C裝置中之一者所相應之該I2C匯流排狀態為不正常，記錄在該複數個I2C裝置中之該者之該I2C匯流排失效，其中該評估步驟係用於在該複數個I2C裝置中所選擇之該者有關之所有通道。
  5. 一種開關裝置，包括：一基板管理控制器；一硬體監視電路；一積體電路匯流排(I2C)，用以連接複數個I2C裝置；以及一中央處理器；其中該硬體監視電路係用以偵測該I2C匯排流之一I2C匯流排失效，並判斷該硬體監視電路是否可自動重置在該I2C匯流排上之複數個I2C裝置；其中若判斷該硬體監視電路可自動重置在該I2C匯流排上之該複數個I2C裝置，該硬體監視電路係重置該複數個I2C裝置，其中若判斷該硬體監視電路無法自動重置在該I2C匯流排上之該複數個I2C裝置，該硬體監視電路係回報所偵測到之該I2C匯流排失效至該基板管理控制器，且該基板管理控制器係處理該I2C匯流排失效，其中該基板管理控制器更用以重置該複數個I2C裝置，且若重置該複數個I2C裝置無法解決該I2C匯流排失效，測試該複數個I2C裝置以判斷該I2C匯流排失效之原因，其中該基板管理控制器更用以回報一處理結果至一中央處理器。
  6. 如申請專利範圍第5項所述之開關裝置，其中在該硬體監視電路更用以偵測是否從該基板管理控制器接收到一重置致能信號，且若接收到該重置致能信號，判斷該硬體監視電路可自動重置該複數個I2C裝置。
  7. 如申請專利範圍第5項所述之開關裝置，其中該硬體監視電路更用以偵測該I2C匯流排之一時鐘線及一資料線(SCL/SDA腳位)。
  8. 如申請專利範圍第5項所述之開關裝置，其中該測試步驟包括：依據下列步驟以依序評估該複數個I2C裝置中之每一者：隔離在該複數個I2C裝置中所選擇之一者；在隔離後檢查該I2C匯流排狀態；以及若判斷在該複數個I2C裝置中之一者所相應之該I2C匯流排狀態為不正常，記錄在該複數個I2C裝置中之該者之該I2C匯流排失效，其中該基板管理控制器係用以在判斷該硬體監視電路無法自動重置該I2C匯流排時，處理在該複數個I2C裝置中所選擇之該者有關之所有通道。
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