SU463234A1 - Устройство делени времени циклов на дробное число интервалов - Google Patents
Устройство делени времени циклов на дробное число интерваловInfo
- Publication number
- SU463234A1 SU463234A1 SU1926967A SU1926967A SU463234A1 SU 463234 A1 SU463234 A1 SU 463234A1 SU 1926967 A SU1926967 A SU 1926967A SU 1926967 A SU1926967 A SU 1926967A SU 463234 A1 SU463234 A1 SU 463234A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- trigger
- shift register
- intervals
- output
- inputs
- Prior art date
Links
Landscapes
- Manipulation Of Pulses (AREA)
Description
Изобретение относитс к вычислительной технике и системе передачи данных, может быть использовано в электронных цифровых вычислительных машинах, электронных приемно-нередающих устройствах, в частности дл цикловых распределителей, дел щих цикл на дробное число интервалов с кратностью 0,5. Известны устройства делени времени цикла на дробиое число интервалов с кратностью 0,5, содержащие регистр сдвига, триггер циклов , входы которого соединены с выходами пускового устройства и источника входной частоты . В известиой схеме вход циклового триггера, не управл етс , что влечет за собой больщое количество логических элементов схемы, а следовательно больщие потребл емую мощность и габариты. Цель изобретени - повыщение эффективности и уменьщение потребл емой мощности- достигаетс благодар введению в схему устройства управл ющего триггера, вход которого подключен к выходу чейки соответствующего разр да регистра сдвига, выходы унравл ющего триггера и триггера циклов подключены ко входам двух дополнительно введенных схем «И, а выходы схем «И соединены со входом регистра сдвига. На фиг. 1 приведена блок-схема устройства; на фиг. 2 - временна диаграмма его работы. Устройство делени времени цикла на дробиое число интервалов с кратностью 0,5 содерл нт управл ющий триггер 1, схемы «И 2, цикловой триггер 3, регистр сдвига 4, пусковое устройство 5, источник входной частоты 6. Выходы а и б управл ющего триггера 1 соединены со входами а и б схем «И 2, выходы которых объединены. Вторые входы схем «И соединены с вы.ходам; а и б циклового триггера 3. Общий выход схем «1Ь соединен со счетными входами триггеров регистра сдвига 4. Дл получени заданного делени цикла на т + 0,5 интервалов, где т - любое целое число , регистр сдвига должен состо ть из т+ триггера. Управл ющие входы циклового триггера 3 подсоединены к пусковому устройству 5, а счетный вход св зан с источником входной частоты 6. Счетный в.чод триггера 1 может быть соединен с выходом любого триггера регистра сдвига. На фиг. 1 показано соединение, например, с триггером т. Работает устройство следующим образом. При запуске схемы от пускового устройства 5 на цнкловой триггер 3 поступает сигнал разрещени счета, и с первым же чмиульсом от источника входной частоты 6 на входы схем «И 2 поступает импульс с триггера 3. На второй вход одной пз схем «И в завпсплюстп от положени управл ющего триггера 1 (например 3 а) поступает управл ющий потенциал, который при совпадении с нмиульсом триггера 3 выдает через схему 3 а разрещающий потенциал на счетные входы всех триггеров регистра сдвига единицы 4.
Тем самым на выходе 4 а триггера регистра сдвига единицы 4 по вл етс потенциал. С приходом на триггер 3 второго импульса входной частоты он нсребрасывастс li другое положение . При этом со схем «И 2 па счетиые входы триггеров регистра сдвига 4 прскр ицаетс подача разрентающего потенциала.
С приходом третьего импульса входной частоты на счетных входах триггеров регистра сдвига 4 вновь по вл етс разрешающпй перепад , а с выхода 4 а триггера регистра сдвига 4 снимаетс потенциал, длител1 ность которого таким образом равна двум периодам входной частоты. В момент пропадани иотенцнала на выходе трнггера 1 потепцпал по вл етс иа выходе триггера 4 б регистра сдвига единиц 4.
Длительность этого потенциала при дальнейшей работе расиределител также равна двум перподам входной частоты и т. д.
С приходом 2 т-1-вого имиульса входной частоты на выходе т триггера, аналогично описанному выше, по вл етс потенциал, длптельность которого равна двум периодам входной частоты, т. е. определ етс прпходом 2 /п+ 1-го импульса.
С приходом этого импульса в выхода т-иого триггера регистра сдвига едпниц 4 на триггер 1 подаетс иереключаю1ций импульс, а значит
сцпмаетс разрешающий со счетиых входов триггеров регистра сдвига 4. В дальнейшем разрешающий иотенциал выдаетс схемой 3 б, котора работает на совиадении четных импульсов 2 т, 2 m-f 2 и т. д. входной частоты с разрешающим потенциалом триггера 1. Работа от схемы 3 б продолжаетс в течение врелтени полного цикла, т. е. до ирихода на триггер 1 следуюи его импульса от т-ного триггера. Таким образом, длптел1)Пость иотеицпала на выходе /7г--1-в()го триггера равна , в отличие от иредыдущих тр1пте{)ов, одному периоду входной частот, т. е. времени между импул1 еами 2 т- и илшульсом 2 т+ 2.
В результате иродолжительность ц;1кла делитс на /п + 0,5 интервалов.
П р е д м е т и з о б р е т е и и
Устройство делени времени цикла на дробное число интервалов с кратностью 0,5, содержащее регистр сдвига, триггер циклов, выходы которого соединены с выходам пускового устройства и источника входной частоты, отличающеес тем, что, с целью повышени эффективности и уменьшени потребл емой мощности, в него введен управл ющпй трпггер, вход которого подключен к выходу чейки еоответствующего разр да регистра сдвига, а выходы управл ющего триггера и триггера циклов подключены ко входам двух дополнительно введенных схем «I-i, а выходы схем «И соединены со входами регистра сдвига.
Л П , I
Jrjg nLJр6- :
т
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU1926967A SU463234A1 (ru) | 1973-06-11 | 1973-06-11 | Устройство делени времени циклов на дробное число интервалов |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU1926967A SU463234A1 (ru) | 1973-06-11 | 1973-06-11 | Устройство делени времени циклов на дробное число интервалов |
Publications (1)
Publication Number | Publication Date |
---|---|
SU463234A1 true SU463234A1 (ru) | 1975-03-05 |
Family
ID=20555111
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU1926967A SU463234A1 (ru) | 1973-06-11 | 1973-06-11 | Устройство делени времени циклов на дробное число интервалов |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU463234A1 (ru) |
-
1973
- 1973-06-11 SU SU1926967A patent/SU463234A1/ru active
Similar Documents
Publication | Publication Date | Title |
---|---|---|
GB1227829A (ru) | ||
US3284715A (en) | Electronic clock | |
SU463234A1 (ru) | Устройство делени времени циклов на дробное число интервалов | |
US3155962A (en) | System for representing a time interval by a coded signal | |
SU485437A1 (ru) | Генератор циклов | |
SU1272342A1 (ru) | Устройство дл вычислени показател экспоненциальной функции | |
SU482897A1 (ru) | Пересчетна схема | |
SU1076892A1 (ru) | Генератор функций Уолша | |
SU1462282A1 (ru) | Устройство дл генерировани синхроимпульсов | |
SU437061A1 (ru) | Генератор цепеей маркова | |
SU372690A1 (ru) | РАСПРЕДЕЛИТЕЛЬ ИМПУЛЬСОВЭСЕСс;;;-х:':...о, "'1 [ЙЙШ'ШО^Я;;;:';;;-',:,! | |
SU437225A1 (ru) | Триггерное устройство | |
SU260961A1 (ru) | УСТРОЙСТВО дл ФОРМИРОВАНИЯ СЕРИЙ ПРЯМОУГОЛЬНЫХ ИМПУЛЬСОВ | |
SU781798A1 (ru) | Генератор равномерно распределенных случайных сигналов | |
SU771619A1 (ru) | Устройство дл допускового контрол | |
RU1775854C (ru) | Управл емый делитель частоты следовани импульсов | |
SU546937A1 (ru) | Перестраиваемый фазо-импульсный многоустойчивый элемент | |
SU387524A1 (ru) | Распределитель импульсов | |
SU590860A1 (ru) | Устройство синхронизации псевдошумовых сигналов | |
SU1280610A1 (ru) | Устройство дл сравнени чисел | |
SU968797A1 (ru) | Устройство дл ввода информации | |
SU1471188A1 (ru) | Устройство дл ввода информации | |
SU395989A1 (ru) | Накапливающий двоичный счетчик | |
SU1056134A1 (ru) | Устройство дл допускового контрол параметров объектов | |
SU1663760A1 (ru) | Генератор импульсов |