SU1786672A1 - Уctpoйctbo abtobыбopa - Google Patents
Уctpoйctbo abtobыбopa Download PDFInfo
- Publication number
- SU1786672A1 SU1786672A1 SU914898837A SU4898837A SU1786672A1 SU 1786672 A1 SU1786672 A1 SU 1786672A1 SU 914898837 A SU914898837 A SU 914898837A SU 4898837 A SU4898837 A SU 4898837A SU 1786672 A1 SU1786672 A1 SU 1786672A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- inputs
- outputs
- input
- output
- error density
- Prior art date
Links
Landscapes
- Radio Transmission System (AREA)
Description
Устройство относится к радиотехнике и может быть использовано для обнаружения и коммутации информационного сигнала в системах обработки с двумя цифровыми выходами, на одном из которых находится информационный, а на другом - ложный сигнал, причем происходит взаимозамена сигналов на выходах по псевдослучайному закону.
Известны устройства для приема информации, передаваемой по двум параллельным каналам связи, и устройство для сложения разнесенных сигналов. Недостатком этих-устройств является их ориентированность на прием одинаковой информации по двум параллельным каналам, в результате чего их применение в указанной области использования приводит к низкой помехоустойчивости приема.
Наиболее близко к предлагаемому устройство для приема информации по двум параллельным каналам связи в системе передачи данных с обратной связью, содержащее первый и второй блоки повышения достоверности, управляющие выходы которых соединены с входами первого и второго анализаторов плотности ошибок соответственно, логическую схему, коммутирующие элементы.
Особенность работы устройства, принятого за прототип, заключается в использовании априорного знания о наличии двух каналов с синхронными информационными потоками, ошибки в которых взаимно некоррелированы. Для определения блока с искаженной информацией используются блоки повышения достоверности (БПД). Потребителю выдается блок с безошибочной информацией с одного из накопителей через ключ и регистр выдачи информации. В случае возникновения необнаруживаемой ошибки в одной из ветвей разнесения и отсутствии ошибок в другой ветви БПД не регистрируют ошибок, а сумматор по модулю два фиксирует наличие несовпадений, свидетельствующее о наличии ошибок по крайней мере в одной из ветвей разнесения. Для определения того, какой из анализируемых в ветвях разнесения блоков информации скоммутировать потребителю, используются анализаторы плотности ошибок в ветвях разнесения (АПО). При этом потребителю выдается блок информации из той ветви разнесения, где плотность ошибок ниже порогового уровня.
Основной'недостаток прототипа - его ориентированность на наличие двух параллельных каналов связи с одинаковой информацией и некоррелированными ошибками. Когда в одном из каналов присутствует ин формационный, а в другом-ложный сигнал, происходит частая взаимозамена этих сигналов, такое устройство работает неэффективно, даже если из его состава исключить сумматор по модулю два и непосредственно связанные с ним элементы схемы.
Цель изобретения - повышение помехоустойчивости путем быстрого обнаружения полезного сигнала. Ожидаемый положительный эффект - уменьшение вероятности возникновения ошибок на выходе устройства.
Для достижения поставленной цели в устройство для приема информации по двум параллельным каналам сйязи в системе передачи данных с решающей обратной связью, содержащее первый и второй блоки повышения достоверности, входы которых являются соответственно первым и вторым входами устройства, первый и второй сумматоры плотности сшибок, каждый из которых содержит последовательно соединенные регистр, реверсивный счетчик и декодер, выход которого является выходом анализатора плотности ошибок, вход регистра объединен с дополнительным входом реверсивного счетчика и является первым входом анализатора плотности ошибок, а на входы Сброс регистра поданы тактовые импульсы с второго входа анализатора плотности ошибок, вторые входы анализаторов плотности ошибок объединены и являются тактовым входом устройства, элемент И, введены дополнительно компаратор, второй элемент И, элемент И-НЕ, триггер и коммутатор, причем выходы реверсивного счетчика каждого анализатора плотности ошибок являются его дополнительными выходами, которые соединены с соответствующими входами компаратора, выходы которого соединены с первыми входами первого и второго элементов И, вторые входы которых соединены с выходом элемента И-НЕ, выходы которого соединены с выходами анализаторов плотности ошибок, выходы первого и второго элементов И соединены соответственно с R- и Sвходами триггера, выход которого соединен с управляющим входом коммутатора, сигнальные входы которого соединены с информационными выходами блоков повышения достоверности, выход коммутатора является выходом устройства.
Устройство работает следующим образом.
С управляющих выходов БПД 1 и 2 потоки ошибок поступают на первые входы
АПО 3 и 4, где осуществляется подсчет количества ошибок за последние N тактов принимаемой в ветви разнесения информации (количество ячеек в регистре 5 равно N). Количество ошибок фиксируется на дополнительных выходах АПО, компаратор 13 определяет, в какой из ветвей меньшая плотность ошибок, и через элементы И 8 и 5 9 и триггер 12 передается команда на коммутацию информации соответствующей ветви разнесения потребителю информации посредством коммутатора 13, на сигнальные входы которого поступает информация с информационных выходов БПД. Так, если в первой ветви разнесения АПО фиксирует большее количество ошибок, чем во второй, сигнал с выхода Больше компаратора 11 через элемент И 8 15 подается на R-вход триггера 12, устанавливая его выход в нулевое состояние. Попадая на управляющий вход коммутатора 13, этот сигнал устанавливает его в режим коммутации потребителю информации из второй 20 ветви разнесения.
Элемент И-НЕ 10 предназначен для предотвращения подачи сигналов управления от компаратора 11 на триггер 12, когда в декодерах 7 АПО ветвей разнесения одновременно фиксируется наличие более·К ошибок за интервал N. При этом сигналы декодеров 7 переводят выход элемента ИНЕ в нулевое состояние, запрещающее изменение состояние триггера 12 перед 30 сигналами, проходящими через элементы И 8 и 9, что необходимо для уменьшения вероятности ложного переключения, т.е. подачи потребителю ложной информации.
Claims (1)
- Формула изобретения Устройство автовыбора, содержащее первый и второй блоки повышения достоверности, входы которых являются соответственно первым и вторым входами устройства автовыбора, первый и второй анализаторы плотности ошибок, первые входы которых соединены с управляющими выходами соответствующих блоков повышения достоверности, вторые входы анализаторов плотности ошибок являются тактовым входом устройства автовыбора, причем каждый анализатор плотности ошибок состоит из последовательно соединен10 ных регистра, реверсивного счетчика и декодера, выход которого является выходом анализатора плотности ошибок, вход регистра соединен с вторым входом реверсивного счетчика и является первым входом анализатора плотности ошибок, входы Сброс регистра являются тактовым входом устройства автовыбора, первый элемент И, отличающееся тем, что, с целью повышения помехоустойчивости путем быстрого обнаружения полезного сигнала, введены второй элемент И, элемент И-НЕ, компаратор, триггер и коммутатор, причем выходы реверсивного счетчика каждого анализатора плотности ошибок явля25 ются его дополнительными выходами, которые соединены с соответствующими входами компаратора, выходы которого соединены с первыми входами первого и второго элементов И, вторые входы которых соединены с выходом элемента И-НЕ, входы которого соединены с выходами анализаторов плотности ошибок, выходы первого и второго элементов И соединены соответственно с R- и S-входами триггера, выход которого соединен с управляющим входом коммутатора, сигнальные входы которого соединены с информационными выходами блоков повышения достоверности, выход коммутатора является выходом устройства 40 автовыбора.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU914898837A SU1786672A1 (ru) | 1991-01-02 | 1991-01-02 | Уctpoйctbo abtobыбopa |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU914898837A SU1786672A1 (ru) | 1991-01-02 | 1991-01-02 | Уctpoйctbo abtobыбopa |
Publications (1)
Publication Number | Publication Date |
---|---|
SU1786672A1 true SU1786672A1 (ru) | 1993-01-07 |
Family
ID=21553478
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU914898837A SU1786672A1 (ru) | 1991-01-02 | 1991-01-02 | Уctpoйctbo abtobыбopa |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU1786672A1 (ru) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
RU2696329C2 (ru) * | 2018-01-22 | 2019-08-01 | Российская Федерация, от имени которой выступает Министерство обороны Российской Федерации | Устройство для приема информации по двум параллельным каналам связи в системе для передачи данных с решающей обратной связью |
-
1991
- 1991-01-02 SU SU914898837A patent/SU1786672A1/ru active
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
RU2696329C2 (ru) * | 2018-01-22 | 2019-08-01 | Российская Федерация, от имени которой выступает Министерство обороны Российской Федерации | Устройство для приема информации по двум параллельным каналам связи в системе для передачи данных с решающей обратной связью |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
WO1987000292A1 (en) | On chip test system for configurable gate arrays | |
SU1786672A1 (ru) | Уctpoйctbo abtobыбopa | |
JPS5854756A (ja) | 多重伝送システムの信号診断方法およびその診断装置 | |
SU1051541A1 (ru) | Устройство дл обнаружени и локализации ошибок при передаче информации | |
RU1780171C (ru) | Коммутатор | |
JP2006071621A (ja) | 移動体検知センサ | |
KR940008244Y1 (ko) | 비식스제트에스(b6zs) 코딩 에러 검출회로 | |
KR100321406B1 (ko) | 지에스버스이중화인터페이스구조 | |
SU1739506A1 (ru) | Устройство дл обнаружени кодовых комбинаций | |
SU582586A1 (ru) | Устройство дл приема сигналов времени и кодовой информации о текущем времени | |
SU1095428A1 (ru) | Устройство дл устранени неопределенности дискретнофазовой модул ции | |
US7343510B1 (en) | Method and device for selecting one of multiple clock signals based on frequency differences of such clock signals | |
SU1432584A1 (ru) | Устройство дл приема дискретной информации | |
SU1427589A1 (ru) | Устройство дл приема дискретной информации | |
SU1483458A1 (ru) | Устройство дл ввода информации от дискретных датчиков | |
SU559415A2 (ru) | Устройство дл защиты от импульсных помех | |
SU989558A1 (ru) | Устройство дл контрол двоичного кода на четность | |
SU1198522A1 (ru) | Многоканальное приоритетное устройство | |
SU502516A1 (ru) | Устройство дл выделени рекуррентного синхросигнала с обнаружением ошибок | |
RU1802407C (ru) | Мажоритарное устройство | |
KR200145157Y1 (ko) | 전전자 교환기내의 디바이스 반응신호 감별회로 | |
SU1084749A1 (ru) | Устройство дл допускового контрол последовательностей импульсов | |
SU1117848A1 (ru) | Дешифратор двоичного циклического кода | |
SU960892A1 (ru) | Комплексное телемеханическое устройство | |
SU1437987A1 (ru) | Цифровой временной дискриминатор |