SU1410709A1 - Computer to peripheral device interface - Google Patents
Computer to peripheral device interface Download PDFInfo
- Publication number
- SU1410709A1 SU1410709A1 SU864055174A SU4055174A SU1410709A1 SU 1410709 A1 SU1410709 A1 SU 1410709A1 SU 864055174 A SU864055174 A SU 864055174A SU 4055174 A SU4055174 A SU 4055174A SU 1410709 A1 SU1410709 A1 SU 1410709A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- register
- output
- input
- information
- computer
- Prior art date
Links
Landscapes
- Multi Processors (AREA)
Description
Изобретение относитс к вычислительной технике, в частности к построению и и|юрмапионно-измерительных систем с использованием ЭВМ с общей шиной (ОШ) и периферийных устройств с пр мой адресацией регистров и разделением передаваемой информации на данные и дополнительные параметры, код операции,The invention relates to computing technology, in particular to the construction and measurement of measurement systems using a common bus computer (OSH) and peripheral devices with direct addressing of registers and separation of transmitted information into data and additional parameters, an operation code,
Целью изобретени вл етс повышение быстродействи устройства,The aim of the invention is to improve the speed of the device
На чертеже дана структурна схема устройства.The drawing is a block diagram of the device.
Устройство содержит регистр 1 адреса , дептфратор 2, генератор 3 ctiH- кроимлульсов, регистр) 4 состо ни и управл ющих сигналов, регистр 5 одностороннего маскировани , регистр 6 прерываний, регистр 7 числа, регистр 8 старших разр дов, регистр 9 запро- coBj общую шину 10 ЭВМ, магистраль 15 пер мферийного устройства (ПУ),The device contains an address register 1, depthfrator 2, a generator of 3 ctiH-curls, a register) 4 states and control signals, a register 5 unilateral masking, a register 6 interrupts, a register 7 numbers, a register 8 higher bits, a register 9 requesting coBj bus 10 computer, trunk 15 of the peripheral device (PU),
. Обща шина ЭВМ представл ет собой унифицированную систему св зей и сиг налов между процессором, о ператив- Koii пам тью и устройствами сопр жени „ Св зь между устройствами, участ- взтощнми в операции обмена на шине асинхронна Магистраль периферийного устройства представл ет собой унифицированную систему св зей и сигналов между периферийным устройством и блоком управлени , функцию которого исполн ет описьгеаемое устройство, ПУ может состо ть из одной или нескольких подсистем, кажда из которых содержит группу устройств. Каждое устройство может содержать группу адресуемых регистров,.. The common computer bus is a unified communication system and signals between the processor, operating memory and interface devices. Communication between devices involved in the exchange operation on the bus. The asynchronous trunk The peripheral device is a unified communication system s and signals between the peripheral device and the control unit, the function of which is performed by the device's list, the control unit may consist of one or several subsystems, each of which contains a group of devices. Each device can contain a group of addressable registers.
Устройство предназначено дл сог- ласовани55 несовместимых сигналов Rsyx интерфейсов. Большинство сигналов общей шины интерпретируетс в соответствующие сигналы магистрали .ПУ... The device is intended to harmonize 55 incompatible signals of Rsyx interfaces. Most of the common bus signals are interpreted into the corresponding signals of the trunk. PU ...
. Регистр 1 адреса представл ет собой регистр разр дность которого совпадает с числом адресных линий общей ЭВМ, Он предназначен дл хранени Шформадии во врем обращени к магистрали ПУ„. The address register 1 is a register whose width coincides with the number of address lines of a common computer. It is intended to store the Scfordium during access to the trunk PU.
Дешифратор 2 предназначен дл дешифрации адресов внутренних регистров устройства сопр жени и определени номера адресуемого регистра ПУ с использованием информации, котора хранитс в регистре адреса.Decoder 2 is designed to decrypt the addresses of the internal registers of the interface and determine the number of the addressable register of the PU using information stored in the address register.
Генератор 3 синхроимпульсов синхронизирует процесс выдачи сигнапов на магистраль ПУ,The generator 3 sync pulses synchronizes the process of issuing signals to the mainline PU,
Регистр 4 состо ни и управл гопихRegister 4 states and control gopih
сигналов определ ет режим работы устройства сопр жени . Информаци , хран ща с в регистре, подраздел етс на ш формацизо длительного хранени иSignals determines the mode of operation of the interface device. The information stored in the register is subdivided into our formatiz durable storage and
оперативно измен ющуюс информацию (код операции).promptly changing information (opcode).
Регистр 5 одностороннего маскировани программно доступен как дл записи, так и дл чтени и используетс дл контрол информации, заносимой в регистр состо ни и шравл ю- щих сигналов. При записи данных в регистр одностороннего маскировани в регистр состо ни и управл ющихThe one-way masking register 5 is programmatically available to both write and read, and is used to control information entered into the status register and the shuffle signals. When writing data to the one-sided masking register in the state register and controlling
сигнапов передаютс только разр ды кода операции. При чтении данных из регистра одностороннего маскировани с ЭВМ передаютс все разр ды регистра состо ни и управл ющих сигналов,only the opcode bits are signaled. When reading data from the unilateral masking register with a computer, all bits of the status register and control signals are transmitted,
Регистр 6 прерьгаани выполн етRegister 6 prereggaani performs
операции захвата общей щины в цел х прерывани процессора и генерирует адрес вектора прерьгаани .common domain capture operations for interrupting the processor and generating the address of the pregangi vector.
Регистр 7 числа предназначен дл Register number 7 is for
промежуточного хранени данных, пере- даваемых между ПУ и ЭВМ.intermediate storage of data transferred between the control panel and the computer.
Регистр 8 старших разр дов обеспечивает доступ ЭВМ к информации, котора передаетс по лини м данных магистрали ПУ, выход щих за пределы разр дности ЭВМ.Register 8 of the higher bits provides the computer with access to information that is transmitted via data lines of the mainline of the control unit, going beyond the limits of computer size.
Регистр 9 запросов управл ет преобразованием запросов на обслуживание , поступающих от ПУ, в запросыRequest register 9 controls the conversion of service requests from the control panel to requests
на рерьгаание ЭВМ,on computer revision,
Устройство работа:ет следующим образом , В регистр А состо ни и управл ющих сигналов заноситс код опера- ции, которую необходимо произвестиThe device operation: em as follows, In the register A of the state and control signals, the operation code is entered, which must be produced
в ПУ. Затем произвести запись или чтение какого-либо регистра ПУ, при этом дешифратор 2 выдает сигнгш генератору 3 синхроимпульсов, последний синхронизирует процесс работы устройства при обмене информацией с ПУ. Дл работы с форматом данных, выход щим за пределы разр дности ЭВМ, служит регистр 8 старших разр дов. В случае передачи данных от ЭВМ в ПУ после установки кода операции, в него записьгааетс старший байт передаваемого числа, затем производитс запись младщей частн передаваемого числа в какой-либо регисгр ПУ, послеin PU. Then make a record or read any register PU, while the decoder 2 generates a signal generator 3 clock pulses, the latter synchronizes the process of the device when exchanging information with PU. To work with a data format that goes beyond the limits of computer size, the register of 8 high bits is used. In the case of data transmission from the computer to the control panel, after the operation code is set, the high byte of the transmitted number is written to it, then the younger private number of the transmitted number is recorded in any register of the control panel, after
чего выдаютс синхросигналы в ПУ. При чтении данных и з ИУ в нем можно прочесть старший байт пересылаемого числа. При возникновении запроса на обслуживаиие в ПУ и наличии разрешени на прерьгеание в регистре 9 запросов и регистре 4 состо ни .и управл ющих сигналов регистр 6 прерьша- ний захватьгеает общую шину 10 ЭВМ и передает по шинам данных адрес вектора прерыван1ш, затем снимает разре- шение прерьшани в регистре 4 состсл- ни и управл ющих сигналов.What are the sync signals in the PU. When reading data and s, in it, you can read the high byte of the number being sent. When a request for service occurs in the control panel and there is a permission to jam in register 9 requests and register 4 states and control signals, the interrupt register 6 captures the common bus 10 of the computer and transmits the address of the interrupt vector over the data buses, then removes the resolution Alarms in the register 4 and the control signals.
Claims (1)
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU864055174A SU1410709A1 (en) | 1986-03-17 | 1986-03-17 | Computer to peripheral device interface |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU864055174A SU1410709A1 (en) | 1986-03-17 | 1986-03-17 | Computer to peripheral device interface |
Publications (1)
Publication Number | Publication Date |
---|---|
SU1410709A1 true SU1410709A1 (en) | 1990-09-15 |
Family
ID=21233180
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU864055174A SU1410709A1 (en) | 1986-03-17 | 1986-03-17 | Computer to peripheral device interface |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU1410709A1 (en) |
-
1986
- 1986-03-17 SU SU864055174A patent/SU1410709A1/en active
Non-Patent Citations (1)
Title |
---|
Патент US Н 3714635 кл. 340- 172.5, 1973. Описание устройства JCC-20, Епег- tec-Schlumberger, Systeme САМАС, Notice Technique. JCC-20, Coupleur de chassis CAMAC/PD П. Edition:Janvier, 1977. * |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
KR100726361B1 (en) | System and method for communicating with memory devices | |
EP0207876A2 (en) | Modular multiport data hub | |
US5564114A (en) | Method and an arrangement for handshaking on a bus to transfer information between devices in a computer system | |
US5274795A (en) | Peripheral I/O bus and programmable bus interface for computer data acquisition | |
JP2000010818A (en) | Computer system and method for operating the computer system | |
CA1323445C (en) | Multi-processor system | |
SU1410709A1 (en) | Computer to peripheral device interface | |
KR920010977B1 (en) | Memory bus architecture | |
SU1541623A1 (en) | Device for interfacing computer with peripheral device | |
US6418491B1 (en) | Apparatus and method for controlling timing of transfer requests within a data processing apparatus | |
JP2834927B2 (en) | Computer system | |
KR950003885B1 (en) | Input/output processor with queue in computer system | |
EP0439594B1 (en) | Device for interfacing a main processor bus connected to a main processor to a peripheral bus having a number of peripheral devices connected thereto | |
JP2976443B2 (en) | Information processing device that exchanges data via system bus | |
JP2537541B2 (en) | DMA control system | |
KR960014177B1 (en) | Data communication device for a parallel data processing system | |
JP2581144B2 (en) | Bus control device | |
SU1451711A1 (en) | Process control computer system | |
EP0568678B1 (en) | Device for transmission of data | |
EP1193606B1 (en) | Apparatus and method for a host port interface unit in a digital signal processing unit | |
SU1176340A1 (en) | Information input-outrut device | |
SU822166A1 (en) | Interface matching device | |
SU1383376A1 (en) | Device for data exchange between users | |
JP3184406B2 (en) | Disk array device | |
JPS6217879Y2 (en) |