RU2008150458A - NEURAL NETWORK OF MODULAR NUMBERS - Google Patents
NEURAL NETWORK OF MODULAR NUMBERS Download PDFInfo
- Publication number
- RU2008150458A RU2008150458A RU2008150458/09A RU2008150458A RU2008150458A RU 2008150458 A RU2008150458 A RU 2008150458A RU 2008150458/09 A RU2008150458/09 A RU 2008150458/09A RU 2008150458 A RU2008150458 A RU 2008150458A RU 2008150458 A RU2008150458 A RU 2008150458A
- Authority
- RU
- Russia
- Prior art keywords
- input
- output
- block
- outputs
- divider
- Prior art date
Links
Landscapes
- Complex Calculations (AREA)
Abstract
Нейронная сеть основного деления модулярных чисел, содержащая входные регистры делимого и делителя, выходы регистра делимого поступают на входы блока деления с нулевым остатком и блока вычитателя, который реализует вычислительную модель αi-bqi , где αi - исходное или промежуточное значение делимого, b - значение делителя и qi - промежуточное частное, и выходы регистра делителя поступают на вход блока преобразования остаточного кода в код обобщенной позиционной системы счисления и блока умножения, который реализует вычислительную модель bqi, где b - делитель, а qi - промежуточное частное, отличающаяся тем, что значения делителя преобразуются из остаточного кода в код обобщенной позиционной системы счисления, которые являются адресным входом постоянного запоминающего устройства, в котором хранятся значения приблизительного делителя , где Q коэффициент (простое число) для выбранного набора модулей СОК, a pi, - значения модуля или их произведений, поступающие на вход блока деления с нулевым остатком, выходы которого в качестве промежуточных частных разветвляются на входы блока умножения для реализации вычислительной модели bqi, выходы которого являются входами блока реализации вычислительной модели αi-bqi, выход которого обеспечивает рекурсию делимого и является входом блока сравнения с нулем, выход которого по сигналу „Нет" через блок запрета разрешает прохождение промежуточного значения целого числа αi на вход регистра делимого для реализации рекурсивной операции, и по сигналу „Да", поступающего на вход сумматора, через ключ, на выходе которого формируется окончательное частное, являющееся выходом нейронной сети о� The neural network of the main division of modular numbers, containing the input registers of the dividend and divider, the outputs of the dividend register go to the inputs of the division block with zero remainder and the subtractor block, which implements the computational model αi-bqi, where αi is the initial or intermediate value of the dividend, b is the value of the divider and qi is the intermediate quotient, and the outputs of the divider register go to the input of the conversion unit of the residual code to the code of the generalized positional number system and the multiplication unit, which implements the computational model bqi, g e b is the divisor, and qi is the intermediate quotient, characterized in that the values of the divider are converted from the residual code to the code of the generalized positional number system, which are the address input of the permanent storage device in which the values of the approximate divisor are stored, where Q is the coefficient (prime) for the selected set of SOK modules, a pi, are the values of the module or their products, which are input to the division block with a zero remainder, the outputs of which, as intermediate quotients, branch into the inputs of the block for the implementation of the computational model bqi, the outputs of which are inputs of the implementation unit of the computational model αi-bqi, the output of which provides recursion of the dividend and is the input of the comparison unit with zero, whose output, by the signal “No”, through the prohibition block allows the passage of the intermediate value of the integer αi to the input of the register is divisible for the implementation of the recursive operation, and according to the signal "Yes" received at the input of the adder, through a key at the output of which the final quotient is formed, which is the output of the neural network about
Claims (1)
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
RU2008150458/09A RU2400813C2 (en) | 2008-12-22 | 2008-12-22 | Neutron network for main division of modular numbers |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
RU2008150458/09A RU2400813C2 (en) | 2008-12-22 | 2008-12-22 | Neutron network for main division of modular numbers |
Publications (2)
Publication Number | Publication Date |
---|---|
RU2008150458A true RU2008150458A (en) | 2010-06-27 |
RU2400813C2 RU2400813C2 (en) | 2010-09-27 |
Family
ID=42683141
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
RU2008150458/09A RU2400813C2 (en) | 2008-12-22 | 2008-12-22 | Neutron network for main division of modular numbers |
Country Status (1)
Country | Link |
---|---|
RU (1) | RU2400813C2 (en) |
Families Citing this family (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
RU2559771C2 (en) * | 2013-10-30 | 2015-08-10 | Федеральное государственное автономное образовательное учреждение высшего профессионального образования "Северо-Кавказский федеральный университет" | Device for primary division of molecular numbers |
RU2559772C2 (en) * | 2013-11-06 | 2015-08-10 | Федеральное государственное автономное образовательное учреждение высшего профессионального образования "Северо-Кавказский федеральный университет" | Device for primary division of molecular numbers in format of remainder class system |
RU2628179C1 (en) * | 2016-11-28 | 2017-08-15 | федеральное государственное автономное образовательное учреждение высшего образования "Северо-Кавказский федеральный университет" | Device for dividing modular numbers |
-
2008
- 2008-12-22 RU RU2008150458/09A patent/RU2400813C2/en not_active IP Right Cessation
Also Published As
Publication number | Publication date |
---|---|
RU2400813C2 (en) | 2010-09-27 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
Chervyakov et al. | An approximate method for comparing modular numbers and its application to the division of numbers in residue number systems | |
RU2008150458A (en) | NEURAL NETWORK OF MODULAR NUMBERS | |
Safieh et al. | A compact coprocessor for the elliptic curve point multiplication over Gaussian integers | |
Molahosseini et al. | A new residue to binary converter based on mixed-radix conversion | |
Keliris et al. | Investigating large integer arithmetic on Intel Xeon Phi SIMD extensions | |
Hiasat | A Reverse Converter for Three-Moduli Set (2 k, 2 n-1, 2 n+ 1), k< n | |
Luca et al. | On the counting function of irregular primes | |
Pintz | A new explicit formula in the additive theory of primes with applications I. The explicit formula for the Goldbach and Generalized Twin Prime Problems | |
CN109960532A (en) | Method and device for front stage operation | |
Zeng et al. | Gronwall inequalities | |
CN114721623A (en) | Multi-party secure division | |
Han et al. | Nonspeculative decimal signed digit adder | |
Luca et al. | On the Diophantine equation 2m+ nx2= yn | |
RU2559771C2 (en) | Device for primary division of molecular numbers | |
Vazquez et al. | Decimal adders/subtractors in FPGA: efficient 6-input LUT implementations | |
Jaberipur | Redundant number system-based arithmetic circuits | |
Vincent et al. | Decimal floating point format based on commonly used precision for embedded system applications | |
Drinfel'd | Two-dimensional l-adic representations of the Galois group of a global field of characteristic p and automorphic forms on GL (2) | |
Sundaresan et al. | High speed BCD adder | |
Stamenković et al. | Reverse convertor design for the 4-moduli set {2ⁿ-1, 2ⁿ, 2ⁿ+ 1, 2²ⁿ+ ¹-1} based on the mixed-radix conversion | |
CN104008086B (en) | Streamline discrete Hilbert transform circuit | |
Tajallipour et al. | Error-free algorithm and architecture of radix-10 logarithmic converter | |
Esmaeili et al. | On Nilpotent Elements of Skew Polynomial Rings | |
Marchenkov | Closed classed of three-valued logic that contain essentially multiplace functions | |
RU2013149446A (en) | DEVICE FOR BASIC DIVISION OF MODULAR NUMBERS IN THE FORMAT OF THE SYSTEM OF RESIDUAL CLASSES |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
MM4A | The patent is invalid due to non-payment of fees |
Effective date: 20101223 |