KR970024546A - 딜레이(delay) 회로 - Google Patents
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- H03K2005/00019—Variable delay
- H03K2005/00058—Variable delay controlled by a digital setting
- H03K2005/00071—Variable delay controlled by a digital setting by adding capacitance as a load
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- Physics & Mathematics (AREA)
- Nonlinear Science (AREA)
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Abstract
본 발명은 모스 트랜지스터와 캐패시터를 구비하는 딜레이 회로에 있어서, 전원전압이 입력되어 출력된 정전압이 모스 트랜지스터의 일 채널전극에 입력되어서, 모스 트랜지스터가 정전압에 의해 동작되도록 하는 정전압회로를 부가하는 것을 특징으로 한다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명에 의한 딜레이 회로의 일실시예를 도시한 회로도.
Claims (2)
- 모스 트랜지스터와 캐패시터를 구비하는 딜레이 회로에 있어서, 전원전압이 입력되어 출력된 정전압이 상기 모스 트랜지스터의 일 채널전극에 입력되어서, 상기 모스 트랜지스터가 정전압에 의해 동작되도록 하는 정전압회로를 부가하는 것을 특징으로 하는 딜레이 회로.
- 제1항에 있어서, 피모스 트랜지스터와 엔모스 트랜지스터로서 다 수의 인버터부와, 상기 인버터부의 사이에 병렬접속되는 캐패시터로 이루어지되, 상기 피모스 트랜지스터의 소오스 전극에 상기 정전압회로의 출력인 정전압이 인가되도록 하는 것을 특징으로 하는 딜레이 회로.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019950034101A KR0177398B1 (ko) | 1995-10-05 | 1995-10-05 | 딜레이 회로 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019950034101A KR0177398B1 (ko) | 1995-10-05 | 1995-10-05 | 딜레이 회로 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR970024546A true KR970024546A (ko) | 1997-05-30 |
KR0177398B1 KR0177398B1 (ko) | 1999-04-01 |
Family
ID=19429320
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019950034101A KR0177398B1 (ko) | 1995-10-05 | 1995-10-05 | 딜레이 회로 |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR0177398B1 (ko) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR102426011B1 (ko) | 2020-12-30 | 2022-07-29 | 사단법인대기환경모델링센터 | 독립형 탄소 분석 멀티 유니트 |
-
1995
- 1995-10-05 KR KR1019950034101A patent/KR0177398B1/ko not_active IP Right Cessation
Also Published As
Publication number | Publication date |
---|---|
KR0177398B1 (ko) | 1999-04-01 |
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