KR970013740A - 파이프라인 출력 기능을 갖는 동기식 기억소자의 출력 회로 - Google Patents
파이프라인 출력 기능을 갖는 동기식 기억소자의 출력 회로 Download PDFInfo
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Abstract
본 발명은 파이프라인 출력(PIPELINED OUTPUT) 기능을 갖는 동기식 기억소자(SYNCHRONOUS MEMORY DEVICE)의 출력 회로에 관한 것으로, 센스 증폭기의 출력을 다음 데이타가 오버라이트 되기 전까지 래치하는 제1래치부; 상기 제1래치부의 데이타를 전달하는 전달부; 클럭에 의해 만들어지는 K-펄스가 인가되면, 상기 전달부를 제어하는 K-트랜스 신호를 만드는 펄스 제너레이터 ; 상기 전달부를 통해 전달되는 데이타를 다음 데이타가 오버라이트 되기전까지 래치하는 제2래치부; 및 상기 제2래치부의 데이타를 외부로 내보내는 출력버퍼를 포함하여 이루어지는 것을 특징으로 한다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 따른 회로도.
Claims (4)
- 센스 증폭기의 출력을 다음 데이타가 오버라이트 되기 전까지 래치하는 제1래치부; 상기 제1래치부의 데이타를 전달하는 전달부; 클럭에 의해 만들어지는 펄스(K-펄스)가 인가되면, 상기 전달부를 제어하는 트랜스 신호(K-트랜스)를 만드는 펄스 제너레이터; 상기 전달부를 통해 전달되는 데이타를 다음 데이타가 오버라이트 되기전까지 래치하는 제2래치부; 및 상기 제2래치부의 데이타를 외부로 내보내는 출력버퍼를 포함하여 이루어지는 것을 특징으로 하는 파이프라인 출력 기능을 갖는 동기식 기억소자의 출력 회로.
- 제1항에 있어서, 상기 펄스 제너레이터는 클럭에 의해 만들어진 펄스를 게이트로 인가받고, 전원단자가 드레인에 연결된 PMOS1; 상기 펄스를 게이트로 인가받고, 상기 PMOS1의 소스가 소스에 연결된 NMOS1; 상기 펄스를 지연시켜 사이클 타임을 조정하는 지연부; 상기 지연부의 출력을 반전시키는 인버터; 상기 PMOS1의 소스가 소스에 연결되고, 전원단자가 드레인에 연결되고, 상기 인버터의 출력을 게이ㅌ로 인가받는 PMOS2; 및 상기 NMOS1의 드레인이 소스에 연결되고, 상기 인버터의 출력을 게이트로 인가받고, 접지단에 드레인이 연결된 NMOS2로 구성되는 것을 특징으로 하는 파이프라인 출력 기능을 갖는 동기식 기억소자의 출력 회로.
- 제2항에 있어서, 상기 트랜스 신호는 상기 래치1의 데이타를 래치2로 저장하게 하며, 그 폭으로 사이클 타임을 결정하도록 상기 전달부를 제어하는 것을 특징으로 하는 파이프라인 출력 기능을 갖는 동기식 기억소자의 출력 회로.
- 제3항에 있어서, 상기 전달부는 상기 트랜스 신호를 게이트로 인가받고 상기 제1래치부의 출력이 소스에 연결되고, 상기 제2래치부의 입력이 드레인에 연결된 PMOS3; 및 상기 트랜스 신호의 위상을 반전시키는 인버터의 출력을 게이트로 인가받고, 상기 PMOS3의 소스가 소스에 연결되고, 상기 PMOS3의 드레인이 드레인에 연결된 NMOS3로 구성되는 특징으로 하는 파이프라인 출력 기능을 갖는 동기식 기억소자의 출력 회로.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019950026370A KR100190301B1 (ko) | 1995-08-24 | 1995-08-24 | 파이프라인 출력 기능을 갖는 동기식 기억소자의 출력 회로 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019950026370A KR100190301B1 (ko) | 1995-08-24 | 1995-08-24 | 파이프라인 출력 기능을 갖는 동기식 기억소자의 출력 회로 |
Publications (2)
Publication Number | Publication Date |
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KR970013740A true KR970013740A (ko) | 1997-03-29 |
KR100190301B1 KR100190301B1 (ko) | 1999-06-01 |
Family
ID=19424371
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019950026370A KR100190301B1 (ko) | 1995-08-24 | 1995-08-24 | 파이프라인 출력 기능을 갖는 동기식 기억소자의 출력 회로 |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR100190301B1 (ko) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100299524B1 (ko) * | 1999-06-28 | 2001-11-01 | 박종섭 | 메모리소자의 래치회로 |
-
1995
- 1995-08-24 KR KR1019950026370A patent/KR100190301B1/ko not_active IP Right Cessation
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100299524B1 (ko) * | 1999-06-28 | 2001-11-01 | 박종섭 | 메모리소자의 래치회로 |
Also Published As
Publication number | Publication date |
---|---|
KR100190301B1 (ko) | 1999-06-01 |
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