KR960042965A - 반도체소자의 콘택 제조방법 - Google Patents
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Abstract
본 발명은 반도체소자의 콘택 제조방법에 관한 것으로서, 하측의 층간 절연막을 통하여 불순물 이온을 주입하여 저저항콘택을 위한 저접합 고농도 이온주입영역을 형성하고, 콘택홀을 형성한 후, 콘택에 의해 노출된 고농도 이온주입영역의 상측에 질화막을 형성하고, 상기 질화막을 통하여 통상의 고에너지 이온주입 장치로 고농도 이온주입영역의 계면에 Ti 이온을 주입하며, 이를 열처리하여 Ti-실리사이드막을 형성하고, 다시 Ti-실리사이드막과 질화막의 계면에 질소 이온을 이온주입하고 열처리하여 반응하지 않은 Ti 이온이나 국소적으로 형성된 Ti-질화막과 반응시켜 Ti-질화막을 형성한 후, 상기 질화막을 제거하고, 금속배선을 형성하여 금속배선 콘택을 완성하였으므로, 저접합의 형성이 용이하여 소자의 고집적화에 유리하고, Ti 이온주입으로 Ti-실리사이드막을 형성하므로 열적안정성이 우수한 얇은 두께의 Ti-실리사이드막을 형성할 수 있고 공정이 단순화되어 소자동작의 신뢰성 및 공정수율이 향상되는 이점이 있다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2a도 내지 제2d도는 본 발명에 따른 반도체소자의 콘택 제조 공정도.
Claims (17)
- 반도체기판상에 제1층간절연막을 형성하는 공정과, 상기 반도체기판에서 콘택으로 예정되어 있는 부분에 상기 제1층간절연막을 통하여 불순물 이온을 주입하여 고농도 이온주입영역을 형성하는 공정과, 상기 제1층간절연막상에 제2층간절연막을 형성하는 공정과, 상기 고농도 이온주입영역 상측의 제2 및 제1층간절연막을 순차적으로 제거하여 콘택홀을 형성하는 공정과, 상기 콘택홀을 통하여 노출되어 있는 고농도 이온주입영역의 상부와 제2층간절연막상에 질화막을 형성하는 공정과, 상기 질화막과 고농도 이온주입영역의 계면에 Ti 이온을 이온주입하는 공정과, 상기 구조의 반도체기판을 일차 열처리하여 Ti-실리사이드막을 형성하는 공정과, 상기 Ti-실리사이드막과 질화막의 사이에 질소 이온을 주입하는 공정과, 상기 구조의 반도체기판을 이차 열처리하여 상기 Ti-실리사이드막의 상측에 Ti-질화막을 형성하는 공정과, 상기 질화막을 제거하는 공정과, 상기 콘택홀을 통하여 Ti-질화막과 접촉되는 금속배선을 형성하는 공정을 구비하는 반도체소자의 콘택 제조방법.
- 제1항에 있어서, 상기 반도체기판상에 N월에 형성되어 있는 것을 특징으로 하는 반도체소자의 콘택 제조방법.
- 제1항에 있어서, 상기 제1층간절연막을 TEOS막으로서 300Å 이상의 두께로 형성하는 것을 특징으로 하는 반도체소자의 콘택 제조방법.
- 제1항에 있어서, 상기 고농도 이온주입영역을 P+형으로 형성하는 것을 특징으로 하는 반도체소자의 콘택 제조방법.
- 제1항에 있어서, 상기 고농도 이온주입영역을 1000Å 이하의 두께를 갖는 저접합으로 형성하는 것을 특징으로 하는 반도체소자의 콘택 제조방법.
- 제1항에 있어서, 상기 제2층간절연막을 BPSG막으로 형성하는 것을 특징으로 하는 반도체소자의 콘택 제조방법.
- 제1항에 있어서, 상기 고농도 이온주입영역 형성을 위하여 주입된 불순물 이온이 상기 제2층간절연막의 플로우를 위한 열처리 공정시 활성화되는 것을 특징으로 하는 반도체소자의 콘택 제조방법.
- 제1항에 있어서, 상기 질화막을 CVD 방법으로 형성하며, 콘택홀의 크기가 작아 측벽에는 도포되지 않는 것을 특징으로 하는 반도체소자의 콘택 제조방법.
- 제1항에 있어서, 상기 Ti의 이온주입량을 10E17 ions/㎠ 이상으로 이온주입하는 것을 특징으로 하는 반도체소자의 콘택 제조방법.
- 제1항에 있어서, 상기 열처리 공정을 600~700℃의 온도에서 10~60초간 실시하는 것을 특징으로 하는 반도체소자의 콘택 제조방법.
- 제1항에 있어서, 상기 일차 열처리후 형성되는 Ti-실리사이드막이 준안정상태인 C49상인 것을 특징으로 하는 반도체소자의 콘택 제조방법.
- 제1항에 있어서, 상기 일차 열처리 후 형성된 Ti-실리사이드막의 상측에 반응하지 않은 Ti원자와 국소적으로 형성된 Ti-질화막이 존지하는 것을 특징으로 하는 반도체소자의 콘택 제조방법.
- 제1항에 있어서, 상기 질소 이온주입량을 10E17 ions/㎠ 이상으로 실시하는 것을 특징으로 하는 반도체소자의 콘택 제조방법.
- 제1항에 있어서, 상기 이차 열처리를 700~1000℃ 온도에서 10~60초간 실시하는 것을 특징으로 하는 반도체소자의 콘택 제조방법.
- 제1항에 있어서, 상기 이차 열처리에 의해 상기 Ti-실리사이드막이 안정상태인 C54 상이 되는 것을 특징으로 하는 반도체소자의 콘택 제조방법.
- 제1항에 있어서, 상기 질화막의 제거 공정을 건식 또는 습식으로 실시하는 것을 특징으로 하는 반도체소자의 콘택 제조방법.
- 제1항에 있어서, 상기 금속배선을 Al 또는 Al 합금재질로 형성하는 것을 특징으로 하는 반도체소자의 콘택 제조방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019950014182A KR0161732B1 (ko) | 1995-05-31 | 1995-05-31 | 반도체소자의 콘택 제조방법 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019950014182A KR0161732B1 (ko) | 1995-05-31 | 1995-05-31 | 반도체소자의 콘택 제조방법 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR960042965A true KR960042965A (ko) | 1996-12-21 |
KR0161732B1 KR0161732B1 (ko) | 1999-02-01 |
Family
ID=19416113
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019950014182A KR0161732B1 (ko) | 1995-05-31 | 1995-05-31 | 반도체소자의 콘택 제조방법 |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR0161732B1 (ko) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100309642B1 (ko) * | 1999-01-29 | 2001-09-26 | 김영환 | 반도체장치의 콘택 형성방법 |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100670744B1 (ko) * | 2000-06-30 | 2007-01-17 | 주식회사 하이닉스반도체 | 반도체 소자의 실리사이드막 형성 방법 |
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1995
- 1995-05-31 KR KR1019950014182A patent/KR0161732B1/ko not_active IP Right Cessation
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---|---|---|---|---|
KR100309642B1 (ko) * | 1999-01-29 | 2001-09-26 | 김영환 | 반도체장치의 콘택 형성방법 |
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KR0161732B1 (ko) | 1999-02-01 |
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