KR960025063A - 메모리 데이타 출력제어회로 - Google Patents
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Abstract
종래의 메모리 데이타 출력제어회로는 디램 데이타가 P 점에 곧바로 도착되기 때문에 시스템 버스가 현재 사용중이면 디램에 접근하는 다른 요구들은 데이타가 시스템 버스로 구동되기 전에는 계속 기다리는 상태에 있기 때문에 시스템 성능을 저하시키는 문제점이 있었다.
따라서 본 발명은 여러장의 프로세서 보드, 메모리 보드가 하나의 시스템 버스를 공유하는 컴퓨터 시스템은 시스템 버스의 사용률이 높을 수록 성능이 저하되는데 이를 방지하기 위하여 시스템 버스의 사용상태에 따라 데이타 응답을 제어하기 위하여 메모리 보드에 데이타 출력 큐를 두어 버스가 바쁜(Busy) 상태이면 디램(DRAM)제어기는 데이타를 큐에 순차적으로 저장해 두었다가 버스가 바쁘지 않으면 데이타를 전송하도록 한 것이다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 발명에 의한 데이타 출력제어회로의 구성도, 제4도는 제3도의 상태 천이다.
Claims (1)
- 디램에 데이타의 저장 및 판독을 제어하는 제어신호를 발생함과 아울러 데이타 출력신호를 제어하는 디램 제어수단과, 상기 디램 제어수단의 데이타 출력 제어신호에 따라 버스 인터페이스 레지스터를 제어함과 아울러 선입선출 메모리수단을 제어하는 데이타 버스 출력 제어수단과, 상기 디램 제어수단의 제어신호에 따라 데이타를 저장 및 판독하는 디램으로부터 출력된 데이타를 선입선출에 의해 일시적으로 저장하고 상기 버스 인터페이스 레지스터를 통해 시스템 버스로 데이타를 출력하는 선입선출 메모리수단으로 구성하여된 것을 특징으로 한 메모리 데이타 출력제어회로.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019940040187A KR960025063A (ko) | 1994-12-30 | 1994-12-30 | 메모리 데이타 출력제어회로 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019940040187A KR960025063A (ko) | 1994-12-30 | 1994-12-30 | 메모리 데이타 출력제어회로 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| KR960025063A true KR960025063A (ko) | 1996-07-20 |
Family
ID=66648073
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| KR1019940040187A KR960025063A (ko) | 1994-12-30 | 1994-12-30 | 메모리 데이타 출력제어회로 |
Country Status (1)
| Country | Link |
|---|---|
| KR (1) | KR960025063A (ko) |
-
1994
- 1994-12-30 KR KR1019940040187A patent/KR960025063A/ko not_active Application Discontinuation
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