KR950031653A - Frame Buffer Using Analog Delay Element - Google Patents

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KR950031653A
KR950031653A KR1019940010791A KR19940010791A KR950031653A KR 950031653 A KR950031653 A KR 950031653A KR 1019940010791 A KR1019940010791 A KR 1019940010791A KR 19940010791 A KR19940010791 A KR 19940010791A KR 950031653 A KR950031653 A KR 950031653A
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analog
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KR1019940010791A
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Korean (ko)
Inventor
서진우
Original Assignee
배순훈
대우전자 주식회사
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Abstract

본 발명은 입력 디지탈 영상 신호를 아나로그 지연 소자를 이용하여 소정 시간동안 지연시키는 것으로, 입력 디지탈 영상 신호를 아나로그 영상 신호로 변환하는 디지탈/아나로그 변환 회로와, 아나로그 영상 신호를 소정 시간동안 지연시키는 데이타 지연 회로와, 지연된 아나로그 영상 신호를 상기 아나로그 신호로 변환되기 이전의 디지탈 신호로 변환하는 아나로그/디지탈 변환회로를 구비한다. 따라서 입력 영상 데이타 지연용 프레임 버퍼를 보다 저렴하게 구현할 수 있다.The present invention is to delay an input digital video signal for a predetermined time by using an analog delay element. And a data delay circuit for delaying, and an analog / digital conversion circuit for converting the delayed analog video signal into a digital signal before being converted into the analog signal. Therefore, a frame buffer for delaying input image data can be implemented at a lower cost.

Description

아나로그 지연소자를 이용한 프레임 버퍼Frame Buffer Using Analog Delay Element

본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음Since this is an open matter, no full text was included.

도면은 본 발명에 따른 프레임 버퍼를 도시한 블럭도.Is a block diagram illustrating a frame buffer in accordance with the present invention.

Claims (3)

입력 디지탈 영상 신호를 아나로그 지연 소자를 이용하여 소정 시간동안 지연시키는 것으로, 상기 입력 디지탈 영상 신호를 아나로그 영상 신호로 변환하는 디지탈/아나로그 변환 회로와, 상기 아나로그 영상 신호를 소정시간 동안 지연시키는 데이타 지연회로와, 상기 지연된 아나로그 연상 신호를 상기 아나로그 신호로 변환 되기 이전의 디지탈 신호로 변환하는 아나로그/디지탈 변환회로를 포함하는 아나로그 지연소자를 이용한 프레임 버퍼.Delaying the input digital video signal for a predetermined time using an analog delay element, and converting the input digital video signal into an analog video signal, and delaying the analog video signal for a predetermined time. And an analog / digital conversion circuit for converting the delayed analog associative signal into a digital signal before being converted into the analog signal. 제1항에 있어서, 상기 데이타 지연 회로에서 지연회로의 수는 상기 입력 영상 신호의 신호특성과 전체 시스템의 신호특성을 고려하여 설정하는 프레임 버퍼.The frame buffer of claim 1, wherein the number of delay circuits in the data delay circuit is set in consideration of signal characteristics of the input video signal and signal characteristics of an entire system. 제2항에 있어서, 상기 아나로그/디지탈 변환 회로에서 변환 회로의 수는 상기 입력 영상의 신호특성과 상기 지연회로의 수를 고려하여 설정하는 프레임 버퍼.The frame buffer of claim 2, wherein the number of conversion circuits in the analog / digital conversion circuit is set in consideration of signal characteristics of the input image and the number of delay circuits. ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.※ Note: The disclosure is based on the initial application.
KR1019940010791A 1994-05-17 1994-05-17 Frame Buffer Using Analog Delay Element KR950031653A (en)

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