KR920002974Y1 - 차동증폭기의 오프셋전압 제어회로 - Google Patents

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Abstract

내용 없음.

Description

차동증폭기의 오프셋전압 제어회로
제1도는 종래 차동증폭기의 오프셋전압 제어회로도.
제2도는 본 고안 차동증폭기의 오프셋전압 제어회로도이다.
* 도면의 주요부분에 대한 부호의 설명
D1, D2: 다이오드 QA, QBQ1∼Q6: 트랜지스터
본 고안은 차동증폭기의 오프셋전압에 의해 발생하는 직류출력전압의 변동을 감소시켜주는 차동증폭기의 오프셋전압 제어회로에 관한 것이다.
일반적으로 종래 차동증폭기의 오프셋전압 제어회로는 제1도에 도시한 바와같이 저항(R1∼R12)과 다이오드(D1, D2) 및 트랜지스터(Q1∼Q6)로 구성되어 있다. 즉 저항(R1∼R3)이 차동증폭기를 이루는 트랜지스터(Q1∼Q3)의 에미터 부하저항으로 작용하고, 저항(R11∼R12)이 출력부하저항으로 작용 하도록 구성되어 있어서, 트랜지스터(Q1∼Q3)의 베이스로 각각 신호(V1, V2)인 교류신호가 입력되면, 증폭도(AV1)로서 증폭되어 출력신호(A1)가 출력되게 되는바, 이때 증폭도(AV1)는되고, 신호(V1, V2)가 같은 경우(이상적인 경우)에 출력신호(V1)는로 된다.
한편, 신호(V2)가 신호(V1)보다 높은 바이어스 전압인 경우, 즉 V2〉V1일 경우에는 전류가 저항(R11)을 통해 트랜지스터(Q6)로 오프셋 전류만큼 흐르게 되므로 출력신호(V1)의 전위가 낮아지게 된다.
이때 신호(V1, V2)의 차가 저항(R3)을 무시하면,로 되므로로 되어 출력신호(V1)의 전위는 ΔI×R11만큼 낮아지게 된다.
이와같이 종래의 증폭기는 오프셋전압에 의해 출력신호(V1)의 직류출력전압이 심하게 변동하게 되므로 이러한 출력신호(V1)를 사용하는 회로 및 소자는 정상적으로 동작하지 않고 오동작하는 등 결점을 갖게된다.
본 고안은 상기한 종래 차동증폭기가 갖는 결점을 제거하고자 제안된 것으로서, 차동증폭기의 두 입력차를 부하단에서 서로 감소시켜 줌으로서 출력전압의 변동이 적은 차동증폭기의 오프셋전압 제어회로를 제공함에 그 목적이 있다.
이하 본 고안의 구성 및 작용, 효과를 첨부도면을 참조하여 상세하게 설명한다.
상기한 목적을 달성하기 위한 본 고안 차동증폭기의 오프셋전압제어회로는 저항(R1∼R12)과 다이오드(D1, D2) 및 트랜지스터(Q1∼Q6)로 구성된 차동증폭기에 있어서, 상기 차동증폭기에 있는 저항(R1, R3)의 접속점에다 트랜지스터(QA)의 에미터를 연결하고, 트랜지스터(QA)의 컬렉터를 트랜지스터(Q1, Q2)의 에미터와 컬렉터 접속점에 연결함과 더불어 트랜지스터(QB)의 베이스를 연결하며, 상기 트랜지스터(QA)의 베이스와 에미터가 저항(R2, R3)의 접속점에 연결된 트랜지스터(QB)의 컬렉터를 트랜지스터(Q3, Q4)의 에미터와 컬렉터 접속점에다 연결한 구성을 갖는다.
제2도는 본 고안 차동증폭기의 오프셋전압 제어회로인바, 트랜지스터(Q1, Q3)의 베이스로 각각 신호(V3, V4)가 입력되면, 증폭도(AV2)로서 증폭되는데, 이때 증폭도(AV2)는 (AV1)는로 되고,이면, 증폭도와는 무관하지만 부하저항이 작으면 증폭도가 (+reA)만큼 떨어지게 된다.
여기서 신호(V3, V4)가 같을 때는 상기한 종래 경우와 마찬 가지로 출력신호(V2)는로 된다.
한편 V4〉V3일 경우에는 트랜지스터(QA, QB)에 의해 차전류(I1-I2)가 종래의 경우와는 반대로 저항(R12)을 통해 흐르게 된다. 따라서로 되고,로 되어 출력신호(V2)는 R12×ΔI만큼 높아지게 되는데, 트랜지스터(Q1)의 에미터전위가 상대적으로 떨어질 때 트랜지스터(QB)의 베이스·에미터간 전압(VBEB)도 낮아지게 되므로(트랜지스터(Q3)도 동일함) 트랜지스터(QA, QB)의 에미터전압이 서로 거의 같게 된다.
이상과 같이 동작하는 본 고안의 출력신호(V2)의 변동을 종래의 출력신호(V1)의 비교하여 표 1에 나타냈다.
[표 1. 입력신호에 따른 출력신호의 변화]
표 1에서 보는 바와같이 종래의 경우에는 출력신호(V1)의 변동량(ΔV1)이 ΔV2=-1.31V이므로 본 고안은 출력신호의 변동이 종래보다 매우 적음을 알 수 있다.
상기한 바와같이 작용하는 본 고안은 차동증폭기의 두 입력이 차이가 나더라도 다이오드동작 특성을 갖는 간단한 트랜지스터 구성으로 출력전압의 변화를 감소시켜 안정된 출력신호를 얻을 수 있는 장점이 있다.

Claims (1)

  1. 저항(R1∼R12)과 다이오드(D1, D2) 및 트랜지스터(Q1∼Q6)로 구성된 차동증폭기에 있어서, 상기 차동증폭기에 있는 저항(R1, R3)의 접속점에다 트랜지스터(QA)의 에미터를 연결하고, 트랜지스터(QA)의 컬렉터를 트랜지스터(Q1, Q2)의 에미터와 컬렉터 접속점에 연결함과 더불어 트랜지스터(QB)의 컬렉터를 트랜지스터(Q3, Q4)의 에미터와 켈렉터 접속점에다 연결한 차동증폭기의 오프셋전압 제어회로.
KR2019890019304U 1989-12-19 1989-12-19 차동증폭기의 오프셋전압 제어회로 KR920002974Y1 (ko)

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