KR910003924A - 발진기 회로 - Google Patents

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KR910003924A
KR910003924A KR1019900009826A KR900009826A KR910003924A KR 910003924 A KR910003924 A KR 910003924A KR 1019900009826 A KR1019900009826 A KR 1019900009826A KR 900009826 A KR900009826 A KR 900009826A KR 910003924 A KR910003924 A KR 910003924A
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generator
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KR1019900009826A
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Inventor
브로노 파에르 장-마리 모떼
Original Assignee
프레데릭 얀 스미트
엔.브이.필립스 글로아이람펜 파브리켄
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    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03L—AUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
    • H03L7/00—Automatic control of frequency or phase; Synchronisation
    • H03L7/06—Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
    • H03L7/08—Details of the phase-locked loop
    • H03L7/10—Details of the phase-locked loop for assuring initial synchronisation or for broadening the capture range
    • H03L7/12—Details of the phase-locked loop for assuring initial synchronisation or for broadening the capture range using a scanning signal

Landscapes

  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
  • Synchronizing For Television (AREA)

Abstract

내용 없음.

Description

발진기 회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 따른 회로의 간략화된 기본 회로 다이어그램.
제2도는 본 발명에 따른 회로의 일부를 구성하는 제어 회로의 바람직한 실시태양의 회로 다이어그램.

Claims (9)

  1. 주파수 결정 소자와, 클럭 신호를 발생하는 클럭 발생기와, 상기 클럭 발생기에 연결되며 상기 주파수 결정 소자의 크기의 함수로서 제어 신호를 발생하며 상기 제어 신호를 상기 주파수 결정소자에 인가하는 제어 회로를 포함하는 회로에 있어서, 상기 제어 회로는 상기 클럭 신호를 시간의 함수로서 일정한 경사를 갖는 제2 신호로 변환하는 제2주파수 결정소자 및 상기 제2신호의 크기에 좌우되는 상기 제어 신호에 대한 축전 소자를 포함하는 것을 특징으로하는 회로.
  2. 제1항에 있어서, 발생지는 상기 축전 소자에 연결되어 상기 축전소자의 신호의 함수로서 상기 발생기에 의해 발생된 상기 신호의 편차를 결정하는 제어 가능한 소자를 포함하는 것을 특징으로 하는 회로.
  3. 제2항에 있어서, 상기 발생기에 의해 발생된 상기 신호 및 상기 제1주파수 결정 소자에 의해 발생된 신호는 시간의 함수로서 동일한 것을 특징으로 하는 회로.
  4. 제3항에 있어서, 상기 제1주파수 결정 소자에 의해 발생된 상기 신호 및 상기 발진기에 의해 발생된 신호는 둘다 톱니파 신호인 것을 특징으로 하는 회로.
  5. 제4항에 있어서, 상기 제2주파수 결정소자는 캐패시터, 및 상기 클럭 신호의 주기중의 일부의 주기동안 상기 캐패시터를 충전시키는 기준전압원을 포함하며, 상기 제어 가능한 소자는 상기 주기중의 잔여 주기동안 상기 캐패시터를 방전시키는 전류원인 것을 특징으로 하는 회로.
  6. 제5항에 있어서, 상기 캐패시터에 연결된 제1 입력 및 제2기준 전압원에 연결된 제2 입력을 가지며, 일반 전류 도통소자를 통하여 상기 축전소자에 접속된 출력을 갖는 자동 증폭기를 더 포함하며, 상기 축전소자는 제2캐패시터인 것을 특징으로 하는 회로.
  7. 제6항에 있어서, 상기 제1 주파수 결정 소자는 제3캐패시터를 각기 충전 및 방전시키기 위한 두개의 또다른 기준 전압원을 포함하며, 상기 발생기에 가산된 기준 전압원들간의 전압차와 상기 또 다른 두 기준 전압원들간의 전압자와의 비율을 실질적으로 일정한 것을 특징으로 하는 회로.
  8. 제6항에 있어서, 상기 발생기의 캐패시터 및 상기 제3 캐패시터의 충전 및 방전 전류는 각기 실질적으로 일정한 비율을 갖는 것을 특징으로 하는 회로.
  9. 제1항에 있어서, 상기 클럭 발생기는 분주기인 것을 특징으로 하는 회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019900009826A 1989-07-04 1990-06-30 발진기 회로 KR100201670B1 (ko)

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NL8901698A NL8901698A (nl) 1989-07-04 1989-07-04 Oscillatorschakeling.

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KR100201670B1 KR100201670B1 (ko) 1999-06-15

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JP (1) JPH0357307A (ko)
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DE (1) DE69017772T2 (ko)
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