KR20160009152A - 표시장치 - Google Patents

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Abstract

실시예에 따른 표시장치는 액정패널과, 상기 액정패널의 일측에 배치되어 다수의 게이트 D-IC로 이루어진 제1 게이트 드라이버와, 상기 액정패널의 타측에 배치되어 다수의 게이트 D-IC로 이루어진 제2 게이트 드라이버와, 상기 제1 게이트 드라이버의 채널과 대응되는 제2 게이트 드라이버의 채널에 디스차징 신호를 동시에 공급하도록 제어하는 제어부를 포함할 수 있다.
실시예는 제1 게이트 드라이버의 채널에 대응되는 제2 게이트 드라이버의 채널을 동시에 디스차징 신호를 공급함으로써, 안정적으로 액정패널을 디스차징을 수행할 수 있는 효과가 있다.

Description

표시장치{DISPLAY DEVICE}
실시예는 액정패널의 디스차징을 효과적으로 수행하기 위한 표시장치에 관한 것이다.
최근 정보화 사회가 발전함에 따라 디스플레이 분야에 대한 요구도 다양한 형태로 증가하고 있으며, 이에 부응하여 박형화, 경량화, 저소비 전력화 등의 특징을 지닌 여러 평판표시장치(Flat Panel Display Device),예를 들어, 액정표시장치(Liquid Crystal Display Device), 플라즈마 표시장치(Plasma Display Panel Device), 유기발광 다이오드 표시장치(Organic Light Emitting Diode Display Device) 등이 연구되고 있다.
액정표시장치는 액정패널과, 액정패널에 광을 제공하는 백라이트 유닛으로 이루어져 있으며, 액정패널의 일측에는 액정패널을 구동하기 위한 게이드 드라이버가 액정패널의 양측에 배치된다. 이러한, 게이트 드라이버는 액정패널을 구동한 이후, 디스차징(Discharging)시키고 있다.
하지만, 액정패널의 일측에 배치된 게이트 드라이버와 타측에 배치된 게이트 드라이버의 채널은 서로 반대 방향으로 배치되어 있기 때문에 일측 게이트 드라이버의 첫번째 패널의 전압과 타측 게이트 드라이버의 마지막 채널이 대응하여 배치된다.
따라서, 일측 게이트 드라이버의 첫번째 채널에 디스차징신호(VGh)을 공급하게 되면, 타측 게이트 드라이버의 마지막 채널에는 구동신호(VGL)가 인가된 상태이기 때문에 일측 게이트 드라이버의 첫번째 채널과 타측 게이트 드라이버의 마지막 채널 사이에 쇼트가 발생되어 디스차징이 이루어지지 않는 문제점이 있다.
상기와 같은 문제점을 해결하기 위해, 실시예는 액정패널의 디스차징을 효과적으로 수행하기 위한 표시장치를 제공하는 것을 그 목적으로 한다.
상술한 목적을 달성하기 위하여, 실시예에 따른 표시장치는 액정패널과, 상기 액정패널의 일측에 배치되어 다수의 게이트 D-IC로 이루어진 제1 게이트 드라이버와, 상기 액정패널의 타측에 배치되어 다수의 게이트 D-IC로 이루어진 제2 게이트 드라이버와, 상기 제1 게이트 드라이버의 채널과 대응되는 제2 게이트 드라이버의 채널에 디스차징 신호를 동시에 공급하도록 제어하는 제어부를 포함할 수 있다.
실시예는 제1 게이트 드라이버의 채널에 대응되는 제2 게이트 드라이버의 채널을 동시에 디스차징 신호를 공급함으로써, 안정적으로 액정패널을 디스차징을 수행할 수 있는 효과가 있다.
도 1은 실시예에 따른 표시장치를 나타낸 블럭도이다.
도 2는 실시예에 따른 표시장치의 게이트 드라이버를 나타낸 도면이다.
도 3 및 도 4는 제1 실시예에 따른 디스차징이 수행되는 모습을 나타낸 도면이다.
도 5는 제2 실시예에 따른 디스차징이 수행되는 모습을 나타낸 도면이다.
이하, 도면을 참조하여 실시예를 상세히 설명하기로 한다.
도 1은 실시예에 따른 표시장치를 나타낸 블럭도이고, 도 2는 실시예에 따른 표시장치의 게이트 드라이버를 나타낸 도면이고, 도 3 및 도 4는 제1 실시예에 따른 디스차징이 수행되는 모습을 나타낸 도면이다.
도 1 및 도 2를 참조하면, 실시예에 따른 표시장치는 액정패널(100)과, 상기 액정패널(100)의 상부에 배치된 데이터 드라이버(200)와, 상기 액정패널(100)의 일측에 배치된 제1 게이트 드라이버(300)와, 상기 액정패널(100)의 타측에 배치된 제2 게이트 드라이버(400)와, 상기 제1 게이트 드라이버(300)의 채널과 대응되는 제2 게이트 드라이버(400)의 채널에 디스차징 신호를 동시에 공급하도록 제어하는 제어부(500)를 포함한다. 여기서, 표시장치는 액정패널에 광을 제공하는 백라이트 유닛을 더 포함할 수 있다.
액정패널(100)은 글라스를 이용한 기판 상에 다수의 게이트라인과 다수의 데이터라인이 교차되어 배치되고, 이 교차지점을 화소영역으로 정의하며, 각각의 화소영역에는 박막트랜지스터와 액정캐패시터 및 저장캐패시터가 구성되어 화상을 표시한다.
데이터 드라이버(200)는 타이밍 컨트롤러(미도시)로부터 입력되는 제어신호들에 응답하여, 입력데이터의 기준전압을 선택하고, 선택한 기준전압을 액정패널(100)에 공급하여 액정 분자의 회전 각도를 제어한다.
타이밍 컨트롤러는 다수의 드라이브 집적회로들로 구성된 데이터 드라이버(200)를 구동하기 위한 소스 출력인에이블신호(Source Output Enable, 이하 SOE)와, 소스샘플링클럭신호(Source Sampling Clock, 이하 SSC)와, 극성반전신호(Polity reverse, 이하 POL)와 소스시작펄스신호(Source Start Pulse, 이하 SSP)등의 데이터제어신호를 생성하고, 데이터 신호(Vdata)를 공급한다. 도 2에 도시된 바와 같이, 데이터 드라이버(200)는 다수의 데이터 드라이버 아이씨(D-IC, 210)로 이루어질 수 있다. 데이터 D-IC(210)는 COF 타입으로 형성될 수 있다.
게이트 드라이버(300, 400)는 타이밍 컨트롤러로부터 입력되는 상기 제어신호들에 응답하여 액정패널(100)상에 배열된 박막트랜지스터들의 온/오프 제어를 수행하는데, 액정패널(100)상의 게이트라인을 1 수평동기시간(1H)씩 순차적으로 인에이블 시킴으로써 액정패널(100)상의 박막 트랜지스터를 1 라인 분씩 순차적으로 구동시켜 데이터 드라이버(200)로부터 공급되는 아날로그 데이터신호들이 각 박막트랜지스터들에 접속된 픽셀들로 인가되도록 한다.
게이트 드라이버(300, 400)는 제1 게이트 드라이버(300)와 제2 게이트 드라이버(400)를 포함할 수 있다. 제1 게이트 드라이버(300)는 액정패널(100)의 일측에 배치될 수 있다. 제2 게이트 드라이버(400)는 액정패널(100)의 타측에 배치될 수 있다. 최근에는 액정패널(100)의 크기가 증가함에 따라 게이트 드라이버(300, 400)는 액정패널(100)의 양측에 배치되는 것이 효과적이다. 도 2에 도시된 바와 같이, 게이트 드라이버(300, 400)는 다수의 게이트 D-IC(310, 410)로 이루어질 수 있다. 게이트 D-IC(310, 410)는 COG 타입으로 형성될 수 있다.
제어부(500)는 제1 게이트 드라이버(300) 및 제2 게이트 드라이버(400)에 구동 신호 및 디스차징 신호를 제공할 수 있다. 게이트 드라이버(300, 400)의 구동 신호는 VGL 신호일 수 있다. 게이트 드라이버(300, 400)의 디스차징 신호는 VGH 신호일 수 있다.
제어부(500)는 데이터 드라이버(200)를 통해 제1 게이트 드라이버(300) 및 제2 게이트 드라이버(400)에 신호를 공급할 수 있다. 제어부(500)는 제1 게이트 드라이버(300) 및 제2 게이트 드라이버(400)에 디스차징 신호를 채널에 따라 순차적으로 공급할 수 있다. 제어부(500)는 제1 게이트 드라이버(300)의 채널과 대응되는 제2 게이트 드라이버(400)의 채널에 디스차징 신호를 동시에 공급할 수 있다.
도 3에 도시된 바와 같이, 제1 게이트 드라이버(300)의 게이트 D-IC(310)는 제1 채널 내지 제m 채널로 이루어질 수 있다. 제1 게이트 드라이버(300)의 게이트 D-IC(310)의 일측에는 제1 채널이 배치될 수 있다. 제1 게이트 드라이버(300)의 게이트 D-IC(310)의 타측에는 제m 채널이 배치될 수 있다. 제1 게이트 드라이버(300)의 게이트 D-IC(310)의 좌측에는 입력 신호(Input)가 전달되고, 제1 게이트 드라이버(300)의 게이트 D-IC(310)의 우측에는 출력 신호(Output)가 출력될 수 있다.
제2 게이트 드라이버(400)의 게이트 D-IC(410)는 제1 채널 내지 제m 채널로 이루어질 수 있다. 제2 게이트 드라이버(400)의 게이트 D-IC(410)의 일측에는 제m 채널이 배치될 수 있다. 제2 게이트 드라이버(400)의 게이트 D-IC(410)의 타측에는 제1 채널이 배치될 수 있다. 제2 게이트 드라이버(400)의 게이트 D-IC(410)의 우측에는 입력 신호(Input)가 전달되고, 제2 게이트 드라이버(400)의 게이트 D-IC(410)의 좌측에는 출력 신호(Output)가 출력될 수 있다.
따라서, 제1 게이트 드라이버(300)의 게이트 D-IC(310)의 제1 채널은 제2 게이트 드라이버(400)의 게이트 D-IC(410) 제m 채널과 대응될 수 있다. 제1 게이트 드라이버(300)의 게이트 D-IC(310)의 제1 채널과 제2 게이트 드라이버(400)의 게이트 D-IC(410)의 제m 채널은 동일한 라인으로 신호가 공급될 수 있다.
제어부(500)는 제1 채널부터 제m/2 채널까지 순차적으로 디스차징 신호를 공급할 수 있다. 이와 동시에 제m 채널부터 제(m/2)+1 채널까지 순차적으로 디스차징 신호를 공급할 수 있다.
제1 게이트 드라이버(300)의 게이트 D-IC(310)의 제1 채널에 디스차징 신호가 공급되면 제2 게이트 드라이버(400)의 게이트 D-IC(410)의 제m 채널에는 구동 신호(VGL 전압)이 흐르고 있는 상태이므로, 제1 게이트 드라이버(300)의 게이트 D-IC(310)의 제1 채널과 제2 게이트 드라이버(400)의 게이트 D-IC(410)의 제m 채널 사이에는 쇼트가 발생될 수 있다.
따라서, 실시예와 같이, 제1 채널과 제m 채널에 디스차징 신호를 동시에 공급하게 되면, 제1 게이트 드라이버(300)의 게이트 D-IC(310)의 제1 채널과 제2 게이트 드라이버(400)의 게이트 D-IC(410)의 제m 채널 사이에는 쇼트가 발생되지 않게 되어 액정패널(100)의 디스차징이 효과적으로 수행될 수 있다. 이때, 제1 게이트 드라이버(300)의 게이트 D-IC(310)의 제m 채널과 제2 게이트 드라이버(400)의 게이트 D-IC(410)의 제1 채널 사이에도 디스차징이 이루어지게 된다.
도 4에 도시된 바와 같이, 제어부(500)는 제1 채널 및 제m 채널에 디스차징을 수행한 후, 제2 채널과 제m-1 채널에 디스차징 신호를 공급할 수 있다. 이로 인해 제1 게이트 드라이버(300)의 게이트 D-IC(310)의 제2 채널 및 제m-1과 그에 대응되는 제2 게이트 드라이버(400)의 게이트 D-IC(410)의 제m-1채널 및 제2 채널 사이에 디스차징이 이루어지게 된다.
도 1로 돌아가서, 백라이트 유닛(600)은 액정패널(100)에 광을 제공하는 역할을 한다. 백라이트 유닛(600)은 서로 직렬 또는 병렬로 조합되어 연결된 복수의 LED군을 구비하고, 각 LED군들로 공급되는 구동 전원(Vled)에 따라 동시 또는 순차적으로 각 LED군들을 온/오프시켜서 광을 발생하게 된다.
백라이트 유닛(600)은 광학부를 더 포함할 수 있다. 광학부는 광원으로부터의 입사광을 확산 및 집광시켜 광 효율을 향상시키게 된다. 여기서, 백라이트 유닛(600)의 각 LED군은 백색의 LED들로만 구성되어 백색광을 발생할 수 있으며, 적색, 녹색, 청색의 LED들이 조합되도록 하여 백색의 광을 발생할 수도 있다. 이러한 복수의 LED군들은 구동 전원(Vled)에 의해 광을 발생하되, 그 출력단에서 조절되는 LED 구동 전류량에 의해 그 발광량 즉, 밝기 정도가 제어된다.
백라이트 제어부(700)는 외부 또는 타이밍 컨트롤러로부터 입력되는 디밍 제어신호(Dim)의 듀티 비에 대응하도록 펄스 폭 변조(PWM; Pulse Width Modulation) 신호를 생성한다. 여기서, PWM 신호는 디밍 제어신호(Dim)의 듀티 비 정보에 따라 각 LED군의 온/오프 주기 예를 들어, 하이/로우 주기가 가변된 신호이다.
백라이트 제어부(700)는 PWM 신호에 따라 백라이트 유닛(600)의 각 구동 전류 출력단으로부터 각각 출력되는 LED 구동 전류들의 전류량을 조절함으로써, 각 LED군들 온/오프 시키는 버스트 모드(Burst Mode)로 구동한다. 이때, 백라이트 제어부(700)는 백라이트 유닛(600)에 배열된 각 LED군들의 출력단을 통해 각각의 LED 구동 전류들을 입력받는다. 그리고 각각의 LED 구동 전류들 간의 전류량 차이를 최소화시킨 후, 각 LED 구동 전류의 전류량을 조절함으로써 각 LED군들의 발광량 즉, 백라이트 유닛(600)의 발광량을 제어하게 된다.
도 5는 제2 실시예에 따른 디스차징이 수행되는 모습을 나타낸 도면이다.
도 5에 도시된 바와 같이, 제1 게이트 드라이버(300)의 게이트 D-IC(310)는 제1 채널 내지 제m 채널로 이루어질 수 있다. 제1 게이트 드라이버(300)의 게이트 D-IC(310)의 일측에는 제1 채널이 배치될 수 있다. 제1 게이트 드라이버(300)의 게이트 D-IC(310)의 타측에는 제m 채널이 배치될 수 있다. 제1 게이트 드라이버(300)의 게이트 D-IC(310)의 좌측에는 입력 신호(Input)가 전달되고, 제1 게이트 드라이버(300)의 게이트 D-IC(310)의 우측에는 출력 신호(Output)가 출력될 수 있다.
제2 게이트 드라이버(400)의 게이트 D-IC(410)는 제1 채널 내지 제m 채널로 이루어질 수 있다. 제2 게이트 드라이버(400)의 게이트 D-IC(410)의 일측에는 제m 채널이 배치될 수 있다. 제2 게이트 드라이버(400)의 게이트 D-IC(410)의 타측에는 제1 채널이 배치될 수 있다. 제2 게이트 드라이버(400)의 게이트 D-IC(410)의 우측에는 입력 신호(Input)가 전달되고, 제2 게이트 드라이버(400)의 게이트 D-IC(410)의 좌측에는 출력 신호(Output)가 출력될 수 있다.
따라서, 제1 게이트 드라이버(300)의 게이트 D-IC(310)의 제1 채널은 제2 게이트 드라이버(400)의 게이트 D-IC(410) 제m 채널과 대응될 수 있다. 제1 게이트 드라이버(300)의 게이트 D-IC(310)의 제1 채널과 제2 게이트 드라이버(400)의 게이트 D-IC(410)의 제m 채널은 동일한 라인으로 신호가 공급될 수 있다.
제어부(500)는 제m/2 채널부터 제1 채널까지 순차적으로 디스차징 신호를 공급할 수 있다. 이와 동시에 제(m/2)_1 채널부터 제m 채널까지 순차적으로 디스차징 신호를 공급할 수 있다.
제m/2 채널과 제(m+2)+1 채널에 디스차징 신호를 동시에 공급하게 되면, 제1 게이트 드라이버(300)의 게이트 D-IC(310)의 제m/2 채널과 제2 게이트 드라이버(400)의 게이트 D-IC(410)의 제(m+2)+1 채널 사이에는 쇼트가 발생되지 않게 되어 액정패널(100)의 디스차징이 효과적으로 수행될 수 있다. 이때, 제1 게이트 드라이버(300)의 게이트 D-IC(310)의 제(m+2)-1 채널과 제2 게이트 드라이버(400)의 게이트 D-IC(410)의 제m/2 채널 사이에도 디스차징이 이루어지게 된다.
상기에서는 도면 및 실시예를 참조하여 설명하였지만, 해당 기술 분야의 숙련된 당업자는 하기의 특허청구범위에 기재된 실시예의 기술적 사상으로부터 벗어나지 않는 범위 내에서 실시예는 다양하게 수정 및 변경시킬 수 있음은 이해할 수 있을 것이다.
100: 액정패널 200: 데이터 드라이버
300: 제1 게이트 드라이버 400: 제2 게이트 드라이버
500: 제어부 600: 백라이트 유닛

Claims (6)

  1. 액정패널;
    상기 액정패널의 일측에 배치되어 다수의 게이트 D-IC로 이루어진 제1 게이트 드라이버;
    상기 액정패널의 타측에 배치되어 다수의 게이트 D-IC로 이루어진 제2 게이트 드라이버; 및
    상기 제1 게이트 드라이버의 채널과 대응되는 제2 게이트 드라이버의 채널에 디스차징 신호를 동시에 공급하도록 제어하는 제어부;
    를 포함하는 표시장치.
  2. 제 1 항에 있어서,
    상기 제1 게이트 드라이버의 게이트 D-IC 일측에는 제1 채널이 배치되고 상기 제1 게이트 드라이버의 게이트 D-IC 타측에는 제m 채널이 배치되고, 상기 제1 게이트 드라이버의 게이트 D-IC 일측에 배치된 제1 채널에 대응되는 제2 게이트 드라이버의 게이트 D-IC 일측에는 제m 패널이 배치되고 상기 제1 게이트 드라이버의 게이트 D-IC 타측에는 배치된 제m 채널에 대응되는 제2 게이트 드라이버의 게이트 D-IC 타측에는 제1 채널이 배치되는 것을 특징으로 하는 표시장치.
  3. 제 2 항에 있어서,
    상기 제어부는 제1 채널부터 제m/2 채널까지 순차적으로 디스차징 신호를 공급하는 동시에 제m 채널부터 제(m/2)+1 채널까지 순차적으로 디스차징 신호를 공급하는 것을 특징으로 하는 표시장치.
  4. 제 2 항에 있어서,
    상기 제어부는 제m/2 널부터 제1 채널까지 순차적으로 디스차징 신호를 공급하는 동시에 제(m/2)+1 채널부터 제m 채널까지 순차적으로 디스차징 신호를 공급하는 것을 특징으로 하는 표시장치.
  5. 제 1 항 내지 제 4 항 중 어느 한 항에 있어서,
    상기 게이트 드라이버는 다수의 게이트 D-IC가 COG 타입으로 이루어진 것을 특징으로 하는 표시장치.
  6. 제 1 항 내지 제 4 항 중 어느 한 항에 있어서,
    상기 데이터 드라이버는 다수의 데이터 D-IC가 COF 타입으로 이루어진 것을 특징으로 하는 표시장치.
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