KR20080053781A - 팬아웃 배선 구조와 이를 구비한 평판표시패널 및평판표시장치 - Google Patents

팬아웃 배선 구조와 이를 구비한 평판표시패널 및평판표시장치 Download PDF

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KR20080053781A
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Abstract

본 발명은 팬아웃 배선 구조와 이를 구비한 액정표시패널 및 액정표시장치에 관한 것으로, 신호 배선과 본딩 패드를 연결하는 팬 아웃 배선 구조로서, 상호 이격되어 배치된 복수의 팬 아웃 배선들을 포함하며, 복수의 팬 아웃 배선의 길이는 서로 상이하게 형성되며, 복수의 팬 아웃 배선들 중 적어도 일부 팬 아웃 배선들에는 각 팬 아웃 배선의 저항차를 보상하기 위한 홀 패턴이 형성되는 팬 아웃 배선 구조와 이를 구비한 액정표시패널 및 액정표시장치가 제공된다.
평판표시장치, 팬 아웃 배선, 홀, 등저항

Description

팬아웃 배선 구조와 이를 구비한 평판표시패널 및 평판표시장치 {Fanout line structure, flat panel and flat panel display}
도 1은 본 발명의 일 실시예에 따른 팬 아웃 배선부의 개략적인 평면도이다.
도 2는 도 1에 도시된 팬 아웃 배선부의 일부를 확대한 평면도이다.
도 3a는 홀 패턴이 형성되지 않은 팬 아웃 배선의 평면도, 도 3b는 홀 패턴이 1열로 형성된 팬 아웃 배선의 평면도, 도 3c는 도 3b에 도시된 팬 아웃 배선의 일부를 확대한 평면도이고, 도 3d는 도 3c에 도시된 팬 아웃 배선의 저항의 등가 저항을 나타낸 도이다.
도 4는 본 발명의 다른 실시예에 따른 팬 아웃 배선부의 일부를 나타낸 평면도이다.
도 5는 본 발명에 따른 팬 아웃 배선부를 구비한 액정표시장치의 일 예를 도시한 개략적인 단면도이다.
도 6은 본 발명에 따른 팬 아웃 배선부를 구비한 액정표시장치의 다른 예를 도시한 개략적인 단면도이다.
*도면의 주요 부분에 대한 부호의 설명*
100: 박막 트랜지스터 기판 200: 컬러 필터 기판
300: 액정층 400: 신호 배선
500: 본딩 패드 600: 팬 아웃 배선부
650: 홀 패턴 700: 구동회로유닛
본 발명은 팬아웃 배선 구조와 이를 구비한 액정표시패널 및 액정표시장치에 관한 것으로, 보다 상세하게는 등저항을 구현할 수 있는 팬아웃 배선 구조와 이를 구비한 액정표시패널 및 액정표시장치에 관한 것이다.
일반적으로, 액정표시장치(Liquid Crystal Display; LCD)는 경량, 박형, 저전력구동, 풀-컬러, 고해상도 구현 등의 특징으로 인해 그 응용범위가 확대되고 있는 실정이다. 액정표시장치는 매트릭스 형태로 배열된 다수의 제어용 스위치들에 인가되는 영상신호에 따라 광의 투과량이 조절되어 액정표시패널에 원하는 화상을 표시한다. 액정표시패널을 구동하기 위한 구동회로유닛은 액정표시패널에 구동 신호를 제공하며, 이러한 구동회로유닛은 액정표시패널에 액정셀을 구동할 수 있는 신호를 입력해주는 다수의 LDI(LCD Driver IC)를 포함하며 이를 제어하는 전기신호를 생성하고 컴퓨터 등으로부터 입력된 화상정보를 제어하는 타이밍 제어부와, 액정셀에 각 그레이-스케일(gray-scale)별로 서로 다른 액정전압을 발생시키는 회로 부품 등이 인쇄회로기판 상에 장착된 형태로 구성된다. 액정표시패널의 신호 배선은 그 일 단에 형성된 팬 아웃 배선에 의해 본딩 패드와 연결되며, 이러한 본딩 패 드에 전기적으로 연결된 구동회로유닛은 화소영역에 배치된 해당 신호배선들과 전기적으로 접속되어 구동신호들을 공급하게 된다.
구동회로유닛은 LCD 기술이 발전함에 따라 고해상도 화상을 구현하기 위해 액정표시패널의 화소수가 증가되어, 팬 아웃(fanout) 배선들의 폭 및 간격이 미세해지고 있다. 이에 따라, 본딩 패드와 화소영역의 해당 신호배선 사이에 접속되는 팬 아웃 배선들은 서로 다른 길이를 가지면서 배치되며, 그 결과, 팬 아웃 배선들은 그 길이차에 따른 저항차를 가지게 된다. 　이러한 저항차들로 인하여 화소영역의 신호배선에 인가되는 신호가 왜곡되어 화질이 저하되는 문제점이 발생하게 된다.
이러한 문제점을 보완하기 위한 종래 기술로서, 팬 아웃 배선의 선폭을 점진적으로 감소시키는 방식이 있었다. 그러나, 이러한 방식은 시스템에서 구현하는데 한계가 있었다. 왜냐하면, 팬 아웃 배선들의 선폭을 점진적으로 감소시키도록 설계하여도, 실제 마스크에는 정확하게 반영이 되지 않기 때문에, 실제적으로 구현된 팬 아웃 배선들의 선폭을 점진적으로 감소되어 형성되지 않는 경우가 빈번히 발생하였다. 따라서, 종래 기술에 따른 방식으로 팬 아웃 배선들의 저항차를 보상하는데 한계가 있었다.
본 발명은 상술한 종래의 문제점을 극복하기 위한 것으로서, 본 발명이 이루고자 하는 기술적 과제는 팬아웃 배선 구조와 이를 구비한 평판표시패널 및 평판표시장치를 제공하기 위한 것이다.
상기 본 발명의 목적을 달성하기 위한 본 발명의 일 실시예에 따르면, 신호 배선과 본딩 패드를 연결하는 팬 아웃 배선 구조로서, 상호 이격되어 배치된 복수의 팬 아웃 배선들을 포함하며, 상기 복수의 팬 아웃 배선의 길이는 서로 상이하게 형성되며, 상기 복수의 팬 아웃 배선들 중 적어도 일부 팬 아웃 배선들에는 각 팬 아웃 배선의 저항차를 보상하기 위한 홀 패턴이 형성되는 팬 아웃 배선 구조가 제공된다.
상기 각 팬 아웃 배선에는 복수의 홀 패턴이 상호 이격되어 형성된다.
상기 각 팬 아웃 배선의 선폭은 동일하게 형성되며, 상기 각 팬 아웃 배선의 길이에 따라, 상기 각 팬 아웃 배선에 형성된 홀 패턴의 크기 또는 개수가 조절된다.
상기 홀 패턴의 크기는 동일하게 형성되며, 상기 팬 아웃 배선의 길이가 증가할수록, 상기 홀 패턴의 개수는 감소되도록 형성된다.
상기 각 팬 아웃 배선의 선폭은 상이하게 형성되며, 상기 각 팬 아웃 배선의 길이 및 선폭에 따라, 상기 각 팬 아웃 배선에 형성된 홀 패턴의 크기 또는 개수가 조절된다.
상기 홀 패턴은 j
Figure 112006091635969-PAT00001
k 매트릭스 형태로 형성된다.
상기 각 팬 아웃 배선의 선저항은 이하의 식에 따라 상기 홀 패턴을 형성하여 등저항을 이루도록 하며, [식] RH = RS(
Figure 112006091635969-PAT00002
)
RH는 팬 아웃 배선의 선저항, RS는 팬 아웃 배선의 시트저항, L은 팬 아웃 배선의 길이, W는 팬 아웃 배선의 선폭, x는 홀 패턴의 제1변의 길이, y는 홀 패턴의 제2변의 길이, n은 홀 패턴의 개수 및 j는 홀 패턴의 행의 개수 및 k는 홀 패턴의 열의 개수인 것을 특징으로 한다.
본 발명의 다른 실시예에 따르면, 기판 상에 형성된 신호 배선; 외부로부터의 구동 신호가 인가되는 본딩 패드; 및 상기 신호 배선과 상기 본딩 패드를 전기적으로 연결하기 위한 팬 아웃 배선부를 포함하며, 상기 팬 아웃 배선부는 상호 이격되어 배치된 복수의 팬 아웃 배선들을 포함하며, 상기 복수의 팬 아웃 배선의 길이는 서로 상이하게 형성되며, 상기 복수의 팬 아웃 배선들 중 적어도 일부 팬 아웃 배선들에는 각 팬 아웃 배선의 저항차를 보상하기 위한 홀 패턴이 형성되는 평판표시패널이 제공된다.
본 발명의 또 다른 실시예에 따르면, 기판 상에 형성된 신호 배선; 외부로부터의 구동 신호가 인가되는 본딩 패드; 및 상기 신호 배선과 상기 본딩 패드를 전기적으로 연결하기 위한 팬 아웃 배선부를 포함하는 평판표시패널; 및 상기 평판표시패널을 구동하기 위한 구동 IC를 포함하는 구동회로유닛을 포함하며,
상기 팬 아웃 배선부는 상호 이격되어 배치된 복수의 팬 아웃 배선들을 포함하며, 상기 복수의 팬 아웃 배선의 길이는 서로 상이하게 형성되며, 상기 복수의 팬 아웃 배선들 중 적어도 일부 팬 아웃 배선들에는 각 팬 아웃 배선의 저항차를 보상하기 위한 홀 패턴이 형성되는 평판표시장치가 제공된다.
이하, 첨부된 도면을 참조하여 본 발명의 바람직한 실시예에 대해 상세히 설명한다.
도 1은 본 발명의 일 실시예에 따른 팬 아웃 배선부의 개략적인 평면도이며, 도 2는 도 1에 도시된 팬 아웃 배선부의 일부를 확대한 평면도이다. 도 1 및 도 2에 도시된 실시예에 따른 팬 아웃 배선부(600)는 길이는 상이하나 선폭을 동일한 팬 아웃 배선으로 구성되며, 도 2에는 제N-3 내지 제N 팬 아웃 배선(FLn -3 ~ FLn)이 도시된다.
도 1을 참조하면, 평판표시패널의 기판(100) 상에는 신호 배선(400), 본딩 패드(500) 및 팬 아웃 배선부(600)가 형성된다.
팬 아웃 배선부(600)는 신호 배선(400)과 본딩 패드(500) 사이에 형성되어, 신호 배선(400)과 본딩 패드(500)를 전기적으로 연결한다. 팬 아웃 배선부(600)의 일 단부는 본딩 패드(500)와 연결되며, 팬 아웃 배선부(600)의 타 단부는 신호 배선(400)과 연결되어, 신호 배선(400)과 본딩 패드(500)는 팬 아웃 배선부(600)에 의해 전기적으로 연결된다.
도면에 도시된 바와 같이, 복수의 본딩 패드(500)는 제1 간격(d1)으로 이격되어 기판(100)의 단부에 배치되며, 복수의 신호 배선(400)은 제2 간격(d2)으로 이격되어 본딩 패드(500)의 내측에 배치된다. 이때, 제2 간격(d2)은 제1 간격(d1)에 비하여 크게 형성된다 즉, 신호 배선 간의 간격이 본딩 패드 간의 간격 보다 크게 형성된다.
따라서, 신호 배선(400)과 본딩 패드(500)를 연결하는 팬 아웃 배선부(600)는 복수의 팬 아웃 배선들(FL1, FL2, FLn -1, FLn)은 서로 상이한 길이를 가지면서 배치된다. 즉, 양측(최좌측 및 최우측)에 배치된 팬 아웃 배선(FL1 , FLn)이 가장 길게 형성되며, 중앙 내부로 갈수록 팬 아웃 배선의 길이는 점차적으로 짧아지게 형성된다.
일반적으로, 팬 아웃 배선의 선저항값은 선폭에 반비례하고, 길이에 비례한다. 본 실시예의 경우, 팬 아웃 배선의 선폭은 동일하기 때문에, 양측에 배치된 팬 아웃 배선(FL1 , FLn)의 선저항값이 가장 높으며, 중앙 내부로 갈수록 점차 감소하여, 팬 아웃 배선의 길이차에 따른 선저항값의 차이가 발생하게 된다.
이러한 팬 아웃 배선간의 선저항값의 차이를 보상하기 위하여, 각 팬 아웃 배선 내에는 복수의 홀 패턴(650)이 형성된다. 이러한 홀 패턴(650)을 팬 아웃 배선 내에 형성하면, 팬 아웃 배선의 선저항값이 증가하게 되는데, 본 실시예의 경우, 각 팬 아웃 배선 내에 형성되는 홀 패턴(650)의 크기는 동일하게 하고, 개수를 상이하게 조절함으로써, 팬 아웃 배선의 길이차에 따른 선저항값의 차이를 보상한다. 즉, 팬 아웃 배선의 길이가 증가할수록, 홀 패턴의 개수는 감소되도록 형성함으로써, 팬 아웃 배선의 길이차에 따른 선저항값의 차이를 보상한다.
도 2를 참조하면, 제N-3 팬 아웃 배선(FLn -3)이 가장 짧게 형성되며, 제N 팬 아웃 배선(FLn)이 가장 길게 형성된다. 따라서, 홀 패턴이 형성되기 전의 팬 아웃 배선의 선저항값은 제 N-3 팬 아웃 배선(FLn -3)이 가장 작으며, 제N 팬 아웃 배선(FLn)이 가장 크다. 이를 보상하기 위하여, 제 N-3 팬 아웃 배선(FLn -3)에는 15개의 홀 패턴(650)이 형성되며, 제 N-2 팬 아웃 배선(FLn -2)에는 14개의 홀 패턴(650)이 형성되며, 제 N-1 팬 아웃 배선(FLn -1)에는 13개의 홀 패턴(650)이 형성되고, 제 N 팬 아웃 배선(FLn)에는 12개의 홀 패턴(650)이 형성된다.
본 실시예에 도시된 홀 패턴의 개수는 설명의 편의를 위한 예에 불과하며, 이러한 홀 패턴의 개수는 다양하게 조절될 수 있다. 이러한 홀 패턴의 디자인 룰에 대해서는 이하에서 상세히 상술한다.
도 3a는 홀 패턴이 형성되지 않은 팬 아웃 배선의 평면도, 도 3b는 홀 패턴이 형성된 팬 아웃 배선의 평면도, 도 3c는 도 3b에 도시된 팬 아웃 배선의 일부를 확대한 평면도이고, 도 3d는 도 3c에 도시된 팬 아웃 배선의 저항의 등가 저항을 나타낸 도이다.
도 3a에는 홀 패턴이 형성되지 않은 팬 아웃 배선이 도시된다. 이러한 팬 아웃 배선의 저항값(RL)은 다음과 같다.
[식 1]
Figure 112006091635969-PAT00003
,
이때, RS는 시트 저항(sheet resistance), L은 팬 아웃 배선의 길이 및 W는 팬 아웃 배선의 선폭을 나타낸다.
도 3b에는 홀 패턴이 형성된 팬 아웃 배선이 도시되며, 이때 홀 패턴(650)의 개수는 n개이며, 홀 패턴(650)은 정방형 또는 장방형으로 형성되며, 각 홀 패턴(650)은 소정 간격(s)으로 이격되어 배치되도록 형성된다. 이때, 홀 패턴(650)의 제1변의 길이는 x이며, 제2변의 길이는 y이다.
도 3c는 도 3b에 도시된 팬 아웃 배선의 점선 원형을 확대한 평면도이며, 도 3d는 도 3c에 도시된 팬 아웃 배선의 저항의 등가 저항을 나타낸 도이다.
도 3c를 참조하면, 팬 아웃 배선은 A 영역 내지 G 영역과 홀 패턴(650)으로 구성되며, 각 영역은 저항을 의미한다. 도 3d를 참조하면, B-C 병렬 저항과 E-F 병렬 저항은 A, D 및 G 저항과 직렬로 연결된다. 따라서, 도 3d에 도시된 팬 아웃 배선의 선저항값은 RA+[(RBRC)/(RB+RC)]+RD+[(RERF)/(RE+RF)]+RG 가 된다.
상기에서 살펴본 결과를 도 3b에 도시된 n개의 홀 패턴이 j
Figure 112006091635969-PAT00004
k 매트릭스 형태로 팬 아웃 배선에 적용하면 다음과 같다(이때, j=1, k=n으로 가정).
홀 패턴이 n개 있다면 A와 같은 저항이 n개, B-C와 같은 병렬저항이 n개가 직렬로 연결되어 있는 회로로 나타낼 수 있다. 또한, 홀 패턴이 부분적으로 삽입되어 있으므로, 홀 패턴이 삽입된 부분을 제외한 선저항이 추가적으로 직렬로 연결된다.
따라서, 홀 패턴이 n개 형성된 팬 아웃 배선의 선저항값(RH)은 다음과 같다.
[식 2]
RH = (RA
Figure 112006091635969-PAT00005
n) + (RBC
Figure 112006091635969-PAT00006
n) + Rres
=
Figure 112006091635969-PAT00007
=
Figure 112006091635969-PAT00008
여기서, RA 는 선폭이 W이고 길이가 s인 선저항값이며, RB 는 선폭이 (W-y)/2이고 길이가 x인 선저항값이며, RBC는 선폭이 (W-y)/2이고 길이가 x인 RB 와 Rc 를 병렬 연결한 선저항값이며, Rres는 홀 패턴이 추가된 영역을 제외한 나머지 부분의 선저항값을 나타낸다.
Figure 112006091635969-PAT00009
이며,
Figure 112006091635969-PAT00010
,
Figure 112006091635969-PAT00011
이며,
Figure 112006091635969-PAT00012
이다.
상기 식 2에서는 j가 1인 경우를 살펴보았으나, j가 2 이상인 경우 즉, 홀 패턴이 2행 이상인 경우의 팬 아웃 배선의 선저항값(RH)을 살펴보면 다음과 같다.
[식 3]
Figure 112006091635969-PAT00013
상기 식 2 및 식 3에 따라 홀 패턴의 개수 및 크기를 조절하여 길이 및 선폭이 상이한 팬 아웃 배선의 선 저항값을 균일하게 조절할 수 있게 된다.
도 4는 본 발명의 다른 실시예에 따른 팬 아웃 배선부의 일부를 나타낸 평면도이다. 도 4에 도시된 팬 아웃 배선부는 홀 패턴이 다수의 행으로 형성된다는 점이 상기 실시예와 상이하며, 나머지 구성은 유사하다.
도 4를 참조하면, 제N-1 팬 아웃 배선(FLn -1)에는 홀 패턴(650)이 3행으로 형성되며, 제N 팬 아웃 배선(FLn)에는 홀 패턴(650)이 2행으로 형성된다. 이와 같이, 홀 패턴(650)은 복수의 행으로 형성될 수도 있으며, 팬 아웃 배선의 선폭은 동일하게 형성될 수도 있고, 서로 상이하게 형성될 수도 있다.
도 5는 본 발명에 따른 팬 아웃 배선부를 구비한 액정표시장치의 일 예를 도 시한 개략적인 단면도이고, 도 6은 본 발명에 따른 팬 아웃 배선부를 구비한 액정표시장치의 다른 예를 도시한 개략적인 단면도이다.
도 5 및 도 6을 참조하면, 액정표시장치는 박막 트랜지스터 기판(100), 컬러 필터 기판(200), 액정층(300), 신호 배선(400), 본딩 배드(500), 팬 아웃 배선부(600) 및 구동회로유닛(700)을 포함한다.
박막 트랜지스터 기판(100)은 매트릭스 형태의 박막 트랜지스터(TFT)(150)가 형성되어 있는 투명한 유리 기판이다. TFT(150)들의 소스 단자에는 데이터 배선이 연결되며, 게이트 단자에는 게이트 배선이 연결되고, 드레인 단자에는 투명한 도전성 재질인 투명 전극으로 이루어진 화소 전극이 연결되어, 데이터 배선 및 게이트 배선에 전기적 신호를 입력하면 각각의 TFT가 턴-온(turn-on) 또는 턴-오프(turn-off)되어 드레인 단자의 화소 형성에 필요한 전기적 신호를 인가한다.
컬러 필터 기판(200)은 광이 통과하면서 소정의 색이 발현되는 색화소인 RGB 화소가 박막 공정에 의해 형성된 기판이다. 컬러 필터 기판(200) 상에는 인듐 틴 옥사이드(indium tin oxide: ITO) 또는 인듐 징크 옥사이드(indium zinc oxide: IZO) 등의 투명한 도전체로 이루어진 공통전극이 도포되어 있다.
박막 트랜지스터 기판(100)의 게이트 단자 및 소스 단자에 전원을 인가하여 TFT를 턴-온시키면 화소 전극과, 컬러 필터 기판의 공통 전극 사이에는 전계가 형성되고, 이로 인해 TFT 기판과 컬러 필터 기판 사이에 주입된 액정의 배열이 변화되고, 변화된 배열에 따라 광투과도가 변경되어 원하는 화상을 얻게 된다.
신호 배선(400)은 TFT 기판의 데이터 신호 배선과 게이트 신호 배선으로 이 루어지며, 그 단부에는 팬 아웃 배선부(600)를 통하여 본딩 패드(500)가 전기적으로 연결된다. 팬 아웃 배선부(600)는 상기에서 살펴본 바와 같이, 서로 상이한 길이를 갖는 복수의 팬 아웃 배선으로 구성되며, 각 팬 아웃 배선에는 홀 패턴이 형성되어, 등저항을 갖게 된다. 본딩 패드(500)는 팬 아웃 배선부(600)의 단부에 형성되며, 구동회로유닛(700)과 전기적으로 접속되는 부분이다.
구동회로유닛(700)은 본딩 패드(500)와 연결되어 팬 아웃 배선부(600)를 통하여 신호 배선(400)에 구동 신호를 제공하는 구동 IC(710)와 타이밍 제어 신호를 제공하는 타이밍 제어기 등과 같은 다양한 구동 회로 부품(770)이 실장된 인쇄회로기판(760)을 포함한다. 이러한 구동 IC(710)는 데이터 배선에 계조전압을 인가하는 소스 구동 드라이브 IC 및 게이트 배선에 박막 트랜지스터 제어 신호를 인가하는 게이트 구동 드라이브 IC를 포함한다. 이때, 소스 구동 드라이브 IC와 게이트 구동 드라이브 IC는 별개로 형성될 수도 있으며, 하나의 칩 형태로 형성될 수도 있다.
구동 IC(710)를 박막 트랜지스터 기판(100)의 본딩 패드(500)에 연결하는 방법으로는 도 5에 도시된 탭(TAB; Tape Automated Bonding) 방식과 도 6에 도시된 칩 온 글라스(COG; Chip On Glass)방식이 있다.
도 5를 참조하면, 탭 방식은 테이프에 구동 IC(710)가 탑재된 테이프 캐리어 패키지(TCP; Tape Carrier Package)(750)의 출력 리드들은 신호 배선(400)에 연결된 본딩 패드(500)에 접속시키고, 테이프 캐리어 패키지(750)의 입력 리드들은 인쇄회로기판(760)에 연결시키는 방법이다.
본 실시예에서는 TCP만을 예로서 상술하고 있으나, 이는 단지 예시일 뿐이 며, TCP보다 유연성이 우수한 재질을 사용하여, 어떠한 위치에서도 자유로이 90도 이상 구부릴 수 있는 COF(Chip On Film) 기술의 패드 구조에도 적용될 수 있다.
도 6을 참조하면, COG 본딩은 박막 트랜지스터 기판(100)의 본딩 패드(500)에 구동 IC(710)를 직접 실장하는 방식으로서, 구동 IC(710)의 출력단자를 각각의 본딩 패드에 접속시키며, 커넥터(780)를 이용하여 구동 IC(710)의 입력 단자들과 인쇄회로기판(760)에 연결시키는 방법이다.
상기 실시예들에서는 평판표시장치 중 액정표시장치를 위주로 상술하였지만, 본 발명의 일 실시예에 따른 팬 아웃 배선 구조는 액정표시장치에 한정되는 것은 아니며, 이 이외에도, 반도체 성질을 갖는 유기물 또는 공액 고분자를 발광소재로 하여, 이를 두 전극 사이에 끼워 놓고 전압을 가하면 전류가 발광소재 내로 흐르면서 유기물 또는 고분자로부터 빛이 발생되는 원리(전기발광이라 부른다)를 이용하는 OLED 또는 두 장의 기판 사이에 작은 셀을 다수 배치하고 그 상하에 장착된 전극(+와 -)사이에서 가스(네온과 아르곤)방전을 일으켜 거기서 발생하는 자외선에 의해 자기 발광시켜 컬러화상을 재현하는 PDP 등의 평판표시장치에도 적용될 수 있다.
이상에서 설명한 것은 본 발명에 따른 팬아웃 배선 구조와 이를 구비한 평판표시패널 및 평판표시장치의 예시적인 실시예에 불과한 것으로서, 본 발명은 상기한 실시예에 한정되지 않고, 이하의 특허청구범위에서 청구하는 바와 같이, 본 발명의 요지를 벗어남이 없이 당해 발명이 속하는 분야에서 통상의 지식을 가진 자라 면 누구든지 다양한 변경 실시가 가능한 범위까지 본 발명의 기술적 정신이 있다고 할 것이다.
전술한 바와 같이 본 발명에 따르면, 팬 아웃 배선간의 저항차를 최소화하고, 이에 의해 신호배선에 인가되는 신호의 왜곡을 최소화하여, 평판표시장치의 화질을 개선할 수 있게 된다.

Claims (19)

  1. 신호 배선과 본딩 패드를 연결하는 팬 아웃 배선 구조로서,
    상호 이격되어 배치된 복수의 팬 아웃 배선들을 포함하며, 상기 복수의 팬 아웃 배선의 길이는 서로 상이하게 형성되며, 상기 복수의 팬 아웃 배선들 중 적어도 일부 팬 아웃 배선들에는 각 팬 아웃 배선의 저항차를 보상하기 위한 홀 패턴이 형성되는 것을 특징으로 하는 팬 아웃 배선 구조.
  2. 제1항에 있어서,
    상기 각 팬 아웃 배선에는 복수의 홀 패턴이 상호 이격되어 형성되는 것을 특징으로 하는 팬 아웃 배선 구조.
  3. 제2항에 있어서,
    상기 각 팬 아웃 배선의 선폭은 동일하게 형성되며, 상기 각 팬 아웃 배선의 길이에 따라, 상기 각 팬 아웃 배선에 형성된 홀 패턴의 크기 또는 개수가 조절되는 것을 특징으로 하는 팬 아웃 배선 구조.
  4. 제3항에 있어서,
    상기 홀 패턴의 크기는 동일하게 형성되며, 상기 팬 아웃 배선의 길이가 증가할수록, 상기 홀 패턴의 개수는 감소되도록 형성되는 것을 특징으로 하는 팬 아 웃 배선 구조.
  5. 제2항에 있어서,
    상기 각 팬 아웃 배선의 선폭은 상이하게 형성되며, 상기 각 팬 아웃 배선의 길이 및 선폭에 따라, 상기 각 팬 아웃 배선에 형성된 홀 패턴의 크기 또는 개수가 조절되는 것을 특징으로 하는 팬 아웃 배선 구조.
  6. 제2항에 있어서,
    상기 홀 패턴은 j
    Figure 112006091635969-PAT00014
    k 매트릭스 형태로 형성되는 것을 특징으로 하는 팬 아웃 배선 구조.
  7. 제6항에 있어서,
    상기 각 팬 아웃 배선의 선저항은 이하의 식에 따라 상기 홀 패턴을 형성하여 등저항을 이루도록 하며,
    [식]
    RH = RS(
    Figure 112006091635969-PAT00015
    )
    RH는 팬 아웃 배선의 선저항, RS는 팬 아웃 배선의 시트저항(sheet resistance), L은 팬 아웃 배선의 길이, W는 팬 아웃 배선의 선폭, x는 홀 패턴의 제1변의 길이, y는 홀 패턴의 제2변의 길이, n은 홀 패턴의 개수 및 j는 홀 패턴의 행의 개수 및 k는 홀 패턴의 열의 개수인 것을 특징으로 하는 팬 아웃 배선 구조.
  8. 기판 상에 형성된 신호 배선;
    외부로부터의 구동 신호가 인가되는 본딩 패드; 및
    상기 신호 배선과 상기 본딩 패드를 전기적으로 연결하기 위한 팬 아웃 배선부를 포함하며,
    상기 팬 아웃 배선부는,
    상호 이격되어 배치된 복수의 팬 아웃 배선들을 포함하며, 상기 복수의 팬 아웃 배선의 길이는 서로 상이하게 형성되며, 상기 복수의 팬 아웃 배선들 중 적어도 일부 팬 아웃 배선들에는 각 팬 아웃 배선의 저항차를 보상하기 위한 홀 패턴이 형성되는 것을 특징으로 하는 평판표시패널.
  9. 제8항에 있어서,
    상기 평판표시패널은,
    제1 기판;
    상기 제1 기판과 대향되는 제2 기판; 및
    상기 제1 기판과 상기 제2 기판 사이에 주입된 액정층을 포함하며, 상기 신호 배선은 상기 제1 기판 상에 형성되는 액정표시패널인 것을 특징으로 하는 평판표시패널.
  10. 제8항에 있어서,
    상기 각 팬 아웃 배선에는 복수의 홀 패턴이 상호 이격되어 형성되는 것을 특징으로 하는 평판표시패널.
  11. 제10항에 있어서,
    상기 홀 패턴은 j
    Figure 112006091635969-PAT00016
    k 매트릭스 형태로 형성되는 것을 특징으로 하는 평판표시패널.
  12. 제11항에 있어서,
    상기 각 팬 아웃 배선의 선저항은 이하의 식에 따라 상기 홀 패턴을 형성하여 등저항을 이루도록 하며,
    [식]
    RH = RS(
    Figure 112006091635969-PAT00017
    )
    RH는 팬 아웃 배선의 선저항, RS는 팬 아웃 배선의 시트저항, L은 팬 아웃 배선의 길이, W는 팬 아웃 배선의 선폭, x는 홀 패턴의 제1변의 길이, y는 홀 패턴의 제2변의 길이, n은 홀 패턴의 개수 및 j는 홀 패턴의 행의 개수 및 k는 홀 패턴의 열의 개수인 것을 특징으로 하는 평판표시패널.
  13. 기판 상에 형성된 신호 배선; 외부로부터의 구동 신호가 인가되는 본딩 패 드; 및 상기 신호 배선과 상기 본딩 패드를 전기적으로 연결하기 위한 팬 아웃 배선부를 포함하는 평판표시패널; 및
    상기 평판표시패널을 구동하기 위한 구동 IC를 포함하는 구동회로유닛을 포함하며,
    상기 팬 아웃 배선부는,
    상호 이격되어 배치된 복수의 팬 아웃 배선들을 포함하며, 상기 복수의 팬 아웃 배선의 길이는 서로 상이하게 형성되며, 상기 복수의 팬 아웃 배선들 중 적어도 일부 팬 아웃 배선들에는 각 팬 아웃 배선의 저항차를 보상하기 위한 홀 패턴이 형성되는 것을 특징으로 하는 평판표시장치.
  14. 제13항에 있어서,
    상기 평판표시패널은,
    제1 기판;
    상기 제1 기판과 대향되는 제2 기판; 및
    상기 제1 기판과 상기 제2 기판 사이에 주입된 액정층을 포함하며, 상기 신호 배선은 상기 제1 기판 상에 형성되는 액정표시패널인 것을 특징으로 하는 평판표시장치.
  15. 제13항에 있어서,
    상기 구동 IC는 TCP(Tape Carrier Package)를 통하여 상기 본딩 패드와 연결 되는 것을 특징으로 하는 평판표시장치.
  16. 제13항에 있어서,
    상기 구동 IC는 COG(Chip On Glass) 실장 방식을 통하여 상기 본딩 패드 상에 실장되는 것을 특징으로 하는 평판표시장치.
  17. 제13항에 있어서,
    상기 각 팬 아웃 배선에는 복수의 홀 패턴이 상호 이격되어 형성되는 것을 특징으로 하는 평판표시장치.
  18. 제17항에 있어서,
    상기 홀 패턴은 j
    Figure 112006091635969-PAT00018
    k 매트릭스 형태로 형성되는 것을 특징으로 하는 평판표시장치.
  19. 제18항에 있어서,
    상기 각 팬 아웃 배선의 선저항은 이하의 식에 따라 상기 홀 패턴을 형성하여 등저항을 이루도록 하며,
    [식]
    RH = RS(
    Figure 112006091635969-PAT00019
    )
    RH는 팬 아웃 배선의 선저항, RS는 팬 아웃 배선의 시트저항, L은 팬 아웃 배선의 길이, W는 팬 아웃 배선의 선폭, x는 홀 패턴의 제1변의 길이, y는 홀 패턴의 제2변의 길이, n은 홀 패턴의 개수 및 j는 홀 패턴의 행의 개수 및 k는 홀 패턴의 열의 개수인 것을 특징으로 하는 평판표시장치.
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