KR20080050691A - Display apparatus - Google Patents
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Abstract
Description
도 1은 본 발명의 일 실시예에 의한 표시 장치를 개략적으로 나타낸 블록도이다. 1 is a block diagram schematically illustrating a display device according to an exemplary embodiment of the present invention.
도 2는 도 1에 도시된 공통 전압 발생부 및 공통 전압 분할 출력부를 개략적으로 나타낸 블록도이다. FIG. 2 is a block diagram schematically illustrating a common voltage generator and a common voltage divider output unit illustrated in FIG. 1.
도 3은 도 1에 도시된 표시 패널의 공통 전압 인가 배선을 개략적으로 나타낸 평면도이다. 3 is a plan view schematically illustrating a common voltage application wiring of the display panel illustrated in FIG. 1.
도 4는 도 3의 공통 전압 인가 배선을 단위 영역에 대하여 나타낸 평면도이다. 4 is a plan view illustrating the common voltage application wiring of FIG. 3 with respect to a unit area.
<도면의 주요 부분에 대한 부호의 설명> <Explanation of symbols for the main parts of the drawings>
100 : 표시 장치 110 : 표시 패널100: display device 110: display panel
111 : 제1 기판 112 : 제2 기판111: first substrate 112: second substrate
113 : 단위 화소 114 : 분할 영역113: unit pixel 114: division area
120 : 게이트 구동부 130 : 데이터 구동부120: gate driver 130: data driver
140 : 공통전압 발생부 150 : 공통전압 분할 출력부140: common voltage generator 150: common voltage division output unit
본 발명은 표시 장치에 관한 것으로, 더욱 상세하게는 킥 백(kick back)에 의한 잔상을 줄일 수 있는 표시 장치에 관한 것이다. BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a display device, and more particularly, to a display device capable of reducing afterimages caused by kick back.
일반적인 표시 장치는 영상을 표시하는 표시 패널과 표시 패널의 구동을 제어하는 구동 유닛을 갖는다. 상기 표시 패널은 스위칭 소자인 박막 트랜지스터(thin film transistor; TFT)가 형성된 제1 기판, 제1 기판과 대향하는 제2 기판 및 상기 두 기판 사이에 개재되는 액정층을 포함한다. 제1 기판은 교차하는 복수의 데이터 라인들 및 게이트 라인들, 및 상기 데이터 라인들 및 게이트 라인들에 의해 정의되는 복수의 화소부를 포함한다. 한편, 각 화소부는 TFT, 액정 커패시터(CLC) 및 스토리지 커패시터(CST)를 포함한다. A typical display device has a display panel for displaying an image and a driving unit for controlling driving of the display panel. The display panel includes a first substrate on which a thin film transistor (TFT) as a switching element is formed, a second substrate facing the first substrate, and a liquid crystal layer interposed between the two substrates. The first substrate includes a plurality of intersecting data lines and gate lines, and a plurality of pixel portions defined by the data lines and gate lines. Meanwhile, each pixel unit includes a TFT, a liquid crystal capacitor CLC, and a storage capacitor CST.
일반적으로 상기 게이트 라인들에는 게이트 전압이 제공되어 TFT를 턴-온(turn-on) 및 턴-오프(turn-off) 시킨다. 상기 게이트 전압은 상기 게이트 라인들과 연결된 TFT의 게이트 전극과 액정 커패시터의 제1 전극에 연결된 TFT의 드레인 전극 사이에 기생 커패시터(Cgd)를 형성한다. 따라서, 상기 게이트 라인들의 전위가 게이트 온 전압(Von)에서 게이트 오프 전압(Voff)으로 천이되는 하강 에지(edge)에서 기생 커패시터(Cgd)의 제1 전극의 전위가 변동됨에 따라 상기 화소부에 연결된 제2 전극의 전위가 변동된다. In general, a gate voltage is provided to the gate lines to turn the TFT on and off. The gate voltage forms a parasitic capacitor Cgd between the gate electrode of the TFT connected to the gate lines and the drain electrode of the TFT connected to the first electrode of the liquid crystal capacitor. Accordingly, the potential of the first electrode of the parasitic capacitor Cgd is changed at the falling edge at which the potential of the gate lines transitions from the gate-on voltage Von to the gate-off voltage Voff. The potential of the second electrode is varied.
이는 데이터 신호에 의해 충전되는 액정 커패시터(CLC) 및 스토리지 커패시터(CST)에 충전 전압이 기생 커패시터(Cgd)의 전위 변화에 연동하여 충전 전압 저하를 야기하는 킥 백(kick back) 전압을 발생하게 된다. 상기 킥 백 전압은 화소 내에 불순물이 존재하는 경우 표시 패널에 잔상을 유발시켜 표시 불량을 일으키는 원인이 된다. This generates a kick back voltage in the liquid crystal capacitor CLC and the storage capacitor CST charged by the data signal in response to the potential change of the parasitic capacitor Cgd, causing the charge voltage to drop. . The kickback voltage causes an afterimage on the display panel when impurities are present in the pixel, causing display defects.
따라서 본 발명의 기술적 과제는 이러한 종래의 문제점을 해결하기 위한 것으로, 본 발명의 목적은 킥 백(kick back)에 의한 잔상을 감소시켜 표시 품질을 향상시킨 표시 장치을 제공하기 위한 것이다. Accordingly, an aspect of the present invention is to solve such a conventional problem, and an object of the present invention is to provide a display device having improved display quality by reducing afterimages caused by kick back.
상기한 본 발명의 목적을 실현하기 위한 백라이트 표시 장치는 표시 패널, 구동부, 공통 전압 발생부 및 공통 전압 분할 출력부를 포함한다. 상기 표시 패널은 서로 교차하는 복수의 게이트 라인 및 데이터 라인, 복수의 화소부들과 스위칭 소자를 포함하는 제1 기판 및 상기 제1 기판과 대향하는 제2 기판을 포함하며, 상기 제1 기판 및 제2 기판에는 각각 스토리지 커패시터와 액정 커패시터의 일 전극이 전기적으로 연결된다. 상기 구동부는 스위칭 소자에 구동 신호를 출력한다. 상기 공통 전압 발생부는 상기 스토리지 커패시터 및 액정 커패시터에 인가되는 공통 전압을 출력한다. 상기 공통 전압 분할 출력부는 상기 공통 전압 발생부에 연결되어 상기 공통 전압을 복수 개로 분할하고, 상기 분할된 복수 개의 공통 전압을 상기 표시 패널의 분할 영역에 포함된 상기 스토리지 커패시터 및 액정 커피시터에 공통으로 공급한다. A backlight display device for realizing the above object of the present invention includes a display panel, a driver, a common voltage generator and a common voltage divider output. The display panel includes a plurality of gate lines and data lines crossing each other, a first substrate including a plurality of pixel units and a switching element, and a second substrate facing the first substrate, wherein the first substrate and the second substrate are opposite to each other. One electrode of the storage capacitor and the liquid crystal capacitor is electrically connected to the substrate, respectively. The driving unit outputs a driving signal to the switching element. The common voltage generator outputs a common voltage applied to the storage capacitor and the liquid crystal capacitor. The common voltage division output unit is connected to the common voltage generation unit to divide the common voltage into a plurality, and the plurality of divided common voltages are common to the storage capacitor and the liquid crystal coffee sheet included in the division area of the display panel. Supply.
상기 공통 전압 분할 출력부는 복수의 저항을 포함하여 상기 공통 전압을 복수 개로 분할할 수 있다. 상기 공통 전압의 분할 개수 및 각각의 분할된 공통 전 압의 크기는 상기 표시 패널의 분할 영역에서 발생하는 잔상의 양에 따라 결정될 수 있다. 상기 잔상이 상대적으로 크게 발생하는 상기 표시 패널의 분할 영역에 공급되는 공통 전압은 상기 잔상이 상대적으로 작게 발생하는 상기 표시 패널의 분할 영역에 공급되는 공통 전압보다 작을 수 있다. The common voltage division output unit may include a plurality of resistors to divide the common voltage into a plurality. The number of divisions of the common voltage and the size of each divided common voltage may be determined according to the amount of residual images generated in the division area of the display panel. The common voltage supplied to the divided area of the display panel in which the afterimage occurs relatively large may be smaller than the common voltage supplied to the divided area of the display panel in which the afterimage occurs relatively small.
상기 분할된 공통 전압들 각각은 상기 표시 패널의 제1 기판 및 제2 기판에 동시에 연결된 입력 단자를 통해 입력될 수 있다. 상기 표시 패널의 제1 기판 및 제2 기판은 각각 제1 공통 전압 인가 배선 및 제2 공통 전압 인가 배선을 포함하며, 상기 제1 공통 전압 인가 배선 및 상기 제2 공통 전압 인가 배선은 상기 분할된 공통 전압들 각각을 공통으로 인가 하도록 동일한 방향으로 서로 대응되도록 형성될 수 있다. 상기 제1 기판 및 제2 기판의 공통 전압 인가 배선은 상기 데이터 라인과 평행한 방향으로 형성될 수 있다. 한편, 상기 제1 기판 및 제2 기판의 공통 전압 인가 배선은 상기 게이트 라인과 평행한 방향으로 형성될 수 있다. Each of the divided common voltages may be input through an input terminal simultaneously connected to a first substrate and a second substrate of the display panel. The first substrate and the second substrate of the display panel each include a first common voltage application wiring and a second common voltage application wiring, and the first common voltage application wiring and the second common voltage application wiring are divided into the common. It may be formed to correspond to each other in the same direction to apply each of the voltages in common. The common voltage application wiring of the first substrate and the second substrate may be formed in a direction parallel to the data line. On the other hand, the common voltage application wiring of the first substrate and the second substrate may be formed in a direction parallel to the gate line.
상기한 본 발명에 따르면, 제1 기판 및 제2 기판에 동일한 분할 영역에 동일한 공통 전압을 인가함으로써, 표시 패널의 위치별 킥 백(kick back) 양의 차이를 최소화할 수 있다. 그리하여, 킥 백(kick back)에 의한 잔상을 줄여 표시 장치의 표시 품질을 향상시킬 수 있다. According to the present invention, by applying the same common voltage to the same divided region to the first substrate and the second substrate, it is possible to minimize the difference in the amount of kick back for each position of the display panel. Thus, the image quality of the display device can be improved by reducing the afterimage caused by the kick back.
이하, 첨부한 도면들을 참조하여, 본 발명의 바람직한 실시예를 보다 상세하게 설명하고자 한다. Hereinafter, with reference to the accompanying drawings, it will be described in detail a preferred embodiment of the present invention.
도 1은 본 발명의 일 실시예에 의한 표시 장치를 개략적으로 나타낸 블록도이다. 도 2는 도 1에 도시된 공통 전압 발생부 및 공통 전압 분할 출력부를 개략 적으로 나타낸 블록도이다. 1 is a block diagram schematically illustrating a display device according to an exemplary embodiment of the present invention. FIG. 2 is a block diagram schematically illustrating a common voltage generator and a common voltage divider output shown in FIG. 1.
도 1 및 도 2를 참조하면, 본 발명의 일 실시예에 의한 표시 장치(100)는 표시 패널(110), 게이트 구동부(120), 데이터 구동부(130), 공통 전압 발생부(140) 및 공통 전압 분할 출력부(150)을 포함한다. 1 and 2, a
상기 표시 패널(110)은 제1 기판(111), 제2 기판(112) 및 상기 제1 기판(111) 및 제2 기판(112) 사이에 개재된 액정층(미도시)을 포함한다. 상기 제1 기판(111)은 복수의 데이터 라인들(DL1,...,DLm)과 상기 복수의 데이터 라인(DL)과 교차로 배선된 복수의 게이트 라인들(GL1,...,GLn)을 포함하고, 상기 데이터 라인들(DL1,...,DLm) 및 게이트 라인들(GL1,...,GLn)에 의해 정의되는 복수의 화소부를 포함한다. 상기 각각의 화소부(113)는 스위칭 소자인 박막 트랜지스터(thin film transistor; TFT), 액정 커패시터(liquid crystal capacitor; CLC) 및 스토리지 커패시터(storage capacitor; CST)를 포함한다. 상기 스위칭 소자(TFT)는 상기 게이트 라인들(GL1,...,GLn)과 전기적으로 연결되는 게이트 전극, 상기 데이터 라인들(DL1,...,DLm)과 전기적으로 연결되는 소스 전극, 및 화소 전극과 전기적으로 연결되는 드레인 전극을 포함한다. The
한편, 상기 액정 커패시터(CLC)는 상기 스위칭 소자(TFT)의 드레인 전극과 전기적으로 연결된 화소 전극인 제1 전극과, 상기 제2 기판(112)에 형성된 공통 전극인 제2 전극을 포함한다. 상기 스토리지 커패시터(CST)는 상기 화소 전극인 제1 전극과, 상기 제1 기판(111)에 인가되는 공통 전극인 제2 전극을 포함한다. The liquid crystal capacitor CLC includes a first electrode, which is a pixel electrode electrically connected to the drain electrode of the switching element TFT, and a second electrode, which is a common electrode formed on the
상기 제2 기판(112)은 상기 화소(113)에 대응하는 위치에 컬러를 발현하기 위한 컬러 필터를 가지며 상기 액정 커패시터(CLC)의 상기 제2 전극인 제2 공통 전극(미도시)을 포함한다. The
상기 스토리지 커패시터(CST)의 상기 제2 전극인 제1 공통 전극(미도시)과 상기 액정 커패시터(CLC)의 상기 제2 전극인 제2 공통 전극에는 상기 공통 전압 발생부(140)에서 발생된 공통 전압(VCOM, VST)이 상기 공통 전압 분할 출력부(150)에서 복수의 공통 전압들(VCOM1,...,VCOMn, VST1, VST2)로 분할 되어 인가된다. 이 때, 상기 공통 전압(VCOM, VST)은 일정 레벨로 제공되는 DC 전압이고, 상기 공통 전압 분할 출력부(150)에서 분할된 복수의 공통 전압들(VCOM1,...,VCOMn, VST1, VST2)도 일정 레벨로 제공되는 DC 전압이다. The
상기 공통 전압 발생부(140)에서 발생된 공통 전압(VCOM, VST)이 상기 공통 전압 분할 출력부(150)에서 복수의 공통 전압들로 분할되어 상기 액정 커패시터(CLC) 및 상기 스토리지 커패시터(CST)에 인가되는 방법은 후술한다. The common voltages VCOM and VST generated by the
상기 게이트 구동부(120)는 제1 제어 신호(CONTROL1)에 기초하여 제1 데이터 신호를 아날로그 형태의 게이트 신호들(G1,...,Gn)로 변환하여 상기 표시 패널(110)의 게이트 라인들(GL1,...,GLn)에 출력한다. The
상기 데이터 구동부(130)는 제2 제어 신호(CONTROL2)에 기초하여 제2 데이터 신호를 아날로그 형태의 데이터 신호들(D1,...,Dm)로 변환하여 상기 표시 패널(110)의 데이터 라인들(DL1,...,DLm)에 출력한다. The
상기 공통 전압 발생부(140)는 제3 제어 신호(CONTROL3)에 기초하여 게이트 온/오프 전압(VON, VOFF) 및 공통 전압(VCOM, VST) 등을 발생한다. 상기 게이트 온/오프 전압(VON, VOFF)은 상기 게이트 구동부(120)에 제공된다. 상기 공통 전압(VCOM, VST)은 상기 공통 전압 분할 출력부(150)에서 상기 복수의 공통 전압들(VCOM1,...,VCOMn, VST1, VST2)로 분할 되어 상기 표시 패널(110)의 스토리지 커패시터(VST) 및 액정 커패시터(CLC)에 제공된다. 이미 언급하였듯이, 상기 공통 전압(VCOM, VST) 및 상기 복수의 공통 전압들(VCOM1,...,VCOMn, VST1, VST2)은 DC 전압이다. The
상기 공통 전압 분할 출력부(150)는 상기 공통 전압 발생부(140)로부터 인가된 상기 공통 전압(VCOM, VST)을 복수의 공통 전압들(VCOM1,...,VCOMn, VST1, VST2)로 분할한 후, 상기 복수의 공통 전압들(VCOM1,...,VCOMn, VST1, VST2)을 상기 액정 커패시터(CLC) 및 스토리지 커패시터(CST)에 제공한다. 상기 공통 전압 분할 출력부(150)는 복수의 저항들(R1,...,Rn, RC1, RC2)을 포함한다. 상기 공통 전압 발생부(140)로부터 인가된 상기 공통 전압(VCOM, VST)은 상기 복수의 저항들(R1,...,Rn, RC1, RC2)을 통해 복수의 공통 전압들(VCOM1,...,VCOMn, VST1, VST2)로 분할된다. The common voltage
구체적으로, 상기 복수의 저항들(R1,...,Rn, RC1, RC2)을 통과하며, 상기 공통 전압 발생부(140)로부터 인가되는 전압(VCOM, VST)은 전압 강하되어, 다양한 전위를 갖는 복수의 공통 전압들(VCOM1,...,VCOMn, VST1, VST2)로 변환된다. 이 때, 각각의 공통 전압들(VCOM1,...,VCOMn, VST1, VST2)의 전압 강하량은 상기 각각의 공통 전압들(VCOM1,...,VCOMn, VST1, VST2)이 인가되는 상기 표시 패널(110)의 분할 영역(114)에서 발생하는 플리커(flicker) 및 잔상의 정도에 따라 가변적으로 제 어된다. Specifically, the voltages VCOM and VST that pass through the plurality of resistors R1,..., Rn, RC1, and RC2, and are applied from the
따라서, 상기 전압 강하된 복수의 공통 전압들(VCOM1,...,VCOMn, VST1, VST2)을 대응하는 상기 표시 패널(110)의 분할 영역(114)에 제공하여, 상기 표시 패널(110)의 분할 영역(114) 별로 발생하는 플리커(flicker) 및 잔상을 개선하여, 표시 품질을 전체적으로 향상시킬 수 있다. Accordingly, the plurality of common voltages VCOM1,..., VCOMn, VST1, and VST2, which have been dropped, are provided to the divided
한편, 킥 백(kick back) 전압의 크기와 상기 플리커(flicker) 및 잔상의 정도는 비례한다. 즉, 킥 백(kick back) 전압이 크면, 상기 플리커 및 잔상의 정도도 커진다. 따라서, 각각의 분할된 공통 전압들(COM1,...,VCOMn, VST1, VST2)의 크기는 상기 표시 패널(110)의 분할 영역(114)에서 발생하는 플리커 및 잔상의 양에 따라 결정된다. Meanwhile, the magnitude of the kick back voltage and the degree of flicker and afterimage are proportional to each other. In other words, when the kick back voltage is large, the degree of flicker and afterimage also increases. Accordingly, the sizes of the divided common voltages COM1,..., VCOMn, VST1, and VST2 are determined according to the amount of flicker and residual images generated in the divided
구체적으로, 상기 표시 패널(110)의 분할 영역(114) 별로 발생하는 플리커 및 잔상을 개선하기 위해서는, 상기 각각의 분할 영역(114)에서의 킥 백(kick back) 전압과 대응되는 각각의 공통 전압들(VCOM1,...,VCOMn, VST1, VST2)의 전압을 강하시켜야 한다. 즉, 상기 플리커 및 잔상이 상대적으로 크게 발생하는 상기 표시 패널(110)의 분할 영역(114)에 제공되는 공통 전압(VCOM, VST)은 상기 플리커 및 잔상이 상대적으로 작게 발생하는 상기 표시 패널(110)의 분할 영역(114)에 공급되는 공통 전압(VCOM, VST)보다 작은 것이 바람직하다. Specifically, in order to improve flicker and afterimage occurring in each of the divided
결국, 상기 복수의 저항들(R1,...,Rn, RC1, RC2) 중 상기 플리커 및 잔상이 상대적으로 크게 발생하는 상기 표시 패널(110)의 분할 영역(114)에 제공되는 공통 전압을 제어하는 저항들은, 상기 플리커 및 잔상이 상대적으로 작게 발생하는 상기 표시 패널(110)의 분할 영역(114)에 제공되는 공통 전압을 제어하는 저항들보다 큰 저항을 갖도록 형성하여야 한다. As a result, the common voltage provided to the divided
한편, 상기 공통 전압 분할 출력부(150)에서 분할하는 공통 전압의 분할 개수는 표시 패널의 크기, 표시 패널에서 요구되는 표시 품질, 플리커 및 잔상의 정도 등에 따라 결정된다. The number of division of the common voltage divided by the common voltage
도 3은 도 1에 도시된 표시 패널의 공통 전압 인가 배선을 개략적으로 나타낸 평면도이다. 3 is a plan view schematically illustrating a common voltage application wiring of the display panel illustrated in FIG. 1.
도 3을 참조하면, 본 발명의 실시예에 의한 표시 패널(110)의 제1 기판(111) 및 제2 기판(112)은 상기 분할된 공통 전압들(VCOM1,...,VCOMn, VST1, VST2)을 제공할 수 있는 공통 전압 인가 배선을 포함한다. Referring to FIG. 3, the
도 3에서는 설명의 편의를 위해 수 개의 공통 전압들(VCOM1,...,VCOM7, VST1, VST2)만 도시하였으나, 이미 언급한 바와 같이 상기 분할된 공통 전압들은 표시 패널의 크기, 표시 품질, 플리커 및 잔상의 정도 등에 따라 분할 개수가 달라질 수 있다. In FIG. 3, only a few common voltages VCOM1,..., VCOM7, VST1, and VST2 are shown for convenience of description, but as mentioned above, the divided common voltages may include the size, display quality, and flicker of the display panel. And the number of divisions may vary according to the degree of residual image.
본 발명의 실시예에 의한 표시 장치(100)에서는, 상기 공통 전압 발생부(140) 및 상기 공통 전압 분할 출력부(150)에서 발생한 상기 공통 전압들(VCOM1,...,VCOMn, VST1, VST2)을 상기 표시 패널(110)의 제1 기판(111) 및 제2 기판(112)에 공통으로 인가한다. In the
예를 들어, 킥 백(kick back) 전압에 의한 잔상을 감소시키기 위해 상기 공통 전압(VCOM, VST)을 복수의 공통 전압들(VCOM1,...,VCOMn, VST1, VST2)로 분할하 더라도, 상기 분할된 공통 전압들(VCOM1,...,VCOMn, VST1, VST2)을 상기 제2 기판(112)에만 인가한다면, 동일한 화소(113)에서 상기 제2 기판(112)에 인가되는 공통 전압과 상기 제1 기판(111)에 인가되는 전압은 서로 달라지게 된다. 즉, 상기 제2 기판(112)에는 상기 분할된 공통 전압들(VCOM1,...,VCOMn, VST1, VST2)이 인가되고, 상기 제1 기판(111)에는 분할 전의 공통 전압(VCOM, VST)이 인가되게 된다. For example, even if the common voltages VCOM and VST are divided into a plurality of common voltages VCOM1,..., VCOMn, VST1, and VST2 to reduce an afterimage caused by a kick back voltage. If the divided common voltages VCOM1,..., VCOMn, VST1, and VST2 are applied only to the
이 경우, 상기 표시 패널(110)의 소정의 위치에서 상기 스위칭 소자(TFT)의 드레인 전극과 전기적으로 연결된 화소 전극과 제2 기판(112)에 형성된 공통 전극 간의 전위차, 즉 상기 액정 커패시터(CLC)에 인가되는 전위차와, 상기 화소 전극과 상기 제1 기판(111)에 형성된 공통 전극 간의 전위차, 즉 상기 스토리지 커패시터(CST)에 인가되는 전위차는 서로 달라지게 된다. 그리하여, 상기 표시 패널(110)의 소정의 위치에서 킥 백(kick back)이 발생하게 되어, 만약 상기 화소(113)내에 불순물이 존재 하는 경우, 플리커 또는 잔상이 발생하게 된다. 이러한 현상은, 상기 제1 기판(111)에 상기 분할된 공통 전압들(VCOM1,...,VCOMn, VST1, VST2)이 인가되고, 상기 제2 기판(112)에 분할 전의 공통 전압(VCOM, VST)이 인가되는 경우에도 발생할 수 있다. In this case, the potential difference between the pixel electrode electrically connected to the drain electrode of the switching element TFT at the predetermined position of the
따라서, 본 발명의 실시예에 의한 표시 장치(100)에서는, 상기 공통 전압들(VCOM1,...,VCOMn, VST1, VST2)을 상기 표시 패널(110)의 제1 기판(111) 및 제2 기판(112) 모두에 공통으로 인가한다. Accordingly, in the
그러나, 상기 공통 전압들(VCOM1,...,VCOMn, VST1, VST2)을 상기 표시 패널(110)의 제1 기판(111) 및 제2 기판(112) 모두에 공통으로 인가하기 위해서는, 상기 제1 기판(111) 및 제2 기판(112)에 형성된 제1 공통 전압 인가 배선들(121) 및 제2 공통 전압 인가 배선들(122)을 배선의 형성 방향 등이 서로 대응되도록 설계할 필요가 있다. However, in order to apply the common voltages VCOM1,..., VCOMn, VST1, and VST2 to both the
즉, 도 3에 도시한 바와 같이, 상기 제1 공통 전압 인가 배선들(121) 및 제2 공통 전압 인가 배선들(122)은 동일한 방향으로 서로 마주보며 대응되도록 형성되는 것이 바람직하다. 또한, 상기 각각의 분할된 공통 전압들(VCOM1,...,VCOMn, VST1, VST2)은 상기 제1 기판(111)과 제2 기판(112)에 동시에 연결된 각각의 입력 단자를 통해 입력되는 것이 바람직하다. 그리하여, 상기 입력 단자를 통해 입력된 상기 공통 전압들(VCOM1,...,VCOMn, VST1, VST2)을 상기 제1 기판(111) 및 제2 기판(112)에 서로 대응되도록 형성된 상기 제1 공통 전압 인가 배선들(121) 및 제2 공통 전압 인가 배선들(122)을 통해 상기 표시 패널(110)의 분할 영역(114)에 제공할 수 있게 된다. 나아가, 상기와 같이 표시 패널(110)을 형성하게 되면, 복잡한 상기 표시 패널(110)의 배선도 단순하게 설계될 수 있다. That is, as shown in FIG. 3, the first common
한편, 도 1 및 도 3에서는, 상기 데이터 라인들(DL1,...,DLm)과 평행하게 형성된 제1 공통 전압 인가 배선들(121) 및 제2 공통 전압 인가 배선들(122)을 포함하는 표시 패널(110)을 도시하였다. 그러나, 상기 제1 공통 전압 인가 배선들(121) 및 제2 공통 전압 인가 배선들(122)는 서로 대응되도록 형성되면 충분하며, 상기 게이트 라인들(GL1,...,GLn)과 평행하게 형성될 수도 있다. Meanwhile, FIGS. 1 and 3 include first common
나아가, 상기 공통 전압 발생부(140) 및 상기 공통 전압 분할 출력부(150)는 상기 게이트 구동부(120) 또는 상기 데이터 구동부(130)에 집적되어 상기 공통 전 압(VCOM, VST)을 분할하며, 분할된 공통 전압들(VCOM1,...,VCOMn, VST1, VST2)을 상기 액정 커패시터(VCOM) 및 상기 스토리지 커패시터(VST)에 각각 제공할 수도 있다. Furthermore, the
도 4는 도 3의 공통 전압 인가 배선을 단위 영역에 대하여 나타낸 평면도이다. 4 is a plan view illustrating the common voltage application wiring of FIG. 3 with respect to a unit area.
도 4를 참조하면, 하나의 분할 영역(114)은 상기 제1 공통 전압 인가 배선들(121)이 형성된 방향과 수직인 방향으로 세 개의 단위 화소들(113)이 결합되어 정의된다. 이와는 달리, 하나의 분할 영역(114)은 표시 패널(110)의 크기, 표시 패널(110)에서 요구되는 표시 품질, 플리커 및 잔상의 정도 등에 의해 다양하게 정의될 수 있다. Referring to FIG. 4, one
상기 세 개의 단위 화소들(113)이 결합된 하나의 분할 영역(114)에서는 상기 공통 전압(VCOM1)이 상기 제1 기판(111) 및 제2 기판(112)에 공통으로 인가되고, 이웃하는 다른 분할 영역(124)에서는 상기 공통 전압(VCOM2)이 상기 제1 기판(111) 및 제2 기판(112)에 공통으로 인가됨으로써, 이웃하는 분할 영역들 간의 잔상을 균일하게 제거할 수 있고, 나아가 표시 패널(110)의 잔상을 줄여 표시 품질을 향상시킬 수 있게 된다. In one divided
상기와 같은 본 발명에 따르면, 제1 기판 및 제2 기판에 동일한 분할 영역에 동일한 공통 전압을 인가함으로써, 표시 패널의 위치별 킥 백(kick back) 양의 차이를 최소화할 수 있다. 그리하여, 킥 백(kick back)에 의한 잔상을 줄여 표시 장 치의 표시 품질을 향상시킬 수 있다. According to the present invention as described above, by applying the same common voltage to the same divided region to the first substrate and the second substrate, it is possible to minimize the difference in the amount of kick back (kickback) for each position of the display panel. Thus, the image quality of the display device can be improved by reducing the afterimage caused by the kick back.
앞서 설명한 본 발명의 상세한 설명에서는 본 발명의 바람직한 실시예들을 참조하여 설명하였지만, 해당 기술분야의 숙련된 당업자 또는 해당 기술분야에 통상의 지식을 갖는 자라면 후술될 특허청구범위에 기재된 본 발명의 사상 및 기술 영역으로부터 벗어나지 않는 범위 내에서 본 발명을 다양하게 수정 및 변경시킬 수 있음을 이해할 수 있을 것이다.In the detailed description of the present invention described above with reference to the preferred embodiments of the present invention, those skilled in the art or those skilled in the art having ordinary skill in the art will be described in the claims to be described later It will be understood that various modifications and variations can be made in the present invention without departing from the scope of the present invention.
Claims (8)
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
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KR1020060121237A KR20080050691A (en) | 2006-12-04 | 2006-12-04 | Display apparatus |
Applications Claiming Priority (1)
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KR1020060121237A KR20080050691A (en) | 2006-12-04 | 2006-12-04 | Display apparatus |
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Family Applications (1)
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KR1020060121237A KR20080050691A (en) | 2006-12-04 | 2006-12-04 | Display apparatus |
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-
2006
- 2006-12-04 KR KR1020060121237A patent/KR20080050691A/en not_active Application Discontinuation
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
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US8952878B2 (en) | 2011-10-14 | 2015-02-10 | Samsung Display Co., Ltd. | Display device |
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