KR20070063640A - 액정 표시 장치 및 그 구동방법 - Google Patents

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Abstract

본 발명은 프레임 레이트 콘트롤(FRC)이나 디더링을 사용하지 않고서도 저비트 구동소자를 이용하여 고계조를 표현할 수 있는 액정 표시 장치 및 그 구동방법를 제공하는 것이다.
본 발명에 따른 액정 표시 장치의 구동방법은 N(N은 자연수)비트의 화소 데이터를 입력받아 상기 N비트의 화소 데이터를 N-L(L은 N보다 작은 자연수)비트의 화소 데이터와, L비트의 화소 데이터로 구분하는 단계와; 상기 N-L비트의 화소 데이터를 아날로그 형태의 화소 전압 신호로 변환하는 단계와; 상기 L비트의 화소 데이터를 이용하여 상기 화소 전압 신호의 충전시간을 제어하는 충전 제어 신호를 생성하는 단계와; 상기 충전 제어 신호에 응답하여 상기 화소 전압 신호를 해당 화소에 충전하여 N비트의 계조를 표현하는 단계를 포함하는 것을 특징으로 한다.

Description

액정 표시 장치 및 그 구동방법{Liquid crystal Display And Method Of Driving The Same}
도 1은 본 발명에 따른 액정표시장치를 도시한 구성 블럭도이다.
도 2는 도 1에 도시된 액정 표시 패널의 제1 실시 예를 나타내는 도면이다.
도 3은 도 1에 도시된 액정 표시 패널의 제2 실시 예를 나타내는 도면이다.
도 4는 도 3에 도시된 충전용 박막트랜지스터와 방전용 박막트랜지스터의 문턱전압을 나타내는 그래프이다.
도 5는 본 발명에 따른 데이터 구동부의 동작 타이밍도이다.
<도면의 주요부분에 대한 부호의 설명>
110: 입력 커넥터 120: 타이밍 제어기
130: DC-DC 컨버터 140: 게이트 구동부
150: 데이터 구동부 152: 아날로그 데이터 구동부
154: 디지털 데이터 구동부 160: TFT-LCD 패널
본 발명은 액정 표시 장치 및 그 구동 방법에 관한 것으로, 더욱 상세하게는 저비트의 데이터 구동부를 이용하여 고계조를 표현할 수 있는 액정 표시 장치 및 그 구동 방법에 관한 것이다.
일반적으로, 액정표시장치(LCD)는 칼라필터 기판과 박막트랜지스터 기판 사이에 액정층을 갖는 액정패널과, 액정패널의 각 화소들을 구동하기 위한 구동회로로 이루어진다. 이러한 액정표시장치는 RGB 입력 데이터의 비트 수에 따라 아날로그 전압으로 계조를 표현하는데, 통상 비트 수가 증가할수록 계조표현 능력(Gray Scale)이 향상된다.
최근들어 디스플레이 기술의 발전에 따라 사용자들도 고사양의 디스플레이장치를 요구하는데, 플라즈마 디스플레이 패널(PDP)의 경우 계조표현을 위한 RGB 입력 데이터가 10비트까지 양산되고 있으나 액정표시장치(LCD)의 경우에는 6 내지 8 비트가 주종을 이루고 있다. 이와 같이 액정표시장치(LCD)가 플라즈마 디스플레이(PDP)에 비해 계조 표현 능력이 떨어지는 이유는 PDP는 디지탈 구동을 하나 LCD의 경우 액정에 전계를 가해 액정의 구동으로 빛의 투과율을 조절하여 하므로 아날로그 전압으로 계조를 표현하기 때문이다.
또한 액정표시장치에 있어서 계조 표현 능력을 향상시키기 위하여 RGB 데이터의 비트 수를 늘리게 되면, 데이터 구동 IC는 디지털 아날로그 변환기(DAC)의 면적이 늘어나고 배선도 늘어나게 되어 전체 면적 및 생산 원가가 향상되게 된다.
따라서 종래에는 적은 비트 수의 데이터 구동 IC로 고계조를 표현하기 위해 예컨대, 6비트 데이터 구동 IC로 8비트 데이터 혹은 8비트 데이터 구동 IC로 10비트 데이터를 구동하기 위해 디더링(Dithering)이나 FRC(Frame Rate Control)기술을 적용하고 있다. 이러한 종래 시간적, 공간적으로 분할하여 구동할 경우 사람의 눈이 평균 휘도를 느끼는 특성을 이용하여 가상적으로 계조(Gray)를 만드는 방법이다.
그런데 이와 같이 디더링 등을 이용하여 6비트 구동 IC로 8비트 데이터를 구동할 경우(디더링 8비트)에는 실제 8비트 구동IC로 구동하는 것(트루 8비트)에 비해 색감이 떨어지는 문제점이 있다.
본 발명이 이루고자 하는 기술적 과제는 프레임 레이트 콘트롤(FRC)이나 디더링을 사용하지 않고서도 저비트 구동소자를 이용하여 고계조를 표현할 수 있는 액정 표시 장치 및 그 구동방법을 제공하는 것이다.
상기 기술적 과제를 달성하기 위하여, 본 발명에 따른 액정 표시 장치의 구동방법은 N(N은 자연수)비트의 화소 데이터를 입력받아 상기 N비트의 화소 데이터를 N-L(L은 N보다 작은 자연수)비트의 화소 데이터와, L비트의 화소 데이터로 구분하는 단계와; 상기 N-L비트의 화소 데이터를 아날로그 형태의 화소 전압 신호로 변 환하는 단계와; 상기 L비트의 화소 데이터를 이용하여 상기 화소 전압 신호의 충전시간을 제어하는 충전 제어 신호를 생성하는 단계와; 상기 충전 제어 신호에 응답하여 상기 화소 전압 신호를 해당 화소에 충전하여 N비트의 계조를 표현하는 단계를 포함하는 것을 특징으로 한다.
여기선, 상기 N비트의 화소 데이터는 8비트의 화소 데이터이며, 상기 L비트의 화소 데이터는 6비트의 화소 데이터인 것을 특징으로 한다.
상기 기술적 과제를 달성하기 위하여, 본 발명에 따른 액정 표시 장치는 액정패널과; N비트의 화소 데이터를 N-L비트의 화소 데이터와, L비트의 화소 데이터로 구분하는 타이밍 제어기와; 상기 N-L비트의 화소 데이터를 아날로그 형태의 화소 전압 신호로 변환하여 상기 액정 표시 패널에 공급하는 아날로그 데이터 구동부와; 상기 L 비트의 화소 데이터를 이용하여 상기 화소 전압 신호의 충전시간을 제어하는 충전 제어 신호를 생성하는 디지털 데이터 구동부를 구비하는 것을 특징으로 한다.
여기서, 상기 액정 표시 장치는 8비트 화소 데이터를 입력받아 하위 6비트를 상기 아날로그 데이터 구동부로 공급하고, 상위 2비트를 상기 디지탈 데이터 구동부로 공급하여 256 계조를 표현하는 것을 특징으로 한다.
상기 액정 표시 패널의 제1 실시 예는 상기 아날로그 화소 전압 신호가 공급되는 제j 및 제j+1 데이터라인과; 상기 제j 및 제j+1 데이터라인 사이에 위치하는 방전용 데이터라인과; 상기 제j 및 제j+1 데이터라인과 방전용 데이터라인과 교차하는 제i 및 제i+1 게이트라인과; 상기 제i 및 제i+1 게이트라인과 나란한 제i 및 제i+1 방전용 게이트라인과; 상기 제i 게이트라인과 상기 제j 데이터라인 사이와, 상기 제i+1 게이트라인과 상기 제j+1 데이터라인 사이에 접속된 충전용 박막트랜지스터와; 상기 제i 및 제i+1 방전용 게이트라인 각각과 상기 방전용 데이터라인 사이에 접속된 방전용 박막트랜지스터와; 상기 충전용 박막트랜지스터 및 방전용 박막트랜지스터와 접속된 화소전극을 포함하는 것을 특징으로 한다.
상기 액정 표시 패널의 제2 실시 예는 상기 아날로그 화소 전압 신호가 공급되는 제j 및 제j+1 데이터라인과; 상기 제j 및 제j+1 데이터라인 사이에 위치하는 방전용 데이터라인과; 상기 제j 및 제j+1 데이터라인과 방전용 데이터라인과 교차하는 제i 및 제i+1 게이트라인과; 상기 제i 게이트라인과 상기 제j 데이터라인 사이와, 상기 제i+1 게이트라인과 상기 제j+1 데이터라인 사이에 접속된 충전용 박막트랜지스터와; 상기 제i 및 제i+1 게이트라인 각각과 상기 방전용 데이터라인 사이에 접속되며 상기 충전용 박막트랜지스터와 문턱전압이 다른 방전용 박막트랜지스터와; 상기 충전용 박막트랜지스터 및 방전용 박막트랜지스터와 접속된 화소전극을 포함하는 것을 특징으로 한다.
이하, 첨부된 도면을 참조하여 본 발명의 바람직한 실시예를 자세히 설명하기로 한다.
먼저, 본 발명은 액정패널의 구동에 일부 디지탈 개념을 도입하여 6비트 데이터 구동IC를 이용하여 8비트의 데이터를 처리하거나 8비트 데이터 구동 IC를 이용하여 10비트 데이터를 처리할 수 있는데, 본 발명의 바람직한 실시예에서는 6비트 데이터 구동 IC로 8비트 데이터를 처리하는 예를 보여준다.
도 1은 본 발명에 따른 박막 트랜지스터 액정표시장치를 도시한 구성 블럭도이다.
본 발명에 따른 액정표시장치는 도 1에 도시된 바와 같이, 입력 커넥터(110)와, 타이밍 제어기(120), DC-DC 컨버터(130), 게이트구동부(140), 데이터 구동부(150), TFT-LCD 패널(160)로 구성되고, 본 발명에 따른 데이터 구동부(150)는 아날로그 데이터 구동부(152)와 디지털 데이터 구동부(154)로 이루어진다.
입력 커넥터(110)는 미도시된 영상 처리장치로부터 RGB 데이터, 클럭(CLK), 수직동기신호(Vsync), 수평동기신호(Hsync), Vcc 전원 등을 입력받아 RGB 데이터, 클럭(CLK), 수직동기신호(Vsync), 수평동기신호(Hsync) 등은 타이밍 제어기(120)로 전달하고, Vcc 전원은 DC-DC 컨버터(130)로 전달한다. 이때 입력 커넥터(110)를 통해 외부장치와 전송된 신호는 LVDS(Low Voltage Differential Signal) 방식이나 TMDS(Transition Minimized Differential Signal) 방식, 혹은 RSDS(Reduced Swing Differential Signal) 방식이 사용될 수 있다.
DC-DC 컨버터(130)는 Vcc전원을 입력받아 타이밍 제어기(120)나 각 구동회로를 동작시키기 위한 전원을 공급함과 아울러 게이트 구동을 위한 게이트 온 전압(VON)과 게이트 오프 전압(VOFF), 공통전극 전압(VCOM)을 게이트 구동부(140)로 제공하고, 계조표현을 위한 아날로그 Vdd 전압(AVDD)을 아날로그 데이터 구동부(152)로 제공한다.
타이밍 제어기(120)는 입력 커넥터(110)를 거쳐 입력된 RGB 각 8비트의 데이 터를 처리하여 아날로그 데이터 구동부(152)로 RGB 각 6비트의 데이터를 제공하고, 디지털 데이터 구동부(154)로 RGB 각 2비트의 데이터를 제공한다. 이 때, 디지털 데이터 구동부(154)로 제공되는 2비트의 데이터는 8비트의 데이터 중 최상위 비트 데이터(MSB) 또는 최하위 비트 데이터(LSB)를 이용한다.
또한 입력 커넥터(110)를 거쳐 입력된 클럭(CLK)신호와, 수직동기신호(Vsync), 수평동기신호(Hsync) 등을 이용하여 타이밍 제어기(120)는 게이트제어신호(G-CONT)와 제1 데이터제어신호(D-CONT1), 제2 데이터 제어신호(D-CONT2)를 생성한 다. 게이트제어신호(G-CONT)는 게이트구동부(140)로 제공되고, 데이터제어신호(D-CONT1, D-CONT2)는 아날로그 데이터 구동부(152)와 디지탈 데이터 구동부(154)로 각각 제공된다.
여기서, 게이트제어신호(G-CONT)는 게이트 온 전압의 출력 시작을 지시하는 수직동기시작신호(STV)와, 게이트 온 전압의 출력시기를 제어하는 게이트 클럭신호(CPV), 및 게이트 온 전압의 지속시간을 한정하는 출력 인에이블신호(OE)를 포함한다. 데이터제어신호(D-CONT1, D-CONT2)는 영상 데이터의 전송시작을 알리는 수평동기시작신호(STH), 데이터 라인에 해당 데이터 전압을 인가하라는 로드신호(TP), 공통전압(Vcom)에 대한 데이터 전압의 극성을 반전시키기 위한 반전신호(RVS), 및 데이터 클럭신호(HCLK) 등을 포함한다.
게이트구동부(140)는 타이밍 제어기(120)로부터 제공된 게이트제어신호(G-CONT)에 따라 게이트 온 전압(VON)을 게이트 라인에 순차적으로 인가하여 게이트 라 인에 연결된 박막트랜지스터를 턴온시키고, 이에 따라 데이터 라인에 인가된 화소 전압신호는 턴온된 스위칭소자를 통해 해당 액정셀에 인가된다.
아날로그 데이터 구동부(152)는 타이밍 제어기(120)로부터 제공된 데이터제어신호(D-CONT1)에 따라 한 행의 화소에 대한 화소 데이터중 하위 6비트의 화소 데이터를 차례로 수신하여 각 화소 데이터에 대응하는 아날로그 화소 전압 신호를 생성한 후 해당 데이터 라인에 인가한다.
디지털 데이터 구동부(154)는 타이밍 제어기(120)로부터 제공된 데이터제어신호(D-CONT2)에 따라 한 행의 화소에 대한 화소 데이터중 상위 2비트의 화소 데이터를 차례로 수신하여 각 화소 데이터에 대응하는 디지탈 충전 제어신호를 제공한다.
액정 패널(160)은 도 2 또는 도 3에 도시된 구조로 형성된다.
도 2에 도시된 액정패널(160)은 게이트 라인들(GL)과, 그 게이트라인들(GL)과 절연되면서 교차하는 데이터 라인들(DL)과, 게이트 라인(GL)과 나란한 방전용 게이트라인들(DGL)과, 데이터 라인들(DL) 사이에 위치하는 방전용 데이터라인들(DDL)과, 게이트 라인(GL) 및 데이터 라인(DL)의 교차부에 위치하는 충전용 박막트랜지스터(CTFT)와, 방전용 게이트라인(DGL) 및 방전용 데이터라인(DDL)의 교차부에 위치하는 방전용 박막트랜지스터(DTFT)와, 충전용 박막트랜지스터(CTFT) 및 방전용 박막트랜지스터(DTFT)와 접속된 액정셀들을 구비한다.
액정셀들 각각은 충전용 및 방전용박막트랜지스터(CTFT,DTFT)와 접속된 화소전극(PXL)과, 화소 전극(PXL)과 액정을 사이에 두고 중첩되는 공통 전극을 구비한 다.
충전용 박막트랜지스터(CTFT)는 해당 게이트라인(GL)으로부터의 스캔신호, 즉 게이트신호에 응답하여 해당 데이터라인(DL)으로부터의 화소전압신호를 화소전극(PXL)에 공급한다. 이 때, 수평방향으로 인접한 화소 영역에 위치하는 충전용 박막트랜지스터(CTFT)는 하나의 데이터라인(DL)에 공통으로 접속된다. 즉, 제j+1 번째 데이터라인(DLj+1)에는 제i 번째 게이트라인(GLi)과 접속된 충전용 박막트랜지스터(CTFT)가 접속되며, 제i+1 번째 게이트라인(GLj+1)과 접속된 충전용 박막트랜지스터(CTFT)가 접속된다.
방전용 박막트랜지스터(DTFT)는 해당 방전용 게이트라인(GL)으로부터의 디지탈 충전제어신호에 응답하여 화소전극(PXL)에 충전된 화소전압신호를 해당 방전용 데이터라인(DDL)을 통해 방전시킨다. 이 때, 수평방향으로 인접한 화소 영역에 위치하는 방전용 박막트랜지스터(DTFT)는 하나의 방전용 데이터라인(DDL)에 공통으로 접속된다. 즉, 제j 번째 방전용 데이터라인(DLj+1)에는 제i 번째 방전용 게이트라인(DGLi)과 접속된 방전용 박막트랜지스터(DTFT)가 접속되며, 제i+1 번째 방전용 게이트라인(DGLj+1)과 접속된 방전용 박막트랜지스터(DTFT)가 접속된다.
화소전극(PXL)은 충전용 박막트랜지스터(CTFT)를 통해 화소 전압 신호를 충전한 후 다음 수평 라인의 충전용 박막트랜지스터(CTFT)가 턴온되기 전에 선택적으로 턴온되는 방전용 박막트랜지스터(DTFT)를 통해 충전된 화소 전압 신호를 방전한다.
도 3에 도시된 액정패널(160)은 도 2에 도시된 액정 표시 패널과 대비하여 방전용 게이트라인이 제거된 것을 제외하고는 동일한 구성요소를 구비한다. 이에 따라, 동일한 구성요소에 대한 상세한 설명은 생략하기로 한다.
방전용 박막트랜지스터(DTFT)는 해당 게이트라인(GL)으로부터의 스캔신호에 응답하여 화소전극(PXL)에 충전된 화소전압신호를 해당 방전용 데이터라인(DDL)을 통해 방전시킨다. 수평방향으로 인접한 화소 영역에 위치하는 방전용 박막트랜지스터(DTFT)는 하나의 방전용 데이터라인(DDL)에 공통으로 접속된다. 즉, 제j 번째 방전용 데이터라인(DLj+1)에는 제i 번째 게이트라인(GLi)과 접속된 방전용 박막트랜지스터(DTFT)가 접속되며, 제i+1 번째 게이트라인(DGLj+1)과 접속된 방전용 박막트랜지스터(DTFT)가 접속된다. 이 때, 방전용 박막트랜지스터(CTFT)의 문턱전압(Vth1)은 도 4에 도시된 바와 같이 충전용 박막트랜지스터의 문턱전압(Vth2)에 비해 낮다. 이에 따라, 이전 게이트라인, 예를 들어 제i 번째 게이트라인(GLi)에 접속된 충전용 박막트랜지스터(CTFT)를 통해 충전된 화소 전압 신호는 현 게이트라인, 예를 들어 제i+1 번째 게이트라인(GLi+1)에 접속된 방전용 박막트랜지스터(DTFT)를 통해 선택적으로 충전된 화소 전압 신호를 방전한다. 이 때, 방전용 박막 트랜지스터(DFTFT)와 동일 게이트라인(GLi+1)에 접속된 충전용 박막 트랜지스터(CTFT)는 방전용 박막트랜지스터(DTFT)에 비해 문턱전압이 높기 때문에 턴오프상태를 유지하게 된다. 그리고, 게이트라인(GL)에는 방전용 박막 트랜지스터(DTFT)를 턴온 시키기 위한 충전 제어 신호가 공급되며, 충전용 박막 트랜지스터(CTFT)를 턴온 시키기 위해 충전 제어 신호보다 전압 레벨이 높은 게이트 신호가 공급된다.
이어서, 상기와 같이 구성되는 본 발명의 실시예의 동작을 설명하면 다음과 같다.
입력 커넥터(110)를 통해 현 프레임의 화소 데이터가 입력되면, 게이트 구동부(140)는 타이밍 제어기(120)로부터 입력된 게이트 수직동기시작신호(STV)에 의해 프레임의 시작을 감지하여 게이트 클럭신호(CPV)에 따라 DC-DC 컨버터(130)가 제공한 게이트 온전압(VON)을 출력 인에이블신호(OE)동안 첫번째 게이트 라인부터 마지막 게이트 라인까지 순차적으로 인가한다.
아날로그 데이터 구동부(152)는 타이밍 제어기(120)로부터 제공된 제어신호에 따라 타이밍 제어기(120)로부터 전달된 화소 데이터의 하위 6비트로 해당 화소 전압신호를 생성하여 데이터 라인에 인가한다. 이러한 아날로그 데이터 구동부(152)의 동작은 종래의 구동 동작과 유사하다.
디지털 데이터 구동부(154)는 타이밍 제어기(120)로부터 제공된 제어신호와 화소 데이터의 상위 2비트에 따라 1 프레임 동안 픽셀에 충전되는 전압을 디지탈로 시분할한 후 도 5에 도시된 바와 같이, 충전시간을 제어하는 충전 제어 신호를 제공한다.
도 5를 참조하면, (A)는 프레임의 시작을 알리는 Start Vertical Signal을 도시한 파형이고, (B) 내지 (E)는 상위 2비트에 따라 한 프레임의 기간을 4개로 시분할한 디지탈 충전제어신호의 파형이다.
도 2의 (B) 내지 (E)에 도시된 파형에 따르면, 상위 2비트가 "00"일 경우에는 한 프레임을 4개 구간으로 균등하게 시분할한 시간중에서 1개 구간(즉, 1/4 프 레임 기간)동안 충전용 박막트랜지스터(CTFT)를 통해 화소 전압 신호를 충전시킨 후 3개 구간 동안 충전 제어 신호에 응답하여 턴온되는 방전용 박막트랜지스터(DTFT)를 통해 충전된 화소 전압 신호를 방전시킨다.
상위 2비트가 "01"일 경우에는 한 프레임을 4개 구간으로 균등하게 시분할한 시간중에서 2개 구간(즉, 1/2 프레임 기간)동안 충전용 박막트랜지스터(CTFT)를 통해 화소 전압 신호를 충전시킨 후 2개 구간 동안 충전 제어 신호에 응답하여 턴온되는 방전용 박막트랜지스터(DTFT)를 통해 충전된 화소 전압 신호를 방전시킨다.
상위 2비트가 "10"일 경우에는 한 프레임을 4개 구간으로 균등하게 시분할한 시간중에서 3개 구간(즉, 3/4 프레임 기간)동안 충전용 박막트랜지스터(CTFT)를 통해 화소 전압 신호를 충전시킨 후 1개 구간 동안 충전 제어 신호에 응답하여 턴온되는 방전용 박막트랜지스터(DTFT)를 통해 충전된 화소 전압 신호를 방전시킨다.
상위 2비트가 "11"일 경우에는 한 프레임을 4개 구간으로 균등하게 시분할한 시간중에서 4개 구간(즉, 전 프레임 기간)동안 충전용 박막트랜지스터(CTFT)를 통해 화소 전압 신호를 충전시킨다.
이와 같이 8비트 입력 데이터 중에서 상위 2비트를 이용하여 1 프레임 동안 픽셀에 충전되는 전압을 디지탈로 시분할한 후, 나머지 각 6비트를 이용하여 64 계조를 각각 표현함으로써 전체적으로 256 그레이를 표현할 수 있다. 즉, 6비트에서 64 그레이를 표현하는 정극성/부극성 전압을, 1 프레임에서 상위 2비트를 이용하여 4개로 시분할을 한다. 상위 비트가 "00"일 경우에는 1 프레임의 1/4만 픽셀에 충전하고, "01"일 때 2/4, "10"일 경우 3/4, "11"일 경우 전 프레임 동안 충전되게 하 여 풀 256 그레이를 표현할 수 있다.
이상에서 몇 가지 실시예를 들어 본 발명을 상세하게 설명하였으나, 본 발명은 반드시 이러한 실시예로 국한되는 것이 아니고, 본 발명의 기술사상을 벗어나지 않는 범위 내에서 다양하게 변형 실시될 수 있다.
이상에서 설명한 바와 같이, 본 발명에 따르면 8비트 영상 데이터를 입력받아서 상위 2비트를 이용하여 생성된 충전 제어 신호로 1 프레임의 충전시간을 조절하고, 나머지 6비트로 종래와 같이 아날로그 계조전압을 표현하여 실제적으로 256 계조를 표현할 수 있다.
따라서 본 발명은 가격이 저렴한 저비트의 데이터 구동IC를 이용하여 고비트의 데이터 구동IC와 동일하게 고계조를 구현할 수 있으므로 고화질을 저비용으로 달성할 수 있다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여 져야만 할 것이다.

Claims (6)

  1. N(N은 자연수)비트의 화소 데이터를 입력받아 상기 N비트의 화소 데이터를 N-L(L은 N보다 작은 자연수)비트의 화소 데이터와, L비트의 화소 데이터로 구분하는 단계와;
    상기 N-L비트의 화소 데이터를 아날로그 형태의 화소 전압 신호로 변환하는 단계와;
    상기 L비트의 화소 데이터를 이용하여 상기 화소 전압 신호의 충전시간을 제어하는 충전 제어 신호를 생성하는 단계와;
    상기 충전 제어 신호에 응답하여 상기 화소 전압 신호를 해당 화소에 충전하여 N비트의 계조를 표현하는 단계를 포함하는 것을 특징으로 하는 액정 표시 장치의 구동 방법.
  2. 제 1 항에 있어서,
    상기 N비트의 화소 데이터는 8비트의 화소 데이터이며, 상기 L비트의 화소 데이터는 6비트의 화소 데이터인 것을 특징으로 하는 액정 표시 장치의 구동 방법.
  3. 액정패널과;
    N비트의 화소 데이터를 N-L비트의 화소 데이터와, L비트의 화소 데이터로 구분하는 타이밍 제어기와;
    상기 N-L비트의 화소 데이터를 아날로그 형태의 화소 전압 신호로 변환하여 상기 액정 표시 패널에 공급하는 아날로그 데이터 구동부와;
    상기 L 비트의 화소 데이터를 이용하여 상기 화소 전압 신호의 충전시간을 제어하는 충전 제어 신호를 생성하는 디지털 데이터 구동부를 구비하는 것을 특징으로 하는 액정 표시 장치.
  4. 제 3 항에 있어서,
    상기 액정 표시 장치는
    8비트 화소 데이터를 입력받아 하위 6비트를 상기 아날로그 데이터 구동부로 공급하고, 상위 2비트를 상기 디지탈 데이터 구동부로 공급하여 256 계조를 표현하는 것을 특징으로 하는 액정 표시 장치.
  5. 제 3 항에 있어서,
    상기 액정 표시 패널은
    상기 아날로그 화소 전압 신호가 공급되는 제j 및 제j+1 데이터라인과;
    상기 제j 및 제j+1 데이터라인 사이에 위치하는 방전용 데이터라인과;
    상기 제j 및 제j+1 데이터라인과 방전용 데이터라인과 교차하는 제i 및 제i+1 게이트라인과;
    상기 제i 및 제i+1 게이트라인과 나란한 제i 및 제i+1 방전용 게이트라인과;
    상기 제i 게이트라인과 상기 제j 데이터라인 사이와, 상기 제i+1 게이트라인 과 상기 제j+1 데이터라인 사이에 접속된 충전용 박막트랜지스터와;
    상기 제i 및 제i+1 방전용 게이트라인 각각과 상기 방전용 데이터라인 사이에 접속된 방전용 박막트랜지스터와;
    상기 충전용 박막트랜지스터 및 방전용 박막트랜지스터와 접속된 화소전극을 포함하는 것을 특징으로 하는 액정 표시 장치.
  6. 제 3 항에 있어서,
    상기 액정 표시 패널은
    상기 아날로그 화소 전압 신호가 공급되는 제j 및 제j+1 데이터라인과;
    상기 제j 및 제j+1 데이터라인 사이에 위치하는 방전용 데이터라인과;
    상기 제j 및 제j+1 데이터라인과 방전용 데이터라인과 교차하는 제i 및 제i+1 게이트라인과;
    상기 제i 게이트라인과 상기 제j 데이터라인 사이와, 상기 제i+1 게이트라인과 상기 제j+1 데이터라인 사이에 접속된 충전용 박막트랜지스터와;
    상기 제i 및 제i+1 게이트라인 각각과 상기 방전용 데이터라인 사이에 접속되며 상기 충전용 박막트랜지스터와 문턱전압이 다른 방전용 박막트랜지스터와;
    상기 충전용 박막트랜지스터 및 방전용 박막트랜지스터와 접속된 화소전극을 포함하는 것을 특징으로 하는 액정 표시 장치.
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