KR20040095177A - Signal difference detector apparatus and optical disk apparatus using the same - Google Patents
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Abstract
Description
본 발명은 2개의 입력 신호 사이의 차에 따른 신호차를 검출하는 신호차 검출 장치 및 그 신호차 검출 장치를 서보(servo) 시스템에 이용하는 광디스크 장치에 관한 것이다.The present invention relates to a signal difference detecting device for detecting a signal difference according to a difference between two input signals, and an optical disk device using the signal difference detecting device in a servo system.
광디스크 장치(이하, 광자기 디스크 장치를 포함)에서는 광디스크의 트랙 추종 동작을 위한 트랙 서보 제어와, 광디스크의 초점 위치 결정을 위한 포커스 서보 제어가 필요하다. 이러한 서보 제어를 위해, 광디스크의 반사광을 2분할 또는 4분할 포토디텍터(photodetector)로 검출하여 트랙 서보 에러 신호, 포커스 서보 에러 신호를 얻는다. 획득한 트랙 서보 에러 신호나 포커스 서보 에러 신호를 사용하여 서보 동작을 실행하고 있다.In the optical disk device (hereinafter, including the magneto-optical disk device), track servo control for track following operation of the optical disk and focus servo control for focus position determination of the optical disk are required. For such servo control, the reflected light of the optical disc is detected by a two- or four-segment photodetector to obtain a track servo error signal and a focus servo error signal. The servo operation is performed using the acquired track servo error signal or focus servo error signal.
광디스크는 안내홈 사이에 트랙이 배치되어 있고, 광학 헤드의 광빔의 조사에 의한 광디스크로부터의 반사광에 의하여 트랙 위치 오차와 포커스 위치 오차가 얻어진다. 광학 헤드로부터의 트랙 서보 에러(트래킹(tracking) 오차) 신호에 의하여 광빔의 트랙 위치 오차를 얻고, 광빔이 트랙를 조사하도록 광학 헤드를 제어한다. 동일하게, 광학 헤드로부터의 포커스 서보 에러(초점 위치 오차) 신호에 의하여 광빔의 초점 위치 오차를 구하고, 광빔의 초점이 트랙 위치로 되도록 광학 헤드를 제어한다.In the optical disc, tracks are arranged between guide grooves, and track position errors and focus position errors are obtained by the reflected light from the optical disc by irradiation of the light beams of the optical head. The track position error of the light beam is obtained by a track servo error (tracking error) signal from the optical head, and the optical head is controlled so that the light beam irradiates the track. Similarly, the focus position error of the light beam is obtained by the focus servo error (focus position error) signal from the optical head, and the optical head is controlled so that the focus of the light beam is at the track position.
트래킹용의 2분할 광검지기, 포커스용의 2분할 광검지기는 각각 2개의 수광 소자(이하, 포토 다이오드)에 2분할되어 있다. 서보 에러 작성 회로를 통해 이 2개의 포토 다이오드의 출력에 근거하여 서보 에러 신호를 얻는다.The two split photodetector for tracking and the two split photodetector for focus are divided into two light receiving elements (hereinafter referred to as photodiodes). Through the servo error generating circuit, a servo error signal is obtained based on the outputs of these two photodiodes.
광디스크의 기록, 삭제, 판독 시에 있어서 광 파워가 달라지거나, 또 광디스크의 매체 반사율이 서로 달라짐에 따라, 포토 다이오드에 흐르는 광전류의 크기가 변화한다. 이로 인해 이 서보 에러 신호 작성 회로에서는 자동 이득 제어(AGC)가 필요하게 된다.As the optical power changes during recording, erasing, and reading of the optical disc, or the media reflectance of the optical disc is different from each other, the magnitude of the optical current flowing through the photodiode changes. This requires automatic gain control (AGC) in this servo error signal generation circuit.
이 AGC를 행하는 데에는 포토 다이오드 전류의 화(和)신호로 포토 다이오드 전류의 신호차를 나눗셈함으로써, 신호차의 진폭을 일정하게 할 수 있다. 도 4는 종래의 서보 에러 신호 등의 신호차 작성 회로의 구성을 나타내는 도면이다(특허 문헌 1을 참조).In performing AGC, the amplitude of the signal difference can be made constant by dividing the signal difference of the photodiode current by the equalization signal of the photodiode current. 4 is a diagram illustrating a configuration of a signal difference generating circuit such as a conventional servo error signal (see Patent Document 1).
도 4에 있어서, PD1, PD2는 트래킹용(또는 포커스용)의 2분할 광검지기의 수광 소자인 포토 다이오드이며 광검지기로서 기능한다. 100은 포토 다이오드 PD1, 포토 다이오드 PD2가 흐르는 전류에 근거하여 신호차를 생성하는 신호차 작성 회로이다.In Fig. 4, PD1 and PD2 are photodiodes which are light-receiving elements of a two-segment photodetector for tracking (or focus), and function as photodetectors. 100 is a signal difference generating circuit that generates a signal difference based on the currents flowing through the photodiode PD1 and photodiode PD2.
신호차 작성 회로(100)에서는 컬렉터와 베이스가 직접 접속된 NPN형 바이폴라 트랜지스터(이하, NPN 트랜지스터) Q1과 포토 다이오드 PD1이 전원 전압 Vcc와 정전압 Vb 점과의 사이에 직렬로 접속된다. 또, 컬렉터와 베이스가 직접 접속된 NPN 트랜지스터 Q4와 포토 다이오드 PD2가 전원 전압 Vcc와 정전압 Vb 점과의 사이에 직렬로 접속된다. 여기서, 정전압 Vb는 전압원 E에 의하여 형성되지만, 이 정전압 Vb는 후술하는 정전류원 I1을 동작시키기 위해 필요한 바이어스 전압이다. 또한, 각 전압은 특별히 이의가 없다면 그라운드 전위를 기준으로 하는 전위를 의미한다.In the signal difference generating circuit 100, an NPN type bipolar transistor (hereinafter referred to as an NPN transistor) Q1 and a photodiode PD1 to which a collector and a base are directly connected are connected in series between a power supply voltage Vcc and a constant voltage Vb point. In addition, the NPN transistor Q4 and the photodiode PD2 to which the collector and the base are directly connected are connected in series between the power supply voltage Vcc and the constant voltage Vb point. Here, the constant voltage Vb is formed by the voltage source E, but this constant voltage Vb is a bias voltage necessary for operating the constant current source I1 described later. In addition, each voltage means a potential with reference to a ground potential unless there is particular objection.
이 포토 다이오드 PD1과 NPN 트랜지스터 Q1과의 직렬 회로에 제1 전류 Iq1이 흐른다. 또, 포토 다이오드 PD2와 NPN 트랜지스터 Q4와의 직렬 회로에 제2 전류 Iq4가 흐른다.The first current Iq1 flows through the series circuit between the photodiode PD1 and the NPN transistor Q1. In addition, the second current Iq4 flows through the series circuit between the photodiode PD2 and the NPN transistor Q4.
신호차 작성 회로(100)에는 또 전류 차동 회로(110)가 설치된다. 전류 차동 회로(110)에서는 저항 R2와 NPN 트랜지스터 Q2가 직렬로 접속되고, 저항 R3과 NPN 트랜지스터 Q3이 직렬로 접속된다. 그 NPN 트랜지스터 Q2의 이미터와 NPN 트랜지스터 Q3의 이미터가 공통으로 접속되고, 정전류원 I1에 접속된다. 이들이 전원 전압 Vcc와 그라운드 사이에 접속된다. 저항 R2와 저항 R3은 같은 저항치(=R)이고, 정전류원 I1의 전류치는 Iref이다.The signal difference producing circuit 100 is further provided with a current differential circuit 110. In the current differential circuit 110, the resistor R2 and the NPN transistor Q2 are connected in series, and the resistor R3 and the NPN transistor Q3 are connected in series. The emitter of the NPN transistor Q2 and the emitter of the NPN transistor Q3 are connected in common and are connected to the constant current source I1. These are connected between the power supply voltage Vcc and ground. The resistor R2 and the resistor R3 have the same resistance value (= R), and the current value of the constant current source I1 is Iref.
NPN 트랜지스터 Q2의 베이스는 NPN 트랜지스터 Q1의 베이스에 접속되고, 또 NPN 트랜지스터 Q3의 베이스는 NPN 트랜지스터 Q4의 베이스에 접속된다. 이로 인해 NPN 트랜지스터 Q1과 NPN 트랜지스터 Q2로 커런트 미러 구성이 되고, NPN 트랜지스터 Q4와 NPN 트랜지스터 Q3으로 커런트 미러 구성이 된다. 저항 R2와 NPN 트랜지스터 Q2와의 접속점과 저항 R3과 NPN 트랜지스터 Q3과의 접속점과의 사이의 전압이 신호차 Vout로서 출력된다.The base of the NPN transistor Q2 is connected to the base of the NPN transistor Q1, and the base of the NPN transistor Q3 is connected to the base of the NPN transistor Q4. This results in a current mirror configuration of the NPN transistor Q1 and the NPN transistor Q2, and a current mirror configuration of the NPN transistor Q4 and the NPN transistor Q3. The voltage between the connection point of the resistor R2 and the NPN transistor Q2 and the connection point of the resistor R3 and the NPN transistor Q3 is output as the signal difference Vout.
이 도 4의 종래의 신호차 작성 회로(100)에 있어서, 신호차 Vout은In the conventional signal difference producing circuit 100 of FIG. 4, the signal difference Vout is
Vout=R×Iref×(Iq1-Iq4)/(Iq1+Iq4)···(1)Vout = R × Iref × (Iq1-Iq4) / (Iq1 + Iq4) ... (1)
로 표시되어 있다. 또한, 식 1의 도출에 대해서는 특허 문헌 1의 단락 번호 「0082」∼「0095」에 기재되어 있다. 따라서 포토 다이오드 전류의 화신호로 포토 다이오드 전류의 신호차를 나눗셈한 신호차 Vout를 얻고, 신호차의 진폭을 일정하게 하여 AGC를 행하도록 하고 있다.Is indicated. Moreover, about derivation of Formula 1, it describes in Paragraph No. "0082"-"0095" of patent document 1. As shown in FIG. Therefore, the signal difference Vout obtained by dividing the signal difference of the photodiode current by the photodiode current signal is obtained, and the amplitude of the signal difference is made constant to perform AGC.
[특허 문헌 1][Patent Document 1]
특개평 6-36303호 공보Publication No. 6-36303
그러나, 도 4의 종래의 특허 문헌 1에서는 각 NPN 트랜지스터 Q1∼Q4의 베이스 전류 Ibq1∼Ibq4가 상기 컬렉터 전류 Icq1∼Icq4에 비해 작아서 무시하고 있다. 즉, 도 4의 신호차 Vout의 식 1은 베이스 전류 Ibq1∼Ibq4를 무시함으로써 성립되고 있다.However, in the conventional patent document 1 of FIG. 4, the base currents Ibq1 to Ibq4 of the NPN transistors Q1 to Q4 are smaller than those of the collector currents Icq1 to Icq4. That is, equation 1 of the signal difference Vout in FIG. 4 is established by ignoring the base currents Ibq1 to Ibq4.
실제로, 각 NPN 트랜지스터 Q1∼Q4에는 각각 베이스 전류 Ibq1∼Ibq4가 존재한다. 이 베이스 전류 Ibq1∼Ibq4를 고려하면, NPN 트랜지스터 Q1의 컬렉터 전류 Icq1은 Icq1=Iq1-Ibq1-Ibq2이고, NPN 트랜지스터 Q4의 컬렉터 전류 Icq4는 Icq4=Iq4-Ibq4-Ibq3이다.In fact, each of the NPN transistors Q1 to Q4 has a base current Ibq1 to Ibq4. Considering these base currents Ibq1 to Ibq4, the collector current Icq1 of the NPN transistor Q1 is Icq1 = Iq1-Ibq1-Ibq2, and the collector current Icq4 of the NPN transistor Q4 is Icq4 = Iq4-Ibq4-Ibq3.
이 베이스 전류 Ibq1∼Ibq4를 고려하여 신호차 Vout을 연산하면,If the signal difference Vout is calculated in consideration of the base currents Ibq1 to Ibq4,
Vout=R×Iref×{(Iq1-Ibq1-Ibq2)-(Iq4-Ibq4-Ibq3)}/{(Iq1-Ibq1-Ibq2)+(Iq4-Ibq4-Ibq3)}· · ·(2)Vout = R × Iref × {(Iq1-Ibq1-Ibq2)-(Iq4-Ibq4-Ibq3)} / {(Iq1-Ibq1-Ibq2) + (Iq4-Ibq4-Ibq3)} (2)
로 된다.It becomes
제1 전류 Iq1과 제2 전류 Iq4의 직류 성분은 대략 같으므로 Ibq1≒Ibq4, Ibq2≒Ibq3 으로 해도 무방하기 때문에, 알기쉽게 하기 위해 식 2를 간략하게 표현하면,Since the direct current components of the first current Iq1 and the second current Iq4 are approximately the same, Ibq1 ≒ Ibq4 and Ibq2 ≒ Ibq3 may be used.
Vout=R×Iref×(Iq1-Iq4)/{(Iq1+Iq4)-2(Ibq1+Ibq2)} · · ·(3)Vout = R × Iref × (Iq1-Iq4) / {(Iq1 + Iq4) -2 (Ibq1 + Ibq2)} ... (3)
로 된다.It becomes
이 식 3으로부터 알 수 있는 바와 같이, 각 NPN 트랜지스터 Q1∼Q4의 베이스 전류 Ibq1∼Ibq4 (즉, 식 3의 분모의 「2 (Ibq1+Ibq2)」)가 크다면, 얻고자 하는 서보 에러 신호인 식 1에 대하여 신호차 Vout이 커지게 된다. 따라서 본래 얻고자 하는 신호차에 대하여 오차가 커지는 문제가 있었다.As can be seen from Equation 3, if the base currents Ibq1 to Ibq4 (that is, "2 (Ibq1 + Ibq2)" of the denominator of Equation 3) of each NPN transistor Q1 to Q4 are large, the servo error signal to be obtained is With respect to equation 1, the signal difference Vout becomes large. Therefore, there is a problem that the error is large with respect to the original signal difference.
또, 각 트랜지스터 Q1∼Q4의 전류 증폭율(컬렉터 전류와 베이스 전류와의 비)은 컬렉터 전류의 대소, 온도의 고저 등에 의하여 변화한다. 따라서 이와 같은 주위 조건에 의해서도 신호차 Vout의 오차가 발생하고 있었다.The current amplification ratio (ratio between collector current and base current) of each of the transistors Q1 to Q4 changes depending on the magnitude of the collector current, the height of the temperature, and the like. Therefore, an error of the signal difference Vout also occurred due to such ambient conditions.
그래서, 본 발명은 2개의 입력 전류 신호 사이의 신호차를 트랜지스터 차동 증폭 회로를 사용하여 검출하는 신호차 검출 장치에 있어서, 트랜지스터의 베이스 전류에 의한 영향을 제거하고 신호차에 포함되는 오차 성분을 현저하게 경감할 수 있는 신호차 검출 장치를 제공하는 것을 목적으로 한다. 또, 그 신호차 검출 장치를 사용하여 트래킹용이나 포커스용의 서보 에러 신호(즉, 신호차)를 정확하게 얻을 수 있는 광디스크 장치를 제공하는 것을 목적으로 한다.Thus, the present invention provides a signal difference detecting device for detecting a signal difference between two input current signals using a transistor differential amplifier circuit, wherein the influence of the transistor's base current is eliminated and the error component included in the signal difference is remarkable. It is an object of the present invention to provide a signal difference detection device that can be reduced. It is also an object of the present invention to provide an optical disk apparatus capable of accurately obtaining a servo error signal (that is, a signal difference) for tracking or focusing using the signal difference detecting device.
청구항 1의 신호차 검출 장치는 제1 전류가 공급되는 제1 바이폴라 트랜지스터를 포함하는 제1 입력 회로와, 상기 제1 바이폴라 트랜지스터의 컬렉터에 입력단이 접속되고, 그 베이스에 출력단이 접속되고, 높은 입력 임피던스와 낮은 출력 임피던스를 가지고, 상기 입력단 전압과 상기 출력단 전압을 소정의 관계로 하는 제1 베이스 전류 공급 회로와, 제2 전류가 공급되는 제2 바이폴라 트랜지스터를 포함하는 제2 입력 회로와, 상기 제2 바이폴라 트랜지스터의 컬렉터에 입력단이 접속되고, 그 베이스에 출력단이 접속되고, 높은 입력 임피던스와 낮은 출력 임피던스를 가지고, 상기 입력단 전압과 상기 출력단 전압을 소정의 관계로 하는 제2 베이스 전류 공급 회로와, 제1 부하와 제3 바이폴라 트랜지스터가 직렬로 접속되고, 제2 부하와 제4 바이폴라 트랜지스터가 직렬로 접속되고, 상기 제3 바이폴라 트랜지스터의 베이스가 상기 제1 바이폴라 트랜지스터의 베이스에 접속되고, 상기 제4 바이폴라 트랜지스터의 베이스가 상기 제2 바이폴라 트랜지스터의 베이스에 접속되고, 또한, 상기 제3 바이폴라 트랜지스터의 이미터와 상기 제4 바이폴라 트랜지스터의 이미터를 공통의 정전류원에 접속하는 차동 증폭 회로를 갖고, 상기 차동 증폭 회로로부터 신호차를 취출하는 것을 특징으로 한다.The signal difference detecting device according to claim 1 includes a first input circuit including a first bipolar transistor supplied with a first current, an input terminal connected to a collector of the first bipolar transistor, an output terminal connected to a base thereof, and a high input. A second input circuit having a impedance and a low output impedance, the first base current supply circuit having a predetermined relationship between the input terminal voltage and the output terminal voltage, a second bipolar transistor to which a second current is supplied, and the second input circuit; A second base current supply circuit having an input terminal connected to a collector of the two bipolar transistors, an output terminal connected to a base thereof, having a high input impedance and a low output impedance, and having a predetermined relationship between the input terminal voltage and the output terminal voltage; The first load and the third bipolar transistor are connected in series, the second load and the fourth bipolar transistor The master is connected in series, the base of the third bipolar transistor is connected to the base of the first bipolar transistor, the base of the fourth bipolar transistor is connected to the base of the second bipolar transistor, and the third And a differential amplifier circuit for connecting the emitter of the bipolar transistor and the emitter of the fourth bipolar transistor to a common constant current source, wherein a signal difference is taken out from the differential amplifier circuit.
청구항 2의 신호차 검출 장치는 청구항 1에 기재된 신호차 검출 장치에 있어서, 상기 제1 베이스 전류 공급 회로(120) 및 상기 제2 베이스 전류 공급 회로(130)는 연산 증폭기를 구비하는 것을 특징으로 한다.The signal difference detection device of claim 2 is the signal difference detection device according to claim 1, wherein the first base current supply circuit 120 and the second base current supply circuit 130 are provided with an operational amplifier. .
청구항 3의 신호차 검출 장치는 청구항 2에 기재된 신호차 검출 장치에 있어서, 상기 제1 베이스 전류 공급 회로(120) 및 상기 제2 베이스 전류 공급 회로(130)는 전압 팔로워인 것을 특징으로 한다.The signal difference detection device of claim 3 is the signal difference detection device according to claim 2, wherein the first base current supply circuit 120 and the second base current supply circuit 130 are voltage followers.
청구항 4의 신호차 검출 장치는 청구항 1에 기재된 신호차 검출 장치에 있어서, 상기 제1 베이스 전류 공급 회로(120) 및 상기 제2 베이스 전류 공급회로(130)는 입력단의 전압에 의하여 제어되는 트랜지스터인 것을 특징으로 한다.The signal difference detection device of claim 4 is the signal difference detection device according to claim 1, wherein the first base current supply circuit 120 and the second base current supply circuit 130 are transistors controlled by a voltage at an input terminal. It is characterized by.
청구항5의 신호차 검출 장치는 청구항 1 내지 4 중 어느 한 항에 기재된 신호차 검출 장치에 있어서, 상기 제1 바이폴라 트랜지스터의 이미터 및 상기 제2 바이폴라 트랜지스터의 이미터를 공통의 전압원에 접속하는 것을 특징으로 한다.The signal difference detecting device according to claim 5 is the signal difference detecting device according to any one of claims 1 to 4, wherein the emitter of the first bipolar transistor and the emitter of the second bipolar transistor are connected to a common voltage source. It features.
청구항 6의 광디스크 장치는 서보 제어를 위한 각각의 수광량에 따른 전류를 출력하는 제1 수광 소자 및 제2 수광 소자와, 상기 제1 수광 소자로부터의 제1 전류가 공급되는 제1 바이폴라 트랜지스터를 포함하는 제1 입력 회로, 상기 제1 바이폴라 트랜지스터의 컬렉터에 입력단이 접속되고, 그 베이스에 출력단이 접속되고, 높은 입력 임피던스와 낮은 출력 임피던스를 갖고 상기 입력단 전압과 상기 출력단 전압을 소정의 관계로 하는 제1 베이스 전류 공급 회로, 상기 제2 수광 소자로부터의 제2 전류가 공급되는 제2 바이폴라 트랜지스터를 포함하는 제2 입력 회로, 상기 제2 바이폴라 트랜지스터의 컬렉터에 입력단이 접속되고, 그 베이스에 출력단이 접속되고, 높은 입력 임피던스와 낮은 출력 임피던스를 갖고 상기 입력단 전압과 상기 출력단 전압을 소정의 관계로 하는 제2 베이스 전류 공급 회로, 제1 부하와 제3 바이폴라 트랜지스터가 직렬로 접속되고, 제2 부하와 제4 바이폴라 트랜지스터가 직렬로 접속되고, 상기 제3 바이폴라 트랜지스터의 베이스가 상기 제1 바이폴라 트랜지스터의 베이스에 접속되고, 상기 제4 바이폴라 트랜지스터의 베이스가 상기 제2 바이폴라 트랜지스터의 베이스에 접속되고, 또한, 상기 제3 바이폴라 트랜지스터의 이미터와 상기 제4 바이폴라 트랜지스터의 이미터를 공통의 정전류원에 접속한 차동 증폭 회로를 가지며, 상기 차동 증폭 회로로부터 신호차를 취출하는 신호차 작성 장치를 갖는 것을 특징으로 한다.The optical disk device of claim 6 includes a first light receiving element and a second light receiving element for outputting a current corresponding to each light receiving amount for servo control, and a first bipolar transistor supplied with a first current from the first light receiving element. A first input circuit, an input terminal is connected to a collector of the first bipolar transistor, an output terminal is connected to a base thereof, and has a high input impedance and a low output impedance and has a predetermined relationship between the input terminal voltage and the output terminal voltage. A second input circuit including a base current supply circuit, a second bipolar transistor supplied with a second current from the second light receiving element, an input terminal connected to a collector of the second bipolar transistor, and an output terminal connected to the base thereof, Has a high input impedance and a low output impedance, and reduces the input terminal voltage and the output terminal voltage. A second base current supply circuit, a first load and a third bipolar transistor connected in series, a second load and a fourth bipolar transistor connected in series, and a base of the third bipolar transistor connected to the first A constant current connected to a base of the bipolar transistor, a base of the fourth bipolar transistor connected to a base of the second bipolar transistor, and an emitter of the third bipolar transistor and an emitter of the fourth bipolar transistor in common It has a differential amplifier circuit connected to a circle, and has a signal difference generator which extracts a signal difference from the said differential amplifier circuit.
청구항 7의 광디스크 장치는 청구항 6에 기재된 광디스크 장치에 있어서, 상기 제1 베이스 전류 공급 회로 및 상기 제2 베이스 전류 공급 회로는 연산 증폭기를 구비하는 것을 특징으로 한다.An optical disc apparatus of claim 7 is the optical disc apparatus according to claim 6, wherein the first base current supply circuit and the second base current supply circuit are provided with an operational amplifier.
청구항8의 광디스크 장치는 청구항 7에 기재된 광디스크 장치에 있어서, 상기 제1 베이스 전류 공급 회로 및 상기 제2 베이스 전류 공급 회로는 전압 팔로워인 것을 특징으로 한다.The optical disk device of claim 8 is the optical disk device according to claim 7, wherein the first base current supply circuit and the second base current supply circuit are voltage followers.
청구항 9의 광디스크 장치는 청구항 6에 기재된 광디스크 장치에 있어서, 상기 제1 베이스 전류 공급 회로 및 상기 제2 베이스 전류 공급 회로는 입력단의 전압에 의하여 제어되는 트랜지스터인 것을 특징으로 한다.The optical disk device of claim 9 is the optical disk device according to claim 6, wherein the first base current supply circuit and the second base current supply circuit are transistors controlled by a voltage at an input terminal.
청구항 10의 광디스크 장치는 청구항 6 내지 9 중 어느 한 항에 기재된 광디스크 장치에 있어서, 상기 제1 바이폴라 트랜지스터의 이미터 및 상기 제2 바이폴라 트랜지스터의 이미터를 공통의 전압원에 접속하는 것을 특징으로 한다.The optical disk device of claim 10 is the optical disk device according to any one of claims 6 to 9, characterized in that the emitter of the first bipolar transistor and the emitter of the second bipolar transistor are connected to a common voltage source.
도 1은 본 발명의 실시형태에 따른 신호차 작성 장치 및 이를 이용한 광디스크 장치의 구성을 나타내는 도면.BRIEF DESCRIPTION OF THE DRAWINGS Fig. 1 is a diagram showing a configuration of a signal difference producing device and an optical disk device using the same according to an embodiment of the present invention.
도 2는 도 1의 베이스 전류 공급 회로를 연산 증폭기로 구성한 예를 나타내는 도면.2 is a diagram illustrating an example in which the base current supply circuit of FIG. 1 is configured as an operational amplifier.
도 3은 도 1의 베이스 전류 공급 회로를 MOS 트랜지스터로 구성한 예를 나타내는 도면.FIG. 3 is a diagram illustrating an example in which the base current supply circuit of FIG. 1 is configured with a MOS transistor. FIG.
도 4는 종래의 신호차 작성 장치의 구성을 나타내는 도면.4 is a diagram illustrating a configuration of a conventional signal difference producing apparatus.
<도면의 주요 부분에 대한 부호의 설명><Explanation of symbols for the main parts of the drawings>
PD1, PD2 : 포토 다이오드 Amp : 증폭기PD1, PD2: Photodiode Amp: Amplifier
100, 100A : 신호차 작성 회로 110 : 전류 차동 회로100, 100A: signal difference generating circuit 110: current differential circuit
120, 130 : 베이스 전류 공급 회로 OP1, OP2 : 연산 증폭기120, 130: base current supply circuit OP1, OP2: operational amplifier
Q1∼Q4 : NPN 트랜지스터 I1, I11 : 정전류원Q1 to Q4: NPN transistors I1 and I11: constant current source
R2, R3 : 저항 E : 전압원R2, R3: resistor E: voltage source
Iq1 : 제1 전류 Iq2 :제2 전류Iq1: first current Iq2: second current
Vout : 신호차 Vcc : 전원 전압Vout: Signal difference Vcc: Power supply voltage
Q11∼Q21 MOS 트랜지스터Q11 to Q21 MOS transistors
이하, 본 발명의 신호차 작성 장치 및 이를 이용한 광디스크 장치의 실시형태에 있어서 도 1∼도 3을 참조하여 설명한다.EMBODIMENT OF THE INVENTION Hereinafter, embodiment of the signal difference producing apparatus of this invention and an optical disk apparatus using the same is demonstrated with reference to FIGS.
도 1은 본 발명의 실시형태에 따른 신호차 작성 장치 및 이를 이용한 광디스크 장치의 구성을 나타내는 도면이다.1 is a diagram showing the configuration of a signal difference producing apparatus and an optical disk apparatus using the same according to an embodiment of the present invention.
도 1에 있어서, 제1 포토 다이오드 PD1 및 제2 포토 다이오드 PD2는 트래킹용(또는 포커스용)에 2분할된 수광 소자이다. 포토 다이오드 PD1의 수광량에 따른제1 전류 Iq1과, 포토 다이오드 PD2의 수광량에 따른 제2 전류 Iq4가 신호차 작성 장치(이하, 신호차 작성 회로)(100A)에 공급된다.In FIG. 1, the first photodiode PD1 and the second photodiode PD2 are light-receiving elements divided into two parts for tracking (or focus). The first current Iq1 corresponding to the light reception amount of the photodiode PD1 and the second current Iq4 according to the light reception amount of the photodiode PD2 are supplied to the signal difference generating device (hereinafter, the signal difference generating circuit) 100A.
신호차 작성 회로(100A)는 도 4의 종래의 신호차 작성 회로(100)와 동일하게 제1 전류 Iq1과 제2 전류 Iq4에 근거하는 신호차 Vout{=R×Iref×(Iq1-Iq4)/(Iq1+Iq4)}를 작성한 것이다.The signal difference generating circuit 100A has a signal difference Vout {= R × Iref × (Iq1-Iq4) / based on the first current Iq1 and the second current Iq4 similarly to the conventional signal difference generating circuit 100 in FIG. 4. (Iq1 + Iq4)}.
도 4의 종래의 신호차 작성 회로(100)에서는 NPN 트랜지스터 Q1의 컬렉터와 그 베이스 사이가 직접 접속되어 있다. 이에 대하여, 본 발명의 도 1에서, 신호차 작성 회로(100A)는 NPN 트랜지스터 Q1의 컬렉터와 그 베이스 사이가 제1 베이스 전류 공급 회로(120)를 통하여 접속하고 있다.In the conventional signal difference generating circuit 100 of FIG. 4, the collector and the base of the NPN transistor Q1 are directly connected. In contrast, in FIG. 1 of the present invention, the signal difference generating circuit 100A is connected between the collector of the NPN transistor Q1 and its base via the first base current supply circuit 120.
제1 베이스 전류 공급 회로(120)는 도 1에 있어서 연산 증폭기(이하, 연산 증폭기) OP1을 사용하여 구성되어 있다. 연산 증폭기 OP1의 비반전 입력단자(+)가 NPN 트랜지스터 Q1의 컬렉터에 접속되고, 그 반전 입력단자(-)와 그 출력 단자가 접속된 다음, NPN 트랜지스터 Q1의 베이스에 접속되어 있다. 즉, NPN 트랜지스터 Q1의 컬렉터와 그 베이스 사이가 전압 팔로워에 의하여 접속되어 있다.The first base current supply circuit 120 is configured by using an operational amplifier OP1 (hereinafter referred to as an operational amplifier) in FIG. 1. The non-inverting input terminal (+) of the operational amplifier OP1 is connected to the collector of the NPN transistor Q1, its inverting input terminal (-) and its output terminal are connected, and then connected to the base of the NPN transistor Q1. That is, the voltage follower is connected between the collector of the NPN transistor Q1 and its base.
제2 베이스 전류 공급 회로(130)는 동일하게 도 1에 있어서 연산 증폭기 OP2에 의하여 구성되고, NPN 트랜지스터 Q4의 컬렉터와 그 베이스 사이를 접속하고 있다. 연산 증폭기 OP2의 비반전 입력단자(+)가 NPN 트랜지스터 Q4의 컬렉터에 접속되고, 그 반전 입력단자(-)와 그 출력 단자가 접속된 다음, NPN 트랜지스터 Q4의 베이스에 접속되어 있다. 즉, NPN 트랜지스터 Q4의 컬렉터와 그 베이스 사이가 전압 팔로워에 의하여 접속되어 있다.The second base current supply circuit 130 is similarly constituted by the operational amplifier OP2 in FIG. 1 and is connected between the collector of the NPN transistor Q4 and its base. The non-inverting input terminal (+) of the operational amplifier OP2 is connected to the collector of the NPN transistor Q4, and its inverting input terminal (-) and its output terminal are connected, and then connected to the base of the NPN transistor Q4. That is, the voltage follower is connected between the collector of the NPN transistor Q4 and its base.
이 제1 베이스 전류 공급 회로(120), 제2 베이스 전류 공급 회로(130)가 각각 연산 증폭기를 이용한 전압 팔로워이기 때문에, 이의 입력측인 NPN 트랜지스터 Q1의 컬렉터측에서 보아 높은 입력 임피던스를 갖고 있고, 출력측인 NPN 트랜지스터 Q1의 베이스측에서 보아 낮은 출력 임피던스를 갖고 있다. 그리고, 그 입력단 (+)전압과 출력단 (-)전압이 거의 동등하게 있다. 이상적인 특성의 연산 증폭기라면, 그 입력 임피던스는 무한대이며, 입력단 (+)전압과 출력단 (-)전압과는 완전히 동등하게 된다.Since the first base current supply circuit 120 and the second base current supply circuit 130 are voltage followers each using an operational amplifier, they have a high input impedance when viewed from the collector side of the NPN transistor Q1, which is an input side thereof, and the output side. NPN transistor Q1 has a low output impedance as seen from the base side. The input terminal (+) voltage and the output terminal (-) voltage are almost equal. For an op amp with ideal characteristics, its input impedance is infinite, and the input voltage (+) and output voltage (-) are completely equal.
신호차 작성 회로(100A)의 출력인 신호차 Vout는 증폭기 Amp에 의하여 증폭되고, 광디스크 장치의 트래킹나 포커스 등의 서보 제어를 행하기 위한 신호로서 사용된다.The signal difference Vout, which is the output of the signal difference generating circuit 100A, is amplified by the amplifier Amp and used as a signal for performing servo control such as tracking and focus of the optical disk device.
도 1의 본 발명의 실시형태에 따른 신호차 작성 장치(100A)는 도 4의 종래의 신호차 작성 장치(100)와는 구성에 있어서, 제1 베이스 전류 공급 회로(120), 제2 베이스 전류 공급 회로(130)가 다를 뿐, 그 밖의 점에서는 구성상에서 동일하다. 따라서 대응하는 구성 요소에는 동일한 부호를 부여하고, 중복 설명은 간략화하기 위해 생략한다.The signal difference producing apparatus 100A according to the embodiment of the present invention in FIG. 1 is configured with the conventional signal difference generating apparatus 100 in FIG. 4, and includes a first base current supply circuit 120 and a second base current supply. The circuit 130 is different, and in other respects, it is the same in configuration. Therefore, the same reference numerals are given to corresponding components, and redundant descriptions are omitted for simplicity.
도 1에 있어서, 제1 베이스 전류 공급 회로(120)의 입력 임피던스는 극히 높기(이상적으로는 무한대) 때문에, 전원 전압 Vcc로부터 포토 다이오드 PD1을 통하여 공급된 제1 전류 Iq1은 NPN 트랜지스터 Q1의 컬렉터 전류 Icq1과 같다. 또, NPN 트랜지스터 Q1의 베이스 전압은 그 컬렉터 전압과 동등하게 되어 있고, 그 베이스 전류 Ibq1은 제1 베이스 전류 공급 회로(120)의 동작 전원으로부터 공급된다. 이NPN 트랜지스터 Q1의 컬렉터 전류 Icq1과 베이스 전류 Ibq1이 그 이미터를 통과하여 전압원 E에 흐른다.In Fig. 1, since the input impedance of the first base current supply circuit 120 is extremely high (ideally infinite), the first current Iq1 supplied through the photodiode PD1 from the power supply voltage Vcc is the collector current of the NPN transistor Q1. Same as Icq1. The base voltage of the NPN transistor Q1 is equal to the collector voltage, and the base current Ibq1 is supplied from the operating power supply of the first base current supply circuit 120. Collector current Icq1 and base current Ibq1 of this NPN transistor Q1 flow through the emitter to the voltage source E.
이 NPN 트랜지스터 Q1의 베이스와 전류 차동 회로(110)의 NPN 트랜지스터 Q2의 베이스가 직접 접속되어 있으므로, NPN 트랜지스터 Q1과 NPN 트랜지스터 Q2의 베이스 전압은 동일하다. 즉, 이른바 커런트 미러 구성으로 되어 있다. 따라서 NPN 트랜지스터 Q2의 베이스에도 제1 베이스 전류 공급 회로(120)로부터 베이스 전류 Ibq2가 흐르고, 이에 따른 컬렉터 전류 Icq2가 흐른다. 이 컬렉터 전류 Icq2는 NPN 트랜지스터 Q1의 컬렉터 전류 Icq1, 즉 제1 전류 Iq1(=Icq1)에 비례한다.Since the base of the NPN transistor Q1 and the base of the NPN transistor Q2 of the current differential circuit 110 are directly connected, the base voltages of the NPN transistor Q1 and the NPN transistor Q2 are the same. That is, it is a so-called current mirror structure. Therefore, the base current Ibq2 also flows from the first base current supply circuit 120 to the base of the NPN transistor Q2, and thus the collector current Icq2 flows. This collector current Icq2 is proportional to the collector current Icq1 of the NPN transistor Q1, that is, the first current Iq1 (= Icq1).
동일하게, 제2 베이스 전류 공급 회로(130)의 입력 임피던스는 극히 높기 때문에, 전원 전압 Vcc로부터 포토 다이오드 PD2를 통하여 공급된 제2 전류 Iq4는 NPN 트랜지스터 Q4의 컬렉터 전류 Icq4와 같다. 또, NPN 트랜지스터 Q4의 베이스 전압은 그 컬렉터 전압과 동등하게 되어 있고, 그 베이스 전류 Ibq4는 제2 베이스 전류 공급 회로(130)의 동작 전원으로부터 공급된다. 이 NPN 트랜지스터 Q4의 컬렉터 전류 Icq4와 베이스 전류 Ibq4가 그 이미터를 통과하여 전압원 E에 흐른다.Similarly, since the input impedance of the second base current supply circuit 130 is extremely high, the second current Iq4 supplied from the power supply voltage Vcc through the photodiode PD2 is equal to the collector current Icq4 of the NPN transistor Q4. The base voltage of the NPN transistor Q4 is equal to the collector voltage, and the base current Ibq4 is supplied from the operating power supply of the second base current supply circuit 130. The collector current Icq4 and the base current Ibq4 of this NPN transistor Q4 flow through the emitter and flow to the voltage source E.
이 NPN 트랜지스터 Q4의 베이스와 전류 차동 회로(110)의 NPN 트랜지스터 Q3의 베이스가 직접 접속되어 있으므로, NPN 트랜지스터 Q4와 NPN 트랜지스터 Q3의 베이스 전압은 동일하다. 이것도, 이른바 커런트 미러 구성으로 되어 있다. 따라서 NPN 트랜지스터 Q3의 베이스에도 제2 베이스 전류 공급 회로(130)로부터 베이스 전류 Ibq3이 흐르고, 이에 따른 컬렉터 전류 Icq3이 흐른다. 이 컬렉터 전류 Icq3은 NPN 트랜지스터 Q4의 컬렉터 전류 Icq4, 즉 제2 전류 Iq4 (=Icq4)에 비례한다.Since the base of the NPN transistor Q4 and the base of the NPN transistor Q3 of the current differential circuit 110 are directly connected, the base voltages of the NPN transistor Q4 and the NPN transistor Q3 are the same. This also has a so-called current mirror configuration. Accordingly, the base current Ibq3 also flows from the second base current supply circuit 130 to the base of the NPN transistor Q3, and thus the collector current Icq3 flows. This collector current Icq3 is proportional to the collector current Icq4 of the NPN transistor Q4, that is, the second current Iq4 (= Icq4).
전류 차동 회로(110)의 저항 R2의 전압 강하(=R×Iq2)와, 저항 R3의 전압 강하(=R×Iq3)의 차전압이 신호차 작성 회로(100A)의 신호차 Vout로서 증폭기 Amp에 공급된다.The voltage drop of the resistor R2 of the current differential circuit 110 (= RxIq2) and the voltage difference of the voltage drop of the resistor R3 (= RxIq3) are supplied to the amplifier Amp as the signal difference Vout of the signal difference generating circuit 100A. Supplied.
이 도 1의 실시형태에 있어서는 각 트랜지스터 Q1∼Q4의 베이스 전류 Ibq1∼Ibq4는 전부 제1 베이스 전류 공급 회로(120) 또는 제2 베이스 전류 공급 회로(130)로부터 공급된다. 따라서 종래의 도 4에 있어서, 식 3의 신호차 Vout의 오차분으로 된 「2(Ibq1+Ibq2)」가 제로로 된다. 이에 의해, 본 발명에서 신호차 Vout은In this embodiment of FIG. 1, all of the base currents Ibq1 to Ibq4 of the transistors Q1 to Q4 are supplied from the first base current supply circuit 120 or the second base current supply circuit 130. Therefore, in FIG. 4 of the related art, "2 (Ibq1 + Ibq2)", which is an error of the signal difference Vout of the equation 3, becomes zero. Thus, in the present invention, the signal difference Vout is
Vout=R×Iref×(Iq1-Iq4)/(Iq1+Iq4)···(4)로 되고, 본래 얻고자 한 신호로 된다.Vout = R x Iref x (Iq1-Iq4) / (Iq1 + Iq4) ... (4), which is the signal originally intended to be obtained.
이와 같이, 출력되는 신호차 Vout으로부터 베이스 전류에 의한 오차분이 제거되어 있다. 따라서 입력 전류인 제1 전류 Iq1이나 제2 전류 Iq4의 크기나 온도 등의 주위 조건의 변동에 기인하여 트랜지스터의 베이스 전류가 변화해도 신호차 Vout에는 영향을 주지 않는다.In this way, the error due to the base current is removed from the output signal difference Vout. Therefore, even if the base current of the transistor changes due to variations in ambient conditions such as the magnitude and temperature of the first current Iq1 and the second current Iq4, which are input currents, the signal difference Vout is not affected.
또, 베이스 전류 공급 회로(120, 130)를 연산 증폭기로 구성함으로써, 포토 다이오드 PD1, PD2에서의 전압 강하를 예상한다해도, 전원 전압 Vcc가 비교적 낮은 경우에도 용이하게 적용할 수 있다.In addition, by configuring the base current supply circuits 120 and 130 as operational amplifiers, even if the voltage drop in the photodiodes PD1 and PD2 is expected, it can be easily applied even when the power supply voltage Vcc is relatively low.
도 2는 도 1의 제1 베이스 전류 공급 회로(120)나 제2 베이스 전류 공급 회로(130)를 연산 증폭기로 구성한 구체적인 예를 나타내는 도면이다.FIG. 2 is a diagram illustrating a specific example in which the first base current supply circuit 120 or the second base current supply circuit 130 of FIG. 1 is configured as an operational amplifier.
이 도 2에서는 P형 MOS 트랜지스터(이하, P형 트랜지스터) Q11과 N형 MOS 트랜지스터(이하, N형 트랜지스터) Q12가 직렬로 접속되고, 그 N형 트랜지스터 Q12의 드레인과 게이트가 접속되어 있다. 또, P형 트랜지스터 Q13과 N형 트랜지스터 Q14가 직렬로 접속되어 있다. 이러한 트랜지스터의 직렬 회로 Q11, Q12와 Q13, Q14가 병렬로 접속되어 있다. 또, N형 트랜지스터 Q12의 게이트와 N형 트랜지스터 Q14의 게이트가 접속되어 있다. 이 트랜지스터 Q11∼Q14의 직병렬 회로와 정전류원 I11이 전원 전압 Vcc와 그라운드 사이에 접속되어 연산 증폭기가 구성된다.In Fig. 2, the P-type MOS transistor (hereinafter referred to as P-type transistor) Q11 and the N-type MOS transistor (hereinafter referred to as N-type transistor) Q12 are connected in series, and the drain and gate of the N-type transistor Q12 are connected. The P-type transistor Q13 and the N-type transistor Q14 are connected in series. The series circuits Q11, Q12 and Q13, Q14 of such a transistor are connected in parallel. The gate of the N-type transistor Q12 and the gate of the N-type transistor Q14 are connected. The serial and parallel circuits of the transistors Q11 to Q14 and the constant current source I11 are connected between the power supply voltage Vcc and ground to form an operational amplifier.
그리고, 이 연산 증폭기의 비반전 입력단(+)으로 된 P형 트랜지스터 Q11의 게이트가 포토 다이오드 PD1(즉, NPN 트랜지스터 Q1의 컬렉터)에 접속된다. 연산 증폭기의 반전 입력단(-)으로 된 P형 트랜지스터 Q13의 게이트가 연산 증폭기의 출력단으로 된 P형 트랜지스터 Q13의 드레인에 접속되는 동시에, NPN 트랜지스터 Q1의 베이스에 접속된다. 이에 따라, 연산 증폭기를 이용한 전압 팔로워가 구성되어 있다. 이 도 2의 연산 증폭기에서는 입력단으로부터 유입(또는 유출)하는 게이트 전류는 제로로 간주할 수 있으므로, 입력 임피던스는 무한대로 해도 된다.The gate of the P-type transistor Q11 serving as the non-inverting input terminal (+) of this operational amplifier is connected to the photodiode PD1 (that is, the collector of the NPN transistor Q1). The gate of the P-type transistor Q13, which is the inverting input terminal (-) of the operational amplifier, is connected to the drain of the P-type transistor Q13, which is the output terminal of the operational amplifier, and is connected to the base of the NPN transistor Q1. Thus, the voltage follower using the operational amplifier is configured. In the operational amplifier of Fig. 2, the gate current flowing in (or out) from the input terminal can be regarded as zero, so the input impedance may be infinite.
이 도 2의 연산 증폭기는 간단한 구성예를 도시하였으나, 다른 구성의 연산 증폭기를 이용할 수 있다. 또, 도 2에서는 연산 증폭기를 MOS 트랜지스터로 구성하였으나, MOS 트랜지스터에 대신하여 바이폴라 트랜지스터로 구성할 수도 있다. 이 경우에는 바이폴라 트랜지스터의 베이스 전류가 흐르지만, 도 4의 종래의 컬렉터와 베이스를 직접 접속한 것에 비해 이 베이스 전류가 현저하게 작기 때문에(예를 들면, 수 십분의 1 정도), 신호차 Vout에 주는 오차분은 실용상에서 문제가 없다.Although the operational amplifier of FIG. 2 shows a simple configuration example, other operational amplifiers may be used. In addition, although the operational amplifier is comprised by the MOS transistor in FIG. 2, it can also be comprised by a bipolar transistor instead of a MOS transistor. In this case, the base current of the bipolar transistor flows, but since the base current is remarkably small (for example, a few tenths) as compared with the direct connection of the conventional collector and base of Fig. 4, the signal difference Vout The error to give is practically no problem.
도 3은 도 1의 제1 베이스 전류 공급 회로(120)나 제2 베이스 전류 공급 회로(130)를 MOS 트랜지스터로 구성한 가장 간단한 예를 나타내는 도면이다. 이 도 2에서는 N형 트랜지스터 Q21의 게이트가 포토 다이오드 PD1(즉, NPN 트랜지스터 Q1의 컬렉터)에 접속되고, 그 소스가 NPN 트랜지스터 Q1의 베이스에 접속되고, 그 드레인이 전원 전압 Vcc에 접속되어 있다. 이 도 3에서도, 입력단으로부터 유입(또는 유출)하는 게이트 전류는 제로로 간주할 수 있으므로, 입력 임피던스는 무한대로 해도 된다. 단지, 이 도 3에서는 N형 트랜지스터 Q21의 게이트와 소스 사이의 전압 Vgs가 존재하므로, NPN 트랜지스터 Q1의 컬렉터 전압은 그 베이스 전압보다 전압 Vgs만큼 높아진다.FIG. 3 is a diagram illustrating a simplest example in which the first base current supply circuit 120 or the second base current supply circuit 130 of FIG. 1 is constituted by MOS transistors. In FIG. 2, the gate of the N-type transistor Q21 is connected to the photodiode PD1 (that is, the collector of the NPN transistor Q1), the source thereof is connected to the base of the NPN transistor Q1, and the drain thereof is connected to the power supply voltage Vcc. Also in FIG. 3, since the gate current flowing in (or out) from the input terminal can be regarded as zero, the input impedance may be infinite. However, in FIG. 3, since the voltage Vgs between the gate and the source of the N-type transistor Q21 exists, the collector voltage of the NPN transistor Q1 becomes higher by the voltage Vgs than the base voltage.
또, 도 3에 있어서 N형 트랜지스터 Q21에 대신하여 NPN형 트랜지스터를 이용할 수도 있다. 이 경우에는 바이폴라 트랜지스터의 베이스 전류가 흐르지만, 도 4의 종래의 컬렉터와 베이스를 직접 접속한 것에 비해 그 베이스 전류가 현저하게 작기 대문에, 신호차 Vout에 주는 오차분은 작다.In addition, in FIG. 3, an NPN type transistor may be used instead of the N type transistor Q21. In this case, although the base current of the bipolar transistor flows, since the base current is remarkably small compared with the direct connection of the conventional collector and base of Fig. 4, the error given to the signal difference Vout is small.
본 발명의 신호차 작성 장치에 의하면, 입력 전류가 공급되는 바이폴라 트랜지스터의 컬렉터와 베이스 사이에 베이스 전류 공급 회로를 설치하고, 각 트랜지스터의 베이스 전류를 베이스 전류 공급 회로로부터 공급하기 때문에, 공급되는 입력 전류와 트랜지스터의 컬렉터 전류를 실질적으로 동일하게 한다. 따라서 출력되는 신호차로부터 베이스 전류에 의한 오차분를 제거할 수 있다.According to the signal difference producing apparatus of the present invention, since the base current supply circuit is provided between the collector and the base of the bipolar transistor to which the input current is supplied, and the base current of each transistor is supplied from the base current supply circuit, the input current is supplied. And collector currents of the transistors are made substantially the same. Therefore, the error due to the base current can be removed from the output signal difference.
또, 입력 전류의 크기나 온도 등의 주위 조건의 변동에 기인하여 트랜지스터의 베이스 전류가 변화하는 경우에도, 신호차에는 영향을 주지 않으므로, 안정적으로 정확한 신호차를 얻을 수 있다.In addition, even when the base current of the transistor changes due to variations in ambient conditions such as the magnitude of the input current or the temperature, the signal difference is not affected, and thus a stable and accurate signal difference can be obtained.
또, 본 발명의 광디스크 장치에 의하면, 수광 소자에 의한 수광량의 차에 따라, 또한 AGC된 정확한 신호차, 즉 서보 에러 신호를 사용하여 트래킹이나 포커스등의 서보 제어를 적절하게 행할 수 있다.Further, according to the optical disk apparatus of the present invention, servo control such as tracking or focus can be appropriately performed by using the AGC accurate signal difference, that is, the servo error signal, depending on the difference in the amount of light received by the light receiving element.
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| Date | Code | Title | Description |
|---|---|---|---|
| WITN | Withdrawal due to no request for examination |