KR20010064130A - Power controller for controlling power consumption according to quantity of image data in plasma display panel device - Google Patents

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KR20010064130A
KR20010064130A KR1019990062263A KR19990062263A KR20010064130A KR 20010064130 A KR20010064130 A KR 20010064130A KR 1019990062263 A KR1019990062263 A KR 1019990062263A KR 19990062263 A KR19990062263 A KR 19990062263A KR 20010064130 A KR20010064130 A KR 20010064130A
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김종기
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Abstract

PURPOSE: A power control device of PDP(plasma display panel) which controls power consumption according to image data quantity is provided to reduce power consumption without image loss by searching for total display load of frame in response to data quantity of image data in every bit and controlling PDP operation with control data recorded in ROM(read only memory) according to the display load. CONSTITUTION: An R-counter(100), a G counter(110) and a B counter(120) receive each 8 bit R, G, B signal transformed into digital image data about each sub-field for one frame. A ROM(read only memory)(140) records a sustain discharge number of each sub-field according to each display load and control data necessary for PDP operation, for example a frequency of sustain discharge pulse according to the sustain discharge number, control timing and the like. An operation unit(130) multiplies the R/G/B data quantity in each bit inputted from the R counter(100), the G counter(110) and the B counter(120) in each sub-field and weighted value in each bit together, and multiplies the result by sub-field weighted value and add the result value of every sub-field to define total display load, and assigns the definite display load as an upper rank address value to output it. A register(150) records the information of control data in each sub-field output from the ROM(140). A lower rank address generation unit(160) generates a lower rank address value of the ROM(140) in response to the information of control data from the register(150). An operation control unit(170) outputs operation data to each operation circuit in response to the information of control timing from the register(150).

Description

이미지 데이터 량에 따라 전력 소모를 제어하는 플라즈마 디스플레이 패널 장치의 전력 제어 장치{POWER CONTROLLER FOR CONTROLLING POWER CONSUMPTION ACCORDING TO QUANTITY OF IMAGE DATA IN PLASMA DISPLAY PANEL DEVICE}POWER CONTROLLER FOR CONTROLLING POWER CONSUMPTION ACCORDING TO QUANTITY OF IMAGE DATA IN PLASMA DISPLAY PANEL DEVICE}

본 발명은 플라즈마 디스플레이 패널 장치에 관한 것으로, 특히 이미지 데이터 량에 따라 전력 소모를 제어하는 플라즈마 디스플레이 패널 장치의 전력 제어 장치에 관한 것이다.The present invention relates to a plasma display panel device, and more particularly, to a power control device of a plasma display panel device for controlling power consumption according to an amount of image data.

일반적으로, 플라즈마 디스플레이 패널 장치(Plasma Display Panel device, 이하 PDP라 함)는 페닝(penning) 가스를 방전 현상에 이용한 평판 표시 장치로서, 비교적 높은 압력의 네온(Ne) 또는 헬륨(He) 가스 등을 베이스 기체로 하여 유전체로 피복된 좁은 전극 간에 발생시킨 방전에 의한 발광 현상을 이용한 표시 장치이다.In general, a plasma display panel device (hereinafter referred to as a PDP) is a flat panel display device that uses a penning gas for discharging, and uses a neon or helium gas having a relatively high pressure. A display device using a light emitting phenomenon caused by discharge generated between a narrow electrode coated with a dielectric as a base gas.

PDP 상의 화면 표시를 위해 일반적으로 이미지 신호는 각 8비트의 R(Red), G(Green), B(Blue)로 연속적으로 인가되는 데, 각각의 R, G, B에 대해 256 계조를 구현하는 PDP의 경우 1 프레임(frame) 화면을 8개의 서브필드(subfield)로 구성하고, 각 서브필드 별로 20, 21, 22, 23, 24, 25, 26, 27,의 비중을 갖도록 구성된다. 이 서브필드 별 비중은 각 서브필드의 유지방전 횟수에 따라 결정되며, 유지방전의 회수에 따라 256계조가 표현되어 진다.In order to display on the PDP, an image signal is generally applied successively to each of 8 bits of R (Red), G (Green), and B (Blue). In case of PDP, one frame screen is composed of 8 subfields, and each subfield has 2 0 , 2 1 , 2 2 , 2 3 , 2 4 , 2 5 , 2 6 , 2 7 , It is configured to have a specific gravity. The specific gravity of each subfield is determined by the number of sustain discharges in each subfield, and 256 gray levels are expressed according to the number of sustain discharges.

이와 같은 PDP는 통상적으로 플라즈마 방전에 필요한 고전압으로 구동되며, 이러한 고전압으로 인해 전력 소모가 커지게 된다.Such a PDP is typically driven at a high voltage necessary for plasma discharge, and the high voltage causes a high power consumption.

특히, PDP 전 방전셀에 대해 256 계조 레벨을 표현할 때 가장 큰 전력을 소모하게 되며, 이러한 큰 전력 소모는 PDP 상품화에 장애가 된다.In particular, the largest power is consumed when the 256 gray levels are expressed for all the discharge cells of the PDP, and this large power consumption is an obstacle to the commercialization of PDP.

따라서, 종래에는 이러한 큰 전력 소모를 줄이기 위해 PDP의 주사 기간 중 데이터 드라이버(Data driver)의 전류 소모량을 측정하여, 제어부에서 측정된 전류 소모량과 일정 기준치와 비교함으로써 전력 소모를 제어하였다. 그러나, 이러한 경우 측정된 아날로그 신호의 전류 소모량이 제어부로 전송되어 기준치와 비교됨으로써 잡음에 민감하고, 정확한 디스플레이 양을 알 수 없으며, 이를 제어하기 위한회로 역시 복잡해지는 문제가 있었다.Therefore, in order to reduce such a large power consumption, the current consumption of the data driver is measured during the scan period of the PDP, and the power consumption is controlled by comparing the current consumption measured by the controller with a predetermined reference value. However, in this case, the current consumption of the measured analog signal is transmitted to the control unit and compared with the reference value, so it is sensitive to noise, and the exact display amount is not known, and the circuit for controlling this has also been complicated.

본 발명은 상기 문제점을 해결하기 위하여 안출된 것으로써, 이미지 데이터의 각 비트별 데이터 양에 응답하여 프레임의 전체 디스플레이 로드를 구하고, 상기 디스플레이 로드에 따라 롬에 저장된 구동에 필요한 제어 데이터로 PDP 구동을 제어함으로써, 이미지 저하 없이 전력 소모를 줄일 수 있는 플라즈마 디스플레이 패널 장치의 전력 제어 장치를 제공하는데 그 목적이 있다.The present invention has been made to solve the above problem, and obtains the total display load of the frame in response to the data amount of each bit of the image data, and drives the PDP with the control data required for driving stored in the ROM according to the display load. It is an object of the present invention to provide a power control device of a plasma display panel device which can reduce power consumption without deteriorating an image.

도 1은 본 발명의 일실시예에 따른 전력 제어 장치의 블록 다이어그램도.1 is a block diagram of a power control apparatus according to an embodiment of the present invention.

* 도면의 주요 부분에 대한 설명* Description of the main parts of the drawing

100 : R 카운터 110 : G 카운터 120 : B 카운터100: R counter 110: G counter 120: B counter

130 : 연산부 140 : 롬 150 : 레지스터130: operation unit 140: ROM 150: register

160 : 하위 어드레스 발생부 170 : 구동 제어부160: lower address generating unit 170: driving control unit

상기 목적을 달성하기 위한 본 발명은, 다수의 서브필드로 이루어지는 1 프레임 단위로 화면을 표시하는 플라즈마 디스플레이 패널 장치의 전력 제어 장치에 있어서, 1 프레임 동안 상기 다수의 서브필드별로 다 비트의 디지털 이미지 신호 R(Red), G(Green), B(Blue)를 각기 입력받아 비트별로 상기 디지털 이미지 신호 R, G, B를 각각 카운트하여, 각 비트별 R/G/B 데이터 량을 출력하는 제1 내지 제3 카운팅 수단; 임의의 디스플레이 로드 각각에 응답하여 상기 플라즈마 디스플레이 패널 장치의 구동을 제어하기 위한 임의의 제어 데이터를 저장하는 저장 수단; 상기 다수의 서브필드별로 상기 제1 내지 제3 카운팅 수단으로부터 출력되는 상기 각 비트별 R/G/B 데이터 량과, 소정의 비트별 가중치 및 서브필드 가중치에 응답하여 상기 다수의 서브필드 전체에 대한 상기 디스플레이 로드를 연산하고, 연산된 상기디스플레이 로드를 상기 저장 수단의 상위 어드레스로 할당하여 출력하기 위한 디스플레이 로드 연산 수단; 상기 각 서브필드 및 상기 플라즈마 디스플레이 패널 장치의 구동 기간에 응답하여 상기 저장 수단의 하위 어드레스를 발생하는 하위 어드레스 발생 수단; 및 상기 저장 수단으로부터 출력되는 상기 제어 데이터에 응답하여 상기 플라즈마 디스플레이 패널 장치의 구동을 제어하는 구동 제어 수단을 포함하여 이루어진다.According to an aspect of the present invention, there is provided a power control apparatus for a plasma display panel device that displays a screen in units of one frame consisting of a plurality of subfields, wherein a multi-bit digital image signal is provided for each of the plurality of subfields during one frame. First through R (Red), G (Green), and B (Blue), respectively, counting the digital image signals R, G, and B for each bit and outputting the amount of R / G / B data for each bit; Third counting means; Storage means for storing arbitrary control data for controlling the driving of the plasma display panel device in response to each of the optional display rods; For each of the plurality of subfields in response to the amount of R / G / B data for each bit output from the first to third counting means for each of the plurality of subfields, a predetermined bit weight, and a subfield weight. Display load calculation means for calculating the display load and allocating the calculated display load to an upper address of the storage means and outputting the calculated load; Lower address generating means for generating a lower address of said storage means in response to each of said subfields and a driving period of said plasma display panel device; And drive control means for controlling the driving of the plasma display panel device in response to the control data output from the storage means.

이하, 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자가 본 발명의 기술적 사상을 용이하게 실시할 수 있을 정도로 상세히 설명하기 위하여, 본 발명의 가장 바람직한 실시예를 첨부된 도면을 참조하여 설명하기로 한다.DETAILED DESCRIPTION Hereinafter, exemplary embodiments of the present invention will be described with reference to the accompanying drawings so that those skilled in the art may easily implement the technical idea of the present invention. do.

도 1은 본 발명의 일실시예에 따른 전력 제어 장치의 블록 다이어그램도이다.1 is a block diagram of a power control apparatus according to an embodiment of the present invention.

도면에 도시된 바와 같이, 본 발명의 전력 제어 장치는 1 프레임 동안 각 서브필드에 대해 디지털 이미지 데이터로 변환되어 입력되는 8비트의 R, G, B 신호를 각기 입력받아 비트별로 카운트하는 R 카운터(100), G 카운터(110) 및 B 카운터(120)와, 디스플레이 로드 각각에 따른 각 서브필드의 유지 방전 회수, 상기 유지 방전 회수에 따른 유지방전 펄스의 주파수, 제어 타이밍 등과 같이 PDP 구동을 위해 필요한 제어 데이터를 저장하는 롬(140)과, 서브필드별로 상기 R 카운터(100), G 카운터(110) 및 B 카운터(120)로부터 입력되는 각 비트별 R/G/B 데이터 량과 비트별 가중치를 곱하고, 그 결과값에 서브필드 가중치를 곱한 후 모든 서브필드에 대한 결과 값을 가산하여 전체 디스플레이 로드를 결정하고, 결정된 디스플레이 로드를 상기 롬(140)의 상위 어드레스 값으로 할당하여 출력하는 연산부(130)와, 상기 롬(140)으로부터 출력되는 각 서브필드별 제어 데이터 정보를 입력받아 저장하는 레지스터(150)와, 상기 레지스터(150)로부터의 제어 데이터 정보에 응답하여 상기 롬(140)의 하위 어드레스 값을 발생하는 하위 어드레스 발생부(160)와, 상기 레지스터(150)로부터의 제어 타이밍 정보에 응답하여 PDP를 구동하는 각 구동 회로부(도면에는 도시되지 않음)로 구동 데이터를 출력하는 구동 제어부(170)로 이루어진다.As shown in the figure, the power control apparatus of the present invention receives an R-counter that receives 8-bit R, G, and B signals which are converted into digital image data for each subfield during one frame and counted for each bit ( 100), the G counter 110 and the B counter 120, and the number of sustain discharges of each subfield according to each display rod, the frequency of the sustain discharge pulses according to the number of sustain discharges, control timing, etc. The amount of R / G / B data for each bit and the weight for each bit inputted from the R counter 100, the G counter 110, and the B counter 120 are stored in the ROM 140 storing control data and for each subfield. Multiply the result by multiplying the subfield weights, and then adding the result values for all subfields to determine the total display load, and determining the determined display load as the upper address value of the ROM 140. The operation unit 130 for outputting the control unit 130, a register 150 for receiving and storing control data information for each subfield output from the ROM 140, and the ROM in response to the control data information from the register 150. Drive data is sent to the lower address generator 160 generating the lower address value of 140 and each driving circuit portion (not shown) for driving the PDP in response to the control timing information from the register 150. It consists of a drive control unit 170 to output.

먼저, 상기와 같이 구성되는 본 발명의 전력 제어 장치는 각 서브필드의 유지 방전에 대해 빛의 양이 일정하고, 선형 특성이 있을 경우 디스플레이 로드에 따른 서브필드별 유지방전 회수를 아래 표 1과 같이 가정한다.First, in the power control apparatus of the present invention configured as described above, when the amount of light is constant for the sustain discharge of each subfield, and there is a linear characteristic, the number of sustain discharge discharges for each subfield according to the display load is shown in Table 1 below. Assume

디스플레이로드Display rod 각 서브필드별 유지방전 회수Number of maintenance discharges for each subfield 100(%)100 (%) 1 : 2 : 4 : 8 : 16 : 32 : 64 : 1281: 2: 4: 8: 16: 32: 64: 128 75(%)75 (%) 2 : 4 : 8 : 16 : 32 : 64 : 128 : 2562: 4: 8: 16: 32: 64: 128: 256 50(%)50 (%) 3 : 6 : 12 : 24 : 48 : 92 : 192 : 3843: 6: 12: 24: 48: 92: 192: 384

상기 표 1에서 가정된 디스플레이 로드에 따른 각 서브필드별 유지방전 회수는 롬(140)에 다른 제어 데이터와 함께 저장되어 진다.The number of sustain discharges for each subfield according to the assumed display load in Table 1 is stored in the ROM 140 along with other control data.

다음으로, 본 발명의 전력 제어 장치는 연산부(130)의 구성을 간단히 하기 위하여 상기 R 카운터(100), G 카운터(110) 및 B 카운터(120)로부터 출력되는 각 비트별 R/G/B 데이터 량을 각각 입력받아 임의의 유효값과 비교하는 3개의 비교기를 더 구비하여, 상기 비교기들을 통해 데이터 량을 다수의 단계, 예를 들어 4단계로 나누어 연산부(130)로 출력하도록 구성할 수도 있다.Next, in order to simplify the configuration of the operation unit 130, the power control apparatus of the present invention outputs R / G / B data for each bit output from the R counter 100, the G counter 110, and the B counter 120. The apparatus may further include three comparators that receive the amounts of the input values and compare the values with arbitrary valid values. The comparator may be configured to output the data amount to the operation unit 130 by dividing the data amount into a plurality of steps, for example, four steps.

도면을 참조하여, 본 발명의 전력 제어 장치에 대한 동작을 아래에 설명한다.Referring to the drawings, the operation of the power control device of the present invention will be described below.

먼저, 1 프레임 동안 각 서브필드에 대해 디지털 이미지 데이터로 변환되어 입력되는 8비트의 R, G, B 신호를 R 카운터(100), G 카운터(110) 및 B 카운터(120)에서 비트별로 카운트하고, 비트별로 카운트된 R, G, B 각 신호를 연산부(130)에서 서브필드별로 비트별 가중치 및 서브필드 가중치와 곱하여 비트별 전력 소모를 계산한다. 계속해서, 곱해진 각 서브필드별 결과값들을 모두 가산하여 전체 전력 소모를 계산한다. 이 가산된 결과값이 1프레임에 대한 디스플레이 로드가 되며, 상기 디스플레이 로드가 상기 롬(140)의 상위 어드레스 값으로 할당되어 롬(140)으로 보내진다.First, the 8-bit R, G, and B signals, which are converted into digital image data for each subfield for one frame, are counted bit by bit in the R counter 100, the G counter 110, and the B counter 120. In operation S130, the R, G, and B signals counted for each bit are multiplied by the bit weight and the subfield weight for each subfield to calculate power consumption for each bit. Subsequently, the total power consumption is calculated by adding up all the multiplied result values for each subfield. This added result is a display load for one frame, and the display load is assigned to the upper address value of the ROM 140 and sent to the ROM 140.

이때, 롬(140)에는 앞서 언급한 바와 같이 디스플레이 로드 각각에 따른 각 서브필드의 유지 방전 회수, 상기 유지 방전 회수에 따른 유지방전 펄스의 주파수, 제어 타이밍 등과 같이 PDP 구동을 위해 필요한 제어 데이터를 저장하고 있는 데, 연산부(130)로부터 할당되어진 상위 어드레스에 응답하여 저장된 상기 제어 데이터들(서브필드의 유지 방전 회수, 유지방전 펄스의 주파수)을 레지스터(150)로 출력한다. 하위 어드레스 발생부(160)는 상기 레지스터(150)로부터 각 서브필드와 구동 구간에 응답하는 하위 어드레스를 발생하여 다시 롬(140)으로 보낸다. 그리고, 구동 제어부(170)는 롬(140)으로부터 출력되는 제어 타이밍 정보에 응답하여 구동 데이터를 구동 회로부로 출력한다.At this time, the ROM 140 stores the control data necessary for driving the PDP, such as the number of sustain discharges of each subfield according to each display rod, the frequency of the sustain discharge pulses according to the number of sustain discharges, and the control timing. The control data (the number of sustain discharges in the subfield and the frequency of the sustain discharge pulses) stored in response to the upper address allocated from the operation unit 130 are output to the register 150. The lower address generator 160 generates a lower address corresponding to each subfield and a driving period from the register 150 and sends the lower address to the ROM 140. The drive controller 170 outputs the drive data to the drive circuit unit in response to the control timing information output from the ROM 140.

따라서, 카운터 및 연산부를 통해 R/G/B 각각의 비트별 데이터 량을 검출하고, 이로부터 전력 소모를 계산하여, 계산된 전력 소모, 즉 디스플레이 로드에 따라 롬에 저장된 제어 데이터로 PDP의 구동 회로부를 제어하도록 구성함으로써, 전력 소모를 데이터 량에 따라 간단히 제어할 수 있다.Therefore, the amount of data for each bit of the R / G / B is detected through the counter and the calculation unit, and the power consumption is calculated therefrom, and the driving circuit unit of the PDP is used as control data stored in the ROM according to the calculated power consumption, that is, the display load. By configuring the control, power consumption can be controlled simply according to the amount of data.

또한, 상기한 일실시예와 같이 1 프레임에 대한 디스플레이 로드만을 계산하지 않고, 각 프레임의 디스플레이 로드를 평균하여 다수의 프레임에 대한 전체 디스플레이 로드를 구해 이로부터 PDP 구동을 제어하도록 구성할 수 있다.In addition, as described above, instead of calculating only display load for one frame, the display load of each frame may be averaged to obtain a total display load for a plurality of frames, and the PDP driving may be controlled therefrom.

본 발명의 기술 사상은 상기 바람직한 실시예에 따라 구체적으로 기술되었으나, 상기한 실시예는 그 설명을 위한 것이며 그 제한을 위한 것이 아님을 주의하여야 한다. 또한, 본 발명의 기술 분야의 통상의 전문가라면 본 발명의 기술 사상의 범위 내에서 다양한 실시예가 가능함을 이해할 수 있을 것이다.Although the technical idea of the present invention has been described in detail according to the above preferred embodiment, it should be noted that the above-described embodiment is for the purpose of description and not of limitation. In addition, those skilled in the art will understand that various embodiments are possible within the scope of the technical idea of the present invention.

상기와 같이 이루어지는 본 발명은, PDP 구동 시 소모되는 전력을 이미지 데이터 량에 따라 간단히 제어할 수 있으며, 이미지 저하없이 전력 소모를 줄임으로써 생산 단가를 줄일 수 있다.According to the present invention made as described above, it is possible to simply control the power consumed when driving the PDP according to the amount of image data, it is possible to reduce the production cost by reducing the power consumption without image degradation.

Claims (4)

다수의 서브필드로 이루어지는 1 프레임 단위로 화면을 표시하는 플라즈마 디스플레이 패널 장치의 전력 제어 장치에 있어서,In the power control device of the plasma display panel device for displaying a screen in units of one frame consisting of a plurality of sub-fields, 1 프레임 동안 상기 다수의 서브필드별로 다 비트의 디지털 이미지 신호 R(Red), G(Green), B(Blue)를 각기 입력받아 비트별로 상기 디지털 이미지 신호 R, G, B를 각각 카운트하여, 각 비트별 R/G/B 데이터 량을 출력하는 제1 내지 제3 카운팅 수단;Multi-bit digital image signals R (Red), G (Green), and B (Blue) are respectively input for each of the plurality of subfields during one frame, and the digital image signals R, G, and B are counted for each bit, respectively. First to third counting means for outputting the amount of R / G / B data for each bit; 임의의 디스플레이 로드 각각에 응답하여 상기 플라즈마 디스플레이 패널 장치의 구동을 제어하기 위한 임의의 제어 데이터를 저장하는 저장 수단;Storage means for storing arbitrary control data for controlling the driving of the plasma display panel device in response to each of the optional display rods; 상기 다수의 서브필드별로 상기 제1 내지 제3 카운팅 수단으로부터 출력되는 상기 각 비트별 R/G/B 데이터 량과, 소정의 비트별 가중치 및 서브필드 가중치에 응답하여 상기 다수의 서브필드 전체에 대한 상기 디스플레이 로드를 연산하고, 연산된 상기 디스플레이 로드를 상기 저장 수단의 상위 어드레스로 할당하여 출력하기 위한 디스플레이 로드 연산 수단;For each of the plurality of subfields in response to the amount of R / G / B data for each bit output from the first to third counting means for each of the plurality of subfields, a predetermined bit weight, and a subfield weight. Display load calculation means for calculating the display load and allocating the calculated display load to an upper address of the storage means and outputting the calculated load; 상기 각 서브필드 및 상기 플라즈마 디스플레이 패널 장치의 구동 기간에 응답하여 상기 저장 수단의 하위 어드레스를 발생하는 하위 어드레스 발생 수단; 및Lower address generating means for generating a lower address of said storage means in response to each of said subfields and a driving period of said plasma display panel device; And 상기 저장 수단으로부터 출력되는 상기 제어 데이터에 응답하여 상기 플라즈마 디스플레이 패널 장치의 구동을 제어하는 구동 제어 수단Drive control means for controlling the drive of the plasma display panel device in response to the control data output from the storage means; 을 포함하여 이루어지는 플라즈마 디스플레이 패널 장치의 전력 제어 장치.Power control device of the plasma display panel device comprising a. 제 1 항에 있어서, 상기 디스플레이 로드 연산 수단은,The method of claim 1, wherein the display load calculation means, 상기 다수의 서브필드별로 상기 제1 내지 제3 카운팅 수단으로부터 출력되는 상기 각 비트별 R/G/B 데이터 량과 상기 비트별 가중치를 곱하기 위한 제1 곱셈 수단;First multiplication means for multiplying the amount of R / G / B data for each bit and the weight for each bit output from the first to third counting means for each of the plurality of subfields; 상기 제1 곱셈 수단으로부터 출력되는 곱셈 결과값과 상기 서브필드 가중치를 곱하기 위한 제2 곱셈 수단;Second multiplication means for multiplying the multiplication result value output from the first multiplication means and the subfield weight; 상기 제2 곱셈 수단으로부터 출력되는 각 서브필드별 곱셈 결과값을 가산하여 가산된 결과값을 상기 디스플레이 로드로 출력하는 가산 수단; 및Adding means for adding the multiplication result value for each subfield output from the second multiplication means and outputting the added result value to the display load; And 상기 가산 수단으로부터의 상기 디스플레이 로드를 상기 저장 수단의 상위 어드레스로 할당하기 위한 수단Means for assigning the display load from the addition means to an upper address of the storage means. 을 포함하여 이루어지는 플라즈마 디스플레이 패널 장치의 전력 제어 장치.Power control device of the plasma display panel device comprising a. 제 1 항 또는 제 2 항에 있어서, 상기 제어 데이터는,The method of claim 1 or 2, wherein the control data, 각 서브필드의 유지 방전 회수, 상기 유지 방전 회수에 따른 유지방전 펄스의 주파수, 제어 타이밍을 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널 장치의 전력 제어 장치.And a control timing of the sustain discharge pulse for each subfield, the frequency of the sustain discharge pulse according to the sustain discharge count, and a control timing. 제 1 항에 있어서,The method of claim 1, 상기 제1 내지 제3 카운팅 수단으로부터 출력되는 상기 각 비트별 R/G/B 데이터 량을 각각 입력받아 임의의 유효값과 비교하여, 상기 각 비트별 R/G/B 데이터 량을 다수의 단계로 각각 나누어 상기 디스플레이 로드 연산 수단으로 출력하는 제1 내지 제3 비교 수단The amount of R / G / B data for each bit, which is output from the first to third counting means, is respectively inputted and compared with an arbitrary valid value, and the amount of R / G / B data for each bit is divided into a plurality of steps. First to third comparison means which are respectively divided and output to the display load calculation means. 을 더 포함하여 이루어지는 플라즈마 디스플레이 패널 장치의 전력 제어 장치.The power control device of the plasma display panel device further comprises.
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* Cited by examiner, † Cited by third party
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KR20010077727A (en) * 2000-02-08 2001-08-20 김순택 Method and apparatus to control drive-power for plasma display panel
KR101223617B1 (en) * 2012-01-11 2013-01-17 (주)그립 Apparatus and method for measuring the power consumption of the display
KR20130053059A (en) * 2011-11-14 2013-05-23 삼성전자주식회사 Method and apparatus for battery gaging in a portable terminal using amoled display

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