KR101564079B1 - 다중 안테나 송신기들에서의 송신기 왜곡 교정을 위한 적응적 간섭 제거 - Google Patents

다중 안테나 송신기들에서의 송신기 왜곡 교정을 위한 적응적 간섭 제거 Download PDF

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Abstract

무선 통신 디바이스는 코어 로직, 제 1 트랜시버 체인 및 제 2 트랜시버 체인, 제 1 안테나 및 제 2 안테나, 그리고 간섭 프로세서를 포함한다. 코어 로직은 제 1 트랜시버 체인과 제 2 트랜시버 체인 모두에 연결되며, 차례로 제 1 트랜시버 체인과 제 2 트랜시버 체인은 제 1 안테나와 제 2 안테나에 각각 연결된다. 간섭 프로세서는 제 1 트랜시버 체인과 제 2 트랜시버 체인 사이에 연결된다. 제 2 트랜시버 체인이 제 2 안테나를 통해 제 2 신호들을 전송하고 있는 동안, 제 2 트랜시버 체인에서 생성된 제 1 신호들을 사용하여 제 1 트랜시버 체인 내의 회로를 교정하기 위해, 간섭 프로세서는 제 2 트랜시버 체인의 송신 회로를 제 1 트랜시버 체인의 수신 회로에 접속하여, 제 1 안테나에 의해 바람직하지 않게 포착된, 제 2 신호의 원치 않는 컴포넌트들을 보상하는데 사용될 수 있는 간섭 피드백 경로를 형성한다.

Description

다중 안테나 송신기들에서의 송신기 왜곡 교정을 위한 적응적 간섭 제거{ADAPTIVE INTERFERENCE CANCELLATION FOR TRANSMITTER DISTORTION CALIBRATION IN MULTI-ANTENNA TRANSMITTERS}
본 실시예들은 일반적으로 통신 시스템들에 관한 것으로, 구체적으로는 다중 안테나 송신기들에서 전력 증폭기들을 교정하기 위한 적응적 간섭 제거에 관한 것이다.
트랜시버들 내에 제공된 전력 증폭기(PA: power amplifier)들의 고유의 비선형 특성들로 인해, 무선 트랜시버들을 사용하여 높은 전력 신호들을 전송하는 것은 까다로울 수 있다. 실제로, 전력 증폭기들은 일반적으로 자신들의 동작 특성들이 예측될 수 있는 제한된 선형 동작 영역을 갖는다. 예를 들어, 전력 증폭기의 동작 온도 및/또는 전력 레벨이 지정된 범위를 벗어난다면, 전력 증폭기는 안테나에 의한 수신 디바이스로의 후속 송신을 위해 증폭되는 데이터 신호를 바람직하지 않게 왜곡하는 비선형 방식으로 동작을 시작할 수 있다. 결과적인 신호 왜곡은 수신 디바이스에서의 데이터 에러들로 이어질 수 있으며, 전송 디바이스의 프론트엔드(front-end) 회로를 과부하가 걸리게 할 수 있고 심지어는 손상시킬 수 있다. 전력 증폭기의 고유의 비선형 특성들을 보상하기 위해, (예를 들어, 전력 증폭기의 이득을 조정함으로써) 신호 전력 레벨들을 특정한 범위들 내에 유지하도록 사전 왜곡 기술들이 적용될 수 있다.
더 구체적으로, 많은 트랜시버들은 전력 증폭기로부터 출력된 신호를 사전 왜곡 회로로 라우팅하는 루프백 경로를 포함하며, 차례로 사전 왜곡 회로는 루프백 신호를 처리하여 (예를 들면, 루프백 신호를 원래의 신호와 비교함으로써) 전력 증폭기의 동작(behavior)을 나타내는 한 세트의 값들을 계산한다. 이러한 값들은 예를 들어, 전력 증폭기에 신호가 인가되기 전에 신호를 사전 조정하고 그리고/또는 전력 증폭기의 하나 또는 그보다 많은 설정들(예를 들면, 이득 설정)을 조정함으로써 전력 증폭기를 교정하는데 사용될 수 있다. 이러한 교정 기술들을 이용하는 많은 무선 통신 디바이스들의 경우, 디바이스 자원들의 불필요한 중복을 피하도록 루프백 신호가 디바이스의 수신기 회로를 통해 사전 왜곡 회로로 라우팅된다. 적절한 교정을 달성하기 위해, 루프백 신호는 (예를 들어, 대략 -40㏈m 미만의 오차를 갖게) 매우 정확해야한다.
많은 다중 입력 다중 출력(MIMO: multiple-input multiple-output) 무선 통신 디바이스들은 다수의 송신 및 수신 체인들과 안테나들을 이용하여 트랜시버 데이터 레이트들을 증가시키고 그리고/또는 다중 경로 페이딩의 영향을 받는 통신 채널들에서의 신호 다이버시티를 달성한다. 공교롭게도, 송신 체인들이 동시에 신호들을 전송하고 있을 때 송신 체인들 간의 제한적인 분리 때문에, MIMO 트랜시버들은 (다중 경로 확산에 의해 야기된 심벌 간 간섭 및 채널 간 간섭 또는 혼선(cross-talk)과 같은) 성능 저하들을 겪기 쉽다. 보다 구체적으로, 많은 MIMO 무선 디바이스들의 송신 체인들 간의 분리는 대략 20㏈m이기 때문에, 2개의 트랜시버 체인들을 갖는 무선 디바이스에서 제 1 트랜시버 체인의 교정 중에는, 제 2 트랜시버 체인에 의해 전송된 신호들이 제 1 트랜시버 체인에 의해 의도치 않게 수신되고 제 1 트랜시버 체인의 교정과 연관된 루프백 신호에 간섭하는 것을 막도록 제 2 트랜시버 체인이 일반적으로 디세이블된다(예를 들어, 신호들의 전송이 불가능하게 된다). 실제로, 많은 MIMO 무선 디바이스들은 교정 프로세스가 완료될 때까지 모든 송신 체인들에 대해 라운드 로빈 방식으로 송신 동작들을 단일 체인(즉, 교정 체인)으로 축소함으로써, 디바이스를 사실상 단일 체인 송신으로 축소하는데, 이는 송신 데이터 레이트들을 바람직하지 않게 저하시킨다.
따라서 MIMO 무선 트랜시버들의 경우, 다른 트랜시버 체인이 동시에 데이터를 전송하고 있는 동안 하나의 트랜시버 체인이 교정되게 하는 것이 바람직할 것이다.
본 명세서의 개시는 첨부 도면들의 그림들로 한정이 아닌 예로서 도시되며, 첨부 도면들에서 동일한 참조 부호들은 유사한 엘리먼트들을 나타낸다.
도 1은 본 실시예들이 내부에 구현될 수 있는 무선 통신 디바이스들을 보여준다.
도 2는 본 실시예들에 따라 구성된 2-체인 무선 통신 디바이스의 기능 블록도이다.
도 3은 도 2의 무선 통신 디바이스의 한 실시예의 보다 상세한 블록도이다.
도 4는 전력 증폭기의 비선형 전달 함수를 나타내는 그래프이다.
도 5는 일부 실시예들에 따른 다중 안테나 무선 통신 디바이스의 블록도이다.
도 6은 일부 실시예들에 따른 예시적인 교정 동작을 나타내는 흐름도이다.
무선 통신 디바이스에서 하나의 트랜시버 체인이 무선 신호들을 전송하고 있는 동안 다른 트랜시버 체인을 교정하기 위한 방법 및 장치가 개시된다. 다음 설명에서, 본 개시의 철저한 이해를 제공하도록 특정 컴포넌트들, 회로들, 소프트웨어 및 프로세스들의 예들과 같은 다수의 특정 세부사항들이 제시된다. 또한, 다음 기재에서 그리고 설명을 위해, 본 실시예들의 철저한 이해를 제공하도록 특정 명명법이 제시된다. 그러나 이러한 특정 세부사항들은 본 실시예들을 실시하는데 요구되지 않을 수도 있다는 점이 해당 기술분야에서 통상의 지식을 가진 자에게 명백할 것이다. 다른 경우들에, 본 개시를 모호하게 하는 것을 피하도록, 잘 알려진 회로들 및 디바이스들은 블록도 형태로 도시된다. 본 명세서에서 사용되는 "연결된"이라는 용어는 하나 또는 그보다 많은 개재 컴포넌트들 또는 회로들을 통해 접속되거나 직접 접속되는 것을 의미한다. 본 명세서에서 설명되는 다양한 버스들을 통해 제공되는 신호들 중 임의의 신호는 다른 신호들과 시간 다중화되어 하나 또는 그보다 많은 공통 버스들을 통해 제공될 수 있다. 추가로, 회로 엘리먼트들이나 소프트웨어 블록들 간의 상호 접속이 버스들로서 또는 단일 신호 라인들로서 도시될 수 있다. 버스들 각각은 대안으로 단일 신호 라인일 수도 있고, 단일 신호 라인들 각각은 대안으로 버스들일 수 있으며, 단일 라인 또는 버스는 컴포넌트들 간의 통신을 위한 무수한 물리적 또는 논리적 메커니즘들 중 임의의 하나 또는 그보다 많은 메커니즘을 나타낼 수도 있다.
코어 로직, 제 1 트랜시버 체인 및 제 2 트랜시버 체인, 제 1 안테나 및 제 2 안테나, 그리고 간섭 프로세서를 포함하는 예시적인 무선 통신 디바이스가 개시된다. 코어 로직은 제 1 트랜시버 체인과 제 2 트랜시버 체인 모두에 연결되며, 차례로 제 1 트랜시버 체인과 제 2 트랜시버 체인은 제 1 안테나와 제 2 안테나에 각각 연결된다. 간섭 프로세서는 제 1 트랜시버 체인과 제 2 트랜시버 체인 사이에 연결되며, 코어 로직 또는 다른 적당한 회로에 의해 생성될 수 있는 인에이블 신호에 응답한다. 제 2 트랜시버 체인이 제 2 안테나를 통해 제 2 신호들을 전송하고 있는 동안 제 1 트랜시버 체인에서 생성된 제 1 신호들을 사용하여 제 1 트랜시버 체인 내의 회로를 교정하기 위해, 간섭 프로세서를 활성화하도록 인에이블 신호가 어서트(assert)된다. 이에 응답하여, 간섭 프로세서는 제 2 트랜시버 체인의 송신 회로를 제 1 트랜시버 체인의 수신 회로에 접속하여, 제 1 안테나에 의해 바람직하지 않게 포착되며 제 1 트랜시버 체인 내의 수신 회로에 제공되는, 제 2 신호의 원치 않는 컴포넌트들을 보상하는데 사용될 수 있는 간섭 피드백 경로를 형성한다.
보다 구체적으로, 코어 로직은 제 1 안테나에 의한 송신을 위해 제 1 체인에 제공되는 제 1 디지털 신호들을 생성하고, 제 2 안테나에 의한 송신을 위해 제 2 체인에 제공되는 제 2 디지털 신호들을 동시에 생성한다. 제 1 신호들은 연관된 제 1 디지털-아날로그 변환기(DAC: digital-to-analog converter)에 의해 아날로그 신호들로 변환되고, 연관된 제 1 전력 증폭기에 의해 증폭되며, 다음에 제 1 안테나에 의해 선택적으로 전송된다. 제 1 전력 증폭기의 출력 신호는 감쇠된 다음, 루프백 교정 신호로서 제 1 체인의 수신 회로에 제공된다. 제 2 신호들은 연관된 제 2 DAC에 의해 아날로그 신호들로 변환되고, 연관된 제 2 전력 증폭기에 의해 증폭되며, 다음에 제 2 안테나에 의해 선택적으로 전송된다. 제 2 전력 증폭기로부터 출력된 신호는 간섭 프로세서에 제공되어, 루프백 교정 신호와 이득이 매치되는 보상 신호를 생성하도록 간섭 프로세서에 의해 처리된다. 그 다음, 제 2 안테나에 의해 전송되어 제 1 안테나에 의해 수신되는 신호들의 원치 않는 컴포넌트들을 루프백 교정 신호로부터 제거하도록 루프백 교정 신호로부터 보상 신호가 차감된다. 이런 식으로, 제 2 체인으로부터 전송되어 제 1 체인에 의해 바람직하지 않게 수신되는 신호들과 연관된 간섭이 루프백 교정 신호로부터 제거된다. 이후, 루프백 교정 신호는 제 2 체인이 정상적인 방식으로 데이터를 전송하고 있는 동안 제 1 체인의 전력 증폭기를 정확히 교정하는데 사용될 수 있다. 일부 실시예들의 경우, 교정 신호는 예를 들어, 잘 알려진 사전 왜곡 기술들을 사용하여 전력 증폭기의 비선형 특성들을 보상하는 사전 왜곡 신호로서 사용될 수 있다. 다른 실시예들의 경우, 교정 신호는 전력 증폭기의 전력 레벨 및/또는 이득 설정들을 조정하는데 사용될 수 있고, 그리고/또는 제 1 DAC의 다양한 설정들을 조정하는데 사용될 수 있다.
따라서 본 실시예들에 따르면, 하나의 트랜시버 체인이 정상적인 방식으로 데이터를 전송하고 있는 동안 다른 트랜시버 체인의 전력 증폭기를 동적으로 교정하는 능력은 무선 통신 디바이스의 데이터 스루풋을 감소시키지 않으면서 교정 동작들이 수행되게 한다. 이런 식으로, 두 트랜시버 체인들 모두의 전력 증폭기들이 성능에 악영향을 주지 않으면서 이들의 선형 동작 영역들에 유지될 수 있다.
도 1은 일부 실시예들에 따라 다수의 트랜시버 체인들을 사용하여 와이파이(Wi-Fi) 신호들, 블루투스 신호들, 셀룰러 신호들, 및/또는 다른 무선 주파수(RF: radio frequency) 신호들을 동시에 전송하도록 구성될 수 있는 랩톱 및 셀룰러폰과 같은 무선 통신 디바이스들(100)을 보여준다. 단순하게 하기 위해 도시되진 않았지만, 무선 디바이스들(100)은 태블릿 컴퓨터, 데스크탑 컴퓨터, PDA들 등과 같은 다른 디바이스들을 포함할 수 있다. 일부 실시예들의 경우, 무선 디바이스들(100)은 와이파이 신호들을 사용하여 인터넷, LAN, WLAN 및/또는 VPN과 데이터를 교환할 수 있고, 블루투스 신호들을 사용하여 헤드셋들, 프린터들, 스캐너들 등과 같은 로컬 BT 인에이블 디바이스들과 데이터를 교환할 수 있다.
도 2는 일부 실시예들에 따라 구성된 무선 디바이스(200)의 고 레벨 기능 블록도이다. 무선 디바이스(200)는 코어 로직(210), 제 1 트랜시버 체인(220A), 제 2 트랜시버 체인(220B), 제 1 안테나(231), 제 2 안테나(232) 및 간섭 프로세서(240)를 포함하는 것으로 도시된다. 프로세서들 및 메모리 엘리먼트들과 같은 잘 알려진 엘리먼트들을 포함할 수 있는 코어 로직(210)은 무선 디바이스(200)에 대한 일반적인 데이터 생성 및 처리 기능들을 수행한다. 제 1 트랜시버 체인(220A)은 코어 로직(210)과 제 1 안테나(231) 사이에 연결되며, 제 1 안테나(231)를 통해 제 1 신호들(S1)의 송신 및 수신을 제어하도록 구성된다. 제 2 트랜시버 체인(220B)은 코어 로직(210)과 제 2 안테나(232) 사이에 연결되며, 제 2 안테나(232)를 통해 제 2 신호들(S2)의 송신 및 수신을 제어하도록 구성된다. 간섭 프로세서(240)는 제 1 트랜시버 체인(220A)과 제 2 트랜시버 체인(220B) 사이에 연결되며, 뒤에 더 상세히 설명되는 바와 같이, 다른 트랜시버 체인이 데이터를 전송하고 있는 동안 하나의 트랜시버 체인의 교정 동작들의 정확도를 향상시키는데 사용될 수 있다.
보다 구체적으로, 제 1 트랜시버 체인(220A)은 코어 로직(210)에 의해 생성된 신호들을 처리한 다음에 제 1 안테나(231)를 통해 (단순하게 하기 위해 도시되지 않은) 다른 무선 디바이스나 액세스 포인트에 전송하도록 구성되며, 또한 제 1 안테나(231)로부터 수신된 신호들을 처리한 다음에 코어 로직(210)으로 전달하도록 구성된다. 마찬가지로, 제 2 트랜시버 체인(220B)은 코어 로직(210)에 의해 생성된 신호들을 처리한 다음에 제 2 안테나(232)를 통해 (단순하게 하기 위해 도시되지 않은) 다른 무선 디바이스나 액세스 포인트에 전송하도록 구성되며, 또한 제 2 안테나(232)로부터 수신된 신호들을 처리한 다음에 코어 로직(210)으로 전달하도록 구성된다. 본 명세서에서 설명되는 예시적인 실시예들의 경우, 제 1 트랜시버 체인(220A) 및 제 2 트랜시버 체인(220B)은 반이중(half-duplex) 트랜시버들로서 동작함으로써, 각각의 체인 내의 송신 및 수신 회로가 공통 안테나를 공유하게 하도록 구성된다. 다른 실시예들의 경우, 각각의 체인 내의 (단순하게 하기 위해 도 2에 도시되지 않은) 송신 및 수신 회로는 전이중(full-duplex) 동작을 가능하게 하도록 각자의 전용 안테나에 접속될 수 있다. 또한, 단 2개의 트랜시버 체인들만을 포함하는 것으로 도시되어 있지만, 다른 실시예들의 경우, 무선 통신 디바이스(200)는 더 많은 수의 트랜시버 체인들 및/또는 안테나들을 포함할 수 있다.
도 3은 도 2의 무선 디바이스(200)의 한 실시예인 무선 디바이스(300)의 보다 상세한 블록도이다. 무선 디바이스(300)는 코어 로직(210), (본 명세서에서는 또한 체인 A로도 지칭되는) 제 1 트랜시버 체인(220A), (본 명세서에서는 또한 체인 B로도 지칭되는) 제 2 트랜시버 체인(220B), 안테나들(231-232) 및 간섭 프로세서(240)를 포함하는 것으로 도시된다. 코어 로직(210)과 제 1 안테나(231) 사이에 연결된 제 1 트랜시버 체인(220A)은 디지털-아날로그 변환기(DAC)(320A), 전력 증폭기(PA)(330A), 감쇠 회로(340A), 저잡음 증폭기(LNA: low noise amplifier)(350A), 합산 노드(360A) 및 아날로그-디지털 변환기(ADC: analog-to-digital converter)(370A)를 포함하는 것으로 도시된다. DAC(320A)와 전력 증폭기(330A)는 제 1 트랜시버 체인(220A)에 대한 송신 회로를 형성하고, LNA(350A)와 ADC(370A)는 제 1 트랜시버 체인(220A)에 대한 수신 회로를 형성한다는 점에 주목한다. 또한, 단순하게 하기 위해 도 3에는 도시되지 않았지만, 제 1 체인(220A)의 송신 회로는 예를 들어, 믹서들, 필터들 및 전력 제어 테이블들을 비롯하여 다른 잘 알려진 엘리먼트들을 포함할 수 있고, 제 1 체인(220A)의 수신 회로는 예를 들어, 믹서들, 필터들 및 다운샘플러들을 비롯하여 다른 잘 알려진 엘리먼트들을 포함할 수 있다.
코어 로직(210)과 제 2 안테나(232) 사이에 연결된 제 2 트랜시버 체인(220B)은 DAC(320B), 전력 증폭기(PA)(330B), 감쇠 회로(340B), LNA(350B), 합산 노드(360B) 및 ADC(370B)를 포함하는 것으로 도시된다. DAC(320B)와 전력 증폭기(330B)는 제 2 트랜시버 체인(220B)에 대한 송신 회로를 형성하고, LNA(350B)와 ADC(370B)는 제 2 트랜시버 체인(220B)에 대한 수신 회로를 형성한다는 점에 주목한다. 또한, 단순하게 하기 위해 도 3에는 도시되지 않았지만, 제 2 체인(220B)의 송신 회로는 예를 들어, 믹서들, 필터들 및 전력 제어 테이블들을 비롯하여 다른 잘 알려진 엘리먼트들을 포함할 수 있고, 제 2 체인(220B)의 수신 회로는 예를 들어, 믹서들, 필터들 및 다운샘플러들을 비롯하여 다른 잘 알려진 엘리먼트들을 포함할 수 있다.
간섭 프로세서(240)는 제 2 체인(220B)의 전력 증폭기(330B)의 출력에 연결된 데이터 입력, 제 1 체인(220A)의 합산 회로(360A)의 음의 입력에 연결된 데이터 출력, 및 인에이블 신호(EN)를 수신하기 위한 제어 입력을 포함하는 것으로 도시된다. 일부 실시예들의 경우, 인에이블 신호(EN)는 코어 로직(210)에 의해 생성된다. 다른 실시예들의 경우, 인에이블 신호(EN)는 다른 적당한 회로, 센서, 및/또는 디바이스에 의해 생성될 수 있다. 인에이블되면, 간섭 프로세서(240)는, 뒤에 더 상세히 설명되는 바와 같이, 제 1 체인의 교정 동안 제 2 체인에 의해 전송되어 제 1 체인에 의해 간섭으로서 수신되는 신호들을 보상하는데 사용될 수 있다. 간섭 프로세서(240)는 아날로그 회로들 또는 로직 게이트들과 같은 하드웨어 컴포넌트들을 사용하여 구현될 수 있으며, 또한 소프트웨어 모듈들 및/또는 컴퓨터 프로그램들을 포함할 수 있다.
정상적인 송신 및 수신 동작들 동안, 간섭 프로세서(240)를 디세이블하기 위해 인에이블 신호(EN)가 (예를 들어, 로직 로우(low))로 디어서트(de-assert)된다. 이에 응답하여, 간섭 프로세서(240)는 제 1 합산 회로(360A)에 아무런 신호들도 제공하지 않음으로써, 제 1 체인(220A)과 제 2 체인(220B) 모두 정상적인 방식으로 동작하게 한다. 보다 구체적으로, 정상적인 송신 동작들 동안, 코어 로직(210)은 제 1 트랜시버 체인(220A) 및 제 2 트랜시버 체인(220B)을 사용하여 각각 제 1 안테나(231) 및 제 2 안테나(232)를 통해 동시에 다른 무선 디바이스나 액세스 포인트로 전송하기 위한 디지털 데이터 신호들을 생성할 수 있다. 예를 들어, 두 송신 체인들을 동시에 이용하기 위해, 코어 로직(210) 내에서 생성된 디지털 신호들은 다양한 기술들(예를 들어, 공간 다이버시티, 빔 형성 등)을 사용하여 2개의 개별 신호들(S1, S2)로 분할된 다음, 각각의 체인들(220A, 220B)에 제공될 수 있다. 그 다음, 코어 로직(210)으로부터 디지털 신호들을 수신하는 각각의 체인(220)마다, DAC(320)에 의해 디지털 신호들이 아날로그 신호들로 변환된 다음, 연관된 안테나들(231, 232)에 의한 송신을 위해 잘 알려진 방식으로 전력 증폭기(330)에 의해 증폭된다.
2개의 체인들(220A, 220B)이 이들 각각의 안테나들(231, 232)을 사용하여 동일한 데이터의 서로 다른 패킷들 또는 부분들을 동시에 전송할 때, 안테나들(231, 232) 간의 공간 차를 보상하기 위해 2개의 신호들(S1, S2)이 서로 다르게 처리될 수 있다는 점에 주목한다.
정상 수신 동작들 동안, 제 1 안테나(231)에 의해 수신된 신호들은 제 1 체인(220A)에 제공되고, 제 2 안테나(232)에 의해 수신된 신호들은 제 2 체인(220B)에 제공된다. 각자의 연관된 안테나로부터 신호들을 수신하는 각각의 체인마다, 각자의 LNA(350)는 수신된 신호들을 증폭하고 결과적으로 증폭된 아날로그 신호들을 합산 노드(360)의 양의 입력에 제공하며, 합산 노드(360)는 증폭된 아날로그 신호들을 ADC(370)로 전달한다. 이에 응답하여, ADC(370)는 아날로그 신호들을 코어 로직(210)에 의한 후속 처리를 위해 디지털 신호들로 변환한다.
전력 증폭기들(330A, 330B)과 같은 전력 증폭기들은 일반적으로, 입력 전압 변동들에 응답하여 비선형 특성들을 나타낸다. 보다 구체적으로, 전력 증폭기들(330A, 330B)은 각각 일반적으로, 열 및 프로세스 변화들에 대한 이들의 민감도로 인해 넓은 범위의 전력 레벨 변화들을 나타내기 때문에, 전력 증폭기들(330A, 330B)은 뒤에 더 상세히 설명되는 바와 같이, 이러한 바람직하지 않은 전력 레벨 변화들을 보상하도록 본 실시예에 따라 동적으로 교정될 수 있다. 예를 들어, 도 4는 도 3의 전력 증폭기들(330A, 330B)과 같은 전력 증폭기의 비선형 전달 함수를 나타내는 그래프이다. 실선은 전력 증폭기(PA)의 입력 전압(VIN)과 출력 전압(VOUT) 간의 관계가 일정한 기울기를 갖는(예를 들어, 선형인) 선형 동작 영역을 나타내고, 파선(501)은 전력 증폭기(PA)의 비선형 영역을 나타낸다. 파선(501)으로 나타낸 비선형 영역은 입력 전압이 특정한 양을 넘어 증가할 때 출력 전압을 안정화(level off)시키는 전력 증폭기들의 전달 함수들에서 3차 고조파 항들로부터 발생한다.
다시 도 3을 참조하면, 일부 실시예들의 경우, 합산 회로(360)에 의해 제공되는 교정 신호는 연관된 전력 증폭기(330)의 비선형 특성들을 보상하는 사전 왜곡 신호로서 사용될 수 있다. 예를 들어, 전력 증폭기(330A)가 비선형 영역에서 동작하고 있다면, 그 출력 신호(OUT_A)의 비선형 특성들이 측정된 다음, 전력 증폭기(330A)의 결과적인 출력 신호가 선형이 되도록 전력 증폭기(330A)에 대한 입력 신호를 사전 왜곡함으로써 비선형성을 사전 보상하는데 사용될 수 있다.
제 2 체인(220B)이 안테나(232)로부터 출력 신호들(Tx_B)을 전송하고 있는 동안 수행되는 제 1 체인(220A)의 예시적인 교정 동작이 아래 설명된다. 본 실시예들은 제 1 체인(220A)이 안테나(231)로부터 출력 신호들(Tx_A)을 전송하고 있는 동안 제 2 체인(220B)을 교정하기 위해 동등하게 적용 가능하다고 이해되어야 한다. 제 1 체인(220A)의 교정 동작들을 시작하기 위해, 간섭 프로세서(240)를 인에이블하도록 인에이블 신호(EN)가 (예를 들어, 로직 하이(high)로) 어서트된다. 이에 응답하여, 간섭 프로세서(240)가 가동하게 되어 제 2 체인(220B)의 전력 증폭기(330B)의 출력을 제 1 체인(220A)의 합산 노드(360A)의 음의 입력에 접속하고, 제 1 안테나(231)에 의해 바람직하지 않게 수신되는 Tx_B와 연관된 임의의 간섭 신호들을 보상함으로써 제 1 체인(220A)의 교정 동안 제 2 체인(220B)이 제 2 안테나(232)로부터 신호들(Tx_B)로서 데이터의 전송을 계속하게 한다.
보다 구체적으로, 제 1 체인 A의 교정 동안, 코어 로직(210)은 제 1 체인 A에 제공되는 제 1 디지털 신호들(S1)을 생성하고, 제 2 안테나(232)를 통한 Tx_B로서의 송신을 위해 제 2 체인 B에 제공되는 제 2 디지털 신호들(S2)을 동시에 생성한다. 제 1 디지털 신호들(S1)은 뒤에 설명되는 바와 같이, 제 1 체인(220A)의 전력 증폭기(330A)를 교정하는데 사용되고, 일부 실시예들의 경우, 제 1 디지털 신호들(S1)은 제 1 체인(220A)으로부터 제 1 안테나(231)를 통해 Tx_A로서 전송되는 실제 데이터일 수 있다. 제 1 신호들(S1)은 DAC(320A)에 의해 아날로그 신호들로 변환된 다음, 전력 증폭기(330A)에 의해 증폭된다. 전력 증폭기(330A)의 출력 신호(OUT_A)는 감쇠 회로(340A)에 의해 감쇠되고 루프백 교정 신호(LB_A)로서 LNA(350A)의 입력에 제공된다. 감쇠 회로(340A)는 전력 증폭기(330A)에 의해 증폭된 신호들을 감쇠시켜 LNA(350A)의 손상을 막고, LNA(350A)는 제 1 안테나(231)에 의해 제공된 증폭되지 않은 신호들을 정상적으로 수신한다. 이런 식으로, 감쇠 회로(340A)는 신호(OUT_A)를 감쇠시켜 이 신호(OUT_A)가 LNA(350A)의 선형 동작 범위 내에 있게 한다. LNA(350A)는 정상적인 방식으로 루프백 교정 신호(LB_A)를 증폭하고, 결과적인 신호(LB_A')를 합산 노드(360A)의 양의 입력에 제공한다.
제 2 신호들(S2)은 DAC(320B)에 의해 아날로그 신호들로 변환되고, 전력 증폭기(330B)에 의해 증폭된 다음, 제 2 안테나(232)에 의해 Tx_B로서 전송된다. 제 1 안테나(231)는 제 1 체인(220A)의 교정 동안 그대로 가동하기 때문에, 제 1 안테나(231)는 전송된 제 2 신호(Tx_B)를 LNA(350A)의 입력에 제공되는 루프백 신호(LB_A)에 포함된(예를 들어, 그 위에 겹쳐진) 간섭 신호로서 바람직하지 않게 포착할 수 있다. 따라서 제 2 체인(220B)이 동시에 신호들(Tx_B)을 전송하고 있는 동안의 제 1 체인(220A)의 교정 동작들을 위해, 루프백 교정 신호(LB_A)는 전력 증폭기(330A)에 의해 생성된 신호(OUT_A)의 컴포넌트들 및 제 2 체인(220B)에 의해 전송된 신호(Tx_B)의 원치 않는 컴포넌트들을 포함한다.
제 2 체인(220B)의 전력 증폭기(330B)의 출력 신호(OUT_B)는 간섭 프로세서(240)에 제공되어, 합산 회로(360A)의 음의 입력에 제공되며 제 1 체인(220A)의 제 1 안테나(231)에 의한 신호(Tx_B)의 원치 않는 수신을 보상하는데 사용되는 보상 신호(CMP_B)를 생성하도록 간섭 프로세서(240)에 의해 처리된다. 보다 구체적으로, 간섭 프로세서(240)는 결과적인 보상 신호(CMP_B)가 합산 회로(360A)에 의해 루프백 교정 신호(LB_A')로부터 차감될 때, 바람직하지 않게 수신된 신호(Tx_B)가 제거되도록 이득 정합을 수행하고 그리고/또는 신호(OUT_B)를 지연시키는 회로를 포함한다. 이런 식으로, 합산 회로(360A)는 전력 증폭기(330A)에 의해 생성된 신호(OUT_A)의 컴포넌트들을 포함하지만 제 1 안테나(231)에 의해 수신된 신호(Tx_B)의 원치 않는 컴포넌트들은 포함하지 않는 교정 신호(CAL_A)를 생성한다.
다른 실시예들의 경우, 합산 회로(360A)의 음의 입력이 양의 입력으로 대체될 수 있고, 간섭 프로세서(240)는 피드백 신호(OUT_B)를 180도 위상 시프트하여 제 1 체인(220A)의 수신 경로로부터의 신호(Tx_B)의 원치 않는 컴포넌트들을 제거하도록 구성될 수 있다. 또 다른 실시예들의 경우, 합산 회로(360A)의 출력 단자가 LNA(350A)의 입력에 접속되고 합산 회로(360A)의 양의 입력이 감쇠 회로(340A)의 출력 및 제 1 안테나(231)에 접속되도록 합산 회로(360A)가 LNA(350A) 앞에 배치될 수 있다.
이후, 교정 신호(CAL_A)는 ADC(370A)에 의해 디지털 신호로 변환된 다음, 코어 로직(210)에 의해, 제 2 체인(220B)이 정상적인 방식으로 데이터를 전송하고 있는 동안 제 1 체인(220A)의 전력 증폭기(330A)를 정확히 교정하는데 사용될 수 있다. 일부 실시예들의 경우, 교정 신호(CAL_A)는 예를 들어, 잘 알려진 사전 왜곡 기술들을 사용하여 전력 증폭기(330A)의 비선형 특성들을 보상하는 사전 왜곡 신호로서 사용될 수 있다. 이러한 사전 왜곡 기술들은 코어 로직(210)에서 수행될 수 있고, 혹은 대안으로 (단순하게 하기 위해 도시되지 않은) 전용 사전 왜곡 블록에서 수행될 수 있다. 다른 실시예들의 경우, 교정 신호(CAL_A)는 전력 증폭기(330A)의 전력 레벨 및/또는 이득 설정들을 조정하는데 사용될 수 있고, 그리고/또는 DAC(320A)의 다양한 설정들을 조정하는데 사용될 수 있다. 또 다른 실시예들의 경우, 교정 신호(CAL_A)는 트랜시버 체인들 각각에 대한 송신 전력 제어 방식을 개선하도록 에러 벡터 크기(EVM: error vector magnitude) 측정들 및/또는 스펙트럼 마스크 측정들에 사용될 수 있다.
따라서 본 실시예들에 따르면, 하나의 트랜시버 체인이 정상적인 방식으로 데이터를 전송하고 있는 동안 다른 트랜시버 체인에서 전력 증폭기를 동적으로 교정하는 능력은 무선 통신 디바이스(300)의 데이터 스루풋을 감소시키지 않으면서 제 1 전력 증폭기의 교정이 정확히 수행되게 한다. 실제로, 루프백 교정 신호(LB_A)로부터의 Tx_B의 원치 않는 컴포넌트들의 적극적인 제거는 교정하는 체인의 전력 증폭기(330A)를 정확하고 동적으로 교정하도록 교정 신호(LB_A)에 대해 용인되는 신호대 잡음비(SNR: signal-to-noise ratio)를 유지한다. 이런 식으로, 두 트랜시버 체인들 모두의 전력 증폭기들은 성능에 악영향을 주지 않으면서 이들의 선형 동작 영역들에 유지될 수 있다.
일부 실시예들의 경우, 간섭 프로세서(240)는 진폭 및 위상을 갖는 복소수(H)를 조작하는 간섭 조정을 수행하도록 구성될 수 있으며, 여기서 복소수(H)는 간섭을 일으키는 결합 채널을 특성화한다. 조작은 간섭을 원하는 신호에 결합하는 채널이 평탄 응답을 가질 때(예를 들어, 다중 경로가 없을 때) 사용될 수 있다. 다른 실시예의 경우, 간섭 조정은 각각의 부대역폭마다 하나씩인 다수의 복소수들을 조작하는 것을 포함할 수 있다. 이러한 조작은 결합 채널이 주파수 선택적일 때(예를 들어, 부대역 내에 평탄 응답이 있지만, 부대역들 간에 다중 경로 조정들이 존재할 때) 사용될 수 있다.
한 실시예의 경우, 간섭 프로세서(240)는 "Active Cancellation of Interference in a Wireless Communication System"이라는 명칭으로 2010년 4월 28일자 제출된 공동 소유의 공동 계류중인 미국 특허출원 제12/769,536호에 개시된 타입의 적극적인 간섭 제거(AIC: active interference cancellation) 회로를 이용할 수 있으며, 이 특허출원 전체가 인용에 의해 본 명세서에 포함된다. 예를 들어, 위에 인용된 특허출원에서 설명된 기술들을 사용하면, 도 3의 제 2 안테나(232)로부터 전송된 신호들은 제 1 안테나(231)에서 간섭으로서 수신된다. AIC 회로는 제 2 체인(220B)의 송신 프론트엔드에서 간섭의 간섭 기준을 조작하여 제 1 안테나(231)에서 관찰되는 간섭의 근사치를 구하는 간섭 조정을 제공할 수 있다. 간섭 조정의 튜닝 후, 간섭이 제거될 수 있다. 이러한 AIC 회로를 사용하여 루프백 교정 신호에 존재하는 간섭 컴포넌트들을 제거하는 것은 제 2 체인(220B) 또한 실제 데이터 패킷들을 전송하고 있는 동안 (예를 들어, 알려진 또는 미리 결정된 신호 파형을 갖는 "더미" 데이터 패킷들을 사용하는 것과는 달리) 실제 데이터 패킷들을 사용하여 제 1 체인(220A)을 정확히 교정하는 능력을 개선한다.
도 5는 도 1의 무선 통신 디바이스(100)의 다른 실시예인 다중 안테나 무선 통신 디바이스(500)의 기능 블록도이다. 디바이스(500)가 복수(n개)의 수신 체인들을 갖는 수신기 회로(510) 및 복수(n개)의 송신 체인들을 갖는 송신기 회로(520)를 포함한다는 점을 제외하면, 디바이스(500)는 도 3의 디바이스(300)와 유사하다. 각각의 수신 체인은 안테나들(512) 중 대응하는 안테나와 코어 로직(530) 사이에 수신 ADC(518)를 통해 연결된 LNA(515) 및 동상 직각위상(IQ: in-phase quadrature) 복조기(516)를 포함한다. 예를 들어, 제 1 수신 체인은 수신 ADC(518)와 제 1 안테나(512(1)) 사이에 연결된 LNA(515(1)) 및 IQ 복조기(516(1))를 포함한다. 단순하게 하기 위해 도 5에 도시되진 않았지만, 각각의 수신 체인은 가변 이득 증폭기(VGA: variable gain amplifier)들, 필터들 및 다른 프론트엔드 수신 회로와 같은 다른 컴포넌트들을 포함할 수 있다. IQ 복조기들(516)은 아날로그 또는 디지털 변조(예를 들어, 가우시안 주파수 시프트 키잉(GFSK: Gaussian frequency-shift keying), 위상 시프트 키잉(PSK: phase-shift keying), 직교 진폭 변조(QAM: quadrature amplitude modulation) 등)와 같은 다양한 변조 방식들로 신호들을 복조할 수 있다. 수신 ADC(518)는 개별 IQ 복조기들(516)의 I 및 Q 채널들의 아날로그 동상(I) 신호(IR) 및 직각위상(Q) 신호(QR)를 수신하고, 코어 로직(530)에 의한 처리를 위해 이 신호들을 디지털 신호들로 변환한다.
송신기(520)는 다중 체인 송신기이며, 여기서 각각의 송신 체인은 안테나들(522) 중 대응하는 안테나와 코어 로직(530) 사이에 송신 DAC(528)를 통해 연결된 전력 증폭기(525) 및 IQ 변조기(526)를 포함한다. 예를 들어, 제 1 송신 체인은 제 1 안테나(522(1))와 코어 로직(530) 사이에 송신 DAC(528)를 통해 연결된 전력 증폭기(525(1)) 및 IQ 변조기(526(1))를 포함한다. (간결하게 하기 위해 도 5에 도시되지 않은) 송신기 기저대역 부분은 각각의 송신기 체인의 I 및 Q 채널들에 대한 디지털 신호들을 DAC(528)에 제공하며, 차례로 DAC(528)는 디지털 신호들을 아날로그 I 및 Q 신호들로 변환한다. 각각의 송신 체인의 아날로그 I 및 Q 신호들(즉, IT 및 QT 신호들)은 코어 로직(530)으로부터 각각의 IQ 변조기(526)에 제공되며, 차례로 각각의 IQ 변조기(526)는 I 및 Q 신호들을 각각의 송신기 체인의 전력 증폭기(525)에 제공되는 RF 신호로 믹싱한다. 전력 증폭기(525)는 하나 또는 그보다 많은 VGA들이 선행하는 단일 전력 증폭기 또는 다단계 전력 증폭기일 수 있다.
디바이스(500)의 기능적 동작을 예시하기 위해 디바이스(500)는 도 5에서 개별 수신 및 송신 안테나들(512, 522)을 갖는 것으로 도시된다는 점을 주목한다. 많은 실제 실시예들에서, 안테나들(512, 522)은 동일한 안테나이다. 예를 들어, 실제 실시예들에서, 제 1 송신 체인과 제 1 수신 체인은 제 1 공통 안테나를 공유하고, 제 2 송신 체인과 제 2 수신 체인은 제 2 공통 안테나를 공유하는 식이다.
도 4에 관해 앞서 설명한 바와 같이, 많은 전력 증폭기들은 (IQ 변조기들(526)에 의해 도입된 IQ 오정합에 의해 악화될 수 있는) 비선형 특성들을 나타낸다. 이러한 비선형 특성들은 예를 들어, 도 3에 관해 앞서 설명한 바와 같이 사전 왜곡 교정 동작들을 사용하여 해결될 수 있다. 사전 왜곡 교정 동작들은 IQ 오정합 교정 모듈(532) 및 사전 왜곡 모듈(535)을 사용하여 수행될 수 있다. 도 5의 예시적인 실시예에 도시된 바와 같이, IQ 오정합 교정 모듈(532) 및 사전 왜곡 모듈(535)은 코어 로직(530) 내에 포함될 수 있으며, 코어 로직(530)은 도 2의 코어 로직(210)의 일 실시예이다.
교정 동작들 동안, 간섭 프로세서(240)는 전력 증폭기(525(1)-525(n))의 출력으로부터 입력 신호들을 수신하고 대응하는 보상 신호들을 LNA들(515(1)-515(n))의 입력들에서 (단순하게 하기 위해 도시되지 않은) 합산 회로들에 제공한다. 보다 구체적으로, 교정되고 있는 각각의 송신 체인에 대해, 간섭 프로세서(240)는 다른 모든 송신 체인들에서 전력 증폭기(525)의 출력들로부터 입력 신호들을 수신하고, 교정되고 있는 송신 체인의 루프백 교정 신호로부터 원치 않는 간섭을 제거하는데 사용될 수 있는 보상 신호를 생성한다. 예를 들어, 오정합 교정 모듈(532)은 수신 ADC(518)로부터 수신된 신호들을 분석하여, 교정하는 송신기 체인에 대응하는 진폭 및 위상 에러들의 값들을 결정하고, 이러한 에러들을 추가 처리를 위해 사전 왜곡 모듈(535)에 제공한다. 사전 왜곡 모듈(535)은 대응하는 송신기 체인의 사전 왜곡 교정을 위해 진폭 및 위상 에러들의 수신된 값들을 사용한다. 예를 들어, 사전 왜곡 모듈(535)은 디지털 사전 왜곡 제어 신호를 디지털-아날로그 변환을 위해 송신 DAC(528)에 제공한다. 변환된 아날로그 사전 왜곡 제어 신호는 각각의 IQ 변조기(526) 및 전력 증폭기(525)에 의해 각각의 전력 증폭기(525)의 사전 왜곡 교정을 수행하는데 사용된다.
일부 실시예들의 경우, 간섭 프로세서(240)는 위에 인용된 미국 특허출원 제12/769,536호에 개시된 타입의 다수의 AIC 회로들을 포함함으로써, 다른 모든 송신 체인들이 활성 상태인(즉, 신호들을 전송하고 있는) 동안 선택된 송신 체인에 대해 사전 왜곡 교정 동작들이 수행되게 할 수 있다. 다른 실시예의 경우, 단일 구성 가능한 AIC 회로가 사용될 수 있으며, 이는 회로 오버헤드를 감소시키지만, 한번에 단 하나의 송신 체인만을 교정할 수 있다.
도 6은 무선 통신 디바이스의 하나의 트랜시버 체인이 활성 상태인 동안 디바이스의 다른 트랜시버 체인이 교정되게 하는 일부 실시예들에 따른 예시적인 교정 동작을 나타내는 예시적인 흐름도이다. 도 3을 또한 참조하면, 교정 동작 동안, 디바이스(300)의 제 1 트랜시버 체인(220A)은 제 1 안테나(231)를 사용하여 제 1 출력 신호를 전송하면서(602), 동시에 디바이스(300)의 제 2 트랜시버 체인(220B)은 제 2 안테나(232)를 사용하여 제 2 출력 신호를 전송한다(604). 그 다음, 제 1 출력 신호가 루프백 교정 신호로서 제 1 트랜시버 체인의 송신 회로로부터 제 1 트랜시버 체인의 수신 회로로 라우팅된다(606). 동시에, 간섭 프로세서(240)는 제 2 트랜시버 체인으로부터 수신된 제 2 출력 신호를 처리하여 보상 신호를 생성한다(608). 앞서 설명한 바와 같이, 보상 신호는 제 1 안테나에 의해 수신된 제 2 출력 신호의 원치 않는 컴포넌트들을 루프백 교정 신호로부터 제거한다. 다음에, 제 1 교정 신호를 생성하도록 루프백 교정 신호로부터 보상 신호가 차감된다(610). 그 다음, 제 1 교정 신호에 응답하여 제 1 트랜시버 체인의 하나 또는 그보다 많은 컴포넌트들의 설정들이 선택적으로 조정된다(612). 앞서 언급한 바와 같이, 일부 실시예들의 경우, 제 1 교정 신호는 코어 로직(210)에 의해 제 1 트랜시버 체인(220A)으로 제공되는 신호들을 사전 왜곡하는 사전 왜곡 신호로서 사용될 수 있다. 다른 실시예들의 경우, 제 1 교정 신호는 제 1 트랜시버 체인(220A) 내에 제공된 전력 증폭기(330A)의 이득 설정을 선택적으로 조정하는데, 그리고/또는 제 1 트랜시버 체인(220A) 내에 제공된 DAC(320A)의 설정들을 조정하는데 사용될 수 있다.
특정 실시예들이 도시 및 설명되었지만, 본 개시를 벗어나지 않으면서 본 개시의 더 넓은 양상들로 변경들 및 수정들이 이루어질 수 있으며, 따라서 첨부된 청구항들은 본 개시의 진의 및 범위 내에 속하는 이러한 모든 변경들 및 수정들을 그 청구항들의 범위 내에 포괄한다는 점이 해당 기술분야에서 통상의 지식을 가진 자들에게 명백할 것이다.

Claims (20)

  1. 다른 트랜시버 체인이 제 2 출력 신호를 전송하고 있는 동안, 동시에 제 1 출력 신호를 전송하고 있는 트랜시버 체인을 교정하도록 구성된 무선 통신 디바이스로서,
    코어 로직과 제 1 안테나 사이에 병렬로 연결된 제 1 송신 회로 및 제 1 수신 회로를 포함하는 제 1 트랜시버 체인 ― 상기 제 1 트랜시버 체인은 상기 제 1 출력 신호를 루프백(loopback) 교정 신호로서 상기 제 1 송신 회로로부터 직접 상기 제 1 수신 회로로 라우팅하도록 구성된 루프백 경로를 더 포함함 ― ;
    상기 코어 로직과 제 2 안테나 사이에 병렬로 연결된 제 2 송신 회로 및 제 2 수신 회로를 포함하는 제 2 트랜시버 체인 ― 상기 제 2 트랜시버 체인은 상기 제 1 트랜시버 체인이 상기 제 1 안테나를 통해 상기 제 1 출력 신호를 전송하는 동안 상기 제 2 안테나를 통해 상기 제 2 출력 신호를 전송함 ― ; 및
    상기 제 2 송신 회로와 상기 제 1 수신 회로 사이에 접속된 간섭 프로세서 ― 상기 간섭 프로세서는, 상기 제 1 안테나에 의해 수신된 상기 제 2 출력 신호의 원치 않는 컴포넌트들을 상기 루프백 교정 신호로부터 제거하는 보상 신호를 생성하도록 상기 제 2 출력 신호를 처리하도록 구성됨 ― 를 포함하는,
    무선 통신 디바이스.
  2. 제 1 항에 있어서,
    상기 제 1 출력 신호 및 상기 제 2 출력 신호는 미리 결정된 파형들을 갖는 더미 패킷들이 아닌,
    무선 통신 디바이스.
  3. 제 1 항에 있어서,
    상기 간섭 프로세서는, 상기 간섭 프로세서를 선택적으로 인에이블하는 인에이블 신호를 수신하기 위한 제어 입력을 더 포함하는,
    무선 통신 디바이스.
  4. 제 1 항에 있어서,
    상기 제 1 수신 회로는, 상기 제 2 트랜시버 체인이 상기 제 2 출력 신호를 전송하고 있는 동안 상기 제 1 트랜시버 체인을 교정하는 제 1 교정 신호를 생성하도록 상기 루프백 교정 신호로부터 상기 보상 신호를 차감하는 합산 노드를 더 포함하는,
    무선 통신 디바이스.
  5. 제 4 항에 있어서,
    상기 제 2 출력 신호는 제 2 송신 체인 내의 전력 증폭기의 출력 신호를 포함하는,
    무선 통신 디바이스.
  6. 제 4 항에 있어서,
    상기 제 1 교정 신호는, 상기 제 1 송신 회로 내의 전력 증폭기의 비선형성(non-linearity)들을 사전 보상(pre-compensate)하기 위해, 상기 코어 로직에 의해 상기 제 1 트랜시버 체인에 제공된 신호들을 사전 왜곡(pre-distort)하는 사전 왜곡 신호를 포함하는,
    무선 통신 디바이스.
  7. 제 4 항에 있어서,
    상기 제 1 교정 신호는 전력 증폭기의 비선형성들을 사전 보상하기 위해 상기 제 1 송신 회로 내의 상기 전력 증폭기의 이득 설정을 선택적으로 조정하는,
    무선 통신 디바이스.
  8. 제 4 항에 있어서,
    상기 루프백 경로는 상기 루프백 교정 신호를 생성하기 위해 상기 제 1 출력 신호를 감쇠시키는 감쇠 회로를 포함하는,
    무선 통신 디바이스.
  9. 무선 통신 디바이스의 하나의 트랜시버 체인이 활성 상태인 동안 상기 디바이스의 다른 트랜시버 체인을 교정하는 방법으로서,
    제 2 안테나를 사용하여 상기 디바이스의 제 2 트랜시버 체인으로부터 제 2 출력 신호를 전송하면서, 동시에 제 1 안테나를 사용하여 상기 디바이스의 제 1 트랜시버 체인으로부터 제 1 출력 신호를 전송하는 단계;
    상기 제 1 출력 신호를 루프백 교정 신호로서 상기 제 1 트랜시버 체인의 송신 회로로부터 상기 제 1 트랜시버 체인의 수신 회로로 라우팅하는 단계;
    보상 신호를 생성하도록 간섭 프로세서에서 상기 제 2 출력 신호를 처리하는 단계;
    제 1 교정 신호를 생성하도록 상기 루프백 교정 신호로부터 상기 보상 신호를 차감하는 단계; 및
    상기 제 1 교정 신호에 응답하여 상기 제 1 트랜시버 체인의 하나 또는 그 초과의 컴포넌트들의 설정들을 선택적으로 조정하는 단계를 포함하는,
    트랜시버 체인을 교정하는 방법.
  10. 제 9 항에 있어서,
    상기 보상 신호는 상기 제 1 안테나에 의해 수신된 상기 제 2 출력 신호의 원치 않는 컴포넌트들을 상기 루프백 교정 신호로부터 제거하는,
    트랜시버 체인을 교정하는 방법.
  11. 제 10 항에 있어서,
    상기 제 2 출력 신호의 원치 않는 컴포넌트들은 상기 제 1 트랜시버 체인의 수신 회로에서 상기 루프백 교정 신호에 겹쳐지는(superimpose),
    트랜시버 체인을 교정하는 방법.
  12. 제 9 항에 있어서,
    상기 제 1 출력 신호 및 상기 제 2 출력 신호는 미리 결정된 파형들을 갖는 더미 패킷들이 아닌,
    트랜시버 체인을 교정하는 방법.
  13. 제 9 항에 있어서,
    상기 제 1 교정 신호는 코어 로직에 의해 상기 제 1 트랜시버 체인에 제공된 신호들을 사전 왜곡하는 사전 왜곡 신호를 포함하는,
    트랜시버 체인을 교정하는 방법.
  14. 제 9 항에 있어서,
    상기 제 1 교정 신호는 상기 제 1 트랜시버 체인 내에 제공된 전력 증폭기의 이득 설정을 선택적으로 조정하는,
    트랜시버 체인을 교정하는 방법.
  15. 다른 트랜시버 체인이 제 2 출력 신호를 전송하고 있는 동안, 동시에 제 1 출력 신호를 전송하고 있는 트랜시버 체인을 교정하도록 구성된 무선 통신 디바이스로서,
    제 2 안테나를 사용하여 상기 디바이스의 제 2 트랜시버 체인으로부터 제 2 출력 신호를 전송하면서, 동시에 제 1 안테나를 사용하여 상기 디바이스의 제 1 트랜시버 체인으로부터 제 1 출력 신호를 전송하기 위한 수단;
    상기 제 1 출력 신호를 루프백 교정 신호로서 상기 제 1 트랜시버 체인의 송신 회로로부터 상기 제 1 트랜시버 체인의 수신 회로로 라우팅하기 위한 수단;
    보상 신호를 생성하도록 간섭 프로세서에서 상기 제 2 출력 신호를 처리하기 위한 수단;
    제 1 교정 신호를 생성하도록 상기 루프백 교정 신호로부터 상기 보상 신호를 차감하기 위한 수단; 및
    상기 제 1 교정 신호에 응답하여 상기 제 1 트랜시버 체인의 하나 또는 그 초과의 컴포넌트들의 설정들을 선택적으로 조정하기 위한 수단을 포함하는,
    트랜시버 체인을 교정하도록 구성된 무선 통신 디바이스.
  16. 제 15 항에 있어서,
    상기 보상 신호는 상기 제 1 안테나에 의해 수신된 상기 제 2 출력 신호의 원치 않는 컴포넌트들을 상기 루프백 교정 신호로부터 제거하는,
    트랜시버 체인을 교정하도록 구성된 무선 통신 디바이스.
  17. 제 16 항에 있어서,
    상기 제 2 출력 신호의 원치 않는 컴포넌트들은 상기 제 1 트랜시버 체인의 수신 회로에서 상기 루프백 교정 신호에 겹쳐지는,
    트랜시버 체인을 교정하도록 구성된 무선 통신 디바이스.
  18. 제 15 항에 있어서,
    상기 제 1 출력 신호 및 상기 제 2 출력 신호는 미리 결정된 파형들을 갖는 더미 패킷들이 아닌,
    트랜시버 체인을 교정하도록 구성된 무선 통신 디바이스.
  19. 제 15 항에 있어서,
    상기 제 1 교정 신호는 코어 로직에 의해 상기 제 1 트랜시버 체인에 제공된 신호들을 사전 왜곡하는 사전 왜곡 신호를 포함하는,
    트랜시버 체인을 교정하도록 구성된 무선 통신 디바이스.
  20. 제 15 항에 있어서,
    상기 제 1 교정 신호는 상기 제 1 트랜시버 체인 내에 제공된 전력 증폭기의 이득 설정을 선택적으로 조정하는,
    트랜시버 체인을 교정하도록 구성된 무선 통신 디바이스.
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