KR101212157B1 - Data driving circuit, apparatus and method for driving of flat panel display device using the same - Google Patents
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Abstract
본 발명은 전류소모를 감소시킬 수 있도록 한 데이터 구동회로와 이를 이용한 평판 표시장치의 구동장치 및 구동방법에 관한 것이다.The present invention relates to a data driving circuit capable of reducing current consumption, a driving apparatus and a driving method of a flat panel display device using the same.
본 발명에 따른 데이터 구동회로는 샘플링 신호를 발생하는 쉬프트 레지스터 어레이부와; 샘플링 신호에 따라 저전압 M(단, M은 양의 정수)비트 디지털 데이터를 래치하는 래치 어레이부와; 텍스트 모드신호에 따라 래치된 저전압 M비트 디지털 데이터의 일부 비트를 고전압 디지털 데이터로 변환하는 레벨 쉬프터 어레이부와; 상기 레벨 쉬프터 어레이부에 의해 변환된 고전압 디지털 데이터를 포함하는 M비트 디지털 데이터를 아날로그 화상신호로 변환하는 디지털-아날로그 변환 어레이부와; 상기 아날로그 화상신호를 버퍼링하여 출력하는 출력 버퍼 어레이부를 포함하여 구성되는 것을 특징으로 한다.According to another aspect of the present invention, a data driving circuit includes a shift register array unit configured to generate a sampling signal; A latch array section for latching low voltage M (where M is a positive integer) bit digital data in accordance with a sampling signal; A level shifter array unit for converting some bits of the low voltage M bit digital data latched according to the text mode signal into the high voltage digital data; A digital-to-analog conversion array unit for converting M-bit digital data including high voltage digital data converted by the level shifter array unit into an analog image signal; And an output buffer array unit configured to buffer and output the analog image signal.
데이터 구동회로, 레벨 쉬프터, 전류소모 Data driver circuit, level shifter, current consumption
Description
도 1은 본 발명의 실시 예에 따른 평판 표시장치의 구동장치를 개략적으로 나타낸 도면.1 is a view schematically illustrating a driving device of a flat panel display device according to an exemplary embodiment of the present invention.
도 2는 도 1에 도시된 데이터 구동회로를 개략적으로 나타낸 블록도.FIG. 2 is a block diagram schematically illustrating a data driving circuit shown in FIG. 1.
도 3은 도 2에 도시된 데이터 구동회로에 공급되는 M비트 디지털 데이터를 나타낸 도면.FIG. 3 is a diagram showing M-bit digital data supplied to the data driving circuit shown in FIG.
도 4는 도 2에 도시된 레벨 쉬프터부를 개략적으로 나타낸 도면.4 is a schematic view of the level shifter portion shown in FIG.
< 도면의 주요 부분에 대한 부호설명 ><Explanation of Signs of Major Parts of Drawings>
106 : 데이터 구동회로 120 : 쉬프트 레지스터 어레이부106: data driving circuit 120: shift register array unit
122 : 래치 어레이부 124 : 레벨 쉬프터 어레이부122: latch array portion 124: level shifter array portion
126 : DAC 어레이부 128 : 출력 버퍼 어레이부126: DAC array unit 128: output buffer array unit
130 : 스위칭부 132 : 레벨 쉬프터부130: switching unit 132: level shifter unit
134 : 선택부134: selection unit
본 발명은 데이터 구동회로에 관한 것으로, 특히 전류소모를 감소시킬 수 있도록 한 데이터 구동회로와 이를 이용한 평판 표시장치의 구동장치 및 구동방법에 관한 것이다.BACKGROUND OF THE
최근, 음극선관(Cathode Ray Tube)의 단점인 무게와 부피를 줄일 수 있는 각종 평판 표시장치들이 대두되고 있다. 이러한 평판 표시장치로는 액정 표시장치(Liquid Crystal Display), 전계방출 표시장치(Field Emission Display), 플라즈마 표시 패널(Plasma Display Panel) 및 발광 표시장치(Light Emitting Display) 등이 있다.Recently, various flat panel display devices that can reduce weight and volume, which are disadvantages of cathode ray tubes, have emerged. Examples of such flat panel display devices include a liquid crystal display, a field emission display, a plasma display panel, and a light emitting display.
평판 표시장치 중 액정 표시장치는 전계를 이용하여 액정의 광 투과율을 조절함으로써 화상을 표시하게 된다. 이를 위하여, 액정 표시장치는 액정셀을 가지는 액정패널과 액정패널을 구동하기 위한 구동회로를 구비한다. 구동회로는 화상정보가 액정패널에 표시되도록 액정셀을 구동한다.Among the flat panel displays, the liquid crystal display displays an image by adjusting the light transmittance of the liquid crystal using an electric field. To this end, the liquid crystal display includes a liquid crystal panel having a liquid crystal cell and a driving circuit for driving the liquid crystal panel. The driving circuit drives the liquid crystal cell so that the image information is displayed on the liquid crystal panel.
구체적으로, 구동회로는 액정패널에 스캔펄스를 공급하기 위한 게이트 구동회로와, 액정패널에 화상신호를 공급하기 위한 데이터 구동회로와, 게이트 및 데이터 구동회로 각각을 제어하는 타이밍 컨트롤러를 포함하여 구성된다.Specifically, the driving circuit includes a gate driving circuit for supplying scan pulses to the liquid crystal panel, a data driving circuit for supplying an image signal to the liquid crystal panel, and a timing controller for controlling each of the gate and the data driving circuit. .
타이밍 컨트롤러는 외부로부터의 데이터를 액정패널의 구동에 알맞도록 정렬하여 데이터 구동회로에 공급함과 아울러 게이트 및 데이터 구동회로 각각을 제어하기 위한 제어신호를 생성한다.The timing controller arranges the data from the outside to be suitable for driving the liquid crystal panel, supplies the data to the data driving circuit, and generates a control signal for controlling each of the gate and the data driving circuit.
게이트 구동회로는 타이밍 컨트롤러로부터의 제어신호에 따라 스캔펄스를 순 차적으로 발생하여 액정패널의 게이트 라인들에 순차적으로 공급한다.The gate driving circuit sequentially generates scan pulses according to a control signal from the timing controller, and sequentially supplies the scan pulses to the gate lines of the liquid crystal panel.
데이터 구동회로는 타이밍 컨트롤러로부터의 제어신호에 따라 타이밍 컨트롤러로부터의 데이터를 아날로그 화상신호로 변환하여 액정패널의 데이터 라인들에 공급한다.The data driving circuit converts the data from the timing controller into an analog image signal according to the control signal from the timing controller and supplies the data to the data lines of the liquid crystal panel.
한편, 최근에는 기술발달로 액정패널의 크기가 대형화되고 있는 추세이다. 이에 따라, 액정패널을 구동하는 데이터 구동회로의 면적 및 소비전력이 증가하고 있다.On the other hand, in recent years, the size of the liquid crystal panel is increasing due to technology development. Accordingly, the area and power consumption of the data driving circuit for driving the liquid crystal panel are increasing.
따라서, 대한민국 특허공개번호 2005-0081608호(칩 면적이 작고 전류소모도 작은 평면 패널 소오스 드라이버의 멀티 레벨 쉬프터 회로)에서는 칩 면적이 비교적 작고 전류소모도 작은 평면 패널 소오스 드라이버의 멀티 레벨 쉬프터 회로가 제안되었다.Accordingly, Korean Patent Publication No. 2005-0081608 (a multilevel shifter circuit of a flat panel source driver having a small chip area and a small current consumption) proposes a multilevel shifter circuit of a flat panel source driver having a relatively small chip area and a small current consumption. It became.
이러한, 종래의 멀티 레벨 쉬프터 회로는 전원전압을 강하(Drop)시켜 강하된 전원전압을 출력하는 전압 강하부; 및 상기 강하된 전원전압을 공통으로 사용하고, 복수 비트의 데이터를 받아 그 레벨을 변환시키는 복수개의 레벨 쉬프터들을 구비하는 것을 특징으로 한다.Such a conventional multi-level shifter circuit includes a voltage drop unit for dropping a power supply voltage and outputting a dropped power supply voltage; And a plurality of level shifters using the dropped power supply voltage in common, and receiving a plurality of bits of data and converting the levels thereof.
그러나, 종래의 멀티 레벨 쉬프터 회로는 외부에서 인가되는 디지털 데이터가 동영상 및 정지영상에 상관없이 디지털 데이터의 레벨을 변환시키기 때문에 전류소모가 크다는 문제점이 있다.However, the conventional multi-level shifter circuit has a problem in that current consumption is large because digital data applied from the outside converts the level of the digital data irrespective of moving images and still images.
예를 들어, 디지털 데이터가 6비트일 경우, 텍스트(Text) 등의 정지영상은 최상위 비트 데이터를 제외한 나머지 비트 데이터를 "1" 또는 "0"의 값으로 고정하 고, 최상위 비트 데이터(또는 상위 3개의 비트 데이터)를 이용하여 표시하게 된다. 이에 따라, 종래의 멀티 레벨 쉬프터 회로는 정지영상을 표시할 경우 모든 비트 데이터의 레벨을 변환시키기 때문에 전류소모가 크게 된다.For example, if the digital data is 6 bits, the still image such as text fixes the remaining bit data except the most significant bit data to a value of "1" or "0", and the most significant bit data (or higher). 3 bit data) to display. Accordingly, the conventional multi-level shifter circuit converts the levels of all the bit data when displaying a still image, resulting in large current consumption.
따라서 상기와 같은 문제점을 해결하기 위하여, 본 발명의 목적은 전류소모를 감소시킬 수 있도록 한 데이터 구동회로와 이를 이용한 평판 표시장치의 구동장치 및 구동방법을 제공하는데 있다.Accordingly, in order to solve the above problems, an object of the present invention is to provide a data driving circuit and a driving apparatus and driving method of a flat panel display device using the same to reduce the current consumption.
상기와 같은 목적을 달성하기 위한 본 발명의 실시 예에 따른 데이터 구동회로는 샘플링 신호를 발생하는 쉬프트 레지스터 어레이부와; 샘플링 신호에 따라 저전압 M(단, M은 양의 정수)비트 디지털 데이터를 래치하는 래치 어레이부와; 텍스트 모드신호에 따라 래치된 저전압 M비트 디지털 데이터의 일부 비트를 고전압 디지털 데이터로 변환하는 레벨 쉬프터 어레이부와; 상기 레벨 쉬프터 어레이부에 의해 변환된 고전압 디지털 데이터를 포함하는 M비트 디지털 데이터를 아날로그 화상신호로 변환하는 디지털-아날로그 변환 어레이부와; 상기 아날로그 화상신호를 버퍼링하여 출력하는 출력 버퍼 어레이부를 포함하여 구성되는 것을 특징으로 한다.A data driving circuit according to an embodiment of the present invention for achieving the above object includes a shift register array unit for generating a sampling signal; A latch array section for latching low voltage M (where M is a positive integer) bit digital data in accordance with a sampling signal; A level shifter array unit for converting some bits of the low voltage M bit digital data latched according to the text mode signal into the high voltage digital data; A digital-to-analog conversion array unit for converting M-bit digital data including high voltage digital data converted by the level shifter array unit into an analog image signal; And an output buffer array unit configured to buffer and output the analog image signal.
상기 텍스트 모드신호는 상기 저전압 M비트 디지털 데이터가 영상 데이터인 경우 제 1 논리상태가 되고, 상기 저전압 M비트 디지털 데이터가 텍스트 데이터인 경우 제 2 논리상태가 되는 것을 특징으로 한다.The text mode signal is in a first logic state when the low voltage M bit digital data is image data, and in a second logic state when the low voltage M bit digital data is text data.
상기 레벨 쉬프터 어레이부는 상기 제 1 논리 상태의 텍스트 모드신호에 따 라 상기 래치된 저전압 M비트 디지털 데이터 각각을 고전압 디지털 데이터로 변환하고, 상기 제 2 논리 상태의 텍스트 모드신호에 따라 상기 래치된 저전압 M비트 디지털 데이터 중 저전압 N(단, N은 M보다 작은 양의 정수)비트 디지털 데이터를 제외한 저전압 M-N비트 디지털 데이터를 고전압 디지털 데이터로 변환하는 것을 특징으로 한다.The level shifter array unit converts each of the latched low voltage M bit digital data into high voltage digital data according to the text mode signal of the first logic state, and the latched low voltage M according to the text mode signal of the second logic state. The low-voltage MN bit digital data except for the low voltage N (where N is a positive integer smaller than M) bit digital data among the bit digital data may be converted into high voltage digital data.
상기 레벨 쉬프터 어레이부는 상기 텍스트 모드신호에 따라 상기 래치 어레이부로부터 공급되는 저전압 M비트 디지털 데이터 중 저전압 N(단, N은 M보다 작은 양의 정수)비트 디지털 데이터 각각을 선택적으로 출력하는 스위칭부와; 구동전압 및 기저전압을 이용하여 상기 저전압 N비트 디지털 데이터를 제외한 저전압 M-N비트 디지털 데이터와 상기 스위칭부로부터의 저전압 N비트 디지털 데이터를 상기 고전압 M비트 디지털 데이터로 변환하는 레벨 쉬프터부와; 상기 텍스트 모드신호에 따라 상기 레벨 쉬프터부로부터의 고전압 N비트 디지털 데이터 및 외부전원 중 어느 하나를 선택하여 출력하는 선택부를 포함하여 구성되는 것을 특징으로 한다.The level shifter array unit and the switching unit for selectively outputting each of the low voltage N (where N is a positive integer less than M) of the low voltage M bit digital data supplied from the latch array unit in accordance with the text mode signal; ; A level shifter for converting low voltage M-N bit digital data excluding the low voltage N bit digital data and low voltage N bit digital data from the switching unit into the high voltage M bit digital data using a driving voltage and a base voltage; And a selection unit for selecting and outputting any one of high voltage N-bit digital data from the level shifter unit and an external power source according to the text mode signal.
본 발명의 실시 예에 따른 평판 표시장치는 영상을 표시하는 표시패널과, 상기 표시패널에 스캔펄스를 공급하는 게이트 구동회로와; 상기 데이터 구동회로와; 상기 데이터 구동회로에 상기 저전압 M비트 디지털 데이터를 공급함과 아울러 상기 게이트 및 데이터 구동회로 각각을 제어하는 타이밍 컨트롤러를 포함하여 구성되는 것을 특징으로 한다.According to an exemplary embodiment of the present invention, a flat panel display includes: a display panel displaying an image, a gate driving circuit supplying scan pulses to the display panel; The data driving circuit; And a timing controller for supplying the low voltage M-bit digital data to the data driving circuit and controlling each of the gate and the data driving circuit.
본 발명의 실시 예에 따른 평판 표시장치의 구동방법은 표시패널에 아날로그 화상신호를 공급하여 영상을 표시하는 방법에 있어서, 상기 표시패널에 아날로그 화상신호를 공급하는 단계는; 샘플링 신호를 발생하는 제 1 단계와; 샘플링 신호에 따라 저전압 M(단, M은 양의 정수)비트 디지털 데이터를 래치하는 제 2 단계와; 텍스트 모드신호에 따라 래치된 저전압 M비트 디지털 데이터의 일부 비트를 고전압 디지털 데이터로 변환하는 제 3 단계와; 상기 변환된 고전압 디지털 데이터를 포함하는 M비트 디지털 데이터를 아날로그 화상신호로 변환하는 제 4 단계와; 상기 아날로그 화상신호를 버퍼링하여 출력하는 제 5 단계를 포함하는 것을 특징으로 한다.According to an aspect of the present invention, there is provided a method of driving a flat panel display, the method for displaying an image by supplying an analog image signal to a display panel. A first step of generating a sampling signal; Latching a low voltage M (where M is a positive integer) bit digital data in accordance with the sampling signal; Converting some bits of the low voltage M bit digital data latched in accordance with the text mode signal into high voltage digital data; A fourth step of converting the M-bit digital data including the converted high voltage digital data into an analog image signal; And a fifth step of buffering and outputting the analog image signal.
상기 텍스트 모드신호는 상기 저전압 M비트 디지털 데이터가 영상 데이터인 경우 제 1 논리상태가 되고, 상기 저전압 M비트 디지털 데이터가 텍스트 데이터인 경우 제 2 논리상태가 되는 것을 특징으로 한다.The text mode signal is in a first logic state when the low voltage M bit digital data is image data, and in a second logic state when the low voltage M bit digital data is text data.
상기 제 3 단계는 상기 제 1 논리 상태의 텍스트 모드신호에 따라 상기 래치된 저전압 M비트 디지털 데이터 각각을 고전압 디지털 데이터로 변환하고, 상기 제 2 논리 상태의 텍스트 모드신호에 따라 상기 래치된 저전압 M비트 디지털 데이터 중 저전압 N(단, N은 M보다 작은 양의 정수)비트 디지털 데이터를 제외한 저전압 M-N비트 디지털 데이터를 고전압 디지털 데이터로 변환하는 것을 특징으로 한다.The third step converts each of the latched low voltage M bit digital data into high voltage digital data according to the text mode signal of the first logic state, and the latched low voltage M bit according to the text mode signal of the second logic state. Among the digital data, low voltage MN bit digital data except low voltage N (where N is a positive integer smaller than M) bit digital data is converted into high voltage digital data.
상기 제 3 단계는 상기 텍스트 모드신호에 따라 상기 래치된 저전압 M비트 디지털 데이터 중 저전압 N(단, N은 M보다 작은 양의 정수)비트 디지털 데이터 각각을 선택적으로 출력하는 제 3-1 단계와; 구동전압 및 기저전압을 이용하여 상기 저전압 N비트 디지털 데이터를 제외한 저전압 M-N비트 디지털 데이터와 상기 저전압 N비트 디지털 데이터를 상기 고전압 M비트 디지털 데이터로 변환하는 제 3-2 단 계와; 상기 텍스트 모드신호에 따라 상기 고전압 N비트 디지털 데이터 및 외부전원 중 어느 하나를 선택하여 출력하는 제 3-3 단계를 포함하여 구성되는 것을 특징으로 한다.The third step may include a step 3-1 of selectively outputting low voltage N (where N is a positive integer less than M) bit digital data among the latched low voltage M bit digital data according to the text mode signal; A step 3-2 of converting the low voltage M-N bit digital data and the low voltage N bit digital data except the low voltage N bit digital data into the high voltage M bit digital data using a driving voltage and a base voltage; And a third step of selecting and outputting any one of the high voltage N-bit digital data and an external power source according to the text mode signal.
이하에서, 첨부된 도면 및 실시 예를 통해 본 발명의 실시 예를 구체적으로 살펴보면 다음과 같다.Hereinafter, an embodiment of the present invention will be described in detail with reference to the accompanying drawings and embodiments.
도 1은 본 발명의 실시 예에 따른 데이터 구동회로와 이를 이용한 액정 표시장치의 구동장치를 개략적으로 나타낸 도면이다.1 is a view schematically illustrating a data driving circuit and a driving apparatus of a liquid crystal display using the same according to an exemplary embodiment of the present invention.
도 1을 참조하면, 본 발명의 실시 예에 따른 데이터 구동회로와 이를 이용한 액정 표시장치의 구동장치는 복수의 게이트 라인(GL1 내지 GLn)과 복수의 데이터 라인(DL1 내지 DLm)에 의해 정의되는 영역마다 액정셀이 형성된 액정패널(102)과; 복수의 게이트 라인(GL1 내지 GLn)에 순차적으로 스캔펄스를 공급하는 게이트 구동회로(104)와; 사용자에 의한 텍스트 모드신호(TMS)에 따라 입력되는 저전압의 M(단, M은 양의 정수)비트 디지털 데이터(R,G,B)의 일부 비트를 고전압 디지털 데이터로 변환하고 변환된 고전압 디지털 데이터를 포함하는 디지털 데이터를 아날로그 화상신호로 변환하여 데이터 라인들(DL1 내지 DLm)에 공급하는 데이터 구동회로(106)와; 데이터 구동회로(106)에 저전압 M비트 디지털 데이터(R,G,B)를 공급함과 아울러 게이트 및 데이터 구동회로(104, 106) 각각을 제어하는 타이밍 컨트롤러(108)를 포함하여 구성된다.Referring to FIG. 1, a data driving circuit and a driving device of a liquid crystal display using the same according to an exemplary embodiment of the present invention are regions defined by a plurality of gate lines GL1 to GLn and a plurality of data lines DL1 to DLm. A
액정패널(102)은 n개의 게이트 라인(GL1 내지 GLn)과 m개의 데이터 라인(DL1 내지 DLm)에 의해 정의되는 영역에 형성된 박막 트랜지스터(TFT)와, 박막 트랜지스 터(TFT)에 접속되는 액정셀들을 구비한다. 박막 트랜지스터(TFT)는 게이트 라인(GL1 내지 GLn)으로부터의 스캔펄스에 응답하여 데이터 라인(DL1 내지 DLm)으로부터의 데이터 신호를 액정셀로 공급한다. 액정셀은 액정을 사이에 두고 대면하는 공통전극과 박막 트랜지스터(TFT)에 접속된 화소전극으로 구성되므로 등가적으로 액정 커패시터(Clc)로 표시될 수 있다. 또한, 액정셀은 액정 커패시터(Clc)에 충전된 데이터 신호를 다음 데이터 신호가 충전될 때까지 유지시키기 위한 스토리지 커패시터(Cst)를 포함한다.The
타이밍 컨트롤러(108)는 외부로부터 공급되는 M비트 디지털 데이터(Data)를 액정패널(102)의 구동에 알맞도록 정렬하여 데이터 구동회로(106)에 공급한다. 또한, 타이밍 컨트롤러(108)는 외부로부터 입력되는 도트클럭(DCLK), 데이터 인에이블 신호(DE), 수평 및 수직 동기신호(Hsync, Vsync)를 이용하여 데이터 제어신호(DCS)와 게이트 제어신호(GCS)를 생성하여 데이터 구동회로(106)와 게이트 구동회로(104) 각각의 구동 타이밍을 제어한다.The
게이트 구동회로(104)는 타이밍 컨트롤러(108)로부터의 게이트 제어신호(GCS)에 따라 스캔펄스 즉, 게이트 하이펄스를 순차적으로 발생하여 n개의 게이트 라인(GL1 내지 GLn)에 순차적으로 공급한다.The
데이터 구동회로(106)는 타이밍 컨트롤러(108)로부터 공급되는 데이터 제어신호(DCS)에 따라 타이밍 컨트롤러(108)로부터 공급되는 저전압의 M(단, M은 양의 정수이고)비트 디지털 데이터(R,G,B)를 래치하고, 사용자에 의한 텍스트 모드신호(TMS)에 따라 래치된 저전압의 M비트 디지털 데이터(R,G,B)의 일부 비트를 고전압 디지털 데이터로 변환하고, 변환된 고전압 디지털 데이터를 포함하는 디지털 데이터를 아날로그 화상신호로 변환한다. 그리고, 데이터 구동회로(106)는 게이트 라인들(GL1 내지 GLn)에 스캔펄스가 공급되는 1수평 주기마다 1수평 라인분의 아날로그 화상신호를 데이터 라인들(DL1 내지 DLm)로 공급한다. 여기서, 텍스트 모드신호(TMS)는 사용자에 의한 액정패널(102)에 표시되는 표시영상이 동영상에서 정지영상으로 전환될 경우에 로우 상태(LOW)로 발생되고 그렇지 않을 경우 하이 상태(High)가 된다. 즉, 텍스트 모드신호(TMS)는 사용자가 이동통신 단말기에서 문자를 작성하거나 읽을 경우에 발생될 수 있다.The
이를 위해, 데이터 구동회로(106)는 도 2에 도시된 바와 같이 샘플링 신호를 발생하는 쉬프트 레지스터 어레이부(120)와; 샘플링 신호에 따라 저전압 M비트 디지털 데이터를 래치하는 래치 어레이부(122)와; 텍스트 모드신호(TMS)에 따라 래치된 저전압 M비트 디지털 데이터(R,G,B)의 일부 비트를 고전압 디지털 데이터로 변환하는 레벨 쉬프터 어레이부(124)와; 레벨 쉬프터 어레이부(124)에 의해 변환된 고전압 디지털 데이터를 포함하는 M비트 디지털 데이터를 아날로그 화상신호로 변환하는 디지털-아날로그 변환(Digital-Analog Converter; 이하 "DAC"라 함) 어레이부(126)와; 아날로그 화상신호를 데이터 라인들(DL1 내지 DLm)로 출력하는 출력 버퍼 어레이부(128)를 포함하여 구성된다.To this end, the
쉬프트 레지스터 어레이부(120)는 타이밍 컨트롤러(108)로부터의 데이터 제어신호(DCS) 중 소스 스타트 펄스(SSP) 및 소스 쉬프트 클럭(SSC)을 이용하여 샘플링 신호를 순차적으로 발생하여 래치 어레이부(122)에 공급한다.The shift
래치 어레이부(122)는 쉬프트 레지스터 어레이부(120)로부터의 샘플링 신호에 따라 타이밍 컨트롤러(122)로부터 공급되는 저전압 M비트 디지털 데이터(R,G,B)를 래치한다. 이때, 래치 어레이부(122)는 1수평 라인분의 저전압 M비트 디지털 데이터(R,G,B)를 래치하고, 데이터 제어신호(DCS) 중 소스 출력 인에이블(SOE) 신호에 따라 래치된 1수평라인분의 저전압 M비트 디지털 데이터(R,G,B)를 출력한다.The
레벨 쉬프터 어레이부(124)는 하이 상태의 텍스트 모드신호에 따라 래치된 저전압 M비트 디지털 데이터 각각을 고전압 디지털 데이터로 변환하고, 로우 상태의 텍스트 모드신호에 따라 상기 래치된 저전압 M비트 디지털 데이터 중 저전압 N(단, N은 M보다 작은 양의 정수)비트 디지털 데이터를 제외한 저전압 M-N비트 디지털 데이터를 고전압 디지털 데이터로 변환한다.The level
이를 위해, 레벨 쉬프터 어레이부(124)는 텍스트 모드신호(TMS)에 따라 래치 어레이부(122)로부터 공급되는 저전압 M비트 디지털 데이터(R,G,B) 중 저전압 N비트 디지털 데이터(R,G,B)를 선택적으로 출력하는 스위칭부(130)와; 래치 어레이부(122)로부터 공급되는 저전압 M-N비트 디지털 데이터(R,G,B)와 스위칭부(130)로부터의 저전압 N비트 디지털 데이터(R,G,B)를 고전압 M비트 디지털 데이터(R,G,B)로 변환하는 레벨 쉬프터부(132)와; 텍스트 모드신호(TMS)에 따라 레벨 쉬프터부(132)로부터의 고전압 N비트 디지털 데이터(R,G,B) 및 외부전원 중 어느 하나를 선택하여 출력하는 선택부(134)를 포함하여 구성된다.To this end, the level
여기서, 저전압 M비트 디지털 데이터(R,G,B)는 도 3에 도시된 바와 같이 6비트(D0 내지 D5)로 가정하기로 한다. 이때, 동영상 데이터일 경우 6비트(D0 내지 D5)를 이용하여 계조를 구현하는 반면에 텍스트 데이터일 경우 6비트(D0 내지 D5) 중 하위 2비트 데이터(D0, D1)를 "1" 또는 "0"의 값으로 고정하고 나머지 4비트(D2 내지 D5)의 계조 값으로 텍스트 계조를 구현하게 된다. 그리고, 텍스트 계조 구현을 위한 비트 수는 시스템에 따라 달라질 수 있다.Here, it is assumed that the low voltage M-bit digital data R, G, and B are 6 bits D0 to D5 as shown in FIG. In this case, grayscale is implemented using 6 bits (D0 to D5) in the case of video data, whereas "1" or "0 is selected as the lower two bit data (D0, D1) among 6 bits (D0 to D5) in case of text data. It is fixed to the value of "and implements the text gradation with the gradation value of the remaining 4 bits (D2 to D5). The number of bits for implementing the text gradation may vary depending on the system.
스위칭부(130)는 도 4에 도시된 바와 같이 저전압 M비트 디지털 데이터(R,G,B)의 하위 제 1 비트 전송라인과 레벨 쉬프터부(132) 사이에 접속되어 텍스트 모드신호(TMS)에 따라 하위 제 1 비트 데이터(D0)를 레벨 쉬프터부(132)에 공급하는 제 1 트랜지스터(T1)와, 저전압 M비트 디지털 데이터(R,G,B)의 하위 제 2 비트 전송라인과 레벨 쉬프터부(132) 사이에 접속되어 텍스트 모드신호(TMS)에 따라 하위 제 2 비트 데이터(D1)를 레벨 쉬프터부(132)에 공급하는 제 2 트랜지스터(T2)를 포함하여 구성된다.As shown in FIG. 4, the
제 1 트랜지스터(T1)는 하이 상태의 텍스트 모드신호(TMS)에 따라 턴-온되어 하위 제 1 비트 데이터(D0)를 레벨 쉬프터부(132)에 공급하는 반면에 로우 상태의 텍스트 모드신호(TMS)에 따라 턴-오프되어 레벨 쉬프터부(132)로 공급되는 하위 제 1 비트 데이터(D0)를 차단한다.The first transistor T1 is turned on according to the text mode signal TMS in the high state to supply the lower first bit data D0 to the
제 2 트랜지스터(T2)는 하이 상태의 텍스트 모드신호(TMS)에 따라 턴-온되어 하위 제 2 비트 데이터(D1)를 레벨 쉬프터부(132)에 공급하는 반면에 로우 상태의 텍스트 모드신호(TMS)에 따라 턴-오프되어 레벨 쉬프터부(132)로 공급되는 하위 제 2 비트 데이터(D1)를 차단한다.The second transistor T2 is turned on according to the text mode signal TMS in the high state to supply the lower second bit data D1 to the
레벨 쉬프터부(132)는 도 4에 도시된 바와 같이 저전압 6비트 디지털 데이터 (R,G,B)이 각 비트 전송라인에 접속된 6개의 레벨 쉬프터(LS0 내지 LS5)를 포함한다.The
6개의 레벨 쉬프터(LS0 내지 LS5) 각각은 외부로부터 공급되는 구동전압(VDD) 및 기저전압(VSS)을 이용하여 저전압 6비트 디지털 데이터(D0 내지 D5) 각각을 고전압 6비트 디지털 데이터((D0' 내지 D5')로 변환한다.Each of the six level shifters LS0 to LS5 uses the driving voltage VDD and the ground voltage VSS supplied from the outside to respectively convert the low voltage 6 bit digital data D0 to D5 into the high voltage 6 bit digital data (D0 '. To D5 ').
이러한, 6개의 레벨 쉬프터(LS0 내지 LS5) 중 제 1 및 제 2 레벨 쉬프터(LS0, LS1) 각각은 제 1 및 제 2 트랜지스터(T1, T2) 각각의 스위칭에 대응되도록 동작된다. 즉, 제 1 및 제 2 레벨 쉬프터(LS0, LS1) 각각은 텍스트 모드신호(TMS)에 따라 제 1 및 제 2 트랜지스터(T1, T2)가 턴-온되어 디지털 데이터(D0, D1)가 공급될 경우에만 동작하게 된다.Each of the first and second level shifters LS0 and LS1 of the six level shifters LS0 to LS5 is operated to correspond to the switching of each of the first and second transistors T1 and T2. That is, each of the first and second level shifters LS0 and LS1 may be turned on to supply the digital data D0 and D1 according to the text mode signal TMS. Will only work.
선택부(134)는 도 4에 도시된 바와 같이 텍스트 모드신호(TMS)에 따라 제 1 레벨 쉬프터(LS0)로부터 공급되는 고전압 제 1 비트 디지털 데이터(D0') 및 기저전압(VSS)을 선택하여 출력하는 제 1 멀티플렉서(M1)와, 텍스트 모드신호(TMS)에 따라 제 2 레벨 쉬프터(LS1)로부터 공급되는 고전압 제 2 비트 디지털 데이터(D1') 및 외부전원을 선택하여 출력하는 제 2 멀티플렉서(M2)를 포함하여 구성된다. 여기서, 외부전원은 구동전압(VDD) 및 기저전압(VSS) 중 어느 하나가 될 수 있다.As shown in FIG. 4, the
제 1 멀티플렉서(M1)는 하이 상태의 텍스트 모드신호(TMS)에 따라 고전압 제 1 비트 디지털 데이터(D0')를 DAC 어레이부(126)에 공급하고, 로우 상태의 텍스트 모드신호(TMS)에 따라 기저전압(VSS)을 DAC 어레이부(126)에 공급한다.The first multiplexer M1 supplies the high voltage first bit digital data D0 'to the
제 2 멀티플렉서(M2)는 하이 상태의 텍스트 모드신호(TMS)에 따라 고전압 제 2 비트 디지털 데이터(D1')를 DAC 어레이부(126)에 공급하고, 로우 상태의 텍스트 모드신호(TMS)에 따라 기저전압(VSS)을 DAC 어레이부(126)에 공급한다.The second multiplexer M2 supplies the high voltage second bit digital data D1 'to the
한편, 제 1 및 제 2 멀티플렉서(M1, M2)에는 기저전압(VSS) 대신에 구동전압(VDD)이 공급될 수 있다.Meanwhile, the driving voltage VDD may be supplied to the first and second multiplexers M1 and M2 instead of the base voltage VSS.
도 2에서, DAC 어레이부(126)는 입력되는 서로 다른 복수의 감마전압(GMA)에 이용하여 레벨 쉬프터 어레이부(124)로부터 공급되는 고전압 6비트 디지털 데이터를 아날로그 화상신호로 변환한다.In FIG. 2, the
출력 버퍼 어레이부(128)는 DAC 어레이부(126)로부터의 아날로그 화상신호를 버퍼링하여 데이터 라인들(DL1 내지 DLm)에 공급한다.The output
이와 같은, 본 발명의 실시 예에 따른 데이터 구동회로와 이를 이용한 평판 표시장치의 구동장치 및 구동방법은 사용자에 의한 텍스트 모드신호(TMS)에 따라 입력되는 저전압의 6비트 디지털 데이터(R,G,B)의 상위 4비트를 고전압 디지털 데이터로 변환함으로써 데이터 구동회로(104)의 전류소모를 감소시킬 수 있다.Such a data driving circuit and a driving apparatus and driving method of a flat panel display device using the same according to an embodiment of the present invention are low-voltage 6-bit digital data (R, G, By converting the upper four bits of B) into high voltage digital data, the current consumption of the
한편, 상술한 본 발명의 실시 예에 따른 데이터 구동회로와 이를 이용한 평판 표시장치의 구동장치 및 구동방법에서는 액정 표시장치를 예를 들어 설명하였으나 이에 한정되지 않고 액정 표시장치, 플라즈마 디스플레이 패널 및 발광 표시장치를 포함하는 평판 표시장치에도 적용될 수 있다.Meanwhile, in the above-described data driving circuit and driving device and driving method of the flat panel display device using the same, the liquid crystal display device is described as an example, but is not limited thereto. The present invention may also be applied to a flat panel display including the device.
다른 한편, 이상에서 설명한 본 발명은 상술한 실시 예 및 첨부된 도면에 한정되는 것이 아니고, 본 발명의 기술적 사상을 벗어나지 않는 범위내에서 여러 가지 치환, 변형 및 변경이 가능하다는 것이 본 발명이 속하는 기술분야에서 종래의 지식을 가진 자에게 있어 명백할 것이다.On the other hand, the present invention described above is not limited to the above-described embodiments and the accompanying drawings, it is a technology that the various permutations, modifications and changes are possible within the scope without departing from the spirit of the present invention It will be apparent to those skilled in the art.
상기와 같은 본 발명의 실시 예에 따른 데이터 구동회로와 이를 이용한 평판 표시장치의 구동장치 및 구동방법은 저전압 M비트 디지털 데이터가 텍스트일 경우 저전압 M-N비트 디지털 데이터를 고전압 M-N비트 디지털 데이터로 변환하는 반면에 N비트 디지털 데이터를 제 1 및 제 2 구동전원 중 어느 하나로 변환한다. 따라서, 본 발명은 저전압 M비트 디지털 데이터 중 저전압 N비트 디지털 데이터를 변환하는 2개의 레벨 쉬프터를 오프시키기 때문에 전류소모를 감소시킬 수 있다.As described above, the data driving circuit and the driving apparatus and driving method of the flat panel display using the same convert the low voltage MN bit digital data into the high voltage MN bit digital data when the low voltage M bit digital data is text. Converts the N-bit digital data into either of the first and second driving power supplies. Therefore, the present invention can reduce current consumption because the two level shifters for converting the low voltage N bit digital data among the low voltage M bit digital data are turned off.
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