KR101024334B1 - 플래시 기억 장치의 과소거 방지 회로 및 그 방법 - Google Patents
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Abstract
Description
Claims (8)
- 특정 값이 프로그램된 레지스터;상기 레지스터가 활성화되어 상기 특정 값이 출력되면 특정 레벨을 갖는 제1 고전압과 상기 제1 고전압보다 높은 레벨을 가지며 특정레벨을 가지는 제2 고전압을 발생하는 펌핑 블록; 및상기 특정 레벨을 갖는 고전압들에 의해 트리밍되는 다수의 기준 셀을 포함하는 기준 셀 블록을 포함하여 구성된 것을 특징으로 하는 플래시 기억 장치의 과소거 방지 회로.
- 상기 제 1 항에 있어서,상기 레지스터는 정상 셀로부터 출력된 소거 데이터가 에러 데이터로 출력되면 활성화되는 것을 특징으로 하는 플래시 기억 장치의 과소거 방지 회로.
- 상기 제 1 항에 있어서,상기 기준 셀은 상기 제 1 고전압이 인가되는 드레인과 상기 제2 고전압이 인가되는 게이트를 갖는 것을 특징으로 하는 플래시 기억 장치의 과소거 방지 회로.
- 소거 및 프로그램 모드로 진입하는 제 1 단계;특정 회수의 소거 동작을 반복 수행하는 제 2 단계;소거 데이터 값이 정상인지를 판단하는 제 3 단계; 및상기 제 3 단계에서 상기 소거 데이터 값이 정상이 아닌 경우 미리 저장된 특정 레지스터 값에 의해 기준 셀을 트리밍하여 상기 제1 단계로 피드백하고, 상기 소거 데이터 값이 정상인 경우 종료하는 제 4 단계를 포함하여 이루어지는 것을 특징으로 하는 플래시 기억 장치의 과소거 방지 방법.
- 상기 제 4 항에 있어서,상기 제 4 단계는 상기 특정 레지스터 값에 의해 펌핑 수단을 활성화하여 특정 레벨을 갖는 제1 고전압 및 상기 제1 고전압보다 높은 레벨을 갖는 제2 고전압을 발생하는 제 5단계를 더 포함하는 것을 특징으로 하는 플래시 기억 장치의 과소거 방지 방법.
- 상기 제 5 항에 있어서,상기 제 5 단계에서 상기 기준 셀은 게이트에 상기 제 1 고전압이 인가되고 드레인에 상기 제 2 고전압이 인가되어 트리밍되는 것을 특징으로 하는 플래시 기억 장치의 과소거 방지 방법.
- 상기 제 4 항에 있어서,상기 제 4 단계에서 상기 트리밍된 기준 셀이 정상적으로 프로그래밍 되었는지를 판단하여 정상적으로 프로그래밍 된 경우 상기 제 1 단계로 피드백하고 정상적으로 프로그래밍 되지 않은 경우 상기 기준 셀을 다시 트리밍하는 제 6 단계를 더 포함하는 것을 특징으로 하는 플래시 기억 장치의 과소거 방지 방법.
- 상기 제 7 항에 있어서,상기 제 6 단계에서 상기 기준 셀의 드레인 전류를 검출하여 정상 셀의 드레인 전류와 비교하는 방법을 사용하여 상기 기준 셀이 정상적으로 프로그래밍 되었는지를 판단하는 것을 특징으로 하는 플래시 기억 장치의 과소거 방지 방법.
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KR20020087114A (ko) * | 2000-03-30 | 2002-11-21 | 마이크론 테크놀로지, 인크. | 플래시에 대한 상부/하부 대칭적 보호 기술 |
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2003
- 2003-08-20 KR KR1020030057542A patent/KR101024334B1/ko active IP Right Grant
Patent Citations (2)
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