KR100922796B1 - Method and Apparatus For Loading Data in Liquid Crystal Display - Google Patents

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Abstract

본 발명은 회로소자의 크기를 줄이고 배선 수와 입/출력핀수를 줄이도록 한 액정표시장치의 데이터 로딩방법 및 장치에 관한 것이다.The present invention relates to a data loading method and apparatus for a liquid crystal display device to reduce the size of circuit elements and to reduce the number of wirings and the number of input / output pins.

이 액정표시장치의 데이터 로딩방법 및 장치는 직렬 어드레스 지정신호를 발생하고, 직렬 어드레스 지정신호에 응답하여 제1 메모리에 저장된 변조 데이터를 제2 메모리로 로딩하게 된다.
The data loading method and apparatus of the liquid crystal display generate a serial addressing signal and load modulation data stored in the first memory into the second memory in response to the serial addressing signal.

Description

액정표시장치의 데이터 로딩방법 및 장치{Method and Apparatus For Loading Data in Liquid Crystal Display} Method and device for loading data of liquid crystal display {Method and Apparatus For Loading Data in Liquid Crystal Display}             

도 1은 통상의 액정표시장치에 있어서 데이터에 따른 휘도 변화를 나타내는 파형도이다.1 is a waveform diagram showing a change in luminance according to data in a conventional liquid crystal display.

도 2는 종래의 고속 구동방법에 있어서 데이터 변조에 따른 휘도 변화의 일례를 나타내는 파형도이다.2 is a waveform diagram showing an example of a luminance change caused by data modulation in the conventional high speed driving method.

도 3은 종래의 고속 구동을 위한 데이터 로딩장치를 나타내는 회로도이다.3 is a circuit diagram illustrating a conventional data loading apparatus for high speed driving.

도 4는 본 발명의 실시예에 따른 액정표시장치를 나타내는 블록도이다. 4 is a block diagram illustrating a liquid crystal display according to an exemplary embodiment of the present invention.

도 5는 본 발명의 실시예에 따른 데이터 로딩장치를 나타내는 회로도이다.5 is a circuit diagram illustrating a data loading apparatus according to an embodiment of the present invention.

도 6은 도 5에 도시된 데이터 로딩장치의 입/출력신호를 나타내는 파형도이다. 6 is a waveform diagram illustrating input / output signals of the data loading apparatus illustrated in FIG. 5.

< 도면의 주요 부분에 대한 부호의 설명 ><Description of Symbols for Main Parts of Drawings>

31,41 : 타이밍 콘트롤러 32,45 : ROM31,41: Timing controller 32,45: ROM

36,51 : RAM 42 : 데이터 구동회로36,51 RAM 42: Data driving circuit

43 : 게이트 구동회로 44 : 액정패널 43: gate driving circuit 44: liquid crystal panel

52 : 멀티플렉서 53 : FSM
52: Multiplexer 53: FSM

본 발명은 액정표시장치에 관한 것으로, 특히 회로소자의 크기를 줄이고 배선 수와 입/출력핀수를 줄이도록 한 액정표시장치의 데이터 로딩방법 및 장치에 관한 것이다. 또한, 본 발명은 고속구동을 위한 변조데이터의 로딩에 필요한 신호라인들의 수와 핀수를 줄이고 회로소자의 크기를 줄이도록 한 액정표시장치에 관한 것이다. BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a liquid crystal display device, and more particularly, to a data loading method and apparatus for a liquid crystal display device which reduces the size of circuit elements and reduces the number of wirings and input / output pins. The present invention also relates to a liquid crystal display device which reduces the number of signal lines and the number of pins required for loading modulation data for high-speed driving and reduces the size of circuit elements.

액정표시장치는 비디오신호에 따라 액정셀들의 광투과율을 조절하여 화상을 표시하게 된다. 액정셀마다 스위칭소자가 형성된 액티브 매트릭스(Active Matrix) 타입의 액정표시장치는 동영상을 표시하기에 적합하다. 액티브 매트릭스 타입의 액정표시장치에 사용되는 스위칭소자로는 주로 박막트랜지스터(Thin Film Transistor; 이하 "TFT"라 함)가 이용되고 있다. The liquid crystal display device displays an image by adjusting light transmittance of liquid crystal cells according to a video signal. An active matrix liquid crystal display device in which switching elements are formed for each liquid crystal cell is suitable for displaying moving images. As a switching element used in an active matrix liquid crystal display device, a thin film transistor (hereinafter, referred to as TFT) is mainly used.

액정표시장치는 수학식 1 및 2에서 알 수 있는 바, 액정의 고유한 점성과 탄성 등의 특성에 의해 응답속도가 느린 단점이 있다. As can be seen in Equations 1 and 2, the liquid crystal display has a disadvantage in that the response speed is slow due to the inherent viscosity and elasticity of the liquid crystal.

Figure 112003004010664-pat00001
Figure 112003004010664-pat00001

여기서, τr는 액정에 전압이 인가될 때의 라이징 타임(rising time)을, Va는 인가전압을, VF는 액정분자가 경사운동을 시작하는 프리드릭 천이 전압(Freederick Transition Voltage)을, d는 액정셀의 셀갭(cell gap)을,

Figure 112003004010664-pat00002
(gamma)는 액정분자의 회전점도(rotational viscosity)를 각각 의미한다. Where τ r is the rising time when voltage is applied to the liquid crystal, Va is the applied voltage, and V F is the Freederick Transition Voltage at which the liquid crystal molecules begin their inclined motion, d Is the cell gap of the liquid crystal cell,
Figure 112003004010664-pat00002
(gamma) means rotational viscosity of liquid crystal molecules, respectively.

Figure 112003004010664-pat00003
Figure 112003004010664-pat00003

여기서, τf는 액정에 인가된 전압이 오프된 후 액정이 탄성 복원력에 의해 원위치로 복원되는 폴링타임(falling time)을, K는 액정 고유의 탄성계수를 각각 의미한다. Here, τ f denotes a falling time during which the liquid crystal is restored to its original position by the elastic restoring force after the voltage applied to the liquid crystal is turned off, and K denotes the elastic modulus inherent to the liquid crystal.

TN 모드의 액정 응답속도는 액정 재료의 물성과 셀갭 등에 의해 달라질 수 있지만 통상, 라이징 타임이 20-80ms이고 폴링 타임이 20-30ms이다. 이러한 액정의 응답속도는 동영상의 한 프레임기간(NTSC : 16.67ms)보다 길기 때문에 도 1과 같이 액정셀에 충전되는 전압이 원하는 전압에 도달하기 전에 다음 프레임으로 진행되기 때문에 동영상에서 화면이 흐릿하게 되는 모션블러링(Motion Burring) 현상이 나타나게 된다. The liquid crystal response speed of the TN mode may vary depending on the physical properties of the liquid crystal material, the cell gap, and the like, but usually has a rising time of 20-80 ms and a polling time of 20-30 ms. Since the response speed of the liquid crystal is longer than one frame period (NTSC: 16.67 ms) of the video, the screen is blurred in the video because the voltage charged in the liquid crystal cell proceeds to the next frame as shown in FIG. 1. Motion blurring phenomenon appears.

도 1을 참조하면, 종래의 액정표시장치는 동영상 구현시 느린 응답속도로 인하여 한 레벨에서 다른 레벨로 소스 데이터(SD)가 변할 때 그에 대응하는 휘도(SBL)가 원하는 휘도에 도달하지 못하게 되어 원하는 색과 휘도를 표현하지 못 하게 된다. 그 결과, 액정표시장치는 동화상에서 모션 블러링 현상이 나타나게 되고, 명암비(Contrast ratio)의 저하로 인하여 표시품질이 떨어지게 된다. Referring to FIG. 1, a conventional liquid crystal display device does not reach a desired luminance when the source data SD changes from one level to another due to a slow response speed when a video is implemented. It can't express color and brightness. As a result, the motion blurring phenomenon appears in the moving picture, and the display quality is deteriorated due to the decrease in the contrast ratio.

이러한 액정표시장치의 느린 응답속도를 해결하기 위하여, 미국특허 제5,495,265호와 PCT 국제공개번호 WO 99/05567에는 룩업 테이블을 이용하여 데이터를 변조하여 액정셀의 느린 응답속도를 보상하는 방안(이하, '고속 구동방법'이라 한다)이 제안된 바 있다. 이 고속 구동방법은 도 2와 같은 원리로 데이터를 변조하게 된다. In order to solve the slow response speed of the liquid crystal display, U.S. Patent No. 5,495,265 and PCT International Publication No. WO 99/05567 propose a method of compensating for the slow response speed of a liquid crystal cell by modulating data using a lookup table (hereinafter, 'High speed driving method' has been proposed. This high speed driving method modulates data in the same principle as in FIG. 2.

도 2를 참조하면, 고속 구동방법은 소스 데이터(SD)를 미리 설정된 변조 데이터(MD)로 변조하고 그 변조 데이터(MD)를 액정셀에 인가하여 원하는 휘도(MBL)를 얻게 된다. 변조 데이터(MD)는 룩업 테이블로 구성되어 메모리에 저장된다. Referring to FIG. 2, the high speed driving method modulates the source data SD into preset modulation data MD and applies the modulation data MD to the liquid crystal cell to obtain a desired luminance MBL. The modulation data MD is composed of a lookup table and stored in a memory.

이러한 고속 구동방법은 한 프레임기간 내에 소스 데이터의 휘도값에 대응하여 원하는 휘도를 얻을 수 있도록 수학식 1에서

Figure 112003004010664-pat00004
을 크게 하게 된다. 따라서, 고속 구동방법을 이용하는 액정표시장치는 액정의 늦은 응답속도를 데이터값의 변조로 보상하여 동화상에서 모션 블러링(Motion Burring) 현상을 완화시킴으로써 원하는 색과 휘도로 화상을 표시할 수 있게 된다. Such a high speed driving method uses Equation 1 to obtain a desired luminance corresponding to the luminance value of the source data within one frame period.
Figure 112003004010664-pat00004
To make it larger. Accordingly, the liquid crystal display device using the high speed driving method compensates the late response speed of the liquid crystal by modulating the data value, thereby alleviating the motion blurring phenomenon in the moving image, thereby displaying an image with a desired color and luminance.

룩업 테이블에 등재된 변조 데이터는 아래의 관계식 ① 내지 ③의 조건을 만족하도록 그 값이 설정된다. The modulation data listed in the lookup table is set to satisfy the conditions of the following relations 1 to 3 below.

SDn < SDn-1 ---> MD < SDn -------- ①SDn <SDn-1 ---> MD <SDn -------- ①

SDn = SDn-1 ---> MD = SDn -------- ② SDn = SDn-1 ---> MD = SDn -------- ②                         

SDn > SDn-1 ---> MD > SDn -------- ③SDn> SDn-1 ---> MD> SDn -------- ③

관계식 ① 내지 ③에 있어서, SDn-1은 이전 프레임의 소스 데이터, SDn은 현재 프레임의 소스 데이터, 그리고 MD는 룩업 테이블에 등재되는 변조 데이터를 각각 나타낸다. In the relations (1) to (3), SDn-1 represents source data of a previous frame, SDn represents source data of a current frame, and MD represents modulation data listed in a lookup table.

변조 데이터를 로딩하기 위해서는 도 3과 같이 룩업 테이블이 저장된 메모리와 액정표시장치의 타이밍 콘트롤러 사이에 룩업 테이블의 로딩에 필요한 많은 수의 제어 라인들과 데이터 입/출력 라인들이 필요하다. In order to load the modulation data, as shown in FIG. 3, a large number of control lines and data input / output lines required for loading the lookup table are required between the memory in which the lookup table is stored and the timing controller of the LCD.

도 3을 참조하면, 타이밍 콘트롤러(31)와 ROM(Read Only Memory)(32) 사이에는 많은 수의 병렬 어드레스 제어 라인들(34)과 데이터 입/출력 라인들(35)이 형성된다. Referring to FIG. 3, a large number of parallel address control lines 34 and data input / output lines 35 are formed between the timing controller 31 and the read only memory (ROM) 32.

타이밍 콘트롤러(31)는 전원이 켜지면 병렬 어드레스 지정신호(PAC)를 ROM(32)에 공급하여 ROM(32) 내에 저장된 룩업 테이블(LUT)을 내장된 RAM(Random Access Memory)(36)으로 로딩한다. 룩업 테이블(LUT)의 로딩이 완료되면 타이밍 콘트롤러(31)는 소스 데이터(SD)에 대응하는 변조 데이터(MD)를 RAM(36)에 저장된 룩업 테이블(LUT)에서 독출하고 그 변조 데이터(MD)를 데이터 구동회로에 공급한다. 한편, 룩업 테이블(LUT)의 로딩 과정 중에는 RAM(36)에 저장된 임의의 데이터나 블랙 데이터가 데이터 구동회로에 공급된다. 또한, 타이밍 콘트롤러(31)는 수직/수평동기신호(H,V)와 클럭신호(CL)를 이용하여 데이터 구동회로와 게이트 구동회로에 필요한 타이밍 제어신호들을 발생한다. The timing controller 31 supplies a parallel addressing signal (PAC) to the ROM 32 when the power is turned on, and loads a lookup table (LUT) stored in the ROM 32 into the built-in random access memory (RAM) 36. do. When loading of the lookup table LUT is completed, the timing controller 31 reads out the modulation data MD corresponding to the source data SD from the lookup table LUT stored in the RAM 36 and modulates the modulation data MD. Is supplied to the data driving circuit. Meanwhile, any data or black data stored in the RAM 36 is supplied to the data driving circuit during the loading of the lookup table LUT. In addition, the timing controller 31 generates timing control signals necessary for the data driving circuit and the gate driving circuit using the vertical / horizontal synchronization signals H and V and the clock signal CL.

병렬 어드레스 지정신호(PAC)는 14[bits]이며, 변조 데이터(MD)는 6[bits] 또는 8[bits]이다. 따라서, 타이밍 콘트롤러(31)와 ROM(32) 사이에는 적어도 20 개 이상의 어드레스/데이터 라인들이 필요하며, 그에 따른 입출력핀들이 타이밍 콘트롤러(31)와 ROM(32) 각각에 형성되어야 한다. 이 때문에 타이밍 콘트롤러(31)와 ROM(32) 각각의 크기와 그 타이밍 콘트롤러(31)와 ROM(32)이 실장되는 인쇄회로보드(Printed Circuit Board : PCB)가 커질 수 밖에 없다.
The parallel addressing signal PAC is 14 [bits] and the modulation data MD is 6 [bits] or 8 [bits]. Therefore, at least 20 address / data lines are required between the timing controller 31 and the ROM 32, and thus input / output pins should be formed in each of the timing controller 31 and the ROM 32. For this reason, the size of each of the timing controller 31 and the ROM 32 and the printed circuit board (PCB) on which the timing controller 31 and the ROM 32 are mounted are large.

따라서, 본 발명의 목적은 회로소자의 크기를 줄이고 배선 수와 입/출력핀수를 줄이도록 한 액정표시장치의 데이터 로딩방법 및 장치를 제공함에 있다.Accordingly, an object of the present invention is to provide a data loading method and apparatus for a liquid crystal display device which reduces the size of circuit elements and reduces the number of wirings and the number of input / output pins.

본 발명의 다른 목적은 고속구동을 위한 변조데이터의 로딩에 필요한 신호라인들의 수와 핀수를 줄이고 회로소자의 크기를 줄이도록 한 액정표시장치를 제공함에 있다.
Another object of the present invention is to provide a liquid crystal display device which reduces the number of signal lines and the number of pins necessary for loading modulation data for high-speed driving, and reduces the size of circuit elements.

상기 목적을 달성하기 위하여, 본 발명의 실시예에 따른 액정표시장치의 데이터 로딩방법은 직렬 어드레스 지정신호를 발생하는 단계와; 직렬 어드레스 지정신호에 응답하여 제1 메모리에 저장된 변조 데이터를 제2 메모리로 로딩하는 단계를 포함한다. In order to achieve the above object, a data loading method of a liquid crystal display according to an embodiment of the present invention comprises the steps of generating a serial addressing signal; Loading modulated data stored in the first memory into the second memory in response to the serial addressing signal.

상기 데이터 로딩방법은 상기 변조 데이터의 로딩을 전원이 켜질 때 실시하는 것을 특징으로 한다. The data loading method is characterized in that the loading of the modulation data is carried out when the power is turned on.                     

상기 데이터 로딩방법은 소스 데이터를 입력 받는 단계를 더 포함한다. The data loading method further includes receiving source data.

상기 데이터 로딩방법은 변조 데이터의 로딩 과정 중에는 소스 데이터를 출력하는 단계를 더 포함한다. The data loading method further includes outputting source data during a loading process of modulated data.

상기 데이터 로딩방법은 변조 데이터의 로딩이 완료되면 변조 데이터를 출력하는 단계를 더 포함한다. The data loading method further includes outputting modulated data when loading of the modulated data is completed.

상기 데이터 로딩방법은 변조 데이터를 액정패널에 공급하여 화상을 표시하는 단계를 더 포함한다. The data loading method further includes supplying modulated data to the liquid crystal panel to display an image.

상기 데이터 로딩방법은 변조 데이터를 직렬로 상기 제2 메모리에 로딩하는 것을 특징으로 한다. The data loading method is characterized in that to load the modulation data in the second memory in series.

본 발명의 실시예에 따른 액정표시장치의 데이터 로딩장치는 변조 데이터가 저장되고 직렬 어드레스 지정신호에 응답하여 변조 데이터를 출력하는 제1 메모리와; 직렬 어드레스 지정신호를 발생하여 변조 데이터를 로딩받는 제2 메모리를 구비한다. A data loading apparatus of a liquid crystal display according to an embodiment of the present invention includes a first memory for storing modulated data and outputting modulated data in response to a serial addressing signal; And a second memory configured to generate a serial addressing signal and to load modulated data.

상기 제1 메모리는 ROM이며, 상기 제2 메모리는 RAM인 것을 특징으로 한다.The first memory is a ROM, and the second memory is a RAM.

상기 데이터 로딩장치는 액정패널과; 액정패널에 데이터를 공급하기 위한 데이터 구동회로와; 액정패널에 스캔신호를 공급하기 위한 스캔 구동회로와; 데이터 구동회로와 스캔 구동회로를 제어하기 위한 타이밍 콘트롤러를 더 구비한다. The data loading device includes a liquid crystal panel; A data driving circuit for supplying data to the liquid crystal panel; A scan driving circuit for supplying a scan signal to the liquid crystal panel; A timing controller for controlling the data driving circuit and the scan driving circuit is further provided.

상기 제2 메모리는 상기 타이밍 콘트롤러 내에 내장되고, 변조 데이터의 로딩완료여부를 지시하는 플래그신호를 발생하는 것을 특징으로 한다.The second memory may be built in the timing controller and generate a flag signal indicating whether loading of the modulated data is completed.

상기 데이터 로딩장치는 소스 데이터가 입력되는 입력라인과; 스위치 제어신 호에 응답하여 변조 데이터와 소스 데이터를 선택하기 위한 스위치소자와; 제2 메모리에 변조 데이터의 로딩을 지시하는 로딩 명령을 발생함과 아울러 제2 메모리로부터의 플래그신호에 응답하여 스위치 제어신호를 발생하는 스위치 제어소자를 더 구비한다. The data loading device includes an input line to which source data is input; A switch element for selecting modulation data and source data in response to a switch control signal; And a switch control element for generating a loading command for instructing loading of the modulation data into the second memory and generating a switch control signal in response to a flag signal from the second memory.

상기 데이터 로딩장치는 변조 데이터의 로딩을 전원이 켜질 때 실시하는 것을 특징으로 한다. The data loading device is characterized in that the loading of the modulation data is carried out when the power is turned on.

상기 스위치소자는 스위치 제어신호의 제1 논리값에 응답하여 변조 데이터의 로딩 과정 중에 상기 소스 데이터를 선택하고, 스위치 제어신호의 제2 논리값에 응답하여 변조 데이터의 로딩이 완료되면 변조 데이터를 선택하는 것을 특징으로 한다. The switch element selects the source data during the loading of the modulation data in response to the first logic value of the switch control signal, and selects the modulation data when loading of the modulation data is completed in response to the second logic value of the switch control signal. Characterized in that.

상기 데이터 로딩장치는 변조 데이터를 직렬로 제2 메모리에 로딩하는 것을 특징으로 한다. The data loading device is characterized in that to load the modulation data in the second memory in series.

본 발명의 실시예에 따른 액정표시장치는 액정패널과; 액정패널에 데이터를 공급하기 위한 데이터 구동회로와; 액정패널에 스캔신호를 공급하기 위한 스캔 구동회로와; 변조 데이터가 저장된 메모리와; 메모리의 어드레스를 지정하는 어드레스신호를 메모리에 직렬로 공급하고 메모리로부터 변조 데이터를 직렬로 로딩받아 변조 데이터를 데이터 구동회로에 공급함과 아울러 데이터 구동회로와 스캔 구동회로를 제어하기 위한 타이밍 콘트롤러를 구비한다. According to an embodiment of the present invention, a liquid crystal display device includes: a liquid crystal panel; A data driving circuit for supplying data to the liquid crystal panel; A scan driving circuit for supplying a scan signal to the liquid crystal panel; A memory in which modulation data is stored; And a timing controller for supplying an address signal specifying a memory address in series to the memory, loading modulation data from the memory in series, and supplying modulation data to the data driving circuit, and controlling the data driving circuit and the scan driving circuit. .

상기 액정표시장치는 변조 데이터의 로딩을 전원이 켜질 때 실시하는 것을 특징으로 한다. The liquid crystal display device is characterized in that the loading of the modulation data is carried out when the power is turned on.                     

상기 액정표시장치는 소스 데이터를 상기 타이밍 콘트롤러에 공급하기 위한 입력라인을 더 구비한다. The liquid crystal display further includes an input line for supplying source data to the timing controller.

상기 타이밍 콘트롤러는 변조 데이터의 로딩 과정 중에 소스 데이터를 데이터 구동회로에 공급하고, 변조 데이터의 로딩이 완료되면 변조 데이터를 데이터 구동회로에 공급하는 것을 특징으로 한다. The timing controller may supply the source data to the data driving circuit during the loading of the modulation data, and supply the modulation data to the data driving circuit when the loading of the modulation data is completed.

이하, 도 4 내지 도 6을 참조하여 본 발명의 바람직한 실시예에 대하여 설명하기로 한다.Hereinafter, exemplary embodiments of the present invention will be described with reference to FIGS. 4 to 6.

도 4를 참조하면,본 발명의 실시예에 따른 액정표시장치는 액정패널(44)과, 액정패널(44)에 형성된 데이터라인(D1 내지 Dm)에 데이터를 공급하기 위한 데이터 구동회로(42)와, 액정패널(44)에 형성된 게이트라인(G1 내지 Gn)에 스캔펄스를 공급하기 위한 게이트 구동회로(43)와, 직렬 로딩방식으로 ROM(45)으로부터 변조 데이터를 로딩하고 데이터 구동회로(42) 및 게이트 구동회로(43)를 제어하기 위한 타이밍 콘트롤러(41)를 구비한다. Referring to FIG. 4, the liquid crystal display according to the exemplary embodiment of the present invention includes a data driving circuit 42 for supplying data to the liquid crystal panel 44 and the data lines D1 to Dm formed on the liquid crystal panel 44. And a gate driving circuit 43 for supplying scan pulses to the gate lines G1 to Gn formed in the liquid crystal panel 44, and loading the modulation data from the ROM 45 in a serial loading manner and performing a data driving circuit 42. ) And a timing controller 41 for controlling the gate driving circuit 43.

액정패널(44)은 두 장의 유리기판 사이에 액정셀이 매트릭스 형태로 배치된다. 이 액정패널(44)의 하부 유리기판 상에는 데이터라인들(D1 내지 Dm)과 게이트라인들(G1 내지 Gn)이 상호 직교된다. 데이터라인들(D1 내지 Dm)과 게이트라인들(G1 내지 Gn)의 교차부에는 박막트랜지스터(Thin film transistor : 이하 "TFT"라 한다)가 형성된다. TFT는 게이트라인(G1 내지 Gn)으로부터의 스캔펄스에 응답하여 데이터라인들(D1 내지 Dm) 상의 데이터를 액정셀(Clc)에 공급하는 스위치소자이다. 이 TFT의 게이트전극은 게이트라인(G1 내지 Gn)에 접속되며, 소 스전극은 데이터라인(D1 내지 Dm)에 접속된다. TFT의 드레인전극은 액정셀(Clc)의 화소전극에 접속된다. 그리고 액정패널(44)에서 각 액정셀(Clc)에는 액정셀(Clc)에 충전된 전압을 일정하게 유지시키기 위한 스토리지 캐패시터(Cst)가 형성된다. In the liquid crystal panel 44, liquid crystal cells are arranged in a matrix form between two glass substrates. The data lines D1 to Dm and the gate lines G1 to Gn are orthogonal to each other on the lower glass substrate of the liquid crystal panel 44. Thin film transistors (hereinafter referred to as TFTs) are formed at the intersections of the data lines D1 to Dm and the gate lines G1 to Gn. The TFT is a switch element for supplying data on the data lines D1 to Dm to the liquid crystal cell Clc in response to a scan pulse from the gate lines G1 to Gn. The gate electrode of this TFT is connected to the gate lines G1 to Gn, and the source electrode is connected to the data lines D1 to Dm. The drain electrode of the TFT is connected to the pixel electrode of the liquid crystal cell Clc. In the liquid crystal panel 44, a storage capacitor Cst is formed in each liquid crystal cell Clc to maintain a constant voltage charged in the liquid crystal cell Clc.

데이터 구동회로(42)는 클럭을 샘플링하기 위한 쉬프트레지스터, 데이터를 일시저장하기 위한 레지스터, 쉬프트레지스터로부터의 클럭신호에 응답하여 데이터를 1 라인분씩 저장하고 저장된 1 라인분의 데이터를 동시에 출력하기 위한 래치, 래치로부터의 디지털 데이터값에 대응하여 정극성/부극성의 감마전압을 선택하기 위한 디지털-아날로그 변환기, 정극성/부극성 감마전압에 의해 변환된 아날로그 데이터가 공급되는 데이터라인(D1 내지 Dm)을 선택하기 위한 멀티플렉서 및 멀티플렉서와 데이터라인 사이에 접속된 출력버퍼 등으로 구성된다. 이 데이터 구동회로(42)는 타이밍 콘트롤러(41)의 제어 하에 타이밍 콘트롤러(410로부터 입력되는 디지털 변조 데이터(MD)를 아날로그 전압으로 변환하고 그 아날로그 전압의 극성을 도트 인버젼, 컬럼 인버젼, 라인 인버젼 등의 극성반전 방식에 따라 제어한다. The data driving circuit 42 stores a shift line for sampling a clock, a register for temporarily storing data, a line for storing data in response to a clock signal from the shift register, and simultaneously outputs the stored one line of data. Latch, a digital-to-analog converter for selecting a positive / negative gamma voltage corresponding to the digital data value from the latch, and a data line to which analog data converted by the positive / negative gamma voltage is supplied (D1 to Dm) ), And a multiplexer for selecting) and an output buffer connected between the multiplexer and the data line. The data driving circuit 42 converts the digital modulation data MD input from the timing controller 410 into an analog voltage under the control of the timing controller 41 and converts the polarity of the analog voltage into dot inversion, column inversion, and line. Control is performed according to the polarity inversion method such as inversion.

게이트 구동회로(43)는 스캔펄스를 순차적으로 발생하는 쉬프트 레지스터와, 스캔펄스의 전압을 액정셀(Clc)의 구동에 적합한 레벨로 쉬프트시키기 위한 레벨 쉬프터 등으로 구성된다. 이 게이트 구동회로(43)는 타이밍 콘트롤러(41)의 제어 하에 게이트라인들(G1 내지 Gn)에 순차적으로 스캔펄스를 공급한다. The gate driving circuit 43 includes a shift register for sequentially generating scan pulses, and a level shifter for shifting the voltage of the scan pulses to a level suitable for driving the liquid crystal cell Clc. The gate driving circuit 43 sequentially supplies scan pulses to the gate lines G1 to Gn under the control of the timing controller 41.

타이밍 콘트롤러(41)는 전원이 켜지면 직렬 로딩방식으로 ROM(45)에 저장된 룩업 테이블을 내장된 RAM으로 로딩하고 도시하지 않은 시스템 본체로부터 입력되 는 소스 데이터(SD)에 대응하는 변조 데이터(MD)를 선택하여 데이터 구동부(42)에 공급한다. 또한, 타이밍 콘트롤러(41)는 수직/수평 동기신호(V,H)와 클럭신호(CLK)를 이용하여 게이트 구동회로(43)를 제어하기 위한 게이트 제어신호(GDC)와 데이터 구동회로(42)를 제어하기 위한 데이터 제어신호(DDC)를 발생한다. 데이터 제어신호(DDC)는 소스 스타트 펄스(Source Start Pulse : SSP), 소스 쉬프트 클럭(Source Shift Clock : SSC), 소스 출력신호(Source Output Enable : SOE), 극성신호(Polarity : POL) 등을 포함한다. 게이트 제어신호(GDC)는 게이트 쉬프트 클럭(Gate Shift Clock : GSC), 게이트 출력신호(Gate Output Enable : GOE), 게이트 스타트 펄스(Gate Start Pulse : GSP) 등을 포함한다. The timing controller 41 loads the lookup table stored in the ROM 45 into the built-in RAM when the power is turned on, and modulates the data MD corresponding to the source data SD input from the system main body (not shown). ) Is supplied to the data driver 42. In addition, the timing controller 41 uses a gate control signal GDC and a data driving circuit 42 for controlling the gate driving circuit 43 by using the vertical / horizontal synchronization signals V and H and the clock signal CLK. It generates a data control signal (DDC) for controlling. The data control signal (DDC) includes a source start pulse (SSP), a source shift clock (SSC), a source output signal (SOE), and a polarity signal (POL). do. The gate control signal GDC includes a gate shift clock (GSC), a gate output signal (GOE), a gate start pulse (GSP), and the like.

ROM(45)은 변조 데이터가 등재된 룩업 테이블이 미리 저장되어 있으며, 전원이 켜지면 타이밍 콘트롤러(41)의 제어 하에 그 룩업 테이블을 타이밍 콘트롤러(41)에 공급한다. 이 ROM(45)은 변조 데이터의 소거 및 갱신이 가능하도록 EEPROM(Electrically erasable ROM)으로 구현될 수 있다. ROM(45)에 저장된 변조 데이터와 룩업 테이블(LUT)은 본원 출원인에 의해 기출원된 특허출원 제10-2001-028907호, 특허출원제10-2001-032464호, 특허출원 제10-2001-054123호, 특허출원 제10-2001-054124, 특허출원 제10-2001-054125호, 특허출원 제10-2001-054327호, 특허출원 제10-2001-054889호, 특허출원 제10-2001-054127호, 특허출원 제10-2001-054128호, 특허출원 제10-2001-057119호, 특허출원 제10-2001-056235호, 특허출원 제10-2001-079008호, 특허출원 제10-2001-078449호, 특허출원 제10-2002-046858호, 특허출원 제10-2002-074366호 각각에 개시된 변조 데이터와 룩업 테이블 로 구현될 수 있다. The ROM 45 stores a lookup table in which modulation data is registered in advance, and supplies a lookup table to the timing controller 41 under the control of the timing controller 41 when the power is turned on. The ROM 45 may be embodied as an electrically erasable ROM (EEPROM) to enable erasure and update of modulated data. The modulation data and look-up table (LUT) stored in the ROM 45 are disclosed in Patent Application No. 10-2001-028907, Patent Application No. 10-2001-032464, and Patent Application No. 10-2001-054123 filed by the present applicant. Patent Application No. 10-2001-054124, Patent Application No. 10-2001-054125, Patent Application No. 10-2001-054327, Patent Application No. 10-2001-054889, Patent Application No. 10-2001-054127 , Patent Application No. 10-2001-054128, Patent Application No. 10-2001-057119, Patent Application No. 10-2001-056235, Patent Application No. 10-2001-079008, Patent Application No. 10-2001-078449 In addition, the present invention may be implemented with modulation data and look-up tables disclosed in Patent Application Nos. 10-2002-046858 and 10-2002-074366, respectively.

도 5는 타이밍 콘트롤러(41)와 ROM(45)을 상세히 나타낸다. 그리고 도 6은 타이밍 콘트롤러(41)와 ROM(45)의 입/출력 파형을 나타내는 파형도이다. 5 shows the timing controller 41 and the ROM 45 in detail. 6 is a waveform diagram showing input / output waveforms of the timing controller 41 and the ROM 45.

도 5 및 도 6을 참조하면, 타이밍 콘트롤러(41)는 전원이 켜지면 ROM(45)으로부터 룩업 테이블(LUT)이 로딩되는 RAM(51)과, 룩업 테이블(LUT)의 로딩완료여부에 따라 멀티플렉서(Multuplexer)(52)와 RAM(51)을 제어하기 위한 FSM(Finite State Machine)(53)을 구비한다. 5 and 6, the timing controller 41 is a multiplexer according to whether the RAM 51 is loaded from the ROM 45 when the power is turned on, and whether the lookup table LUT is completely loaded. (Multuplexer) 52 and a finite state machine (FSM) 53 for controlling the RAM 51.

RAM(51)은 SRAM(Static RAM)으로 구현되며 전원이 켜지면 FSM(53)으로부터의 명령(LC)에 응답하여 ROM(45) 내의 어드레스를 지정하기 위한 직렬 어드레스신호(SC)를 ROM(45)에 공급한다. 그리고 RAM(51)은 ROM(45)으로부터 변조 데이터(MD) 즉, 룩업 테이블(LUT)을 직렬로 로딩 받고 룩업 테이블(LUT)의 로딩이 완료되면 플래그신호(LF)를 FSM(53)에 공급한다. The RAM 51 is implemented as a static RAM (SRAM), and when the power is turned on, the ROM 51 outputs a serial address signal SC for specifying an address in the ROM 45 in response to a command LC from the FSM 53. Supplies). The RAM 51 loads the modulation data MD, that is, the lookup table LUT, from the ROM 45 in series and supplies the flag signal LF to the FSM 53 when the loading of the lookup table LUT is completed. do.

RAM(51)으로부터의 직렬 어드레스신호(SC)는 하나의 제어버스라인을 경유하여 ROM(45)으로 공급된다. 그리고 ROM(45)으로부터의 변조 데이터(MD)는 하나의 데이터버스라인을 경유하여 RAM(51)에 전송된다. The serial address signal SC from the RAM 51 is supplied to the ROM 45 via one control bus line. The modulated data MD from the ROM 45 is transferred to the RAM 51 via one data bus line.

멀티플렉서(52)는 입력라인으로부터의 소스 데이터(SD)와 RAM(51)으로부터의 변조 데이터(MD)를 입력 받는다. 또한, 멀티플렉서(52)는 FSM(53)으로부터의 스위치 제어신호(MUXC)에 응답하여 입력신호들(SD,MD) 중 어느 하나를 선택하고 선택된 데이터(SD,MD)를 데이터 구동회로(42)에 공급한다. The multiplexer 52 receives the source data SD from the input line and the modulation data MD from the RAM 51. In addition, the multiplexer 52 selects any one of the input signals SD and MD in response to the switch control signal MUXC from the FSM 53 and selects the selected data SD and MD from the data driving circuit 42. To feed.

FSM(53)은 전원이 켜지면 룩업 테이블(LUT)을 로딩하기 위하여 룩업 테이블 로딩 명령(LC)을 발생하고, RAM(51)에 룩업 테이블(LUT)의 로딩이 완료여부를 지시하는 플래그신호(LF)를 RAM(51)으로부터 입력 받는다. 또한, FSM(53)은 플래그신호(LF)에 따라 스위치 제어신호(MUXC)를 발생한다. The FSM 53 generates a lookup table loading command LC to load the lookup table LUT when the power is turned on, and indicates a flag signal indicating whether the loading of the lookup table LUT is completed in the RAM 51. LF) is input from the RAM 51. In addition, the FSM 53 generates the switch control signal MUXC according to the flag signal LF.

전원이 켜지면 직렬 어드레스신호(SC)에 응답하여 ROM(LUT)으로부터 타이밍 콘트롤러(41)의 RAM(51)에 룩업 테이블(LUT)이 로딩된다. 룩업 테이블(LUT)의 로딩 과정 중에, FSM(53)으로부터 발생되는 스위치 제어신호(MUXC)는 플래그신호(LF)의 제1 논리값에 따라 소스 데이터(SD)의 출력을 지시하는 제1 논리값을 유지한다. 따라서, 룩업 테이블(LUT)의 로딩 과정 중이면 타이밍 콘트롤러(41)는 소스 데이터(SD)를 데이터 구동회로(42)에 공급한다. 룩업 테이블(LUT)의 로딩이 완료되면 FSM(53)으로부터 발생되는 스위치 제어신호(MUXC)는 플래그신호(LF)의 제2 논리값에 따라 변조 데이터(MD)의 출력을 지시하는 제2 논리값을 유지한다. 따라서, 룩업 테이블(LUT)의 로딩이 완료되면 타이밍 콘트롤러(41)는 변조 데이터(MD)를 데이터 구동회로(42)에 공급한다.
When the power is turned on, the lookup table LUT is loaded from the ROM (LUT) into the RAM 51 of the timing controller 41 in response to the serial address signal SC. During the loading process of the lookup table LUT, the switch control signal MUXC generated from the FSM 53 is a first logic value indicating the output of the source data SD according to the first logic value of the flag signal LF. Keep it. Therefore, when the lookup table LUT is being loaded, the timing controller 41 supplies the source data SD to the data driving circuit 42. When the loading of the lookup table LUT is completed, the switch control signal MUXC generated from the FSM 53 may indicate a second logic value indicating the output of the modulation data MD according to the second logic value of the flag signal LF. Keep it. Therefore, when loading of the lookup table LUT is completed, the timing controller 41 supplies the modulation data MD to the data driving circuit 42.

상술한 바와 같이, 본 발명에 따른 액정표시장치의 데이터 로딩방법 및 장치는 타이밍 콘트롤러로부터 발생되는 어드레스 지정신호를 하나의 라인을 경유하여 ROM에 직렬 방식으로 전송하고 ROM으로부터 룩업 테이블의 변조 데이터를 하나의 라인을 경유하여 타이밍 콘트롤러 내의 RAM에 로딩하게 된다. 그 결과, 본 발명에 따른 액정표시장치의 데이터 로딩방법 및 장치는 2 개의 라인만으로 타이밍 콘트롤 러와 ROM 사이에 변조 데이터의 로딩이 가능하므로 타이밍 콘트롤러와 ROM의 크기를 줄이고 배선 수와 입/출력핀수를 줄일 수 있다. 나아가, 본 발명에 따른 액정표시장치의 데이터 로딩방법 및 장치는 전원이 켜질 때 소스 데이터를 출력함으로써 전원이 켜질 때 표시품질의 저하를 최소화할 수 있다. 또한, 본 발명에 따른 액정표시장치는 타이밍 콘트롤러와 ROM 사이의 신호라인들의 수와 핀수를 최소화할 수 있고 그 결과 상기 타이밍 콘트롤러와 상기 ROM의 크기를 줄일 수 있다. As described above, the data loading method and apparatus of the liquid crystal display according to the present invention transmit the addressing signal generated from the timing controller to the ROM via one line in a serial manner and transmit the modulation data of the lookup table from the ROM. It is loaded into RAM in the timing controller via the line of. As a result, the data loading method and apparatus of the liquid crystal display according to the present invention can load modulation data between the timing controller and the ROM using only two lines, thereby reducing the size of the timing controller and the ROM, the number of wirings, and the number of input / output pins. Can be reduced. Furthermore, the data loading method and apparatus of the liquid crystal display according to the present invention can minimize the deterioration of display quality when the power is turned on by outputting source data when the power is turned on. In addition, the liquid crystal display according to the present invention can minimize the number of pins and the number of signal lines between the timing controller and the ROM, thereby reducing the size of the timing controller and the ROM.

이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정해져야만 할 것이다.Those skilled in the art will appreciate that various changes and modifications can be made without departing from the technical spirit of the present invention. Therefore, the technical scope of the present invention should not be limited to the contents described in the detailed description of the specification but should be defined by the claims.

Claims (19)

직렬 어드레스 지정신호를 발생하는 단계와;Generating a serial addressing signal; 상기 직렬 어드레스 지정신호에 응답하여 제1 메모리에 저장된 변조 데이터를 제2 메모리로 로딩하는 단계를 포함하는 것을 특징으로 하는 액정표시장치의 데이터 로딩방법. And loading modulated data stored in a first memory into a second memory in response to the serial addressing signal. 제 1 항에 있어서, The method of claim 1, 상기 변조 데이터의 로딩은 전원이 켜질 때 실시되는 것을 특징으로 하는 액정표시장치의 데이터 로딩방법. And the loading of the modulated data is performed when the power is turned on. 제 1 항에 있어서, The method of claim 1, 소스 데이터를 입력 받는 단계를 더 포함하는 것을 특징으로 하는 액정표시장치의 데이터 로딩방법. The data loading method of the liquid crystal display device further comprising the step of receiving the source data. 제 3 항에 있어서, The method of claim 3, wherein 상기 변조 데이터의 로딩 과정 중에는 상기 소스 데이터를 출력하는 단계를 더 포함하는 것을 특징으로 하는 액정표시장치의 데이터 로딩방법. And outputting the source data during the loading of the modulated data. 제 3 항에 있어서, The method of claim 3, wherein 상기 변조 데이터의 로딩이 완료되면 상기 변조 데이터를 출력하는 단계를 더 포함하는 것을 특징으로 하는 액정표시장치의 데이터 로딩방법. And outputting the modulated data when the loading of the modulated data is completed. 제 1 항에 있어서, The method of claim 1, 상기 변조 데이터를 액정패널에 공급하여 화상을 표시하는 단계를 더 포함하는 것을 특징으로 하는 액정표시장치의 데이터 로딩방법. And supplying the modulated data to the liquid crystal panel to display an image. 제 1 항에 있어서, The method of claim 1, 상기 변조 데이터는 직렬로 상기 제2 메모리에 로딩되는 것을 특징으로 하는 액정표시장치의 데이터 로딩방법. And the modulated data is serially loaded into the second memory. 변조 데이터가 저장되고 직렬 어드레스 지정신호에 응답하여 상기 변조 데이터를 출력하는 제1 메모리와;A first memory for storing modulated data and outputting the modulated data in response to a serial addressing signal; 상기 직렬 어드레스 지정신호를 발생하여 상기 변조 데이터를 로딩받는 제2 메모리를 구비하는 것을 특징으로 하는 액정표시장치의 데이터 로딩장치. And a second memory configured to generate the serial address designation signal and to load the modulated data. 제 8 항에 있어서,The method of claim 8, 상기 제1 메모리는 ROM이며,The first memory is a ROM, 상기 제2 메모리는 RAM인 것을 특징으로 하는 액정표시장치의 데이터 로딩장치. And the second memory is a RAM. 제 8 항에 있어서, The method of claim 8, 액정패널과;A liquid crystal panel; 상기 액정패널에 데이터를 공급하기 위한 데이터 구동회로와;A data driver circuit for supplying data to the liquid crystal panel; 상기 액정패널에 스캔신호를 공급하기 위한 스캔 구동회로와;A scan driving circuit for supplying a scan signal to the liquid crystal panel; 상기 데이터 구동회로와 상기 스캔 구동회로를 제어하기 위한 타이밍 콘트롤러를 더 구비하는 것을 특징으로 하는 액정표시장치의 데이터 로딩장치. And a timing controller for controlling the data driving circuit and the scan driving circuit. 제 10 항에 있어서, The method of claim 10, 상기 제2 메모리는 상기 타이밍 콘트롤러 내에 내장되고;The second memory is embedded in the timing controller; 상기 변조 데이터의 로딩완료여부를 지시하는 플래그신호를 발생하는 것을 특징으로 하는 액정표시장치의 데이터 로딩장치. And a flag signal indicative of whether the modulation data is completely loaded. 제 11 항에 있어서, The method of claim 11, 소스 데이터가 입력되는 입력라인과;An input line to which source data is input; 스위치 제어신호에 응답하여 상기 변조 데이터와 상기 소스 데이터를 선택하기 위한 스위치소자와;A switch element for selecting the modulation data and the source data in response to a switch control signal; 상기 제2 메모리에 상기 변조 데이터의 로딩을 지시하는 로딩 명령을 발생함과 아울러 상기 제2 메모리로부터의 플래그신호에 응답하여 상기 스위치 제어신호를 발생하는 스위치 제어소자를 더 구비하는 것을 특징으로 하는 액정표시장치의 데이터 로딩장치. And a switch control element generating a loading command for instructing the loading of the modulated data into the second memory and generating the switch control signal in response to a flag signal from the second memory. Data loading device of display device. 제 8 항에 있어서, The method of claim 8, 상기 변조 데이터의 로딩은 전원이 켜질 때 실시되는 것을 특징으로 하는 액정표시장치의 데이터 로딩장치. The loading of the modulated data is performed when the power is turned on. 제 12 항에 있어서, The method of claim 12, 상기 스위치소자는 상기 스위치 제어신호의 제1 논리값에 응답하여 상기 변조 데이터의 로딩 과정 중에 상기 소스 데이터를 선택하고;The switch element selects the source data during the loading of the modulated data in response to a first logic value of the switch control signal; 상기 스위치 제어신호의 제2 논리값에 응답하여 상기 변조 데이터의 로딩이 완료되면 상기 변조 데이터를 선택하는 것을 특징으로 하는 액정표시장치의 데이터 로딩장치. And when the loading of the modulated data is completed in response to a second logic value of the switch control signal, selecting the modulated data. 제 8 항에 있어서, The method of claim 8, 상기 변조 데이터는 직렬로 상기 제2 메모리에 로딩되는 것을 특징으로 하는 액정표시장치의 데이터 로딩장치. And the modulated data is serially loaded into the second memory. 액정패널과;A liquid crystal panel; 상기 액정패널에 데이터를 공급하기 위한 데이터 구동회로와;A data driver circuit for supplying data to the liquid crystal panel; 상기 액정패널에 스캔신호를 공급하기 위한 스캔 구동회로와;A scan driving circuit for supplying a scan signal to the liquid crystal panel; 변조 데이터가 저장된 메모리와;A memory in which modulation data is stored; 상기 메모리의 어드레스를 지정하는 어드레스신호를 상기 메모리에 직렬로 공급하고 상기 메모리로부터 상기 변조 데이터를 직렬로 로딩받아 상기 변조 데이터를 상기 데이터 구동회로에 공급함과 아울러 상기 데이터 구동회로와 상기 스캔 구동회로를 제어하기 위한 타이밍 콘트롤러를 구비하는 것을 특징으로 하는 액정표시장치. Supplying an address signal specifying an address of the memory to the memory in series, loading the modulation data from the memory in series, supplying the modulation data to the data driving circuit, and supplying the data driving circuit and the scan driving circuit. And a timing controller for controlling the liquid crystal display. 제 16 항에 있어서,The method of claim 16, 상기 변조 데이터의 로딩은 전원이 켜질 때 실시되는 것을 특징으로 하는 액정표시장치. The loading of the modulated data is performed when the power is turned on. 제 16 항에 있어서, The method of claim 16, 소스 데이터를 상기 타이밍 콘트롤러에 공급하기 위한 입력라인을 더 구비하는 것을 특징으로 하는 액정표시장치. And an input line for supplying source data to the timing controller. 제 18 항에 있어서, The method of claim 18, 상기 타이밍 콘트롤러는 상기 변조 데이터의 로딩 과정 중에 상기 소스 데이터를 상기 데이터 구동회로에 공급하고;The timing controller supplies the source data to the data driving circuit during the loading of the modulated data; 상기 변조 데이터의 로딩이 완료되면 상기 변조 데이터를 상기 데이터 구동회로에 공급하는 것을 특징으로 하는 액정표시장치. And when the loading of the modulated data is completed, supplying the modulated data to the data driving circuit.
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