KR100655601B1 - Device and method for timing recovery based on window - Google Patents
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Abstract
본 발명은 디지털 수신기에서 수신된 아날로그 신호로부터 정확한 심볼을 검출하기 위하여 타이밍 에러를 복원하는 타이밍 복원장치 및 방법에 관한 것이다.The present invention relates to a timing recovery apparatus and method for recovering a timing error in order to detect an accurate symbol from an analog signal received at a digital receiver.
본 발명에 따른 윈도우 기반의 타이밍 복원 장치는, 수신된 아날로그 신호를 소정의 샘플링 속도로 샘플링한 데이터로부터, 현재 샘플 위치를 중심으로, 하나 이전의 샘플과 하나 이후의 샘플 간 샘플값의 차이를 이용하여 타이밍 에러를 검출하는 타이밍 에러 검출부; 및 상기 타이밍 에러 검출부로부터 타이밍 에러를 수신하여, 상기 샘플된 데이터 사이로 윈도우를 이동하며, 상기 타이밍 에러가 심볼 복원 여부를 판단하기 위해 설정된 문턱값 이하인 경우 상기 윈도우에 포함된 샘플 값을 이용하여 심볼을 복원하는 심볼 검출부를 포함하는 것을 특징으로 한다. The window-based timing recovery apparatus according to the present invention utilizes a difference in sample values between one previous sample and one subsequent sample, based on a current sample position, from data obtained by sampling a received analog signal at a predetermined sampling rate. A timing error detector for detecting a timing error; And receiving a timing error from the timing error detector, moving a window between the sampled data, and using a sample value included in the window when the timing error is less than or equal to a threshold set to determine whether to recover a symbol. And a symbol detecting unit for reconstructing.
디지털 수신기, 심볼, 타이밍 복원, 타이밍 에러 검출 Digital Receiver, Symbol, Timing Recovery, Timing Error Detection
Description
도 1은 일반적인 디지털 송수신기의 구성도.1 is a block diagram of a general digital transceiver.
도 2는 일반적인 가드너(Gardner) 방식의 타이밍 복원장치의 구성도.2 is a block diagram of a general Gardner type timing recovery apparatus.
도 3은 본 발명의 제1 실시예에 따른 윈도우 기반 타이밍 복원장치를 갖는 디지털 수신기의 구성도.3 is a block diagram of a digital receiver having a window-based timing recovery apparatus according to a first embodiment of the present invention.
도 4는 본 발명의 실시예에 따른 타이밍 에러 검출부의 세부 구성도. 4 is a detailed configuration diagram of a timing error detector according to an exemplary embodiment of the present invention.
도 5는 본 발명의 제1 실시예에 따른 심볼 검출 과정을 나타내는 도면.5 is a diagram illustrating a symbol detection process according to a first embodiment of the present invention.
도 6은 본 발명의 제2 실시예에 따른 타이밍 복원 장치부의 세부 구성도. 6 is a detailed block diagram of a timing recovery device according to a second embodiment of the present invention;
도 7은 본 발명의 제2 실시예에 따른 심볼 검출 과정을 나타내는 도면.7 is a diagram illustrating a symbol detection process according to a second embodiment of the present invention.
본 발명은 디지털 변조를 이용하여 데이터를 송수신하는 디지털 통신 장치에 관한 것으로, 특히 디지털 수신기에서 수신된 아날로그 신호로부터 정확한 심볼 (symbol)을 검출하기 위하여 타이밍 에러(timing error)를 복원하는 타이밍 복원장치 및 방법에 관한 것이다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a digital communication apparatus for transmitting and receiving data using digital modulation, and more particularly, to a timing recovery apparatus for recovering a timing error in order to detect an accurate symbol from an analog signal received at a digital receiver. It is about a method.
일반적으로, 무선 통신 장치는 잡음 특성이 열악하기 때문에 수신 신호의 주파수 또는 위상 잡음의 영향에 크게 받지 않도록 복잡한 구성의 타이밍 알고리즘이 요구된다. 반면에 유선 채널 또는 광 채널을 통해 전송되는 디지털 송수신기의 경우는 채널 성능이 양호한 대신, 고속의 동작을 요구한다. 따라서 유선 채널 또는 광 채널의 디지털 송수신기에는 고속으로 데이터를 처리할 수 있으면서도, 용이하게 구현될 수 있는 타이밍 동기 방식이 요구된다. In general, since a wireless communication device has a poor noise characteristic, a timing algorithm having a complicated configuration is required so as not to be greatly affected by the frequency or phase noise of a received signal. On the other hand, a digital transceiver transmitted through a wired channel or an optical channel requires high speed operation instead of good channel performance. Accordingly, a digital synchronization transceiver of a wired channel or an optical channel requires a timing synchronization method that can be easily implemented while processing data at high speed.
도 1은 일반적인 디지털 송수신기의 구성도이다.1 is a block diagram of a general digital transceiver.
도 1을 참조하면, 일반적인 디지털 송수신기는 디지털 송신기(110)가 유무선 전송채널(120)을 통하여 디지털 수신기(130)와 연결된다. 상기 디지털 송신기(110)는 송신할 데이터를 변조하는 디지털 변조부(111)와, 디지털-아날로그 변환기(Digital-Analog Converter: DAC)(112,113)와, 곱셈기(114,115)와, 반송파 발진기(116)와, 덧셈기(117) 및 주파수 필터(118)를 포함한다. Referring to FIG. 1, a general digital transceiver includes a
상기 디지털 변조부(111)는 송신할 데이터를 디지털 변조하는 기능을 하며, 주로 위상편이방식(Phase Shift Keying: PSK) 또는 직교진폭변조(Quadrature Amplitude Modulation: QAM) 방식이 적용된다. 상기 디지털-아날로그 변환기(DAC)(112,113)는 상기 디지털 변조부(111)에 의하여 변조된 디지털 신호를 아날로 그 신호로 변환하는 기능을 한다. 제1 디지털-아날로그 변환기(DAC)(112)의 출력은 제1 곱셈기(114)에서 반송파 발진기(116)로부터 출력된 반송파(cosωct)와 곱해진다. 그리고 제2 디지털-아날로그 변환기(DAC)(113)의 출력은 제2 곱셈기(115)에서 반송파 발진기(116)으로부터 출력되고 90°의 위상차를 갖는 반송파(sinωct)와 곱해진다. 그리고 상기 제1,2 곱셈기(114,115)의 출력은 덧셈기(117)에서 합해진 후, 주파수 필터(118)에 의하여 반송파를 중심으로 필터링(filtering)한 후, 상기 전송채널(120)을 통하여 전송된다. The
상기 디지털 수신기(130)는 송신할 데이터를 변조하는 주파수 필터(131)와,반송파 발진기(132)와, 곱셈기(133,134)와, 아날로그-디지털 변환기(Analog-Digital Converter: ADC)(135,136)와, 타이밍 복원장치(137) 및 디지털 변조부(138)을 포함한다. The
상기 주파수 필터(131)는 상기 전송채널(120)로부터 수신된 신호로부터 원하는 대역의 신호를 필터링한다. 상기 주파수 필터(131)로부터 출력된 신호는 반송파 발진기(132)의 출력 신호와 함께 제3,4 곱셈기(133,134)에서 곱해진다. 이때 반송파 발진기(132)로부터 동위상(Inphase channel: I) 채널로는 코사인파(cosωct)가 입력되고, 반위상(Quadrature channel:Q) 채널로는 90°의 위상차를 갖는 사인파(sinωct)가 입력된다. 그리고 상기 제3,4 곱셈기(133,134)의 출력 신호는 각각 제1,2 아날로그-디지털 변환기(ADC)(135, 136)를 통하여 샘플링되어 디지털 신호로 변환된 후, 타이밍 복원장치(137)로 입력된다. 여기서 상기 아날로그-디지털 변환기(ADC)(135, 136)로부터 샘플링된 정보에서 정확한 심볼 정보를 찾기 위해서는, 상기 디지털 수신기(130)에서 사용한 아날로그-디지털 변환기(ADC)(135,136)의 샘플링 클럭이 상기 디지털 송신기(110)에서 사용된 디지털-아날로그 변환기(112,113)의 샘플링 클럭(clock)과 동일하여야 한다. 그러나 상기 디지털 송신기(110)에서 사용되는 디지털-아날로그 변환기(DAC)(112,113)와 상기 디지털 수신기(130)에서 사용되는 아날로그-디지털 변환기(ADC)(135, 136) 사이의 샘플링 클럭 오차로 인하여 타이밍(timing)의 변화가 발생하며, 디지털 수신기(130)에서는 이러한 타이밍 오차를 복원하기 위한 알고리즘이 요구된다. 이와 같이 상기 타이밍 복원장치(137)는 디지털 복조부(138)에 의하여 디지털 복조를 수행하기 이전에 정확한 심볼의 위치를 찾아내는 역할을 수행한다. 여기서 상기 타이밍 복원장치(137)로서는 일반적으로 가드너(Gardner) 방식이 사용된다. 그리고 상기 타이밍 복원장치(137)에 의하여 찾아낸 심볼은 상기 디지털 복조부(138)에 의하여 복조됨으로써 원하는 데이터를 복원할 수 있다. The
도 2는 일반적인 가드너(Gardner) 방식의 타이밍 복원장치의 구성도이다.2 is a block diagram of a general Gardner type timing recovery apparatus.
도 2를 참조하면, 가드너 방식의 타이밍 복원장치(137)는 타이밍 에러 검출부(Timing Error Detection)(21)와, 루프 필터(Loop Filter)(22) 및 심볼검출부(23)를 포함한다. Referring to FIG. 2, the Gardner type
상기 타이밍 에러 검출부(21)는 매 심볼마다 수신 샘플들의 타이밍 오차를 계산하여 에러 정보를 생성한다. 상기 루프 필터(22)는 심볼마다 발생한 에러를 누 적하는 기능을 한다. 즉, 상기 루프 필터(22)는 상기 타이밍 에러 검출부(21)에서 생성된 에러 정보를 수신하여, 상기 에러 정보 중에서 원하는 대역의 에러 정보를 추출하여 상기 심볼 검출부(23)로 전달한다. 상기 심볼검출부(21)는 상기 타이밍 에러 검출부(22)의 출력 정보를 이용하여 상기 심볼검출부(23)에 입력되는 입력 샘플로부터 심볼 정보를 추출하는 기능을 한다. The
상기 심볼검출부(23)는 제1,2 아날로그-디지털 변환기(ADC)(135,136)으로부터 오버 샘플링되어 출력된 동위상(I) 채널 데이터와, 반위상(Q) 채널 데이터(Over-sampled signal)를 수신한다. 그리고 상기 심볼 검출부(23)와 타이밍 에러 검출부(21) 사이에는 최적의 샘플(Optimal sample)과 중간 샘플(intermediate sample)이 혼재하게 된다. 그리고 상기 타이밍 에러 검출부(21)를 통하여 최적의 샘플(Optical sample)이 디지털 복조부(138)로 출력된다. The
상기 가드너 방식의 타이밍 에러 검출부(21)는 현재 심볼과 이전 심볼, 그리고 현재 심볼과 이전 심볼 사이의 중간값만을 가지고 하기 [수학식 1]에 의하여 타이밍 에러를 검출한다.The Gardner type timing
여기서, 는 현재 심볼과 이전 심볼의 중간값,here, Is the median of the current and previous symbols,
y(r)는 현재 심볼값, y (r) is the current symbol value,
y(r-1)는 이전 심볼값, y (r-1) is the previous symbol value,
I는 I 채널, Q는 Q채널을 나타낸다. I denotes an I channel and Q denotes a Q channel.
상기 가드너 방식은 이론적으로 심볼 속도에 2배의 속도를 갖는 샘플만 있으면 타이밍 에러를 추적할 수 있다는 장점이 있다. 그러나 실제로는 상기 가드너 방식을 이용하여 고속의 광대역 신호를 전송하는 경우, 상기 타이밍 에러 검출부(21)는 상기 [수학식 1]에 나타나는 바와 같이 곱하기 기능과 덧셈 기능을 수행해야 하고, 상기 타이밍 복원 장치(137)는 심볼 속도의 약 4~16배 이상의 고속 동작을 수행해야 하기 때문에, 실제 이러한 기능을 디지털로 구현하기는 매우 어려운 문제가 있다. The Gardner method has the advantage that the theoretical error can be tracked if only a sample having twice the symbol rate is theoretical. In practice, however, when a high speed broadband signal is transmitted using the Gardner method, the
상기와 같은 문제점을 해소하기 위한 본 발명의 목적은 디지털 송수신기간의 타이밍 오차를 복원하는데 있어서 고속으로 데이터를 처리할 수 있으면서도, 간단한 동작으로 구현이 용이한 타이밍 복원 장치 및 방법을 제공함에 있다. SUMMARY OF THE INVENTION An object of the present invention for solving the above problems is to provide a timing recovery apparatus and method which can process data at high speed in recovering timing error of a digital transmission / reception period and is easy to implement with a simple operation.
상기 목적을 달성하기 위한 본 발명에 따른 윈도우 기반의 타이밍 복원 장치는, 수신된 아날로그 신호를 소정의 샘플링 속도로 샘플링한 데이터로부터, 현재 샘플 위치를 중심으로, 하나 이전의 샘플과 하나 이후의 샘플 간 샘플값의 차이를 이용하여 타이밍 에러를 검출하는 타이밍 에러 검출부;및 상기 타이밍 에러 검출부로부터 타이밍 에러를 수신하여, 상기 샘플된 데이터 사이로 윈도우를 이동하며, 상기 타이밍 에러가 심볼 복원 여부를 판단하기 위해 설정된 문턱값 이하인 경우 상기 윈도우에 포함된 샘플 값을 이용하여 심볼을 복원하는 심볼 검출부를 포함하는 것을 특징으로 한다. Window-based timing recovery apparatus according to the present invention for achieving the above object, from the data sampled the received analog signal at a predetermined sampling rate, between one previous sample and one or more samples from the current sample position A timing error detector for detecting a timing error by using a difference in a sample value; and receiving a timing error from the timing error detector, moving a window between the sampled data, and setting the timing error to determine whether to recover a symbol. If it is less than the threshold value characterized in that it comprises a symbol detector for restoring the symbol by using the sample value included in the window.
또한, 상기 목적을 달성하기 위한 본 발명에 따른 디지털 수신기는, 전송 채널을 통하여 수신된 아날로그 신호로부터 소정의 샘플링 속도에 의하여 데이터를 샘플링하는 아날로그-디지털 변환기(ADC); 상기 아날로그-디지털 변환기로부터 수신된 샘플링된 데이터로부터, 현재 샘플 위치를 중심으로, 하나 이전의 샘플과 하나 이후의 샘플 간 샘플값의 차이를 이용하여 타이밍 에러를 검출하여, 상기 타이밍 에러가 심볼 복원 여부를 판단하기 위해 설정된 문턱값 이하인 경우 상기 샘플값을 이용하여 심볼을 복원하는 타이밍 복원 장치; 및 상기 심볼 검출기로부터 검출된 심볼을 복조하는 디지털 복조부를 포함하는 것을 특징으로 한다. In addition, a digital receiver according to the present invention for achieving the above object comprises: an analog-to-digital converter (ADC) for sampling data at a predetermined sampling rate from an analog signal received through a transmission channel; From the sampled data received from the analog-to-digital converter, a timing error is detected by using a difference of sample values between one previous sample and one subsequent sample, centering on a current sample position, thereby determining whether the timing error is a symbol restoration. A timing restoration apparatus for restoring a symbol by using the sample value when the threshold value is less than or equal to a threshold set to determine a value; And a digital demodulator for demodulating the symbols detected from the symbol detector.
상기 목적을 달성하기 위한 본 발명에 따른 윈도우 기반의 타이밍 복원 방법은, 수신된 아날로그 신호로부터 소정의 샘플링 속도로 샘플링된 데이터를 수신하는 제1 단계; 상기 샘플링된 데이터에서 현재 샘플 위치를 중심으로, 하나 이전의 샘플과 하나 이후의 샘플 간 샘플값의 차이를 이용하여 타이밍 에러를 검출하는 제2 단계; 및 상기 샘플된 데이터 사이로 윈도우를 이동하여, 상기 타이밍 에러가 심볼 복원 여부를 판단하기 위해 설정된 문턱값 이하인 경우 상기 윈도우에 포함된 샘플값을 이용하여 심볼을 복원하는 제3 단계를 포함하는 것을 특징으로 한다. According to another aspect of the present invention, there is provided a window-based timing recovery method comprising: a first step of receiving data sampled at a predetermined sampling rate from a received analog signal; A second step of detecting a timing error by using a difference of a sample value between a sample before and a sample after the current sample position in the sampled data; And reconstructing a symbol by moving a window between the sampled data and using a sample value included in the window when the timing error is equal to or less than a threshold set to determine whether to restore a symbol. do.
이하 본 발명의 바람직한 실시예의 상세한 설명이 첨부된 도면들을 참조하여 설명될 것이다. 도면들 중 참조번호 및 동일한 구성요소들에 대해서는 비록 다른 도면상에 표시되더라도 가능한 한 동일한 참조번호들 및 부호들로 나타내고 있음에 유의해야 한다. 하기에서 본 발명을 설명함에 있어, 관련된 공지 기능 또는 구성에 대한 구체적인 설명이 본 발명의 요지를 불필요하게 흐릴 수 있다고 판단되는 경우에는 그 상세한 설명을 생략할 것이다.DETAILED DESCRIPTION A detailed description of preferred embodiments of the present invention will now be described with reference to the accompanying drawings. It should be noted that reference numerals and like elements among the drawings are denoted by the same reference numerals and symbols as much as possible even though they are shown in different drawings. In the following description of the present invention, if it is determined that a detailed description of a related known function or configuration may unnecessarily obscure the subject matter of the present invention, the detailed description thereof will be omitted.
도 3은 본 발명의 제1 실시예에 따른 윈도우 기반 타이밍 복원장치를 갖는 디지털 수신기의 구성도이다.3 is a block diagram of a digital receiver having a window-based timing recovery apparatus according to a first embodiment of the present invention.
본 발명에 따른 디지털 수신기(300)는 주파수 필터(310)와, 반송파 발진기(320)와, 제1,2 곱셈기(331,332)와, 제1,2 아날로그-디지털 변환기(ADC)(341,342)와, 본 발명의 제1 실시예예 따른 타이밍 복원 장치(350) 및 디지털 복조부(360)를 포함한다.The
상기 주파수 필터(310)는 유무선 전송채널로부터 수신된 신호로부터 원하는 대역의 신호를 필터링한다. 상기 주파수 필터(131)로부터 출력된 신호는 반송파 발진기(320)의 출력 신호와 함께 제1,2 곱셈기(331,332)에서 곱해짐으로써, 반송파가 제거되고 베이스 밴드 신호로 천이된다. 이때 반송파 발진기(320)로부터 동위상(Inphase channel: I) 채널로는 코사인파(cosωct)가 입력되고, 반위상(Quadrature channel:Q) 채널로는 90°의 위상차를 갖는 사인파(sinωct)가 입력된다. 상기 제1,2 곱셈기(331,332)의 출력은 각각 제1,2 아날로그-디지털 변환기(ADC)(341,342)를 통하여 일정 간격으로 샘플링되어 디지털 신호로 변환된 후, 타이밍 복원장치(350)로 입력된다. 여기서 상기 제1,2 아날로그-디지털 변환기(ADC)(341,342)는 본 발명에 따라 윈도우 기반으로 타이밍을 복원하기 위하여 심볼 속도의 4배 이상의 샘플링 속도로 데이터를 샘플링하는 것이 바람직하다.The
상기 타이밍 복원장치(350)는 타이밍 에러 검출부(351)와 심볼 검출부(352)를 포함하며, 디지털 복조부(360)에 의하여 디지털 복조를 수행하기 이전에 정확한 심볼의 위치를 찾아내는 역할을 수행한다. 상기 타이밍 에러 검출부(351)는 상기 제1,2 아날로그-디지털 변환기(341,342)에 의하여 소정의 샘플링 속도로 샘플링되어 출력된 데이터로부터, 하기 [수학식 2]에 의하여 현재 샘플 위치를 중심으로, 하나 이전의 샘플과 하나 이후의 샘플 간 샘플값의 차이를 이용하여 타이밍 에러를 검출하는 기능을 한다. The
여기서, et(r)는 타이밍 에러, Where e t (r) is the timing error,
│ │는 절대값,│ is the absolute value,
y(r)은 현재 샘플의 심볼값,y (r) is the symbol value of the current sample,
yI(r+1)은 동위상(I) 채널의 현재 샘플로부터 하나 이후 샘플의 심볼값,y I (r + 1) is the symbol value of one or more samples from the current sample of the in-phase (I) channel,
yI(r-1)은 동위상(I) 채널의 현재 샘플로부터 하나 이전 샘플의 심볼값,y I (r-1) is the symbol value of the previous sample from the current sample of the in-phase (I) channel,
yQ(r+1)은 반위상(Q) 채널의 현재 샘플로부터 하나 이후 샘플의 심볼값, y Q (r + 1) is the symbol value of one or more samples from the current sample of the antiphase (Q) channel,
yQ(r-1)은 반위상(Q) 채널의 현재 샘플로부터 하나 이전 샘플의 심볼값을 나타낸다.y Q (r-1) represents the symbol value of the previous sample from the current sample of the anti-phase (Q) channel.
상기 심볼 검출부(352)는 상기 타이밍 에러 검출부(351)로부터 수신한 타이밍 에러를 수신하여, 상기 샘플된 데이터 사이로 윈도우를 이동하여, 상기 타이밍 에러가 심볼 복원 여부를 판단하기 위해 기 설정한 문턱값(threshold value) 이하인 경우에 상기 윈도우에 포함된 샘플 값을 이용하여 심볼을 복원하는 기능을 수행한다.The
상기 심볼 검출부(352)는 상기 타이밍 에러 검출부(351)로부터 수신한 타이밍 에러가 문턱값(threshold value) 이상이면 다음 샘플 위치로 윈도우를 이동하고, 이와 같이 윈도우를 몇 번 이동하는 과정을 거친 후에 타이밍 에러가 상기 문턱값 이하인 윈도우를 찾게 되면, 이 윈도우의 중앙 샘플을 적합한 심볼 정보로 판단하여 선택된 샘플을 출력한다. 또한 상기 심볼 검출부(352)는 하기 [수학식 3]과 같이 상기 윈도우의 중앙에 위치한 현재 샘플과 상기 현재 샘플을 기준으로 하나 이전의 샘플 및 하나 이후의 샘플에 대한 전체 평균값을 적합한 심볼값으로 취하여 출력할 수 있다. The
여기서, y(r)은 현재 샘플값, Where y (r) is the current sample value,
y(r+1)은 현재 샘플을 중심으로 하나 이후의 샘플값, y (r + 1) is one or more sample values centered on the current sample,
y(r-1)은 현재 샘플을 중심으로 하나 이전의 샘플값을 나타낸다. y (r-1) represents the previous sample value centered on the current sample.
이와 같이, 상기 타이밍 복원장치(350)에 의하여 찾아낸 심볼은 상기 디지털 복조부(360)에 의하여 복조됨으로써 원하는 데이터가 복원될 수 있다. As such, the symbols found by the timing
도 4는 본 발명의 실시예에 따른 타이밍 에러 검출부의 세부 구성도이다. 4 is a detailed block diagram of a timing error detector according to an exemplary embodiment of the present invention.
도 4를 참조하면, 본 발명의 실시예에 따른 타이밍 에러 검출부(351)는 복수의 지연기(D)(401 내지 406)와, 복수의 감산기(411,412), 복수의 절대값 취득부(421,422) 및 가산기(430)를 포함한다.Referring to FIG. 4, the
상기 복수의 지연기(D)(401 내지 406)는 동위상(I) 채널 및 반위상(Q) 채널로부터 입력된 샘플을 각각 한 샘플씩 지연시키는 기능을 한다. 예를 들어 동위상(I) 채널로 들어오는 샘플 데이터는 상기 지연기(401 내지 403)를 통과할 때마나 한 샘플씩 지연된다. 따라서 중간 샘플, 즉 현재 샘플이 위치한 지연기(402)의 전단에 위치한 지연기(403)에는 상기 현재 샘플을 기준으로 하나 이전의 샘플이 위치한다. 그리고 상기 현재 샘플이 위치한 지연기(402)의 후단에 위치한 지연기(401)에는 상기 현재 샘플을 기준으로 하나 이후의 샘플이 위치한다. 이와 유사하게, 반위상(Q) 채널로부터 들어오는 샘플 데이터는 상기 지연기(404 내지 406)를 통과할 때마나 한 샘플씩 지연됨으로써, 현재 샘플이 위치한 지연기(405)를 중심으로 전단에 위치한 지연기(406)와 후단에 위치한 지연기(406)에, 각각 현재 샘플을 기준으로 이전 샘플과 이후 샘플이 위치한다. The plurality of delay units (D) 401 to 406 function to delay one sample each of the samples input from the in-phase (I) channel and the anti-phase (Q) channel. For example, sample data coming into the in-phase (I) channel is delayed by one sample each time it passes through the retarders 401-403. Therefore, an intermediate sample, that is, a
상기 감산기(411,412)는 각각 동위상(I) 채널 및 반위상(Q) 채널에 대하여 상기 지연기(401 내지 406)로부터 현재 샘플을 중심으로 하나 이후의 샘플값 및 하나 이전의 샘플값을 수신하여, 상기 하나 이후의 샘플값으로부터 상기 하나 이전의 샘플값을 감산하는 기능을 한다. The
상기 절대값 취득부(421,422)는 상기 감산기(411,412)의 출력값의 크기만을 적용하기 위해 절대값을 구하는 기능을 한다. The absolute
상기 가산기(430)는 상기 복수의 절대값 취득부(421,422)의 출력값을 합산함으로써 상기 [수학식 2]에 따른 타이밍 에러 값을 출력하는 기능을 한다. The
도 5는 본 발명의 제1 실시예에 따른 심볼 검출 과정을 나타내는 도면이다.5 is a diagram illustrating a symbol detection process according to a first embodiment of the present invention.
먼저 도 5(a)는, 본 발명에 따른 아날로그-디지털 변환기(341,342)에 입력된 아날로그 신호가, 소정의 샘플링 속도에 의하여 샘플링된 모습을 나타내는 도면이다. 상기 도 5(a)에서는, 심볼속도의 4배로 샘플링한 경우이며, 가로축은 시간을 나타내고, 각 심볼마다 점으로 표시된 부분이 샘플링된 위치를 나타낸다. 본 발명에서의 샘플링 속도는 데이터의 고속 처리를 위하여 심볼 속도의 4배 이상인 것이 바람직하다. First, FIG. 5 (a) is a diagram showing how analog signals inputted to the analog-to-
도 5(b)는 상기 도 5(a)와 같이 아날로그-디지털 변환기(341,342)에서 샘플링된 데이터들이 디지털 신호로 표시되어 타이밍 복원 장치(350)로 입력되는 모습을 나타내는 도면이다. 도 5(b)를 참조하면, 수신기에 입력된 아날로그 신호는 아날로그-디지털 변환기(341,342)에 의하여 샘플링되어 디지털 신호로 변환된다. 이와 같이 디지털 신호로 변환된 샘플링 데이터는 소정의 윈도우(501)를 이용하여 상기 수학식 2에 의하여 현재 샘플(512)을 기준으로, 하나 이전의 샘플(511)과 하나 이후의 샘플(513) 사이의 샘플값의 차이에 의하여 얻어진 타이밍 에러를, 심볼 복원 수행 여부를 판단하기 위해 미리 설정된 문턱값과 비교한다. 여기서 상기 소정의 윈도우(501)는 하나의 심볼 구간 내에서 현재의 샘플과, 상기 현재 샘플을 기준으로 하나 이전의 샘플 및 하나 이후의 샘플 구간으로 형성된다.FIG. 5B is a diagram illustrating the data sampled by the analog-to-
상기 비교 결과, 상기 소정의 윈도우(501) 내에서의 타이밍 에러가 설정된 문턱값보다 큰 경우(fail)에는 윈도우를 다음 샘플의 위치로 이동한다. 상기 이동된 위치에서의 윈도우(502)에 포함된 현재 샘플(513)를 기준으로, 하나 이전의 샘플(512)과 하나 이후의 샘플(514) 사이의 샘플값의 차이에 의하여 얻어진 타이밍 에러가 설정된 문턱값보다 여전히 더 높은 경우(fail)에는, 다시 윈도우를 하나의 샘플만큼 다음 위치로 이동시킨다. 이와 같이 이동된 윈도우(503)에 포함된 현재 샘플(514)을 기준으로, 하나 이전의 샘플(513)과 하나 이후의 샘플(515) 사이의 샘플값의 차이에 의하여 얻어진 타이밍 에러가 설정된 문턱값보다 낮은 경우(detection)에는 상기 윈도우(503)의 중앙 샘플, 즉 현재 샘플을 적합한 심볼 정보로 판단하고, 선택된 심볼을 출력한다. 또한 상기 심볼 검출부(352)는 상기 [수학식 3]과 같이 현재 샘플(514)과, 현재 샘플을 중심으로 하나 이전의 샘플(513)과 하나 이후의 샘플(515)의 평균값을 취하여 출력할 수 있다. 이와 같이 선택된 심볼 또는 출력값은 디지털 복조부(360)에 의하여 복조됨으로써 상기 디지털 수신기(300)는 원하는 데이터를 수신할 수 있다. As a result of the comparison, when the timing error in the
이와 같이 본 발명의 제1 실시예에 따른 타이밍 복원 장치(350)에 따르면, 매 샘플마다 타이밍 에러를 구하고, 이를 이용하여 심볼을 복원하기 때문에 채널 상황에 민감하게 반응하면서, 신속하게 타이밍 동기를 얻을 수 있게 된다.As described above, according to the
도 6은 본 발명의 제2 실시예에 따른 타이밍 복원 장치부의 세부 구성도이다. 6 is a detailed block diagram of a timing recovery apparatus according to a second embodiment of the present invention.
도 6을 참조하면, 본 발명의 제2 실시예에 따른 타이밍 복원 장치(600)는 타이밍 에러 검출부(610)와, 루프 필터(620) 및 심볼 검출부(630)를 포함한다.Referring to FIG. 6, the
상기 타이밍 에러 검출부(610)는 상기 [수학식 2] 및 도 4에 도시된 바와 같은 원리에 의하여, 타이밍 에러를 검출한다. 다만 상기 타이밍 에러 검출부(610)는 상기 심볼 검출부(630)로부터 심볼값을 샘플링할 위치 정보를 수신한다. 그리고 상기 타이밍 에러 검출부(610)는 상기 수신한 심볼값 샘플링 위치 정보를 이용하여, 본 발명의 제1 실시예에 따른 타이밍 에러 검출부(350)와는 달리 매 샘플마다 타이밍 에러를 검출하지 않고서, 매 심볼당 한 번씩 타이밍 에러를 검출하여 상기 루프 필터(620)로 전달한다. The
이와 같이 상기 타이밍 에러 검출부(610)에 의하여 검출된 타이밍 에러는 루프 필터(620)에서 누적되며, 상기 누적된 타이밍 에러 값은 심볼 검출부(630)로 전 달된다.As such, the timing error detected by the
상기 심볼 검출부(630)는 상기 루프 필터(620)로부터 전달받은 누적된 타이밍 에러 값이 미리 설정된 문턱값보다 큰 경우에는 심볼값을 샘플링하는 위치를 샘플 하나 만큼 이동하고, 상기 타이밍 에러 검출부(610)로 변경된 심볼값을 샘플하는 위치 정보를 전달한다. 이로 인하여 상기 타이밍 에러 검출부(610)는 다음 번 심볼에서 하나의 샘플 만큼 이동한 위치에서 타이밍 에러를 검출하여, 상기 타이밍 에러를 루프 필터(620)로 전달하는 과정을 반복한다. 따라서 상기 심볼 검출부(630)는 상기 루프 필터(620)로부터 수신되는 누적 타이밍 에러 값이 작은 위치를 찾을 수 있고, 이와 같이 타이밍 에러가 작은 위치의 값을 샘플링하여 심볼을 복원할 수 있게 된다. If the accumulated timing error value received from the
도 7은 본 발명의 제2 실시예에 따른 심볼 검출 과정을 나타내는 도면이다.7 is a diagram illustrating a symbol detection process according to a second embodiment of the present invention.
먼저 도 7(a)은, 본 발명에 따른 아날로그-디지털 변환기(341,342)에 입력된 아날로그 신호가, 심볼 속도의 4배의 샘플링 속도에 의하여 샘플링된 모습을 나타내는 도면이다. First, FIG. 7 (a) is a diagram showing an analog signal input to the analog-to-
도 7(b)은 상기 도 7(a)와 같이 아날로그-디지털 변환기(341,342)에서 샘플링된 데이터들이 디지털 신호로 표시되어 본 발명의 제2 실시예에 따른 타이밍 복원 장치(600)로 입력되는 모습을 나타내는 도면이다. 도 7(b)을 참조하면, 디지털 수신기(300)에 입력된 아날로그 신호는 아날로그-디지털 변환기(341,342)에 의하여 샘플링되어 디지털 신호(511 내지 532)로 변환된다. 타이밍 에러 검출부(610)는 이 와 같이 디지털 신호로 변환된 샘플링 데이터로부터, 상기 수학식 2에 의하여 현재 샘플(512)를 기준으로, 하나 이전의 샘플(511)과 하나 이후의 샘플(513) 사이의 샘플값의 차이에 의하여 얻어진 타이밍 에러를 구하여 루프 필터(620)로 전달한다.FIG. 7 (b) shows the data sampled by the analog-to-
그리고 상기 타이밍 에러 검출부(610)는 다음 심볼에서의 동일한 심볼값 샘플링 위치로 윈도우를 이동하고, 이동된 위치에서의 윈도우(702)에 포함된 현재 샘플(516)를 기준으로, 하나 이전의 샘플(515)과 하나 이후의 샘플(517) 사이의 샘플값의 차이에 의하여 얻어진 타이밍 에러를 구하여 역시 루프 필터(620)으로 전달한다. The
이후 다시 다음 심볼의 동일한 샘플 위치로 윈도우를 이동하는 과정을 반복하고, 이동된 위치에서의 윈도우(703)에 포함된 현재 샘플(520)를 기준으로, 하나 이전의 샘플(519)과 하나 이후의 샘플(521) 사이의 샘플값의 차이에 의하여 얻어진 타이밍 에러를 구하여 역시 루프 필터(620)으로 전달한다. After that, the process of moving the window to the same sample position of the next symbol is repeated, and based on the
이와 같이 상기 타이밍 에러 검출부(610)로부터 수 회 전달되어 상기 루프 필터(620)에 누적된 타이밍 에러 값이 미리 설정된 문턱값보다 큰 경우에는, 다음 심볼에서의 심볼값을 샘플링하는 위치를 하나의 샘플만큼 이동한다. 이와 같이 하나의 샘플만큼 윈도우가 이동된 경우, 이동 후 위치에서의 윈도우(704)를 통하여 현재 샘플(523)과, 상기 현재 샘플(523)을 기준으로 이전 및 이후 샘플(522,523)에 대한 타이밍 에러를 구하는 과정을 반복한다. As described above, when the timing error value transmitted from the
이후에는 매 심볼마다 한 번씩 상기 원래의 위치로부터 하나의 샘플만큼 이동한 위치에서 윈도우(705,706)를 이용하여 타이밍 에러를 구한다. 그리고 이와 같이 얻어진 타이밍 에러는 루프 필터(620)에서 누적되어 미리 설정된 문턱값과 비교되고, 누적된 타이밍 에러가 미리 설정된 문턱값 이하이면 샘플링 위치를 고정하여 샘플링을 계속 수행한다. 그러나 상기 루프 필터(620)에 누적된 타이밍 에러 값이 상기 미리 설정된 문턱값 이상이면 다시 샘플링 위치를 하나의 샘플만큼 이동하여 타이밍 에러가 작은 위치의 값을 샘플링할 수 있게 된다. 이와 같이 샘플링된 심볼은 디지털 복조부(360)에 의하여 복조됨으로써 원하는 데이터를 복원할 수 있게 된다.Thereafter, the timing error is obtained by using the
이와 같이 본 발명의 제2 실시예에 따른 타이밍 복원 장치(600)에 따르면, 매 심볼마다 타이밍 에러를 구하고, 이를 수 회 누적한 값을 이용하여 심볼을 복원하기 때문에 상기 제1 실시예와 비교하여 타이밍 동기을 얻는 속도가 느리지만, 갑작스런 잡음(noise) 등의 영향을 받지 않는 이점이 있다.As described above, according to the
본 발명에 따른 윈도우 기반 타이밍 복원 방법은 디지털과 아날로그 신호를 이용하여 정보를 전송하는 전송장치에서 구현될 수 있다. 특히 신호에 대역제한을 적게 할 수록 좋은 성능의 전송장치를 구현할 수 있다. The window-based timing recovery method according to the present invention can be implemented in a transmission apparatus for transmitting information using digital and analog signals. In particular, the lower the bandwidth limit of the signal, the better the transmission performance.
한편 본 발명의 상세한 설명에서는 구체적인 실시예에 관해 설명하였으나, 본 발명의 범위에서 벗어나지 않는 한도 내에서 여러 가지 변형이 가능함은 물론이다. 그러므로 본 발명의 범위는 설명된 실시예에 국한되어 정해져서는 안되며, 후술하는 특허청구범위뿐만 아니라 이 특허청구범위와 균등한 것들에 의해 정해져야 한다. Meanwhile, in the detailed description of the present invention, specific embodiments have been described, but various modifications are possible without departing from the scope of the present invention. Therefore, the scope of the present invention should not be limited to the described embodiments, but should be defined not only by the claims below, but also by those equivalent to the claims.
상술한 바와 같은 본 발명에 따르면 디지털 송수신기간의 타이밍 오차를 복원하는데 있어서 현재 샘플을 중심으로, 하나 이전의 샘플과 하나 이후의 샘플 간의 차이만을 이용하여 타이밍 에러를 검출하므로, 하드웨어 구현이 용이하면서도 고속으로 심볼 동기를 얻을 수 있는 이점이 있다. 특히 본 발명에 따르면 고속 비트 전송이 필요한 광네트워크와 같은 유선 기반 디지털 전송 시스템의 수신 신호의 심볼 동기를 간단히 구현할 수 있는 이점이 있다. According to the present invention as described above, in recovering the timing error of the digital transmission and reception period, the timing error is detected using only the difference between one previous sample and one subsequent sample centering on the current sample. As a result, symbol synchronization can be obtained. In particular, according to the present invention, there is an advantage in that symbol synchronization of a received signal of a wire-based digital transmission system such as an optical network requiring high-speed bit transmission can be simply implemented.
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