KR100641609B1 - Repeater using Tx/Rx switching in OFDM/TDD system and method for controlling Tx/Rx switching - Google Patents
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Abstract
본 발명은 OFDM/TDD(Orthogonal Frequency Division Multiplexing/Time Division Duplex) 방식의 중계장치에 관한 것으로, 더욱 상세하게는 상·향링크 신호 제어장치가 구비된 OFDM/TDD 방식 중계장치 및 중계방법에 관한 것이다.The present invention relates to an orthogonal frequency division multiplexing / time division duplex (OFDM / TDD) relay apparatus, and more particularly, to an OFDM / TDD relay apparatus and a relay method provided with an uplink signal control device. .
본 발명에 따른 상·향링크 신호 제어장치가 구비된 OFDM/TDD 방식 중계장치는, 기지국에서 입력된 OFDM/TDD 신호 프레임의 동기를 CP(Cyclic Prefix)를 이용하여 검출한 후, 하나의 OFDM 심볼 주기와 같은 신호를 출력하는 동기 검출 장치와; 상기 동기 검출 장치의 출력 신호를 기본 클럭으로 사용하여 기본 클럭의 주파수의 정수배인 높은 주파수를 갖는 클럭을 발생 출력하여 중계장치의 메인 클럭으로 사용하게 하는 PLL 장치와; 상기 동기 검출 장치의 출력신호와 PLL장치의 출력 클럭을 사용하여 상·하향 링크 제어 신호를 발생하는 링크 제어 신호 발생 장치를 포함하여 구성됨으로서 상·하향링크 신호를 정확하고 신뢰성 있게 중계할 수 있도록 한 것이다.In the OFDM / TDD relay apparatus equipped with an uplink / link signal control apparatus according to the present invention, after detecting synchronization of an OFDM / TDD signal frame input from a base station using a cyclic prefix (CP), one OFDM symbol is used. A synchronization detecting device for outputting a signal such as a period; A PLL device for generating and outputting a clock having a high frequency that is an integer multiple of the frequency of the base clock by using the output signal of the synchronization detecting device as a base clock; And a link control signal generator for generating an uplink / downlink control signal by using the output signal of the synchronous detection device and the output clock of the PLL device, so that the uplink / downlink signal can be relayed accurately and reliably. will be.
OFDM, TDD, CP, 타이밍, 리커버리, 상관 OFDM, TDD, CP, Timing, Recovery, Correlation
Description
도 1은 직교 주파수 분할 다중방식(OFDM)의 기본원리를 보여주는 개념도, 1 is a conceptual diagram illustrating a basic principle of orthogonal frequency division multiplexing (OFDM);
도 2는 OFDM 시스템의 심볼 구조도, 2 is a symbol structure diagram of an OFDM system;
도 3은 TDD 신호 프레임 구조도, 3 is a TDD signal frame structure diagram;
도 4는 일반적인 TDD방식 중계장치를 보여주는 블럭도, 4 is a block diagram showing a general TDD relay device;
도 5는 본 발명에 따른 링크 제어 장치를 보여주는 개략적인 블럭도, 5 is a schematic block diagram showing a link control device according to the present invention;
도 6은 본 발명의 동기 검출 장치를 보여주는 블럭도, 6 is a block diagram showing a synchronization detecting device of the present invention;
도 7은 본 발명의 PPL 장치를 보여주는 블럭도, 7 is a block diagram showing a PPL device of the present invention;
도 8은 동기 검출 장치의 레벨검출기의 출력신호를 보여주는 그래프, 8 is a graph showing an output signal of a level detector of a synchronization detecting device;
도 9는 동기 검출 장치의 판별기의 출력신호를 보여주는 그래프,9 is a graph showing an output signal of the discriminator of the synchronization detecting apparatus;
도 10은 레벨검출기의 출력신호 및 PLL 장치의 클럭신호를 이용하여 링크 제어 신호를 생성하는 작용을 설명하는 그래프이다.10 is a graph for explaining the operation of generating a link control signal using the output signal of the level detector and the clock signal of the PLL device.
***도면의 주요 부분에 대한 부호의 설명****** Description of the symbols for the main parts of the drawings ***
400 : 링크 제어부 401 : 동기 검출 장치400: link control unit 401: synchronization detection device
402 : PLL 장치 403 : 링크 제어 신호 발생 장치402: PLL device 403: link control signal generator
502 : 레벨 검출기 503 : T 지연기502: level detector 503: T delay
601 : 위상검출기 603 : 국부발진기601: phase detector 603: local oscillator
604 : 디바이더 701 : 레벨검출신호604: divider 701: level detection signal
703 : 펄스신호 705 : 클럭신호703: pulse signal 705: clock signal
707 : 링크 제어 신호707 link control signal
본 발명은 OFDM/TDD(Orthogonal Frequency Division Multiplexing/Time Division Duplex) 방식의 중계장치에 관한 것으로, 더욱 상세하게는 상·향링크 신호 제어장치가 구비된 OFDM/TDD 방식 중계장치 및 중계방법에 관한 것이다.The present invention relates to an orthogonal frequency division multiplexing / time division duplex (OFDM / TDD) relay apparatus, and more particularly, to an OFDM / TDD relay apparatus and a relay method provided with an uplink signal control device. .
일반적으로 직교 주파수 분할 다중(OFDM:Orthogonal Frequency Division Multiplexing) 방식은 다수의 직교하는 반송파 신호를 다중화 하는 디지털 변조방식으로 최근 활발히 연구되고 있다. OFDM 방식은 전송될 데이터를 블록화 한 후에 다수의 반송파를 이용하여 병렬로 전송함으로써 주파수 효율성이 증가되고 심볼의 주기가 증가하여 지연 확산에 대한 민감도가 감소하게 된다. 또한 고속의 이퀄라이저의 사용을 피하고 멀티 패스 페이딩(multi-path fading)과 펄스형 노이즈를 줄일 뿐만 아니라 가용대역을 충분히 사용할 수 있는 장점이 있다.In general, orthogonal frequency division multiplexing (OFDM) is a digital modulation scheme for multiplexing a plurality of orthogonal carrier signals. The OFDM scheme blocks data to be transmitted and transmits the data in parallel using a plurality of carriers, thereby increasing frequency efficiency and increasing symbol periods, thereby reducing sensitivity to delay spread. It also has the advantage of avoiding the use of high-speed equalizers, reducing multi-path fading and pulsed noise, and using the available bandwidth.
도1은 대역 제한 필터와 발진기에 의한 다수반송파의 기저대역 변·복조의 기본원리를 보여준다. 도시된 바와 같이, 병렬화 된 다수 개의 데이터 심볼들은 해 당 반송판에 의해 변조되고 그 결과가 더해져 하나의 OFDM 심볼을 구성하게 되며, 최종적으로 RF단에 입력되어 채널로 전송된다. 그리고 다중경로채널을 통과해 수신된 신호는 기저대역으로 변환된 후 복조 과정이 수행되는데 이때 송신 데이터를 정확히 복조하기 위해서는 모든 부반송파가 상호 직교해야 한다. 그리고 OFDM 심볼의 전송은 심볼단위로 이루어지나 OFDM 심볼이 다중경로 채널을 통해 전송되는 동안 이전 심볼에 의한 영향을 받게 된다. Fig. 1 shows the basic principle of baseband modulation and demodulation of a multicarrier by a band limiting filter and an oscillator. As shown, the parallelized data symbols are modulated by the corresponding carrier and the result is added to form an OFDM symbol, which is finally input to the RF stage and transmitted to the channel. The signal received through the multipath channel is converted to baseband and then demodulated. In this case, all subcarriers must be orthogonal to each other in order to accurately demodulate the transmitted data. The transmission of OFDM symbols is performed in symbol units, but is affected by previous symbols while OFDM symbols are transmitted through a multipath channel.
이러한 심볼간 간섭(intersymbol interference)을 방지하기 위해 연속된 OFDM 심볼 사이에 채널의 최대지연확산(τmax)보다 긴 보호구간(guard interval)을 삽입한다. 즉, 도2에서 보는 바와 같이, OFDM 심볼주기(Ts)는 실제 데이터가 전송되는 유효심볼구간(Tb)과 보호구간(Tg)의 합으로 이루어진다. 따라서 수신단에서는 보호구간(Tg)을 제거한 후 유효심볼구간 동안의 데이터를 취하여 복조를 수행한다. 이러한 보호구간(Tg)은 부반송파의 지연에 의해 발생할 수 있는 직교성의 파괴를 방지하기 위해 유효심볼 구간에서 마지막 구간의 신호를 복사하여 삽입하여 이루어지는데 이를 CP(Cyclic Prefix)라 한다.In order to prevent such intersymbol interference, a guard interval longer than the maximum delay spread τ max of a channel is inserted between consecutive OFDM symbols. That is, as shown in Figure 2, the OFDM symbol period (T s ) is made up of the sum of the effective symbol interval (T b ) and the guard period (T g ) that is actually transmitted. Therefore, the receiver performs demodulation by removing the guard interval T g and taking data during the valid symbol interval. This protection interval (T g ) is made by copying and inserting the signal of the last section in the effective symbol section in order to prevent the destruction of orthogonality caused by the delay of the subcarrier, this is called CP (Cyclic Prefix).
한편, TDD(Time Division Duplex) 방식은 양방향 통신을 위해 상향링크(uplink)와 하향링크(downlink)에 다른 주파수 대역을 사용하는 FDD(Frequency Division Duplexing)방식과 달리 동일한 주파수 대역을 이용하여 양방향 전송을 지원한다. 이론적으로 FDD방식보다 적은 타임슬롯을 사용하여 동일한 전송속도 지원이 가능하다는 점, 타임슬롯의 동적 할당으로 비대칭(asymmetric)이나 버스티 (bursty)한 애플리케이션의 전송이 적합하다는 특성외에도 FDD에 비해 1/2 주파수로, 결국 1/2가격으로 서비스를 제공할 수 있다는 점에서 저렴한 무선 인터넷 서비스를 제공하고자 하는 통신사업자에게 매우 매력적인 기술이다.On the other hand, the TDD (Time Division Duplex) method uses the same frequency band as the Frequency Division Duplexing (FDD) method, which uses different frequency bands for uplink and downlink for bidirectional communication. Support. Theoretically, the same transmission rate can be supported using fewer timeslots than the FDD scheme, and the dynamic allocation of timeslots makes it suitable for transmission of asymmetric or bursty applications. It is a very attractive technology for service providers who want to provide inexpensive wireless Internet service in that it can provide service at 2 frequencies and eventually at half price.
그리고 중계장치(repeater)는 전계강도가 부족하여 발생하는 부분적인 음영지역을 커버하기 위하여 기지국 신호를 재증폭하여 주는 것으로서, 기지국의 하향링크 신호를 수신, 대역제한 및 증폭하여 단말기로 송신하는 동시에 상향링크인 단말기의 신호를 수신, 대역제한 및 증폭하여 기지국으로 전송하여 기지국과 단말기간의 양방향 통신이 원활히 이루어지도록 하는 장치이다. 특히 TDD 중계장치는 원하는 정보를 시간간격을 두고 송수신하여 사용자를 구별하고 통신하는 시스템으로서, 그 신호 프레임은 도3에서 보는 바와 같이, 하향링크신호, TTG(TX/RX Transition Gap), 상향링크신호 및 RTG(RX/TX Transition Gap)으로 구분되어 있으므로 이를 중계하기 위해서는 이 신호의 시간정보를 추출해야 한다. 또한 추출된 시간정보를 바탕으로 하향링크 시간구간에는 하향링크 경로를 활성화시키고, 상향링크 시간구간에는 상향링크 경로를 활성화시키는 방법이 필요하다.The repeater re-amplifies the base station signal in order to cover a partial shadow area caused by the lack of electric field strength. The repeater receives, band-limits and amplifies the downlink signal of the base station and transmits the signal to the terminal. Receiving, band limiting and amplifying a signal of a terminal that is a link is transmitted to the base station to facilitate the two-way communication between the base station and the terminal. In particular, the TDD relay device is a system for distinguishing and communicating users by transmitting and receiving desired information at time intervals, and the signal frame is a downlink signal, a TTG (TX / RX Transition Gap), an uplink signal, as shown in FIG. And RTG (RX / TX Transition Gap), so it is necessary to extract the time information of this signal in order to relay it. In addition, there is a need for a method of activating a downlink path in a downlink time interval and activating an uplink path in an uplink time interval based on the extracted time information.
도4는 종래 기술에 따른 일반적인 중계장치의 일예를 보여주는 구성도이다. 도시된 바와 같이, 일반적인 중계장치는 하향링크 신호기간 동안에는 기지국안테나(100), 제1대역제한필터(110), 제1서큘레이터(120), 저잡음증폭기(130), 기지국측 스위치(140), 증폭기, 감쇄기 및 고출력증폭기로 구성된 하향송신부(150), 제2서큘레이터(160) 및 서비스안테나(200)로 연결되어 하향링크 경로를 형성하고, 상향링크 신호기간 동안에는 서비스안테나(200), 제2대역제한필터(170), 제2서큘레이 터(160), 저잡음증폭기(230), 기지국측 스위치(240), 증폭기, 감쇄기 및 고출력증폭기로 구성된 상향송신부(250), 제1서큘레이터(120) 및 기지국안테나(200)로 연결되어 하향링크 경로를 형성한다. 이때 상기 기지국측 스위치(130)와 서비스측 스위치(240)는 하향링크 신호와 상향링크 신호의 동기에 정확히 일치되도록 제어하는 소정의 링크제어부(300)와 연결되어 있다. Figure 4 is a block diagram showing an example of a general relay device according to the prior art. As shown in the drawing, a general repeater includes a base station antenna (100), a first band limiting filter (110), a first circulator (120), a low noise amplifier (130), a base station side switch (140) during a downlink signal period. It is connected to a
따라서 상기 링크제어부(300)는 기지국에서 단말기 방향으로 전파를 송신하는 하향링크 시간대에는 기지국측 스위치(140)를 접속시켜 하향링크 경로가 연결되도록 하고, 단말기에서 기지국으로 전파를 송신하는 상향링크 시간대에는 서비스측 스위치(240)을 접속시켜 상향링크 경로가 연결되도록 한다. 그러나, 현실적으로 기지국과 중계장치는 시간정보를 공유할 수 없다. 따라서 정확하게 하향링크 신호와 상향링크 신호에 동기되도록 스위칭하는 것이 중요한 문제로 대두되고 있다.Therefore, the link control unit 300 is connected to the base station-
그런데 기존의 TDD 방식 중계장치는 입력된 기지국의 하향링크 신호에서 단순히 시간 정보를 추출하여 상·하향링크 제어 신호를 발생하여 이 제어 신호를 상· 하향 경로를 활성화하는데 사용하고 있는데, 이 제어 신호를 생성하는 장치에서 사용하는 클럭은 기지국의 신호와 동기가 되지 않은 것으로, 이것으로 인해 기지국과 중계장치가 동기가 되어 있지 않아 발생하는 여러 가지 타이밍 문제들 즉, 링크 제어신호의 오차율, 중계장치에서 복조된 TDD 신호의 에러율, 타이밍 오차에서 오는 중계장치의 신뢰성 문제들이 발생한다. However, the conventional TDD repeater simply extracts time information from the downlink signal of the base station to generate an uplink / downlink control signal, and uses the control signal to activate the uplink and downlink paths. The clock used by the generating device is not synchronized with the signal of the base station. As a result, various timing problems caused by the synchronization between the base station and the relay are not synchronized, that is, the error rate of the link control signal and the demodulation in the relay device. The reliability problems of the repeater arise from the error rate and timing error of the received TDD signal.
따라서, 본 발명은 종래 기술의 문제점을 해결하기 위한 것으로서, 본 발명의 주된 목적은 OFDM/TDD 중계 장치에서 TDD 프레임 신호의 타이밍 정보를 추출하는 장치 및 그 추출 신호에 동기하여 기지국과 주파수 및 위상이 동기된 클럭을 발생하는 장치를 제공하는 것이다. Accordingly, the present invention is to solve the problems of the prior art, the main object of the present invention is to extract the timing information of the TDD frame signal in the OFDM / TDD relay device and the base station and the frequency and phase in synchronization with the extracted signal It is to provide a device for generating a synchronized clock.
이러한 목적을 달성하기 위하여, 본 발명에 따른 상·하향링크 제어장치가 구비된 OFDM/TDD 중계장치는, 기지국과 단말기간의 상·하향 링크신호를 송수신하는 중계장치에 있어서, 기지국에서 입력된 OFDM/TDD 신호 프레임의 동기를 자기 상관을 이용하여 검출한 후, 하나의 OFDM 심볼 주기와 같은 신호를 출력하는 동기 검출 장치와; 상기 동기 검출 장치의 출력 신호를 기본 클럭으로 사용하여 기본 클럭의 주파수의 정수배인 높은 주파수를 갖는 클럭을 발생 출력하여 중계장치의 메인 클럭으로 사용하게 하는 PLL 장치와, 상기 동기 검출 장치의 출력신호와 PLL장치의 출력 클럭을 사용하여 상·하향 링크 제어 신호를 발생하는 링크 제어 신호 발생 장치를 포함하여 구성된 것을 특징으로 한다. In order to achieve the above object, the OFDM / TDD relay device equipped with an uplink / downlink control apparatus according to the present invention is a relay device for transmitting and receiving uplink and downlink signals between the base station and the terminal, the OFDM / A synchronization detecting device for detecting synchronization of the TDD signal frame using autocorrelation and then outputting a signal such as one OFDM symbol period; A PLL device for generating and outputting a clock having a high frequency that is an integer multiple of the frequency of the base clock by using the output signal of the synchronization detecting device as a main clock, and using the output signal of the synchronization detecting device; And a link control signal generator for generating an uplink / downlink control signal using an output clock of the PLL device.
또한 본 발명에 있어서, 상기 동기 검출 장치는 입력되는 하향링크 신호의 파워 레벨을 검출하는 레벨 검출기와, 검출된 신호를 일정 시간 지연시키는 T 지연기와, 지연된 신호와 지연되지 않는 신호을 곱하는 곱셈기와, 상기 곱셈기의 결과를 Tg구간 동안 누적시키는 적분기와, 판별기를 포함하여 구성되는 것을 특징으로 한다.In addition, in the present invention, the synchronization detection device is a level detector for detecting the power level of the input downlink signal, a T delay for delaying the detected signal for a predetermined time, a multiplier for multiplying the delayed signal with a non-delayed signal, And an integrator that accumulates the result of the multiplier for the period Tg, and a discriminator.
그리고 본 발명에 있어서, 상기 PLL장치는 상기 동기 검출 장치의 출력 신호에 동기 되고 주파수가 입력 신호의 주파수의 정수배에 해당하는 클럭신호를 생성하여 출력하는 것을 특징으로 한다. In the present invention, the PLL device generates and outputs a clock signal synchronized with the output signal of the synchronization detection device and whose frequency corresponds to an integer multiple of the frequency of the input signal.
또한 본 발명에 있어서, 상기 링크제어 신호 발생 장치는 상기 동기 검출 장치로부터 입력된 신호와 상기 PLL장치로부터 입력된 클럭신호를 사용하여 상 하향 링크를 제어하는 링크 제어 신호를 발생하는 것을 특징으로 한다.In the present invention, the link control signal generator is characterized in that for generating a link control signal for controlling the downlink by using the signal input from the synchronization detection device and the clock signal input from the PLL device.
본 발명은 또한, 기지국과 단말기간의 상·하향 링크신호를 송수신하는 중계방법에 있어서, 입력되는 하향 링크신호에 대해 자기 상관특성을 사용하여 기지국의 프레임 타이밍 정보를 추출하는 동기 검출 단계와; 검출된 기준 신호에 동기화되고 주파수가 기준신호의 정수배가 되는 클럭신호를 발생하는 단계와; 상기 동기 검출 단계의 출력신호와 클럭신호를 입력하여 상·하향 링크 제어신호를 생성 출력하는 단계를 포함하여 구성된 것을 특징으로 한다.The present invention also provides a relay method for transmitting and receiving uplink and downlink signals between a base station and a terminal, comprising: a synchronization detecting step of extracting frame timing information of a base station using an autocorrelation property with respect to an input downlink signal; Generating a clock signal synchronized with the detected reference signal and whose frequency is an integer multiple of the reference signal; And generating and outputting an uplink / downlink control signal by inputting an output signal and a clock signal of the synchronization detection step.
본 발명의 실시예에 있어서, 상기 동기 검출 단계는, 입력되는 하향 링크신호의 파워 레벨을 검출하여 출력시키는 단계와, 검출된 신호의 일정 시간 지연된 신호와 지연되지 않는 신호와의 자기 상관 특성을 이용하여 기지국의 하향 신호의 심볼 시간 및 주기를 검출하여 출력하는 단계를 포함한다.In an embodiment of the present invention, the synchronization detection step may include detecting and outputting a power level of an input downlink signal, and using autocorrelation characteristics between a signal delayed for a predetermined time and a signal that is not delayed. And detecting and outputting a symbol time and a period of the downlink signal of the base station.
또한 본 발명의 실시예에 있어서, 상기 검출된 동기 신호와 생성된 클럭신호를 사용하여 상 ·하향 링크를 제어하는 링크 제어 신호를 발생하는 단계를 포함하여 구성된다.In addition, the embodiment of the present invention includes the step of generating a link control signal for controlling the uplink and the downlink by using the detected synchronization signal and the generated clock signal.
이에 따라 상기 PLL장치에서 출력된 클럭은 기지국에서 출력한 신호와 동기가 되어 이 클럭을 사용하는 중계장치의 모든 부분은 기지국과 동기되어 작동하므로 정확한 링크제어신호를 발생할 수 있게 되어 상·하향링크 신호를 정확하고 신뢰성 있게 중계하는 것이 가능하게 된다. Accordingly, the clock output from the PLL device is synchronized with the signal output from the base station, so that all parts of the relay device using the clock operate in synchronization with the base station, so that accurate link control signals can be generated. It is possible to relay accurately and reliably.
이하 첨부도면을 참조하여 본 발명에 따른 OFDM/TDD 방식 중계장치용 상·하향링크 제어장치를 보여주는 바람직한 실시예를 상세히 설명한다.Hereinafter, a preferred embodiment showing an uplink / downlink control device for an OFDM / TDD relay device according to the present invention will be described in detail with reference to the accompanying drawings.
먼저, 도5는 본 발명에 따른 OFDM/TDD 방식 중계장치용 상·하향링크 제어장치를 보여주는 블럭도이다. 도시된 바와 같이, 기지국의 하향링크 신호로부터 타이밍 정보를 추출하는 동기 검출 장치(401), 상기 동기 검출 장치(401)에서 출력된 펄스신호의 정수배 주파수를 가지는 클럭을 생성 출력하는 PLL 장치(402), 상기 PLL 장치의 출력 클럭과, 동기 검출 장치의 레벨검출신호 및 펄스신호를 이용하여 상 하향링크 제어 신호를 생성하는 링크 제어 신호 발생 장치(403)로 구성되어 있다. First, FIG. 5 is a block diagram showing an uplink / downlink control apparatus for an OFDM / TDD relay apparatus according to the present invention. As shown, a
즉, 상기 동기 검출 장치(401)에서는 기지국 신호의 타이밍 정보를 추출 하기 위해서 OFDM 변조 방식의 주요한 특징인 Cyclic Prefix(이하 CP)를 이용한다. 도2에서 보는 바와 같이 상기 CP는 유효 심볼 시간의 마지막 Tg 만큼의 복사본을 OFDM 신호의 맨 앞에 붙인 것이다. 즉 동일한 신호가 심볼의 앞과 뒤에 위치하므로 둘 사이의 상관 (correlation)을 이용하면 OFDM 심볼의 존재 여부 및 정확한 심볼 시간 정보를 추출 할 수 있게 된다.That is, the
도6은 본 발명에 따른 동기 검출 장치(401)의 구성을 보다 상세하게 나타낸 것으로, 대역제한필터(501), 레벨검출기(502), T지연기(503), 곱셈기(504), 적분기(505), 판별기(506)로 구성되어 있다. 따라서 상기 동기검출장치(401)로 입력되는 하향 링크신호 중 소정 대역의 신호가 상기 대역제한필터(501)를 통하여 레벨검출기(502)에 입력된다. 그러면 상기 레벨검출기(502)에서는 입력신호의 파워레벨을 검출하여 레벨검출신호(701)를 출력한다. 도8은 상기 레벨검출기(502)에서 출력되는 출력파형을 나타낸 것이다. 또한 상기 레벨검출기(502)에서 검출된 레벨검출신호(701)와 T지연기(503)에 의해 T시간 동안 시간 지연된 지연신호(702)는 자기 상관을 위해 곱셈기(504)에서 곱해진다. 그리고 상기 곱셈기(504)의 결과는 적분기(505)에 Tg 구간 동안 누적된다. 여기서 지연시간 T는 유효심볼 구간인 Tb이며, 적분기(505)의 누적 구간 Tg 는 CP구간에 해당하는 시간이다. 따라서 적분기(505)의 출력은 OFDM 심볼이 존재하는 구간에서 OFDM 심볼의 주기인 Ts 마다 피크값을 가지며, 이를 바탕으로 하향 링크 구간에서 도9와 같이 주기 Ts 인 펄스신호가 발생하게 된다. 이때 발생된 펄스신호(703)는 기지국과 동기되며, 주기가 OFDM심볼의 주기(Ts )인 주기신호이다. 따라서 상기 동기검출장치(401)는 레벨검출신호(701)과 펄스신호(703)를 각각 PLL 장치(402)와 링크 제어 신호 발생 장치(403)로 출력한다.6 shows the configuration of the
이어 도7은 PLL 장치(402)의 일반적인 구조를 보여주는 블럭도로서, 위상검출기(601), 저역통과필터(602), 국부발진기(603), 디바이더(604)로 구성되어 주파수를 변환시키는 기능을 한다. 따라서 동기 검출 장치(401)로부터 입력된 주기 Ts 인 동기 펄스신호(703)는 위상검출기(601)에 입력되어 PLL 장치(402)의 기준 클럭으로 사용된다. 그리고 상기 위상검출기(601)에서는 입력된 펄스신호(703)와 디바 이더(604)의 출력신호와의 위상차이를 비교하여 위상 차이 값을 저역통과필터(602)를 통하여 국부발진기(603)에 제공한다. 상기 국부발진기(603)는 위상 차이 값만큼 출력신호의 주파수를 변화시켜 출력한다. 그리고 상기 국부발진기(603)에서 출력되는 신호는 다시 PLL 루프를 형성하기 위해 디바이더(604)에 입력되어 정수배 계수로 나누어진 후 위상검출기(601)에 출력되어 PLL루프를 형성하게 된다. 상기 PLL 장치(402)는 일정한 시간이 지난 후부터는 PLL의 입력 신호, 즉 주기 Ts 인 펄스신호에 동기 되어진 클럭신호(705)를 출력시킨다. 이 출력 클럭신호(705)는 펄스신호(703)에 동기된 것으로 이것의 주파수는 입력 펄스신호(703)의 정수배이다. Wibro인 경우의 정수 배는 '한 OFDM 심볼의 FFT 수 X 오버 샘플링 비율 = 1152 X 오버 샘플링 비율'이 된다.7 is a block diagram showing a general structure of the
다시 도5를 참조하면, 상기 링크 제어 신호 발생 장치(403)에서는 동기 검출 장치(401)의 레벨검출신호(701) 및 펄스신호(703)와 PLL 장치(402)의 출력 클럭(705)을 이용하여 상·하향 신호를 중계하는데 필요한 링크 제어 신호(707)를 생성 출력한다. 이때 상기 링크 제어 신호(707)를 생성하기 위해서는 OFDM 한 심볼의 주기와 시간 정보 뿐만 아니라 하향링크 신호의 프레임 시작과 종료 위치를 알아야 한다. 이와 같은 프레임의 시작 위치를 검출하기 위해서, 상기 링크 제어 신호 방생 장치(403)는 도10에서 보는 바와 같이, 상기 동기검출장치(401)의 출력신호인 레벨검출신호(701)를 통해서 하향링크의 대략적인 시작 위치tstart(904)를 선택하고, 상기 동기검출장치(401)의 출력신호인 동기 펄스신호(703)의 피크점들 중에서 피크 점이 하향링크의 시작위치tstart (904) 보다 앞서고 하향링크의 시작위치tstart(904)와 가장 근사한 위치의 피크점 위치를 하향링크 신호의 시작점 tdown_start(903)으로 결정한다. Referring back to FIG. 5, the link
이어 하향링크의 종료 위치를 검출하기 위해서는 상기 동기검출장치(401)의 출력신호인 레벨검출신호(701)를 통하여 하향링크의 대략적인 종료 위치tstop(906)를 선택하고, 상기 동기검출장치(401)의 출력신호인 동기 펄스신호(703)의 피크점들 중에서 피크점이 하향링크의 종료 위치 tstop(906)보다 뒤에 있으면서 하향링크 종료 위치에 가장 가까운 위치의 피크점 위치를 하향링크 신호의 종료 위치 tdown_stop(908)로 결정한다. 이렇게 검출한 프레임 위치 정보와 OFDM 심볼 위치 정보를 조합하여 링크제어신호를 생성 출력한다.In order to detect an end position of the downlink, the stop
따라서 상기 링크제어신호(707)에 따라서 기지국측 스위치와 서비스측 스위치를 제어하면 하향링크 신호와 상향링크 신호에 정확히 동기되는 스위칭을 제공할 수 있다.Accordingly, when the base station switch and the service switch are controlled according to the
한편 상기한 실시예의 설명은 본 발명의 이해를 돕기 위해 제시된 것으로서 본 발명을 한정하는 의미로 해석되어서는 아니될 것이다. 또한 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자는 본 발명의 기술적 사상을 벗어나지 않는 범위 내에서 다양한 실시예를 만드는 것이 가능할 것이다. On the other hand, the description of the above embodiments are presented to aid the understanding of the present invention and should not be construed as limiting the present invention. In addition, it will be possible for those skilled in the art to make various embodiments without departing from the technical spirit of the present invention.
이상에서 설명한 바와 같이 본 발명에 따르면, OFDM 심볼의 상관 검출을 이용하여 신호의 정확한 심볼 위치를 검출할 수 있고, 검출된 신호를 이용하여 클럭을 생성함으로써 중계 장치와 기지국을 동기화 하여 동기화가 되지 않아 발생하는 타이밍 오차로 인한 여러 가지 문제들을 제거할 수 있다.
As described above, according to the present invention, it is possible to detect the exact symbol position of a signal by using correlation detection of OFDM symbols, and to generate a clock by using the detected signal to synchronize the relay and the base station so that it is not synchronized. Various problems due to timing errors that occur can be eliminated.
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